JPH043676A - データ信号復調装置 - Google Patents
データ信号復調装置Info
- Publication number
- JPH043676A JPH043676A JP2105603A JP10560390A JPH043676A JP H043676 A JPH043676 A JP H043676A JP 2105603 A JP2105603 A JP 2105603A JP 10560390 A JP10560390 A JP 10560390A JP H043676 A JPH043676 A JP H043676A
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- signal
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- dpsk
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野１
本発明はビデオフロッピー再生装置に用いて好適なデー
タ信号復調装置に関する。
タ信号復調装置に関する。
［従来の技術］
第４図は、特願平１−７６３２４号として本出願人が先
に提案した従来のデータ信号復調装置の一例の構成を示
すブロック図である。
に提案した従来のデータ信号復調装置の一例の構成を示
すブロック図である。
モータ１により回転されるテ゛イスク２がヘッド３によ
り再生きれる。ヘッド３より出力された再生信号はプリ
アンプ４により増幅され、バイパスフィルタ（ＨＰＦ）
５、ローパスフィルタ（Ｌ Ｐ Ｆ ）８、同調アンプ
１０に、それぞれ入力される。
り再生きれる。ヘッド３より出力された再生信号はプリ
アンプ４により増幅され、バイパスフィルタ（ＨＰＦ）
５、ローパスフィルタ（Ｌ Ｐ Ｆ ）８、同調アンプ
１０に、それぞれ入力される。
バイパスフィルタ５は入力信号からＦＭ輝度信号成分を
分離する。バイパスフィルタ５により分＋＊きれたＦＭ
輝度信号は信号処理回路６に入力され、復調、処理され
た後、エンコーダ７に出力される。同様に、ローパスフ
ィルタ８により分離されたＦＭ色信号が信号処理回路９
に入力され、復調、処理され、エンコーダ７に出力され
る。エンコーダ７は輝度信号と色信号を加算して、複合
映像信号として図示せぬ回路に出力する。
分離する。バイパスフィルタ５により分＋＊きれたＦＭ
輝度信号は信号処理回路６に入力され、復調、処理され
た後、エンコーダ７に出力される。同様に、ローパスフ
ィルタ８により分離されたＦＭ色信号が信号処理回路９
に入力され、復調、処理され、エンコーダ７に出力され
る。エンコーダ７は輝度信号と色信号を加算して、複合
映像信号として図示せぬ回路に出力する。
一方、同調・アンプ１０は、入力信号のうち、ＤＰＳＫ
信号周波数成分に同調し、これを分離し、増幅する。同
調アンプ１０の出力（第５図Ｂ）はエンベロープ検波回
路１１に入力され、そのエンベロープが検波される。Ｄ
ＰＳＫ信号は、例えばデータが４Ｈごとに変化している
ような場合には、水平同期信号（第５図Ａ）と比較して
明かなように、４Ｈ毎にその位相が変化するので、その
エンベロープも、４Ｈ毎に変化する。この変化点が変化
点検出回路１２により検出される。変化点検出回路１２
の検出出力（第５図Ｃ）は復調データ生成回路１３に入
力される。復調データ生成回路１３は、例えばフリップ
フロップからなり、変化点検出回路１２の出力によりト
リガされる。その結果、変化点が発生する毎に位相が反
転するＤＰＳＫ復調データ（第５図Ｄ）が復調データ生
成回路１３により生成される。
信号周波数成分に同調し、これを分離し、増幅する。同
調アンプ１０の出力（第５図Ｂ）はエンベロープ検波回
路１１に入力され、そのエンベロープが検波される。Ｄ
ＰＳＫ信号は、例えばデータが４Ｈごとに変化している
ような場合には、水平同期信号（第５図Ａ）と比較して
明かなように、４Ｈ毎にその位相が変化するので、その
エンベロープも、４Ｈ毎に変化する。この変化点が変化
点検出回路１２により検出される。変化点検出回路１２
の検出出力（第５図Ｃ）は復調データ生成回路１３に入
力される。復調データ生成回路１３は、例えばフリップ
フロップからなり、変化点検出回路１２の出力によりト
リガされる。その結果、変化点が発生する毎に位相が反
転するＤＰＳＫ復調データ（第５図Ｄ）が復調データ生
成回路１３により生成される。
信号処理回路６の出力は、同期分離回路１４に入力され
、同期分離回路１４は垂直同期信号を分離する。モノマ
ルチバイブレーク１５はこの垂直同期信号によりトリガ
され、リセットパルスを発生する。復調データ生成回路
１３を構成するフリップフロップはこのリセットパルス
によりリセットされる。
、同期分離回路１４は垂直同期信号を分離する。モノマ
ルチバイブレーク１５はこの垂直同期信号によりトリガ
され、リセットパルスを発生する。復調データ生成回路
１３を構成するフリップフロップはこのリセットパルス
によりリセットされる。
［発明が解決しようとする課題１
従来の装置はこのように、Ｄ Ｐ Ｓ Ｋ （８号のエ
ンベロープの変化点を検出し、変化点に対応してフリッ
プフロップをトリガして、ＤＰＳＫ復調データを生成す
るようにしていた。その結果、ＤＰＳＫ信号（第５図Ｅ
）にドロップアウトがあると、このドロップアウトに対
応する変化点が検出され（第５図Ｆ）、誤った復調が行
なわれる問題点があった（第５図Ｇ）。
ンベロープの変化点を検出し、変化点に対応してフリッ
プフロップをトリガして、ＤＰＳＫ復調データを生成す
るようにしていた。その結果、ＤＰＳＫ信号（第５図Ｅ
）にドロップアウトがあると、このドロップアウトに対
応する変化点が検出され（第５図Ｆ）、誤った復調が行
なわれる問題点があった（第５図Ｇ）。
本発明はこのような状況に鑑みてなされたもので、ドロ
ップアウトに影響されずに、ＤＰＳＫ信号を正しく復調
することができるようにするものである。
ップアウトに影響されずに、ＤＰＳＫ信号を正しく復調
することができるようにするものである。
［課題を解決するための手段］
本発明のデータ信号復調装置は、入力信号からＤＰＳＫ
信号を分離するＤＰＳＫ分離回路と、ＤＰＳＫ分離回路
の出力のエンベロープを検波するエンベロープ検波回路
と、エンベロープ検波回路の出力の変化点を検出する変
化点検出回路と、変化点検出回路の出力に対応してＤＰ
ＳＫ（８号の復調データを生成する復調データ生成回路
と、ＤＰＳＫ信号のドロップアウトを検出するドロップ
アウト検出回路と、ドロップアウト検出回路の出力に対
応して、変化点検出回路の出力の復調データ生成回路へ
の供給をゲートするゲート回路とを備えることを特（数
とする。
信号を分離するＤＰＳＫ分離回路と、ＤＰＳＫ分離回路
の出力のエンベロープを検波するエンベロープ検波回路
と、エンベロープ検波回路の出力の変化点を検出する変
化点検出回路と、変化点検出回路の出力に対応してＤＰ
ＳＫ（８号の復調データを生成する復調データ生成回路
と、ＤＰＳＫ信号のドロップアウトを検出するドロップ
アウト検出回路と、ドロップアウト検出回路の出力に対
応して、変化点検出回路の出力の復調データ生成回路へ
の供給をゲートするゲート回路とを備えることを特（数
とする。
［作用］
上記構成のデータ信号復調装置においては、ＤＰＳＫ信
号のドロップアウトにより発生した変化点の復調データ
生成回路への供給がゲート回路により禁止きれる。
号のドロップアウトにより発生した変化点の復調データ
生成回路への供給がゲート回路により禁止きれる。
従って、ドロップアウトに影響きれずにＤＰＳＫ信号を
復調することができる。
復調することができる。
［実施例］
第１図は本発明の一データ信号復調装置の一実施例の構
成を示すブロック図であり、第４図における場合と対応
する部分には同一の符号を付してあり・ 繰り返しにな
るので、その説明は適宜省略する。
成を示すブロック図であり、第４図における場合と対応
する部分には同一の符号を付してあり・ 繰り返しにな
るので、その説明は適宜省略する。
本実施例においては、信号処理回路６が分離、出力する
映像信号（輝度信号）から、同期分離回路１４により分
離された垂直同期信号か、モノマルチバイブレータ１５
をトリガするとともに、マイクロコンピュータ等よりな
る制御回路２５にも供給されている。また、同期分離回
路１４により分離された水平同期信号が抵抗２１とコン
デンサ２２により積分され、２つのシュミット回路２３
゜２４により波形整形された後、制御回路２５に供給さ
れている。
映像信号（輝度信号）から、同期分離回路１４により分
離された垂直同期信号か、モノマルチバイブレータ１５
をトリガするとともに、マイクロコンピュータ等よりな
る制御回路２５にも供給されている。また、同期分離回
路１４により分離された水平同期信号が抵抗２１とコン
デンサ２２により積分され、２つのシュミット回路２３
゜２４により波形整形された後、制御回路２５に供給さ
れている。
また、プリアンプ４の出力がドロップアウト検出回路２
６に入力され、ドロップアウトが検出され、その検出出
力に対応してモノマルチバイブレータ２７がトリガされ
、ゲートパルスを発生するようになっている。このゲー
トパルスはノアゲート３２（ゲート回路）に印加されて
いる。変化点検出回路１２の出力は、抵抗２９、コンデ
ンサ３０゜およびシュミット回路３１よりなる遅延回路
により遅延された後、ノアゲート３２に入力されている
。ノアゲート３２の出力が復調データ生成回路１３に供
給されている。復調データ生成回路１３の出力は制御回
路２５に供給されている。
６に入力され、ドロップアウトが検出され、その検出出
力に対応してモノマルチバイブレータ２７がトリガされ
、ゲートパルスを発生するようになっている。このゲー
トパルスはノアゲート３２（ゲート回路）に印加されて
いる。変化点検出回路１２の出力は、抵抗２９、コンデ
ンサ３０゜およびシュミット回路３１よりなる遅延回路
により遅延された後、ノアゲート３２に入力されている
。ノアゲート３２の出力が復調データ生成回路１３に供
給されている。復調データ生成回路１３の出力は制御回
路２５に供給されている。
その他の構成は第４図における場合と同様である。
次に、第２図のタイミングチャートを参照してその動作
を説明する。
を説明する。
上述したように、変化点検出回路１２は同調アンプ１０
の出力（第２図Ｂ）に実際に位相の変化が発生したとき
、ならびにドロップアウトが発生したとき、変化点検出
出力（第２図Ｃ）を発生する。
の出力（第２図Ｂ）に実際に位相の変化が発生したとき
、ならびにドロップアウトが発生したとき、変化点検出
出力（第２図Ｃ）を発生する。
この変化点検出出力は、抵抗２９、コンデンサ３０、シ
ュミット回路３１よりなる遅延回路により遅延された後
、ノアゲート３２に入力される（第２図Ｄ）。
ュミット回路３１よりなる遅延回路により遅延された後
、ノアゲート３２に入力される（第２図Ｄ）。
ドロップアウト検出回路２６は、プリアンプ４より入力
されるＤＰＳＫ信号のドロップアウトを検出する。ドロ
ップアウト検出回路２６のドロップアウト検出信号（第
２図Ｅ）に同期して、モノマルチバイブレータ２７がト
リガされ、ノアゲート３２にゲートパルス（第２図Ｆ）
を発生する。
されるＤＰＳＫ信号のドロップアウトを検出する。ドロ
ップアウト検出回路２６のドロップアウト検出信号（第
２図Ｅ）に同期して、モノマルチバイブレータ２７がト
リガされ、ノアゲート３２にゲートパルス（第２図Ｆ）
を発生する。
一方、変化点検出回路１２の出力（第２図Ｃ）が、抵抗
２９、コンデンサ３０． およびシュミット回路３１
により遅延された後、ノアゲート３２に入力される（第
２図Ｄ）。
２９、コンデンサ３０． およびシュミット回路３１
により遅延された後、ノアゲート３２に入力される（第
２図Ｄ）。
その結果、ノアゲート３２は、ドロップアウトによって
生じたトリガパルスを通過ぎせない（第２図Ｇ）。復調
データ生成回路１３はノアゲート３２によりゲートされ
た検出信号に対応してＤＰＳＫ復調データ（第２図Ｈ）
を生成し、制御回路２５に出力する。
生じたトリガパルスを通過ぎせない（第２図Ｇ）。復調
データ生成回路１３はノアゲート３２によりゲートされ
た検出信号に対応してＤＰＳＫ復調データ（第２図Ｈ）
を生成し、制御回路２５に出力する。
上述したように、制御回路２５に入力されるＤＰＳＫ復
調信号は抵抗２９、コンデンサ３ｏ、シュミット回路３
１よりなる遅延回路により遅延されている。そこで、こ
の復調データを読み取るタイミングも遅延きせるため、
同期分離回路１４が出力する水平同期信号は、抵抗２１
、コンデンサ２２、シュミット回路２３よりなる遅延回
路により遅延された後、制御回路２５に入力される（第
２図Ｉ）。なお、シュミット回路２４は極性調整のため
のものである。
調信号は抵抗２９、コンデンサ３ｏ、シュミット回路３
１よりなる遅延回路により遅延されている。そこで、こ
の復調データを読み取るタイミングも遅延きせるため、
同期分離回路１４が出力する水平同期信号は、抵抗２１
、コンデンサ２２、シュミット回路２３よりなる遅延回
路により遅延された後、制御回路２５に入力される（第
２図Ｉ）。なお、シュミット回路２４は極性調整のため
のものである。
次に、第３図を参照して、ＤＰＳＫ復調データの再生動
作についてさらに説明する。
作についてさらに説明する。
ＤＰＳＫ信号の第１フイールドの第２８８乃至第３２Ｈ
の４Ｈはイニシャルビットとされ、続く第３２８乃至４
０８には、フィールドまたはフレームの識別信号が配置
され、第４０８乃至第６８Ｈには、トラックナンバーが
配置されている（第３図Ａ、Ｂ）。例えば第３図の例で
はＤＰＳＫ信号（第３図Ｂ）の第３２Ｈ１第４４Ｈ１第
４８Ｈ１第５６Ｈ，には変化点が存在し、この変化点が
検出されて（第３図Ｃ）、波形整形される（第３図Ｄ）
。この変化点により論理ＨまたはＬに反転する信号（第
３図Ｅ、Ｆ）が生成される。制御回路２５は、連続する
２つの論理の排他的論理和を演算して、ＤＰＳＫ信号を
読み取る。
の４Ｈはイニシャルビットとされ、続く第３２８乃至４
０８には、フィールドまたはフレームの識別信号が配置
され、第４０８乃至第６８Ｈには、トラックナンバーが
配置されている（第３図Ａ、Ｂ）。例えば第３図の例で
はＤＰＳＫ信号（第３図Ｂ）の第３２Ｈ１第４４Ｈ１第
４８Ｈ１第５６Ｈ，には変化点が存在し、この変化点が
検出されて（第３図Ｃ）、波形整形される（第３図Ｄ）
。この変化点により論理ＨまたはＬに反転する信号（第
３図Ｅ、Ｆ）が生成される。制御回路２５は、連続する
２つの論理の排他的論理和を演算して、ＤＰＳＫ信号を
読み取る。
［発明の効果コ
以上のように、本発明のデータ信号復調装置によれば、
ＤＰＳＫ信号のエンベロープの変化点検出信号の復調デ
ータ生成回路への供給を、ドロップアウト発生時に禁止
するようにしたので、ドロップアウトに影響されずに、
ＤＰＳＫ信号を復調することが可能になる。
ＤＰＳＫ信号のエンベロープの変化点検出信号の復調デ
ータ生成回路への供給を、ドロップアウト発生時に禁止
するようにしたので、ドロップアウトに影響されずに、
ＤＰＳＫ信号を復調することが可能になる。
第１図は本発明のデータ信号復調装置の一実施例の構成
を示すブロック図、第２図および第３図は第１図の実施
例の動作を説明するタイミングチャート、第４図は従来
のデータ信号復調装置の一例の構成を示すブロック図、
第５図は第４図の例の動作を説明するタイミングチャー
トである。 ６．９・・・信号処理回路、１０・・・同調アンプ、１
１・・・エンベロープ検波回路、１２・・・変化点検出
回路、１３・・・復調データ生成回路、１４・・・同期
分離回路、２５・・・制御回路、２６・・・ドロップア
ウト検出回路、３２・・・ノアゲート（ゲート回路）。 特許出願人 旭光学工業株式会社
を示すブロック図、第２図および第３図は第１図の実施
例の動作を説明するタイミングチャート、第４図は従来
のデータ信号復調装置の一例の構成を示すブロック図、
第５図は第４図の例の動作を説明するタイミングチャー
トである。 ６．９・・・信号処理回路、１０・・・同調アンプ、１
１・・・エンベロープ検波回路、１２・・・変化点検出
回路、１３・・・復調データ生成回路、１４・・・同期
分離回路、２５・・・制御回路、２６・・・ドロップア
ウト検出回路、３２・・・ノアゲート（ゲート回路）。 特許出願人 旭光学工業株式会社
Claims (1)
- 【特許請求の範囲】 入力信号からＤＰＳＫ信号を分離するＤＰＳＫ分離回路
と、 前記ＤＰＳＫ分離回路の出力のエンベロープを検波する
エンベロープ検波回路と、 前記エンベロープ検波回路の出力の変化点を検出する変
化点検出回路と、 前記変化点検出回路の出力に対応してＤＰＳＫ信号の復
調データを生成する復調データ生成回路と、 前記ＤＰＳＫ信号のドロップアウトを検出するドロップ
アウト検出回路と、 前記ドロップアウト検出回路の出力に対応して、前記変
化点検出回路の出力の前記復調データ生成回路への供給
をゲートするゲート回路とを備えることを特徴とするＤ
ＰＳＫ信号復調装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2105603A JP3026580B2 (ja) | 1990-04-20 | 1990-04-20 | データ信号復調装置 |
| US07/685,673 US5287197A (en) | 1990-04-20 | 1991-04-16 | Signal demodulation device |
| DE4112876A DE4112876A1 (de) | 1990-04-20 | 1991-04-19 | Einrichtung zum demodulieren von signalen |
| GB9108585A GB2243272B (en) | 1990-04-20 | 1991-04-22 | Signal demodulation device |
| FR9104914A FR2661302B1 (fr) | 1990-04-20 | 1991-04-22 | Dispositif de demodulation de signal. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2105603A JP3026580B2 (ja) | 1990-04-20 | 1990-04-20 | データ信号復調装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH043676A true JPH043676A (ja) | 1992-01-08 |
| JP3026580B2 JP3026580B2 (ja) | 2000-03-27 |
Family
ID=14412080
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2105603A Expired - Fee Related JP3026580B2 (ja) | 1990-04-20 | 1990-04-20 | データ信号復調装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3026580B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6107003A (en) * | 1998-01-14 | 2000-08-22 | Mitsui Mining & Smelting Co., Ltd. | Method for producing multi-layer printed wiring boards having blind vias |
| US6240636B1 (en) | 1998-04-01 | 2001-06-05 | Mitsui Mining & Smelting Co., Ltd. | Method for producing vias in the manufacture of printed circuit boards |
| US6326559B1 (en) | 1998-06-30 | 2001-12-04 | Matsushita Electric Works, Ltd. | Multilayer printed wiring board and method for manufacturing same |
| US6884944B1 (en) | 1998-01-14 | 2005-04-26 | Mitsui Mining & Smelting Co., Ltd. | Multi-layer printed wiring boards having blind vias |
| US7415761B2 (en) | 1998-09-03 | 2008-08-26 | Ibiden Co., Ltd. | Method of manufacturing multilayered circuit board |
-
1990
- 1990-04-20 JP JP2105603A patent/JP3026580B2/ja not_active Expired - Fee Related
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6107003A (en) * | 1998-01-14 | 2000-08-22 | Mitsui Mining & Smelting Co., Ltd. | Method for producing multi-layer printed wiring boards having blind vias |
| US6884944B1 (en) | 1998-01-14 | 2005-04-26 | Mitsui Mining & Smelting Co., Ltd. | Multi-layer printed wiring boards having blind vias |
| US6240636B1 (en) | 1998-04-01 | 2001-06-05 | Mitsui Mining & Smelting Co., Ltd. | Method for producing vias in the manufacture of printed circuit boards |
| US6326559B1 (en) | 1998-06-30 | 2001-12-04 | Matsushita Electric Works, Ltd. | Multilayer printed wiring board and method for manufacturing same |
| US6671949B2 (en) | 1998-06-30 | 2004-01-06 | Matsushita Electric Works, Ltd. | Multilayer printed wiring board and method for manufacturing same |
| US7415761B2 (en) | 1998-09-03 | 2008-08-26 | Ibiden Co., Ltd. | Method of manufacturing multilayered circuit board |
| US7832098B2 (en) | 1998-09-03 | 2010-11-16 | Ibiden Co., Ltd. | Method of manufacturing a multilayered printed circuit board |
| US8148643B2 (en) | 1998-09-03 | 2012-04-03 | Ibiden Co., Ltd. | Multilayered printed circuit board and manufacturing method thereof |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3026580B2 (ja) | 2000-03-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |