JPH0437636B2 - - Google Patents

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JPH0437636B2
JPH0437636B2 JP62294286A JP29428687A JPH0437636B2 JP H0437636 B2 JPH0437636 B2 JP H0437636B2 JP 62294286 A JP62294286 A JP 62294286A JP 29428687 A JP29428687 A JP 29428687A JP H0437636 B2 JPH0437636 B2 JP H0437636B2
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Japan
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signal
circuit
control signal
image
line
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JP62294286A
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Andoryuu Waago Robaato
Arubaato Haautsudo Reohorudo
Harorudo Purichaado Doruton
Suchiibun Chaateia Maikeru
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RCA Licensing Corp
Original Assignee
RCA Licensing Corp
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Publication date
Application filed by RCA Licensing Corp filed Critical RCA Licensing Corp
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Publication of JPH0437636B2 publication Critical patent/JPH0437636B2/ja
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/14—Picture signal circuitry for video frequency region
    • H04N5/144—Movement detection
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N7/00—Television systems
    • H04N7/01—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level
    • H04N7/0117—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level involving conversion of the spatial resolution of the incoming video signal
    • H04N7/012—Conversion between an interlaced and a progressive signal
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N9/00—Details of colour television systems
    • H04N9/77—Circuits for processing the brightness signal and the chrominance signal relative to each other, e.g. adjusting the phase of the brightness signal relative to the colour signal, correcting differential gain or differential phase
    • H04N9/78—Circuits for processing the brightness signal and the chrominance signal relative to each other, e.g. adjusting the phase of the brightness signal relative to the colour signal, correcting differential gain or differential phase for separating the brightness signal or the chrominance signal from the colour television signal, e.g. using comb filter

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  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Computer Graphics (AREA)
  • Television Systems (AREA)
  • Processing Of Color Television Signals (AREA)
  • Color Television Systems (AREA)
  • Picture Signal Circuits (AREA)

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、テレビジヨン信号中の動きに起因す
る画像変化に応答してテレビジヨン信号を適応的
に処理するテレビジヨン信号処理システムに関す
る。
発明の背景 複合ビデオ信号からルミナンス成分とクロミナ
ンス成分を分離することは、テレビジヨン信号の
処理において必要な一段階である。画像の動きが
生じなければ、フレームくし型フイルタは、十分
にこの分離を実行することができる。画像の動き
が在る場合は、ラインくし型フイルタがフレーム
くし型フイルタより好ましく、その理由は、ライ
ンくし型フイルタは動きにより生じるアーテイフ
アクトを減少させるからである。しかしながら、
画像の垂直解像度の低下が起こる。また、ハンギ
ングドツトが垂直画像カラー遷移および対角線の
ルミナンス遷移の部分に現われる。
テレビジヨン信号から再生される画像は、伝送
されたインターレース方式のライン間に補間ライ
ンを含んでいる倍走査のノンインターレース方式
の表示を形成することにより強調される。満足で
きる補間ラインは、補間ラインの位置に対応する
位置からのラインであるが、画像の動きが生じな
ければ、前フイールドからのラインである。画像
の動きがある場合、補間ラインのフイールドと同
じフイールド内のラインから補間される補間ライ
ンが好ましいが、画像の垂直解像が低下し、ライ
ン・フリツカが生じる。
最適の性能を提供しようとする際、前記のよう
なシステムは、処理済みの信号を別々に同時に発
生する。例えば、ラインくし型濾波されフレーム
くし型濾波されたルミナンス成分とクロミナンス
成分の両方、あるいはフイールド遅延された信号
とライン補間された補間信号の両方が発生され
る。２つの二者択一の信号の中の一方もしくは他
方、あるいはそれらの混合信号が、画像の動きの
推定値に基づいて、さらに処理するためにシステ
ムの残りの部分に供給される。
問題点は、別個に処理された信号の適当な割合
を画像の動きの関数として決定する際に生じる。
ルミナンス／クロミナンスの分離の場合、フレー
ムくし型濾波されたルミナンス信号が、分離され
たルミナンス信号を発生する混合信号中に大きす
ぎる割合で含まれていると、動きに因るアーテイ
フアクトが再生画像中に見えるようになる。ライ
ンくし型濾波されたルミナンス信号が大きすぎる
割合でその混合物中に含まれていると、画像変化
の領域における垂直解像度が低下し、ハンギング
ドツトが目に見える。
倍走査のノンインターレース方式の変換器の場
合、フイールド遅延された信号が大きすぎる割合
で補間ラインを発生する混合成分中に含まれてい
ると、動きに因るアーテイフアクト（ぎざぎさの
付いたエツジのような）が動き領域に見える。一
方、ライン補間された信号が大きすぎる割合で混
合成分中に含まれていると、動き領域の垂直解像
度が低下し、ライン・フリツカが目につく。画像
の解像度を余り低下させないで、あるいは動きに
因るアーテイフアクトの可視性を増大させること
なく信号の混合を行なえるような方法でビデオ信
号の処理の動きの関数として適応的に制御するこ
とが望ましい。
発明の概要 本発明の原理に従つて、伝送された画像におけ
る差は画像の走査時間期間にわたつて推定され
る。推定された画像差の非線形の関数である制御
信号が発生される。この制御信号は、この制御信
号に応答してテレビジヨン信号の適応的処理を制
御するために使われる。
本発明の１つの特徴によると、制御信号Ｋと画
像差信号ｘを関係づける非線形関数は次式で与え
られ、実質的に指数関数である。
Ｋ＝Ae-b/x (1) ここで、Ａとｂは定数である。
本発明のもう１つの特徴によると、伝送された
画像のパラメータの推定値が得られ、推定された
パラメータの値に応答して非線形の伝達関数が変
更される。
本発明の更にもう１つの特徴によると、第１の
処理済み信号は画像の第１走査内のラインを表わ
す複数の信号に応答し、第２の処理済み信号は別
の走査におけるラインを表わす信号に応答する。
これらの２つの信号は、比較的小さな画像変化に
対しては最小値を有し、比較的大きな画像変化に
対しては最大値に漸近的に近くなり、中間の値に
ついては単調に減少する傾きを示す制御信号に基
づいた割合で合成される。
実施例 第１図は、ルミナンス／クロミナンスの分離回
路を示す。第１図において、入力端子５はルミナ
ンス成分とクロミナンス成分とを含む複合ビデオ
信号（CV）源（図示せず）に結合される。入力
端子５は、フレームくし型フイルタ１０、ライン
くし型フイルタ２０および動き検出回路３０の各
入力端子に結合される。フレームくし型フイルタ
１０は、その各出力端子にフレームくし型濾波さ
れたルミナンス成分Yfおよびフレームくし型濾
波されたクロミナンス成分Cfを発生する。フレー
ムくし型濾波済みルミナンス成分Yfを発生する
出力端子は信号合成回路４０の第１の入力端子に
結合される。
ラインくし型フイルタ２０は、その各出力端子
にラインくし型濾波済みルミナンス成分YLおよ
びラインくし型濾波済みクロミナンス成分CLを
発生する。ラインくし型濾波済みルミナンス成分
YLを発生する出力端子は信号合成回路４０の第
２の入力端子に結合される。信号合成回路４０の
出力端子は出力端子１５に結合され、分離された
ルミナンス成分Ｙを発生する。動き検出回路３０
の出力端子は、制御信号発生回路５０の入力端子
に結合される。制御信号発生回路５０の出力端子
は、信号合成回路４０の制御入力端子に結合され
る制御信号Ｋを発生する。
動作において、フレームくし型フイルタ１０お
よびラインくし型フイルタ２０は、ルミナンス成
分を含んでいる各信号を公知の方法で発生する。
動き検出回路３０は、画像走査の時間期間、例え
ば、１フレーム時間期間の間ピクセル毎のベース
で画像の差を発生する。画像の差の大きさは信号
Ｍとして与えられる。制御信号発生回路５０は、
動きの信号Ｍの非線形関数である制御信号Ｋを発
生する。信号合成回路４０は、フレームくし型濾
波済みルミナンス信号およびラインくし型濾波済
みルミナンス信号を相補的な割合で合成し、制御
信号Ｋにより制御される出力ルミナンス信号Ｙを
発生する。
動きの信号Ｍが、画像の差が前の画像時間期間
にわたつて発生しなかつたことを示すと、信号合
成回路４０は、出力ルミナンス信号Ｙとしてフレ
ームくし型濾波済みルミナンス信号Yfだけを実
質的に供給するように条件づけられる。動きの信
号Ｍが、フレーム間の画像の差が多量に発生した
ことを示すと、信号合成回路４０は、ルミナンス
出力信号Ｙとしてラインくし型濾波済みルミナン
ス成分YLだけを実質的に供給するように条件づ
けられる。画像の差の中間の値については、フレ
ームくし型濾波済みルミナンス成分とラインくし
型濾波済みルミナンス成分の割合は、制御信号Ｋ
に従つて信号合成回路４０において変えられる。
第２図は、倍走査のノンインターレース方式の
変換器を示す。第２図において、入力端子７は、
ビデオ信号の一成分、例えば、ルミナンス成分Ｙ
の成分源（図示せず）に結合される。入力端子
は、等化遅延要素８０、ライン補間回路６０、フ
イールド遅延要素７０および動き検出回路３０の
各入力端子に結合される。等化遅延要素８０の出
力端子は、信号Ｒを発生し、時間圧縮回路８３の
入力端子に結合される。時間圧縮回路８３の出力
端子は、スイツチ９０の第１の端子に結合され
る。スイツチ９０の出力端子は出力端子２５に結
合される。出力端子２５は、伝送された画像を表
わす倍走査ノンインターレース方式の信号を発生
する表示装置（図示せず）に結合される。
ライン補間回路６０の出力端子は、信号合成回
路４０′の第１の入力端子に結合される信号ILを
発生する。フイールド遅延要素７０の出力端子
は、信号合成回路４０′の第２の入力端子に結合
される信号Ifを発生する。信号合成回路４０′の
出力端子は、第２の時間圧縮回路８７の入力端子
に結合される信号Ｉを発生する。
動き検出回路３０の出力端子は、制御信号発生
回路５０′の入力端子に結合される信号Ｍを発生
する。制御信号発生回路５０′の出力端子は、信
号合成回路４０′の制御入力端子に結合される制
御信号Ｋを発生する。
動作において、ライン補間回路６０およびフイ
ールド遅延要素７０は、２つの受信ライン間に表
示される補間ラインＩについて別個に処理された
推定値を発生する。ライン補間回路６０はライン
補間された補間ラインILを発生し、フイールド遅
延要素７０は知られている方法でフイールド遅延
された補間信号Ifを発生する。信号合成回路４
０′は相補的な割合で補間信号ILおよびIfを合成
し、補間信号Ｉを発生する。
信号Ｍは、前の画像期間にわたつて成分信号Ｙ
の画像の差の大きさを示す。制御信号Ｋは動きの
信号Ｍの非線形の関数であり、補間ラインＩにお
けるライン補間された補間信号とフイールド遅延
された補間信号の割合をそれぞれ制御する。動き
の信号Ｍが、前の画像時間期間にわたつて画像の
差が何も生じなかつたことを示すと、補間信号Ｉ
は実質上フイールド遅延された補間信号Ifだけで
ある。画像の差が多量に発生すると、補間信号Ｉ
は実質上ライン補間された補間信号ILだけであ
る。フレーム間の差の中間の値については、ILお
よびIfの割合は、制御信号Ｋに従つて、信号合成
回路４０′において変更される。
時間圧縮回路８３は、受け取られたラインＲを
１水平ライン期間の1/2で走査するのに必要な時
間量だけ圧縮する。時間圧縮回路８７は、補間ラ
インＩに対して同様の機能を実行する。時間圧縮
回路８３と８７およびスイツチ９０の組合わせ
は、受け取られたラインＲおよび補間ラインＩを
単一の水平ライン時間期間に時間多重化する。こ
のようにして、倍走査のノンインターレース方式
のビデオ信号が発生される。
第３図は、第１図と第２図に示す回路における
動き検出回路として使われる知られた画像差の検
出回路である。第３図において、入力端子３１
は、第１図における入力端子５あるいは第２図に
おける入力端子７に結合される。入力端子３１
は、フレーム遅延要素３２および減算器３４の各
入力端子に結合される。フレーム遅延要素３２の
出力端子は減算器３４の第２の入力端子に結合さ
れる。減算器３４の出力端子は、低域通過フイル
タ３６および絶対値回路３８を介して出力端子３
９に結合される。出力端子３９は第１図の制御信
号発生回路５０あるいは第２図の制御信号発生回
路５０′に結合される。
動作において、複合ビデオ信号（CV）が端子
３１に供給されると、減算器３４は１フレーム期
間だけ離れた画像信号の差を発生する。低域通過
フイルタ３６は通常カラー情報を含んでいる周波
数帯域を減衰させ、画像差の情報だけを残す。絶
対値回路３８は、画像差の大きさを信号Ｍとして
出力端子３９に発生する。前記の動き検出回路は
１フレーム時間期間の画像期間にわたつて画像差
を計算する。フイールド時間期間のような別の画
像期間を使うこともできる。さらに、現在処理さ
れつつあるフイールド内からの情報も画像の動き
を推定するのに使用することができる。
制御信号発生回路５０および５０′で使われる
最適な非線形関数を決定するために、一連の実験
を行なつた。複合ビデオ信号のルミナンス成分と
クロミナンス成分を分離するために、第１図に示
す回路と同様な回路が使用された。次いで分離さ
れた成分は受像管上に画像を再生するために処理
された。
複合ビデオ信号は、画像が20IRE単位のレベル
において暗い灰色の背景で伝送されるように合成
された。この場合、7.5IRE単位の信号レベルは
黒色の画像を発生し、100IRE単位の信号レベル
は白色の画像を発生する。画像は予め定められる
IRE単位だけ背景と異なり、背景上を水平方向に
左右に動く四角形であつた。フレームくし型濾波
されたテレビジヨン信号の場合、四角形の左右の
エツジにおける影から成る動きに因るアーテイフ
アクトが見える。例えば、背景レベルが20IRE単
位で、四角形が22IRE単位のとき、影領域におけ
る画像変化の大きさＭは2IRE単位である。
次に、この表示が観察され、制御信号Ｋがフレ
ームくし型濾波された成分だけが表示される値か
ら、ラインくし型濾波された成分だけが表示され
る値まで手動で変えられる。影が見えなくなるＫ
の値が分つた。
例えば、画像差が2IRE単位の場合、Ｋを80／
127に調整すると、影の見える直前である。その
後このテストは、20IRE単位の背景から表に示
す異なるIRE単位だけ変化する四角形について繰
り返され、最適のＫが分つた。この一連のテスト
は、35IRE単位の背景レベルについても著しい差
のない状態で繰り返された。次に示す表は、こ
れらのテストの結果を示す。
水平に移動する濃い四角形は低周波のルミナン
スの動きについての結果を与える。この一連のテ
ストは、最初に20IRE単位の背景レベルから次に
30IRE単位の予め定められるIRE単位レベルだけ
異なる薄い垂直ラインについて繰り返された。こ
のようなパターンは高周波のルミナンス情報を有
する。次に示す表は、高周波のルミナンス情報
についての一連のテストの結果を示す。実験によ
り得られる関係のある点が第４図に示され、動き
に因り引き起こされる目に見えるアーテイフアク
トを発生させることなく最高の垂直解像度を与え
るフレーム遅延処理の最適合成を与える関数の各
点を定める。
表 Ｍ（IRE） Ｋ 2 80／127 15 116／127 35 123／127 55 127／127 表 Ｍ（IRE） Ｋ 2 92／127 5 100／127 15 120／127 35 124／127 55 127／127 これらの表に基づいて、これらの各点により表
わされる関数を近似する数式が導かれる。その関
数は次式で表わされる。
Ｋ＝Ae-0.924/M (2) ここで、ＡはＫがとる最大値を決める定数であ
り、Ｍは個別の水平および垂直位置におけるフレ
ーム時間期間にわたつてのIRE単位で表わした画
像差である。この式は実験により得られたデータ
を表わすけれども、別の数式も同様にこのデータ
を正確に表わすことができる。関数を決定するの
は実験上のデータであり、数式は関数を近似する
だけであり、実験により得られるデータ点間の各
点における適当な関数の推定が行なわれる。
第５図は、第１図に示す回路に使われる制御信
号発生回路５０のデイジタルの構成例である。第
５図において、読出し専用メモリ（以下、ROM
という。）５９は、動き検出回路３０（第１図）
から多ビツトのデイジタル信号Ｍを受け取るよう
に結合されるアドレス入力端子を有する。ROM
５９のデータ出力端子は、信号合成回路４０（第
１図）に供給される信号K′を発生する。多ビツ
トのデイジタル信号出力K′がｎビツトから成る
と、K′が取り得る最大値は2n−１である。例え
ば、ｎ＝７であれば、最大値は127であり、関数
は次の数式で近似される。
K′＝127e-0.924/M (3) 制御信号ＫはK′／128に等しく、１／128のス
テツプで０から127／128まで変化する。デイジタ
ル構成の場合、K′は128の一定減衰を伴つて用い
られ、それはハードウエアによるビツト・シフト
でよい。ROM５９は、Ｍの各値について、Ｍの
値によりアドレスされるロケーシヨンが対応する
K′の値を含むように予めプログラムされている。
従つて、値Ｍを有するデイジタル入力について、
(3)式で示されるように、値127Kを有するデイジ
タル出力K′が発生される。予めプログラムされ
ているROM５９は、実質的にはテーブル・ルツ
クアツプの関数発生器である。先に述べたよう
に、実験的に導入される各点が関数を定め、
ROM５９に予めプログラムされた値のテーブル
な、入力値についての関数の推定値を与える。別
の数式から導入される値のテーブルも関数につい
て許容可能な推定値を与える。
第６図は、信号合成回路４０または４０′の一
実施例を示す。第６図において、第１の入力端子
４１は、フレームくし型フイルタ１０（第１図）
もしくはフイールド遅延要素７０（第２図）に結
合される。入力端子４１は、乗算器４３の第１の
入力端子に結合される。乗算器４３の出力端子は
加算器４４の第１の入力端子に結合される。加算
器４４の出力端子は出力端子４９に結合される。
出力端子４９は、出力端子１５（第１図）あるい
は時間圧縮回路８７（第２図）の入力端子に結合
される。
第２の入力端子４２は、ラインくし型フイルタ
２０（第１図）もしくはライン補間回路６０（第
２図）の出力端子に結合される。入力端子４２
は、第２の乗算器４５の第１の入力端子に結合さ
れる。乗算器４５の出力端子は加算器４４の第２
の入力端子に結合される。制御入力端子４６は、
制御信号発生回路５０（第１図）もしくは制御信
号発生回路５０′（第２図）の出力端子に結合さ
れる。制御信号Ｋを伝達する制御入力端子４６
は、乗算器４５の第２の入力端子および信号Ａ−
Ｋを発生する関数発生器４７の入力端子に結合さ
れる。ここで、Ａは、(1)式および(2)式について先
に述べたように、制御信号Ｋの最大値である。関
数発生器４７の出力端子は乗算器４３の第２入力
端子に結合される。
動作において、乗算器４３および４５は各入力
信号の変化する割合を有する信号を発生する。加
算器４４は、乗算器４３および４５からの配合さ
れた信号を合成し、入力端子４６からの制御信号
Ｋにより制御されるとき、端子４１および４２か
らの入力信号の変化する割合を有する出力信号を
端子４９に発生する。例えば、制御信号Ｋが零に
等しければ、入力端子４２からの信号の零倍と入
力端子４１からの信号の（Ａ−Ｏ）倍、すなわち
Ａ倍とが加算器４４で合成される。制御信号Ｋが
Ａに等しいならば、入力端子４２からの信号のＡ
倍と入力端子４１からの信号の（Ａ−Ａ）倍、す
なわち零倍とが加算器４４で合成される。Ｋが中
間レベルにあると、端子４１および４２からの入
力信号の変化する割合が加算器４４で合成され
る。例えば、Ｋが1/4Ａに等しいと、入力端子４
２からの信号の1/4Ａ倍と入力端子４１からの信
号の（Ａ−1/4Ａ）倍、すなわち3/4Ａ倍とが加算
器44で合成される。Ａ＝１ならば、入力信号の相
補的な割合が加算器４４で合成される。
第４図に示す伝達関数を有する制御信号発生回
路５０′は、第２図に示す倍走査のノンインター
レース方式の変換器において有利に用いられる。
このような倍走査のノンインターレース方式の変
換器において、ライン・フリツカおよびライン補
間された補間信号により生じる垂直解像度の低
下、またフイールド遅延された補間信号から生じ
る、ぎざぎざのエツジのような動きに因り生じる
アーテイフアクト間で妥協が行なわれる。
別のテストにより、変化しない画像について
は、ライン補間された補間信号の比率が36／127
より大きくなつてはならず、また変化する画像に
ついては、その比率は80／127より小さくなつて
はならない。画像差は時々ノイズにより生じるか
ら、動き検出回路からの低い値の画像差信号出力
が変化していない画像中のノイズであるかもしく
は低いコントラスト画像における動きにより引き
起こされた画像差であるかどうかを決定すること
ができない。従つて、36／127あるいは80／127の
選択は、すべての場合について正確ではないかも
知れない。
第８図は、上記の問題点を或る程度軽減する制
御信号発生回路５０′（第２図）用の伝達関数を
示す。太い曲線は、Kfの最小値が36／128に等し
く設定されていることを除けば、第４図に示す伝
達関数の曲線と同じである。従つて、変化してい
ない画像は、低い値の画像差が検出された時、正
しく処理される。しかしながら、これらの画像差
が画像の動きにより引き起こされるものならば、
何らかの画質低下が経験される。画像差信号Ｍが
画像走査時間期間（表参照）にわたつて2IRE
単位の差に相当する値をとる時、曲線が80／128
のＫの値に達するから、この画質低下はより大き
な画像変化により速やかに除去される。
ノイズにより引き起こされる画像差が存在する
と、変化していない画像における大きな垂直遷移
によりフリツカが生じる。このノイズは垂直遷移
の暗い部分よりも明るい部分においてより目に見
える。この画像品質の低下を最小限にするために
は、垂直デテールの量すなわちエネルギーを検出
し、検出された垂直デテールのエネルギーのレベ
ルに基づいて伝達関数を変更することが必要であ
る。検出された垂直デテール情報のレベルが増加
するにつれて、制御信号Ｋの最小レベルKfは
36／128から０に減少する。従つて、垂直デテー
ルのエネルギーが増加するにつれて、より多くの
フイールド遅延された信号がライン補間された信
号と混合され、補間信号を形成する。
再び第２図に戻ると、ライン補間回路６０は、
制御信号発生回路５０′の第２の入力端子に結合
され垂直デテール情報信号VD（破線で示される）
を第２の出力端子に発生する。制御信号発生回路
５０′は、第８図に示す伝達関数を示し、ライン
補間回路６０から供給される垂直デテール情報信
号のレベルにより変更される。
第７図は、第２図に示す倍走査のノンインター
レース方式の変換器の破線で示す変形例に用いら
れるライン補間回路６０を示す。入力端子７は、
ライン期間の遅延要素６１の入力端子および加算
器６２と減算器６４の各第１の入力端子に結合さ
れる。ライン期間遅延要素６１の出力端子は、加
算器６２および減算器６４の各第２の入力端子に
結合される。加算器６２の出力端子は、その入力
端子における信号に1/2を掛けるスケーリング回
路６３に結合される。スケーリング回路６３の出
力端子は、信号合成回路４０′（第２図）の入力
端子に結合される信号ILを発生する。減算器６４
の出力端子は、低域通過フイルタ６５を介して絶
対値回路６６に結合される。低域通過フイルタ６
５は、入力信号の中の公称上クロミナンス情報を
含んでいるスペクトル部分を減衰させ、垂直デテ
ール情報だけを残す。絶対値回路６６は、垂直デ
テール情報の大きさを表わし、制御信号発生回路
５０′（第２図）に結合される信号VDを発生す
る。
第９図は、第２図に示す回路において破線で示
す変形例で使われる制御信号発生回路５０′を示
す。第９図において、ライン補間回路６０（第２
図）からの信号VDは、ROM５９′のアドレス入
力端子のサブセツトに供給される。動き検出回路
３０（第２図）からの信号Ｍは、ROM５９′の
アドレス入力端子の残りの部分に供給される。
ROM５９′は、制御信号Ｋを発生し、信号合成
回路４０′（第２図）に結合される。
動作において、ROM５９′は、第８図に示す
ように、複数の異なる伝達関数曲線を有する。フ
レーム間の差信号Ｍは、ROM５９′に予めプロ
グラムされている選択された伝達関数曲線に対し
てＫなる対応値を有するロケーシヨンをアドレス
する。この制御信号Ｋは信号合成回路４０′（第
２図）に供給される。どの伝達関数曲線で選択さ
れるかは、信号VDの値により決まる。第８図に
示すように、信号VDの値が増加するにつれて、
Ｋの最小値Kfは減少する。
本発明は、フレーム間の差（動き）のアーテイ
フアクトおよびフレーム内の（ライン・フリツ
カ、垂直解像度の低下）アーテイフアクト間の最
適な妥協点が得られるような方法でフレーム間の
差信号Ｍを比例定数Ｋに関連づける非線形の伝達
関数に関する。ルミナンス／クロミナンス分離お
よび倍走査のノンインターレース方式変換に関し
て例示的な実施例を示したけれども、フレーム間
の差信号が目に見える適応型処理に影響を及ぼす
ような他の応用例においても本発明の原理を有利
に使うことができる。
【図面の簡単な説明】
第１図は、本発明による制御信号発生回路を組
み込んだルミナンス／クロミナンス分離回路のブ
ロツク図である。第２図は、本発明による制御信
号発生回路を含む倍走査のノンインターレース方
式の変換器のブロツク図である。第３図は、第１
図もしくは第２図に示す回路で使われる既知の動
き検出回路のブロツク図である。第４図は、第１
図もしくは第２図に示す制御信号発生回路の伝達
関数を示す。第５図は、第４図に示す伝達関数を
有し、第１図もしくは第２図に示す回路において
使われる制御信号発生回路のデイジタル構成のブ
ロツク図である。第６図は、第１図および第２図
に示す回路で使われる信号合成回路のブロツク図
である。第７図は、第２図に示す回路で使われる
ライン補間回路のブロツク図である。第８図は、
第２図に示す回路で使われる制御信号発生回路の
伝達関数を示す。第９図は、第９図に示す伝達関
数を有し、第２図に示す回路において使われる制
御信号発生回路のデイジタル構成例である。 ５……入力端子、３０……動き検出回路、４０
……信号合成回路、５０……制御信号発生回路。

Claims (1)

  1. 【特許請求の範囲】 １ 処理しようとするビデオ入力信号を供給する
    信号源と、 前記信号源に結合され、ライン処理されたビデ
    オ出力信号を発生するライン処理回路と、 前記信号源に結合され、フイールド処理された
    ビデオ出力信号を発生するフイールド処理回路
    と、 前記ビデオ入力信号に応答し、動き表示信号を
    発生する動き検出回路と、 前記動き表示信号に応答し、且つ所定の入出力
    関数を有し、非線形の合成制御信号を発生する制
    御信号発生回路と、 前記ライン処理されたビデオ出力信号と前記フ
    イールド処理されたビデオ出力信号とを前記合成
    制御信号に従つて合成し、合成されたビデオ出力
    信号を発生する合成回路と、 前記ビデオ入力信号に応答し、垂直デテール表
    示信号を発生する垂直デテール信号検出回路と、 前記垂直デテール表示信号を前記制御信号発生
    回路の入力に供給し、前記ビデオ入力信号中に含
    まれる前記垂直デテールの量に従つて前記制御信
    号発生回路の前記入出力関数を変更する手段とを
    含んでいる、ビデオ信号処理システム。
JP62294286A 1986-11-25 1987-11-24 ビデオ信号処理システム Granted JPS63141491A (ja)

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US934923 1986-11-25
US06/934,923 US4716462A (en) 1986-11-25 1986-11-25 Motion adaptive television signal processing system

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JPH0437636B2 true JPH0437636B2 (ja) 1992-06-19

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KR (1) KR970004198B1 (ja)
DE (1) DE3739812A1 (ja)
FR (1) FR2607342B1 (ja)
GB (1) GB2198311B (ja)
HK (1) HK48096A (ja)
IT (1) IT1222970B (ja)

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