JPH0440162A - 画像出力装置 - Google Patents
画像出力装置Info
- Publication number
- JPH0440162A JPH0440162A JP2148043A JP14804390A JPH0440162A JP H0440162 A JPH0440162 A JP H0440162A JP 2148043 A JP2148043 A JP 2148043A JP 14804390 A JP14804390 A JP 14804390A JP H0440162 A JPH0440162 A JP H0440162A
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- 230000015654 memory Effects 0.000 claims abstract description 32
- 238000000034 method Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 3
- 239000011159 matrix material Substances 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
Landscapes
- Image Processing (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野１
本発明は、カラープリンタ、カラーハードコピー等の画
像出力装置に関するものである。
像出力装置に関するものである。
［従来の技術］
一般に画像を鮮鋭化する方法として、第２図に示すラプ
ラシアンフィルターを用いてマトリクス演算する方法が
知られている。注目画素゛Ｚ°に対して近傍の４画素を
Ａ、Ｂ、Ｃ，Ｄとすれば、鮮鋭化処理されたデータＺ′
は（１）式により与えられる。ｎは０〜１の値をとり鮮
鋭度を変えることができる。
ラシアンフィルターを用いてマトリクス演算する方法が
知られている。注目画素゛Ｚ°に対して近傍の４画素を
Ａ、Ｂ、Ｃ，Ｄとすれば、鮮鋭化処理されたデータＺ′
は（１）式により与えられる。ｎは０〜１の値をとり鮮
鋭度を変えることができる。
Ｚ’＝Ｚ＋ｎ（Ｚ−１／４（Ａ＋Ｂ＋Ｃ＋Ｄ）ｌ ・
［）式従来、鮮鋭化処理した画像データをカラープリン
タ等に出力するには、ホストコンピュータで演算して鮮
鋭化処理した画像データを−Ｈ画像メモリ装置に転送し
、カラープリンタに出力していた。
［）式従来、鮮鋭化処理した画像データをカラープリン
タ等に出力するには、ホストコンピュータで演算して鮮
鋭化処理した画像データを−Ｈ画像メモリ装置に転送し
、カラープリンタに出力していた。
［発明が解決しようとする課題］
従来の方法ではホストコンビニーりで演算処理するため
、ホストコンピュータの負担が大きく処理時間も長くな
るという課題があった。
、ホストコンピュータの負担が大きく処理時間も長くな
るという課題があった。
［課題を解決するための手段］
本発明では上記課題を解決するために、ホストコンピュ
ータよりの画像データに基づき、画像を出力する画像出
力装置において、ホストコンピュータからの画像データ
を記憶するための画像メモリと該画像データを演算処理
して画像を鮮鋭化処理するためのエツジ強調回路を備え
た。
ータよりの画像データに基づき、画像を出力する画像出
力装置において、ホストコンピュータからの画像データ
を記憶するための画像メモリと該画像データを演算処理
して画像を鮮鋭化処理するためのエツジ強調回路を備え
た。
画像メモリから読みだした画像データを、エツジ強調回
路によってリアルタイムに鮮鋭化処理することにより、
ホストコンピュータで演算処理しなくても鮮鋭化された
画像をカラープリンタ等に出力することができる。
路によってリアルタイムに鮮鋭化処理することにより、
ホストコンピュータで演算処理しなくても鮮鋭化された
画像をカラープリンタ等に出力することができる。
［実施例］
以下に、本発明の実施例を図面に基づいて説明する。第
１図は、本発明を好適に実施するための実施例である０
画像メモリ部１１は画像データを記憶するための画像メ
モリと画像メモリの制御回路である。リードアドレスカ
ウンタ１２は、画像メモリからデータを読み出すための
メモリアドレス発生回路である。エツジ処理部１３は、
画像メモリ部１１から読みだした画像データを演算して
エツジ強調処理する回路である。プリンタＩ／Ｆ部１４
は、プリンタに画像データを出力するための制御回路で
ある。ホストＩ／Ｆ部１５は、ホストコンピュータより
の画像データを、画像メモリに書き込むための制御回路
である。ＣＰＵ回路部１６は、装置の全体シーケンスを
制御する。第１図を参照しながら本実施例の動作を説明
する。ホストコンピュータよりの画像データはホストＩ
／Ｆ部１５を介してＣＰＵ回路部１６の制御により画像
メモリ部１１の画像メモリに書き込まれる。一画面分の
画像データが画像メモリに書き終ると次にプリンタへの
データ転送が始まる。リードアドレスカウンタ１２から
発生するメモリアドレスに従って画像メモリ部１１から
読みだした画像データは、エツジ処理部１３において演
算され、鮮鋭化された画像データを生成しながらプリン
タＩ／Ｆ部１４を介してプリンタに転送される。第３図
にエツジ処理回路の例を示す、ラインメモリ２１は、前
ラインの画像データを記憶するためのメモリである。ラ
インメモリ２２は、前々ラインの画像データを記憶する
ためのメモリである。アドレスカウンタ２３はラインメ
モリ２１．２２のアドレスを発生する。ラッチ２４〜３
０はラインメモリ２１．２２、及び画像メモリがら読み
だしたデータを第２図のラプラシアンフィルターのマト
リクス状にラッチする。演算部３１はラッチ２５〜３０
でラッチされたデータから（１）式におけるＺ′を演算
する。演算部３１は加算器、減算器を用いることにより
高速に演算することができ、画像メモリから読みだした
データはリアルタイムに鮮鋭化処理されプリンタに転送
することができる。
１図は、本発明を好適に実施するための実施例である０
画像メモリ部１１は画像データを記憶するための画像メ
モリと画像メモリの制御回路である。リードアドレスカ
ウンタ１２は、画像メモリからデータを読み出すための
メモリアドレス発生回路である。エツジ処理部１３は、
画像メモリ部１１から読みだした画像データを演算して
エツジ強調処理する回路である。プリンタＩ／Ｆ部１４
は、プリンタに画像データを出力するための制御回路で
ある。ホストＩ／Ｆ部１５は、ホストコンピュータより
の画像データを、画像メモリに書き込むための制御回路
である。ＣＰＵ回路部１６は、装置の全体シーケンスを
制御する。第１図を参照しながら本実施例の動作を説明
する。ホストコンピュータよりの画像データはホストＩ
／Ｆ部１５を介してＣＰＵ回路部１６の制御により画像
メモリ部１１の画像メモリに書き込まれる。一画面分の
画像データが画像メモリに書き終ると次にプリンタへの
データ転送が始まる。リードアドレスカウンタ１２から
発生するメモリアドレスに従って画像メモリ部１１から
読みだした画像データは、エツジ処理部１３において演
算され、鮮鋭化された画像データを生成しながらプリン
タＩ／Ｆ部１４を介してプリンタに転送される。第３図
にエツジ処理回路の例を示す、ラインメモリ２１は、前
ラインの画像データを記憶するためのメモリである。ラ
インメモリ２２は、前々ラインの画像データを記憶する
ためのメモリである。アドレスカウンタ２３はラインメ
モリ２１．２２のアドレスを発生する。ラッチ２４〜３
０はラインメモリ２１．２２、及び画像メモリがら読み
だしたデータを第２図のラプラシアンフィルターのマト
リクス状にラッチする。演算部３１はラッチ２５〜３０
でラッチされたデータから（１）式におけるＺ′を演算
する。演算部３１は加算器、減算器を用いることにより
高速に演算することができ、画像メモリから読みだした
データはリアルタイムに鮮鋭化処理されプリンタに転送
することができる。
［発明の効果］
本発明によれば、ホストコンピュータで画像データを鮮
鋭化処理するための演算をする必要がないので、ホスト
コンピュータの負担を軽減することができ、画像メモリ
に画像データを転送するだけで鮮鋭化された画像をカラ
ープリンタ等に出力することができる。
鋭化処理するための演算をする必要がないので、ホスト
コンピュータの負担を軽減することができ、画像メモリ
に画像データを転送するだけで鮮鋭化された画像をカラ
ープリンタ等に出力することができる。
第１図は本発明の実施例を示すブロック図である。第２
図はラプラシアンフィルターの説明図である。第３図は
エツジ処理回路のブロック図である。 ｌ １ ・ ・ ・ ｌ ２ ・ ・ ・ １３ ・ ・ ・ １４ ・ ・ ・ ｌ ５ ・ ・ ・ １６ ・ ・ ・ ２１、２２ ２３ ・ ・ ・ ２４〜３０ ３ ｌ ・ ・ ・ ・画像メモリ部 ・リードアドレスカウンタ ・エツジ処理部 ・プリンタＩ／Ｆ部 ・ホストＩ／Ｆ部 ・ＣＰＵ回路部 ・ラインメモリ ・アドレスカウンタ ・ラッチ ・演算部 以上 出願人 セイコー電子工業株式会社
図はラプラシアンフィルターの説明図である。第３図は
エツジ処理回路のブロック図である。 ｌ １ ・ ・ ・ ｌ ２ ・ ・ ・ １３ ・ ・ ・ １４ ・ ・ ・ ｌ ５ ・ ・ ・ １６ ・ ・ ・ ２１、２２ ２３ ・ ・ ・ ２４〜３０ ３ ｌ ・ ・ ・ ・画像メモリ部 ・リードアドレスカウンタ ・エツジ処理部 ・プリンタＩ／Ｆ部 ・ホストＩ／Ｆ部 ・ＣＰＵ回路部 ・ラインメモリ ・アドレスカウンタ ・ラッチ ・演算部 以上 出願人 セイコー電子工業株式会社
Claims (1)
- ホストコンピュータよりの画像データに基づき画像を出
力する画像出力装置に於て、ホストコンピュータからの
画像データを格納するメモリと、該画像データを演算処
理して画像を鮮鋭化処理し出力するためのエッジ強調回
路と該データに基づき画像を出力する出力装置とから成
ることを特徴とする画像出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2148043A JPH0440162A (ja) | 1990-06-06 | 1990-06-06 | 画像出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2148043A JPH0440162A (ja) | 1990-06-06 | 1990-06-06 | 画像出力装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0440162A true JPH0440162A (ja) | 1992-02-10 |
Family
ID=15443854
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2148043A Pending JPH0440162A (ja) | 1990-06-06 | 1990-06-06 | 画像出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0440162A (ja) |
-
1990
- 1990-06-06 JP JP2148043A patent/JPH0440162A/ja active Pending
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