JPH0441673U - - Google Patents

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JPH0441673U
JPH0441673U JP8164690U JP8164690U JPH0441673U JP H0441673 U JPH0441673 U JP H0441673U JP 8164690 U JP8164690 U JP 8164690U JP 8164690 U JP8164690 U JP 8164690U JP H0441673 U JPH0441673 U JP H0441673U
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JP
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memory
equipped package
package
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error
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JP8164690U
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【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図は従来例を示すブロツク図である。 1,2,3,4……レジスタ、5,15,16
,17,18……メモリ、6,7,8,9,10
……OR回路、11,19……PKG1のエラー
ビツト情報、12,20……PKG2のエラービ
ツト情報、13,21……PKG3のエラービツ
ト情報、14,22……PKG4のエラービツト
情報。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) レジスタと、メモリとを有し、複数のメモ
    リ搭載パツケージを同時に検査するメモリ搭載パ
    ツケージ検査装置であつて、 レジスタは、各メモリ搭載パツケージにそれぞ
    れ対応して複数設けてあり、メモリ搭載パツケー
    ジのエラーが発生したビツト情報を記憶するもの
    であり、 メモリは、複数のメモリ搭載パツケージに対し
    て1個設けてあり、エラーが発生したメモリ搭載
    パツケージの情報を記憶するものであることを特
    徴とするメモリ搭載パツケージ検査装置。 (2) レジスタ用OR回路を有し、 該レジスタ用OR回路は、前記レジスタに対応
    してそれぞれ設けてあり、検査信号からメモリ搭
    載パツケージのエラーが発生したビツト情報を作
    成するものであることを特徴とする請求項第(1)
    項記載のメモリ搭載パツケージ検査装置。 (3) メモリ用OR回路を有し、 該メモリ用OR回路は、前記メモリに対応して
    設けてあり、同時に入力する複数の信号から、エ
    ラーが発生したメモリ搭載パツケージの情報を作
    成するものであることを特徴とする請求項第(1)
    項記載のメモリ搭載パツケージ検査装置。
JP8164690U 1990-07-31 1990-07-31 Pending JPH0441673U (ja)

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JP8164690U JPH0441673U (ja) 1990-07-31 1990-07-31

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JP8164690U JPH0441673U (ja) 1990-07-31 1990-07-31

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JPH0441673U true JPH0441673U (ja) 1992-04-08

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ID=31627768

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JP8164690U Pending JPH0441673U (ja) 1990-07-31 1990-07-31

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