JPH0445973U - - Google Patents

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JPH0445973U
JPH0445973U JP8674290U JP8674290U JPH0445973U JP H0445973 U JPH0445973 U JP H0445973U JP 8674290 U JP8674290 U JP 8674290U JP 8674290 U JP8674290 U JP 8674290U JP H0445973 U JPH0445973 U JP H0445973U
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JP
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signal
analog
span adjustment
digital converter
zero
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JP8674290U
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  • Measurement Of Current Or Voltage (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図ないし第３図は本考案に係わるゼロスパ
ン調整回路の一実施例を説明するために示したも
ので、第１図はゼロスパン調整回路の構成図、第
２図は補正値を求めるための説明図、第３図は補
正値算出の処理の流れ図、第４図及び第５図はそ
れぞれ従来のゼロスパン調整回路の構成図である
。 ２１……計測アンプ、２２……アナログデジタ
ル変換器、２３……識別信号発生スイツチ、２４
……ＣＰＵ、２５……プログラム可能ＲＯＭ。

Claims (1)

  1. 【実用新案登録請求の範囲】 アナログ信号を計測アンプで計測した後、ＣＰ
    Ｕによつて制御されるアナログデジタル変換器に
    よりデジタル信号に変換する回路のゼロスパン調
    整回路において、 現在計測アンプを介して前記アナログデジタル
    変換器に入力されている信号がゼロスパン調整に
    用いる基準電圧の上限値または下限値であるかを
    識別させる信号を発生するスイツチと、このスイ
    ツチからの識別信号に基づいて前記アナログデジ
    タル変換器から基準電圧の上限値及び下限値を取
    り込んでゼロスパン調整用の補正値を求める補正
    値算出手段とを備えたことを特徴とするゼロスパ
    ン調整回路。
JP8674290U 1990-08-21 1990-08-21 Pending JPH0445973U (ja)

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JP8674290U JPH0445973U (ja) 1990-08-21 1990-08-21

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JPH0445973U true JPH0445973U (ja) 1992-04-20

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