JPH0458676A - 輪郭補正回路 - Google Patents
輪郭補正回路Info
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- JPH0458676A JPH0458676A JP2170851A JP17085190A JPH0458676A JP H0458676 A JPH0458676 A JP H0458676A JP 2170851 A JP2170851 A JP 2170851A JP 17085190 A JP17085190 A JP 17085190A JP H0458676 A JPH0458676 A JP H0458676A
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- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 1
- 230000001934 delay Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
- H04N5/20—Circuitry for controlling amplitude response
- H04N5/205—Circuitry for controlling amplitude response for correcting amplitude versus frequency characteristic
- H04N5/208—Circuitry for controlling amplitude response for correcting amplitude versus frequency characteristic for compensating for attenuation of high frequency components, e.g. crispening, aperture distortion correction
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- Multimedia (AREA)
- Signal Processing (AREA)
- Picture Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、映像記録再生機器１例えばＶＴＲ、ビデオデ
ィスクプレーヤ、ビデオカメラなどの信号処理回路に用
いられる輪郭補正回路に関するものである。
ィスクプレーヤ、ビデオカメラなどの信号処理回路に用
いられる輪郭補正回路に関するものである。
添付図面第８図に基づいて従来の技術を説明すると、映
像信号は入力端子３１に入力され、さらに入力マツチン
グ抵抗３２を通過して遅延線３３に入力される。遅延線
３３は一定時間（例えばｔｄ）だけ信号を遅延させる。
像信号は入力端子３１に入力され、さらに入力マツチン
グ抵抗３２を通過して遅延線３３に入力される。遅延線
３３は一定時間（例えばｔｄ）だけ信号を遅延させる。
遅延線３３で遅延された信号は、減算器３４の正極性の
入力と、加算器３５の一方の入力端子に入力される。遅
延！！３３の出力側は、高インピーダンスで受けられて
いるので遅延線３３の出力端において、反射作用が発生
し、この反射信号は更に遅延して遅延線３３の入力側に
伝送される。入力信号と、２ｔｄ時間遅延した信号は、
入力マツチング抵抗３２によって加算され、減算器３４
の負極性入力に入力される。なお、減算器３４の入力は
、加算器３５の他方の入力に供給され、入力映像信号の
輪郭部が強調された信号が、加算ｆ！＃３５がら出力端
子３６に出力される。なお、第９図には各種信号を示し
、（ａ）は入力端子３１に入力される映像信号。
入力と、加算器３５の一方の入力端子に入力される。遅
延！！３３の出力側は、高インピーダンスで受けられて
いるので遅延線３３の出力端において、反射作用が発生
し、この反射信号は更に遅延して遅延線３３の入力側に
伝送される。入力信号と、２ｔｄ時間遅延した信号は、
入力マツチング抵抗３２によって加算され、減算器３４
の負極性入力に入力される。なお、減算器３４の入力は
、加算器３５の他方の入力に供給され、入力映像信号の
輪郭部が強調された信号が、加算ｆ！＃３５がら出力端
子３６に出力される。なお、第９図には各種信号を示し
、（ａ）は入力端子３１に入力される映像信号。
（ｂ）は遅延線３３でｔｄ待時間け遅延した信号。
（ｃ）は入力信号と、遅延線３３の出力端において反射
し、２ｔｄ時間遅延した信号が、マツチング抵抗３２で
加算された信号。
し、２ｔｄ時間遅延した信号が、マツチング抵抗３２で
加算された信号。
（ｄ）は減算器３４の出力信号。
（ｅ）は上記ｃｂ＞に（ｄ）を加算した加算器３５の出
力信号を示す。
力信号を示す。
上述した従来技術の問題点としては、映像信号の輪郭部
を強調するだけでなく、高周波帯域のノイズも強調する
ことが上げられる。その結果、特に映像信号のレベルが
低い時にノイズが目立ち問題となる。従って映像信号の
レベルに応じて、映像信号の輪郭部の強調度合を制御す
ればいいのであるが、従来技術では自然の感じで制御す
ることがむづかしかった。本発明は、この問題を除去す
ることを目的とする。
を強調するだけでなく、高周波帯域のノイズも強調する
ことが上げられる。その結果、特に映像信号のレベルが
低い時にノイズが目立ち問題となる。従って映像信号の
レベルに応じて、映像信号の輪郭部の強調度合を制御す
ればいいのであるが、従来技術では自然の感じで制御す
ることがむづかしかった。本発明は、この問題を除去す
ることを目的とする。
本発明の輪郭補正回路は、入力映像信号を時間ｔｄだけ
遅延させた第１の信号を生成する第１の手段と、入力映
像信号と、入力映像信号を時間２ｔｄだけ遅延させた信
号とを加算した第２の信号を生成する第２の手段と、第
１の信号から第２の信号を減算した第３の信号を生成す
る第３の手段と、第１の信号と第３の信号を加算する第
４の手段と、第３の信号を加算する比率を、第２の信号
に対応して制御する手段を備えることを特徴とするもの
である。
遅延させた第１の信号を生成する第１の手段と、入力映
像信号と、入力映像信号を時間２ｔｄだけ遅延させた信
号とを加算した第２の信号を生成する第２の手段と、第
１の信号から第２の信号を減算した第３の信号を生成す
る第３の手段と、第１の信号と第３の信号を加算する第
４の手段と、第３の信号を加算する比率を、第２の信号
に対応して制御する手段を備えることを特徴とするもの
である。
上記構成の輪郭補正回路においては、第３の信号の第１
の信号に対する加算の比率が、第２の信号に対応して制
御される。従って、ノイズの目立たない画像が得られる
。
の信号に対する加算の比率が、第２の信号に対応して制
御される。従って、ノイズの目立たない画像が得られる
。
本発明の一実施例を第１図および第２図によって説明す
ると、入力端子１に、第２図の信号ａを入力すると、遅
延時間ｔ ｄの遅延線３を通過した信号すが減算器４の
正極性入力端子に入力されるとともに、加算器５の一方
の入力に供給される。
ると、入力端子１に、第２図の信号ａを入力すると、遅
延時間ｔ ｄの遅延線３を通過した信号すが減算器４の
正極性入力端子に入力されるとともに、加算器５の一方
の入力に供給される。
さらに入力信号は遅延１ＩＸ３の出力端で反射し、２ｔ
ｄ時間遅延した後、入力マツチング抵抗２で入力信号と
加算された信号Ｃとなる。この信号Ｃは減算器４の負極
性入力端子に入力される。減算器４は正極性入力端子の
信号すから負極性入力端子Ｃの信号を減算し、信号ｄを
出力する。
ｄ時間遅延した後、入力マツチング抵抗２で入力信号と
加算された信号Ｃとなる。この信号Ｃは減算器４の負極
性入力端子に入力される。減算器４は正極性入力端子の
信号すから負極性入力端子Ｃの信号を減算し、信号ｄを
出力する。
この信号ｄを加算器５で信号すにそのまま加算してしま
ったのでは、信号すのレベルが高くない所で高周波ノイ
ズが目立ってしまう。そこで、信号Ｃのレベルで電圧制
御増幅器（ＶＣＡ）７の電圧利得を制御する。これによ
り、電圧制御増幅器７の出力は信号ｅとなり、信号ｄの
レベルが低いところでは輪郭の補正量を少くすることが
でき、輪郭の補正ができるとともにノイズの目立たない
映像が得られる。
ったのでは、信号すのレベルが高くない所で高周波ノイ
ズが目立ってしまう。そこで、信号Ｃのレベルで電圧制
御増幅器（ＶＣＡ）７の電圧利得を制御する。これによ
り、電圧制御増幅器７の出力は信号ｅとなり、信号ｄの
レベルが低いところでは輪郭の補正量を少くすることが
でき、輪郭の補正ができるとともにノイズの目立たない
映像が得られる。
入力信号ａで電圧制御増幅器７を直接制御してしまうと
、信号ｆのようにアップエツジとダウンエツジで輪郭補
正信号がアンバランスになってしまう、この信号により
輪郭補正を行うと映像が不自然になってしまう。また信
号すで電圧制御増幅器７を制御した場合には、輪郭補正
信号は信号ｇになってしまいアンバランスになる。
、信号ｆのようにアップエツジとダウンエツジで輪郭補
正信号がアンバランスになってしまう、この信号により
輪郭補正を行うと映像が不自然になってしまう。また信
号すで電圧制御増幅器７を制御した場合には、輪郭補正
信号は信号ｇになってしまいアンバランスになる。
なお、入力映像信号に高周波の成分が含まわている場合
にはこの高周波の信号成分によって、電圧制御増幅器が
制御され、輪郭補正信号がその高周波信号成分で振幅変
調されてしまう。そこで、第３図に示すように、低域通
過フィルタ（ＬＰＦ）８を通った信号で電圧制御増幅器
７を制御する方法が望ましい。
にはこの高周波の信号成分によって、電圧制御増幅器が
制御され、輪郭補正信号がその高周波信号成分で振幅変
調されてしまう。そこで、第３図に示すように、低域通
過フィルタ（ＬＰＦ）８を通った信号で電圧制御増幅器
７を制御する方法が望ましい。
本発明の他の実施例を第４図乃至第６図を用いて説明す
る。
る。
第１図および第３図に示した実施例では、本来の映像信
号と、輪郭補正信号を作るための映像信号が共に入力端
子ｌに入力されるようになっている。
号と、輪郭補正信号を作るための映像信号が共に入力端
子ｌに入力されるようになっている。
これに対して、第４図に示すように本来の映像信号と、
輪郭補正のための映像信号を別個にすることができる。
輪郭補正のための映像信号を別個にすることができる。
第４図の実施例においては、輪郭補正信号を作るための
映像信号が入力端子１に入力され、第３図における場合
と同様に輪郭補正信号が作られ、加算器５の一方の入力
端子に供給される。
映像信号が入力端子１に入力され、第３図における場合
と同様に輪郭補正信号が作られ、加算器５の一方の入力
端子に供給される。
二九に対して、本来の映像信号は、入力端子９に入力さ
れ、抵抗１０と遅延線３と同じ遅延量ｔｄを持つ遅延＠
ｉｉを通過して、加算器５の他方の入力端子に入力され
る。この加算器５によって本来の映像信号に輪郭補正信
号が加算され出力端子６に出力される。なお、抵抗１２
は遅延線１〕の出力マツチング抵抗である。
れ、抵抗１０と遅延線３と同じ遅延量ｔｄを持つ遅延＠
ｉｉを通過して、加算器５の他方の入力端子に入力され
る。この加算器５によって本来の映像信号に輪郭補正信
号が加算され出力端子６に出力される。なお、抵抗１２
は遅延線１〕の出力マツチング抵抗である。
入力端子９に入力される本来の映像信号と入力端子１に
入力される補正用の映像信号は、例えば第５図または第
６図に示す回路により生成される。
入力される補正用の映像信号は、例えば第５図または第
６図に示す回路により生成される。
輪郭補正信号を作るための映像信号は、数ラインの映像
信号を加算した信号を使用した方が、画面斜め方向の輪
郭補正が自然に行なえるなどの利点がある。
信号を加算した信号を使用した方が、画面斜め方向の輪
郭補正が自然に行なえるなどの利点がある。
そこで、第５図の実施例においては、入力端子１３に入
力された映像信号を遅延線１４でＩＨ遅延させ、これを
出力端子１６から本来の映像信号として出力するととも
に、遅延線］４により、ＩＨ遅延された信号と遅延され
ない信号とを加算器１５で加算して、これを輪郭補正用
の映像信号どして出力端子１６から出力している。
力された映像信号を遅延線１４でＩＨ遅延させ、これを
出力端子１６から本来の映像信号として出力するととも
に、遅延線］４により、ＩＨ遅延された信号と遅延され
ない信号とを加算器１５で加算して、これを輪郭補正用
の映像信号どして出力端子１６から出力している。
また、第６図の実施例においては、１Ｈ遅延線が２側設
けられ、遅延、［１４によりＩＨ遅延さ肛た信号と、遅
延線１８によりさらにＩＨ（合計２Ｈ）遅延した信号を
、遅延しない信号と加算器１９で加算して、合計３本の
水平走査線により補正用の映像信号を生成している。
けられ、遅延、［１４によりＩＨ遅延さ肛た信号と、遅
延線１８によりさらにＩＨ（合計２Ｈ）遅延した信号を
、遅延しない信号と加算器１９で加算して、合計３本の
水平走査線により補正用の映像信号を生成している。
第７図はさらに他の実施例を示している。
第１図、第３図および第４図の実施例においては、２ｔ
ｄ時間遅延した信号を、遅延線３の出力端子を高インピ
ーダンスとすることにより反射を利用して生成していた
が、第７図の実施例ではｔｄ待時間遅延量を持つ遅延線
２０と２１の２個の遅延線を使用して生成している。
ｄ時間遅延した信号を、遅延線３の出力端子を高インピ
ーダンスとすることにより反射を利用して生成していた
が、第７図の実施例ではｔｄ待時間遅延量を持つ遅延線
２０と２１の２個の遅延線を使用して生成している。
上述したように、本発明の輪郭補正回路によれば、第３
の信号を第１の信号に加算する比率を、第２の信号で制
御するようにしたので、映像信号の輪郭補正がバランス
よく行なわれ、しかも信号のレベルが低い所では輪郭の
補正を少なくすることができるので、低レベル時にノイ
ズが目立つという欠点も防止でき、ＩＣ化にも適してい
る。
の信号を第１の信号に加算する比率を、第２の信号で制
御するようにしたので、映像信号の輪郭補正がバランス
よく行なわれ、しかも信号のレベルが低い所では輪郭の
補正を少なくすることができるので、低レベル時にノイ
ズが目立つという欠点も防止でき、ＩＣ化にも適してい
る。
第１図は本発明の輪郭補正回路の一実施例の構成を示す
ブロック図、第２図は第１図の実施例の動作を説明する
波形図、第３図、第４図および第７図は本発明の輪郭補
正回路の他の実施例の構成を示すブロック図、第５図お
よび第６図は本発明のもので、第４図の入力端子に供給
する映像信号を生成する回路の一実施例の構成を示すブ
ロック図、第８図は従来例の輪郭補正回路の一実施例の
構成を示すブロック図、第９図は第８図の動作に説明す
る波形図である。 １．９，１３，３１・・・入力端子、２，１０．３２・
・・入力マッチング抵抗、１２．２２・・・出力マツチ
ング抵抗、３，１１，１４，１８，２０，２１゜３３・
・・遅延線、４．３４・・・減算器、５，１９．２３・
・・加算器、６，１６，１７，３６・・・出力端子、７
・・・電圧制御増幅器、８・・・低域通過フィルタ、２
４・・・減衰看。 第１図 第２因 （ｄ） 一譜一円Ｆ 第９図 第７ 図 手続補正書 （自発） 平成３年４月 ２４日 補正の内容 （１）明細書の「発明の詳細な説明」の桐生、第２頁第
１５行目の 「減算器３４の入力は、」を、 「減算器３４の出力は、」と補正する。 （２）明細書の「図面の簡単な説明」の桐生、第９頁第
１８行目の ｒ５． １９． ２３・・・加算器、 」を、ｒ５．
１９，２３．１５．３５・・・加算器ｊと補正する。 図面中、第８図を、 別紙のとおり補正する。 第８
ブロック図、第２図は第１図の実施例の動作を説明する
波形図、第３図、第４図および第７図は本発明の輪郭補
正回路の他の実施例の構成を示すブロック図、第５図お
よび第６図は本発明のもので、第４図の入力端子に供給
する映像信号を生成する回路の一実施例の構成を示すブ
ロック図、第８図は従来例の輪郭補正回路の一実施例の
構成を示すブロック図、第９図は第８図の動作に説明す
る波形図である。 １．９，１３，３１・・・入力端子、２，１０．３２・
・・入力マッチング抵抗、１２．２２・・・出力マツチ
ング抵抗、３，１１，１４，１８，２０，２１゜３３・
・・遅延線、４．３４・・・減算器、５，１９．２３・
・・加算器、６，１６，１７，３６・・・出力端子、７
・・・電圧制御増幅器、８・・・低域通過フィルタ、２
４・・・減衰看。 第１図 第２因 （ｄ） 一譜一円Ｆ 第９図 第７ 図 手続補正書 （自発） 平成３年４月 ２４日 補正の内容 （１）明細書の「発明の詳細な説明」の桐生、第２頁第
１５行目の 「減算器３４の入力は、」を、 「減算器３４の出力は、」と補正する。 （２）明細書の「図面の簡単な説明」の桐生、第９頁第
１８行目の ｒ５． １９． ２３・・・加算器、 」を、ｒ５．
１９，２３．１５．３５・・・加算器ｊと補正する。 図面中、第８図を、 別紙のとおり補正する。 第８
Claims (1)
- 入力映像信号を時間ｔｄだけ遅延させた第１の信号を生
成する第１の手段と、前記入力映像信号と、前記入力映
像信号を時間２ｔｄだけ遅延させた信号とを加算した第
２の信号を生成する第２の手段と、前記第１の信号から
前記第２の信号を減算した第３の信号を生成する第３の
手段と、前記第１の信号と前記第３の信号を加算する第
４の手段と、前記第３の信号を加算する比率を、前記第
２の信号に対応して制御する手段を備えることを特徴と
する輪郭補正回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2170851A JP2551205B2 (ja) | 1990-06-28 | 1990-06-28 | 輪郭補正回路 |
| KR1019910010046A KR950001442B1 (ko) | 1990-06-28 | 1991-06-18 | 윤곽 보정 회로 |
| US07/723,176 US5303047A (en) | 1990-06-28 | 1991-06-28 | Contour compensation circuit for a signal processing apparatus of an image recording and reproduction apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2170851A JP2551205B2 (ja) | 1990-06-28 | 1990-06-28 | 輪郭補正回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0458676A true JPH0458676A (ja) | 1992-02-25 |
| JP2551205B2 JP2551205B2 (ja) | 1996-11-06 |
Family
ID=15912500
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2170851A Expired - Lifetime JP2551205B2 (ja) | 1990-06-28 | 1990-06-28 | 輪郭補正回路 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5303047A (ja) |
| JP (1) | JP2551205B2 (ja) |
| KR (1) | KR950001442B1 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5903316A (en) * | 1992-12-25 | 1999-05-11 | Canon Kabushiki Kaisha | Information signal processing apparatus |
| JP3697844B2 (ja) * | 1997-07-25 | 2005-09-21 | 株式会社富士通ゼネラル | 輪郭強調回路 |
| EP0969657A1 (en) * | 1998-06-29 | 2000-01-05 | NuWave Technologies, Inc. | Apparent image clarity improving apparatus and method |
| JP3969644B2 (ja) * | 2002-08-27 | 2007-09-05 | 日本放送協会 | 輪郭補償方法、輪郭補償回路、輪郭補償プログラムおよび映像信号表示装置 |
| KR100514182B1 (ko) * | 2003-09-08 | 2005-09-13 | 삼성에스디아이 주식회사 | 유기전계발광표시장치 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62189880A (ja) * | 1986-02-17 | 1987-08-19 | Hitachi Denshi Ltd | 輪郭強調回路 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58219872A (ja) * | 1982-06-15 | 1983-12-21 | Pioneer Electronic Corp | 輪郭補正回路 |
| JPS63122368A (ja) * | 1986-11-12 | 1988-05-26 | Matsushita Electric Ind Co Ltd | 画質調整装置 |
| JPS63287175A (ja) * | 1987-05-19 | 1988-11-24 | Victor Co Of Japan Ltd | 輪郭補償回路 |
| DE68922433T2 (de) * | 1988-05-18 | 1996-01-11 | Hitachi Ltd | Aporturkorrekturschaltung. |
-
1990
- 1990-06-28 JP JP2170851A patent/JP2551205B2/ja not_active Expired - Lifetime
-
1991
- 1991-06-18 KR KR1019910010046A patent/KR950001442B1/ko not_active Expired - Fee Related
- 1991-06-28 US US07/723,176 patent/US5303047A/en not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62189880A (ja) * | 1986-02-17 | 1987-08-19 | Hitachi Denshi Ltd | 輪郭強調回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR920001493A (ko) | 1992-01-30 |
| KR950001442B1 (ko) | 1995-02-24 |
| US5303047A (en) | 1994-04-12 |
| JP2551205B2 (ja) | 1996-11-06 |
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