JPH0478828U - - Google Patents

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JPH0478828U
JPH0478828U JP12083490U JP12083490U JPH0478828U JP H0478828 U JPH0478828 U JP H0478828U JP 12083490 U JP12083490 U JP 12083490U JP 12083490 U JP12083490 U JP 12083490U JP H0478828 U JPH0478828 U JP H0478828U
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voltage
frequency
controlled oscillator
converter
low
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の実施例のＰＬＬ回路のブロ
ツク図、第２図はＰＬＬロツク時のアツプ／ダウ
ンカウンタ７の出力変化を示す図である。 １は基準発振回路、２，３は分周器、４は位相
比較回路、５はＯＲゲート回路、６はＡＮＤゲー
ト回路、７はアツプ／ダウンカウンタ、８はデジ
タル・アナログコンバータ（ＤＡＣ）、９は低域
通過ろ波器、１０は電圧制御発振器（ＶＣＯ）、
１１は分周器である。

Claims (1)

  1. 【実用新案登録請求の範囲】 制御電圧に従つて発振する電圧制御発振器と、 この電圧制御発振器に基づく周波数と基準周波
    数との位相差に比例する時間幅の進み又は遅れ位
    相を示すパルス信号を出力する位相比較器と、 このパルス信号に応じて前記基準周波数よりも
    充分に高い周波数のクロツク信号でアツプ／ダウ
    ンするアツプ／ダウンカウンタと、 このアツプ／ダウンカウンタの出力をアナログ
    信号に変換するＤ／Ａ変換器と、 このアナログ信号を比較的高いカツトオフ周波
    数で低域通過ろ波して前記電圧制御発振器に帰還
    する低域通過ろ波器とを備えたことを特徴とする
    ＰＬＬ回路。
JP12083490U 1990-11-20 1990-11-20 Pending JPH0478828U (ja)

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