JPH0487559A - 高圧電源制御装置 - Google Patents

高圧電源制御装置

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JPH0487559A
JPH0487559A JP2197852A JP19785290A JPH0487559A JP H0487559 A JPH0487559 A JP H0487559A JP 2197852 A JP2197852 A JP 2197852A JP 19785290 A JP19785290 A JP 19785290A JP H0487559 A JPH0487559 A JP H0487559A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、例えば複写機やレーザプリンタ等において感
光体を有する電子写真機構部に使用される高圧電源制御
装置に関する。
［従来の技術］ 複写機やレーザプリンタ等に使用される電子写真機構部
は、例えば感光体ドラムを備え、この感光体ドラムの感
光体を帯電部で帯電させた後露光部で露光して感光体上
に静電潜像を形成し、その静電潜像に対して現像部にて
トナーを付着させ、そのトナー像を転写部にて転写用紙
に転写させるようになっている。
このような電子写真機構部においては、帯電部における
帯電チャージャや現像部における現像スリーブや転写部
における転写チャージャにそれぞれ高電圧を印加させる
ため高圧電源制御装置が設けられている。
従来、このような高圧電源制御装置としては、第６図に
示すものが知られている。これはスイッチングトランジ
スタ１のスイッチング動作により帯電用高圧トランス２
に高電圧を発生させその高電圧を帯電チャージャ３に印
加させ、またスイッチングトランジスタ４のスイッチン
グ動作により転写用高圧トランス５に高電圧を発生させ
その高電圧を転写チャージャ６に印加させ、さらにスイ
ッチングトランジスタ７のスイッチング動作によりバイ
アス用高圧トランス８に高電圧を発生させその高電圧を
現像スリーブ９に印加させるようにしている。
前記各スイッチングトランジスタ１．４．７はそれぞれ
帯電用ＰＷＭ（パルス幅変調）制御部１０、転写用ＰＷ
Ｍ制御部１１、バイアス用ＰＷＭ制御部１２からのパル
ス信号によってスイッチング制御されるようになってい
る。
また前記各高圧トランス２，５．８に発生する高電圧変
化をそれぞれモニタ電圧検出回路１３゜１４．１５でモ
ニタし、そのモニタ出力をそれぞれ帯電用Ａ／Ｄ　（ア
ナログ／デジタル）変換器１６、転写用Ａ／Ｄ変換器１
７、バイアス用Ａ／Ｄ変換器１８でＡ／Ｄ変換した後前
記帯電用ＰＷＭ制御部１０、転写用ＰＷＭ制御部１１、
バイアス用ＰＷＭ制御部１２に供給するようになってい
る。
前記帯電用ＰＷＭ制御部１０、転写用ＰＷＭ制御部１１
、バイアス用ＰＷＭ制御部１２にはまたマイクロプロセ
ッサ１９から帯電ＯＮ信号と帯電基準値、転写ＯＮ信号
と転写基準値、バイアスＯＮ信号とバイアス基準値がそ
れぞれ入力されるようになっている。
前記各ＰＷＭ制御部１０〜１２は第７図に示すように演
算部２１、モニタ電圧基準値設定部２２、周波数基準値
設定部２３、基準クロック発生器２４、この基準クロッ
ク発生器２４からの基準クロックをカウントする基準カ
ウンタ２５、コンパレータ２６，２７、フリップフロッ
プ（Ｆ／Ｆ）２８及びタイミングコントローラ２９を設
け、前記演算部２１にＡ／Ｄ変換器１６〜１８からのモ
ニタ電圧のデジタル値を入力するとともにモニタ電圧基
準値設定部２２のモニタ電圧基準値を入力している。な
お、モニタ電圧基準値設定部２２に対するモニタ電圧基
準値（帯電基準値、転写基準値、バイアス基準値）の設
定はマイクロプロセッサ１９により行われるようになっ
ている。
前記演算部２１は入力されるデジタル値とモニタ電圧基
準値とを比較演算しその差分の加減算された演算出力値
をコンパレータ２７に供給するようになっている。
すなわちコンパレータ２６にて周波数基準値設定部２３
からの周波数基準値と基準カウンタ２５のカウント値を
比較し、カウント値が周波数基準値に一致するとコンパ
レータ２６の出力がアクティブとなってフリップフロッ
プ２８をＯＮする。
また基準カウンタ２５はこのときクリアされる。
これによりフリップフロップ２８からの出力、すなわち
ＰＷＭ制御部１０〜１２の出力がハイレベルとなる。
またコンパレータ２７にて演算部２１からの演算出力値
と基準カウンタ２５のカウント値を比較し、カウント値
が演算出力値に一致するとコンパレータ２７の出力がア
クティブとなってフリップフロップ２８をＯＦＦする。
これによりフリップフロップ２８からの出力、すなわち
ＰＷＭ制御部１０〜１２の出力がローレベルとなる。す
なわち演算部２１からの演算出力値はスイッチングトラ
ンジスタ１，４．７のスイッチングデユーティ比を決め
ている。
なお、タイミング・コントローラ２９はマイクロプロセ
ッサ１９からのＯＮ信号を入力しＡ／Ｄ変換器１６の動
作タイミング及び演算部２１の動作タイミングを決めて
いる。
この装置においては、マイクロプロセッサ１９からの各
ＯＮ信号により各ＰＷＭ制御部１０〜１２はそれぞれ独
自に動作するようになる。
［発明が解決しようとする課題］ しかしこの従来装置では、ＰＷＭ制御部及びＡ／Ｄ変換
器を帯電用、転写用、バイアス用と個々に設けているた
め使用する回路部品点数が多くなるとともに装置が大形
化する問題があった。また各ＰＷＭ制御部が個々に独立
して動作するため各ＰＷＭ制御部においては動作の休止
期間が長く動作効率が悪かった。
そこで本発明は、１個のＰＷＭ制御部及びＡ／Ｄ変換器
を複数の高電圧発生制御に対して共通に使用でき、従っ
て使用する回路部品点数を少なくできるとともに装置を
小形化でき、しかもＰＷＭ制御部の動作効率を向上でき
る高圧電源制御装置を提供しようとするものである。
［課題を解決するための手段］ 請求項（１）対応の発明は、複数の高圧トランスを設け
、それぞれスイッチング手段のスイッチング動作により
対応する高圧トランスに高電圧を発生させ負荷に印加さ
せる高圧電源制御装置において、各高圧トランスに発生
する高電圧変化をそれぞれモニタする複数のモニタ電圧
検出回路と、この各モニタ電圧検出回路からのモニタ電
圧を所定のタイミングで順次選択し共通のアナログ／デ
ジタル変換器に供給するマルチプレクサと、アナログ／
デジタル変換器からのデジタル値と予め設定された基準
値を比較演算するとともにその比較演算結果をフィード
バック値と加算して出力値を得る演算部と、この演算部
から出力される各モニタ電圧に対応した演算出力をそれ
ぞれラッチするとともにそのラッチした値をフィードバ
ック値として演算部に供給する複数のラッチ回路と、基
準クロックをカウントする基準カウンタと、周波数基準
値及び各ラッチ回路のラッチした値並びに基準カウンタ
のカウント値により各スイッチング手段をスイッチング
動作させるデユーティ比を制御する出力制御手段を設け
たものである。
請求項（２）対応の発明は、請求項（１）対応の発明に
おいて、演算部は演算結果から得られる出力値が所定の
範囲内に無いときエラー信号を出力する構成としたもの
である。
請求項（３）対応の発明は、請求項（１）対応の発明に
おいて、さらにアナログ／デジタル変換器からのデジタ
ル値を判断し、そのデジタル値が所定の範囲内に無いと
きエラー信号を出力する手段を設けたものである。
［作用］ このような構成の本発明においては、各高圧トランスに
発生する高電圧変化をそれぞれ個々のモニタ電圧検出回
路でモニタする。そしてこの各モニタ電圧検出回路から
のモニタ電圧をマルチプレクサにより所定のタイミング
で順次選択されてアナログ／デジタル変換器に供給され
デジタル変換された後演算部に供給される。
演算部では入力されるデジタル値と予め設定された基準
値を比較演算し、さらに比較演算結果をラッチ回路から
のフィードバック値に加算して出力値を得る。
こうして演算部から出力される各モニタ電圧に対応した
出力値を複数のラッチ回路により個々にラッチする。
そして予め設定された周波数基準値及び各ラッチ回路で
ラッチした値及び基準カウンタのカウント値により各ス
イッチング手段のデユーティ比を制御する。
［実施例］ 以下、本発明の一実施例を図面を参照して説明する。な
お、本実施例は本発明を電子写真機構部における高圧発
生制御に適用したものについて述べる。
第１図に示すように、スイッチングトランジスタ３１の
スイッチング動作により帯電用高圧トランス３２に高電
圧を発生させその高電圧を帯電チャージャ３３に印加さ
せ、またスイッチングトランジスタ３４のスイッチング
動作により転写用高圧トランス３５に高電圧を発生させ
その高電圧を転写チャージャ３６に印加させ、さらにス
イッチングトランジスタ３７のスイッチング動作により
バイアス用高圧トランス３８に高電圧を発生させその高
電圧を現像スリーブ３９に印加させるようにしている。
前記各スイッチングトランジスタ３１，３４゜３７は共
通のＰＷＭ　（パルス幅変調）制御部４０からのパルス
信号によってスイッチング制御されるようになっている
。
また前記各高圧トランス３２，３５．３８に発生する高
電圧変化をそれぞれモニタ電圧検出回路４１．４２．４
３でモニタし、そのモニタ出力をアナログマルチプレク
サ４４に供給している。
前記アナログマルチプレクサ４４は入力される前記各モ
ニタ電圧検出回路４１．４２．４３からのモニタ出力を
所定のタイミングで順次選択し共通のＡ／Ｄ　（アナロ
グ／デジタル）変換器４５に供給している。
前記Ａ／Ｄ変換器４５は入力されるモニタ電圧をデジタ
ル値に変換し、そのデジタル値を前記ＰＷＭ制御部４０
に供給している。
前記ＰＷＭ制御部４０にはまた、マイクロプロセッサ４
６から帯電ＯＮ信号、転写ＯＮ信号、バイアスＯＮ信号
がそれぞれ入力されるとともに帯電基準値、転写基準値
、バイアス基準値か書き込みデータとしてそれぞれ入力
されるようになっている。
前記ＰＷＭ制御部４０は第２図に示すように演算部５１
、帯電用基準値設定部５２、転写用基準値設定部５３、
バイアス用基準値設定部５４、周波数基準値設定部５５
、基準クロック発生器５６、この基準クロック発生器５
６からの基準クロックをカウントする基準カウンタ５７
、第１、第２のセレクタ５８，５９、第１、第２、第３
のラッチ回路６０，６１，６２、第１、第２、第３、第
４のコンパレータ６３，６４，６５．６６、第１、第２
、第３のフリップフロップ（Ｆ／Ｆ）６７゜６８．６９
、半周期制御回路７０及び前記アナログマルチプレクサ
４４、Ａ／Ｄ変換器４５、演算部５１、第１、第２のセ
レクタ５８，５９、第１、第２、第３のラッチ回路６０
．６１．６２をそれぞれ所定のタイミングで制御するタ
イミング・コントローラ７１からなり、前記Ａ／Ｄ変換
器４５からのモニタ電圧のデジタル値を前記演算部５１
に供給するとともに、前記マイクロプロセッサ４６から
の帯電ＯＮ信号、転写ＯＮ信号、バイアスＯＮ信号を前
記タイミング・コントローラ７１及び前記第１、第２、
第３のフリップフロップ６７．６８．６９のクリア端子
ＣＬに供給している。
前記帯電用基準値設定部５２、転写用基準値設定部５３
、バイアス用基準値設定部５４に対する基準値の設定は
前記マイクロプロセッサ４６からの帯電基準値、転写基
準値、バイアス基準値の書き込みデータにより行われる
ようになっている。
前記アナログマルチプレクサ４４は前記タイミング・コ
ントローラ７１からの制御信号により帯電用モニタ電圧
、転写用モニタ電圧、バイアス用モニタ電圧を選択しＡ
／Ｄ変換器４５に供給している。
前記第１のセレクタ５８は前記タイミング・コントロー
ラ７１からの制御信号により前記各ラッチ回路６０．６
１．６２の出力を選択し、フィードバック値として前記
演算部５１に供給するようになっている。
前記第２のセレクタ５９は前記タイミング・コントロー
ラ７１からの制御信号により前記帯電用基準値設定部５
２、転写用基準値設定部５３、バイアス用基準値設定部
５４からの基準値を選択して前記演算部５１に供給する
ようになっている。
前記周波数基準値設定部５５からの周波数基準値を前記
演算部５１及び第４のコンパレータ６６に供給するよう
になっている。
前記演算部５１は第３図に示すように、反転回路８１、
第１、第２の加算器８２．８Ｂ、ｒ　０１　ＨＪ　及ヒ
ｒ　Ｆ　Ｅ　ＨＪ　（１）データ発生回路８４、コンパ
レータ８５及びセレクタ８６で構成され、前記Ａ／Ｄ変
換器４５からのデジタル値を前記反転回路８１を介して
前記第１の加算器８２に供給している。前記第１の加算
器８２にはまた前記第２のセレクタ５９からの基準値が
入力されるようになっている。
前記第１の加算器８２からは８ビツトのデータが出力さ
れ、その内の７ビツトをアンドゲート８７に供給し１ビ
ツトをオアゲート８８に供給している。
前記ｒ０１ＨＪ及びｒＦＥＨＪのデータ発生回路８４は
前記タイミング・コントローラ７１に制御され、Ａ／Ｄ
変換器４５からのデジタル値が前記第２のセレクタ５９
からの基準値と一致するまではｒ０１ＨＪデータを出力
し、デジタル値が基準値を越えるとｒＦＥＨＪデータを
出力し、そのデータを前記アンドゲート８７及びオアゲ
ート８８に供給するようになっている。
前記アンドゲート８７及びオアゲート８８の出力を前記
第２の加算器８３に供給している。前記第２の加算器８
３にはまた前記第１のセレクタ５８からのフィードバッ
ク値が人力されるようになっている。
前記第２の加算器８３はフィードバック値と前記アンド
ゲート８７及びオアゲート８８からのデータを加算し、
その加算値を前記セレクタ８６及びコンパレータ８５に
供給している。
前記セレクタ８６及びコンパレータ８５にはまた前記周
波数基準値設定部５５からの周波数基準値が入力されて
いる。
前記コンパレータ８５は加算値と周波数基準値を比較し
、加算値が周波数基準値になるまでは前記セレクタ８６
に加算値を選択させる信号を出力し、また加算値が周波
数基準値以上になると前記セレクタ８６に周波数基準値
を選択させる信号を出力するようになっている。
前記各加算器８２．８３は加算結果が負になるとキャリ
一端子ＣＡからの信号をローレベルにし前記セレクタ８
６のイネーブル状態を解除するようになっている。これ
により前記セレクタ８６は演算出力値をゼロにするよう
になっている。
前記セレクタ８６からの出力値は前記演算部５１の出力
値で、その出力値を第２図に示すように前記各ラッチ回
路６０，６１．６２に供給している。前記各ラッチ回路
６０．６１．６２は前記タイミング・コントローラ７１
に制御され、帯電ＯＮ時にはラッチ回路６０が出力値を
ラッチし、転写ＯＮ時にはラッチ回路６１が出力値をラ
ッチし、かつバイアスＯＮ時にはラッチ回路６２が出力
値をラッチするようになっている。
前記各ラッチ回路６０，６１．６２がラッチした値を第
１、第２、第３のコンパレータ６３゜６４．６５にそれ
ぞれ供給している。前記各コンパレータ６３，６４，６
５．６６にはまた前記基準カウンタ５７からのカウント
値が入力されている。
前記第４のコンパレータ６６は周波数基準値設定部５５
からの周波数基準値に基準カウンタ５７のカウント値が
一致するとアクデイプとなり、その出力を前記基準カウ
ンタ５７のクリア端子ＣＬに供給するとともに半周期制
御回路７０に供給している。前記周波数基準値設定部５
′５からの周波数基準値はトランジスタスイッチング周
波数の半分に設定されており、前記半周期制御回路７０
により第１、第３のフリップフロップ６７．６９のＯＮ
タイミングと第２のフリップフロップ６８のＯＮタイミ
ングを半周期ずらしている。すなわち前記半周期制御回
路７０のＱ端子出力を前記第１、第３のフリップフロッ
プ６７．６９のＯＮ端子に供給し、口端干出力を前記第
２のフリップフロップ６８のＯＮ端子に供給することに
よって、帯電及びバイアスのＯＮ周期と転写のＯＮ周期
を半周期ずらしている。
前記第１、第２、第３のコンパレータは周波数基準値設
定部５５からの周波数基準値に基準カウンタ５７のカウ
ント値が一致するとアクデイプとなり、その出力を前記
第１、第２、第３のフリップフロップ６７．６８．６９
のＯＦＦ端子に供給している。
そして前記第１、第２、第３のフリップフロップ６７．
６８．６９から前記各スイッチングトランジスタ３１，
３４．３７を駆動する帯電出力、転写出力、バイアス出
力をそれぞれ送出するようになっている。
なお、前記第１、第２、第３のフリップフロ、ツブ６７
．６８．６９のクリア端子ＣＬにはマイクロプロセッサ
４６からの帯電ＯＮ信号、転写ＯＮ信号及びバイアスＯ
Ｎ信号かそれぞれ入力されている。
第４図及び第５図は前記スイッチングトランジスタ３１
，３４．３７、高圧トランス３２，３５゜３８及びモニ
タ電圧検出回路４１，４２．４３で構成される具体的回
路例を示すもので、第４図は定電圧制御方式を使用した
ものであり、第５図は定電流制御方式を使用したもので
ある。
このような構成の本実施例においては、電源が投入され
るとマイクロプロセッサ４６は先ず帯電用基準値、転写
用基準値、バイアス用基準値をＰＷＭ制御部４０の各設
定部５２．５３．５４にそれぞれ設定する。
この状態でマイクロプロセッサ４６から帯電ＯＮ信号、
転写ＯＮ信号、バイアスＯＮ信号のいずれかがタイミン
グ・コントローラ７１に入力されるとタイミング・コン
トローラ７１は動作を開始する。そしてアナログプレク
サ４４の３つの入力アドレスを所定のタイミングで順次
切り替える。
このときアドレスが切り替えられる毎にＡ／Ｄ変換器４
５に変換要求を行う。
Ａ／Ｄ変換器４５からのデジタル値は演算部５１に供給
される。出力ＯＮ直後はモニタ電圧の出力はゼロなので
Ａ／Ｄ変換されたデジタル値もゼロとなる。そこで出力
ＯＮ直後はｒｏｌＨＪ及びｌ”ＦＥＨＪのデータ発生回
路８４からはｒ０１ＨＪデータが出力され第２の加算器
８３に供給される。この第２の加算器８３に入力される
フィードバック値も当初はゼロなので、この加算器出力
はｒｏｌＨＪとなる。
この値ｒ０１ＨＪは周波数基準値より小さいのでセレク
タ８６は加算器出力を選択する。こうしてセレクタ８６
は通常は加算器出力を選択することになる。
一方、タイミング・コントローラ７１に制御されて第１
、第２のセレクタ５８．５９はアナログマルチプレクサ
４４の入力アドレス選択に対応した選択を行い、フィー
ドバック値及び基準値を演算部５１に供給する。
また各ラッチ回路６０，６１．６２もタイミング・コン
トローラ７１に制御されてアナログマルチプレクサ４４
の入力アドレス選択に対応したラッチイネーブル状態と
なる。
そして第４のコンパレータ６６は基準カウンタ５７のカ
ウント値が周波数基準値に一致するタイミングでアクテ
ィブとなり、これにより第１、第３のフリップフロップ
６７．６９が先ずＯＮとなり、半周期後に第２のフリッ
プフロップ６８がＯＮとなる。また第４のコンパレータ
６６がアクティブとなったタイミングで基準カウンタ５
７はクリアされる。
また第１、第２、第３のコンパレータ６３゜６４．６５
はラッチ回路６０．６１．６２がそれぞれラッチした値
に基準カウンタ５７のカウント値が一致するとアクティ
ブとなって第１、第２、第３のフリップフロップ６７．
６８．６９をそれぞれＯＦＦする。
こうして第１のフリップフロップ６７のＯＦＦタイミン
グによりスイッチングトランジスタ３１への帯電出力の
デユーティ比が制御され、第２のフリップフロップ６８
のＯＦＦタイミングによりスイッチングトランジスタ３
４への転写出力のデユーティ比が制御され、かつ第３の
フリップフロップ６９のＯＦＦタイミングによりスイッ
チングトランジスタ３７へのバイアス出力のデユーティ
比が制御される。
周波数基準値により各スイッチングトランジスタ３１，
３４．３７のスイッチング周期が制御され、かつ演算部
５１からの演算出力値により各スイッチングトランジス
タ３１，３４．３７のスイッチングデユーティ比が制御
されることになる。
このように１個のＰＷＭ制御部４０とＡ／Ｄ変換器４５
を使用して帯電用、転写用、現像バイアス用の高圧発生
制御ができるので、使用する回路部品点数を少なくでき
るとともに装置を小形化を図ることができる。またＰＷ
Ｍ制御部４０は各高圧発生制御が順次行われるため休止
している時間は少なく動作効率を向上できる。
ところで出力ＯＮ当初においてはラッチした値はゼロな
のでデユーティ比は基準クロック発生器５６からの基準
クロックの１クロック分となる。
そしてその後デユーティ比は基準クロックの１クロック
分ずつ徐々に増加し、やがてＡ／Ｄ変化されたデジタル
値が基準値設定部５２，５３．５４からの基準値以上に
なると、データ発生回路８４からの出力がｒＦＥＨＪデ
ータに切り替わる。
これにより第２の加算器８３には第１の加算器８２から
の出力が入力されるようになる。すなわち基準値とデジ
タル値との差（２の補数）が第２の加算器８３に入力さ
れフィードバック値に加算される。
基準値がデジタル値よりも大きい場合は、その差分フィ
ードバック値が増加した値が新しいデユーティ比となっ
て出力が増加し、また基準値かデジタル値よりも小さい
場合は、その差分フィードバック値が減少した値が新し
いデユーティ比となって出力が減少する。
またコンパレータ８５において加算器８３の出力値が周
波数基準値以上になるとセレクタ８６は周波数基準値を
選択するように動作する。また各加算器８２．８３にお
いて加算した結果が負になることがあると、各加算器８
２．８３のキャリー端子ＣＡからキャリー信号が発生し
、この結果セレクタ８６のイネーブル状態が解かれて演
算部出力はゼロとなる。
なお、演算結果がゼロとなったり、あるいは予めプツト
タイムを設定しておき演算結果がデッドタイムとなった
ときにそれをマイクロプロセッサ４６に知らせ、マイク
ロプロセッサ４６はそれにより異常を判断して出力を停
止させることもできる。すなわち演算部５１において演
算結果帯られる出力値が所定の範囲内に無いときエラー
信号を出力させるようにすればよい。
例えば第４図の回路を使用した場合、出力が短絡すると
モニタ電圧がゼロとなるため出力のデユーティはデッド
タイムまで増加することになるので、これをマイクロプ
ロセッサ４６に知らせることにより出力を停止させるこ
とができる。
また、第５図の回路を使用した場合、出力がオーブン状
態になると電流が流れずモニタ電圧がゼロとなるため出
力のデユーティはデッドタイムまで増加することになる
ので、これをマイクロプロセッサ４６に知らせることに
より出力を停止させることができる。
さらにＡ／Ｄ変換器４５からのデジタル値を直接エラー
検出用の上限値と下限値とで比較する手段を設け、デジ
タル値がこの上限値と下限値の範囲内に無いときエラー
信号を出力してマイクロプロセッサ４６に知らせるよう
にしてもよい。
なお、本実施例は本発明を電子写真機構部における高圧
発生制御に適用したものについて述べたが必ずしもこれ
に限定されるものでないのは勿論である。
［発明の効果コ 以上詳述したように本発明によれば、１個のＰＷＭ制御
部及びＡ／Ｄ変換器を複数の高電圧発生制御に対して共
通に使用でき、従って使用する回路部品点数を少なくで
きるとともに装置を小形化でき、しかもＰＷＭ制御部の
動作効率を向上できる高圧電源制御装置を提供できるも
のである。
【図面の簡単な説明】
第１図乃至第５図は本発明の一実施例を示すもので、第
１図は全体のブロック図、第２図は第１図におけるＰＷ
Ｍ制御部の構成を示すブロック図、第３図は第２図にお
ける演算部の構成を示すブロック図、第４図及び第５図
はスイッチングトランジスタ、高圧トランス及びモニタ
電圧検出回路の具体回路例を示す回路図、第６図及び第
７図は従来例を示すブロック図である。 ３１．３４．３７・・・スイッチングトランジスタ、３
２．３５．３８・・・高圧トランス、４０・・・ＰＷＭ
（パルス幅変調）制御部、４１〜４３・・・モニタ電圧
検出回路、４４・・・アナログマルチプレクサ、 ４５・・・Ａ／Ｄ変換器、 ４６・・・マイクロプロセッサ− ５１・・・演算部、 ５７・・・基準カウンタ、 ６０〜６２・・・ラッチ回路、 ６３〜６６・・・コンノくレータ、 ６７〜６９・・・フリップフロ・ツブ、７１・・・タイ
ミング・コントローラ。

Claims (3)

    【特許請求の範囲】
  1. （１）複数の高圧トランスを設け、それぞれスイッチン
    グ手段のスイッチング動作により対応する高圧トランス
    に高電圧を発生させ負荷に印加させる高圧電源制御装置
    において、前記各高圧トランスに発生する高電圧変化を
    それぞれモニタする複数のモニタ電圧検出回路と、この
    各モニタ電圧検出回路からのモニタ電圧を所定のタイミ
    ングで順次選択し共通のアナログ／デジタル変換器に供
    給するマルチプレクサと、前記アナログ／デジタル変換
    器からのデジタル値と予め設定された基準値を比較演算
    するとともにその比較演算結果をフィードバック値に加
    算して出力値を得る演算部と、この演算部から出力され
    る各モニタ電圧に対応した演算出力をそれぞれラッチす
    るとともにそのラッチした値をフィードバック値として
    前記演算部に供給する複数のラッチ回路と、基準クロッ
    クをカウントする基準カウンタと、予め設定された周波
    数基準値及び前記各ラッチ回路のラッチした値並びに前
    記基準カウンタのカウント値により前記各スイッチング
    手段をスイッチング動作させるデューティ比を制御する
    出力制御手段を設けたことを特徴とする高圧電源制御装
    置。
  2. （２）演算部は演算結果から得られる出力値が所定の範
    囲内に無いときエラー信号を出力することを特徴とする
    請求項（１）記載の高圧電源制御装置。
  3. （３）請求項（１）記載の高圧電源制御装置において、
    アナログ／デジタル変換器からのデジタル値を判断し、
    そのデジタル値が所定の範囲内に無いときエラー信号を
    出力する手段を設けたことを特徴とする高圧電源制御装
    置。
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