JPH0496329A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0496329A JPH0496329A JP21468090A JP21468090A JPH0496329A JP H0496329 A JPH0496329 A JP H0496329A JP 21468090 A JP21468090 A JP 21468090A JP 21468090 A JP21468090 A JP 21468090A JP H0496329 A JPH0496329 A JP H0496329A
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Landscapes
- Drying Of Semiconductors (AREA)
- Cleaning Or Drying Semiconductors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、臭素を含むガスを用いて半導体素子をドラ
イエツチングする半導体装置の製造方法に関する。
イエツチングする半導体装置の製造方法に関する。
半導体装置を微細加J4、例えば、ゲート電極を加工す
る場合、臭素系ガスを用いたプラズマエツチングが使用
される場合がある。臭素系ガスを用いた場合、エツチン
グ終了後に酸素プラズマによるアッシングを行っても残
渣が発生ずる場合が多い。半導体基板上の残渣は非常に
除去することが困難であり、その発生原因と17では半
導体基板の温度に強く依存(2、例えば半導体基板を冷
却1.たときに発生1.やすいことが知られでいる(特
開昭6l−110726)。
る場合、臭素系ガスを用いたプラズマエツチングが使用
される場合がある。臭素系ガスを用いた場合、エツチン
グ終了後に酸素プラズマによるアッシングを行っても残
渣が発生ずる場合が多い。半導体基板上の残渣は非常に
除去することが困難であり、その発生原因と17では半
導体基板の温度に強く依存(2、例えば半導体基板を冷
却1.たときに発生1.やすいことが知られでいる(特
開昭6l−110726)。
残渣を除去する半導体K ’IKの製造方法と1−で、
緩衝沸酸液(BHF)を用いて除去する方法、あるいは
02/CF4ガスにjSリダウンフローアッシングを用
いて除去する方法が、ナカムラ氏等により Varia
ble Pro口1e poly−SIEi、ehin
g vit、hLow Te5perat、ure R
IE and HBr gas と題する論文(pp
、5g−60)で1988年のドライプロセスシンポジ
ウムに報告されている。
緩衝沸酸液(BHF)を用いて除去する方法、あるいは
02/CF4ガスにjSリダウンフローアッシングを用
いて除去する方法が、ナカムラ氏等により Varia
ble Pro口1e poly−SIEi、ehin
g vit、hLow Te5perat、ure R
IE and HBr gas と題する論文(pp
、5g−60)で1988年のドライプロセスシンポジ
ウムに報告されている。
また、この残渣が発生しないような条件出しが平成2年
春季応用物理学会(28p−ZF−3)に報告されてい
る。
春季応用物理学会(28p−ZF−3)に報告されてい
る。
しかし、前述した緩衝沸酸液を用いて除去する方法は、
ゲート電極を加工する場合にゲート酸化膜やLOGO8
の膜減りや消失が起こる。これらがひどくなると、ゲー
トのバーズビーク(bird’5beak)が増大した
り、ソース領域やドレイン領域にイオンを注入して高濃
度不純物領域を形成する時、フィールド部の突き抜けが
問題になる。その為、この方法の使用は最小限度に抑え
る必要があり、十分に残渣を除去することができないと
いう欠点があった。
ゲート電極を加工する場合にゲート酸化膜やLOGO8
の膜減りや消失が起こる。これらがひどくなると、ゲー
トのバーズビーク(bird’5beak)が増大した
り、ソース領域やドレイン領域にイオンを注入して高濃
度不純物領域を形成する時、フィールド部の突き抜けが
問題になる。その為、この方法の使用は最小限度に抑え
る必要があり、十分に残渣を除去することができないと
いう欠点があった。
また、02/CF4を用いたダウンフローアッシングに
よる方法は、ポリシリコンがエツチングされる為、同様
に使用上の限度があり、十分に残渣を除去することがで
きなかった。
よる方法は、ポリシリコンがエツチングされる為、同様
に使用上の限度があり、十分に残渣を除去することがで
きなかった。
さらに、残渣が発生しないようなエツチングの条件出し
をする方法は、エツチング中の側壁保護膜の効果が十分
でなく、垂直な側面の形状を得るためのプロセスマージ
ンが小さくなるという欠点があった。この場合、非破壊
で残渣が残っているかどうかの判断をすることが容易で
はなく、エツチング後には確実にこれらの残渣が除去で
きる処理が必要であった。
をする方法は、エツチング中の側壁保護膜の効果が十分
でなく、垂直な側面の形状を得るためのプロセスマージ
ンが小さくなるという欠点があった。この場合、非破壊
で残渣が残っているかどうかの判断をすることが容易で
はなく、エツチング後には確実にこれらの残渣が除去で
きる処理が必要であった。
そこで、本発明は確実に残渣を除去できる半導体装置の
製造方法を提供することを目的とする。
製造方法を提供することを目的とする。
本発明者は従来の欠点を解決する為に、■般の半導体装
置製造プロセスでは使用されない特殊な装置や薬液を使
用しないこと、■ 長時間の処理でもエツチングなどの
問題が生じず、残渣除去効果を十分に得るのにマージン
があること、という観点から、臭素系ガスを用いて半導
体素子をドライエツチングした後、a)硫酸過酸化水素
水による洗浄、b)塩酸過酸化水素水による洗浄、C)
アンモニア過酸化水素水による洗浄、d)有機溶剤によ
る超音波洗浄、e)現像液処理を試みた。その結果、ア
ンモニア過酸化水素水による洗浄で十分な残渣除去効果
が得られることを発見した。また、過酸化水素を含まな
いアンモニア水では残渣除去の効果は低いが、さらに加
熱すれば、残渣除去効果が大きくなることが分った。
置製造プロセスでは使用されない特殊な装置や薬液を使
用しないこと、■ 長時間の処理でもエツチングなどの
問題が生じず、残渣除去効果を十分に得るのにマージン
があること、という観点から、臭素系ガスを用いて半導
体素子をドライエツチングした後、a)硫酸過酸化水素
水による洗浄、b)塩酸過酸化水素水による洗浄、C)
アンモニア過酸化水素水による洗浄、d)有機溶剤によ
る超音波洗浄、e)現像液処理を試みた。その結果、ア
ンモニア過酸化水素水による洗浄で十分な残渣除去効果
が得られることを発見した。また、過酸化水素を含まな
いアンモニア水では残渣除去の効果は低いが、さらに加
熱すれば、残渣除去効果が大きくなることが分った。
したがって、本発明に係る半導体装置の製造方法は半導
体素子をドライエツチングした後で、アンモニア過酸化
水素水を用いて上記半導体素子を洗浄することを特徴と
する。
体素子をドライエツチングした後で、アンモニア過酸化
水素水を用いて上記半導体素子を洗浄することを特徴と
する。
この場合、アンモニア過酸化水素水の温度を60℃乃至
90℃にすると効果的である。
90℃にすると効果的である。
本発明に係る半導体装置の製造方法は、以上のように構
成されているので、アンモニア過酸化水素水によりエツ
チング後の残渣は効果的に除去される。
成されているので、アンモニア過酸化水素水によりエツ
チング後の残渣は効果的に除去される。
また、アンモニア過酸化水素水の使用温度を90℃以上
にすると、アンモニア過酸化水素水から02が激しく発
生し、薬液のへたりが非常に早くなる。また、60℃未
満にすると、アンモニア過酸化水素水が新しくても、や
や残渣除去効果が劣る。
にすると、アンモニア過酸化水素水から02が激しく発
生し、薬液のへたりが非常に早くなる。また、60℃未
満にすると、アンモニア過酸化水素水が新しくても、や
や残渣除去効果が劣る。
以下、本発明の一実施例に係る半導体装置の製造方法を
添附図面に基づき説明する。なお、説明において同一要
素には同一符号を使用し、重複する説明は省略する。
添附図面に基づき説明する。なお、説明において同一要
素には同一符号を使用し、重複する説明は省略する。
第1図は本発明に係る半導体装置の製造方法を示す縦断
面図である。Si基板1の上にはゲート酸化膜2が形成
されており、この上に高濃度n型多結晶Si膜3が形成
されている。
面図である。Si基板1の上にはゲート酸化膜2が形成
されており、この上に高濃度n型多結晶Si膜3が形成
されている。
まず、高濃度n型多結晶Si膜3上に形成されたレジス
トパターン4を用いて、HBrによりドライエツチング
しく同図(a)) 、このドライエツチング後にアッシ
ング処理している。その後、60℃〜90℃のアンモニ
ア過酸化水素水を用いて上記高濃度n型多結晶S1膜1
を洗浄する。ドライエツチング後のアッシング処理では
残渣5が残るが、本発明に係る方法を適用した場合、残
渣5は確実になくなる(同図(C)参照)。この場合、
この洗浄処理により高濃度n型多結晶Si膜はほとんど
エツチングされない。
トパターン4を用いて、HBrによりドライエツチング
しく同図(a)) 、このドライエツチング後にアッシ
ング処理している。その後、60℃〜90℃のアンモニ
ア過酸化水素水を用いて上記高濃度n型多結晶S1膜1
を洗浄する。ドライエツチング後のアッシング処理では
残渣5が残るが、本発明に係る方法を適用した場合、残
渣5は確実になくなる(同図(C)参照)。この場合、
この洗浄処理により高濃度n型多結晶Si膜はほとんど
エツチングされない。
第2図はアンモニア過酸化水素水とアンモニア水の残渣
除去効果を比較1.た実験結果である。
除去効果を比較1.た実験結果である。
この実験では、14 B rを用いて上面に1ノジスト
パターンが形成された高濃度に1型多結晶Si膜1をト
ライエツチング12、その後、アンモニア過酸化水素水
又はアンモニア水で洗浄lまた時の残渣残り状況を洗浄
液の使用温度毎に示すものである。
パターンが形成された高濃度に1型多結晶Si膜1をト
ライエツチング12、その後、アンモニア過酸化水素水
又はアンモニア水で洗浄lまた時の残渣残り状況を洗浄
液の使用温度毎に示すものである。
こ1−では、洗浄処理前にアッシング処理を施1.てお
り、高濃度n型多結晶Si膜1は平坦面に450nm形
成17.20%のオーバエツチングが施されている。O
印は10分の洗浄処理によりSEM観察の1ノベルで残
渣を除去できたことを表オー)1、=、X印は残渣が残
った状態を示す。アンモニア過酸化水素水を用いて処理
する場合、アンモニア水による洗浄j″り広い温度範囲
で使用できることがわかる。
り、高濃度n型多結晶Si膜1は平坦面に450nm形
成17.20%のオーバエツチングが施されている。O
印は10分の洗浄処理によりSEM観察の1ノベルで残
渣を除去できたことを表オー)1、=、X印は残渣が残
った状態を示す。アンモニア過酸化水素水を用いて処理
する場合、アンモニア水による洗浄j″り広い温度範囲
で使用できることがわかる。
第3図は本発明の第1一実施例に係る通常のゲト電極を
加工する時の処理例を示す。この場合、臭素系ガスを用
いたドライエツチング(ステップ101)の後で、アッ
シング処理(ステップ]02)を介1.てアンモニア過
酸化水素水を用いて処理するが(ステップ103)、そ
の後、一般にピラニア洗浄と呼ばれる、硫酸過酸化水素
水を用いた洗浄を行ってもよい(ステップ〕04)。
加工する時の処理例を示す。この場合、臭素系ガスを用
いたドライエツチング(ステップ101)の後で、アッ
シング処理(ステップ]02)を介1.てアンモニア過
酸化水素水を用いて処理するが(ステップ103)、そ
の後、一般にピラニア洗浄と呼ばれる、硫酸過酸化水素
水を用いた洗浄を行ってもよい(ステップ〕04)。
このピラニア洗浄は、アンモニア過酸化水素水により剥
離されたIノジストパーティクルを除去する点で効果的
である。
離されたIノジストパーティクルを除去する点で効果的
である。
第4図は本発明の第2実施例に係る長時間のドライエツ
チングを行った時の処理例を示す。こ、の実施例はアッ
シング処理の前に、アンモニア過酸化水素水を用いて処
理する点(ステップ202)で第1実施例とは異なる。
チングを行った時の処理例を示す。こ、の実施例はアッ
シング処理の前に、アンモニア過酸化水素水を用いて処
理する点(ステップ202)で第1実施例とは異なる。
このように、アッシング前にアンモニア過酸化水素水を
用いた洗浄処理を施すことにより1、酸素のみのアッシ
ングによって全くレジストが剥離できない8八には有用
である。
用いた洗浄処理を施すことにより1、酸素のみのアッシ
ングによって全くレジストが剥離できない8八には有用
である。
17か17、この洗浄処理(ステップ202)が長くな
ると、レジストが侵され、剥離されたレジストが洗浄槽
に浮き、パーティクルを大量に発生ずる。イーの後、同
(〜洗浄槽でピラニア洗浄を行えば1/シストに起因す
るこれらのパーティクルは除去されるか、これらの処理
には時間かかかる。その為、このアッシング前の洗浄処
理は短くし、アッシングにより1ノジストの大部分の剥
離が可能になる程度の最小限度に1−2でおき、アッシ
ング後に前述した同様の処理をすることが望ましい。こ
のような上程をとると工程数は増えるが、高スルーブツ
ト、低パーティクルが実現できる。以」二のような処理
を行−)t−後は、洗浄、酸化、その他の通常の処理を
行えばよい。
ると、レジストが侵され、剥離されたレジストが洗浄槽
に浮き、パーティクルを大量に発生ずる。イーの後、同
(〜洗浄槽でピラニア洗浄を行えば1/シストに起因す
るこれらのパーティクルは除去されるか、これらの処理
には時間かかかる。その為、このアッシング前の洗浄処
理は短くし、アッシングにより1ノジストの大部分の剥
離が可能になる程度の最小限度に1−2でおき、アッシ
ング後に前述した同様の処理をすることが望ましい。こ
のような上程をとると工程数は増えるが、高スルーブツ
ト、低パーティクルが実現できる。以」二のような処理
を行−)t−後は、洗浄、酸化、その他の通常の処理を
行えばよい。
なお、本発明は上、記実施例に限定されるものではない
。例んば、この実施例では多結晶Si膜を用いているが
、材料はSiに限定されない。
。例んば、この実施例では多結晶Si膜を用いているが
、材料はSiに限定されない。
本発明は、以−ト説明したように構成されているので、
半導体素子をトライエツチングして半導体装置を製造す
る際、ドライエツチングにより発生する残渣を効率良く
除去できる。
半導体素子をトライエツチングして半導体装置を製造す
る際、ドライエツチングにより発生する残渣を効率良く
除去できる。
第1図は本発明に係る半導体装置の製造方法におけるエ
ツチング後の残渣除去処理を示す縦断面図、第2図は本
発明と従来例を比較12.た実験結果を示す図、第3図
は本発明の第1実施例に係る半導体装置の製造方法を示
す工程図、第4図は本発明の第2実施例に係る半導体装
置の製造方法を示す工程図である。 1・・・81基板、2・・・ゲート酸化膜、3・・・高
濃度【】型多結晶Si膜、4・・・1ノジス!・パター
ン、5・・残渣。
ツチング後の残渣除去処理を示す縦断面図、第2図は本
発明と従来例を比較12.た実験結果を示す図、第3図
は本発明の第1実施例に係る半導体装置の製造方法を示
す工程図、第4図は本発明の第2実施例に係る半導体装
置の製造方法を示す工程図である。 1・・・81基板、2・・・ゲート酸化膜、3・・・高
濃度【】型多結晶Si膜、4・・・1ノジス!・パター
ン、5・・残渣。
Claims (1)
- 【特許請求の範囲】 1、臭素を含むガスを用いて半導体素子をドライエッチ
ング加工する半導体装置の製造方法において、 前記ドライエッチング加工の後に、アンモニア過酸化水
素水を用いて前記半導体素子を洗浄することを特徴とす
る半導体装置の製造方法。 2、前記アンモニア過酸化水素水が、60℃乃至90℃
であることを特徴とする請求項1記載の半導体装置の製
造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2214680A JP2807069B2 (ja) | 1990-08-14 | 1990-08-14 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2214680A JP2807069B2 (ja) | 1990-08-14 | 1990-08-14 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0496329A true JPH0496329A (ja) | 1992-03-27 |
| JP2807069B2 JP2807069B2 (ja) | 1998-09-30 |
Family
ID=16659805
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2214680A Expired - Fee Related JP2807069B2 (ja) | 1990-08-14 | 1990-08-14 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2807069B2 (ja) |
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| US6446641B2 (en) | 2000-06-22 | 2002-09-10 | Mitsubishi Denki Kabushiki Kaisha | Method of manufacturing semiconductor device, and semiconductor device manufactured thereby |
| JP2007207791A (ja) * | 2006-01-31 | 2007-08-16 | Fujitsu Ltd | 半導体装置の製造方法 |
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| JPS60117717A (ja) * | 1983-11-30 | 1985-06-25 | Nec Corp | 半導体装置の製造方法 |
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-
1990
- 1990-08-14 JP JP2214680A patent/JP2807069B2/ja not_active Expired - Fee Related
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