JPH05235491A - 薄膜回路基板とその製造方法 - Google Patents

薄膜回路基板とその製造方法

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Abstract

(57)【要約】 【目的】 絶縁層に配設された導電層の周囲に低誘電率
絶縁体によって覆うように形成される薄膜回路基板とそ
の製造方法に関し、導電層と絶縁層との間に所定のサイ
ズのアンダーカット部の形成が確実に行われるようにす
ることを目的とする。 【構成】 導電層が配設される絶縁層をエッチングレイ
トの異なる第1の層と、第2の層とによって形成し、該
第2の層の上面に該第1の層が積層され、所定の厚みに
形成された該第1の層の上面に該導電層が積層される該
絶縁層をエッチング処理することで該導電層と、該絶縁
層との間に該導電層の周囲を低誘電率絶縁体によって覆
うことが可能なアンダーカット部の形成を行うように構
成する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、絶縁層に配設された導
電層の周囲に低誘電率絶縁体によって覆うように形成さ
れる薄膜回路基板とその製造方法に関する。
【0002】近年、大型コンピュータなどの電子装置の
高速化に伴い、これらの電子装置に使用される回路基板
に於ける導電層の信号伝播速度を高速にすることが行わ
れている。
【0003】このような回路基板に於ける導電層の信号
伝播速度は、その導電層を保持する絶縁層の誘電率の影
響を受けるので、信号伝播速度の高速化を図るためには
絶縁層を誘電率の低い絶縁体によって形成されることが
望ましい。
【0004】
【従来の技術】従来は図5の従来の説明図に示すように
構成されていた。図5の(a) は側面断面図,(b1) 〜(b5)
は製造工程図である。
【0005】図5の(a) に示すように、薄膜回路基板9
は、グランドパターン12と13との間に形成された絶縁層
10,11 に信号を伝播する薄膜による導電層1 を配設する
ことで形成され、また、導電層1 の外周には低誘電率絶
縁体5 を設けることで導電層1 の誘電率を極力小さくす
ることが行われていた。
【0006】また、このような薄膜回路基板9 を形成す
る場合は、図5の(b1)に示すように、先づ、グランドパ
ターン12に積層されたポリイミド材より成る絶縁層10の
上層10A に所定のパターンニングされた、例えば、厚み
数μm のアルミまたは銅などの良導電材より成る導電層
1 を形成し、絶縁層10をエッチング処理することで、図
5の(b2)に示すように、導電層1 と絶縁層10の上面10A
との間に幅H1、深さH2のアンダカット部6 の形成を行
う。
【0007】次に、図5の(b3)に示すように、導電層1
の周囲にテフロンなどの低誘電率絶縁体5 のコーティン
グを行い、低誘電率絶縁体5 のコーティングが行われた
導電層1 を図5の(b4)に示すように、ポリイミド材の絶
縁層11によって覆うよう積層を行う。
【0008】最後に、図5の(b5)に示すように、絶縁層
11の上面11A にグランドパターン13の形成を行うことで
薄膜回路基板9 の形成が行われていた。したがって、導
電層1 の周囲をほぼ低誘電率絶縁体5 によって覆うこと
で、導電層1 の誘電率を極力小さくすることが行われて
いた。
【0009】
【発明が解決しようとする課題】しかし、このような絶
縁層10をエッチング処理することで導電層1 と絶縁層10
の上面10A との間に形成するアンダカット部6 は、実際
には、図5の(b2)に示す深さH2の方向はエッチング処理
の時間を長くすることで大きくすることが可能である
が、幅H1の方向は、限界があり、エッチング処理の時間
を長くしても大きくすることはできない。
【0010】したがって、単にエッチング処理すること
では、幅H1の値が小さくなり、低誘電率絶縁体5 によっ
て導電層1 を覆う面積が少なくなり、実際には、導電層
1 の誘電率の低下が減少し、信号伝播速度の高速化が減
少する問題を有していた。
【0011】そこで、本発明では、導電層と絶縁層との
間に所定のサイズのアンダーカット部の形成を確実に行
うようにすることを目的とする。
【0012】
【課題を解決するための手段】図1は本第1の発明の原
理説明図であり、図2は本第2の発明の原理説明図であ
り、図1の(a)(b)に示すように、導電層1 が配設される
絶縁層2 をエッチングレイトの異なる第1の層3 と、第
2の層4 とによって形成し、該第2の層4 の上面4Aに該
第1の層3 が積層され、所定の厚みT に形成された該第
1の層3 の上面3Aに該導電層1 が積層される該絶縁層2
をエッチング処理することで該導電層1と、該絶縁層2
との間に該導電層1 の周囲を低誘電率絶縁体5 によって
覆うことが可能なアンダーカット部6 の形成を行うよう
に、また、前記第1の層3 がエッチングレイトの高いカ
プトン系ポリイミド材によって形成され、前記第2の層
4が該エッチングレイトの低い低熱膨張のポリイミド材
によって形成されるように、または、図2の(a)(b)に示
すように、導電層1 が上面7Aに配設される絶縁層7に耐
熱性有し、かつ、エッチング液に溶け難いバリヤ層8 を
形成し、該バリヤ層8 を該上面7Aから所定距離S となる
箇所に位置させ、該絶縁層7 をエッチング処理すること
で該導電層1 と、該絶縁層7 との間に該導電層1 の周囲
を低誘電率絶縁体5 によって覆うことが可能なアンダー
カット部6 の形成を行うように、また、前記バリヤ層8
が二酸化ケイ素SiO2によって形成されるように構成す
る。
【0013】このように構成することによって前述の課
題は解決される。
【0014】
【作用】即ち、第1の発明では、絶縁層2 をエッチング
レイトの高いカプトン系ポリイミド材より成る第1の層
3 と、エッチングレイトの低い低熱膨張のポリイミド材
より成る第2の層4 とによって形成し、エッチング処理
することで導電層1 を配設した第1層3 の上面3Aの溶解
が容易に行われ、導電層1 と第1層3 の上面3Aとの間に
所定のサイズのアンダカット部6 の形成が確実に行われ
るようにしたものであり、また、第2の発明では、絶縁
層7 の所定箇所には耐熱性有し、かつ、エッチング液に
溶け難い二酸化ケイ素SiO2より成るバリア層8 を形成
し、エッチング処理することで導電層1 を配設した絶縁
層7 の上面7Aの溶解がバリア層8 に達した時、その溶解
の進行が前述のH1方向に進行することになり、導電層1
と第1層3 の上面3Aとの間に所定のサイズのアンダカッ
ト部6 の形成が確実に行われるようにしたものである。
【0015】いずれの場合でも、エッチング処理するこ
とで形成されるアンダカット部6 のH1方向の進行を大き
くすることができ、所定のサイズのアンダカット部6 の
形成が行え、低誘電率絶縁体5 によって覆われる面積の
拡大により、導電層1 に於ける信号伝播速度の高速化を
図ることができる。
【0016】
【実施例】以下本発明を図3および図4を参考に詳細に
説明する。図3の(a) 〜(c) は本第1の発明による一実
施例の製造工程図, 図4の(a) 〜(c) は本第2の発明に
よる一実施例の製造工程図である。全図を通じて、同一
符号は同一対象物を示す。
【0017】第1の発明の場合は、図3の(a) に示すよ
うに、導電層1 を配設する絶縁層2を、エッチングレイ
トの高いカプトン系ポリイミド材より成る所定の厚みT
の第1の層3 と、エッチングレイトの低い低熱膨張のポ
リイミド材よりなる第2の層4 とによって形成し、第1
の層3 の上面3Aに導電層1 が、第2の層4 の上面4Aに第
1の層3 がそれぞれ積層されるようにしたものである。
【0018】そこで、絶縁層2 をエッチングを行うこと
で、図3の(b) に示すように、エッチング液による溶解
が第1の層3 の厚みT が除去される位置まで達した時
は、導電層1 と絶縁層2 との間には幅H1, 深さH2のサイ
ズとなるアンダカット部6 の形成が行われる。
【0019】この場合のアンダカット部6 のサイズは幅
H1の方向の溶解速度が遅いため、深さH2に比較して小さ
くなる。しかし、更に、エッチングによる絶縁層2 の溶
解を進行させと、図3の(c) に示すように、溶解の進行
が第1の層3 の点線で示す厚みT を超える時は、第2の
層4 のエッチングレイトに比較して第1の層3 のエッチ
ングレイトが高いため、第1の層3 の溶解が進行するこ
とでアンダカット部6 のサイズに於いては、幅H1が増加
しH11 となる。
【0020】したがって、アンダカット部6 の幅をH11
になることで、低誘電率絶縁層5 によって導電層1 を覆
う場合、導電層1 の周囲を広い範囲で覆うことができ、
導電層1 に於ける誘電率をより低くすることが行える。
【0021】実際には、第1の層3 を形成するカブトン
系ポリイミド材としては下記示す化学構造式によって構
成されたものを用い。
【0022】
【化1】 第2の層3 を形成する低熱膨張のポリイミド材としては
下記に示す化学構造式によって構成されたものを用い。
【0023】
【化2】 エッチング液としてはヒドラジン・エチレンジアミン混
合液N2H4・C2H8N2を用いることで良好なアンダカット部
6の形成を行うことが確認できた。
【0024】また、第2の発明の場合は、図4の(a) に
示すように、導電層1 を配設する絶縁層7 には約1 μm
の厚みのエッチング液に溶け難い部材より成るバリア層
8 を設け、絶縁層7 の上面7Aに導電層1 を配設し、ま
た、バリア層8 は上面7Aから所定距離S の箇所に位置す
るようにしたものである。
【0025】そこで、絶縁層7 をエッチングを行うこと
で、図4の(b) に示すように、エッチング液により絶縁
層7 が溶解され、パリア層8 が露出位置まで達した時
は、導電層1 と絶縁層7 との間には幅H1, 深さS のサイ
ズとなるアンダカット部6 の形成が行われる。
【0026】この場合のアンダカット部6 のサイズは幅
H1の方向の溶解速度が遅いため、深さS に比較して小さ
くなる。しかし、更に、エッチングによる絶縁層7 の溶
解を進行させると、図4の(c)に示すように、バリア層8
の上層側の絶縁層7 の溶解が進行することでアンダカ
ット部6 のサイズが幅H1が増加しH11 となり、大きくす
ることが行える。
【0027】したがって、前述の場合と同様に、低誘電
率絶縁層5 によって導電層1 を覆う場合、導電層1 の周
囲を広い範囲で覆うことができ、導電層1 に於ける誘電
率をより低くすることが行える。
【0028】また、この場合のバリア層8 の材質として
は、耐熱性有し、かつ、エッチング液に溶け難く、しか
も絶縁材であることが望ましいので、例えば、二酸化ケ
イ素SiO2によって形成すると良い。
【0029】
【発明の効果】以上説明したように、本発明によれば、
エックング処理することで絶縁層と導電層との間に所定
のサイズのアンダカット部の形成を行うことができ、導
電層をの周囲を低誘電率絶縁体によって覆う面積の拡大
させることができる。
【0030】したがって、導電層に於ける誘電率を低く
することができ、信号伝播速度の高速化が図れ、実用的
効果は大である。
【図面の簡単な説明】
【図1】 本第1の発明の原理説明図
【図2】 本第2の発明の原理説明図
【図3】 本第1の発明による一実施例の製造工程図
【図4】 本第2の発明による一実施例の製造工程図
【図5】 従来の説明図
【符号の説明】
1 導電層 2,7 絶縁層 3 第1の層 4 第2の層 5 低誘電率絶縁体 6 アンダカット部 8 バリア層

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 導電層(1) が配設される絶縁層(2) をエ
    ッチングレイトの異なる第1の層(3) と、第2の層(4)
    とによって形成し、該第2の層(4) の上面(4A)に該第1
    の層(3) が積層され、所定の厚み(T) に形成された該第
    1の層(3) の上面(3A)に該導電層(1) が積層されること
    を特徴とする薄膜回路基板。
  2. 【請求項2】 請求項1記載の前記第1の層(3) がエチ
    ングレイトの高いカプトン系ポリイミド材によって形成
    され、前記第2の層(4) がエッチングレイトの低い低熱
    膨張のポリイミド材によって形成されることを特徴とす
    る薄膜回路基板。
  3. 【請求項3】 請求項1記載の前記絶縁層(2) をエッチ
    ング処理することで前記導電層(1) と、該絶縁層(2) と
    の間に該導電層(1) の周囲を低誘電率絶縁体(5) によっ
    て覆うことが可能なアンダーカット部(6) の形成を行う
    ことを特徴とする薄膜回路基板の製造方法。
  4. 【請求項4】 導電層(1) が上面(7A)に配設される絶縁
    層(7) に耐熱性有し、かつ、エッチング液に溶け難い所
    定の厚みのバリヤ層(8) が形成され、該バリヤ層(8) が
    該上面(7A)から所定距離(S) となる箇所に位置されるこ
    とを特徴とする薄膜回路基板。
  5. 【請求項5】 請求項4記載の前記バリヤ層(8) が二酸
    化ケイ素SiO2によって形成されることを特徴とする薄膜
    回路基板。
  6. 【請求項6】 請求項4記載の前記該絶縁層(7) をエッ
    チング処理することで前記導電層(1) と、該絶縁層(7)
    との間に該導電層(1) の周囲を低誘電率絶縁体(5) によ
    って覆うことが可能なアンダーカット部(6) の形成を行
    うことを特徴とする薄膜回路基板の製造方法。
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