JPH0527891B2 - - Google Patents
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- JPH0527891B2 JPH0527891B2 JP60138699A JP13869985A JPH0527891B2 JP H0527891 B2 JPH0527891 B2 JP H0527891B2 JP 60138699 A JP60138699 A JP 60138699A JP 13869985 A JP13869985 A JP 13869985A JP H0527891 B2 JPH0527891 B2 JP H0527891B2
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- G06F21/78—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure storage of data
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- A63F—CARD, BOARD, OR ROULETTE GAMES; INDOOR GAMES USING SMALL MOVING PLAYING BODIES; VIDEO GAMES; GAMES NOT OTHERWISE PROVIDED FOR
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- A63F13/90—Constructional details or arrangements of video game devices not provided for in groups A63F13/20 or A63F13/25, e.g. housing, wiring, connections or cabinets
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- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/10—Protecting distributed programs or content, e.g. vending or licensing of copyrighted material ; Digital rights management [DRM]
- G06F21/12—Protecting executable software
- G06F21/121—Restricting unauthorised execution of programs
- G06F21/123—Restricting unauthorised execution of programs by using dedicated hardware, e.g. dongles, smart cards, cryptographic processors, global positioning systems [GPS] devices
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- H05K5/00—Casings, cabinets or drawers for electric apparatus
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- H05K5/0256—Details of interchangeable modules or receptacles therefor, e.g. cartridge mechanisms
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- A63F2300/20—Features of games using an electronically generated display having two or more dimensions, e.g. on a television screen, showing representations related to the game characterised by details of the game platform
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Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、外部記憶装置のソフトウエア管理
システムに関し、特に、外部記憶装置に記憶され
たソフトウエアの真偽を管理するシステムに関す
る。
システムに関し、特に、外部記憶装置に記憶され
たソフトウエアの真偽を管理するシステムに関す
る。
［先行技術の説明］
従来、情報処理装置本体に対して外部記憶装置
を装着し、この外部記憶装置に記憶されたソフト
ウエアを情報処理装置本体で実行させているよう
な情報処理システムが種々提案されている。本願
出願人もこのような情報処理システムとして、情
報処理装置本体をテレビジヨン受像機と接続する
ことによりテレビジヨン受像機の画面上で種々の
ゲームを楽しむことができ、またその他の目的に
も使用できるような家庭用ビデオゲーム装置を開
発し製品化している（商品名フアミリーコンピユ
ータ）。
を装着し、この外部記憶装置に記憶されたソフト
ウエアを情報処理装置本体で実行させているよう
な情報処理システムが種々提案されている。本願
出願人もこのような情報処理システムとして、情
報処理装置本体をテレビジヨン受像機と接続する
ことによりテレビジヨン受像機の画面上で種々の
ゲームを楽しむことができ、またその他の目的に
も使用できるような家庭用ビデオゲーム装置を開
発し製品化している（商品名フアミリーコンピユ
ータ）。
ところで、上記のような情報処理システムで
は、ユーザが市販されている複数種類のソフトウ
エアの中から所望のものを購入して情報処理装置
本体に装着することにより、種々のソフトウエア
が利用できるような構成となつている。しかしな
がら、市販されているソフトウエアの中には、品
質が劣悪なものもあり、そのような粗悪品が大量
に販売されると、情報処理システム自体の商品イ
メージが低下してしまい市場性が失われてしまう
ことになる。そのため、優れた情報処理システム
を開発したものは、それに使用されるソフトウエ
アの品質について管理する必要があつた。
は、ユーザが市販されている複数種類のソフトウ
エアの中から所望のものを購入して情報処理装置
本体に装着することにより、種々のソフトウエア
が利用できるような構成となつている。しかしな
がら、市販されているソフトウエアの中には、品
質が劣悪なものもあり、そのような粗悪品が大量
に販売されると、情報処理システム自体の商品イ
メージが低下してしまい市場性が失われてしまう
ことになる。そのため、優れた情報処理システム
を開発したものは、それに使用されるソフトウエ
アの品質について管理する必要があつた。
また、従来の情報処理システムは、外部記憶装
置のプログラムが不正に複製されたものでもオリ
ジナルなものと同様に使用できるという問題があ
つた。
置のプログラムが不正に複製されたものでもオリ
ジナルなものと同様に使用できるという問題があ
つた。
［発明が解決しようとする問題点］
しかしながら、従来は、上記のようなソフトウ
エアの品質を管理するための有効な手段はなく、
他人によるソフトウエアの販売は全く野放しの状
態であつた。そのため、多大な経費と労力をかけ
て優れた情報処理システムを開発しても、他人に
よつて粗悪なソフトウエアが乱売されれば、商品
価値の低下により大きな損害を被ることとなると
いう問題があつた。このことは、逆に、消費者に
対して品質の低いソフトウエアを提供することに
なり、社会的見地からも好ましくない。
エアの品質を管理するための有効な手段はなく、
他人によるソフトウエアの販売は全く野放しの状
態であつた。そのため、多大な経費と労力をかけ
て優れた情報処理システムを開発しても、他人に
よつて粗悪なソフトウエアが乱売されれば、商品
価値の低下により大きな損害を被ることとなると
いう問題があつた。このことは、逆に、消費者に
対して品質の低いソフトウエアを提供することに
なり、社会的見地からも好ましくない。
また、不正に複製された模倣品を使用できれ
ば、模倣品の氾濫を招き、長期間かけてオリジナ
ルの外部記憶装置のプログラムを開発したものの
利益が著しく害される。
ば、模倣品の氾濫を招き、長期間かけてオリジナ
ルの外部記憶装置のプログラムを開発したものの
利益が著しく害される。
この発明は、上記のような問題点を解消するた
めになされたもので、情報処理装置本体に装着さ
れる外部記憶装置の真偽を判別でき、それによつ
て使用されるソフトウエアを管理し、不正にプロ
グラムを複製した外部記憶装置の使用を排除し得
る外部記憶装置のソフトウエア管理システムを提
供することを目的とする。
めになされたもので、情報処理装置本体に装着さ
れる外部記憶装置の真偽を判別でき、それによつ
て使用されるソフトウエアを管理し、不正にプロ
グラムを複製した外部記憶装置の使用を排除し得
る外部記憶装置のソフトウエア管理システムを提
供することを目的とする。
［問題点を解決するための手段］
この発明は、要約すれば、情報処理装置本体
と、この情報処理装置本体に対して着脱自在に構
成された外部記憶装置とを含む。上記外部記憶装
置は、所望の情報処理のためのプログラムを記憶
する記憶装置と、当該外部記憶装置の真偽判別の
ための所定の動作を行なう第１の能動素子とを含
む。上記情報処理装置本体は、外部記憶装置の記
憶装置に記憶されたプログラムに基づいて所望の
情報処理を実行する中央処理手段と、この中央処
理手段による上記記憶装置上のプログラム実行開
始に先立つて、第１の能動素子と協働して外部記
憶装置の真偽判別のための所定の動作を行なう第
２の能動素子とを含む。
と、この情報処理装置本体に対して着脱自在に構
成された外部記憶装置とを含む。上記外部記憶装
置は、所望の情報処理のためのプログラムを記憶
する記憶装置と、当該外部記憶装置の真偽判別の
ための所定の動作を行なう第１の能動素子とを含
む。上記情報処理装置本体は、外部記憶装置の記
憶装置に記憶されたプログラムに基づいて所望の
情報処理を実行する中央処理手段と、この中央処
理手段による上記記憶装置上のプログラム実行開
始に先立つて、第１の能動素子と協働して外部記
憶装置の真偽判別のための所定の動作を行なう第
２の能動素子とを含む。
［作用］
第２の能動素子は、第１の能動素子の動作状態
が予め定める状態であることに応答して、情報処
理装置本体の中央処理手段の動作を能動化させ、
それによつて正規または真性の外部記憶装置のみ
を使用可能とする。
が予め定める状態であることに応答して、情報処
理装置本体の中央処理手段の動作を能動化させ、
それによつて正規または真性の外部記憶装置のみ
を使用可能とする。
［実施例］
第２図はビデオゲーム装置に適用されたこの発
明の一実施例を示す外観斜視図である。図におい
て、情報処理装置本体（以下、単に「本体」と称
す）１には、外部機器としてのゲームコントロー
ラ３ａおよび３ｂと、CRT表示器４とが接続さ
れる。また、本体１は外部記憶装置としての
ROMカートリツジ２（またはROMカセツト２）
が着脱自在な構成とされる。ROMカートリツジ
２には、ゲーム実行のために必要なソフトウエア
ないしプログラムが格納されている。
明の一実施例を示す外観斜視図である。図におい
て、情報処理装置本体（以下、単に「本体」と称
す）１には、外部機器としてのゲームコントロー
ラ３ａおよび３ｂと、CRT表示器４とが接続さ
れる。また、本体１は外部記憶装置としての
ROMカートリツジ２（またはROMカセツト２）
が着脱自在な構成とされる。ROMカートリツジ
２には、ゲーム実行のために必要なソフトウエア
ないしプログラムが格納されている。
第３図は第２図に示す実施例の電気回路部分を
示す概略ブロツク図である。まず、本体１の構成
について説明する。接続コネクタ１１には、
CPU１２と、VDC（ビデオデイスプレイコントロ
ーラ）１３と、能動素子１４と、クロツク発振器
（以下、単に発振器と称す）１５とが接続される。
接続コネクタ１１は、本体１にROMカートリツ
ジ２が装着されたとき、ROMカートリツジ２の
接続コネクタ２１と結合され、それによつて本体
１の内部回路とROMカートリツジ２の内部回路
との電気的接続を図る。中央処理手段としての
CPU１２は、本体１の動作を制御するためのも
のである。VDC１３は、CRT表示器４の表示動
作を制御するためのものである。能動素子１４
は、後述するROMカートリツジ２の能動素子２
４と協働して、本体１に装着されたROMカート
リツジ２の真偽を判別するためのものである。発
振器１５の発振出力はクロツク信号として能動素
子１４に与えられる。また、発振器１５の発振出
力は、本体１にROMカートリツジ２が装着され
たとき、ROMカートリツジ２の能動素子２４に
クロツク信号として与えられる。能動素子１４に
は、リセツトスイツチRSが接続される。CPU１
２には、外部機器との接続を図るためのＩ／Ｏイ
ンターフエイス１６が接続される。この実施例で
は、外部機器としてゲームコントローラ３ａおよ
び３ｂと、CRT表示器４とがＩ／Ｏインターフ
エイス１６に接続される。なお、Ｉ／Ｏインター
フエイス１６に接続される外部機器は第３図のも
のに限らず種々のものが接続可能である。
示す概略ブロツク図である。まず、本体１の構成
について説明する。接続コネクタ１１には、
CPU１２と、VDC（ビデオデイスプレイコントロ
ーラ）１３と、能動素子１４と、クロツク発振器
（以下、単に発振器と称す）１５とが接続される。
接続コネクタ１１は、本体１にROMカートリツ
ジ２が装着されたとき、ROMカートリツジ２の
接続コネクタ２１と結合され、それによつて本体
１の内部回路とROMカートリツジ２の内部回路
との電気的接続を図る。中央処理手段としての
CPU１２は、本体１の動作を制御するためのも
のである。VDC１３は、CRT表示器４の表示動
作を制御するためのものである。能動素子１４
は、後述するROMカートリツジ２の能動素子２
４と協働して、本体１に装着されたROMカート
リツジ２の真偽を判別するためのものである。発
振器１５の発振出力はクロツク信号として能動素
子１４に与えられる。また、発振器１５の発振出
力は、本体１にROMカートリツジ２が装着され
たとき、ROMカートリツジ２の能動素子２４に
クロツク信号として与えられる。能動素子１４に
は、リセツトスイツチRSが接続される。CPU１
２には、外部機器との接続を図るためのＩ／Ｏイ
ンターフエイス１６が接続される。この実施例で
は、外部機器としてゲームコントローラ３ａおよ
び３ｂと、CRT表示器４とがＩ／Ｏインターフ
エイス１６に接続される。なお、Ｉ／Ｏインター
フエイス１６に接続される外部機器は第３図のも
のに限らず種々のものが接続可能である。
次に、ROMカートリツジ２の構成について説
明する。接続コネクタ２１には、プログラム
ROM２２と、キヤラクタROM２３と、能動素
子２４とが接続される。プログラムROM２２
は、本体１で実行されるプログラムすなわちソフ
トウエアが格納される。この実施例は、ビデオゲ
ーム装置に適用されているため、プログラム
ROM２２には、ゲームのためのソフトウエアが
格納されている。キヤラクタROM２３は、CRT
表示器４に表示させる種々のキヤラクタに関する
情報が格納されている。能動素子２４は、ROM
カートリツジ２が本体１に装着されたとき、本体
側の能動素子１４と協働してROMカートリツジ
２の真偽の判別を行なう。
明する。接続コネクタ２１には、プログラム
ROM２２と、キヤラクタROM２３と、能動素
子２４とが接続される。プログラムROM２２
は、本体１で実行されるプログラムすなわちソフ
トウエアが格納される。この実施例は、ビデオゲ
ーム装置に適用されているため、プログラム
ROM２２には、ゲームのためのソフトウエアが
格納されている。キヤラクタROM２３は、CRT
表示器４に表示させる種々のキヤラクタに関する
情報が格納されている。能動素子２４は、ROM
カートリツジ２が本体１に装着されたとき、本体
側の能動素子１４と協働してROMカートリツジ
２の真偽の判別を行なう。
第４図は第３図に示す能動素子１４および２４
として、デイジタルICを用いた場合を示す概略
ブロツク図である。なお、この第４図では、説明
を簡単にするために、第３図の接続コネクタ１１
および２１は省略してある。前述のように、能動
素子１４および２４はそれぞれが協働してROM
カートリツジ２の真偽を判別するが、これら２つ
の能動素子機能はいわゆる錠と鍵の関係に譬える
ことができる。したがつて、ここでは、能動素子
１４に用いられるデイジタルICをロツク用ICと
称し、能動素子２４に用いられるデイジタルIC
をキー用ICと称する。ロツク用IC１４は或る端
子が接地され、キー用IC２４は或る端子が電源
ラインに接続される。これによつて、ロツク用
IC１４およびキー用IC２４は自己がロツクの役
目またはキーの役目のいずれであるかを判別する
ことができる。ロツク用IC１４およびキー用IC
２４はデータの入出力を行なうために、一方側の
データ出力端子が他方側のデータ入力端子に接続
される。また、ロツク用IC１４からはキー用IC
２４にリセツト信号が与えられる。また、ロツク
用IC１４およびキー用IC２４には、前述の発振
器１５からクロツク信号が与えられる。したがつ
て、ロツク用IC１４およびキー用IC２４はそれ
ぞれの動作周期および位相が完全に同期して動作
を行なうように構成されている。また、ロツク用
IC１４には、リセツトスイツチRSが接続される。
ロツク用IC１４は、このリセツトスイツチRSの
オンにより動作を開始するように構成されてい
る。さらに、ロツク用IC１４には、リセツトス
イツチRSと並列にリセツト用コンデンサCRが接
続される。このリセツト用コンデンサCRは、本
体１の電源（図示せず）オン時に充電されて所定
時間ロツク用IC１４をリセツト状態に保つ。ロ
ツク用IC１４は、このリセツト用コンデンサCR
によるリセツト（パワーオンクリア）によつても
動作を開始するように構成されている。ロツク用
IC１４からは、リセツト信号が出力される。こ
のリセツト信号は、第３図のCPU１２および
VDC１３に与えられる。
として、デイジタルICを用いた場合を示す概略
ブロツク図である。なお、この第４図では、説明
を簡単にするために、第３図の接続コネクタ１１
および２１は省略してある。前述のように、能動
素子１４および２４はそれぞれが協働してROM
カートリツジ２の真偽を判別するが、これら２つ
の能動素子機能はいわゆる錠と鍵の関係に譬える
ことができる。したがつて、ここでは、能動素子
１４に用いられるデイジタルICをロツク用ICと
称し、能動素子２４に用いられるデイジタルIC
をキー用ICと称する。ロツク用IC１４は或る端
子が接地され、キー用IC２４は或る端子が電源
ラインに接続される。これによつて、ロツク用
IC１４およびキー用IC２４は自己がロツクの役
目またはキーの役目のいずれであるかを判別する
ことができる。ロツク用IC１４およびキー用IC
２４はデータの入出力を行なうために、一方側の
データ出力端子が他方側のデータ入力端子に接続
される。また、ロツク用IC１４からはキー用IC
２４にリセツト信号が与えられる。また、ロツク
用IC１４およびキー用IC２４には、前述の発振
器１５からクロツク信号が与えられる。したがつ
て、ロツク用IC１４およびキー用IC２４はそれ
ぞれの動作周期および位相が完全に同期して動作
を行なうように構成されている。また、ロツク用
IC１４には、リセツトスイツチRSが接続される。
ロツク用IC１４は、このリセツトスイツチRSの
オンにより動作を開始するように構成されてい
る。さらに、ロツク用IC１４には、リセツトス
イツチRSと並列にリセツト用コンデンサCRが接
続される。このリセツト用コンデンサCRは、本
体１の電源（図示せず）オン時に充電されて所定
時間ロツク用IC１４をリセツト状態に保つ。ロ
ツク用IC１４は、このリセツト用コンデンサCR
によるリセツト（パワーオンクリア）によつても
動作を開始するように構成されている。ロツク用
IC１４からは、リセツト信号が出力される。こ
のリセツト信号は、第３図のCPU１２および
VDC１３に与えられる。
第５図は第４図に示すロツク用IC１４の詳細
を示すブロツク図である。図において、ロツク用
IC１４は、たとえば４ビツトのマイクロコンピ
ユータによつて構成される。すなわち、ロツク用
IC１４は、CPU１４１と、このCPU１４１の動
作プログラムを格納しているROM１４２と、
CPU１４１のデータ処理に必要な種々のデータ
を記憶するRAM１４３とを含む。また、CPU１
４１にはアキユムレータ１４４が接続される。一
方、ROM１４２にはレジスタ１４５が接続され
る。このレジスタ１４５は、ROM１４２から読
出されたプログラムデータを一時格納しておくた
めのものである。CPU１４１と、アキユムレー
タ１４４と、レジスタ１４５は、データバスDB
によつて接続される。このデータバスDBは、
Ｉ／Ｏポート１４７に接続される。このＩ／Ｏポ
ート１４７からは、キー用IC２４に向けてデー
タが出力され、またキー用IC２４からのデータ
を受ける。また、CPU１４１からは、Ｉ／Ｏポ
ート１４７を介して２つのリセツト信号が出力さ
れる。一方のリセツト信号は、キー用IC２４の
CPUに与えられる。他方のリセツト信号はCPU
１２およびVDC１３に与えられる。なお、キー
用IC２４も同様のリセツト信号を出力する端子
を有しているが、これらの端子はいずれの回路に
も接続されていない。さらに、ロツク用IC１４
には、前述の発振器１５から与えられるクロツク
信号CLKを分周するための分周器１４６が設け
られる。この分周器１４６の分周比は、たとえば
１／４に選ばれている。
を示すブロツク図である。図において、ロツク用
IC１４は、たとえば４ビツトのマイクロコンピ
ユータによつて構成される。すなわち、ロツク用
IC１４は、CPU１４１と、このCPU１４１の動
作プログラムを格納しているROM１４２と、
CPU１４１のデータ処理に必要な種々のデータ
を記憶するRAM１４３とを含む。また、CPU１
４１にはアキユムレータ１４４が接続される。一
方、ROM１４２にはレジスタ１４５が接続され
る。このレジスタ１４５は、ROM１４２から読
出されたプログラムデータを一時格納しておくた
めのものである。CPU１４１と、アキユムレー
タ１４４と、レジスタ１４５は、データバスDB
によつて接続される。このデータバスDBは、
Ｉ／Ｏポート１４７に接続される。このＩ／Ｏポ
ート１４７からは、キー用IC２４に向けてデー
タが出力され、またキー用IC２４からのデータ
を受ける。また、CPU１４１からは、Ｉ／Ｏポ
ート１４７を介して２つのリセツト信号が出力さ
れる。一方のリセツト信号は、キー用IC２４の
CPUに与えられる。他方のリセツト信号はCPU
１２およびVDC１３に与えられる。なお、キー
用IC２４も同様のリセツト信号を出力する端子
を有しているが、これらの端子はいずれの回路に
も接続されていない。さらに、ロツク用IC１４
には、前述の発振器１５から与えられるクロツク
信号CLKを分周するための分周器１４６が設け
られる。この分周器１４６の分周比は、たとえば
１／４に選ばれている。
なお、キー用IC２４もロツク用IC１４と全く
同様に構成されるので、その詳細を省略するが、
以下の説明ではロツク用IC１４の各部と対応す
る部分は第５図の括弧書に示す符号をつけて説明
する。
同様に構成されるので、その詳細を省略するが、
以下の説明ではロツク用IC１４の各部と対応す
る部分は第５図の括弧書に示す符号をつけて説明
する。
ここで、第６図のタイムチヤートを参照して、
分周器１４６の動作について簡単に説明する。上
述のように、分周器１４６は発振器１５からのク
ロツク信号CLKを１／４の分周比で分周するが、
その結果位相の異なる４つのクロツク信号φ１，
φ２，φ３およびφ４を発生する。これらクロツ
ク信号φ１〜φ４は、CPU１４１に与えられる。
CPU１４１は、これら４つのクロツク信号φ１
〜φ４に同期して、順次所定の動作を行なう。た
とえば、クロツク信号φ１でデータの読込を行な
い、φ２およびφ３で所定の演算処理等を行な
う。そして、クロツク信号φ４でデータの出力を
行なう。キー用IC２４のCPU２４１にも上述と
同様のクロツク信号φ１〜φ４が与えられてお
り、ロツク用IC１４のCPU１４１と完全に同期
して動作を実行する。すなわち、ロツク用IC１
４とキー用IC２４は、動作プログラムのステツ
プ数およびアーキテクチユアが同一であり、しか
もハード回路のクロツク信号も全く同様であるた
め、それぞれのマシンサイクルも完全に一致して
いる。
分周器１４６の動作について簡単に説明する。上
述のように、分周器１４６は発振器１５からのク
ロツク信号CLKを１／４の分周比で分周するが、
その結果位相の異なる４つのクロツク信号φ１，
φ２，φ３およびφ４を発生する。これらクロツ
ク信号φ１〜φ４は、CPU１４１に与えられる。
CPU１４１は、これら４つのクロツク信号φ１
〜φ４に同期して、順次所定の動作を行なう。た
とえば、クロツク信号φ１でデータの読込を行な
い、φ２およびφ３で所定の演算処理等を行な
う。そして、クロツク信号φ４でデータの出力を
行なう。キー用IC２４のCPU２４１にも上述と
同様のクロツク信号φ１〜φ４が与えられてお
り、ロツク用IC１４のCPU１４１と完全に同期
して動作を実行する。すなわち、ロツク用IC１
４とキー用IC２４は、動作プログラムのステツ
プ数およびアーキテクチユアが同一であり、しか
もハード回路のクロツク信号も全く同様であるた
め、それぞれのマシンサイクルも完全に一致して
いる。
なお、上述の実施例では、能動素子１４および
２４としてデイジタルICを用いているが、これ
らのデイジタルICに代えてアナログ的処理を行
なうアナログプロセツサを用いてもよい。また、
能動素子１４および２４のいずれか一方にアナロ
グ回路を用いていずれか他方にデイジタル回路を
用いてもよい。さらに、アナログ的処理を行なう
回路としては、アナログプロセツサ以外にも種々
の回路を用いることができる。この場合は、上記
のようなデイジタル演算処理に代えて、周波数変
換やデユーテイ比の変換や積分あるいは微分演算
等のアナログ処理を行ない、能動素子１４と２４
との間でその一致を判別するようにすればよい。
２４としてデイジタルICを用いているが、これ
らのデイジタルICに代えてアナログ的処理を行
なうアナログプロセツサを用いてもよい。また、
能動素子１４および２４のいずれか一方にアナロ
グ回路を用いていずれか他方にデイジタル回路を
用いてもよい。さらに、アナログ的処理を行なう
回路としては、アナログプロセツサ以外にも種々
の回路を用いることができる。この場合は、上記
のようなデイジタル演算処理に代えて、周波数変
換やデユーテイ比の変換や積分あるいは微分演算
等のアナログ処理を行ない、能動素子１４と２４
との間でその一致を判別するようにすればよい。
第１図は上記実施例におけるロツク用IC１４
およびキー用IC２４の基本的な動作を示すフロ
ーチヤートである。以下、この第１図を参照して
上記実施例の基本的な動作を説明する。なお、具
体的な動作の説明については、第７図を参照して
後に述べる。まず、ROMカートリツジ２が本体
１に装着されて本体１の電源（図示せず）がオン
されると、動作を開始する（ステツプS1）。続い
て、ロツク用IC１４が本体１の種々の機器
（CPU１２、VDC１３等）をリセツトし、その状
態を保持する（ステツプS2）。これによつて、本
体１はゲームの実行が行なえない状態となつてい
る。次に、ロツク用IC１４とキー用IC２４との
同期が取られる（ステツプS3）。このときの同期
のとり方について第６図を参照して説明する。ロ
ツク用IC１４からキー用IC２４に与えられるリ
セツト信号は、クロツク信号CLKの或る周期の
クロツク信号φ４と次の周期のクロツク信号φ１
との間で出力されるようにロツク用IC１４のマ
シンサイクルが設定されている。そのため、キー
用IC２４には、必ずクロツク信号φ１からクロ
ツク信号が入力されることになる。したがつて、
キー用IC２４はロツク用IC１４と全く同一のマ
シンサイクルから動作を開始することになる。こ
れによつて、ロツク用IC１４とキー用IC２４と
の同期がとられ、以後完全に同期した状態でそれ
ぞれが動作を行なう。
およびキー用IC２４の基本的な動作を示すフロ
ーチヤートである。以下、この第１図を参照して
上記実施例の基本的な動作を説明する。なお、具
体的な動作の説明については、第７図を参照して
後に述べる。まず、ROMカートリツジ２が本体
１に装着されて本体１の電源（図示せず）がオン
されると、動作を開始する（ステツプS1）。続い
て、ロツク用IC１４が本体１の種々の機器
（CPU１２、VDC１３等）をリセツトし、その状
態を保持する（ステツプS2）。これによつて、本
体１はゲームの実行が行なえない状態となつてい
る。次に、ロツク用IC１４とキー用IC２４との
同期が取られる（ステツプS3）。このときの同期
のとり方について第６図を参照して説明する。ロ
ツク用IC１４からキー用IC２４に与えられるリ
セツト信号は、クロツク信号CLKの或る周期の
クロツク信号φ４と次の周期のクロツク信号φ１
との間で出力されるようにロツク用IC１４のマ
シンサイクルが設定されている。そのため、キー
用IC２４には、必ずクロツク信号φ１からクロ
ツク信号が入力されることになる。したがつて、
キー用IC２４はロツク用IC１４と全く同一のマ
シンサイクルから動作を開始することになる。こ
れによつて、ロツク用IC１４とキー用IC２４と
の同期がとられ、以後完全に同期した状態でそれ
ぞれが動作を行なう。
次に、ロツク用IC１４およびキー用IC２４は、
それぞれが完全に同期した状態で所定の演算処理
を行なう（ステツプS4、S4′）。このとき、ロツ
ク用IC１４で行なわれる演算処理とキー用IC２
４で行なわれる演算処理とは同じものである。し
たがつて、もしROMカートリツジ２が正規のも
のであれば、ステツプS4およびステツプS4′で行
なわれる演算の結果と同じものとなる。次に、ロ
ツク用IC１４とキー用IC２４との間で演算結果
の交信が行なわれる（ステツプS5）。続いて、ロ
ツク用IC１４およびキー用IC２４は、自己が行
なつた演算の結果と、相手方が行なつた演算の結
果とを照合しそれぞれが一致するか否かを判断す
る（ステツプS6）。上述のように、ROMカート
リツジ２が正規のものであれば、この演算結果は
一致するはずであるから、一致しない場合は
ROMカートリツジ２が正規のものでないと判断
され、本体１のリセツトが解除されない（ステツ
プS7）。したがつて、本体１ではゲームの実行が
行なわれない。一方、ロツク用IC１４の演算結
果とキー用IC２４の演算結果とが一致した場合
は、本体１のCPU１２やVDC１３等のリセツト
が解除される（ステツプS8）。これによつて、本
体１のCPU１２はROMカートリツジ２のROM
２２に記憶されたゲームプログラムの実行を開始
する。
それぞれが完全に同期した状態で所定の演算処理
を行なう（ステツプS4、S4′）。このとき、ロツ
ク用IC１４で行なわれる演算処理とキー用IC２
４で行なわれる演算処理とは同じものである。し
たがつて、もしROMカートリツジ２が正規のも
のであれば、ステツプS4およびステツプS4′で行
なわれる演算の結果と同じものとなる。次に、ロ
ツク用IC１４とキー用IC２４との間で演算結果
の交信が行なわれる（ステツプS5）。続いて、ロ
ツク用IC１４およびキー用IC２４は、自己が行
なつた演算の結果と、相手方が行なつた演算の結
果とを照合しそれぞれが一致するか否かを判断す
る（ステツプS6）。上述のように、ROMカート
リツジ２が正規のものであれば、この演算結果は
一致するはずであるから、一致しない場合は
ROMカートリツジ２が正規のものでないと判断
され、本体１のリセツトが解除されない（ステツ
プS7）。したがつて、本体１ではゲームの実行が
行なわれない。一方、ロツク用IC１４の演算結
果とキー用IC２４の演算結果とが一致した場合
は、本体１のCPU１２やVDC１３等のリセツト
が解除される（ステツプS8）。これによつて、本
体１のCPU１２はROMカートリツジ２のROM
２２に記憶されたゲームプログラムの実行を開始
する。
第７図は上記実施例のさらに詳しい動作を説明
するためのフローチヤートである。以下、この第
７図を参照して、上記実施例の詳細な動作を説明
する。ROMカートリツジ２が本体１に装着され
て、本体１の電源（図示せず）がオンされるかま
たはリセツトスイツチRSがオンされると、ロツ
ク用IC１４のリセツト動作が行なわれ、ロツク
用IC１４は動作を開始する（ステツプS10）。続
いて、ステツプS11に進み、ロツク用IC１４は自
己がロツク用ICかキー用ICかを判断する。この
判断は、第４図で説明したように、或る端子が接
地されているかあるいは電源ラインに接続されて
いるかを判別することによつて行なわれる。この
場合、ロツク用ICと判断されるはずであるが、
たとえば配線ミスや動作不良等によつてキー用
ICと判断された場合は、不安定な状態となり何
の動作も行なわれない。ロツク用ICと判断され
た場合は、ステツプS12に進み、本体１がゲーム
プログラムを実行しないように各回路にリセツト
をかける。すなわち、CPU１２やVDC１３がリ
セツトされる。また、このステツプS12では、キ
ー用IC２４をリセツトする。次に、ステツプS13
に進み、ロツク用IC１４はキー用IC２４のリセ
ツトを解除し、ロツク用ICとの同期をとる。こ
のステツプS13の動作は、第１図のステツプS3に
対応し、その詳細な動作は第１図において説明し
たのでここでは省略する。
するためのフローチヤートである。以下、この第
７図を参照して、上記実施例の詳細な動作を説明
する。ROMカートリツジ２が本体１に装着され
て、本体１の電源（図示せず）がオンされるかま
たはリセツトスイツチRSがオンされると、ロツ
ク用IC１４のリセツト動作が行なわれ、ロツク
用IC１４は動作を開始する（ステツプS10）。続
いて、ステツプS11に進み、ロツク用IC１４は自
己がロツク用ICかキー用ICかを判断する。この
判断は、第４図で説明したように、或る端子が接
地されているかあるいは電源ラインに接続されて
いるかを判別することによつて行なわれる。この
場合、ロツク用ICと判断されるはずであるが、
たとえば配線ミスや動作不良等によつてキー用
ICと判断された場合は、不安定な状態となり何
の動作も行なわれない。ロツク用ICと判断され
た場合は、ステツプS12に進み、本体１がゲーム
プログラムを実行しないように各回路にリセツト
をかける。すなわち、CPU１２やVDC１３がリ
セツトされる。また、このステツプS12では、キ
ー用IC２４をリセツトする。次に、ステツプS13
に進み、ロツク用IC１４はキー用IC２４のリセ
ツトを解除し、ロツク用ICとの同期をとる。こ
のステツプS13の動作は、第１図のステツプS3に
対応し、その詳細な動作は第１図において説明し
たのでここでは省略する。
ステツプS13でキー用IC２４のリセツトが解除
されると、キー用IC２４は、自己がロツク用IC
かキー用ICかを判断する（ステツプS11′）。この
ステツプS11′の判断は、前述のステツプS11と同
様に、キー用IC２４の或る端子が接地されてい
るか電源ラインに接続されているかを判別するこ
とによつて行なわれる。このステツプS11′ではキ
ー用ICと判断されるはずであるが、配線ミスや
動作不良等によりロツク用ICと判断された場合
は、不安定な状態となり何の動作も行なわれな
い。一方、キー用ICと判断された場合は、ステ
ツプS14′以下の動作が実行される。これに対し、
ロツク用IC１４では、ステツプS13の動作の後、
ステツプS14以下の動作が実行される。以後、ロ
ツク用IC14およびキー用IC２４では、全く同様
の動作が同期して（時間軸が一致して）行なわれ
る。
されると、キー用IC２４は、自己がロツク用IC
かキー用ICかを判断する（ステツプS11′）。この
ステツプS11′の判断は、前述のステツプS11と同
様に、キー用IC２４の或る端子が接地されてい
るか電源ラインに接続されているかを判別するこ
とによつて行なわれる。このステツプS11′ではキ
ー用ICと判断されるはずであるが、配線ミスや
動作不良等によりロツク用ICと判断された場合
は、不安定な状態となり何の動作も行なわれな
い。一方、キー用ICと判断された場合は、ステ
ツプS14′以下の動作が実行される。これに対し、
ロツク用IC１４では、ステツプS13の動作の後、
ステツプS14以下の動作が実行される。以後、ロ
ツク用IC14およびキー用IC２４では、全く同様
の動作が同期して（時間軸が一致して）行なわれ
る。
まず、ロツク用IC１４およびキー用IC２４は、
乱数的に暗号符号を出力する（ステツプS14およ
びS14′）。この暗号符号の出力は全く同じランダ
ム関数を用いて行なわれる。そして、ランダム関
数に与えられる条件もロツク用IC１４とキー用
IC２４とで同じである。したがつて、ROMカー
トリツジ２が正規のものである場合は、ロツク用
IC１４で発生される暗号符号とキー用IC２４で
発生される暗号符号とは全く同一のものとなる。
次に、ロツク用IC１４およびキー用IC２４はデ
ータの交信を行ない、それぞれ相手方の発生した
暗号符号を入力する（ステツプS15およびS15′）。
続いて、相手方から入力した暗号符号に基づい
て、所定の演算処理を行なう（ステツプS16およ
びS16′）。この演算処理に用いられる演算式は、
ロツク用IC１４とキー用IC２４とで全く同一の
ため、入力される暗号符号が同一の場合はこの演
算結果も同一となる。次に、ロツク用IC１４お
よびキー用IC２４は演算の結果をそれぞれ相手
方のICに出力する（ステツプS17およびS17′）。
応じて、ロツク用IC１４およびキー用IC２４は
相手方から出力された演算結果を入力する（ステ
ツプS18およびS18′）。ここで、ロツク用IC１４
およびキー用IC２４は全く同じ動作を同期して
行なつているため、相手方のICから入力される
演算結果も同一のタイミングで入力されることに
なる。したがつて、この実施例では、演算結果の
一致のみならず、時間軸方向（すなわち実行して
いるステツプ番号）の一致も真偽判別のために考
慮していることになる。
乱数的に暗号符号を出力する（ステツプS14およ
びS14′）。この暗号符号の出力は全く同じランダ
ム関数を用いて行なわれる。そして、ランダム関
数に与えられる条件もロツク用IC１４とキー用
IC２４とで同じである。したがつて、ROMカー
トリツジ２が正規のものである場合は、ロツク用
IC１４で発生される暗号符号とキー用IC２４で
発生される暗号符号とは全く同一のものとなる。
次に、ロツク用IC１４およびキー用IC２４はデ
ータの交信を行ない、それぞれ相手方の発生した
暗号符号を入力する（ステツプS15およびS15′）。
続いて、相手方から入力した暗号符号に基づい
て、所定の演算処理を行なう（ステツプS16およ
びS16′）。この演算処理に用いられる演算式は、
ロツク用IC１４とキー用IC２４とで全く同一の
ため、入力される暗号符号が同一の場合はこの演
算結果も同一となる。次に、ロツク用IC１４お
よびキー用IC２４は演算の結果をそれぞれ相手
方のICに出力する（ステツプS17およびS17′）。
応じて、ロツク用IC１４およびキー用IC２４は
相手方から出力された演算結果を入力する（ステ
ツプS18およびS18′）。ここで、ロツク用IC１４
およびキー用IC２４は全く同じ動作を同期して
行なつているため、相手方のICから入力される
演算結果も同一のタイミングで入力されることに
なる。したがつて、この実施例では、演算結果の
一致のみならず、時間軸方向（すなわち実行して
いるステツプ番号）の一致も真偽判別のために考
慮していることになる。
次に、ロツク用IC１４は、キー用IC２４から
入力した演算結果と、自己が行なつた演算結果と
を照合し一致するか否かを判断する。この照合の
結果一致しないと判断された場合は、本体１の各
回路（CPU１２やVDC１３等）のリセツト状態
を保持する（ステツプS20）。これによつて、本
体１はゲームプログラムの実行が禁止される。な
お、このようなリセツト動作に替えて警報を発生
させるようにしてもよいし、または初期状態すな
わちステツプS11の戻るように制御してもよい。
一方、照合の結果両方の演算結果が一致したと判
断された場合は、CPU１２やVDC１３等のリセ
ツトを解除する（ステツプS21）。続いて、ロツ
ク用IC１４は所定のランダム関数に基づいて乱
数１および２を発生する（ステツプS22）。次に、
ロツク用IC１４は、上述の乱数２で演算式の種
類を選択し、乱数１および２をその選択された演
算式に代入する代入値としてセツトする（ステツ
プS23）。すなわち、この実施例では、ｎ（正の整
数）種類の演算式が予め設定されており、その中
から乱数２に対応する演算式が選択されるのであ
る。次に、選択された演算式に乱数１および２が
代入されてその演算が実行される（ステツプ
S24）。以上のステツプS19〜S24の動作は、キー
用IC２４においても全く同じタイミングで行な
われている。そして、乱数１および２を発生させ
るためのランダム関数もロツク用IC１４で用い
られるものと同じものが用いられる。さらに、乱
数１および２を発生させるとき、ランダム関数に
与えられる条件は、ロツク用IC１４とキー用IC
２４とで全く同一である。したがつて、演算式も
全く同じものが選択され、その結果も同一とな
る。次に、ロツク用IC１４はステツプS24の演算
結果をキー用IC２４に与えるとともに、キー用
IC２４で演算された結果を受取る（ステツプ
S25）。同様の動作がキー用IC２４でも行なわれ
る。次に、ロツク用IC１４はキー用IC２４から
受取つた演算結果と、自己の演算結果とを比較照
合し一致しているか否かを判断する。もし、本体
１に装着されたROMカートリツジ２が正規のも
のでない場合は、演算結果に不一致が生じるた
め、そのときはCPU１２の動作を停止させる
（ステツプS27）。一方、キー用IC２４から受取つ
た演算結果と自己の演算結果とが一致した場合
は、再びステツプS22の動作に戻り、以後ステツ
プS22〜S26の動作を繰返す。この動作の繰返し
の中で１回でも演算結果の不一致が生じた場合
は、ステツプS27でCPU１２の動作が停止され
る。これによつて、CPU１２はゲームプログラ
ムの実行が禁止される。なお、ステツプS26およ
びS27と同様の動作もキー用IC２４で行なわれて
いる。但し、キー用IC２４では、本体１の各回
路のリセツト、リセツト解除の動作については、
リセツト信号の出力先がないので、本体１の各回
路には何ら影響を与えない。
入力した演算結果と、自己が行なつた演算結果と
を照合し一致するか否かを判断する。この照合の
結果一致しないと判断された場合は、本体１の各
回路（CPU１２やVDC１３等）のリセツト状態
を保持する（ステツプS20）。これによつて、本
体１はゲームプログラムの実行が禁止される。な
お、このようなリセツト動作に替えて警報を発生
させるようにしてもよいし、または初期状態すな
わちステツプS11の戻るように制御してもよい。
一方、照合の結果両方の演算結果が一致したと判
断された場合は、CPU１２やVDC１３等のリセ
ツトを解除する（ステツプS21）。続いて、ロツ
ク用IC１４は所定のランダム関数に基づいて乱
数１および２を発生する（ステツプS22）。次に、
ロツク用IC１４は、上述の乱数２で演算式の種
類を選択し、乱数１および２をその選択された演
算式に代入する代入値としてセツトする（ステツ
プS23）。すなわち、この実施例では、ｎ（正の整
数）種類の演算式が予め設定されており、その中
から乱数２に対応する演算式が選択されるのであ
る。次に、選択された演算式に乱数１および２が
代入されてその演算が実行される（ステツプ
S24）。以上のステツプS19〜S24の動作は、キー
用IC２４においても全く同じタイミングで行な
われている。そして、乱数１および２を発生させ
るためのランダム関数もロツク用IC１４で用い
られるものと同じものが用いられる。さらに、乱
数１および２を発生させるとき、ランダム関数に
与えられる条件は、ロツク用IC１４とキー用IC
２４とで全く同一である。したがつて、演算式も
全く同じものが選択され、その結果も同一とな
る。次に、ロツク用IC１４はステツプS24の演算
結果をキー用IC２４に与えるとともに、キー用
IC２４で演算された結果を受取る（ステツプ
S25）。同様の動作がキー用IC２４でも行なわれ
る。次に、ロツク用IC１４はキー用IC２４から
受取つた演算結果と、自己の演算結果とを比較照
合し一致しているか否かを判断する。もし、本体
１に装着されたROMカートリツジ２が正規のも
のでない場合は、演算結果に不一致が生じるた
め、そのときはCPU１２の動作を停止させる
（ステツプS27）。一方、キー用IC２４から受取つ
た演算結果と自己の演算結果とが一致した場合
は、再びステツプS22の動作に戻り、以後ステツ
プS22〜S26の動作を繰返す。この動作の繰返し
の中で１回でも演算結果の不一致が生じた場合
は、ステツプS27でCPU１２の動作が停止され
る。これによつて、CPU１２はゲームプログラ
ムの実行が禁止される。なお、ステツプS26およ
びS27と同様の動作もキー用IC２４で行なわれて
いる。但し、キー用IC２４では、本体１の各回
路のリセツト、リセツト解除の動作については、
リセツト信号の出力先がないので、本体１の各回
路には何ら影響を与えない。
上述の実施例では、ステツプS19における演算
結果の照合動作だけでも十分な真偽判別が行なえ
るが、本体１が動作している限り常時ステツプ
S22〜S26で演算処理およびその結果の照合を行
なつているため、ほぼ完全な真偽判別が行なえ
る。したがつて、ROM２２およびROM２３の
プログラム内容をコピーしたもの、またはこれに
類似のプラグラムを記憶したROMを含むROM
カートリツジ２を不正販売しようとする場合は、
キー用IC２４と全く同一のハード回路を入手し
ない限り上記実施例のプロテクトを破ることは不
可能である。また、キー用IC２４に通常の規格
とは異なるカスタムメードのものを用いれば、コ
ストの面でこの実施例のプロテクトを破ることは
ほぼ完全に不可能となる。
結果の照合動作だけでも十分な真偽判別が行なえ
るが、本体１が動作している限り常時ステツプ
S22〜S26で演算処理およびその結果の照合を行
なつているため、ほぼ完全な真偽判別が行なえ
る。したがつて、ROM２２およびROM２３の
プログラム内容をコピーしたもの、またはこれに
類似のプラグラムを記憶したROMを含むROM
カートリツジ２を不正販売しようとする場合は、
キー用IC２４と全く同一のハード回路を入手し
ない限り上記実施例のプロテクトを破ることは不
可能である。また、キー用IC２４に通常の規格
とは異なるカスタムメードのものを用いれば、コ
ストの面でこの実施例のプロテクトを破ることは
ほぼ完全に不可能となる。
なお、上記実施例では、外部記憶装置として、
ROMカートリツジを用いているが、このような
ROMカートリツジに代えて、ICカードやフロツ
ピイデイスクや光メモリ等を用いてもよい。
ROMカートリツジを用いているが、このような
ROMカートリツジに代えて、ICカードやフロツ
ピイデイスクや光メモリ等を用いてもよい。
第８図は外部記憶装置としてフロツピイデイス
クを用いた場合を示す平面図である。図におい
て、フロツピイデイスク５は、周知のごとくケー
ス５１とこのケース５１内に回転自在に収納され
る円盤状磁気シート５２とを含む。そして、ケー
ス５１には、能動素子としてのキー用IC２４と、
このキー用IC２４と外部装置との接続を図るた
めにケース５１の表面に露出して形成されている
電極５３とが設けられる。このようなフロツピイ
デイスク５を受入れる本体１の内部には、第９図
に示すように、フロツピイデイスクドライバFD
と、電極５３と内部回路との接続を図るためのコ
ンタクトピン１７とが設けられる。
クを用いた場合を示す平面図である。図におい
て、フロツピイデイスク５は、周知のごとくケー
ス５１とこのケース５１内に回転自在に収納され
る円盤状磁気シート５２とを含む。そして、ケー
ス５１には、能動素子としてのキー用IC２４と、
このキー用IC２４と外部装置との接続を図るた
めにケース５１の表面に露出して形成されている
電極５３とが設けられる。このようなフロツピイ
デイスク５を受入れる本体１の内部には、第９図
に示すように、フロツピイデイスクドライバFD
と、電極５３と内部回路との接続を図るためのコ
ンタクトピン１７とが設けられる。
なお、第２図の実施例では、本体１はフロツピ
イデイスク５を直接接着し得るようには構成され
ていないので、第１０図に示すような構成として
もよい。すなわち、ROMカートリツジ２と同形
状を有し、本体１に対して着脱自在に構成された
接続アダプタ２′を設け、この接続アダプタ２′に
フロツピイデイスク読取装置６を接続する。そし
て、このフロツピイデイスク接続装置６に第８図
に示すようなフロツピイデイスク５を装着するよ
うにすればよい。この場合、フロツピイデイスク
読取装置６内には、本体１内に設けられたロツク
用IC１４と全く同様のロツク用ICを設け、ROM
カセツト２に代えてフロツピイデイスク５を用い
る場合はフロツピイデイスク読取装置６内のロツ
ク用ICで本体１の内部回路のリセツトまたはリ
セツト解除を制御するようにすればよい。また、
フロツピイデイスク読取装置６内にロツク用IC
を設けずに、本体１に内蔵されたロツク用IC１
４とフロツピイデイスク５に設けられたキー用
IC２４とで真偽判別を行なうようにすることも
できる。
イデイスク５を直接接着し得るようには構成され
ていないので、第１０図に示すような構成として
もよい。すなわち、ROMカートリツジ２と同形
状を有し、本体１に対して着脱自在に構成された
接続アダプタ２′を設け、この接続アダプタ２′に
フロツピイデイスク読取装置６を接続する。そし
て、このフロツピイデイスク接続装置６に第８図
に示すようなフロツピイデイスク５を装着するよ
うにすればよい。この場合、フロツピイデイスク
読取装置６内には、本体１内に設けられたロツク
用IC１４と全く同様のロツク用ICを設け、ROM
カセツト２に代えてフロツピイデイスク５を用い
る場合はフロツピイデイスク読取装置６内のロツ
ク用ICで本体１の内部回路のリセツトまたはリ
セツト解除を制御するようにすればよい。また、
フロツピイデイスク読取装置６内にロツク用IC
を設けずに、本体１に内蔵されたロツク用IC１
４とフロツピイデイスク５に設けられたキー用
IC２４とで真偽判別を行なうようにすることも
できる。
なお、第１０図において、接続アダプタ２′に
接続される装置自身に記憶手段を含むような場合
（たとえばシンセサイジ用ROMを含む音源装置
等を接続した場合）においては、接続アダプタ
２′内にキー用IC２４を設け、このキー用IC２４
と本体１に内蔵されたロツク用IC１４とで協働
して外部記憶装置の真偽判別を行なうようにすれ
ばよい。
接続される装置自身に記憶手段を含むような場合
（たとえばシンセサイジ用ROMを含む音源装置
等を接続した場合）においては、接続アダプタ
２′内にキー用IC２４を設け、このキー用IC２４
と本体１に内蔵されたロツク用IC１４とで協働
して外部記憶装置の真偽判別を行なうようにすれ
ばよい。
なお、以上説明した実施例では、この発明を家
庭用ビデオゲーム装置に適用したものについて示
したが、この発明は家庭用ビデオゲーム装置に限
らず業務用ビデオゲーム装置あるいはその他種々
の用途で利用されるコンピユータシステム等にも
適用することができる。
庭用ビデオゲーム装置に適用したものについて示
したが、この発明は家庭用ビデオゲーム装置に限
らず業務用ビデオゲーム装置あるいはその他種々
の用途で利用されるコンピユータシステム等にも
適用することができる。
また、以上説明した実施例では、外部記憶装置
としてのROMカートリツジ２の真偽判別を４ビ
ツトマイクロコンピユータを用いてソフト処理で
行なうようにしたが、このようなソフト処理と同
等の機能を有するハード回路を設けてハード処理
によつて真偽判別を行なうようにしてもよい。
としてのROMカートリツジ２の真偽判別を４ビ
ツトマイクロコンピユータを用いてソフト処理で
行なうようにしたが、このようなソフト処理と同
等の機能を有するハード回路を設けてハード処理
によつて真偽判別を行なうようにしてもよい。
［発明の効果］
以上のように、この発明によれば、情報処理装
置本体に装着される外部記憶装置の真偽を判別し
てその判別結果に基づいて情報処理装置本体の内
部回路の動作の許否を決するように構成されてい
るので、正規でない外部記憶装置は確実に排除す
ることができ、その結果粗悪なソフトウエアおよ
び不正にソフトウエアを模倣した外部記憶装置が
市場に氾濫するのを未然に防止することができ
る。したがつて、情報処理装置本体の商品価値が
損なわれることなく、また正当な外部記憶装置の
ソフトウエア開発者の利益保護ができ、また消費
者に対して品質の粗悪なソフトウエアが提供され
ることを間接的に防止することができる。
置本体に装着される外部記憶装置の真偽を判別し
てその判別結果に基づいて情報処理装置本体の内
部回路の動作の許否を決するように構成されてい
るので、正規でない外部記憶装置は確実に排除す
ることができ、その結果粗悪なソフトウエアおよ
び不正にソフトウエアを模倣した外部記憶装置が
市場に氾濫するのを未然に防止することができ
る。したがつて、情報処理装置本体の商品価値が
損なわれることなく、また正当な外部記憶装置の
ソフトウエア開発者の利益保護ができ、また消費
者に対して品質の粗悪なソフトウエアが提供され
ることを間接的に防止することができる。
第１図はこの発明の一実施例の基本的な動作を
示すフローチヤートである。第２図はビデオゲー
ム装置に適用された場合のこの発明の一実施例を
示す外観斜視図である。第３図は第２図に示す実
施例の電気回路部分を示す概略ブロツク図であ
る。第４図は第３図に示す能動素子１４および２
４としてデイジタルICを用いた場合の構成を示
す概略ブロツク図である。第５図は第４図に示す
ロツク用IC１４の詳細を示すブロツク図である。
第６図は第５図に示す分周器１４６の動作を説明
するためのタイムチヤートである。第７図はこの
発明の一実施例の詳細な動作を示すフローチヤー
トである。第８図は外部記憶装置として用いられ
るフロツピイデイスクを示す平面図である。第９
図は第８図に示すフロツピイデイクを受入れる本
体の内部構造を簡単に示す図である。第１０図は
フロツピイデイスクを外部装置として用いる場合
の一例を示す外観斜視図である。 図において、１は本体、２はROMカートリツ
ジ、５はフロツピイデイスク、６はフロツピイデ
イスク読取装置、２′は接続アダプタ、１４およ
び２４は能動素子、１２はCPU、１３はVDC、
１５は発振器、２２はプログラムROM、２３は
キヤラクタROMを示す。
示すフローチヤートである。第２図はビデオゲー
ム装置に適用された場合のこの発明の一実施例を
示す外観斜視図である。第３図は第２図に示す実
施例の電気回路部分を示す概略ブロツク図であ
る。第４図は第３図に示す能動素子１４および２
４としてデイジタルICを用いた場合の構成を示
す概略ブロツク図である。第５図は第４図に示す
ロツク用IC１４の詳細を示すブロツク図である。
第６図は第５図に示す分周器１４６の動作を説明
するためのタイムチヤートである。第７図はこの
発明の一実施例の詳細な動作を示すフローチヤー
トである。第８図は外部記憶装置として用いられ
るフロツピイデイスクを示す平面図である。第９
図は第８図に示すフロツピイデイクを受入れる本
体の内部構造を簡単に示す図である。第１０図は
フロツピイデイスクを外部装置として用いる場合
の一例を示す外観斜視図である。 図において、１は本体、２はROMカートリツ
ジ、５はフロツピイデイスク、６はフロツピイデ
イスク読取装置、２′は接続アダプタ、１４およ
び２４は能動素子、１２はCPU、１３はVDC、
１５は発振器、２２はプログラムROM、２３は
キヤラクタROMを示す。
Claims (1)
- 【特許請求の範囲】 １ 情報処理装置本体と、この情報処理装置本体
に対して着脱自在に構成された外部記憶装置とか
らなる情報処理システムにおいて、前記外部記憶
装置のソフトウエアの真偽を管理するシステムで
あつて、 前記外部記憶装置は、 所望の処理のためのプログラムを記憶する記憶
装置、および 当該外部記憶装置の真偽判別のための所定の動
作を行なう第１の能動素子を備え、 前記情報処理装置本体は、 前記記憶装置に記憶されたプログラムに基づい
て所望の情報処理を実行する中央処理手段、およ
び 前記中央処理手段による前記記憶装置上のプロ
グラム実行開始に先立つて、前記第１の能動素子
と協働して前記外部記憶装置の真偽判別のための
所定の動作を行なう第２の能動素子を備え、 前記第２の能動素子の動作状態と前記第１の能
動素子の動作状態とに基づいて、前記中央処理手
段の動作の許否を決定する制御手段を含む、外部
記憶装置のソフトウエア管理システム。 ２ 前記第１および第２の能動素子は、同じ能動
素子を含む、特許請求の範囲第１項記載の外部記
憶装置のソフトウエア管理システム。 ３ 前記制御手段は、前記第２の能動素子の動作
状態と前記第１の能動素子の動作状態が予め定め
る状態でないことに応答して前記中央処理手段を
不能動化する手段を含む、特許請求の範囲第１項
記載の外部記憶装置のソフトウエア管理システ
ム。 ４ 前記制御手段は、前記第２の能動素子の動作
状態と前記第１の能動素子の動作状態が予め定め
る状態であることに応答して前記中央処理手段を
能動化する手段を含む、特許請求の範囲第１項記
載の外部記憶装置のソフトウエア管理システム。 ５ 前記第２の能動素子と前記第１の能動素子
は、前記外部記憶装置の真偽判別を繰返し行う手
段を含み、かつ 前記制御手段は、前記第２の能動素子の動作状
態と前記第１の能動素子の動作状態が予め定める
状態を持続することに応答して前記中央処理手段
の能動化状態を継続する手段を含む、特許請求の
範囲第４項記載の外部記憶装置のソフトウエア管
理システム。 ６ 前記第１および第２の能動素子は、それぞれ
デイジタル処理手段を含み、 前記制御手段は、第１および第２のデイジタル
処理手段による処理の結果が所定の関係にあるか
否かを判断する判断手段を含む、特許請求の範囲
第１項記載の外部記憶装置のソフトウエア管理シ
ステム。 ７ 前記第１および第２のデイジタル処理手段
は、処理プログラムを含むプログラム手段を含
み、前記プログラム手段からのプログラムに基づ
いて真偽判別のためのデイジタル処理を実行する
ことを特徴とする、特許請求の範囲第６項記載の
外部記憶装置のソフトウエア管理システム。 ８ 前記第１および第２のデイジタル処理手段
は、同じデイジタル処理手段を含み、 前記プログラム手段は、前記第１および第２の
デイジタル処理手段に同じ処理プログラムを与
え、 前記判断手段は、前記処理の結果が一致してい
るかどうかを判断するための手段を含む、特許請
求の範囲第７項記載の外部記憶装置のソフトウエ
ア管理システム。 ９ 前記プログラム手段は、前記第１のデイジタ
ル処理手段のための処理プログラムを含む第１の
半導体メモリ、および前記第２のデイジタル処理
手段のための処理プログラムを含む第２の半導体
メモリを含む、特許請求の範囲第７項記載の外部
記憶装置のソフトウエア管理システム。 １０ 前記プログラム手段は、前記第１および第
２のデイジタル処理手段に同じクロツクを与える
ためのクロツク手段を含み、 前記判断手段は、前記第１および第２のデイジ
タル処理手段による処理の時系列の一致を判断す
るための手段を含む、特許請求の範囲第９項記載
の外部記憶装置のソフトウエア管理システム。 １１ 前記第１および第２の半導体メモリは、そ
れぞれ異なる第１および第２の処理プログラムを
含み、 前記判断手段は、前記第１および第２のデイジ
タル処理手段のそれぞれ前記第１および第２の半
導体メモリからのプログラムに基づいて第１およ
び第２の処理を実行し、さらに前記第１および第
２の処理のつど前記第１および第２のデイジタル
処理手段による処理の結果の一致を判断するため
の手段を含む、特許請求の範囲第９項記載の外部
記憶装置のソフトウエア管理システム。
Priority Applications (14)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60138699A JPS61296433A (ja) | 1985-06-24 | 1985-06-24 | 外部記憶装置のソフトウエア管理システム |
| CA000497868A CA1270339A (en) | 1985-06-24 | 1985-12-17 | System for determining a truth of software in an information processing apparatus |
| US06/812,929 US4799635A (en) | 1985-06-24 | 1985-12-23 | System for determining authenticity of an external memory used in an information processing apparatus |
| EP86304592A EP0206704B1 (en) | 1985-06-24 | 1986-06-16 | System for determining the authenticity of software in an information processing apparatus |
| DE3689574T DE3689574T2 (de) | 1985-06-24 | 1986-06-16 | System zum Feststellen der Echtheit von Software in einer Informationsverarbeitungsanlage. |
| FI862598A FI92767C (fi) | 1985-06-24 | 1986-06-18 | Järjestelmä ohjelmiston aitouden määrittämiseksi tietojenkäsittelylaitteessa |
| AU58816/86A AU599317B2 (en) | 1985-06-24 | 1986-06-18 | A system for determining a truth of software in an information processing apparatus |
| NO862523A NO177548C (no) | 1985-06-24 | 1986-06-23 | System for bestemmelse av en programvares riktighet i et databehandlingsapparat |
| US07/297,105 US5070479A (en) | 1985-06-24 | 1989-01-13 | External memory having an authenticating processor and method of operating same |
| AU64834/90A AU636401B2 (en) | 1985-06-24 | 1990-10-19 | An external memory unit for connection to a main data processing unit |
| US08/043,745 US5426762A (en) | 1985-06-24 | 1993-04-07 | System for determining a truth of software in an information processing apparatus |
| SG49494A SG49494G (en) | 1985-06-24 | 1994-04-12 | System for determining the authenticity of software in an information processing apparatus |
| HK195A HK195A (en) | 1985-06-24 | 1995-01-05 | System for determining the authenticity of software in an information processing apparatus |
| HK98104258.2A HK1005196B (en) | 1985-06-24 | 1998-05-18 | System for determining the authenticity of software in an information processing apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60138699A JPS61296433A (ja) | 1985-06-24 | 1985-06-24 | 外部記憶装置のソフトウエア管理システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61296433A JPS61296433A (ja) | 1986-12-27 |
| JPH0527891B2 true JPH0527891B2 (ja) | 1993-04-22 |
Family
ID=15228055
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60138699A Granted JPS61296433A (ja) | 1985-06-24 | 1985-06-24 | 外部記憶装置のソフトウエア管理システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61296433A (ja) |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2560124B2 (ja) * | 1990-03-16 | 1996-12-04 | 株式会社セガ・エンタープライゼス | ビデオゲームシステム及び情報処理装置 |
| JP3310318B2 (ja) * | 1991-12-27 | 2002-08-05 | 任天堂株式会社 | データ処理システム |
| JPH06161902A (ja) * | 1992-11-26 | 1994-06-10 | Nintendo Co Ltd | 補助記憶媒体の真偽判別装置およびそれに用い られる補助記憶装置 |
| JP2970739B2 (ja) * | 1994-09-30 | 1999-11-02 | 日本ビクター株式会社 | 光ディスクの再生制御方法 |
| US5644636A (en) * | 1994-12-30 | 1997-07-01 | Xtec, Incorporated | Method and apparatus for securing data stored in semiconductor memory cells |
| DE10002203B4 (de) * | 2000-01-19 | 2009-12-10 | Robert Bosch Gmbh | Verfahren zum Schutz eines Mikrorechner-Systems gegen Manipulation von in einer Speicheranordnung des Mikrorechner-Systems gespeicherten Daten |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2469760A1 (fr) * | 1979-11-09 | 1981-05-22 | Cii Honeywell Bull | Procede et systeme d'identification de personnes demandant l'acces a certains milieux |
| JPS5759248A (en) * | 1980-09-27 | 1982-04-09 | Sofuia Syst:Kk | Prevention device for surreptitious use of program |
| US4368515A (en) * | 1981-05-07 | 1983-01-11 | Atari, Inc. | Bank switchable memory system |
| US4446519A (en) * | 1981-05-26 | 1984-05-01 | Corban International, Ltd. | Method and apparatus for providing security for computer software |
| JPS5910680A (ja) * | 1982-04-22 | 1984-01-20 | エニグマ・ロジツク・インコ−ポレイテツド | 安全保障システム |
| EP0114522A3 (en) * | 1982-12-27 | 1986-12-30 | Synertek Inc. | Rom protection device |
| JPS59216250A (ja) * | 1983-05-24 | 1984-12-06 | Toyota Motor Corp | 汎用化ｐｃ周辺装置の制御方法 |
-
1985
- 1985-06-24 JP JP60138699A patent/JPS61296433A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61296433A (ja) | 1986-12-27 |
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Legal Events
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|---|---|---|---|
| R250 | Receipt of annual fees |
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| LAPS | Cancellation because of no payment of annual fees |