JPH05284423A - 表示装置 - Google Patents

表示装置

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Publication number
JPH05284423A
JPH05284423A JP7966992A JP7966992A JPH05284423A JP H05284423 A JPH05284423 A JP H05284423A JP 7966992 A JP7966992 A JP 7966992A JP 7966992 A JP7966992 A JP 7966992A JP H05284423 A JPH05284423 A JP H05284423A
Authority
JP
Japan
Prior art keywords
signal
screen
synchronizing signal
display device
vertical
Prior art date
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Withdrawn
Application number
JP7966992A
Other languages
English (en)
Inventor
Masanori Uesugi
雅則 上杉
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC IC Microcomputer Systems Co Ltd
Original Assignee
NEC IC Microcomputer Systems Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC IC Microcomputer Systems Co Ltd filed Critical NEC IC Microcomputer Systems Co Ltd
Priority to JP7966992A priority Critical patent/JPH05284423A/ja
Publication of JPH05284423A publication Critical patent/JPH05284423A/ja
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Abstract

(57)【要約】 【目的】複数画面を表示する表示装置において、水平同
期信号及び垂直同期信号に遅延を与えた信号に同期し
て、複数画面の内にある画面を他の画面に重ね合わせて
表示することで、その画面の表示位置を任意に設定可能
な回路を提供する。 【構成】映像信号4より水平同期信号8及び垂直同期信
号9を分離する同期分離回路7を設け、水平同期信号8
及び垂直同期信号9にそれぞれ任意の遅延量を与えて水
平同期信号11及び垂直同期信号12を生成する遅延回
路10を設け、遅延回路10における遅延量の設定値を
入力する入力回路3を設け、映像信号4を含む複数の映
像信号により表される画面情報を水平同期信号8及び垂
直同期信号9に同期して表示し、さらに前記画面情報に
重ね合わせて映像信号5により表される画面情報を水平
同期信号11及び垂直同期信号12に同期して表示する
表示装置本体13を設ける。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は表示装置に関し、特に複
数画面の表示装置に関する。
【0002】
【従来の技術】従来の技術について、ピクチャーインピ
クチャーシステムを例にとり図面を参照して説明する。
【0003】図4は、従来のピクチャーインピクチャー
システムのブロック図であり、図5は従来のピクチャー
インピクチャーシステムの表示画面を示す平面図であ
る。
【0004】従来のピクチャーインピクチャーシステム
は、図4に示すように入力端子1からの映像信号4より
水平同期信号8及び垂直同期信号9を分離する同期分離
回路7と、制御信号17を出力する入力回路18と、映
像信号4により表される画面情報を水平同期信号8及び
垂直同期信号9に同期して表示し、その画面情報に重ね
合わせて、水平同期信号8及び垂直同期信号9及び制御
信号17により設定される位置に映像信号5により表さ
れる画面情報を表示する表示装置本体16を有してい
る。
【0005】次に、動作について説明する。映像信号の
入力端子1より入力された親画面用の映像信号4は、同
期分離回路7及び複数の画面を表示する表示装置本体1
6へ入力される。同期分離回路7へ入力された映像信号
4は、水平同期信号8及び垂直同期信号9に分離され、
分離された水平同期信号8及び垂直同期信号9は表示装
置本体16へ入力される。
【0006】入力回路18は2ビットの信号を入力し、
制御信号17として表示装置本体16へ入力する。映像
信号の入力端子2より入力された子画面15用映像信号
5は表示装置16本体へ入力され、子画面15用に処理
される。そして表示装置本体16は、水平同期信号8及
び垂直同期信号9に同期して映像信号4により表される
親画面14と、映像信号5を処理した信号により表され
る子画面15を、親画面14に子画面15を重ねる形で
表示する。このとき子画面15の表示位置は、水平同期
信号8及び垂直同期信号9に同期して動作するカウンタ
のカウント値が制御信号17により設定される値と等し
くなることにより設定される。
【0007】
【発明が解決しようとする課題】この従来のピクチャー
インピクチャーシステムの場合は、制御信号17が2ビ
ットの信号であるため、子画面15の表示位置を4箇所
中の1箇所しか設定することが出来ないという問題点が
ある。
【0008】本発明の目的は、前記問題点を解決し、親
画面の任意の位置に子画面を移動できるようにした表示
装置を提供することにある。
【0009】
【課題を解決するための手段】本発明の表示装置の構成
は、映像信号より水平同期信号及び垂直同期信号を分離
する同期分離回路と、前記水平同期信号及び垂直同期信
号にそれぞれ任意の遅延量を与えれ遅延水平同期信号及
び遅延垂直同期信号を生成する遅延回路と、前記遅延回
路の遅延量を任意に設定する制御信号を入力する入力回
路と、前記映像信号を含む複数の映像信号により表され
る第1の画面情報を前記水平同期信号及び垂直同期信号
に同期して表示し、さらに前記複数の映像信号または他
の映像信号により表される第2の画面情報を前記遅延水
平同期信号及び遅延垂直信号に同期させて前記第1の画
面情報に重ね合わせて表示する表示装置本体とを備えた
ことを特徴とする。
【0010】
【実施例】図1は本発明の一実施例の表示装置のピクチ
ャーインピクチャーシステムを示すブロック図である。
図2は図1のピクチャーインピクチャーシステムにおけ
る表示画面を示す平面図である。
【0011】図1,図2において、本実施例のピクチャ
ーインピクチャーシステムは、入力端子1の映像信号4
より水平同期信号8及び垂直同期信号9を分離する同期
分離回路7と、水平同期信号8及び垂直同期信号9にそ
れぞれ任意の遅延量を与えて水平同期信号11及び垂直
同期信号12を生成する遅延回路10と、この遅延回路
10における遅延量の設定値を入力する入力回路3と、
映像信号4により表される画面情報を水平同期信号8及
び垂直同期信号9に同期して表示し、その画面に重ね合
わせて、入力端子2からの映像信号5を子画面15用に
処理し、その処理した信号により表される画面情報を水
平同期信号11及び垂直同期信号12に同期して表示す
る表示装置本体13とを備えている。
【0012】次に、動作について説明する。映像信号4
の入力端子1より入力された親画面14用の映像信号4
は、同期分離回路7及び複数の画面を表示する表示装置
13へ入力される。同期分離回路7へ入力された映像信
号4は水平同期信号8及び垂直同期信号9に分離され、
分離された水平同期信号8及び垂直同期信号9は遅延回
路10及び表示装置本体13へ入力される。
【0013】入力回路3を用いて設定される遅延量が、
遅延回路10において水平同期信号8及び垂直同期信号
9に与えられることで、水平同期信号11及び垂直同期
信号12が作成され、表示装置本体13へ入力される。
【0014】表示装置本体13へ入力された映像信号4
により表される親画面14は、水平同期信号8及び垂直
同期信号9に同期して表示される。さらに、映像信号の
入力端子2より入力された子画面15用の映像信号5は
表示装置本体13において子画面15用に処理され、処
理をされた信号により表される子画面15は水平同期信
号11及び垂直同期信号12に同期して親画面14に重
ね合わせて表示される。
【0015】この結果、入力回路3を用いて設定する遅
延回路10の遅延量を変化することにより、図2に示す
ように子画面15の表示位置を任意に移動・設定するこ
とが出来る。
【0016】図3は本発明の他の実施例における表示画
面を示す平面図である。図1はアスペクト比9:16の
表示装置の複数画面を表示するシステムにおける一実施
例のブロック図であり、図3はアスペクト比9:16の
表示装置の複数画面を表示するシステムにおける他の実
施例の表示画面の平面図である。
【0017】図3において、本実施例におけるアスペク
ト比9:16の表示装置の複数画面を表示するシステム
は、図1の場合と同様に、映像信号4より水平同期信号
8及び垂直同期信号9を分離する同期分離回路7と、水
平同期信号8及び垂直同期信号9にそれぞれ任意の遅延
量を与えて水平同期信号11及び垂直同期信号12を生
成する遅延回路10と、遅延回路10における遅延量の
設定値を入力する入力回路3と、映像信号4及び映像信
号5をそれぞれ処理し、映像信号4を処理した信号によ
り表される画面情報を水平同期信号8及び垂直同期信号
9に同期して表示し、その画面に重ね合わせて、映像信
号5を処理した信号により表される画面情報を水平同期
信号11及び垂直同期信号12に同期して表示する表示
装置本体13とを備えている。
【0018】次に、動作について説明する。映像信号の
入力端子1より親画面14用として入力された映像信号
4は、同期分離回路7及び複数の画面を表示する表示装
置本体13へ入力される。同期分離回路7へ入力された
映像信号4は水平同期信号8及び垂直同期信号9に分離
され、分離された水平同期信号8及び垂直同期信号9は
遅延回路10及び表示装置本体13へ入力される。
【0019】入力回路3の出力信号6を用いて設定され
る遅延量が遅延回路10において水平同期信号8及び垂
直同期信号9に与えられることで、水平同期信号11及
び垂直同期信号12が作成され、表示装置本体13へ入
力される。
【0020】表示装置本体13へ入力された映像信号4
は親画面14用に処理され、その処理たれた信号により
表される親画面14は水平同期信号8及び垂直同期信号
9に同期して表示される。さらに、映像信号の入力端子
2より入力された子画面15用の映像信号5は表示装置
本体13において子画面15用に処理をされ、処理をさ
れた信号により表される子画面15は水平同期信号11
及び垂直同期信号12に同期して親画面14中の処理前
の映像信号4により表される箇所以外に重ね合わせて表
示される。
【0021】この結果、入力回路3を用いて設定する遅
延量を変化することにより、図3に示すように、子画面
15の表示位置を任意に設定することが出来る。
【0022】
【発明の効果】以上説明したように、本発明は、水平同
期信号及び垂直同期信号に任意の遅延を与えることで、
この遅延を与えた水平同期信号及び垂直同期信号に同期
してある画面に重ね合わせて表示される画面の表示位置
を、任意に設定することが出来るという効果を有する。
【図面の簡単な説明】
【図1】本発明の一実施例の表示装置のピクチャーイン
ピクチャーシステムのブロック図である。
【図2】本発明の一実施例の表示装置の表示画面を示す
平面図である。
【図3】本発明の他の実施例の表示装置の表示画面を示
す平面図である。
【図4】従来のピクチャーインピクチャーシステムのブ
ロック図である。
【図5】従来のピクチャーインピクチャーシステムの表
示画面を示す平面図である。
【符号の説明】
1,2 入力端子 4,5 映像信号 3,18 入力回路 6 入力回路出力信号 7 同期分離回路 8,11 水平同期信号 9,12 垂直同期信号 10 遅延回路 13,16 表示装置本体 14 親画面 15 子画面 17 制御信号

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 映像信号より水平同期信号及び垂直同期
    信号を分離する同期分離回路と、前記水平同期信号及び
    垂直同期信号にそれぞれ任意の遅延量を与えれ遅延水平
    同期信号及び遅延垂直同期信号を生成する遅延回路と、
    前記遅延回路の遅延量を任意に設定する制御信号を入力
    する入力回路と、前記映像信号を含む複数の映像信号に
    より表される第1の画面情報を前記水平同期信号及び垂
    直同期信号に同期して表示し、さらに前記複数の映像信
    号または他の映像信号により表される第2の画面情報を
    前記遅延水平同期信号及び遅延垂直信号に同期させて前
    記第1の画面情報に重ね合わせて表示する表示装置本体
    とを備えたことを特徴とする表示装置。
JP7966992A 1992-04-01 1992-04-01 表示装置 Withdrawn JPH05284423A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP7966992A JPH05284423A (ja) 1992-04-01 1992-04-01 表示装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP7966992A JPH05284423A (ja) 1992-04-01 1992-04-01 表示装置

Publications (1)

Publication Number Publication Date
JPH05284423A true JPH05284423A (ja) 1993-10-29

Family

ID=13696589

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7966992A Withdrawn JPH05284423A (ja) 1992-04-01 1992-04-01 表示装置

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JP (1) JPH05284423A (ja)

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Effective date: 19990608