JPH0530296B2 - - Google Patents

Info

Publication number
JPH0530296B2
JPH0530296B2 JP14828386A JP14828386A JPH0530296B2 JP H0530296 B2 JPH0530296 B2 JP H0530296B2 JP 14828386 A JP14828386 A JP 14828386A JP 14828386 A JP14828386 A JP 14828386A JP H0530296 B2 JPH0530296 B2 JP H0530296B2
Authority
JP
Japan
Prior art keywords
layer
single crystal
region
substrate
polycrystalline
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP14828386A
Other languages
English (en)
Other versions
JPS636834A (ja
Inventor
Koichiro Kotani
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
National Institute of Advanced Industrial Science and Technology AIST
Original Assignee
Agency of Industrial Science and Technology
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Agency of Industrial Science and Technology filed Critical Agency of Industrial Science and Technology
Priority to JP14828386A priority Critical patent/JPS636834A/ja
Publication of JPS636834A publication Critical patent/JPS636834A/ja
Publication of JPH0530296B2 publication Critical patent/JPH0530296B2/ja
Granted legal-status Critical Current

Links

Description

【発明の詳細な説明】 〔概要〕 従来の選択エピタキシヤル成長方法において
は、選択用マスク材上に成長した多結晶層が、単
結晶上に成長した単結晶層に浸透し、単結晶層領
域を狭くする。これを防止するため基板上に形成
した凸部に単結晶層を成長し、さらに、選択用マ
スク材を成長しようとする結晶層と同分子の非晶
質層を用いて単結晶領域と多結晶領域の境界の応
力を低下させる。
〔産業上の利用分野〕
本発明は選択エピタキシヤル成長に関する。
半導体基板として、珪素(Si)等族半導体、
ガリウム砒素(GaAs)等の−V族化合物半導
体等の単結晶基板が用いられる。
これらの基板は用途によりダメージフリー、半
絶縁性、高濃度等のものがある。
また単結晶作成法としては引き上げ(CZ)法、
フローテイングゾーン(FZ)法等があり、これ
らの手段でインゴツトが作成され、それをスライ
スし、研磨してウエハ状態の基板が得られる。
半導体デバイスを作成するとき、基板のまま使
用されることは少なく、基板上にさらにエピタキ
シヤル成長させた単結晶層を使用する場合の方が
多い。
さらに、半導体デバイスの進展にともない、基
板上に選択エピタキシヤル成長を行い、活性領域
(素子形成領域)には単結晶層、フイールド領域
(素子分離領域)には多結晶層を成長させる手法
が用いられるようになつた。
基板表面にエピタキシヤル成長させる方法は、
現在では化合物半導体デバイスの作成に多く用い
られている。
すなわち、液相エピタキシヤル成長(LPE)
法を用いる半導体レーザや受光素子のヘテロエピ
タキシヤル層や、有機金属気相成長(MO−
CVD)法や分子線エピタキシヤル成長(MBE)
法による高電子易動度素子(HEMT)のヘテロ
エピタキシヤル層や、超格子素子等の多層ヘテロ
エピタキシヤル層の形成に多用されている。
〔従来の技術〕
第3図は従来の選択エピタキシヤル成長を説明
する断面図である。
図において、1は単結晶基板で、この上に選択
用マスクとして二酸化珪素(SiO2)層2を被着
し、通常のリソグラフイを用いて、素子形成のた
めの活性領域を開口する。
開口部を覆つて結晶層を成長すると露出した単
結晶基板1上には単結晶層3Aが選択的にエピタ
キシヤル成長し、SiO2層2上には多結晶層3B
が成長する。
この場合、単結晶層3Aは開口部の底に露出さ
れた単結晶上にのみ1方向に成長するのに対し
て、多結晶層3Bの成長方向は、SiO2層2の段
差を覆つて270°であるため開口部内に成長する単
結晶層3Aの領域内に多結晶層3Bが浸透し、単
結晶層3Aの領域を狭くする。
多結晶層3Bの単結晶層3Aに接する領域は不
整合領域となり、この領域が活性領域内に浸透す
ることになる。
また、多結晶層3BはSiO2上に成長するため、
くすんだ色となり、鏡面になり難い。
このように、半導体デバイスの活性領域となる
単結晶層3Aに多結晶層3Bが浸透し、また不整
合領域が活性領域内にあるため、素子解析にも不
明瞭なことが生じやすい。
さらに、選択用マスクの素材に問題があり、こ
こで用いた、容易に得られるが問題の多いSiO2
層の場合について説明する。
一般に、成長分子が単結晶基板分子と同じなら
ば整合して基板上に単結晶が成長し、非晶質、な
いし多結晶のSiO2上には多結晶が成長する。
この場合多結晶は任意の方向に成長し、大きな
グレインとなつて成長してゆく。厚い層の成長の
場合はこれらのグレインは問題とならないが、エ
ピタキシヤル成長層が数nm程度と薄い場合は、
SiO2層上の多結晶層は素子分離層としても不安
定な層となる。
さらに、マスク材と単結晶表面に飛来するエピ
タキシヤル成長分子は、異なつた反応律則で成長
するため、単結晶領域と多結晶領域との境界には
余分な応力を生じ、不安定な成長層となる。
〔発明が解決しようとする問題点〕
従来の選択エピタキシヤル成長においては、フ
イールド領域の多結晶層3Bは、活性領域となる
単結晶層3Aの領域内に浸透して単結晶層3Aの
領域を狭くし、界面は不整合領域となり、余分な
応力を生ずる。
〔問題点を解決するための手段〕
上記問題点の解決は、単結晶基板上に凸部を形
成する工程と、該単結晶基板上の該凸部以外の領
域に非晶質層を被着する工程と、該単結晶基板上
全面に結晶層を成長する工程とを含む本発明によ
る選択エピタキシヤル成長方法によつて達成され
る。
前記非晶質層が成長しようとする結晶層と同種
分子の物質よりなる場合は、一層安定な成長層が
得られる。
〔作用〕
マスク材を単結晶表面より低く被着することに
より、多結晶成長領域は矯正される方向にはたら
き、従つて単結晶領域は多結晶の浸透を受け難く
なる。
さらに、マスク材を成長分子と同種分子を有す
る非晶質で形成すれば、単結晶領域と多結晶領域
は同じ反応律則で成長するため、その界面に余分
な応力を生じることなく、物理的に安定な成長層
が得られる。
第1図は本発明の選択エピタキシヤル成長を説
明する断面図である。
図において、11は単結晶基板で半絶縁性ガリ
ウム砒素(SI−GaAs)基板で、単結晶基板11
の表面の活性領域に凸部12を形成し、単結晶基
板11の表面の凸部12以外の領域に選択用マス
クとして非晶質GaAs層13Bを被着する。
基板全面に結晶層としてGaAs層14を成長す
ると露出した単結晶基板11上には単結晶層14
Aが選択的にエピタキシヤル成長し、非晶質
GaAs層13B上には多結晶層14Bが成長す
る。
この場合、単結晶層14Aは凸部12上に露出
された単結晶上に成長するのに対して、多結晶層
14Bは凸部12により形成された段差の下に成
長する。
従つて、単結晶層14Aの領域内に多結晶層1
4Bが浸透して単結晶層14Aの領域を狭くする
ことはない。
多結晶層14Bの単結晶層14Aに接する領域
は不整合領域となるが、本発明の場合では、この
領域は活性領域外に形成されることになる。
また、マスク材を成長分子と同一分子を有する
非晶質GaAs層13Bで形成するため、単結晶領
域と多結晶領域の界面に余分な応力を生じること
なく、安定な成長層が得られる。
〔実施例〕
第2図1から5は選択エピタキシヤル成長の実
施例を説明する断面図である。
第2図1において、11は単結晶基板でSI−
GaAs基板で、この上に通常のリソグラフイ工程
を用いて活性領域にレジストパターン15を形成
する。
第2図2において、単結晶基板11の活性領域
以外を100nm程度、すなわち成長しようとするエ
ピタキシヤル層と同程度の深さをエツチングし、
基板表面の活性領域に凸部12を形成する。
第2図3において、スパツタ、蒸着等により、
成長分子と同種の非晶質GaAs層13を基板全面
に成長する。
第2図4において、活性領域の非晶質GaAs層
13Aをリフトオフし、フイールド領域に非晶質
GaAs層13Bを残し、エピタキシヤル成長の選
択用マスクとする。
第2図5において、基板全面に結晶層として
GaAs層14を成長する。
そうすると、露出した単結晶基板11上には単
結晶層14Aが選択的にエピタキシヤル成長し、
非晶質GaAs層13B上には多結晶層14Bが成
長する。
この場合、単結晶層14Aは凸部12上に露出
された単結晶上に成長するのに対して、多結晶層
14Bは凸部12により形成された段差の下に成
長する。
従つて、単結晶層14Aの領域内に多結晶層1
4Bが浸透して単結晶層14Aの領域を狭くする
ことはない。
また、多結晶層14Bは高抵抗層となつて素子
間分離が可能となる。
〔発明の効果〕
以上詳細に説明したように本発明による選択エ
ピタキシヤル成長においては、フイールド領域の
多結晶層は、活性領域となる単結晶層領域内に浸
透して単結晶層領域を狭くすることなく、単結晶
層領域との界面の不整合領域は活性層の外側にで
き、また界面には余分な応力を生じない。
従つて、素子形成の微細化と、素子間分離に有
効な成長方法が得られる。
【図面の簡単な説明】
第1図は本発明の選択エピタキシヤル成長を説
明する断面図、第2図1〜5は本発明の選択エピ
タキシヤル成長の実施例を説明する断面図、第3
図は従来の選択エピタキシヤル成長を説明する断
面図である。 図において、11は単結晶基板でSI−GaAs基
板、12は凸部、13Bは選択用マスクで非晶質
GaAs層、14は成長結晶層、14Aは単結晶
層、14Bは多結晶層、15はレジストパター
ン、である。

Claims (1)

  1. 【特許請求の範囲】 1 単結晶基板11上に凸部12を形成する工程
    と、 該単結晶基板11上の該凸部12以外の領域に
    非晶質層13Bを被着する工程と、 該単結晶基板11上全面に結晶層14を成長す
    る工程 とを含むことを特徴とする選択エピタキシヤル成
    長方法。 2 前記非晶質層13Bが成長しようとする結晶
    層14と同種分子の物質よりなることを特徴とす
    る特許請求の範囲第1項記載の選択エピタキシヤ
    ル成長方法。
JP14828386A 1986-06-26 1986-06-26 選択エピタキシヤル成長方法 Granted JPS636834A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP14828386A JPS636834A (ja) 1986-06-26 1986-06-26 選択エピタキシヤル成長方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP14828386A JPS636834A (ja) 1986-06-26 1986-06-26 選択エピタキシヤル成長方法

Publications (2)

Publication Number Publication Date
JPS636834A JPS636834A (ja) 1988-01-12
JPH0530296B2 true JPH0530296B2 (ja) 1993-05-07

Family

ID=15449300

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14828386A Granted JPS636834A (ja) 1986-06-26 1986-06-26 選択エピタキシヤル成長方法

Country Status (1)

Country Link
JP (1) JPS636834A (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB2228617A (en) * 1989-02-27 1990-08-29 Philips Electronic Associated A method of manufacturing a semiconductor device having a mesa structure
JP2011171639A (ja) * 2010-02-22 2011-09-01 Sanken Electric Co Ltd 半導体装置、半導体ウェハ、半導体装置の製造方法及び半導体ウェハの製造方法

Also Published As

Publication number Publication date
JPS636834A (ja) 1988-01-12

Similar Documents

Publication Publication Date Title
JP2889589B2 (ja) 単結晶半導体材料層及び絶縁材料層の交互層製造方法
US5144379A (en) Semiconductor device having a group iii-v epitaxial semiconductor layer on a substrate
JP2889588B2 (ja) 単結晶半導体材料層及び絶縁材料層の交番の形成方法
US4614564A (en) Process for selectively patterning epitaxial film growth on a semiconductor substrate
JPH0766922B2 (ja) 半導体装置の製造方法
WO1999001594A1 (en) Thermal mismatch compensation to produce free standing substrates by epitaxial deposition
JPH03236218A (ja) 化合物半導体装置およびその製造方法
JPH11162850A (ja) 炭化珪素基板およびその製造方法、並びに炭化珪素基板を用いた半導体素子
JPH04303920A (ja) Iv族基板上の絶縁膜/iii −v族化合物半導体積層構造
JPH04315419A (ja) 元素半導体基板上の絶縁膜/化合物半導体積層構造
JPH0530296B2 (ja)
JPS61188927A (ja) 化合物半導体装置
US5057880A (en) Semiconductor device having a heteroepitaxial substrate
KR950020969A (ko) V-홈을 이용한 이종접합 구조의 박막 제조방법
JPH0475649B2 (ja)
JPS63182811A (ja) 化合物半導体のエピタキシヤル成長方法
JP2687445B2 (ja) ヘテロエピタキシャル成長方法
JP3060486B2 (ja) Soi基板の形成方法
JP4747319B2 (ja) ヘテロエピタキシャル成長方法
JP2508456B2 (ja) 半導体単結晶薄膜の形成方法
US11735418B2 (en) Method for forming semiconductor layers
JP2527016B2 (ja) 半導体膜の製造方法
JPH0263115A (ja) 薄膜の選択成長方法
JP2964547B2 (ja) Soi基板の形成方法
JP3167350B2 (ja) 素子の製造法

Legal Events

Date Code Title Description
EXPY Cancellation because of completion of term