JPH05336182A - 復調器 - Google Patents
復調器Info
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- JPH05336182A JPH05336182A JP4162297A JP16229792A JPH05336182A JP H05336182 A JPH05336182 A JP H05336182A JP 4162297 A JP4162297 A JP 4162297A JP 16229792 A JP16229792 A JP 16229792A JP H05336182 A JPH05336182 A JP H05336182A
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- 238000001514 detection method Methods 0.000 claims abstract description 6
- 230000001360 synchronised effect Effects 0.000 claims description 8
- 238000005070 sampling Methods 0.000 claims description 7
- 230000007257 malfunction Effects 0.000 claims description 4
- 238000000034 method Methods 0.000 claims description 3
- 230000001172 regenerating effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 8
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 5
- 238000012544 monitoring process Methods 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 3
- 230000000875 corresponding effect Effects 0.000 description 2
- 238000011084 recovery Methods 0.000 description 2
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- 230000001427 coherent effect Effects 0.000 description 1
- 230000002596 correlated effect Effects 0.000 description 1
Landscapes
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】
【目的】 ＬＳＩ化による小型化、低価格化を可能にす
る復調器を提供する。 【構成】 直交同期検波器（ミキサ２、同３、移相器
４、搬送波再生回路５）では端子１から入力する受信デ
ィジタル変調信号を直交検波し２系列の復調ベースバン
ド信号を出力する。これは６と７の対応する低域通過ろ
波器を介して８と９の対応するＡ／Ｄ変換器に入力す
る。Ａ／Ｄ変換器では１０からのクロック信号により入
力ベースバンド信号を識別し、Ｎビットのディジタル信
号を形成し、ＭＳＢを復調信号として１２と１３の端子
から図外に出力するが、一方のＡ／Ｄ変換器８の全出力
Ｎビットのディジタル信号はエラーパルス発生回路１１
に与えられる。エラーパルス発生回路ではＮビットのデ
ィジタル信号が示す信号点がＡ／Ｄ変換器の識別点を含
む所定範囲に設定した判定領域の内側にあるときエラー
パルス信号を出力するが、論理回路で構成されるので、
復調器はＬＳＩ化できる。
る復調器を提供する。 【構成】 直交同期検波器（ミキサ２、同３、移相器
４、搬送波再生回路５）では端子１から入力する受信デ
ィジタル変調信号を直交検波し２系列の復調ベースバン
ド信号を出力する。これは６と７の対応する低域通過ろ
波器を介して８と９の対応するＡ／Ｄ変換器に入力す
る。Ａ／Ｄ変換器では１０からのクロック信号により入
力ベースバンド信号を識別し、Ｎビットのディジタル信
号を形成し、ＭＳＢを復調信号として１２と１３の端子
から図外に出力するが、一方のＡ／Ｄ変換器８の全出力
Ｎビットのディジタル信号はエラーパルス発生回路１１
に与えられる。エラーパルス発生回路ではＮビットのデ
ィジタル信号が示す信号点がＡ／Ｄ変換器の識別点を含
む所定範囲に設定した判定領域の内側にあるときエラー
パルス信号を出力するが、論理回路で構成されるので、
復調器はＬＳＩ化できる。
Description
【０００１】
【産業上の利用分野】本発明は、ディジタル変調信号の
復調器に係り、特にエラーパルスの発生方式の改良に関
する。
復調器に係り、特にエラーパルスの発生方式の改良に関
する。
【０００２】
【従来の技術】図６は、従来の復調器の構成例を示す。
図６において、この復調器は、直交同期検波器（ミキサ
２、同３、移相器４、搬送波再生回路５）と、低域通過
ろ波器（６、７）と、識別器（フリップフロップ回路
（Ｆ／Ｆ）１７、同１８）と、クロック信号発生回路１
０と、エラーパルス発生回路１９とを基本的に備える。
以下、動作を説明する。
図６において、この復調器は、直交同期検波器（ミキサ
２、同３、移相器４、搬送波再生回路５）と、低域通過
ろ波器（６、７）と、識別器（フリップフロップ回路
（Ｆ／Ｆ）１７、同１８）と、クロック信号発生回路１
０と、エラーパルス発生回路１９とを基本的に備える。
以下、動作を説明する。
【０００３】端子１から入力される受信ディジタル変調
信号（例えば４ＰＳＫ）が２分岐され、一方はミキサ２
の一方の入力となり、他方はミキサ３の一方の入力とな
る。また、搬送波再生回路５で再生された搬送波信号は
直接ミキサ３の他方の入力となると共に、移相器４でπ
／２移相されてミキサ２の他方の入力となる。これによ
り、受信ディジタル変調信号は、搬相波信号とこれをπ
／２移相したものとで直交同期検波され、ミキサ２と同
３から互いに直交するアナログ復調信号（ベースバンド
信号）が出力される。
信号（例えば４ＰＳＫ）が２分岐され、一方はミキサ２
の一方の入力となり、他方はミキサ３の一方の入力とな
る。また、搬送波再生回路５で再生された搬送波信号は
直接ミキサ３の他方の入力となると共に、移相器４でπ
／２移相されてミキサ２の他方の入力となる。これによ
り、受信ディジタル変調信号は、搬相波信号とこれをπ
／２移相したものとで直交同期検波され、ミキサ２と同
３から互いに直交するアナログ復調信号（ベースバンド
信号）が出力される。
【０００４】この直交同期検波器の出力たる２系列のベ
ースバンド信号は、低域通過ろ波器（６、７）にて高調
波成分の除去処理を受けて識別器（１７、１８）とエラ
ーパルス発生回路１９とに入力する。
ースバンド信号は、低域通過ろ波器（６、７）にて高調
波成分の除去処理を受けて識別器（１７、１８）とエラ
ーパルス発生回路１９とに入力する。
【０００５】識別器（１７、１８）では、クロック信号
発生回路１０からサンプリングクロックを受けて対応す
るベースバンド信号を識別しディジタル信号を再生出力
する。図示例では、Ｆ／Ｆ１７がＰチャネルのディジタ
ル信号を端子１２とエラーパルス発生回路１９とに再生
出力し、Ｆ／Ｆ１８がＱチャネルのディジタル信号を端
子１３に再生出力する。
発生回路１０からサンプリングクロックを受けて対応す
るベースバンド信号を識別しディジタル信号を再生出力
する。図示例では、Ｆ／Ｆ１７がＰチャネルのディジタ
ル信号を端子１２とエラーパルス発生回路１９とに再生
出力し、Ｆ／Ｆ１８がＱチャネルのディジタル信号を端
子１３に再生出力する。
【０００６】エラーパルス発生回路１９は、例えば図７
に示すように構成される。図７において、Ｑチャネルの
アナログ復調信号（ベースバンド信号）は減衰器２２に
てノイズレベルまで減衰させられ雑音信号となり、合成
器２１にてＱチャネルのアナログ復調信号（ベースバン
ド信号）と合成され、Ｆ／Ｆ２３に入力する。
に示すように構成される。図７において、Ｑチャネルの
アナログ復調信号（ベースバンド信号）は減衰器２２に
てノイズレベルまで減衰させられ雑音信号となり、合成
器２１にてＱチャネルのアナログ復調信号（ベースバン
ド信号）と合成され、Ｆ／Ｆ２３に入力する。
【０００７】Ｆ／Ｆ２３は、クロック信号発生回路１０
の出力（ＣＬＫ）により合成器２１の出力を識別し、雑
音の付加されたディジタル信号を復調する。
の出力（ＣＬＫ）により合成器２１の出力を識別し、雑
音の付加されたディジタル信号を復調する。
【０００８】排他的論理和回路２４では、Ｆ／Ｆ１７の
出力（Ｐチャネルの復調ディジタル信号）とＦ／Ｆ２３
の出力（雑音の付加されたＰチャネルの復調ディジタル
信号）との相関を取り、一致しているときは“０”レベ
ルを出力し、不一致のときは“１”レベルを出力する。
出力（Ｐチャネルの復調ディジタル信号）とＦ／Ｆ２３
の出力（雑音の付加されたＰチャネルの復調ディジタル
信号）との相関を取り、一致しているときは“０”レベ
ルを出力し、不一致のときは“１”レベルを出力する。
【０００９】論理積回路２５では、排他的論理和回路２
４の出力とクロック信号発生回路１０の出力（ＣＬＫ）
との論理積を取り、排他的論理和回路２４の出力が
“１”レベルのとき、即ち、復調ディジタル信号が誤っ
ているときは、端子１４にエラーパルス信号を出力す
る。
４の出力とクロック信号発生回路１０の出力（ＣＬＫ）
との論理積を取り、排他的論理和回路２４の出力が
“１”レベルのとき、即ち、復調ディジタル信号が誤っ
ているときは、端子１４にエラーパルス信号を出力す
る。
【００１０】なお、このエラーパルス信号は、回線品質
監視システムでの監視信号、回線切替システムでの切替
信号等として利用される。
監視システムでの監視信号、回線切替システムでの切替
信号等として利用される。
【００１１】
【発明が解決しようとする課題】上述した従来の復調器
では、エラーパルス信号を発生するのに、一方のアナロ
グ復調信号から雑音信号を形成し、それを他方のアナロ
グ復調信号に付加してフリップフロップで雑音の付加さ
れたディジタル信号を識別復調し、これと本来の復調デ
ィジタル信号との相関判定をするようにしているが、ア
ナログ回路を含むので回路が複雑化し、復調器全体のＬ
ＳＩ化による小型化、低価格化が困難であるという問題
がある。
では、エラーパルス信号を発生するのに、一方のアナロ
グ復調信号から雑音信号を形成し、それを他方のアナロ
グ復調信号に付加してフリップフロップで雑音の付加さ
れたディジタル信号を識別復調し、これと本来の復調デ
ィジタル信号との相関判定をするようにしているが、ア
ナログ回路を含むので回路が複雑化し、復調器全体のＬ
ＳＩ化による小型化、低価格化が困難であるという問題
がある。
【００１２】本発明の目的は、ＬＳＩ化による小型化、
低価格化を可能にする復調器を提供することにある。
低価格化を可能にする復調器を提供することにある。
【００１３】
【課題を解決するための手段】前記目的を達成するため
に、本発明の復調器は次の如き構成を有する。即ち、本
発明の復調器は、受信入力されるディジタル変調信号に
ついて直交同期検波を行い、互いに直交する２系列のベ
ースバンド信号を出力する直交同期検波器と； 前記２
系列のベースバンド信号の各々について識別処理を共通
のサンプリングクロックにより行い復調ディジタル信号
を出力する２つのＡ／Ｄ変換器と； 前記２つのＡ／Ｄ
変換器の一方の出力及び前記サンプリングクロックを受
けて当該Ａ／Ｄ変換器の出力が示す前記ベースバンド信
号の信号点が当該Ａ／Ｄ変換器の識別点を含む所定範囲
に設定した判定領域の内外何れにあるかを判定し領域外
のとき誤動作を示すパルス信号を出力するエラーパルス
発生回路と； を備えたことを特徴とするものである。
に、本発明の復調器は次の如き構成を有する。即ち、本
発明の復調器は、受信入力されるディジタル変調信号に
ついて直交同期検波を行い、互いに直交する２系列のベ
ースバンド信号を出力する直交同期検波器と； 前記２
系列のベースバンド信号の各々について識別処理を共通
のサンプリングクロックにより行い復調ディジタル信号
を出力する２つのＡ／Ｄ変換器と； 前記２つのＡ／Ｄ
変換器の一方の出力及び前記サンプリングクロックを受
けて当該Ａ／Ｄ変換器の出力が示す前記ベースバンド信
号の信号点が当該Ａ／Ｄ変換器の識別点を含む所定範囲
に設定した判定領域の内外何れにあるかを判定し領域外
のとき誤動作を示すパルス信号を出力するエラーパルス
発生回路と； を備えたことを特徴とするものである。
【００１４】
【作用】次に、前記の如く構成される本発明の復調器の
作用を説明する。本発明では、直交同期検波後の２系列
のベースバンド信号をそれぞれＡ／Ｄ変換器で識別し、
一方のＡ／Ｄ変換器の出力をエラーパルス発生回路に入
力し、ベースバンド信号の信号点が判定領域の内外何れ
にあるかを判定し、領域外のとき誤動作を示すパルス信
号（エラーパルス信号）を出力する。
作用を説明する。本発明では、直交同期検波後の２系列
のベースバンド信号をそれぞれＡ／Ｄ変換器で識別し、
一方のＡ／Ｄ変換器の出力をエラーパルス発生回路に入
力し、ベースバンド信号の信号点が判定領域の内外何れ
にあるかを判定し、領域外のとき誤動作を示すパルス信
号（エラーパルス信号）を出力する。
【００１５】ここに、エラーパルス発生回路は論理回路
により構成されるので、判定領域の範囲は任意に設定で
きる。従って、伝送路の品質等に柔軟に対応でき、適切
な監視信号ないしは切替信号等としてのエラーパルスを
発生できる。また、エラーパルス発生回路はアナログ回
路を含まないので、復調器全体のＬＳＩ化が可能とな
り、復調器の小型化、低価格化が可能となる。
により構成されるので、判定領域の範囲は任意に設定で
きる。従って、伝送路の品質等に柔軟に対応でき、適切
な監視信号ないしは切替信号等としてのエラーパルスを
発生できる。また、エラーパルス発生回路はアナログ回
路を含まないので、復調器全体のＬＳＩ化が可能とな
り、復調器の小型化、低価格化が可能となる。
【００１６】
【実施例】以下、本発明の実施例を図面を参照して説明
する。図１は、本発明の一実施例に係る復調器を示す。
この復調器は、識別器としてＡ／Ｄ変換器（８、９）を
用い、一方のＡ／Ｄ変換器８の出力をエラーパルス発生
回路１１に入力し、誤動作の有無を判断するようにした
ものである。従って、エラーパルス発生回路１１は論理
回路で構成される。
する。図１は、本発明の一実施例に係る復調器を示す。
この復調器は、識別器としてＡ／Ｄ変換器（８、９）を
用い、一方のＡ／Ｄ変換器８の出力をエラーパルス発生
回路１１に入力し、誤動作の有無を判断するようにした
ものである。従って、エラーパルス発生回路１１は論理
回路で構成される。
【００１７】Ａ／Ｄ変換器８と同９は、その識別ビット
数はディジタル変調方式の種類（４ＰＳＫ、１６ＱＡ
Ｍ、６４ＱＡＭ、２５６ＱＡＭ等）で異なるが、以下、
４ビット構成の場合について説明する。
数はディジタル変調方式の種類（４ＰＳＫ、１６ＱＡ
Ｍ、６４ＱＡＭ、２５６ＱＡＭ等）で異なるが、以下、
４ビット構成の場合について説明する。
【００１８】Ａ／Ｄ変換器８と同９は、クロック信号発
生回路１０の出力クロックを共通のサンプリングクロッ
クとして低域通過ろ波器（６、７）でろ波処理された２
系列のベースバンド信号の対応するものを識別し、その
内容を４ビットのディジタル信号として出力する。具体
的には、Ａ／Ｄ変換器８（９）は図２に示すように動作
する。
生回路１０の出力クロックを共通のサンプリングクロッ
クとして低域通過ろ波器（６、７）でろ波処理された２
系列のベースバンド信号の対応するものを識別し、その
内容を４ビットのディジタル信号として出力する。具体
的には、Ａ／Ｄ変換器８（９）は図２に示すように動作
する。
【００１９】図２において、主信号識別点はアイパター
ンのサンプリング点であり、この主信号識別点とアナロ
グ復調信号（入力ベースバンド信号）の信号点●との間
の距離の値がＤ１、Ｄ２、Ｄ３、Ｄ４の４ビットで示さ
れる。Ｄ１は最上位ビット（ＭＳＢ）であり、復調信号
として１２（Ｐチャネル出力端子）と１３（Ｑチャネル
出力端子）から図外へ送出される一方、Ａ／Ｄ変換器８
の全出力４ビットはエラーパルス発生回路１１の判定回
路１５に与えられる（図３）。
ンのサンプリング点であり、この主信号識別点とアナロ
グ復調信号（入力ベースバンド信号）の信号点●との間
の距離の値がＤ１、Ｄ２、Ｄ３、Ｄ４の４ビットで示さ
れる。Ｄ１は最上位ビット（ＭＳＢ）であり、復調信号
として１２（Ｐチャネル出力端子）と１３（Ｑチャネル
出力端子）から図外へ送出される一方、Ａ／Ｄ変換器８
の全出力４ビットはエラーパルス発生回路１１の判定回
路１５に与えられる（図３）。
【００２０】図３において、エラーパルス発生回路１１
は、判定回路１５と論理積回路１６とで構成される。
は、判定回路１５と論理積回路１６とで構成される。
【００２１】判定回路１５は、４ビットのディジタル信
号（Ｄ１、Ｄ２、Ｄ３、Ｄ４）を受けてアナログ復調信
号の信号点●（図２）が主信号識別点を含む所定範囲に
設定した判定領域の内外何れにあるかを判定し、その判
定信号を出力する。具体的には、判定回路１５は、例え
ば図４に示すように構成され、図５に示すように動作す
る。
号（Ｄ１、Ｄ２、Ｄ３、Ｄ４）を受けてアナログ復調信
号の信号点●（図２）が主信号識別点を含む所定範囲に
設定した判定領域の内外何れにあるかを判定し、その判
定信号を出力する。具体的には、判定回路１５は、例え
ば図４に示すように構成され、図５に示すように動作す
る。
【００２２】即ち、判定領域は、図５に示すように、主
信号識別点から図中上方のＤ１＝１、Ｄ２＝０、Ｄ３＝
０、Ｄ４＝０で規定される範囲と主信号識別点から図中
下方のＤ１＝０、Ｄ２＝１、Ｄ３＝１、Ｄ４＝１で規定
される範囲とに設定され、アナログ復調信号の信号点●
が、この判定領域の外（例えばＡ）にあるときは論理和
回路２８から“０”が出力され、この判定領域の内側
（Ｂ）にあるときは論理和回路２８から“１”が出力さ
れる。
信号識別点から図中上方のＤ１＝１、Ｄ２＝０、Ｄ３＝
０、Ｄ４＝０で規定される範囲と主信号識別点から図中
下方のＤ１＝０、Ｄ２＝１、Ｄ３＝１、Ｄ４＝１で規定
される範囲とに設定され、アナログ復調信号の信号点●
が、この判定領域の外（例えばＡ）にあるときは論理和
回路２８から“０”が出力され、この判定領域の内側
（Ｂ）にあるときは論理和回路２８から“１”が出力さ
れる。
【００２３】論理積回路１６では、判定回路１５の出力
（“１”または“０”）とクロック信号発生回路１０の
出力クロックＣＬＫとの論理積を取り、判定回路１５の
出力が“０”レベルのときは、“０”レベルをエラーパ
ルス信号として出力する。これにより外部へ送出した復
調ディジタル信号の正しいことが示される。
（“１”または“０”）とクロック信号発生回路１０の
出力クロックＣＬＫとの論理積を取り、判定回路１５の
出力が“０”レベルのときは、“０”レベルをエラーパ
ルス信号として出力する。これにより外部へ送出した復
調ディジタル信号の正しいことが示される。
【００２４】一方、論理積回路１６は、クロック信号発
生回路１０の出力クロックＣＬＫとの論理積を取り、判
定回路１５の出力が“１”レベルのときはクロックＣＬ
Ｋをエラーパルス信号として出力する。これにより外部
へ送出した復調ディジタル信号が誤りであることが示さ
れる。
生回路１０の出力クロックＣＬＫとの論理積を取り、判
定回路１５の出力が“１”レベルのときはクロックＣＬ
Ｋをエラーパルス信号として出力する。これにより外部
へ送出した復調ディジタル信号が誤りであることが示さ
れる。
【００２５】なお、判定回路１５での判定領域の範囲は
伝送路の品質等を勘案してシステム設計時に予め定めら
れるが、その設定は論理回路の組み合わせで任意になし
得ることは以上の説明から明らかである。
伝送路の品質等を勘案してシステム設計時に予め定めら
れるが、その設定は論理回路の組み合わせで任意になし
得ることは以上の説明から明らかである。
【００２６】
【発明の効果】以上説明したように、本発明の復調器に
よれば、直交同期検波後の２系列のベースバンド信号を
それぞれＡ／Ｄ変換器で識別し、一方のＡ／Ｄ変換器の
出力をエラーパルス発生回路に入力し、ベースバンド信
号の信号点が判定領域の内外何れにあるかを判定し、領
域外のとき誤動作を示すパルス信号（エラーパルス信
号）を出力するが、エラーパルス発生回路は論理回路に
より構成されるので、判定領域の範囲は任意に設定でき
る。従って、伝送路の品質等に柔軟に対応でき、適切な
監視信号ないしは切替信号等としてのエラーパルスを発
生できる。また、エラーパルス発生回路はアナログ回路
を含まないので、復調器全体のＬＳＩ化が可能となり、
復調器の小型化、低価格化が可能となる効果がある。
よれば、直交同期検波後の２系列のベースバンド信号を
それぞれＡ／Ｄ変換器で識別し、一方のＡ／Ｄ変換器の
出力をエラーパルス発生回路に入力し、ベースバンド信
号の信号点が判定領域の内外何れにあるかを判定し、領
域外のとき誤動作を示すパルス信号（エラーパルス信
号）を出力するが、エラーパルス発生回路は論理回路に
より構成されるので、判定領域の範囲は任意に設定でき
る。従って、伝送路の品質等に柔軟に対応でき、適切な
監視信号ないしは切替信号等としてのエラーパルスを発
生できる。また、エラーパルス発生回路はアナログ回路
を含まないので、復調器全体のＬＳＩ化が可能となり、
復調器の小型化、低価格化が可能となる効果がある。
【図１】本発明の一実施例に係る復調器の構成ブロック
図である。
図である。
【図２】Ａ／Ｄ変換器の入出力関係図である。
【図３】エラーパルス発生回路の構成及びＡ／Ｄ変換器
との関係図である。
との関係図である。
【図４】判定回路の回路図である。
【図５】エラーパルス発生回路の動作説明図である。
【図６】従来の復調器の構成ブロック図である。
【図７】従来のエラーパルス発生回路の回路図である。
２，３ ミキサ ４ 移相器 ５ 搬送波再生回路 ６，７ 低域通過ろ波器 ８，９ Ａ／Ｄ変換器 １０ クロック信号発生回路 １１ エラーパルス発生回路 １５ 判定回路 １６ 論理積回路
Claims (1)
- 【請求項１】 受信入力されるディジタル変調信号につ
いて直交同期検波を行い、互いに直交する２系列のベー
スバンド信号を出力する直交同期検波器と；前記２系列
のベースバンド信号の各々について識別処理を共通のサ
ンプリングクロックにより行い復調ディジタル信号を出
力する２つのＡ／Ｄ変換器と； 前記２つのＡ／Ｄ変換
器の一方の出力及び前記サンプリングクロックを受けて
当該Ａ／Ｄ変換器の出力が示す前記ベースバンド信号の
信号点が当該Ａ／Ｄ変換器の識別点を含む所定範囲に設
定した判定領域の内外何れにあるかを判定し領域外のと
き誤動作を示すパルス信号を出力するエラーパルス発生
回路と； を備えたことを特徴とする復調器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4162297A JP3036972B2 (ja) | 1992-05-28 | 1992-05-28 | 復調器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4162297A JP3036972B2 (ja) | 1992-05-28 | 1992-05-28 | 復調器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05336182A true JPH05336182A (ja) | 1993-12-17 |
| JP3036972B2 JP3036972B2 (ja) | 2000-04-24 |
Family
ID=15751822
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4162297A Expired - Fee Related JP3036972B2 (ja) | 1992-05-28 | 1992-05-28 | 復調器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3036972B2 (ja) |
-
1992
- 1992-05-28 JP JP4162297A patent/JP3036972B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3036972B2 (ja) | 2000-04-24 |
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