JPH0540551Y2 - - Google Patents
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- Publication number
- JPH0540551Y2 JPH0540551Y2 JP14981985U JP14981985U JPH0540551Y2 JP H0540551 Y2 JPH0540551 Y2 JP H0540551Y2 JP 14981985 U JP14981985 U JP 14981985U JP 14981985 U JP14981985 U JP 14981985U JP H0540551 Y2 JPH0540551 Y2 JP H0540551Y2
- Authority
- JP
- Japan
- Prior art keywords
- led elements
- decoder
- group
- signal
- drivers
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000010586 diagram Methods 0.000 description 8
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【考案の詳細な説明】
（産業上の利用分野）
本考案は、LED等の発光素子をいくつか組合
せて構成される、例えばセグメント方式の多桁数
字表示装置に関するものである。
せて構成される、例えばセグメント方式の多桁数
字表示装置に関するものである。
（従来の技術）
第３図は、従来の多桁数字表示装置の一例を示
す構成ブロツク図で、ここでは７セグメント８桁
表示器を用いた場合で、２桁について示し、他の
桁については省略してある。図において、D11，
D1２…D17，D21・D22…D27はいずれも発光素子
としてのLEDであり、R1，R2…R7は一端が共通
の電源V+に接続された電流制限用抵抗である。
U1は複数個の発光素子D11〜D27…のうちの７個
D11〜D17，D21〜D27…をひとつのグループとし
て桁選択のための信号DG1，DG2…を与えるデコ
ーダで、３ビツトのコード信号ABCを入力して
いる。S1〜S7は各グループに属する発光素子D11
〜D17，D21〜D27のうちのひとつを選択するセグ
メント選択用のドライバである。
す構成ブロツク図で、ここでは７セグメント８桁
表示器を用いた場合で、２桁について示し、他の
桁については省略してある。図において、D11，
D1２…D17，D21・D22…D27はいずれも発光素子
としてのLEDであり、R1，R2…R7は一端が共通
の電源V+に接続された電流制限用抵抗である。
U1は複数個の発光素子D11〜D27…のうちの７個
D11〜D17，D21〜D27…をひとつのグループとし
て桁選択のための信号DG1，DG2…を与えるデコ
ーダで、３ビツトのコード信号ABCを入力して
いる。S1〜S7は各グループに属する発光素子D11
〜D17，D21〜D27のうちのひとつを選択するセグ
メント選択用のドライバである。
第４図は、第３図装置の動作を示す波形図であ
る。
る。
デコーダU1には、第４図チ，リ，ヌに示すよ
うなコード信号ABCが周期的に印加されており、
ここからは、第４図ル，ヲ…ワに示すように、８
個の桁を順番に１個ずつ選択する信号DG1〜DG8
を出力する。ドライバS1〜S7は、例えばオープン
コレクタ形式のTTLが使用されており、セグメ
ント選択信号を出力する。第４図イ〜トは、発光
素子D11からD14、発光素子D24〜D27を発光させ
る場合のドライブ信号を例示する。
うなコード信号ABCが周期的に印加されており、
ここからは、第４図ル，ヲ…ワに示すように、８
個の桁を順番に１個ずつ選択する信号DG1〜DG8
を出力する。ドライバS1〜S7は、例えばオープン
コレクタ形式のTTLが使用されており、セグメ
ント選択信号を出力する。第４図イ〜トは、発光
素子D11からD14、発光素子D24〜D27を発光させ
る場合のドライブ信号を例示する。
（考案が解決しようとする問題点）
このように従来装置においては、発光素子を点
灯させる場合、桁選択信号DGをロウレベルの信
号とし、ドライバの出力信号をハイレベルの信号
とすることにより、発光素子側に電流を流し、発
光素子を消灯する場合は、ドライバの出力信号を
ロウレベルの信号とすることによつて電源V+か
らの電流をドライバ側に流すようにしている。
灯させる場合、桁選択信号DGをロウレベルの信
号とし、ドライバの出力信号をハイレベルの信号
とすることにより、発光素子側に電流を流し、発
光素子を消灯する場合は、ドライバの出力信号を
ロウレベルの信号とすることによつて電源V+か
らの電流をドライバ側に流すようにしている。
このために、従来装置においては、発光素子を
点灯している場合も消灯している場合も、制限抵
抗Ｒを介して電流が流れ、消灯時における消費電
力が大きくなるという問題点があつた。
点灯している場合も消灯している場合も、制限抵
抗Ｒを介して電流が流れ、消灯時における消費電
力が大きくなるという問題点があつた。
（問題点を解決するための手段）
この様な目的を達成する本考案は、
電流制限抵抗を介してアノード側が電源に接続
された複数個のLED素子Ｄ１１，Ｄ１２…Ｄ１
７，Ｄ２１，Ｄ２２…Ｄ２７と、これら複数個の
LED素子の互いに隣接するいくつかをひとつの
グループとし当該LED素子のカソード側を共通
に接続し、各グループの共通接続点に桁選択信号
を与えるデコーダＵ１と、前記LED素子のアノ
ード側の電位をハイレベル、ローレベルにするこ
とで各グループに属するいくつかのLED素子の
ひとつを選択する複数のドライバＳ１，Ｓ２…Ｓ
７とを備えた表示装置において、 前記デコーダをイネーブル端子付のもので構成
すると共に、 前記複数のドライバの各出力端側にゲート回路
を挿入するかまたは、各ドライバをトライステー
トバツフアで構成し、 前記デコーダのイネーブル端子と前記各ゲート
または各トライステートバツフアに一斉に信号を
印加することで、前記複数個のLED素子のアノ
ード側とカソード側をハイレベルにできるように
した表示装置である。
された複数個のLED素子Ｄ１１，Ｄ１２…Ｄ１
７，Ｄ２１，Ｄ２２…Ｄ２７と、これら複数個の
LED素子の互いに隣接するいくつかをひとつの
グループとし当該LED素子のカソード側を共通
に接続し、各グループの共通接続点に桁選択信号
を与えるデコーダＵ１と、前記LED素子のアノ
ード側の電位をハイレベル、ローレベルにするこ
とで各グループに属するいくつかのLED素子の
ひとつを選択する複数のドライバＳ１，Ｓ２…Ｓ
７とを備えた表示装置において、 前記デコーダをイネーブル端子付のもので構成
すると共に、 前記複数のドライバの各出力端側にゲート回路
を挿入するかまたは、各ドライバをトライステー
トバツフアで構成し、 前記デコーダのイネーブル端子と前記各ゲート
または各トライステートバツフアに一斉に信号を
印加することで、前記複数個のLED素子のアノ
ード側とカソード側をハイレベルにできるように
した表示装置である。
（実施例）
第１図は、本考案に係る装置の一例を示す構成
ブロツク図である。第３図装置の各部分に対応す
る部分には同一符号を付して示す。
ブロツク図である。第３図装置の各部分に対応す
る部分には同一符号を付して示す。
本考案に係る装置は、デコーダＵ１をイネーブ
ル端子付のもので構成すると共に、複数のドライ
バＳ１〜Ｓ７の各出力端側にゲート回路Ｇ１〜Ｇ
７を挿入するように構成し、全てのLED素子Ｄ
１１，Ｄ１２…Ｄ１７，Ｄ２１，Ｄ２２…Ｄ２７
を消灯する時（非表示状態とする時）に、デコー
ダＵ１のイネーブル端子Ｇと、各ゲートＳ１〜Ｓ
７に、一斉にイネーブル信号（バーENB）を印
加することで、全てのLED素子のアノード側と
カソード側をハイレベルにできるように構成した
ものである。
ル端子付のもので構成すると共に、複数のドライ
バＳ１〜Ｓ７の各出力端側にゲート回路Ｇ１〜Ｇ
７を挿入するように構成し、全てのLED素子Ｄ
１１，Ｄ１２…Ｄ１７，Ｄ２１，Ｄ２２…Ｄ２７
を消灯する時（非表示状態とする時）に、デコー
ダＵ１のイネーブル端子Ｇと、各ゲートＳ１〜Ｓ
７に、一斉にイネーブル信号（バーENB）を印
加することで、全てのLED素子のアノード側と
カソード側をハイレベルにできるように構成した
ものである。
即ち、複数のドライバＳ１〜Ｓ７の各出力端と
全てのLED素子Ｄ１１，Ｄ１２…Ｄ１７，Ｄ２
１，Ｄ２２…Ｄ２７のアノードとの間には、それ
ぞれゲート回路Ｇ１〜Ｇ７が挿入・接続されてい
る。そして、各ゲート回路Ｇ１〜Ｇ７に、インバ
ータIVを介して一斉にイネーブル信号（バー
ENB）を印加すると、各ゲート回路Ｇ１〜Ｇ７
の出力がいずれもハイレベルとなるようにしてあ
る。
全てのLED素子Ｄ１１，Ｄ１２…Ｄ１７，Ｄ２
１，Ｄ２２…Ｄ２７のアノードとの間には、それ
ぞれゲート回路Ｇ１〜Ｇ７が挿入・接続されてい
る。そして、各ゲート回路Ｇ１〜Ｇ７に、インバ
ータIVを介して一斉にイネーブル信号（バー
ENB）を印加すると、各ゲート回路Ｇ１〜Ｇ７
の出力がいずれもハイレベルとなるようにしてあ
る。
イネーブル信号（バーENB）は、図示してい
ない駆動回路から出力されるもので、第１図に示
す実施例では、表示器を動作させる状態とする場
合（表示状態）はロウレベル、表示器の表示動作
を停止させた状態とする場合（非表示状態とする
場合）はハイレベルとする。
ない駆動回路から出力されるもので、第１図に示
す実施例では、表示器を動作させる状態とする場
合（表示状態）はロウレベル、表示器の表示動作
を停止させた状態とする場合（非表示状態とする
場合）はハイレベルとする。
このように構成した本考案の装置によれば、消
灯時には、イネーブル信号によつて、デコ
ーダU1及び各ゲートG1〜G8の出力端は、いずれ
もハイレベルとなり、各制限抵抗Ｒには電流が流
れなくなる。従つて、消灯時における消費電力を
低減させることができる。
灯時には、イネーブル信号によつて、デコ
ーダU1及び各ゲートG1〜G8の出力端は、いずれ
もハイレベルとなり、各制限抵抗Ｒには電流が流
れなくなる。従つて、消灯時における消費電力を
低減させることができる。
第２図は、第１図実施例における、ドライバＳ
とゲートＧとに代えて用いる他の構成要素を示す
ブロツク図である。ここでは、トライステートバ
ツフアBAを用いたもので、信号をハイレベ
ルとすることによつて、その出力がハイインピー
ダンスになる。
とゲートＧとに代えて用いる他の構成要素を示す
ブロツク図である。ここでは、トライステートバ
ツフアBAを用いたもので、信号をハイレベ
ルとすることによつて、その出力がハイインピー
ダンスになる。
（考案の効果）
以上詳細に説明したように、本考案によれば、
表示器の表示動作が停止状態（非表示状態）にあ
る時の消費電力を大幅に低減することのできる表
示器が実現できる。
表示器の表示動作が停止状態（非表示状態）にあ
る時の消費電力を大幅に低減することのできる表
示器が実現できる。
第１図は本考案に係る装置の一例を示す構成ブ
ロツク図、第２図は第１図装置におけるドライバ
とゲートとに代えて用いる他の構成要素のブロツ
ク図、第３図は従来装置の構成ブロツク図、第４
図はその動作波形図である。 D11〜D17，D21〜D27……発光素子、R1〜R7…
…電流制限抵抗、U1……デコーダ、S1〜S7……
ドライバ、G1〜G7……ゲート。
ロツク図、第２図は第１図装置におけるドライバ
とゲートとに代えて用いる他の構成要素のブロツ
ク図、第３図は従来装置の構成ブロツク図、第４
図はその動作波形図である。 D11〜D17，D21〜D27……発光素子、R1〜R7…
…電流制限抵抗、U1……デコーダ、S1〜S7……
ドライバ、G1〜G7……ゲート。
Claims (1)
- 【実用新案登録請求の範囲】 電流制限抵抗を介してアノード側が電源に接続
された複数個のLED素子Ｄ１１，Ｄ１２…Ｄ１
７，Ｄ２１，Ｄ２２…Ｄ２７と、これら複数個の
LED素子の互いに隣接するいくつかをひとつの
グループとし当該LED素子のカソード側を共通
に接続し、各グループの共通接続点に桁選択信号
を与えるデコーダＵ１と、前記LED素子のアノ
ード側の電位をハイレベルまたはローレベルにす
ることで各グループに属するいくつかのLED素
子のひとつを選択する複数のドライバＳ１，Ｓ２
…Ｓ７とを備えた表示装置において、 前記デコーダをイネーブル端子付のもので構成
すると共に、 前記複数のドライバの各出力端側にゲート回路
を挿入するかまたは、各ドライバをトライステー
トバツフアで構成し、 前記デコーダのイネーブル端子と前記各ゲート
または各トライステートバツフアに一斉に信号を
印加することで、前記複数個のLED素子のアノ
ード側とカソード側をハイレベルにできるように
した表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14981985U JPH0540551Y2 (ja) | 1985-09-30 | 1985-09-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14981985U JPH0540551Y2 (ja) | 1985-09-30 | 1985-09-30 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6258493U JPS6258493U (ja) | 1987-04-11 |
| JPH0540551Y2 true JPH0540551Y2 (ja) | 1993-10-14 |
Family
ID=31065385
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14981985U Expired - Lifetime JPH0540551Y2 (ja) | 1985-09-30 | 1985-09-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0540551Y2 (ja) |
-
1985
- 1985-09-30 JP JP14981985U patent/JPH0540551Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6258493U (ja) | 1987-04-11 |
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