JPH0541680A - 回線スリツプ対応型エコーキヤンセラ - Google Patents
回線スリツプ対応型エコーキヤンセラInfo
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- JPH0541680A JPH0541680A JP19554291A JP19554291A JPH0541680A JP H0541680 A JPH0541680 A JP H0541680A JP 19554291 A JP19554291 A JP 19554291A JP 19554291 A JP19554291 A JP 19554291A JP H0541680 A JPH0541680 A JP H0541680A
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- 230000001934 delay Effects 0.000 claims description 4
- DNTFEAHNXKUSKQ-RFZPGFLSSA-N (1r,2r)-2-aminocyclopentane-1-sulfonic acid Chemical compound N[C@@H]1CCC[C@H]1S(O)(=O)=O DNTFEAHNXKUSKQ-RFZPGFLSSA-N 0.000 claims description 2
- 238000010079 rubber tapping Methods 0.000 claims 1
- 238000004364 calculation method Methods 0.000 description 19
- 230000003111 delayed effect Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 2
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- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Landscapes
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】
【目的】 １サンプル周期，データがずれても，エコー
信号を除去できる回線スリップ対応型エコーキャンセラ
の提供。 【構成】 送信側入力信号を２タップ遅延させる第１の
遅延器７、８と，エコーキャンセラのタップ係数値を保
持するＨレジスタ１２と，受信側入力信号の積和を取る
際にＨレジスタのタップ係数値を２タップ遅延させる第
２の遅延器９、１０と，前記第１の遅延器の２つの出力
と送信側入力信号から疑似エコー信号を減算する３つの
減算器１５、１６、１７と，３つの出力結果のレベルを
比較するレベル比較器１８と，そのレベルの判断結果に
より積和を取るＨレジスタを何タップ遅延を行ってＸレ
ジスタ１３との積和を取るかを決定する切り替え回路１
１を持つ。
信号を除去できる回線スリップ対応型エコーキャンセラ
の提供。 【構成】 送信側入力信号を２タップ遅延させる第１の
遅延器７、８と，エコーキャンセラのタップ係数値を保
持するＨレジスタ１２と，受信側入力信号の積和を取る
際にＨレジスタのタップ係数値を２タップ遅延させる第
２の遅延器９、１０と，前記第１の遅延器の２つの出力
と送信側入力信号から疑似エコー信号を減算する３つの
減算器１５、１６、１７と，３つの出力結果のレベルを
比較するレベル比較器１８と，そのレベルの判断結果に
より積和を取るＨレジスタを何タップ遅延を行ってＸレ
ジスタ１３との積和を取るかを決定する切り替え回路１
１を持つ。
Description
【０００１】
【産業上の利用分野】本発明は，エコーキャンセラに関
する。
する。
【０００２】
【従来の技術】従来，この種のエコーキャンセラ１′
は，減算器１７，計算回路１４，Ｈ（タップ係数値保
持）レジスタ１２，Ｘレジスタ１３，タップ係数修正回
路１９，送信側入力端子３，受信側出力端子４，送信側
出力端子５，受信側入力端子６からなり，エコー径路２
のインパルス応答を推定し，エコーキャンセラ１′内の
Ｘレジスタ１３，タップ係数修正回路１９，Ｈレジスタ
１２，及び計算回路１４で疑似エコー信号を生成し，減
算器１７で疑似エコー信号と実際のエコー信号との差を
取ることによって実際のエコー信号を消去するというも
のがあった。
は，減算器１７，計算回路１４，Ｈ（タップ係数値保
持）レジスタ１２，Ｘレジスタ１３，タップ係数修正回
路１９，送信側入力端子３，受信側出力端子４，送信側
出力端子５，受信側入力端子６からなり，エコー径路２
のインパルス応答を推定し，エコーキャンセラ１′内の
Ｘレジスタ１３，タップ係数修正回路１９，Ｈレジスタ
１２，及び計算回路１４で疑似エコー信号を生成し，減
算器１７で疑似エコー信号と実際のエコー信号との差を
取ることによって実際のエコー信号を消去するというも
のがあった。
【０００３】以下に，動作について説明する。通信回線
上で遠端話者側より送信された信号が，ハイブリット・
トランス回路のインピーダンス不整合などにより，エコ
ーとなって，遠端話者に戻る。このエコー信号を消去す
るために，図２のエコーキャンセラ１′が用いられる。
一般に廻り込むエコー径路２は、定常的に線形であると
みなすことができる。従って、エコー径路２のインパル
ス応答をｈ（ｉ）（ｉ＝０，１，２，…，Ｎ−１）とす
ると，時刻ｊの実際のエコー信号Ｙ（ｊ）は受信信号ｘ
（ｊ）より，下記の数式１によって表わすことができ
る。
上で遠端話者側より送信された信号が，ハイブリット・
トランス回路のインピーダンス不整合などにより，エコ
ーとなって，遠端話者に戻る。このエコー信号を消去す
るために，図２のエコーキャンセラ１′が用いられる。
一般に廻り込むエコー径路２は、定常的に線形であると
みなすことができる。従って、エコー径路２のインパル
ス応答をｈ（ｉ）（ｉ＝０，１，２，…，Ｎ−１）とす
ると，時刻ｊの実際のエコー信号Ｙ（ｊ）は受信信号ｘ
（ｊ）より，下記の数式１によって表わすことができ
る。
【０００４】
【数１】
【０００５】これと同一特性をもった，エコー路モデル
を，エコーキャンセラ１′内部で生成する。この疑似エ
コー信号Ｙ′（ｊ）を生成するエコーキャンセラ１′内
部のインパルス応答をｈ′（ｉ）を使って表わすと，下
記の数式２によって表わすことができる。
を，エコーキャンセラ１′内部で生成する。この疑似エ
コー信号Ｙ′（ｊ）を生成するエコーキャンセラ１′内
部のインパルス応答をｈ′（ｉ）を使って表わすと，下
記の数式２によって表わすことができる。
【０００６】
【数２】
【０００７】ｈ（ｉ）＝ｈ′（ｉ）が成立するときに，
Ｙ（ｊ）＝Ｙ′（ｊ）となり，エコー信号Ｙ（ｊ）が消
去される。これが，エコーキャンセラのアルゴリズムで
ある。これを実現するために，遠端話者側から送られて
きた入力信号を受信側入力端子６から入力し，その信号
をＸレジスタ１３内に保持し，Ｈレジスタ１２内には，
インパルス応答がタップ係数として格納されており，計
算回路１４で各タップの積ｈ′（ｉ）×（ｊ−ｉ）が計
算され，更にＮ個の積の和算が行われる。ここで求めた
値が上記のＹ′（ｊ）であり，計算回路１４の出力結果
から，送信側入力端子３から入力したエコー信号Ｙ
（ｊ）を，減算器１７で減算する。この減算器１７の演
算結果を送信側出力端子５に送信してエコー信号を消去
した信号として回路外部に送出する。Ｈレジスタ１２の
出力と，減算器１７の演算結果の差信号と，Ｘレジスタ
１３の出力とを，タップ係数修正回路１９に入力する。
このタップ係数修正回路１９の出力が，Ｈレジスタ１２
の内部のタイプ係数を修正して上記のｈ′（ｉ）をでき
るだけｈ（ｉ）に近づけていくのである。こうしてエコ
ー信号Ｙ（ｊ）をできるだけ消去していくというもので
あった。
Ｙ（ｊ）＝Ｙ′（ｊ）となり，エコー信号Ｙ（ｊ）が消
去される。これが，エコーキャンセラのアルゴリズムで
ある。これを実現するために，遠端話者側から送られて
きた入力信号を受信側入力端子６から入力し，その信号
をＸレジスタ１３内に保持し，Ｈレジスタ１２内には，
インパルス応答がタップ係数として格納されており，計
算回路１４で各タップの積ｈ′（ｉ）×（ｊ−ｉ）が計
算され，更にＮ個の積の和算が行われる。ここで求めた
値が上記のＹ′（ｊ）であり，計算回路１４の出力結果
から，送信側入力端子３から入力したエコー信号Ｙ
（ｊ）を，減算器１７で減算する。この減算器１７の演
算結果を送信側出力端子５に送信してエコー信号を消去
した信号として回路外部に送出する。Ｈレジスタ１２の
出力と，減算器１７の演算結果の差信号と，Ｘレジスタ
１３の出力とを，タップ係数修正回路１９に入力する。
このタップ係数修正回路１９の出力が，Ｈレジスタ１２
の内部のタイプ係数を修正して上記のｈ′（ｉ）をでき
るだけｈ（ｉ）に近づけていくのである。こうしてエコ
ー信号Ｙ（ｊ）をできるだけ消去していくというもので
あった。
【０００８】
【発明が解決しようとする課題】しかしながら，上述し
たエコーキャンセラ１´では，ディジタル回線に起こる
ジッタや，年間遅延変動等によって生じるスリップによ
って１サンプル周期，データがずれてしまったときに，
疑似エコー信号が真のエコー信号と著しく異なってしま
い，Ｈレジスタ１２内の推定動作を行わなければなら
ず，修正が完了するまでにかなりの時間を要してしま
う。その結果，スリップが起こった直後は，著しくエコ
ー信号の廻り込みが起こるという欠点があった。
たエコーキャンセラ１´では，ディジタル回線に起こる
ジッタや，年間遅延変動等によって生じるスリップによ
って１サンプル周期，データがずれてしまったときに，
疑似エコー信号が真のエコー信号と著しく異なってしま
い，Ｈレジスタ１２内の推定動作を行わなければなら
ず，修正が完了するまでにかなりの時間を要してしま
う。その結果，スリップが起こった直後は，著しくエコ
ー信号の廻り込みが起こるという欠点があった。
【０００９】本発明の課題は，ディジタル回線に起こる
ジッタや，年間遅延変動等によって生じるスリップによ
って１サンプル周期，データがずれても，エコー信号を
除去できる回線スリップ対応型エコーキャンセラを提供
することにある。
ジッタや，年間遅延変動等によって生じるスリップによ
って１サンプル周期，データがずれても，エコー信号を
除去できる回線スリップ対応型エコーキャンセラを提供
することにある。
【００１０】
【課題を解決するための手段】本発明によれば、遠端話
者側より送信された信号より起こるエコー信号を，エコ
ー径路のインパルス応答にあわせて適応的にタップ係数
を変化させ，消去するエコーキャンセラにおいて，送信
側入力信号を２タップ遅延させる第１の遅延器と，前記
エコーキャンセラのタップ係数値を保持するタップ係数
値保持レジスタと，受信側入力信号の積和を取る際にタ
ップ係数値保持レジスタのタップ係数値を２タップ遅延
させる第２の遅延器と，前記第１の遅延器の２つの出力
と送信側入力信号から疑似エコー信号を減算する３つの
減算器と，３つの出力結果のレベルを比較するレベル比
較器と，そのレベルの判断結果により積和を取るタップ
係数値保持レジスタを何タップ遅延を行ってＸレジスタ
との積和を取るかを決定する切り替え回路を有すること
を特徴とするエコーキャンセラが得られる。
者側より送信された信号より起こるエコー信号を，エコ
ー径路のインパルス応答にあわせて適応的にタップ係数
を変化させ，消去するエコーキャンセラにおいて，送信
側入力信号を２タップ遅延させる第１の遅延器と，前記
エコーキャンセラのタップ係数値を保持するタップ係数
値保持レジスタと，受信側入力信号の積和を取る際にタ
ップ係数値保持レジスタのタップ係数値を２タップ遅延
させる第２の遅延器と，前記第１の遅延器の２つの出力
と送信側入力信号から疑似エコー信号を減算する３つの
減算器と，３つの出力結果のレベルを比較するレベル比
較器と，そのレベルの判断結果により積和を取るタップ
係数値保持レジスタを何タップ遅延を行ってＸレジスタ
との積和を取るかを決定する切り替え回路を有すること
を特徴とするエコーキャンセラが得られる。
【００１１】
【実施例】図１を参照すると，本発明の一実施例による
回線スリップ対応型エコーキャンセラ１は，送信側入力
端子３から入力した信号を１サンプル周期分遅延させる
遅延器７を含む。遅延器８は，遅延器７の出力信号を１
サンプル周期分遅延させる。Ｈレジスタタップ遅延器９
及び１０の各々は，Ｈレジスタ１２内のタップ係数を１
タップ遅延させる。切り替え回路１１はレベル比較器１
８の結果よりＨレジスタ１２の係数値を何タップずらせ
るかを決定する。Ｈレジスタ１２は，エコー径路２を推
定してそのインパルス応答のタップ係数値をＮタップ分
保持している。Ｘレジスタ１３は受信側入力端子６から
入力した信号を本エコーキャンセラ１の（タップ数分＋
１）のデータを保持する。計算回路１４はＨレジスタ１
２とＸレジスタ１３の内容の積を各タップについて計算
すると共に，Ｎタップ分の積の和を計算する。減算器１
７は，送信側入力端子３から受信した信号から計算回路
１４の出力信号を減算する。減算器１６は，送信側入力
端子３から受信した信号が遅延器７のみを通った後の信
号から計算回路１４の出力信号を減算する。減算器１５
は，送信側入力端子３から受信した信号が遅延器７及び
８を通った信号から計算回路１４の出力信号を減算す
る。レベル比較器１８は，減算器１５，１６，１７の演
算結果をレベル比較し，その比較結果を切り替え回路１
１に出力し，Ｈレジスタ１２のタップ係数をずらさなか
ったり，遅延器９により１タップ遅延させたり，遅延器
９及び１０により２タップ遅延させたりするのである。
タップ係数修正回路１９は，送信側出力端子５に送信さ
れる差信号とＸレジスタ１３の値を使ってＨレジスタ１
２内のタップ係数値をエコー径路２のインパルス応答に
近づけていくのである。
回線スリップ対応型エコーキャンセラ１は，送信側入力
端子３から入力した信号を１サンプル周期分遅延させる
遅延器７を含む。遅延器８は，遅延器７の出力信号を１
サンプル周期分遅延させる。Ｈレジスタタップ遅延器９
及び１０の各々は，Ｈレジスタ１２内のタップ係数を１
タップ遅延させる。切り替え回路１１はレベル比較器１
８の結果よりＨレジスタ１２の係数値を何タップずらせ
るかを決定する。Ｈレジスタ１２は，エコー径路２を推
定してそのインパルス応答のタップ係数値をＮタップ分
保持している。Ｘレジスタ１３は受信側入力端子６から
入力した信号を本エコーキャンセラ１の（タップ数分＋
１）のデータを保持する。計算回路１４はＨレジスタ１
２とＸレジスタ１３の内容の積を各タップについて計算
すると共に，Ｎタップ分の積の和を計算する。減算器１
７は，送信側入力端子３から受信した信号から計算回路
１４の出力信号を減算する。減算器１６は，送信側入力
端子３から受信した信号が遅延器７のみを通った後の信
号から計算回路１４の出力信号を減算する。減算器１５
は，送信側入力端子３から受信した信号が遅延器７及び
８を通った信号から計算回路１４の出力信号を減算す
る。レベル比較器１８は，減算器１５，１６，１７の演
算結果をレベル比較し，その比較結果を切り替え回路１
１に出力し，Ｈレジスタ１２のタップ係数をずらさなか
ったり，遅延器９により１タップ遅延させたり，遅延器
９及び１０により２タップ遅延させたりするのである。
タップ係数修正回路１９は，送信側出力端子５に送信さ
れる差信号とＸレジスタ１３の値を使ってＨレジスタ１
２内のタップ係数値をエコー径路２のインパルス応答に
近づけていくのである。
【００１２】以下に，図１のエコーキャンセラ１の動作
について説明する。遠端話者から送信された信号が受信
側入力端子６に受信され，Ｘレジスタ１３内に保持され
るとともに，受信側出力端子４に送信される。送信側出
力端子４から出力された信号はエコー径路２を通って送
信側入力端子３に入力される。これがエコー信号となる
わけである。その信号は，そのまま減算器１７に与えら
れる信号と，遅延器７によって１サンプル遅延して減算
器１６に与えられる信号と，遅延器７及び８によって２
サンプル遅延して減算器１５に与えられる信号との３つ
のエコー信号に分けられる。また一方で，計算回路１４
は，Ｈレジスタ１２内のタップ係数値とＸレジスタ１３
の値との積を各タップについて計算すると共に，Ｎタッ
プ分の積の和を計算する。減算器１５，１６及び１７
は，計算回路１４の出力結果を３つのエコー信号の各々
から減算する。標準時においては，減算器１６の結果が
送信側出力端子５に送信される。また減算器１６の結果
とＸレジスタ１３の値を使ってタップ係数修正回路１９
でＨレジスタ１２のタップ係数を修正して，Ｘレジスタ
１３のタップ係数値をエコー径路２のインパルス応答に
近づけていく。ところでこのときに，ディジタル回線上
においてジッタや，年間遅延変動等によって生じるスリ
ップによって１サンプル周期データがずれてしまうこと
がある。このスリップ現象が起こると，エコーキャンセ
ラ１は，エコー径路２が著しく変化したと判断して，タ
ップ係数の修正を再度行い始める。修正が終了するまで
にかなりの時間を要する。ところが実際にスリップ現象
が起こった際にズレが生じるのが，１サンプル前後どち
らかである。つまり，エコーキャンセラ１内部のインパ
ルス応答ｈ′（ｉ）が充分にエコー径路２のインパルス
応答であるｈ（ｉ）に等しくなっていれば，時間ｊにお
ける実際のエコー信号Ｙ（ｊ）は，以下に数式３，数式
４，及び数式５によってそれぞれ示される疑似エコー信
号Ｙ′（ｊ），Ｙ′（ｊ−１），及びＹ′（ｊ−２）の
うちのいずれかに，ほとんど一致しているはずである。
について説明する。遠端話者から送信された信号が受信
側入力端子６に受信され，Ｘレジスタ１３内に保持され
るとともに，受信側出力端子４に送信される。送信側出
力端子４から出力された信号はエコー径路２を通って送
信側入力端子３に入力される。これがエコー信号となる
わけである。その信号は，そのまま減算器１７に与えら
れる信号と，遅延器７によって１サンプル遅延して減算
器１６に与えられる信号と，遅延器７及び８によって２
サンプル遅延して減算器１５に与えられる信号との３つ
のエコー信号に分けられる。また一方で，計算回路１４
は，Ｈレジスタ１２内のタップ係数値とＸレジスタ１３
の値との積を各タップについて計算すると共に，Ｎタッ
プ分の積の和を計算する。減算器１５，１６及び１７
は，計算回路１４の出力結果を３つのエコー信号の各々
から減算する。標準時においては，減算器１６の結果が
送信側出力端子５に送信される。また減算器１６の結果
とＸレジスタ１３の値を使ってタップ係数修正回路１９
でＨレジスタ１２のタップ係数を修正して，Ｘレジスタ
１３のタップ係数値をエコー径路２のインパルス応答に
近づけていく。ところでこのときに，ディジタル回線上
においてジッタや，年間遅延変動等によって生じるスリ
ップによって１サンプル周期データがずれてしまうこと
がある。このスリップ現象が起こると，エコーキャンセ
ラ１は，エコー径路２が著しく変化したと判断して，タ
ップ係数の修正を再度行い始める。修正が終了するまで
にかなりの時間を要する。ところが実際にスリップ現象
が起こった際にズレが生じるのが，１サンプル前後どち
らかである。つまり，エコーキャンセラ１内部のインパ
ルス応答ｈ′（ｉ）が充分にエコー径路２のインパルス
応答であるｈ（ｉ）に等しくなっていれば，時間ｊにお
ける実際のエコー信号Ｙ（ｊ）は，以下に数式３，数式
４，及び数式５によってそれぞれ示される疑似エコー信
号Ｙ′（ｊ），Ｙ′（ｊ−１），及びＹ′（ｊ−２）の
うちのいずれかに，ほとんど一致しているはずである。
【００１３】
【数３】
【００１４】
【数４】
【００１５】
【数５】
【００１６】つまり，本エコーキャンセラ１において
は，従来のものより，Ｙ（ｊ）を１サンプル遅らせた信
号Ｙ（ｊ−１）を標準時においては用いて演算及び推定
を行い，スリップによってデータが前方にずれてしまっ
たときには，Ｙ′（ｊ）で減算を行い，データが後方へ
ずれてしまったときにはＹ′（ｊ−２）で減算を行えば
エコー信号は消去されるはずである。その原理を実現さ
せるために本発明のエコーキャンセラ１においては，送
信側入力端子３からの入力信号を遅延器７及び８を用い
てＹ（ｊ），Ｙ（ｊ−１），Ｙ（ｊ−２）の３タイプに
分け，標準時には，Ｈレジスタ１２内のタップ係数値を
１サンプル遅延させた信号を計算回路１４に与え，計算
回路１４の出力信号と下記の数式６によって表される
Ｙ′（ｊ）との減算を減算器１５，１６，及び１７で行
い，そのレベルの比較をレベル比較器１８で行う。
は，従来のものより，Ｙ（ｊ）を１サンプル遅らせた信
号Ｙ（ｊ−１）を標準時においては用いて演算及び推定
を行い，スリップによってデータが前方にずれてしまっ
たときには，Ｙ′（ｊ）で減算を行い，データが後方へ
ずれてしまったときにはＹ′（ｊ−２）で減算を行えば
エコー信号は消去されるはずである。その原理を実現さ
せるために本発明のエコーキャンセラ１においては，送
信側入力端子３からの入力信号を遅延器７及び８を用い
てＹ（ｊ），Ｙ（ｊ−１），Ｙ（ｊ−２）の３タイプに
分け，標準時には，Ｈレジスタ１２内のタップ係数値を
１サンプル遅延させた信号を計算回路１４に与え，計算
回路１４の出力信号と下記の数式６によって表される
Ｙ′（ｊ）との減算を減算器１５，１６，及び１７で行
い，そのレベルの比較をレベル比較器１８で行う。
【００１７】
【数６】
【００１８】もし回線上でスリップ現象が起こった場合
には，前方へスリップが起これば，減算器１７の出力レ
ベルが最も低くなり，後方に起こった場合には，減算器
１５の出力レベルが最も低くなるわけである。もし減算
器１６の出力レベルより他の減算器の出力レベルが低く
なった場合にはエコーキャンセラのＨレジスタ１２の修
正動作をいったん停止し，数十サンプル程度レベルを検
出し，減算器１５のレベルが最も低い場合にはＨレジス
タ１２の値を一度だけ１サンプル遅延させて，計算回路
１４に下記の数式７の演算を行わせる。
には，前方へスリップが起これば，減算器１７の出力レ
ベルが最も低くなり，後方に起こった場合には，減算器
１５の出力レベルが最も低くなるわけである。もし減算
器１６の出力レベルより他の減算器の出力レベルが低く
なった場合にはエコーキャンセラのＨレジスタ１２の修
正動作をいったん停止し，数十サンプル程度レベルを検
出し，減算器１５のレベルが最も低い場合にはＨレジス
タ１２の値を一度だけ１サンプル遅延させて，計算回路
１４に下記の数式７の演算を行わせる。
【００１９】
【数７】
【００２０】また減算器１７のレベルが最も低い場合に
おいてはＨレジスタの値を一度だけ遅延させずに，計算
回路１４に下記の数式８の演算を行わせる。
おいてはＨレジスタの値を一度だけ遅延させずに，計算
回路１４に下記の数式８の演算を行わせる。
【００２１】
【数８】
【００２２】その後はまた通常路と同様に戻してＨレジ
スタ１２を１サンプル遅らせたＨレジスタ１２のタップ
係数値で演算を行い，減算器１６で減算を行いエコー信
号を取り除いて送出側出力端子５から信号を送出する。
そしてこの差信号を用いてタップ係数の修正を行い修正
動作行いながらエコー信号を消去していくのである。こ
の場合実際には，Ｘレジスタ１３の内部にはＮ＋１タッ
プのデータを保持することになるが，積の和を取れない
項に関しては，タップ係数を強制的に０とすることにし
ておく。こうすれば多少の誤差が一瞬生じるがその差は
きわめて微少であり，修正を繰り返していけばほとんど
影響を与える値ではない。
スタ１２を１サンプル遅らせたＨレジスタ１２のタップ
係数値で演算を行い，減算器１６で減算を行いエコー信
号を取り除いて送出側出力端子５から信号を送出する。
そしてこの差信号を用いてタップ係数の修正を行い修正
動作行いながらエコー信号を消去していくのである。こ
の場合実際には，Ｘレジスタ１３の内部にはＮ＋１タッ
プのデータを保持することになるが，積の和を取れない
項に関しては，タップ係数を強制的に０とすることにし
ておく。こうすれば多少の誤差が一瞬生じるがその差は
きわめて微少であり，修正を繰り返していけばほとんど
影響を与える値ではない。
【００２３】
【発明の効果】以上説明したように本発明では，ディジ
タル回線に起こるジッタや，年間遅延変動等によって生
じるスリップによって１サンプル周期データがずれてし
まったときに，疑似エコーが実際のエコー信号と著しく
異なってしまい，Ｈレジスタ内の推定動作を行わなけれ
ばならず，修正が完了するまでにかなりの時間を要して
しまうという欠点を解決するという結果，スリップが起
こった直後は，著しくエコー信号の廻り込みが起こると
いう欠点を解決するという効果がある。
タル回線に起こるジッタや，年間遅延変動等によって生
じるスリップによって１サンプル周期データがずれてし
まったときに，疑似エコーが実際のエコー信号と著しく
異なってしまい，Ｈレジスタ内の推定動作を行わなけれ
ばならず，修正が完了するまでにかなりの時間を要して
しまうという欠点を解決するという結果，スリップが起
こった直後は，著しくエコー信号の廻り込みが起こると
いう欠点を解決するという効果がある。
【図１】本発明の一実施例による回線スリップ対応型エ
コーキャンセラのブロック図である。
コーキャンセラのブロック図である。
【図２】従来の回線スリップ対応型エコーキャンセラの
ブロック図である。 １ エコーキャンセラ ２ エコー径路 ３ 送信側入力端子 ４ 受信側出力端子 ５ 送信側出力端子 ６ 受信側入力端子 ７，８ 遅延器 ９，１０ Ｈレジスタタップ遅延器 １１ 切り替え回路 １２ Ｈレジスタ １３ Ｘレジスタ １４ 計算回路 １５，１６，１７ 減算器 １８ レベル比較器 １９ タップ係数修正回路。
ブロック図である。 １ エコーキャンセラ ２ エコー径路 ３ 送信側入力端子 ４ 受信側出力端子 ５ 送信側出力端子 ６ 受信側入力端子 ７，８ 遅延器 ９，１０ Ｈレジスタタップ遅延器 １１ 切り替え回路 １２ Ｈレジスタ １３ Ｘレジスタ １４ 計算回路 １５，１６，１７ 減算器 １８ レベル比較器 １９ タップ係数修正回路。
Claims (1)
- 【請求項１】 遠端話者側より送信された信号より起こ
るエコー信号を，エコー径路のインパルス応答にあわせ
て適応的にタップ係数を変化させ，消去するエコーキャ
ンセラにおいて，送信側入力信号を２タップ遅延させる
第１の遅延器と，前記エコーキャンセラのタップ係数値
を保持するタップ係数値保持レジスタと，受信側入力信
号の積和を取る際にタップ係数値保持レジスタのタップ
係数値を２タップ遅延させる第２の遅延器と，前記第１
の遅延器の２つの出力と送信側入力信号から疑似エコー
信号を減算する３つの減算器と，３つの出力結果のレベ
ルを比較するレベル比較器と，そのレベルの判断結果に
より積和を取るタップ係数値保持レジスタを何タップ遅
延を行ってＸレジスタとの積和を取るかを決定する切り
替え回路を有することを特徴とするエコーキャンセラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19554291A JP2845644B2 (ja) | 1991-08-05 | 1991-08-05 | 回線スリップ対応型エコーキャンセラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19554291A JP2845644B2 (ja) | 1991-08-05 | 1991-08-05 | 回線スリップ対応型エコーキャンセラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0541680A true JPH0541680A (ja) | 1993-02-19 |
| JP2845644B2 JP2845644B2 (ja) | 1999-01-13 |
Family
ID=16342832
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19554291A Expired - Lifetime JP2845644B2 (ja) | 1991-08-05 | 1991-08-05 | 回線スリップ対応型エコーキャンセラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2845644B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6064733A (en) * | 1996-10-28 | 2000-05-16 | Nec Corporation | Echo canceller apparatus |
-
1991
- 1991-08-05 JP JP19554291A patent/JP2845644B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6064733A (en) * | 1996-10-28 | 2000-05-16 | Nec Corporation | Echo canceller apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2845644B2 (ja) | 1999-01-13 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19981007 |