JPH05508976A - m/nコード用復調器 - Google Patents

m/nコード用復調器

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Publication number
JPH05508976A
JPH05508976A JP91511083A JP51108391A JPH05508976A JP H05508976 A JPH05508976 A JP H05508976A JP 91511083 A JP91511083 A JP 91511083A JP 51108391 A JP51108391 A JP 51108391A JP H05508976 A JPH05508976 A JP H05508976A
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JP
Japan
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code word
bit
demodulator
code
word
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Pending
Application number
JP91511083A
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English (en)
Inventor
ショルツ,ヴェルナー
Original Assignee
ドイチエ トムソン―ブラント ゲゼルシヤフト ミツト ベシユレンクテル ハフツング
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Filing date
Publication date
Application filed by ドイチエ トムソン―ブラント ゲゼルシヤフト ミツト ベシユレンクテル ハフツング filed Critical ドイチエ トムソン―ブラント ゲゼルシヤフト ミツト ベシユレンクテル ハフツング
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Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00—Baseband systems
    • H04L25/38—Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40—Transmitting circuits; Receiving circuits
    • H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H04L25/4906—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes
    • H04L25/4908—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes using mBnB codes

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  • Physics & Mathematics (AREA)
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  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Stereo-Broadcasting Methods (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるため要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は請求項1による復調器を基礎とする。
m/nコードで変調された信号の復調のためには当該復調テーブルが当該変調テ ーブルのnビットコード語に対して変化せしめられているコード語に対して作成 されるのが有利である。
R−DATの場合NRZI変換付き8/10変調が使用される。NRZI信号は 当該情報が極性非依存性であるという利点を有する。
欠点となるのは勿論、当該伝送コードは誤り伝播が免れないことである。従って 特許出願P4011894ではNRZI変換なしの8/10変換を使用し、極性 識別のため信号を用いて自動的極性補正を行なうことが提案されている。
上記8/lOコード用復調器では例えば同期パターンの識別が極性非依存性であ り(当該レベル状態遷移が評価されることにより)、一方、データ信号は極性依 存性である(当該ビット値を利用することにより)。復調器回路ではレベル状態 遷移パターンを表わす信号と、ビットパターンを表わす信号とに対して別個の直 列−並列変換器が必要である。
本発明の基礎を成す課題とするところは、上述の復特表千5−508976 ( 2) 調器において複数評価回路の共通の利用、もってそれにより構成部分の節減を行 なわせ得ることにある。
上記課題は請求項1に規定された構成要件により解決される0本発明の発展形態 は引用請求項に示されている。
従って本発明の解決手段ではソフトウェアの変化により、ハードウェアの節減、 すなわち、評価回路の共通の利用による構成部分の節減が達成され、その際復調 テーブルの変化、変更、即ち、ROMの内容の変化、変更によってもハードウェ アに余分のコスト、構成を要しない。
次に図を用いて本発明を説明する。
図1は上記の先頃の復調回路を示し、 図2は復調テーブルを変化修整した回路を示し、図3は図11図2による回路に おける信号の特性を示す。
図1はドイツ連邦共和国特許出願P4011894による信号に対する従来復調 回路を示す、上記回路中上方部分1・・・5は同期化のため用いられ、それの下 方部分では8/10復調が実施される。同期信号の識別は極性非依存性である( レベル状態遷移のパターンが使用されることにより)、このためにフリップフロ ップ1及びEX−ORゲート2が用いられる。EX−ORゲート2の出力側にお けるビットパターンはレベル状態遷移のパターンを成す。直列−並列変換器3及 びコンパレータ4を用いては何時当該レベル状態遷移のパターンが設定された同 期パターンと一致するかが検出される。一致するとコンパレータ出力側にパルス SOが現われる。このパルスは同期化回路5における語クロックfW及びブロッ ククロックfBの位相調整のために用いられる。斜めトラック記録に適する同期 化回路は例えばドイツ連邦共和国特許出願P4018605.9に記載されてい る。
上記パルスSOは更に、信号極性の識別のため用いられる。回路6においてはS Oを用いて、当該設定値の知られている所定ビットの値がめられる(検出される )。入力信号AOはEX−ORゲート7を用いて正しい極性に調整セツティング される。極性識別回路6の出力信号Cの値は可変でない(極性変化が生じている 可能性が存在しない間は)、、当該極性変化の可能性が生起存在する限り、新た な識別過程がスタートされる。スタート信号の生成に必要なロジックはそのつど の状況に適合さるべきである。
EX−ORゲート7の出力側からは信号が適正極性を以て直列−並列変換器8の 入力側に供給される。各ビットクロックごとに当該信号の、最後(直前の)の1 0の順次連続するビットが、レジスタ10のD入力側に加えられる。語クロック fWによってはそのつど1つの10ビット−語に属するビットが、1つの語の持 続時間中ROMIIのアドレス入力側に加わる。ROMの出力側にはコード語に 所属する8ビット−データ語が現われる。ROMIIにおける復調テーブルは変 調テーブルにて使用されているコード語向けに作成されている。
図2に示す回路では復調テーブルがROMII中(こ変調テーブルとは異なるコ ード語に対して作成されている。各コード語の第1の(最初の)ビットのみが、 極性補正を介して変らずに転送される。残りの9ビツトはオリジナル(原)コー ド語のレベル状態遷移のパターンを成す。従って、上記ビットは直列−並列変換 器3の出力側から取出され得る。直列−並列変換器8の代わりに、たんに1つの クリップフロップ9が、1つのコード語の持続時間中コード語の第1ビツトの記 憶のために必要とされるに過ぎない。従って変化されたテーブル(これは余分の コストを要しない)によって、特に長いコード語の場合、回路コストが著しく低 減され得る。
図3は回路装置における信号特性経過を示す。−参上のダイヤグラムは入力信号 AOの語限界(始端、終端)をマーキングする1語31.S2はここでは20ビ ツトから成る同期信号を形成する。同期信号の第1ビツトはデジタル和の適合化 のため可変であり、更に、同期パターンは極性切換えて現われてもよい。極性識 別が行なわれ得る信号領域に対して、例えば斜めトラック記録のスタート(ラン イン)領域内で、同期パターンの極性が定められており、t(Wl)は次のよう な時点、即ち、修整変化されたコード語W1が図2のレジスタ10内に読込まれ る時点である。ビット0(bft O)はオリジナル語WILv41i性補正さ れた第1ビツトであり、一方、ビットド・・9はWlのレベル状態遷移のパター ンを表わす。
要 約 書 評価回路の共通の利用(共用)を可能にし、それにより構成部品の節減を行なわ せ得ることが本発明の課題である。変調テーブルのnビットコード語に対して変 化されているコード語に対する復調テーブルが作成される。殊にデジタルオーデ ィオ又はビデオ信号の記録用である。
τ謁謹審謡失 国際調査報告

Claims (4)

    【特許請求の範囲】
  1. 1.m/nコード用復調器であって、m−ビットデークコード語がn−ビットコ ード語に対応付けられており当該コード語はブロックごとに伝送され、当該コー ド語間に語−及びブロック同期化用ビットパターンが配置されているものにおい て、当該復調テーブルは当該変調テーブルのnビットコード語に対して変化され ているコード語に対して作成されていることを特徴とするm/nコード用復調器 。
  2. 2.当該復調テーブル作成のための変化されているコード語においてn−1ビッ トが、もとのnビットコード語のレベル状態遷移のパターンに相応し、そして別 の1つのビットが、もとのコード語の第1の(最初の)ピットの値に相応するよ うに構成されている請求項1記載の復調器。
  3. 3.当該の同期信号の識別のため当該レベル状態遷移のパターンを坪価する回路 (1・・・4)が用いられ、上記回路によっては(n−1)の並列線路上にて復 調テーブルに対するコード語が送出されるように構成されている(図2)請求項 2記載の復調器。
  4. 4.補正可能な信号極性を以ての伝送のため、上記複数コード語の第1ビットの みが極性補正回路(6,7,9)を介して、当該復調テーブルを含むROM(1 1)に供給されるように構成されている請求項2及び3記載の復調器。
JP91511083A 1990-07-04 1991-06-26 m/nコード用復調器 Pending JPH05508976A (ja)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
DE4021343,9 1990-07-04
DE4021343A DE4021343A1 (de) 1990-07-04 1990-07-04 Demodulator fuer einen m/n-code
PCT/EP1991/001195 WO1992001349A1 (de) 1990-07-04 1991-06-26 DEMODULATOR FÜR EINEN m/n-CODE

Publications (1)

Publication Number Publication Date
JPH05508976A true JPH05508976A (ja) 1993-12-09

Family

ID=6409670

Family Applications (1)

Application Number Title Priority Date Filing Date
JP91511083A Pending JPH05508976A (ja) 1990-07-04 1991-06-26 m/nコード用復調器

Country Status (6)

Country Link
EP (1) EP0538290B1 (ja)
JP (1) JPH05508976A (ja)
AT (1) ATE166509T1 (ja)
AU (1) AU8075491A (ja)
DE (2) DE4021343A1 (ja)
WO (1) WO1992001349A1 (ja)

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3685033A (en) * 1970-08-24 1972-08-15 Honeywell Inc Block encoding for magnetic recording systems

Also Published As

Publication number Publication date
EP0538290B1 (de) 1998-05-20
WO1992001349A1 (de) 1992-01-23
AU8075491A (en) 1992-02-04
DE4021343A1 (de) 1992-01-09
EP0538290A1 (de) 1993-04-28
DE59108991D1 (de) 1998-06-25
ATE166509T1 (de) 1998-06-15

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