JPH0555443A - 半導体装置 - Google Patents

半導体装置

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JPH0555443A
JPH0555443A JP3214937A JP21493791A JPH0555443A JP H0555443 A JPH0555443 A JP H0555443A JP 3214937 A JP3214937 A JP 3214937A JP 21493791 A JP21493791 A JP 21493791A JP H0555443 A JPH0555443 A JP H0555443A
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JP
Japan
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semiconductor element
semiconductor device
wire
insulating plate
fixed
Prior art date
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Pending
Application number
JP3214937A
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English (en)
Inventor
Kaoru Sonobe
薫 園部
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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Publication of JPH0555443A publication Critical patent/JPH0555443A/ja
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Abstract

(57)【要約】 【目的】半導体装置中の半導体素子1が小サイズ化し金
属細線3が長尺化しても、樹脂封止等の半導体装置製造
時に金属細線3がショートすることを防止し、小サイズ
の半導体素子1に対応可能な半導体装置を提供する。 【構成】ワイヤボンディング用金属細線3の少なくとも
一部が接着剤6あるいは熱可塑性樹脂を介して電気的絶
縁板5に固着され、かつ、電気的絶縁板5は、複数のリ
ード先端7に固着されている。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体装置に関し、特に
ワイヤボンディング用の金属細線により構成される半導
体装置に関する。
【0002】
【従来の技術】従来の半導体装置は、図3に示すよう
に、半導体素子1を搭載する半導体素子搭載台2とワイ
ヤボンディング用の金属細線3により半導体素子1に接
続される複数のリード4を有しており、半導体素子1を
リードフレームの半導体素子搭載台2にAgペースト等
により固着させたのち、半導体素子1とリードフレーム
4とを金属細線3で接続して製造される。また、半導体
素子1を搭載する半導体素子搭載台2の端部表面と複数
のリード4の金属細線3接続部のリード先端7表面には
絶縁板5が固着されている。絶縁板5としては、例えば
セラミックスやポリイミド等の薄板を用いている(例え
ば、特願昭60−141712号公報参照)。
【0003】
【発明が解決しようとする課題】この従来の半導体装置
は、半導体素子を搭載する半導体素子搭載台の端部表面
と複数のリード先端部表面に絶縁板を固着したのみであ
るので、トランスファモールド法等により樹脂注入され
て半導体装置を成形する際に金属細線が変形を生じ、お
互いにショートしてしまうというような問題点があっ
た。
【0004】本発明の目的は、金属細線の変形によるシ
ョートのない半導体装置を提供することにある。
【0005】
【課題を解決するための手段】本発明は、複数の電極パ
ッドと、該複数の電極パッドに金属細線を介して接続す
るリードとを有する半導体装置において、前記金属細線
との接続部の前記リード先端に電気的絶縁物が固着さ
れ、前記金属細線の少くとも一部が接着剤と熱可塑性樹
脂とのうちのいずれか一方を介して前記絶縁板に固着さ
れている。
【0006】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
【0007】図1(a),(b)は本発明の第1の実施
例の平面図およびそのA−A′線断面図である。
【0008】第1の実施例は、図1(a),(b)に示
すように、半導体素子1を搭載する半導体素子搭載台2
とワイヤボンディング用の金属細線3により半導体素子
1に接続される複数のリード4のリード先端7がセラミ
ックスやポリイミド等の絶縁板5とエポキシ系の接着剤
等により固着されており、さらに、絶縁板5の表面の接
着剤6により金線等の金属細線3の少なくとも一部が絶
縁板5に固着されている。
【0009】これにより、リードフレームのリード4の
ピッチを微細化するか、金属細線3を長尺化しなければ
搭載が従来不可能であった比較的サイズの小さい半導体
素子1も搭載可能となる。
【0010】例えば、従来のエッチング技術で、リード
フレームの板厚が0.15mmの場合、製造可能なリー
ドピッチの最小値は0.22mm程度であり、ボンディ
ング可能な最長金属細線3の長さを3.5mmとした場
合、296ピンのプラスチックQFP(Quad Fl
at Package)では、14mm角以下の半導体
素子1の搭載は不可能であったが、本実施例により14
mm角以下でも搭載可能となった。また、樹脂封止時の
金属細線の変形によるショートもなくなった。
【0011】図2(a),(b)は本発明の第2の実施
例の平面図およびそのB−B′線断面図である。第2の
実施例は、図2(a),(b)に示すように、ワイヤボ
ンディング用金属細線3を電気的絶縁板5に熱可塑性樹
脂9で固着し、かつ、図1(a),(b)の半導体素子
搭載台2が取り除かれた例であり、より薄型の半導体装
置が製作可能となっている。熱可塑性樹脂は200℃程
度以上のワイヤボンディング時に軟化し、ワイヤボンデ
ィング後の温度で硬化するようにしている。
【0012】このことにより、複数のワイヤボンディン
グ用金属細線3で半導体素子1を保持することが可能と
なる。
【0013】
【発明の効果】以上説明したように本発明は、ワイヤボ
ンディング用金属細線の少なくとも一部をリード先端部
に固着した電気的絶縁板に接着剤、あるいは、熱可塑性
樹脂を介して固着したので、樹脂注入による半導体装置
製造時における金属細線の変形によるショートを防止
し、かつ、サイズの小さい半導体素子も金属細線の長さ
にかかわらず同一のリードパターンで搭載が可能である
という効果を有する。
【0014】また、半導体素子搭載台部を取り除くこと
も可能で、より薄型の半導体装置に対応できるという効
果も有する。
【図面の簡単な説明】
【図1】本発明の第1の実施例の平面図およびそのA−
A′線断面図である。
【図2】本発明の第2の実施例の平面図およびそのB−
B′線断面図である。
【図3】従来の半導体装置の一例の平面図およびそのC
−C′線断面図である。
【符号の説明】
1 半導体素子 2 半導体素子搭載台 3 金属細線 4 リード 5 絶縁板 6 接着剤 7 リード先端 8 搭載台リード 9 熱可塑性樹脂

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 複数の電極パッドと、該複数の電極パッ
    ドに金属細線を介して接続するリードとを有する半導体
    装置において、前記金属細線との接続部の前記リード先
    端に電気的絶縁物が固着され、前記金属細線の少くとも
    一部が接着剤と熱可塑性樹脂とのうちのいずれか一方を
    介して前記絶縁板に固着されていることを特徴とする半
    導体装置。
JP3214937A 1991-08-27 1991-08-27 半導体装置 Pending JPH0555443A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3214937A JPH0555443A (ja) 1991-08-27 1991-08-27 半導体装置

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Application Number Priority Date Filing Date Title
JP3214937A JPH0555443A (ja) 1991-08-27 1991-08-27 半導体装置

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JPH0555443A true JPH0555443A (ja) 1993-03-05

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ID=16664045

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JP3214937A Pending JPH0555443A (ja) 1991-08-27 1991-08-27 半導体装置

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