JPH0561993A - 定積分回路 - Google Patents
定積分回路Info
- Publication number
- JPH0561993A JPH0561993A JP22326191A JP22326191A JPH0561993A JP H0561993 A JPH0561993 A JP H0561993A JP 22326191 A JP22326191 A JP 22326191A JP 22326191 A JP22326191 A JP 22326191A JP H0561993 A JPH0561993 A JP H0561993A
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- JP
- Japan
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- operational amplifier
- output
- ground
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- terminal
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- Granted
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- 239000003990 capacitor Substances 0.000 claims abstract description 14
- 230000010354 integration Effects 0.000 abstract description 11
- 238000007599 discharging Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 5
- 238000009825 accumulation Methods 0.000 description 1
- HODRFAVLXIFVTR-RKDXNWHRSA-N tevenel Chemical compound NS(=O)(=O)C1=CC=C([C@@H](O)[C@@H](CO)NC(=O)C(Cl)Cl)C=C1 HODRFAVLXIFVTR-RKDXNWHRSA-N 0.000 description 1
Landscapes
- Amplifiers (AREA)
Abstract
(57)【要約】
【目的】積分前及び積分後の出力電圧及び積分時間を正
確に指定でき、且つ積分出力を直線的に時間変化させ得
る積分回路を提供する。 【構成】オペアンプ３の入力端と出力端とを接続しボル
テージフォロア回路構成として、その出力に電荷蓄積、
放出用のコンデンサ４を接続し出力端子に導き、オペア
ンプ３の正、負電源端子にそれぞれ定電流源１，２を接
続し、オペアンプ３のプラス入力端を入力端子とした構
成を持つ。
確に指定でき、且つ積分出力を直線的に時間変化させ得
る積分回路を提供する。 【構成】オペアンプ３の入力端と出力端とを接続しボル
テージフォロア回路構成として、その出力に電荷蓄積、
放出用のコンデンサ４を接続し出力端子に導き、オペア
ンプ３の正、負電源端子にそれぞれ定電流源１，２を接
続し、オペアンプ３のプラス入力端を入力端子とした構
成を持つ。
Description
【０００１】
【産業上の利用分野】本発明は定積分回路に関する。
【０００２】
【従来の技術】従来の定積分回路としては、図３に示す
ような回路がある。オペアンプ９の入力端を直流入力端
子Ｉinとし、オペアンプ９の入力端および出力端の間に
コンデンサ１０を接続し、オペアンプ９の出力端を電圧
出力端子Ｖout とし、またオペアンプ９の２つの電源端
とグランドとの間にそれぞれ定電圧源１１，１２を接続
してある。直流入力端子から電流が入力されると、その
入力電流の大きさとコンデンサ１０の容量とで決まる時
間で出力電圧Ｖout が最大でオペアンプ９の電源電圧１
１，１２まで変化する。
ような回路がある。オペアンプ９の入力端を直流入力端
子Ｉinとし、オペアンプ９の入力端および出力端の間に
コンデンサ１０を接続し、オペアンプ９の出力端を電圧
出力端子Ｖout とし、またオペアンプ９の２つの電源端
とグランドとの間にそれぞれ定電圧源１１，１２を接続
してある。直流入力端子から電流が入力されると、その
入力電流の大きさとコンデンサ１０の容量とで決まる時
間で出力電圧Ｖout が最大でオペアンプ９の電源電圧１
１，１２まで変化する。
【０００３】
【発明が解決しようとする課題】この従来の定積分回路
は、積分前または積分後の出力電圧を正確に指定するこ
とが出来ない上に、出力電圧を直線的に時間変化させる
には、入力電流Ｉinを定電流としなければならない。
は、積分前または積分後の出力電圧を正確に指定するこ
とが出来ない上に、出力電圧を直線的に時間変化させる
には、入力電流Ｉinを定電流としなければならない。
【０００４】
【課題を解決するための手段】本発明の定積分回路は、
オペアンプのマイナス入力端と出力端と積分用のコンデ
ンサの一端とを接続した接続点を出力端子とし、前記コ
ンデンサの他端をグランドに接続し、前記オペアンプの
プラス電源端とグランドとの間に前記グランドから前記
プラス電源端へ直流電流が流れるように第１の定電流源
を接続し、また前記オペアンプのマイナス電源端とグラ
ンドとの間に前記マイナス電源端から前記グランドへ直
流電流が流れるように第２の定電流源を接続し、前記オ
ペアンプのプラス入力端を入力端子とした構成を有して
いる。
オペアンプのマイナス入力端と出力端と積分用のコンデ
ンサの一端とを接続した接続点を出力端子とし、前記コ
ンデンサの他端をグランドに接続し、前記オペアンプの
プラス電源端とグランドとの間に前記グランドから前記
プラス電源端へ直流電流が流れるように第１の定電流源
を接続し、また前記オペアンプのマイナス電源端とグラ
ンドとの間に前記マイナス電源端から前記グランドへ直
流電流が流れるように第２の定電流源を接続し、前記オ
ペアンプのプラス入力端を入力端子とした構成を有して
いる。
【０００５】
【実施例】次に本発明について図面を参照して説明す
る。
る。
【０００６】図１は本発明の一実施例の回路図である。
オペアンプ３のマイナス入力端と出力端とを接続し、そ
の接続点とグランドとの間にコンデンサ４を接続し、オ
ペアンプ３のプラス電源端とグランドとの間にグランド
からプラス電源端へ直流電流が流れるように定電流源１
を接続し、またオペアンプ３のマイナス電源端とグラン
ドとの間に、マイナス電源端からグランドへ直流電流が
流れるように定電流源２を接続し、オプアンプ３のプラ
ス入力端を電圧入力端子Ｖinとし、オペアンプ３の出力
端を電圧出力端子Ｖout とする。
オペアンプ３のマイナス入力端と出力端とを接続し、そ
の接続点とグランドとの間にコンデンサ４を接続し、オ
ペアンプ３のプラス電源端とグランドとの間にグランド
からプラス電源端へ直流電流が流れるように定電流源１
を接続し、またオペアンプ３のマイナス電源端とグラン
ドとの間に、マイナス電源端からグランドへ直流電流が
流れるように定電流源２を接続し、オプアンプ３のプラ
ス入力端を電圧入力端子Ｖinとし、オペアンプ３の出力
端を電圧出力端子Ｖout とする。
【０００７】図２は本実施例の動作を例示する電圧波形
図である。図１の電圧入力端子に図２の入力電圧波形Ｖ
inが入力された場合、図１の電圧出力端子には図２の出
力電圧波形Ｖout が得られる。図２の入力電圧波形Ｖin
は時刻ａまで０［ｖ］を維持しているが、時刻ａに於て
ｖ［Ｖ］までステップ状に変化する。図１のオペアンプ
３はボルテージフォロア回路構成となっているため、出
力電圧Ｖout は入力電圧Ｖin（ｖ［Ｖ］）に等しくなる
ように制御される。この時、図１のコンデンサ４にｖ
［Ｖ］を発生させるに十分な電荷を蓄積する必要があ
る。この電荷蓄積は、オペアンプ３の出力端からの吐き
出し電流によって行われるが、その電流は定電流源１に
よって制限されている。すなわち、定電流源１の電流の
大きさとコンデンサ４の容量とによって充電時間ｔ1 が
決まる。出力電圧波形Ｖoutは、時刻ａからｔ1 後に電
圧ｖ［Ｖ］へ到達する。この状態は入力電圧波形Ｖinが
変化しない限り、持続される。
図である。図１の電圧入力端子に図２の入力電圧波形Ｖ
inが入力された場合、図１の電圧出力端子には図２の出
力電圧波形Ｖout が得られる。図２の入力電圧波形Ｖin
は時刻ａまで０［ｖ］を維持しているが、時刻ａに於て
ｖ［Ｖ］までステップ状に変化する。図１のオペアンプ
３はボルテージフォロア回路構成となっているため、出
力電圧Ｖout は入力電圧Ｖin（ｖ［Ｖ］）に等しくなる
ように制御される。この時、図１のコンデンサ４にｖ
［Ｖ］を発生させるに十分な電荷を蓄積する必要があ
る。この電荷蓄積は、オペアンプ３の出力端からの吐き
出し電流によって行われるが、その電流は定電流源１に
よって制限されている。すなわち、定電流源１の電流の
大きさとコンデンサ４の容量とによって充電時間ｔ1 が
決まる。出力電圧波形Ｖoutは、時刻ａからｔ1 後に電
圧ｖ［Ｖ］へ到達する。この状態は入力電圧波形Ｖinが
変化しない限り、持続される。
【０００８】次いで、時刻ｂに波形Ｖinがｖ［Ｖ］から
０［Ｖ］に変化すると、オペアンプ３のボルテージフォ
ロア回路の動作によって、出力電圧Ｖout は入力電圧Ｖ
in（０［Ｖ］）に等しくなるように制御される。その時
図１のコンデンサ４には電圧ｖ［Ｖ］を発生させる電荷
が蓄積されているので、この電荷を全て放電させなけれ
ばならない。この電荷放電は、オペアンプ３の出力端へ
の吸い込み電流によって行われれが、その電流は定電流
源２によって制限されている。つまり、定電流源２の電
流の大きさとコンデンサ４の容量とによって放電時間ｔ
2 が決まる。
０［Ｖ］に変化すると、オペアンプ３のボルテージフォ
ロア回路の動作によって、出力電圧Ｖout は入力電圧Ｖ
in（０［Ｖ］）に等しくなるように制御される。その時
図１のコンデンサ４には電圧ｖ［Ｖ］を発生させる電荷
が蓄積されているので、この電荷を全て放電させなけれ
ばならない。この電荷放電は、オペアンプ３の出力端へ
の吸い込み電流によって行われれが、その電流は定電流
源２によって制限されている。つまり、定電流源２の電
流の大きさとコンデンサ４の容量とによって放電時間ｔ
2 が決まる。
【０００９】以上のようにして、本実施例では積分前及
び積分後の出力電圧と積分時間とを高精度に指定するこ
とが出来、かつ出力電圧を直線的に時間変化させること
が可能になる。
び積分後の出力電圧と積分時間とを高精度に指定するこ
とが出来、かつ出力電圧を直線的に時間変化させること
が可能になる。
【００１０】
【発明の効果】以上説明したように本発明によれば、オ
ぺアンプをボルテージフォロア回路構成としそのオペア
ンプ出力にコンデンサを接続しオペアンプの電源部を定
電流にすることにより、積分前及び積分後の出力電圧及
び積分時間を高精度に設定出来、また積分出力を直線的
に時間変化させることが出来る。
ぺアンプをボルテージフォロア回路構成としそのオペア
ンプ出力にコンデンサを接続しオペアンプの電源部を定
電流にすることにより、積分前及び積分後の出力電圧及
び積分時間を高精度に設定出来、また積分出力を直線的
に時間変化させることが出来る。
【図１】本発明の実施例の回路図。
【図２】図１の回路動作を例示する信号波形図。
【図３】従来の定積分回路の回路図。
１，２ 定電流源 ３，９ オペアンプ ４，１０ コンデンサ １１，１２ 定電圧源
Claims (1)
- 【請求項１】 オペアンプのマイナス入力端と出力端と
積分用のコンデンサの一端とを接続した接続点を出力端
子とし、前記コンデンサの他端をグランドに接続し、前
記オペアンプのプラス電源端とグランドとの間に前記グ
ランドから前記プラス電源端へ直流電流が流れるように
第１の定電流源を接続し、また前記オペアンプのマイナ
ス電源端とグランドとの間に前記マイナス電源端から前
記グランドへ直流電流が流れるように第２の定電流源を
接続し、前記オペアンプのプラス入力端を入力端子とし
た構成を有している事を特徴とする定積分回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22326191A JP2723704B2 (ja) | 1991-09-04 | 1991-09-04 | 定積分回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22326191A JP2723704B2 (ja) | 1991-09-04 | 1991-09-04 | 定積分回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0561993A true JPH0561993A (ja) | 1993-03-12 |
| JP2723704B2 JP2723704B2 (ja) | 1998-03-09 |
Family
ID=16795337
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22326191A Expired - Lifetime JP2723704B2 (ja) | 1991-09-04 | 1991-09-04 | 定積分回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2723704B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8779642B2 (en) | 2009-02-18 | 2014-07-15 | Sumitomo Electric Industries, Ltd. | Electric power distribution member for stator and method of manufacturing the same |
-
1991
- 1991-09-04 JP JP22326191A patent/JP2723704B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8779642B2 (en) | 2009-02-18 | 2014-07-15 | Sumitomo Electric Industries, Ltd. | Electric power distribution member for stator and method of manufacturing the same |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2723704B2 (ja) | 1998-03-09 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19971104 |