JPH0571118B2 - - Google Patents
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- Publication number
- JPH0571118B2 JPH0571118B2 JP60269083A JP26908385A JPH0571118B2 JP H0571118 B2 JPH0571118 B2 JP H0571118B2 JP 60269083 A JP60269083 A JP 60269083A JP 26908385 A JP26908385 A JP 26908385A JP H0571118 B2 JPH0571118 B2 JP H0571118B2
- Authority
- JP
- Japan
- Prior art keywords
- image
- image memory
- memory
- display
- signals
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、高解像度画像を帯域に制限のあるラ
イン系を介して伝送する送信機と、送信機から伝
送された信号を受信し、表示手段に表示させる受
信機とからなる画像表示装置に関するものであ
る。
イン系を介して伝送する送信機と、送信機から伝
送された信号を受信し、表示手段に表示させる受
信機とからなる画像表示装置に関するものであ
る。
(従来の技術)
高解像度画像をCRTのような表示手段に表示
させる手法として、従来よりインタレース走査方
式が公知である。この方式は、2つのフレームに
よる走査線を互にずらせて表示するものである
が、ゆつくりしたリフレツシユレートでは、表示
がちらつくという問題点がある。この方式による
ちらつきを防ぐために、2つのフレームをリアル
タイムでそれぞれ画像メモリに取り込み、これを
合成した画像を速いリフレツシユレートで表示手
段に読み出し、表示するという手法もある。
させる手法として、従来よりインタレース走査方
式が公知である。この方式は、2つのフレームに
よる走査線を互にずらせて表示するものである
が、ゆつくりしたリフレツシユレートでは、表示
がちらつくという問題点がある。この方式による
ちらつきを防ぐために、2つのフレームをリアル
タイムでそれぞれ画像メモリに取り込み、これを
合成した画像を速いリフレツシユレートで表示手
段に読み出し、表示するという手法もある。
一方、リアルタイム画像の伝送は、1Km程度ま
では普通に行なわれている。しかしながら、一般
的な伝送ラインの伝送能力は、例えば15MHzで1
Km程度であり、それ故にこれ以上の長距離に、一
般的な伝送ラインを用いて複数のリアルタイム画
像あるいは高解像度画像を伝送することは困難で
ある。
では普通に行なわれている。しかしながら、一般
的な伝送ラインの伝送能力は、例えば15MHzで1
Km程度であり、それ故にこれ以上の長距離に、一
般的な伝送ラインを用いて複数のリアルタイム画
像あるいは高解像度画像を伝送することは困難で
ある。
(発明が解決しようとする問題点)
本発明は、このような問題点に鑑みてなされた
もので、その目的は、帯域に制限のある一般的な
伝送ラインを用いて高解像度画像を伝送、表示す
ることの可能な画像表示装置を実現しようとする
ものである。
もので、その目的は、帯域に制限のある一般的な
伝送ラインを用いて高解像度画像を伝送、表示す
ることの可能な画像表示装置を実現しようとする
ものである。
(問題点を解決するための手段)
このような目的を達成する本発明は、画像メモ
リと、この画像メモリ上に描画を行なうとともに
画像の更新を行なう制御プロセツサと、水平、垂
直同期信号及び表示アドレスを出力するCRTコ
ントローラと、このCRTコントローラとともに
動作し定められたフレームの数だけ前記画像メモ
リ中の画像をスキヤンし当該画像信号を送信する
手段とからなる送信機、この送信機から出力され
る水平、垂直同期信号及び画像信号を伝送する伝
送ライン、この伝送ラインを介して送られた画像
信号が書き込まれるデユアルポートメモリで構成
された画像メモリと、この画像メモリから読み出
された画像信号を表示する表示手段と、前記画像
メモリに格納された画像信号を切換スイツチ手段
によつて指定された場所だけ前記表示手段に選択
して読み出す手段と、前記画像メモリに格納され
た画像信号を前記表示手段に原画像が再構成され
るように読み出す手段とからなる受信機を備えて
構成される。
リと、この画像メモリ上に描画を行なうとともに
画像の更新を行なう制御プロセツサと、水平、垂
直同期信号及び表示アドレスを出力するCRTコ
ントローラと、このCRTコントローラとともに
動作し定められたフレームの数だけ前記画像メモ
リ中の画像をスキヤンし当該画像信号を送信する
手段とからなる送信機、この送信機から出力され
る水平、垂直同期信号及び画像信号を伝送する伝
送ライン、この伝送ラインを介して送られた画像
信号が書き込まれるデユアルポートメモリで構成
された画像メモリと、この画像メモリから読み出
された画像信号を表示する表示手段と、前記画像
メモリに格納された画像信号を切換スイツチ手段
によつて指定された場所だけ前記表示手段に選択
して読み出す手段と、前記画像メモリに格納され
た画像信号を前記表示手段に原画像が再構成され
るように読み出す手段とからなる受信機を備えて
構成される。
(実施例)
第1図は本発明装置の全体構成概念図である。
図において、TRは送信機で、CRTコントローラ
と画像メモリとを含んで構成されており、画像デ
ータと、水平、垂直同期信号とを出力する。RE
は伝送ラインLNを介して画像データ、水平、垂
直同期信号を入力する受信機で、デユアルポート
メモリ、CRTのような表示手段を含んで構成さ
れている。
図において、TRは送信機で、CRTコントローラ
と画像メモリとを含んで構成されており、画像デ
ータと、水平、垂直同期信号とを出力する。RE
は伝送ラインLNを介して画像データ、水平、垂
直同期信号を入力する受信機で、デユアルポート
メモリ、CRTのような表示手段を含んで構成さ
れている。
第2図は送信機TRの構成ブロツク図である。
1は制御プロセツサ、2は水平同期信号
HSYNC、垂直同期信号VSYNC及び表示アドレ
スを出力するCRTコントローラで、制御プロセ
ツサ1によつて制御される。3は画像データを格
納する画像メモリで、制御プロセツサ1からの指
令によりデータをリード(Read)/ライト
(Write)可能である。4は垂直同期信号VSYNC
を入力するカウンタで、予じめセツトしたフレー
ム番号Nになるとリセツトし、同時にNフレーム
(FRAME)信号を出力する。また、このカウン
タ4は、垂直同期信号VSYNCの数をカウンタト
した結果を、フレームナンバ(FRAMENO)と
して出力する。5は水平、垂直同期信号及びカウ
ンタ4からのNフレーム信号を入力する遅れ回
路、Nフレーム信号が来ると垂直同期信号
VSYNCを1/2水平スキヤン時間分だけ遅らせ、
これを受信機側に送信する。6,9はバスの切替
手段、7はカウンタ4からのフレームナンバによ
つて固有の画像メモリ3上のオフセツト値を記憶
するオフセツト値テーブルである。切替手段6は
このテーブル7を制御プロセツサ1からプログラ
ムする時用いられる。8はCRTコントローラ2
から出力される表示アドレスと、オフセツト値テ
ーブル7から出力されるオフセツトアドレスを加
算する加算器で、ここからの表示アドレスは、切
替手段9を介して画像メモリ3に与えられ、当該
表示アドレスのRGBのビデオ信号が受信機側に
送信される。
1は制御プロセツサ、2は水平同期信号
HSYNC、垂直同期信号VSYNC及び表示アドレ
スを出力するCRTコントローラで、制御プロセ
ツサ1によつて制御される。3は画像データを格
納する画像メモリで、制御プロセツサ1からの指
令によりデータをリード(Read)/ライト
(Write)可能である。4は垂直同期信号VSYNC
を入力するカウンタで、予じめセツトしたフレー
ム番号Nになるとリセツトし、同時にNフレーム
(FRAME)信号を出力する。また、このカウン
タ4は、垂直同期信号VSYNCの数をカウンタト
した結果を、フレームナンバ(FRAMENO)と
して出力する。5は水平、垂直同期信号及びカウ
ンタ4からのNフレーム信号を入力する遅れ回
路、Nフレーム信号が来ると垂直同期信号
VSYNCを1/2水平スキヤン時間分だけ遅らせ、
これを受信機側に送信する。6,9はバスの切替
手段、7はカウンタ4からのフレームナンバによ
つて固有の画像メモリ3上のオフセツト値を記憶
するオフセツト値テーブルである。切替手段6は
このテーブル7を制御プロセツサ1からプログラ
ムする時用いられる。8はCRTコントローラ2
から出力される表示アドレスと、オフセツト値テ
ーブル7から出力されるオフセツトアドレスを加
算する加算器で、ここからの表示アドレスは、切
替手段9を介して画像メモリ3に与えられ、当該
表示アドレスのRGBのビデオ信号が受信機側に
送信される。
第3図は受信機REの構成ブロツク図である。
20はNフレーム検出回路、21はカウンタで、
これらは垂直同期信号VSYNCを入力している。
Nフレーム検出回路20は、同期フレームを検出
すると、カウンタ21をリセツトし、カウンタ2
1は垂直同期信号VSYNCをカウントし、それを
フレームナンバとして出力する。22はフレーム
ナンバを入力するオフセツト値テーブルで、後述
する画像メモリ25へ書き込む際の、各フレーム
のオフセツトアドレスを出力する。23は加算
器、24はDMAコントローラである。DMAコ
ントローラ24は水平、垂直同期信号HSYNC,
VSYNCを入力し、画像メモリ25への書き込み
アドレスを出力する。加算器23はオフセツト値
テーブル22からのオフセツトアドレスと、
DMAコントローラ24からの書き込みアドレス
とを加算し、各フレームの書き込みアドレスを切
替手段26を介して、画像メモリ25に与える。
画像メモリ25は、デユアルポートメモリで構成
されており、書き込みアドレスに同期して送られ
てくるR,G,Bのビデオ信号が書き込まれる。
また、切替手段26を介してCRTコントローラ
27から、読み出しアドレスが与えられ、そのア
ドレスに格納されたビデオ信号が表示手段として
のCRT30に読み出される。28は制御プロセ
ツサ、29は切換スイツチで、これらは高解像度
画像の伝送モード、多重画像の伝送モードの切換
えや、画面の切換え、オフセツトテーブル22の
データの書き換え等の制御を行なう。
20はNフレーム検出回路、21はカウンタで、
これらは垂直同期信号VSYNCを入力している。
Nフレーム検出回路20は、同期フレームを検出
すると、カウンタ21をリセツトし、カウンタ2
1は垂直同期信号VSYNCをカウントし、それを
フレームナンバとして出力する。22はフレーム
ナンバを入力するオフセツト値テーブルで、後述
する画像メモリ25へ書き込む際の、各フレーム
のオフセツトアドレスを出力する。23は加算
器、24はDMAコントローラである。DMAコ
ントローラ24は水平、垂直同期信号HSYNC,
VSYNCを入力し、画像メモリ25への書き込み
アドレスを出力する。加算器23はオフセツト値
テーブル22からのオフセツトアドレスと、
DMAコントローラ24からの書き込みアドレス
とを加算し、各フレームの書き込みアドレスを切
替手段26を介して、画像メモリ25に与える。
画像メモリ25は、デユアルポートメモリで構成
されており、書き込みアドレスに同期して送られ
てくるR,G,Bのビデオ信号が書き込まれる。
また、切替手段26を介してCRTコントローラ
27から、読み出しアドレスが与えられ、そのア
ドレスに格納されたビデオ信号が表示手段として
のCRT30に読み出される。28は制御プロセ
ツサ、29は切換スイツチで、これらは高解像度
画像の伝送モード、多重画像の伝送モードの切換
えや、画面の切換え、オフセツトテーブル22の
データの書き換え等の制御を行なう。
このように構成した装置の動作を次に、複数画
面の多重伝送を行なう場合と、高解像度画像の伝
送を行なう場合とに分けて説明する。
面の多重伝送を行なう場合と、高解像度画像の伝
送を行なう場合とに分けて説明する。
(複数画面の多重伝送を行なう場合)
第4図はこの場合の動作説明図である。ここで
は伝送ラインLNに3組の受信機が結合している
場合を例示する。
は伝送ラインLNに3組の受信機が結合している
場合を例示する。
制御プロセツサ1は、英文字、漢字文字、グラ
フ等画面表示のためのプログラムで構成される複
数個の画面表示タスクA〜Nをリアルタイムで実
行し、画像メモリ3上に描画を行ない、また、画
像の更新を行なつている。CRTコントローラ2
は、カウンタ4、オフセツト値テーブル7及び加
算器8で構成されるマツピングコントローラ10
と共に動作し、定められたフレームの数だけ、画
像メモリ3中の画像をスキヤンし、これを伝送ラ
インLNを介して送信する。
フ等画面表示のためのプログラムで構成される複
数個の画面表示タスクA〜Nをリアルタイムで実
行し、画像メモリ3上に描画を行ない、また、画
像の更新を行なつている。CRTコントローラ2
は、カウンタ4、オフセツト値テーブル7及び加
算器8で構成されるマツピングコントローラ10
と共に動作し、定められたフレームの数だけ、画
像メモリ3中の画像をスキヤンし、これを伝送ラ
インLNを介して送信する。
受信機REにおいて、デユアルポートメモリで
構成された画像メモリ25は、伝送送信機LNを
介して送られた画像信号を、フレームの順番に格
納する。画像メモリ25に格納された画像信号
は、切換スイツチ29によつて指定された場所だ
け、CRTコントローラ27で選択的に繰返して
読み出され、CRT30に所望の画像が表示され
る。
構成された画像メモリ25は、伝送送信機LNを
介して送られた画像信号を、フレームの順番に格
納する。画像メモリ25に格納された画像信号
は、切換スイツチ29によつて指定された場所だ
け、CRTコントローラ27で選択的に繰返して
読み出され、CRT30に所望の画像が表示され
る。
このような動作によつて、nフレームで1回の
リフレツシユサイクルとすれば、n枚の半リアル
タイム画像(リアルタイム画像よりも、多少リフ
レツシユ周期の長い画像)を同時に伝送すること
ができる。例えば、通常1枚の画像を送る時に、
1秒に60枚程度送つていたとすると、枚数を増加
させれば、それだけ画像更新周期が長くなるわけ
で、2枚にすれば、1秒に30枚となる。
リフレツシユサイクルとすれば、n枚の半リアル
タイム画像(リアルタイム画像よりも、多少リフ
レツシユ周期の長い画像)を同時に伝送すること
ができる。例えば、通常1枚の画像を送る時に、
1秒に60枚程度送つていたとすると、枚数を増加
させれば、それだけ画像更新周期が長くなるわけ
で、2枚にすれば、1秒に30枚となる。
また、送信機TRからの画像信号の伝送を、図
示するようにマルチドロツプで3組の受信機RE
に送信すれば、各受信機毎に異なる画面を見るこ
とができる。
示するようにマルチドロツプで3組の受信機RE
に送信すれば、各受信機毎に異なる画面を見るこ
とができる。
(高解像度画像の伝送を行なう場合)
第5図はこの場合の動作説明図である。制御プ
ロセツサ1は、複数の画面表示タスクA〜Nをリ
アルタイムで実行し、画像メモリ3上に複数の高
解像度の画像の描画を行ない、また、画像の更新
を行なつている。CRTコントローラ2は、マツ
ピングコントローラ10と共に動作し、高解像度
画像を図示するように複数(ここでは〜の4
個)のフレームに分割し、画像信号を送信する。
ロセツサ1は、複数の画面表示タスクA〜Nをリ
アルタイムで実行し、画像メモリ3上に複数の高
解像度の画像の描画を行ない、また、画像の更新
を行なつている。CRTコントローラ2は、マツ
ピングコントローラ10と共に動作し、高解像度
画像を図示するように複数(ここでは〜の4
個)のフレームに分割し、画像信号を送信する。
受信機REにおいて、画像メモリ25は伝送さ
れた複数フレームの画像信号を順次格納する。
CRTコントローラ27は、送信機TRでの送出手
法に合わせて、画像メモリ25に格納されている
画像信号を、原画像が再構成できるように読み出
し、CRT30に表示させる。
れた複数フレームの画像信号を順次格納する。
CRTコントローラ27は、送信機TRでの送出手
法に合わせて、画像メモリ25に格納されている
画像信号を、原画像が再構成できるように読み出
し、CRT30に表示させる。
このような動作によつて、nフレーム分の画像
データにより、1枚の高解像度画像の構成データ
を送信し、CRT30に高解像度の画像を表示す
ることができる。
データにより、1枚の高解像度画像の構成データ
を送信し、CRT30に高解像度の画像を表示す
ることができる。
(発明の効果)
一般に、リアルタイム画像といえども、例えば
プロセス・オートメーシヨン用の運転画面等は、
画像の更新周期をそれほど短かくしなくとも(例
えば1秒に4〜5回程度でも)実用上問題とはな
らない。一方、CRTのような表示手段は、人間
の目の性質と、蛍光体のような発光素子の残光時
間との兼合いから、ちらつきのない画像を得るた
めには、最低でも1秒間に40枚程度の更新が必要
である。このため、現在実用化されている画像信
号の伝送ラインは、1秒当り50枚程度の画像信号
を伝送できるように作られている。そこで、この
差(秒5枚と50枚)に着目すると、10枚程度まで
は画像を多重伝送できることが分かる。この際、
従来は長残光蛍光体のCRT表示手段を用いてい
る。本発明においては、受信機REにデユアルポ
ートメモリで構成される画像メモリを用い、これ
を自由に読み出すようにしたもので、次のような
作用効果が生ずる。
プロセス・オートメーシヨン用の運転画面等は、
画像の更新周期をそれほど短かくしなくとも(例
えば1秒に4〜5回程度でも)実用上問題とはな
らない。一方、CRTのような表示手段は、人間
の目の性質と、蛍光体のような発光素子の残光時
間との兼合いから、ちらつきのない画像を得るた
めには、最低でも1秒間に40枚程度の更新が必要
である。このため、現在実用化されている画像信
号の伝送ラインは、1秒当り50枚程度の画像信号
を伝送できるように作られている。そこで、この
差(秒5枚と50枚)に着目すると、10枚程度まで
は画像を多重伝送できることが分かる。この際、
従来は長残光蛍光体のCRT表示手段を用いてい
る。本発明においては、受信機REにデユアルポ
ートメモリで構成される画像メモリを用い、これ
を自由に読み出すようにしたもので、次のような
作用効果が生ずる。
(a) n枚の半リアルタイム画像を伝送することに
より、受信機RE側ではスイツチによつて切替
えて見ることができる。また、伝送信号をマル
チドロツプで多数の受信機に送出すれば、各受
信機において異なつた画面を見ることができ
る。
より、受信機RE側ではスイツチによつて切替
えて見ることができる。また、伝送信号をマル
チドロツプで多数の受信機に送出すれば、各受
信機において異なつた画面を見ることができ
る。
(b) 高解像度画像も、n枚の半リアルタイム画像
に分割し伝送することにより、通信コストを上
げずに、受信機側の表示手段に表示を行なえ
る。
に分割し伝送することにより、通信コストを上
げずに、受信機側の表示手段に表示を行なえ
る。
第1図は本発明装置の全体構成概念図、第2図
は送信機の構成ブロツク図、第3図は受信機の構
成ブロツク図、第4図は複数画面の多重伝送を行
なう場合の動作説明図、第5図は高解像度画像の
伝送を行なう場合の動作説明図である。 TR…送信機、LN…伝送ライン、RE…受信
機、1,28…制御プロセツサ、3,25…画像
メモリ、2,27…CRTコントローラ、30…
表示手段。
は送信機の構成ブロツク図、第3図は受信機の構
成ブロツク図、第4図は複数画面の多重伝送を行
なう場合の動作説明図、第5図は高解像度画像の
伝送を行なう場合の動作説明図である。 TR…送信機、LN…伝送ライン、RE…受信
機、1,28…制御プロセツサ、3,25…画像
メモリ、2,27…CRTコントローラ、30…
表示手段。
Claims (1)
- 【特許請求の範囲】 1 画像メモリと、この画像メモリ上に描画を行
なうとともに画像の更新を行なう制御プロセツサ
と、水平、垂直同期信号及び表示アドレスを出力
するCRTコントローラと、このCRTコントロー
ラとともに動作し定められたフレームの数だけ前
記画像メモリ中の画像をスキヤンし当該画像信号
を送信する手段とからなる送信機、 この送信機から出力される水平、垂直同期信号
及び画像信号を伝送する伝送ライン、 この伝送ラインを介して送られた画像信号が書
き込まれるデユアルポートメモリで構成された画
像メモリと、この画像メモリから読み出された画
像信号を表示する表示手段と、前記画像メモリに
格納された画像信号を切換スイツチ手段によつて
指定された場所だけ前記表示手段に選択して読み
出す手段と、前記画像メモリに格納された画像信
号を前記表示手段に原画像が再構成されるように
読み出す手段とからなる受信機 を備えた画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60269083A JPS62127884A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60269083A JPS62127884A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62127884A JPS62127884A (ja) | 1987-06-10 |
| JPH0571118B2 true JPH0571118B2 (ja) | 1993-10-06 |
Family
ID=17467431
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60269083A Granted JPS62127884A (ja) | 1985-11-29 | 1985-11-29 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62127884A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3048153B2 (ja) * | 1987-12-23 | 2000-06-05 | テキサス インスツルメンツ インコーポレイテツド | メモリ回路とデータ・ストリームを記憶する方法 |
| JPH01201188A (ja) * | 1988-02-05 | 1989-08-14 | Nec Corp | 表示データ伝送装置 |
| JPH0490591A (ja) * | 1990-08-02 | 1992-03-24 | Hitachi Ltd | カラー液晶端末装置 |
-
1985
- 1985-11-29 JP JP60269083A patent/JPS62127884A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62127884A (ja) | 1987-06-10 |
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