JPH0583131A - クランプ付ａ／ｄ変換器 - Google Patents
クランプ付ａ／ｄ変換器Info
- Publication number
- JPH0583131A JPH0583131A JP3245843A JP24584391A JPH0583131A JP H0583131 A JPH0583131 A JP H0583131A JP 3245843 A JP3245843 A JP 3245843A JP 24584391 A JP24584391 A JP 24584391A JP H0583131 A JPH0583131 A JP H0583131A
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- JP
- Japan
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- signal
- clamp
- video signal
- circuit
- clamped
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Abstract
(57)【要約】
【目的】 映像信号から同期信号を抽出するための特別
な回路を必要としないクランプ付Ａ／Ｄ変換器を実現し
て、回路規模の縮小化を図る。 【構成】 アンダーフロー出力付Ａ／Ｄ変換回路４を採
用する。このＡ／Ｄ変換回路４は、映像信号ａ中の同期
信号の到来をアンダーフロー信号ｂによりクランプパル
ス発生回路７に伝える機能を有するものである。クラン
プパルス発生回路７は、アンダーフロー信号ｂに応答し
てクランプパルスｃを生成する。クランプ回路３は、ク
ランプパルスｃに応答して映像信号ａをクランプするも
のである。この際、映像信号ａは、ペデスタルレベルが
クランプレベル入力端子２を通して設定されたクランプ
レベルにクランプされたうえでＡ／Ｄ変換回路４に与え
られる。
な回路を必要としないクランプ付Ａ／Ｄ変換器を実現し
て、回路規模の縮小化を図る。 【構成】 アンダーフロー出力付Ａ／Ｄ変換回路４を採
用する。このＡ／Ｄ変換回路４は、映像信号ａ中の同期
信号の到来をアンダーフロー信号ｂによりクランプパル
ス発生回路７に伝える機能を有するものである。クラン
プパルス発生回路７は、アンダーフロー信号ｂに応答し
てクランプパルスｃを生成する。クランプ回路３は、ク
ランプパルスｃに応答して映像信号ａをクランプするも
のである。この際、映像信号ａは、ペデスタルレベルが
クランプレベル入力端子２を通して設定されたクランプ
レベルにクランプされたうえでＡ／Ｄ変換回路４に与え
られる。
Description
【０００１】
【産業上の利用分野】本発明は、入力アナログ信号を所
定のレベルにクランプしたうえでデジタル信号に変換す
る機能を有するクランプ付Ａ／Ｄ変換器に関するもので
ある。
定のレベルにクランプしたうえでデジタル信号に変換す
る機能を有するクランプ付Ａ／Ｄ変換器に関するもので
ある。
【０００２】
【従来の技術】近年、デジタル信号処理システムが増え
ている。このシステムでアナログ信号を取り扱うには、
アナログ信号をデジタル信号に変換するためのＡ／Ｄ変
換器が不可欠である。特にアナログ映像信号を入力とす
るデジタル信号処理システムでは、映像信号のペデスタ
ルレベルを所定のクランプレベルにクランプすることに
よって該映像信号をＡ／Ｄ変換に適したレベルに調整し
たうえで、該映像信号をデジタル信号に変換する必要が
ある。そこで、クランプ付Ａ／Ｄ変換器が必要になる。
ている。このシステムでアナログ信号を取り扱うには、
アナログ信号をデジタル信号に変換するためのＡ／Ｄ変
換器が不可欠である。特にアナログ映像信号を入力とす
るデジタル信号処理システムでは、映像信号のペデスタ
ルレベルを所定のクランプレベルにクランプすることに
よって該映像信号をＡ／Ｄ変換に適したレベルに調整し
たうえで、該映像信号をデジタル信号に変換する必要が
ある。そこで、クランプ付Ａ／Ｄ変換器が必要になる。
【０００３】図３は、映像信号を取り扱う従来のクラン
プ付Ａ／Ｄ変換器のブロック図である。同図において１
１は、同期信号と該同期信号に続くアナログ画像信号と
を有する映像信号ｅを入力するための映像信号入力端子
である。１２は、クランプレベルを設定するためのクラ
ンプレベル入力端子である。１３は、クランプレベル入
力端子１２を通して設定されたクランプレベルに映像信
号ｅのペデスタルレベルをクランプするためのクランプ
回路であって、クランプパルスｇに応答して動作するも
のである。１４は映像信号ｅから同期信号を抽出するた
めの同期分離回路、１５は抽出された同期信号ｆに基づ
いて前記クランプ回路１３に与えるクランプパルスｇを
生成するためのクランプパルス発生回路である。１６
は、クランプ回路１３からクランプされた映像信号ｈの
入力を受け、該クランプされた映像信号ｈのうちのアナ
ログ画像信号をデジタル信号に変換するためのＡ／Ｄ変
換回路である。１７は、該Ａ／Ｄ変換回路１６のデジタ
ル出力端子である。
プ付Ａ／Ｄ変換器のブロック図である。同図において１
１は、同期信号と該同期信号に続くアナログ画像信号と
を有する映像信号ｅを入力するための映像信号入力端子
である。１２は、クランプレベルを設定するためのクラ
ンプレベル入力端子である。１３は、クランプレベル入
力端子１２を通して設定されたクランプレベルに映像信
号ｅのペデスタルレベルをクランプするためのクランプ
回路であって、クランプパルスｇに応答して動作するも
のである。１４は映像信号ｅから同期信号を抽出するた
めの同期分離回路、１５は抽出された同期信号ｆに基づ
いて前記クランプ回路１３に与えるクランプパルスｇを
生成するためのクランプパルス発生回路である。１６
は、クランプ回路１３からクランプされた映像信号ｈの
入力を受け、該クランプされた映像信号ｈのうちのアナ
ログ画像信号をデジタル信号に変換するためのＡ／Ｄ変
換回路である。１７は、該Ａ／Ｄ変換回路１６のデジタ
ル出力端子である。
【０００４】映像信号ｅ、同期信号ｆ、クランプパルス
ｇ及びクランプされた映像信号ｈの各々の波形を図４に
示す。同期分離回路１４は、同期信号と該同期信号に続
くアナログ画像信号とを有する映像信号ｅからアクティ
ブロウの同期信号ｆのみを抽出する。クランプパルス発
生回路１５は、この同期信号ｆの立ち上がりエッジに応
答してクランプパルスｇを生成する。クランプ回路１３
は、このクランプパルスｇに応答して映像信号ｅをクラ
ンプする。この際、映像信号ｅは、そのペデスタルレベ
ルがクランプレベル入力端子１２を通して設定されたク
ランプレベルにクランプされたうえで（図４中のｈ参
照）、Ａ／Ｄ変換回路１６に与えられる。Ａ／Ｄ変換回
路１６は、クランプされた映像信号ｈの入力を受けてア
ナログ画像信号をデジタル信号に変換する。
ｇ及びクランプされた映像信号ｈの各々の波形を図４に
示す。同期分離回路１４は、同期信号と該同期信号に続
くアナログ画像信号とを有する映像信号ｅからアクティ
ブロウの同期信号ｆのみを抽出する。クランプパルス発
生回路１５は、この同期信号ｆの立ち上がりエッジに応
答してクランプパルスｇを生成する。クランプ回路１３
は、このクランプパルスｇに応答して映像信号ｅをクラ
ンプする。この際、映像信号ｅは、そのペデスタルレベ
ルがクランプレベル入力端子１２を通して設定されたク
ランプレベルにクランプされたうえで（図４中のｈ参
照）、Ａ／Ｄ変換回路１６に与えられる。Ａ／Ｄ変換回
路１６は、クランプされた映像信号ｈの入力を受けてア
ナログ画像信号をデジタル信号に変換する。
【０００５】
【発明が解決しようとする課題】上記従来のクランプ付
Ａ／Ｄ変換器は、同期分離回路１４により映像信号ｅか
ら同期信号ｆを抽出したうえで該同期信号ｆに基づいて
クランプ回路１３のためのクランプパルスｇを生成する
構成であったので、同期分離回路１４が不可欠であっ
た。このため、従来のクランプ付Ａ／Ｄ変換器は、回路
が大規模かつ複雑になる欠点を有していた。
Ａ／Ｄ変換器は、同期分離回路１４により映像信号ｅか
ら同期信号ｆを抽出したうえで該同期信号ｆに基づいて
クランプ回路１３のためのクランプパルスｇを生成する
構成であったので、同期分離回路１４が不可欠であっ
た。このため、従来のクランプ付Ａ／Ｄ変換器は、回路
が大規模かつ複雑になる欠点を有していた。
【０００６】本発明の目的は、同期分離回路を必要とし
ないクランプ付Ａ／Ｄ変換器を実現することにある。
ないクランプ付Ａ／Ｄ変換器を実現することにある。
【０００７】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明は、アンダーフロー出力付きのＡ／Ｄ変換
回路を用いることにより、従来の映像信号から抽出され
た同期信号に代わる信号を該Ａ／Ｄ変換回路から得る構
成を採用したものである。
めに、本発明は、アンダーフロー出力付きのＡ／Ｄ変換
回路を用いることにより、従来の映像信号から抽出され
た同期信号に代わる信号を該Ａ／Ｄ変換回路から得る構
成を採用したものである。
【０００８】具体的に説明すると、本発明は、図１に示
すように、同期信号と該同期信号に続くアナログ画像信
号とを有する映像信号ａとクランプパルスｃとの入力を
受け該クランプパルスｃに応答して映像信号ａを所定の
クランプレベルにクランプするためのクランプ回路３
と、該クランプ回路３からクランプされた映像信号ｄの
入力を受け該クランプされた映像信号ｄのうちの前記同
期信号のレベルが所定の基準レベルを下回っていること
を検出したときにアンダーフロー信号ｂを出力しかつ該
クランプされた映像信号ｄのうちの前記アナログ画像信
号をデジタル信号に変換するためのＡ／Ｄ変換回路４
と、該Ａ／Ｄ変換回路４のアンダーフロー信号ｂが入力
され該アンダーフロー信号ｂに基づいて前記クランプ回
路３に与えるクランプパルスｃを生成するためのクラン
プパルス発生回路７とを備えた構成を採用したものであ
る。
すように、同期信号と該同期信号に続くアナログ画像信
号とを有する映像信号ａとクランプパルスｃとの入力を
受け該クランプパルスｃに応答して映像信号ａを所定の
クランプレベルにクランプするためのクランプ回路３
と、該クランプ回路３からクランプされた映像信号ｄの
入力を受け該クランプされた映像信号ｄのうちの前記同
期信号のレベルが所定の基準レベルを下回っていること
を検出したときにアンダーフロー信号ｂを出力しかつ該
クランプされた映像信号ｄのうちの前記アナログ画像信
号をデジタル信号に変換するためのＡ／Ｄ変換回路４
と、該Ａ／Ｄ変換回路４のアンダーフロー信号ｂが入力
され該アンダーフロー信号ｂに基づいて前記クランプ回
路３に与えるクランプパルスｃを生成するためのクラン
プパルス発生回路７とを備えた構成を採用したものであ
る。
【０００９】
【作用】本発明によれば、Ａ／Ｄ変換回路４は、アンダ
ーフロー信号ｂにより映像信号ａ中の同期信号の到来を
クランプパルス発生回路７に伝える。つまり、公知のア
ンダーフロー出力付Ａ／Ｄ変換回路４を活用することに
より、映像信号ａから同期信号を抽出するための同期分
離回路を特別に設けていないにもかかわらず、映像信号
ａのためのクランプ付Ａ／Ｄ変換器が構成される。
ーフロー信号ｂにより映像信号ａ中の同期信号の到来を
クランプパルス発生回路７に伝える。つまり、公知のア
ンダーフロー出力付Ａ／Ｄ変換回路４を活用することに
より、映像信号ａから同期信号を抽出するための同期分
離回路を特別に設けていないにもかかわらず、映像信号
ａのためのクランプ付Ａ／Ｄ変換器が構成される。
【００１０】
【実施例】図１は、映像信号を取り扱う本発明の一実施
例のクランプ付Ａ／Ｄ変換器のブロック図である。同図
において１は、同期信号と該同期信号に続くアナログ画
像信号とを有する映像信号ａを入力するための映像信号
入力端子である。２は、クランプレベルを設定するため
のクランプレベル入力端子である。３は、クランプレベ
ル入力端子２を通して設定されたクランプレベルに映像
信号ａのペデスタルレベルをクランプするためのクラン
プ回路であって、クランプパルスｃに応答して動作する
ものである。４は、クランプ回路１３からクランプされ
た映像信号ｄの入力を受け、該クランプされた映像信号
ｄのうちの前記同期信号のレベルが所定の基準レベルを
下回っていることを検出したときにアンダーフロー信号
ｂを出力するとともに、該クランプされた映像信号ｄの
うちの前記アナログ画像信号をデジタル信号に変換する
ためのアンダーフロー出力付Ａ／Ｄ変換回路である。５
は該Ａ／Ｄ変換回路４のデジタル出力端子、６は該Ａ／
Ｄ変換回路４のアンダーフロー出力端子である。７は、
Ａ／Ｄ変換回路４から出力されるアンダーフロー信号ｂ
に基づいて前記クランプ回路３に与えるクランプパルス
ｃを生成するためのクランプパルス発生回路である。
例のクランプ付Ａ／Ｄ変換器のブロック図である。同図
において１は、同期信号と該同期信号に続くアナログ画
像信号とを有する映像信号ａを入力するための映像信号
入力端子である。２は、クランプレベルを設定するため
のクランプレベル入力端子である。３は、クランプレベ
ル入力端子２を通して設定されたクランプレベルに映像
信号ａのペデスタルレベルをクランプするためのクラン
プ回路であって、クランプパルスｃに応答して動作する
ものである。４は、クランプ回路１３からクランプされ
た映像信号ｄの入力を受け、該クランプされた映像信号
ｄのうちの前記同期信号のレベルが所定の基準レベルを
下回っていることを検出したときにアンダーフロー信号
ｂを出力するとともに、該クランプされた映像信号ｄの
うちの前記アナログ画像信号をデジタル信号に変換する
ためのアンダーフロー出力付Ａ／Ｄ変換回路である。５
は該Ａ／Ｄ変換回路４のデジタル出力端子、６は該Ａ／
Ｄ変換回路４のアンダーフロー出力端子である。７は、
Ａ／Ｄ変換回路４から出力されるアンダーフロー信号ｂ
に基づいて前記クランプ回路３に与えるクランプパルス
ｃを生成するためのクランプパルス発生回路である。
【００１１】映像信号ａ、アンダーフロー信号ｂ、クラ
ンプパルスｃ及びクランプされた映像信号ｄの各々の波
形を図２に示す。図２中のＶRBはＡ／Ｄ変換回路４の基
準電位のロー側を示しており、Ａ／Ｄ変換回路４のアナ
ログ入力電圧が該所定の基準レベルＶRBを下回っている
間、アンダーフロー出力端子６からアクティブハイのア
ンダーフロー信号ｂが出力される。つまり、このアンダ
ーフロー信号ｂは、図３の同期分離回路１４から出力さ
れた同期信号ｆ（図４参照）と同じ形で極性の異なる波
形をもつ。クランプパルス発生回路７は、このアンダー
フロー信号ｂの立ち下がりエッジに応答してクランプパ
ルスｃを生成する。クランプ回路３は、このクランプパ
ルスｃに応答して映像信号ａをクランプする。この際、
映像信号ａは、そのペデスタルレベルがクランプレベル
入力端子２を通して設定されたクランプレベルにクラン
プされたうえで（図２中のｄ参照）、Ａ／Ｄ変換回路４
に与えられる。Ａ／Ｄ変換回路４は、クランプされた映
像信号ｄの入力を受けてアナログ画像信号をデジタル信
号に変換する。
ンプパルスｃ及びクランプされた映像信号ｄの各々の波
形を図２に示す。図２中のＶRBはＡ／Ｄ変換回路４の基
準電位のロー側を示しており、Ａ／Ｄ変換回路４のアナ
ログ入力電圧が該所定の基準レベルＶRBを下回っている
間、アンダーフロー出力端子６からアクティブハイのア
ンダーフロー信号ｂが出力される。つまり、このアンダ
ーフロー信号ｂは、図３の同期分離回路１４から出力さ
れた同期信号ｆ（図４参照）と同じ形で極性の異なる波
形をもつ。クランプパルス発生回路７は、このアンダー
フロー信号ｂの立ち下がりエッジに応答してクランプパ
ルスｃを生成する。クランプ回路３は、このクランプパ
ルスｃに応答して映像信号ａをクランプする。この際、
映像信号ａは、そのペデスタルレベルがクランプレベル
入力端子２を通して設定されたクランプレベルにクラン
プされたうえで（図２中のｄ参照）、Ａ／Ｄ変換回路４
に与えられる。Ａ／Ｄ変換回路４は、クランプされた映
像信号ｄの入力を受けてアナログ画像信号をデジタル信
号に変換する。
【００１２】
【発明の効果】以上説明してきたとおり本発明によれ
ば、アンダーフロー出力付Ａ／Ｄ変換回路を活用して、
従来の映像信号から抽出された同期信号に代わるアンダ
ーフロー信号を該Ａ／Ｄ変換回路から得る構成を採用し
たので、映像信号から同期信号を抽出するための同期分
離回路を特別に設ける必要がない。したがって、回路規
模が小さくかつ簡素なクランプ付Ａ／Ｄ変換器を実現す
ることができる。
ば、アンダーフロー出力付Ａ／Ｄ変換回路を活用して、
従来の映像信号から抽出された同期信号に代わるアンダ
ーフロー信号を該Ａ／Ｄ変換回路から得る構成を採用し
たので、映像信号から同期信号を抽出するための同期分
離回路を特別に設ける必要がない。したがって、回路規
模が小さくかつ簡素なクランプ付Ａ／Ｄ変換器を実現す
ることができる。
【図１】 本発明の一実施例のクランプ付Ａ／Ｄ変換器
のブロック図である。
のブロック図である。
【図２】 図１のクランプ付Ａ／Ｄ変換器の各部の信号
波形図である。
波形図である。
【図３】 従来のクランプ付Ａ／Ｄ変換器のブロック図
である。
である。
【図４】 図３のクランプ付Ａ／Ｄ変換器の各部の信号
波形図である。
波形図である。
１ 映像信号入力端子 ２ クランプレベル入力端子 ３ クランプ回路 ４ アンダーフロー出力付Ａ／Ｄ変換回路 ５ デジタル出力端子 ６ アンダーフロー出力端子 ７ クランプパルス発生回路 ａ 映像信号 ｂ アンダーフロー信号 ｃ クランプパルス ｄ クランプされた映像信号
Claims (1)
- 【請求項１】 同期信号と該同期信号に続くアナログ画
像信号とを有する映像信号とクランプパルスとの入力を
受け、該クランプパルスに応答して前記映像信号を所定
のクランプレベルにクランプするためのクランプ回路
と、 前記クランプ回路からクランプされた映像信号の入力を
受け、該クランプされた映像信号のうちの前記同期信号
のレベルが所定の基準レベルを下回っていることを検出
したときにアンダーフロー信号を出力し、かつ該クラン
プされた映像信号のうちの前記アナログ画像信号をデジ
タル信号に変換するためのＡ／Ｄ変換回路と、 前記Ａ／Ｄ変換回路のアンダーフロー信号が入力され、
該アンダーフロー信号に基づいて前記クランプ回路に与
えるクランプパルスを生成するためのクランプパルス発
生回路とを備えたことを特徴とするクランプ付Ａ／Ｄ変
換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3245843A JPH0583131A (ja) | 1991-09-25 | 1991-09-25 | クランプ付ａ／ｄ変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3245843A JPH0583131A (ja) | 1991-09-25 | 1991-09-25 | クランプ付ａ／ｄ変換器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0583131A true JPH0583131A (ja) | 1993-04-02 |
Family
ID=17139680
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3245843A Withdrawn JPH0583131A (ja) | 1991-09-25 | 1991-09-25 | クランプ付ａ／ｄ変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0583131A (ja) |
-
1991
- 1991-09-25 JP JP3245843A patent/JPH0583131A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19981203 |