JPH0591440A - テレビジヨン信号処理回路 - Google Patents
テレビジヨン信号処理回路Info
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- JPH0591440A JPH0591440A JP3247756A JP24775691A JPH0591440A JP H0591440 A JPH0591440 A JP H0591440A JP 3247756 A JP3247756 A JP 3247756A JP 24775691 A JP24775691 A JP 24775691A JP H0591440 A JPH0591440 A JP H0591440A
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- JP
- Japan
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- contour
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Abstract
(57)【要約】
【目的】１６：９の画面に４：３の映像を表示した場合
に、画像の輪郭強調を行なっても、映像と枠の境の焼き
付き現象を防止する。 【構成】時間軸圧縮回路１０６は、４：３用に映像の時
間軸を圧縮する。枠レベル発生回路１１１は、画像の平
均値を出力する。切り換え回路１１４は、枠位置発生回
路１２２から出力されるパルスによって映像と枠レベル
を切り換える。輪郭補正回路１２０は、映像の輪郭を強
調すると同時に、輪郭補正制御パルス発生回路１２３か
らのパルスによって、映像と枠の境は、輪郭強調動作を
やめる。従って、映像と枠の境の焼き付きを防止でき
る。
に、画像の輪郭強調を行なっても、映像と枠の境の焼き
付き現象を防止する。 【構成】時間軸圧縮回路１０６は、４：３用に映像の時
間軸を圧縮する。枠レベル発生回路１１１は、画像の平
均値を出力する。切り換え回路１１４は、枠位置発生回
路１２２から出力されるパルスによって映像と枠レベル
を切り換える。輪郭補正回路１２０は、映像の輪郭を強
調すると同時に、輪郭補正制御パルス発生回路１２３か
らのパルスによって、映像と枠の境は、輪郭強調動作を
やめる。従って、映像と枠の境の焼き付きを防止でき
る。
Description
【０００１】
【産業上の利用分野】本発明は、ＮＴＳＣ方式、高品位
テレビジョン方式などが受信できるテレビジョン信号受
信機に関するものである。
テレビジョン方式などが受信できるテレビジョン信号受
信機に関するものである。
【０００２】
【従来の技術】近年、現行のＮＴＳＣ方式の持つアスペ
クト比４：３とは異なるアスペクト比（１６：９）を持
つ高品位テレビジョン方式が普及しようとしている。こ
のような高品位テレビジョン方式の普及に際しても、高
品位テレビジョン信号が受信出来ることはもちろんのこ
と、アスペクト比の異なる現行のテレビジョン信号が受
信できることが望ましい。１６：９の受信機に４：３の
画像を表示する信号処理装置の例として、特開平２−１
０８３７７などが上げられる。この場合、図５に示すよ
うに１６：９の画面の中に、左右映像の無い部分（図５
において斜線で示す。）を設けて４：３の映像を表示す
るものである。このような映像を得るための信号処理の
一例を図６に示す。同図において１０２はＡ／Ｄコンバ
ータ、１０３はＹ／Ｃ分離回路、１０４は色復調回路、
１０５及び１０６は走査線補間回路、１０７及び１０８
倍速変換回路、１０９及び１１０は時間軸圧縮回路、１
１１、１１２及び１１３は枠レベル発生回路、１１４、
１１５及び１１６は切り換え回路、１１７、１１８及び
１１９はＤ／Ａコンバータ、６０１は輝度信号出力端
子、６０２及び６０３はＲ−Ｙ及びＢ−Ｙ出力端子、１
２１は同期発生回路、１２２は枠位置発生回路である。
図６において、１６：９から４：３に変換する部分は、
主に時間軸圧縮回路である。この動作を図７を用いて説
明する。同図において（ａ）は、時間軸圧縮回路１０９
の入力信号である。時間軸圧縮回路１０９では、時間軸
を３／４に圧縮し４：３の映像を得る（図７（ｂ））。
枠レベル発生回路１１１では図５の斜線で示した部分
（枠）のレベルを得る。枠位置発生回路１２２では、図
５の枠の位置に相当するパルス（図７（ｃ）に示す。）
を発生し、枠レベル発生回路１１１で得た枠レベルと時
間軸圧縮回路出力信号を切り換え回路１１４で切り換え
て、図７（ｄ）のような信号を得る。
クト比４：３とは異なるアスペクト比（１６：９）を持
つ高品位テレビジョン方式が普及しようとしている。こ
のような高品位テレビジョン方式の普及に際しても、高
品位テレビジョン信号が受信出来ることはもちろんのこ
と、アスペクト比の異なる現行のテレビジョン信号が受
信できることが望ましい。１６：９の受信機に４：３の
画像を表示する信号処理装置の例として、特開平２−１
０８３７７などが上げられる。この場合、図５に示すよ
うに１６：９の画面の中に、左右映像の無い部分（図５
において斜線で示す。）を設けて４：３の映像を表示す
るものである。このような映像を得るための信号処理の
一例を図６に示す。同図において１０２はＡ／Ｄコンバ
ータ、１０３はＹ／Ｃ分離回路、１０４は色復調回路、
１０５及び１０６は走査線補間回路、１０７及び１０８
倍速変換回路、１０９及び１１０は時間軸圧縮回路、１
１１、１１２及び１１３は枠レベル発生回路、１１４、
１１５及び１１６は切り換え回路、１１７、１１８及び
１１９はＤ／Ａコンバータ、６０１は輝度信号出力端
子、６０２及び６０３はＲ−Ｙ及びＢ−Ｙ出力端子、１
２１は同期発生回路、１２２は枠位置発生回路である。
図６において、１６：９から４：３に変換する部分は、
主に時間軸圧縮回路である。この動作を図７を用いて説
明する。同図において（ａ）は、時間軸圧縮回路１０９
の入力信号である。時間軸圧縮回路１０９では、時間軸
を３／４に圧縮し４：３の映像を得る（図７（ｂ））。
枠レベル発生回路１１１では図５の斜線で示した部分
（枠）のレベルを得る。枠位置発生回路１２２では、図
５の枠の位置に相当するパルス（図７（ｃ）に示す。）
を発生し、枠レベル発生回路１１１で得た枠レベルと時
間軸圧縮回路出力信号を切り換え回路１１４で切り換え
て、図７（ｄ）のような信号を得る。
【０００３】
【発明が解決しようとする課題】図５に示したように、
１６：９の画面の中に４：３の映像を表示した場合に
は、左右に絵の無い部分（枠）ができ、映像部と枠の部
分の輝度差によって、ＣＰＴのマスクが変形して映像部
と枠の境界に縦筋が残る、いわゆる焼き付き現象が起こ
る。この問題を解決するために、枠のレベルは、表示画
像の平均輝度レベルを表示することを行なっている。し
かし、一般的に、図６に示した枠レベルの付随した輝度
信号出力端子６０１、色差信号出力端子６０２、６０３
の後段には、図８に示した回路が接続される。輝度信号
は、輪郭補正回路８０４が接続される。輪郭補正回路８
０４の入出力信号を図９（ａ），（ｂ）にそれぞれ示
す。輪郭補正回路を通した場合は、同図（ｂ）に示した
ように、映像と枠の境界を強調するために、境界部分に
シュートが付き枠と映像の輝度差が大きくなり、焼き付
き現象が生じてしまう。
１６：９の画面の中に４：３の映像を表示した場合に
は、左右に絵の無い部分（枠）ができ、映像部と枠の部
分の輝度差によって、ＣＰＴのマスクが変形して映像部
と枠の境界に縦筋が残る、いわゆる焼き付き現象が起こ
る。この問題を解決するために、枠のレベルは、表示画
像の平均輝度レベルを表示することを行なっている。し
かし、一般的に、図６に示した枠レベルの付随した輝度
信号出力端子６０１、色差信号出力端子６０２、６０３
の後段には、図８に示した回路が接続される。輝度信号
は、輪郭補正回路８０４が接続される。輪郭補正回路８
０４の入出力信号を図９（ａ），（ｂ）にそれぞれ示
す。輪郭補正回路を通した場合は、同図（ｂ）に示した
ように、映像と枠の境界を強調するために、境界部分に
シュートが付き枠と映像の輝度差が大きくなり、焼き付
き現象が生じてしまう。
【０００４】本発明の目的は、画像の輪郭補正を行なっ
ても、焼き付き現象の生じない信号処理回路を提供する
ことにある。
ても、焼き付き現象の生じない信号処理回路を提供する
ことにある。
【０００５】
【課題を解決するための手段】上記問題を解決するため
に本発明では、映像と枠の境界に対応したパルスを求め
る輪郭補正制御パルス発生回路と、前記パルスによって
輪郭補正回路をＯＦＦする輪郭補正制御回路から構成さ
れる。
に本発明では、映像と枠の境界に対応したパルスを求め
る輪郭補正制御パルス発生回路と、前記パルスによって
輪郭補正回路をＯＦＦする輪郭補正制御回路から構成さ
れる。
【０００６】
【作用】前記輪郭補正制御パルス発生回路は、映像と枠
の境に位置するパルスを発生する。前記輪郭補正制御回
路は、前記パルスによって、映像と枠の境の期間におい
て、輪郭補正回路をＯＦＦする。従って、映像と枠の境
に生じるシュートが無くなるので、焼き付き現象が起こ
ることが無い。
の境に位置するパルスを発生する。前記輪郭補正制御回
路は、前記パルスによって、映像と枠の境の期間におい
て、輪郭補正回路をＯＦＦする。従って、映像と枠の境
に生じるシュートが無くなるので、焼き付き現象が起こ
ることが無い。
【０００７】
【実施例】以下図面を用いて本発明を説明する。
【０００８】図１は、本発明による、第一の実施例を示
すブロック図である。本実施例は、ＥＤ（Ｅｎｈａｎｃ
ｅｄ Ｄｅｆｉｎｉｔｉｏｎ）ＴＶに本発明を適用した
例である。同図において、１０１はコンポジットビデオ
入力端子、１０２はＡ／Ｄコンバータ、１０３はＹ／Ｃ
分離回路、１０４は色復調回路、１０５、１０６は走査
線補間回路、１０７、１０８は倍速変換回路、１０９、
１１０は時間軸圧縮回路、１１１，１１２及び１１３は
枠レベル発生回路、１１４，１１５及び１１６は切り換
え回路、１１７、１１８及び１１９はＤ／Ａコンバー
タ、１２０は輪郭補正回路、１２１は同期発生回路、１
２２は枠位置パルス発生回路、１２３は輪郭補正制御パ
ルス発生回路、１２４はマトリックス回路、１２５、１
２６、１２７はＲＧＢ出力端子である。
すブロック図である。本実施例は、ＥＤ（Ｅｎｈａｎｃ
ｅｄ Ｄｅｆｉｎｉｔｉｏｎ）ＴＶに本発明を適用した
例である。同図において、１０１はコンポジットビデオ
入力端子、１０２はＡ／Ｄコンバータ、１０３はＹ／Ｃ
分離回路、１０４は色復調回路、１０５、１０６は走査
線補間回路、１０７、１０８は倍速変換回路、１０９、
１１０は時間軸圧縮回路、１１１，１１２及び１１３は
枠レベル発生回路、１１４，１１５及び１１６は切り換
え回路、１１７、１１８及び１１９はＤ／Ａコンバー
タ、１２０は輪郭補正回路、１２１は同期発生回路、１
２２は枠位置パルス発生回路、１２３は輪郭補正制御パ
ルス発生回路、１２４はマトリックス回路、１２５、１
２６、１２７はＲＧＢ出力端子である。
【０００９】本回路の基本的動作を以下に説明する。コ
ンポジットビデオ入力端子に入力されたコンポジットビ
デオ信号は、Ａ／Ｄコンバータ１０２でディジタル値に
変換される。Ｙ／Ｃ分離回路１０３では、コンポジット
ビデオ信号から、輝度信号Ｙと色信号Ｃを分離する。色
信号Ｃは、色復調回路１０４において色差信号Ｒ−Ｙ及
びＢ−Ｙ信号に変換される。走査線補間回路１０５，１
０６、倍速変換回路１０７、１０８では、インタレース
信号からノンインタレース信号に変換される。時間軸圧
縮回路１０９，１１０では、４：３用に映像を圧縮す
る。枠レベル発生回路では、焼き付き現象が起きないよ
うに映像信号の平均値（例えば積分回路などで実現でき
る。）を出力する。時間軸圧縮回路１０９、１１０の出
力と、枠レベル発生回路１１１，１１２及び１１３の出
力は、切り換え回路１１４，１１５及び１１６におい
て、枠位置パルス発生回路１２２から出力されるパルス
によって切り換えられる。Ｄ／Ａコンバータ１１７、１
１８及び１１９によってアナログ値に変換された後、輝
度信号は輪郭補正回路１２０を通り、色差信号はそのま
まマトリックス回路１２４へ入力される。輪郭補正回路
１２０では、輪郭部を強調するために輪郭部にシュート
を付けると同じに、輪郭補正制御パルス発生回路１２３
から出力されるパルスによって映像と枠の境のシュート
を無くすよう輪郭補正回路をＯＦＦする。マトリックス
回路１２４ではＲＧＢ信号に変換し表示装置（ディスプ
レイ等、図示せず。）に出力する。
ンポジットビデオ入力端子に入力されたコンポジットビ
デオ信号は、Ａ／Ｄコンバータ１０２でディジタル値に
変換される。Ｙ／Ｃ分離回路１０３では、コンポジット
ビデオ信号から、輝度信号Ｙと色信号Ｃを分離する。色
信号Ｃは、色復調回路１０４において色差信号Ｒ−Ｙ及
びＢ−Ｙ信号に変換される。走査線補間回路１０５，１
０６、倍速変換回路１０７、１０８では、インタレース
信号からノンインタレース信号に変換される。時間軸圧
縮回路１０９，１１０では、４：３用に映像を圧縮す
る。枠レベル発生回路では、焼き付き現象が起きないよ
うに映像信号の平均値（例えば積分回路などで実現でき
る。）を出力する。時間軸圧縮回路１０９、１１０の出
力と、枠レベル発生回路１１１，１１２及び１１３の出
力は、切り換え回路１１４，１１５及び１１６におい
て、枠位置パルス発生回路１２２から出力されるパルス
によって切り換えられる。Ｄ／Ａコンバータ１１７、１
１８及び１１９によってアナログ値に変換された後、輝
度信号は輪郭補正回路１２０を通り、色差信号はそのま
まマトリックス回路１２４へ入力される。輪郭補正回路
１２０では、輪郭部を強調するために輪郭部にシュート
を付けると同じに、輪郭補正制御パルス発生回路１２３
から出力されるパルスによって映像と枠の境のシュート
を無くすよう輪郭補正回路をＯＦＦする。マトリックス
回路１２４ではＲＧＢ信号に変換し表示装置（ディスプ
レイ等、図示せず。）に出力する。
【００１０】輪郭補正回路１２０の動作を図２を用いて
説明する。同図において、（ａ）は輪郭補正回路の入力
信号である。今、同図に示すよう映像が白から黒、黒か
ら白へ変わるような場合を考える。輪郭補正回路では、
通常は、同図（ｂ）に示すよう枠と映像、白と黒、黒と
白の境にシュートを付けて輪郭を強調する。従って、こ
のままでは、枠と映像の境の輝度差が大きくなり焼き付
き現象が起きてしまう。輪郭補正制御パルス発生回路１
２３では、図２（ｃ）に示すよう映像と枠の境に位置す
るパルスを発生する。輪郭補正回路１２０では、このパ
ルスが”Ｈ”の期間輪郭補正動作をＯＦＦする。従っ
て、図２（ｄ）に示すよう、映像の輪郭強調は行なった
まま、映像と枠の境のシュートを無くすことが出来るの
で焼き付き現象を防止することができる。
説明する。同図において、（ａ）は輪郭補正回路の入力
信号である。今、同図に示すよう映像が白から黒、黒か
ら白へ変わるような場合を考える。輪郭補正回路では、
通常は、同図（ｂ）に示すよう枠と映像、白と黒、黒と
白の境にシュートを付けて輪郭を強調する。従って、こ
のままでは、枠と映像の境の輝度差が大きくなり焼き付
き現象が起きてしまう。輪郭補正制御パルス発生回路１
２３では、図２（ｃ）に示すよう映像と枠の境に位置す
るパルスを発生する。輪郭補正回路１２０では、このパ
ルスが”Ｈ”の期間輪郭補正動作をＯＦＦする。従っ
て、図２（ｄ）に示すよう、映像の輪郭強調は行なった
まま、映像と枠の境のシュートを無くすことが出来るの
で焼き付き現象を防止することができる。
【００１１】図３に輪郭補正回路１２０の一具体例のブ
ロック図を示す。同図ににおいて、３０１は輪郭補正回
路入力端子、３０２、３０３は遅延素子、３０４、３０
５、３０６は乗算器、３０７、３１０は加算器、３０８
は可変乗算器、３０９は切り換え回路、３１１は輪郭補
正出力端子、３１２は輪郭補正制御パルス入力端子であ
る。可変乗算器３０８からは、画像の輪郭成分が出力さ
れる。輪郭補正制御パルス入力端子３１２からは、図２
（ｃ）に示すようなパルスが入力される。このパルス
が”Ｈ”の期間、切り換え回路３０９は”０”を選択す
るので、加算器３１０からは、この期間輪郭強調されな
い信号が出力される。従って、映像と枠の境には、シュ
ートが付かない。輪郭補正制御パルスが”Ｈ”の期間乗
算器の係数Ｋを０にしても同様の効果が得られる。ま
た、輪郭補正回路は、図１に示した、Ｄ／Ａコンバータ
１１７の前に挿入されてディジタル的に輪郭補正を行な
った場合においても同様な効果が得られる。
ロック図を示す。同図ににおいて、３０１は輪郭補正回
路入力端子、３０２、３０３は遅延素子、３０４、３０
５、３０６は乗算器、３０７、３１０は加算器、３０８
は可変乗算器、３０９は切り換え回路、３１１は輪郭補
正出力端子、３１２は輪郭補正制御パルス入力端子であ
る。可変乗算器３０８からは、画像の輪郭成分が出力さ
れる。輪郭補正制御パルス入力端子３１２からは、図２
（ｃ）に示すようなパルスが入力される。このパルス
が”Ｈ”の期間、切り換え回路３０９は”０”を選択す
るので、加算器３１０からは、この期間輪郭強調されな
い信号が出力される。従って、映像と枠の境には、シュ
ートが付かない。輪郭補正制御パルスが”Ｈ”の期間乗
算器の係数Ｋを０にしても同様の効果が得られる。ま
た、輪郭補正回路は、図１に示した、Ｄ／Ａコンバータ
１１７の前に挿入されてディジタル的に輪郭補正を行な
った場合においても同様な効果が得られる。
【００１２】図４に本発明による第二の実施例のブロッ
ク図を示す。同図において４０１は輝度信号入力端子、
４０２，４０３は色差信号入力端子、４０４はマトリッ
クス回路、４０５はブラウン管、４０６は速度変調コイ
ル、４０７は微分回路、４０８は増幅器、４０９は速度
変調御回路、４１０は速度変調制御パルス入力端子、４
１１、４１２は抵抗、４１３はトランジスタである。輪
郭を強調する回路として、輪郭部の走査速度を変調して
行なう方法がある。図４は、速度変調回路に本発明を適
用した例である。入力端子４０１，４０２，４０３は、
これまでの例と同様に、４：３の映像用に枠の付いた信
号が入力される。微分回路４０７では、輪郭信号が出力
される。増幅器４０８では、微分信号を増幅し、速度変
調用コイル４０６を駆動する。速度変調制御回路４０９
は、速度変調制御パルス入力端子４１０から入力され
る、映像と枠の境に位置するパルスによって、微分回路
４０７の出力を”０”とする。従って、映像と枠の境に
おいては速度変調が効かないので輪郭強調されない。よ
って焼き付き現象を防止できる。
ク図を示す。同図において４０１は輝度信号入力端子、
４０２，４０３は色差信号入力端子、４０４はマトリッ
クス回路、４０５はブラウン管、４０６は速度変調コイ
ル、４０７は微分回路、４０８は増幅器、４０９は速度
変調御回路、４１０は速度変調制御パルス入力端子、４
１１、４１２は抵抗、４１３はトランジスタである。輪
郭を強調する回路として、輪郭部の走査速度を変調して
行なう方法がある。図４は、速度変調回路に本発明を適
用した例である。入力端子４０１，４０２，４０３は、
これまでの例と同様に、４：３の映像用に枠の付いた信
号が入力される。微分回路４０７では、輪郭信号が出力
される。増幅器４０８では、微分信号を増幅し、速度変
調用コイル４０６を駆動する。速度変調制御回路４０９
は、速度変調制御パルス入力端子４１０から入力され
る、映像と枠の境に位置するパルスによって、微分回路
４０７の出力を”０”とする。従って、映像と枠の境に
おいては速度変調が効かないので輪郭強調されない。よ
って焼き付き現象を防止できる。
【００１３】以上の実施例は、ＥＤＴＶに適用した例を
示したが、標準速用のＴＶに適用しても同様の効果が得
られる。
示したが、標準速用のＴＶに適用しても同様の効果が得
られる。
【００１４】
【発明の効果】以上により、輪郭補正回路を接続した場
合においても、映像と枠に境は、シュートが付かず輪郭
を強調することが無いので、映像の輪郭は強調したまま
で、焼き付き現象も防止できる。
合においても、映像と枠に境は、シュートが付かず輪郭
を強調することが無いので、映像の輪郭は強調したまま
で、焼き付き現象も防止できる。
【図１】本発明による第一の実施例を示すブロック図
【図２】図１の動作を示す波形図。
【図３】図１の輪郭補正回路の一具体例を示すブロック
図。
図。
【図４】本発明による第二の実施例を示すブロック図。
【図５】１６：９の画面に４：３の映像を表示した場合
の状態図。
の状態図。
【図６】従来例を示すブロック図。
【図７】図６の動作を示す波形図。
【図８】従来例を示すブロック図。
【図９】図８の動作を示す波形図。
１０９、１１０…時間軸圧縮回路、 １１１、１１２、１１３…枠レベル発生回路、 １１４、１１５、１１６…切り換え回路、 １２０…輪郭補正回路、 １２２…枠位置発生回路、 １２３…輪郭補正制御パルス発生回路。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 窪田 定雄 神奈川県横浜市戸塚区吉田町292番地株式 会社日立製作所ＡＶ機器事業部内
Claims (2)
- 【請求項１】１６：９のテレビジョン受信機に４：３の
標準テレビジョン信号を表示するテレビジョン信号処理
回路において、４：３に時間軸圧縮する時間軸圧縮回路
と、映像の無い部分（枠）のレベルを出力する枠レベル
発生回路と、前記時間軸圧縮回路の出力と前記枠レベル
発生回路の出力を切り換える切り換え回路と、前記切り
換え回路を制御するべく枠の位置に対応したパルスを発
生する枠位置発生回路と、前記切り換え回路の後段に接
続される輪郭補正回路と、前記輪郭補正回路を制御する
べく映像と枠の輪郭部の位置にに対応したパルスを発生
する輪郭補正制御パルス発生回路と、輪郭補正制御回路
を具備したことを特徴とするテレビジョン信号処理回
路。 - 【請求項２】前記輪郭補正回路は、微分回路と、増幅器
と、偏向速度変調用のコイルとから構成されることを特
徴とする請求項１のテレビジョン信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24775691A JP3147428B2 (ja) | 1991-09-26 | 1991-09-26 | テレビジョン信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24775691A JP3147428B2 (ja) | 1991-09-26 | 1991-09-26 | テレビジョン信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0591440A true JPH0591440A (ja) | 1993-04-09 |
| JP3147428B2 JP3147428B2 (ja) | 2001-03-19 |
Family
ID=17168198
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24775691A Expired - Fee Related JP3147428B2 (ja) | 1991-09-26 | 1991-09-26 | テレビジョン信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3147428B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6297854B1 (en) | 1997-03-25 | 2001-10-02 | Fujitsu General Limited | Contour emphasizing circuit |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| BR112023013812A2 (pt) | 2021-03-12 | 2023-10-03 | Foshan Ideal Co Ltd | Amortecedor bidirecional para porta de boxe de banho |
-
1991
- 1991-09-26 JP JP24775691A patent/JP3147428B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6297854B1 (en) | 1997-03-25 | 2001-10-02 | Fujitsu General Limited | Contour emphasizing circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3147428B2 (ja) | 2001-03-19 |
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