JPH0612267B2 - パルスエンコーダのパルス読み込み回路 - Google Patents
パルスエンコーダのパルス読み込み回路Info
- Publication number
- JPH0612267B2 JPH0612267B2 JP6543288A JP6543288A JPH0612267B2 JP H0612267 B2 JPH0612267 B2 JP H0612267B2 JP 6543288 A JP6543288 A JP 6543288A JP 6543288 A JP6543288 A JP 6543288A JP H0612267 B2 JPH0612267 B2 JP H0612267B2
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- JP
- Japan
- Prior art keywords
- pulse
- signal
- edge
- output
- detecting means
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- Expired - Lifetime
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- Transmission And Conversion Of Sensor Element Output (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は工作機械の主軸の定位置停止制御装置等で位
置検出に使用するパルスエンコーダにおいて、原点リセ
ット信号の誤出力を確実に防止することができるように
したパルス読み込み回路に関する。
置検出に使用するパルスエンコーダにおいて、原点リセ
ット信号の誤出力を確実に防止することができるように
したパルス読み込み回路に関する。
パルスエンコーダのパルス読み込み回路の従来例を第４
図にもとづいて説明する。この図において、パルスエツ
ジ検出手段１，２で第５図に示すＡ相パルスとＢ相パル
スのそれぞれ立ち上がりエツジと立ち下がりエツジを検
出してエツジ信号３，４を出力するとともに、回転方向
判別手段５でＡ相とＢ相の位相関係から回転方向を判別
して回転方向信号６を出力するようになっている。一方
前記エンコーダの１回転に１回出力するＣパルスは立ち
上がり検出手段７と立ち下がり検出手段８でそれぞれ立
ち上がりエツジと立ち下がりエツジを検出してその出力
信号と前記回転方向信号６により正転時は立ち上がりエ
ツジをまた逆転時は立ち下がりエツジを有効エツジと判
断する有効エツジ検出手段９でリセット信号１０を出力
し、このリセット信号１０をカウンタのリセット等の原
点信号として使用するようにしていた。
図にもとづいて説明する。この図において、パルスエツ
ジ検出手段１，２で第５図に示すＡ相パルスとＢ相パル
スのそれぞれ立ち上がりエツジと立ち下がりエツジを検
出してエツジ信号３，４を出力するとともに、回転方向
判別手段５でＡ相とＢ相の位相関係から回転方向を判別
して回転方向信号６を出力するようになっている。一方
前記エンコーダの１回転に１回出力するＣパルスは立ち
上がり検出手段７と立ち下がり検出手段８でそれぞれ立
ち上がりエツジと立ち下がりエツジを検出してその出力
信号と前記回転方向信号６により正転時は立ち上がりエ
ツジをまた逆転時は立ち下がりエツジを有効エツジと判
断する有効エツジ検出手段９でリセット信号１０を出力
し、このリセット信号１０をカウンタのリセット等の原
点信号として使用するようにしていた。
前記Ｃパルスには第６図に示すように幅があるので原点
位置を正確にするために正転時は第６図（ａ）に有効エ
ツジと図示した立ち上がりエツジでまた逆転時は第６図
（ｂ）に示すように立ち下がりエツジでリセット信号１
０を出力する必要があり、この動作は一般に回転方向信
号６がＨレベルの場合は立ち上がりエツジでまたＬレベ
ルの場合は立ち下がりエツジで行うようになっている。
ところが前記回路では第７図のタイムチャートに示すよ
うに正転でｘ位置まで移動させた後逆転させると回転方
向判別手段５にＡ相パルスまたはＢ相パルスのいずれか
が入力されるまで回転方向の判別ができず回転方向信号
６が実際の回転方向より遅れて出力されるので、リセッ
ト信号１０を本来出力すべきでないＣパルスの立ち上が
りエツジ（無効エツジ）のｙ位置で出力してしまうこと
があるという欠点があった。
位置を正確にするために正転時は第６図（ａ）に有効エ
ツジと図示した立ち上がりエツジでまた逆転時は第６図
（ｂ）に示すように立ち下がりエツジでリセット信号１
０を出力する必要があり、この動作は一般に回転方向信
号６がＨレベルの場合は立ち上がりエツジでまたＬレベ
ルの場合は立ち下がりエツジで行うようになっている。
ところが前記回路では第７図のタイムチャートに示すよ
うに正転でｘ位置まで移動させた後逆転させると回転方
向判別手段５にＡ相パルスまたはＢ相パルスのいずれか
が入力されるまで回転方向の判別ができず回転方向信号
６が実際の回転方向より遅れて出力されるので、リセッ
ト信号１０を本来出力すべきでないＣパルスの立ち上が
りエツジ（無効エツジ）のｙ位置で出力してしまうこと
があるという欠点があった。
この発明は前記の欠点を除去するために、Ｃパルスの無
効エツジ付近で正逆反転してもリセット信号の誤出力を
確実に防止することができるようにしたパルスエンコー
ダのパルス読み込み回路を提供することを目的とする。
効エツジ付近で正逆反転してもリセット信号の誤出力を
確実に防止することができるようにしたパルスエンコー
ダのパルス読み込み回路を提供することを目的とする。
この発明は前記の目的を達成するために、Ｃパルスの有
効エツジ検出手段９と並列に無効エツジ検出手段１１を
設けるとともに有効エツジ検出手段９の次段に有効エツ
ジ禁止検出手段１２を設け、これらの出力信号の論理和
のうちにＣパルスの無効エツジ信号１３があると前記有
効エツジ禁止検出手段１２および論理積素子１４にリセ
ット信号出力禁止信号１５を出力する禁止信号メモリ１
６と、前記リセット信号出力禁止信号１５をその出力後
Ａ相パルスまたはＢ相パルスの少なくともいずれかの新
しいエツジ信号３，４の入力を待って解除しこの状態で
Ｃパルスの有効エツジ信号１７を前記論理積素子１４を
介しリセット信号１０として出力するリセット手段１８
とを備えるようにしたものである。
効エツジ検出手段９と並列に無効エツジ検出手段１１を
設けるとともに有効エツジ検出手段９の次段に有効エツ
ジ禁止検出手段１２を設け、これらの出力信号の論理和
のうちにＣパルスの無効エツジ信号１３があると前記有
効エツジ禁止検出手段１２および論理積素子１４にリセ
ット信号出力禁止信号１５を出力する禁止信号メモリ１
６と、前記リセット信号出力禁止信号１５をその出力後
Ａ相パルスまたはＢ相パルスの少なくともいずれかの新
しいエツジ信号３，４の入力を待って解除しこの状態で
Ｃパルスの有効エツジ信号１７を前記論理積素子１４を
介しリセット信号１０として出力するリセット手段１８
とを備えるようにしたものである。
前記リセット信号出力禁止信号１５を回転方向信号６が
実際の回転方向と一致したこと確認して解除し、その後
の最初のＣパルスの有効エツジ信号１７をリセット信号
１０として出力するようにしたので、無効エツジ信号１
３の誤判断によるリセット信号１０の誤出力を確実に防
止することができる。
実際の回転方向と一致したこと確認して解除し、その後
の最初のＣパルスの有効エツジ信号１７をリセット信号
１０として出力するようにしたので、無効エツジ信号１
３の誤判断によるリセット信号１０の誤出力を確実に防
止することができる。
第１図および第２図はこの発明の実施例を示すもので、
第４図ないし第７図と同一符号で示すものは同一部品で
ある。これらの図において、立ち上がり検出手段７と立
ち下がり検出手段８の次段にこれらの出力信号と回転方
向信号６によりＣパルスのエツジが有効かまたは無効か
を判断する有効エツジ検出手段９と無効エツジ検出手段
１１が並列に設けられ、有効エツジ検出手段９の次段に
はその出力である有効エツジ信号１７と禁止信号メモリ
１６から出力するリセット信号出力禁止信号１５とを入
力することにより有効エツジ信号17をリセット信号１０
として出力しなかったことを検出する有効エツジ禁止検
出手段１２が設けられている。前記禁止信号メモリ１６
は有効エツジ禁止検出手段１２と無効エツジ検出手段１
１の出力信号の論理和素子１９による論理和のうちにＣ
パルスの無効エツジ信号１３があると有効エツジ禁止検
出手段１２と論理積素子１４に前記リセット信号出力禁
止信号１５を出力するもので、この禁止信号メモリ１６
のリセット手段１８には前記論理和とＡ相パルスおよび
Ｂ相パルスのエツジ信号３，４が入力される。
第４図ないし第７図と同一符号で示すものは同一部品で
ある。これらの図において、立ち上がり検出手段７と立
ち下がり検出手段８の次段にこれらの出力信号と回転方
向信号６によりＣパルスのエツジが有効かまたは無効か
を判断する有効エツジ検出手段９と無効エツジ検出手段
１１が並列に設けられ、有効エツジ検出手段９の次段に
はその出力である有効エツジ信号１７と禁止信号メモリ
１６から出力するリセット信号出力禁止信号１５とを入
力することにより有効エツジ信号17をリセット信号１０
として出力しなかったことを検出する有効エツジ禁止検
出手段１２が設けられている。前記禁止信号メモリ１６
は有効エツジ禁止検出手段１２と無効エツジ検出手段１
１の出力信号の論理和素子１９による論理和のうちにＣ
パルスの無効エツジ信号１３があると有効エツジ禁止検
出手段１２と論理積素子１４に前記リセット信号出力禁
止信号１５を出力するもので、この禁止信号メモリ１６
のリセット手段１８には前記論理和とＡ相パルスおよび
Ｂ相パルスのエツジ信号３，４が入力される。
前記リセット信号出力禁止信号１５はこれを出力した後
リセット手段１８にＡ相パルスかまたはＢ相パルスの少
なくともいずれかの新しいエツジ信号３，４が入力する
かまたはその途中で論理和が更新したらそれまでのエツ
ジ信号３，４を無効とし新しいエツジ信号３，４の入力
を待ってすなわち回転方向信号６が実際の回転方向と一
致したことを確認して禁止信号メモリ１６をリセットす
ることにより解除され、この状態でその後の最初のＣパ
ルスの有効エツジ信号１７を前記論理積素子１４を介し
て第３図に示すようにリセット信号１０として出力すれ
ば無効エツジ信号１３の誤判断によるリセット信号１０
の誤出力を防止することができる。
リセット手段１８にＡ相パルスかまたはＢ相パルスの少
なくともいずれかの新しいエツジ信号３，４が入力する
かまたはその途中で論理和が更新したらそれまでのエツ
ジ信号３，４を無効とし新しいエツジ信号３，４の入力
を待ってすなわち回転方向信号６が実際の回転方向と一
致したことを確認して禁止信号メモリ１６をリセットす
ることにより解除され、この状態でその後の最初のＣパ
ルスの有効エツジ信号１７を前記論理積素子１４を介し
て第３図に示すようにリセット信号１０として出力すれ
ば無効エツジ信号１３の誤判断によるリセット信号１０
の誤出力を防止することができる。
この発明によればパルスエンコーダのパルス読み込み回
路において、Ｃパルスの無効エツジ信号があるとリセッ
ト信号の出力を禁止するリセット信号出力禁止信号を回
転方向信号が実際の回転方向と一致したことを確認して
解除し、その後の最初の有効エツジ信号を原点リセット
信号として出力するようにしたので、Ｃパルスの無効エ
ツジ付近で正逆反転してもリセット信号の誤出力を確実
に防止してカウンタ等の原点を正常に保つことができる
という効果が得られる。
路において、Ｃパルスの無効エツジ信号があるとリセッ
ト信号の出力を禁止するリセット信号出力禁止信号を回
転方向信号が実際の回転方向と一致したことを確認して
解除し、その後の最初の有効エツジ信号を原点リセット
信号として出力するようにしたので、Ｃパルスの無効エ
ツジ付近で正逆反転してもリセット信号の誤出力を確実
に防止してカウンタ等の原点を正常に保つことができる
という効果が得られる。
第１図はこの発明の実施例のブロック図、第２図は第１
図の要部ブロック図、第３図は第１図および第２図の動
作を示すタイムチャート、第４図は従来例のブロック
図、第５図は第４図のパルス波形を示すタイムチャー
ト、第６図は第４図のリセット信号の動作説明図、第７
図は第４図の動作を示すタイムチャートである。 ３，４……エツジ信号、６……回転方向信号、７……立
ち上がり検出手段、８……立ち下がり検出手段、９……
有効エツジ検出手段、１０……リセット信号、１１……
無効エツジ検出手段、１２……有効エツジ禁止検出手
段、１３……無効エツジ信号、１４……論理積素子、１
５……リセット信号出力禁止信号、１６……禁止信号メ
モリ、１７……有効エツジ信号、１８……リセット手
段。
図の要部ブロック図、第３図は第１図および第２図の動
作を示すタイムチャート、第４図は従来例のブロック
図、第５図は第４図のパルス波形を示すタイムチャー
ト、第６図は第４図のリセット信号の動作説明図、第７
図は第４図の動作を示すタイムチャートである。 ３，４……エツジ信号、６……回転方向信号、７……立
ち上がり検出手段、８……立ち下がり検出手段、９……
有効エツジ検出手段、１０……リセット信号、１１……
無効エツジ検出手段、１２……有効エツジ禁止検出手
段、１３……無効エツジ信号、１４……論理積素子、１
５……リセット信号出力禁止信号、１６……禁止信号メ
モリ、１７……有効エツジ信号、１８……リセット手
段。
Claims (1)
- 【請求項１】パルスエンコーダのＡ相パルスとＢ相パル
スの位相関係から求めた回転方向信号と前記エンコーダ
の１回転に１回出力するＣパルスの立ち上がり検出手段
および立ち下がり検出手段の出力信号とによりＣパルス
の有効エツジ検出手段で原点リセット信号を出力するパ
ルス読み込み回路において、前記有効エツジ検出手段と
並列にＣパルスの無効エツジ検出手段を設けるとともに
有効エツジ検出手段の次段に有効エツジ禁止検出手段を
設け、これらの出力信号の論理和のうちにＣパルスの無
効エツジ信号があると前記有効エツジ禁止検出手段およ
び論理積素子にリセット信号出力禁止信号を出力する禁
止信号メモリと、前記リセット信号出力禁止信号をその
出力後Ａ相パルスまたはＢ相パルスの少なくともいずれ
かの新しいエツジ信号の入力を待って解除しこの状態で
Ｃパルスの有効エツジ信号を前記論理積素子を介しリセ
ット信号として出力するリセット手段とを備えてなるこ
とを特徴とするパルスエンコーダのパルス読み込み回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6543288A JPH0612267B2 (ja) | 1988-03-18 | 1988-03-18 | パルスエンコーダのパルス読み込み回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6543288A JPH0612267B2 (ja) | 1988-03-18 | 1988-03-18 | パルスエンコーダのパルス読み込み回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01239417A JPH01239417A (ja) | 1989-09-25 |
| JPH0612267B2 true JPH0612267B2 (ja) | 1994-02-16 |
Family
ID=13286940
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6543288A Expired - Lifetime JPH0612267B2 (ja) | 1988-03-18 | 1988-03-18 | パルスエンコーダのパルス読み込み回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0612267B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH086259Y2 (ja) * | 1990-10-30 | 1996-02-21 | 株式会社小松製作所 | 直線位置検出装置 |
| DE102004048132A1 (de) * | 2004-10-02 | 2006-04-06 | Robert Bosch Gmbh | Verfahren zur Rückdreherkennung für Brennkraftmaschinen |
| JP2011143291A (ja) * | 2011-04-26 | 2011-07-28 | Sammy Corp | 遊技装置 |
-
1988
- 1988-03-18 JP JP6543288A patent/JPH0612267B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01239417A (ja) | 1989-09-25 |
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Legal Events
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Year of fee payment: 15 Free format text: PAYMENT UNTIL: 20090216 |