JPH0612361A - 送受信装置 - Google Patents
送受信装置Info
- Publication number
- JPH0612361A JPH0612361A JP8129792A JP8129792A JPH0612361A JP H0612361 A JPH0612361 A JP H0612361A JP 8129792 A JP8129792 A JP 8129792A JP 8129792 A JP8129792 A JP 8129792A JP H0612361 A JPH0612361 A JP H0612361A
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- Japan
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- transmission
- data
- buffer
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- transmitting
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Abstract
(57)【要約】
【目的】複数送受信回路の一つに送信データの送信処理
をさせるマイクロプロセッサの負荷軽減を図った送受信
装置を提供する。 【構成】マイクロプロセッサ２は、送信用ポインタ１に
よりデータ送信可能なバッファ６ｉ（アドレス７ｉ）の
指示を受けて送信データをデータバス３に送出する。送
受信回路４の全ては、データバス３から上記送信データ
を受け、それぞれ送信用バッファ５のうちの指定アドレ
ス７ｉを持つバッファ６ｉにこの送信データを取り込
む。送受信回路４は、上記送信データが書き込まれたバ
ッファ６ｉを見つけると、送信データ中の個別番号を自
身の識別番号と照合し、これらが一致するとバッフア６
ｉに取り込まれたデータの送信処理を行う。
をさせるマイクロプロセッサの負荷軽減を図った送受信
装置を提供する。 【構成】マイクロプロセッサ２は、送信用ポインタ１に
よりデータ送信可能なバッファ６ｉ（アドレス７ｉ）の
指示を受けて送信データをデータバス３に送出する。送
受信回路４の全ては、データバス３から上記送信データ
を受け、それぞれ送信用バッファ５のうちの指定アドレ
ス７ｉを持つバッファ６ｉにこの送信データを取り込
む。送受信回路４は、上記送信データが書き込まれたバ
ッファ６ｉを見つけると、送信データ中の個別番号を自
身の識別番号と照合し、これらが一致するとバッフア６
ｉに取り込まれたデータの送信処理を行う。
Description
【０００１】
【産業上の利用分野】本発明は制御回路や計算機などの
マイクロプロセッサにより複数の送受信回路のデータ送
信を制御する送受信装置に関する。
マイクロプロセッサにより複数の送受信回路のデータ送
信を制御する送受信装置に関する。
【０００２】
【従来の技術】従来のこの種の送受信装置は、データ送
信を行う送受信回路をマイクロプロセッサにより選択
し、このマイクロプロセッサにより選択された送受信回
路のみが上記送信データを受けてデータ送信を行ってい
た。
信を行う送受信回路をマイクロプロセッサにより選択
し、このマイクロプロセッサにより選択された送受信回
路のみが上記送信データを受けてデータ送信を行ってい
た。
【０００３】
【発明が解決しようとする課題】上述した送受信装置で
は、上記送受信回路が多数であると、これら送受信回路
の一つを選択する上記マイクロプロセッサの負担が大き
くなってしまうという欠点があった。
は、上記送受信回路が多数であると、これら送受信回路
の一つを選択する上記マイクロプロセッサの負担が大き
くなってしまうという欠点があった。
【０００４】
【課題を解決するための手段】この発明による送受信装
置は、送信データをデータバスに送信するマイクロプロ
セッサと、前記データバスから受けた前記送信データを
処理して送信する複数の送受信回路とを備える送受信装
置において、前記マイクロプロセッサが、送信処理を行
わせたい前記送受信回路の個別番号を含む前記送信デー
タを送信する手段を備え、前記送受信回路の各各が、固
有の識別番号を格納する識別番号格納手段と、前記デー
タバスから前記送信データを受けるデータ受信手段と、
前記データ受信手段が受けた前記個別番号と前記識別番
号格納手段に格納されている識別番号とを照合する識別
番号照合手段と、前記識別番号照合手段から前記照合結
果の一致情報を受けると前記データ受信手段が受けた前
記送信データを処理して送信するデータ送信手段とを備
えている。
置は、送信データをデータバスに送信するマイクロプロ
セッサと、前記データバスから受けた前記送信データを
処理して送信する複数の送受信回路とを備える送受信装
置において、前記マイクロプロセッサが、送信処理を行
わせたい前記送受信回路の個別番号を含む前記送信デー
タを送信する手段を備え、前記送受信回路の各各が、固
有の識別番号を格納する識別番号格納手段と、前記デー
タバスから前記送信データを受けるデータ受信手段と、
前記データ受信手段が受けた前記個別番号と前記識別番
号格納手段に格納されている識別番号とを照合する識別
番号照合手段と、前記識別番号照合手段から前記照合結
果の一致情報を受けると前記データ受信手段が受けた前
記送信データを処理して送信するデータ送信手段とを備
えている。
【０００５】
【実施例】次に本発明について図面を参照して説明す
る。
る。
【０００６】図１は本発明の一実施例のブロック図であ
る。この送受信装置は、送信データをデータバス３に送
信するマイクロプロセッサ２と、このマイクロプロセッ
サ２とデータバス３によって接続され上記送信データを
受けて送信処理するＮ（Ｎは整数）個の送受信回路４
（４Ａ，４Ｊ，４Ｎのみを示す）とを含んでいる。
る。この送受信装置は、送信データをデータバス３に送
信するマイクロプロセッサ２と、このマイクロプロセッ
サ２とデータバス３によって接続され上記送信データを
受けて送信処理するＮ（Ｎは整数）個の送受信回路４
（４Ａ，４Ｊ，４Ｎのみを示す）とを含んでいる。
【０００７】ここで、送受信回路４のそれぞれは、上記
送信データをデータバス３から受ける同一機能の送信用
バッファ５（５Ａ，５Ｊ，５Ｎのみを示す）を有してい
る。この送信用バッファ５は、８個のバッファ６ａ，６
ｂ，６ｃ，…，６ｉ，…，６（ｎ−１），６ｎを有する
（ｉは１〜８のうちの任意の数，ｎ＝８）。これらのバ
ッファ６にはそれぞれ、アドレス部７ａ，７ｂ，７ｃ，
…，７ｉ，…，７（ｎ−１），７ｎを有する。また、送
受信回路４は、自身を他の送受信回路４から識別する固
有の識別番号を図示されない記憶回路に記憶している。
なお、マイクロプロセッサ２の送信する送信データには
送信したい送受信回路４の個別番号、即ち，識別番号が
含まれている。
送信データをデータバス３から受ける同一機能の送信用
バッファ５（５Ａ，５Ｊ，５Ｎのみを示す）を有してい
る。この送信用バッファ５は、８個のバッファ６ａ，６
ｂ，６ｃ，…，６ｉ，…，６（ｎ−１），６ｎを有する
（ｉは１〜８のうちの任意の数，ｎ＝８）。これらのバ
ッファ６にはそれぞれ、アドレス部７ａ，７ｂ，７ｃ，
…，７ｉ，…，７（ｎ−１），７ｎを有する。また、送
受信回路４は、自身を他の送受信回路４から識別する固
有の識別番号を図示されない記憶回路に記憶している。
なお、マイクロプロセッサ２の送信する送信データには
送信したい送受信回路４の個別番号、即ち，識別番号が
含まれている。
【０００８】マイクロプロセッサ２は、送信用ポインタ
１によりデータ送信可能なバッファ６ｉの指示（即ち、
アドレス７ｉの指示）を受けて送信データをデータバス
３に送出する。送受信回路４の全ては、データバス３か
ら送信データを受け、それぞれ送信用バッファ５のうち
の指定アドレス７ｉを持つバッファ６ｉに上記送信デー
タを取り込む。なお、送信用ポインタ１は、上記の指示
を終えると次のデータ送信のためにインクリメントし、
次のバッファ６ｉを指示するようにしておく。
１によりデータ送信可能なバッファ６ｉの指示（即ち、
アドレス７ｉの指示）を受けて送信データをデータバス
３に送出する。送受信回路４の全ては、データバス３か
ら送信データを受け、それぞれ送信用バッファ５のうち
の指定アドレス７ｉを持つバッファ６ｉに上記送信デー
タを取り込む。なお、送信用ポインタ１は、上記の指示
を終えると次のデータ送信のためにインクリメントし、
次のバッファ６ｉを指示するようにしておく。
【０００９】送受信回路４は、８個のバッファ６ａ〜６
ｎを常にポーリングしており、上記送信データが書き込
まれたバッファ６ｉを見つけると、送信データ中の個別
番号を自身の識別番号と照合する。ここでは、送受信回
路４Ｊの識別番号と、上記バッファ６ｉ中の個別番号が
一致したとするので、送受信回路４Ｊはバッフア６ｉに
取り込まれたデータの送信処理を行う。一方、この場合
には、送信回路４Ａおよび４Ｎの識別番号とそれぞれの
送受信回路４Ａおよび４Ｎ中のバッファ６ｉに取り込ま
れた個別番号とは一致しないので、これら送受信回路４
Ａおよび４Ｎはデータの送信処理を行わない。
ｎを常にポーリングしており、上記送信データが書き込
まれたバッファ６ｉを見つけると、送信データ中の個別
番号を自身の識別番号と照合する。ここでは、送受信回
路４Ｊの識別番号と、上記バッファ６ｉ中の個別番号が
一致したとするので、送受信回路４Ｊはバッフア６ｉに
取り込まれたデータの送信処理を行う。一方、この場合
には、送信回路４Ａおよび４Ｎの識別番号とそれぞれの
送受信回路４Ａおよび４Ｎ中のバッファ６ｉに取り込ま
れた個別番号とは一致しないので、これら送受信回路４
Ａおよび４Ｎはデータの送信処理を行わない。
【００１０】なお、この送受信装置は、受信データの処
理においては送信用バッファ５を使用せず、各送受信回
路４ごとに固有のアドレスを持つ受信専用のバッファ
（図示せず）設け、データ受信が行われると割り込みに
てマイクロプロセッサ２に通報し、各受信回路４それぞ
れ用の上記受信専用バッファをマイクロプロセッサ２が
リードする。
理においては送信用バッファ５を使用せず、各送受信回
路４ごとに固有のアドレスを持つ受信専用のバッファ
（図示せず）設け、データ受信が行われると割り込みに
てマイクロプロセッサ２に通報し、各受信回路４それぞ
れ用の上記受信専用バッファをマイクロプロセッサ２が
リードする。
【００１１】
【発明の効果】以上説明したように本発明は、マイクロ
プロセッサから受けた送信データの処理判断を複数の送
受信回路でそれぞれ行わせるので、上記マイクロプロセ
ッサの負荷を軽減させる効果がある。
プロセッサから受けた送信データの処理判断を複数の送
受信回路でそれぞれ行わせるので、上記マイクロプロセ
ッサの負荷を軽減させる効果がある。
【図１】本発明の一実施例のブロック図である。
１ 送信用ポインタ ２ マイクロプロセッサ ３ データバス ４Ａ，４Ｊ，４Ｎ 送受信回路 ５Ａ，５Ｊ，５Ｎ 送信用バッファ ６ａ，６ｂ，６ｃ，６ｉ，６（ｎ−１），６ｎ バッ
ファ ７ａ，７ｂ，７ｃ，７ｉ，７（ｎ−１），７ｎ アド
レス
ファ ７ａ，７ｂ，７ｃ，７ｉ，７（ｎ−１），７ｎ アド
レス
Claims (1)
- 【請求項１】 送信データをデータバスに送信するマイ
クロプロセッサと、前記データバスから受けた前記送信
データを処理して送信する複数の送受信回路とを備える
送受信装置において、 前記マイクロプロセッサが、送信処理を行わせたい前記
送受信回路の個別番号を含む前記送信データを送信する
手段を備え、 前記送受信回路の各各が、固有の識別番号を格納する識
別番号格納手段と、前記データバスから前記送信データ
を受けるデータ受信手段と、前記データ受信手段が受け
た前記個別番号と前記識別番号格納手段に格納されてい
る識別番号とを照合する識別番号照合手段と、前記識別
番号照合手段から前記照合結果の一致情報を受けると前
記データ受信手段が受けた前記送信データを処理して送
信するデータ送信手段とを備えることを特徴とする送受
信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8129792A JP2825040B2 (ja) | 1992-04-03 | 1992-04-03 | 送受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8129792A JP2825040B2 (ja) | 1992-04-03 | 1992-04-03 | 送受信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0612361A true JPH0612361A (ja) | 1994-01-21 |
| JP2825040B2 JP2825040B2 (ja) | 1998-11-18 |
Family
ID=13742462
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8129792A Expired - Lifetime JP2825040B2 (ja) | 1992-04-03 | 1992-04-03 | 送受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2825040B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100347329B1 (ko) * | 2000-10-13 | 2002-08-07 | 주식회사 하이닉스반도체 | Ｐｃ 및 운용자 정합 프로세서간 데이터 송/수신 장치 및그 방법 |
-
1992
- 1992-04-03 JP JP8129792A patent/JP2825040B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100347329B1 (ko) * | 2000-10-13 | 2002-08-07 | 주식회사 하이닉스반도체 | Ｐｃ 및 운용자 정합 프로세서간 데이터 송/수신 장치 및그 방법 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2825040B2 (ja) | 1998-11-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980811 |