JPH06232099A - 半導体装置の製造方法,半導体装置の製造装置,半導体レーザの製造方法,量子細線構造の製造方法,及び結晶成長方法 - Google Patents

半導体装置の製造方法,半導体装置の製造装置,半導体レーザの製造方法,量子細線構造の製造方法,及び結晶成長方法

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JPH06232099A
JPH06232099A JP5044869A JP4486993A JPH06232099A JP H06232099 A JPH06232099 A JP H06232099A JP 5044869 A JP5044869 A JP 5044869A JP 4486993 A JP4486993 A JP 4486993A JP H06232099 A JPH06232099 A JP H06232099A
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etching
layer
semiconductor
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弘隆 杵築
Akio Hayafuji
紀生 早藤
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達也 木村
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Mitsubishi Electric Corp
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Abstract

(57)【要約】 【目的】 ドライエッチングとMOCVD再成長を組み
合わせたプロセスにおいて、特にAlGaAsのGaA
s再成長層の結晶品質向上を図る。 【構成】 AlGaAs上にGaAsキャップ層をあら
かじめ形成しておき、ドライエッチングは上記GaAs
キャップ層より行うものとし、さらにエッチングに先立
って硫化アンモニウム溶液にてキャップGaAs表面の
クリーニングを行う。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、半導体装置の製造方
法,半導体装置の製造装置,半導体レーザの製造方法,
量子細線構造の製造方法,及び結晶成長方法に関し、特
にドライエッチングとエピタキシャル成長とを組み合わ
せた複合プロセスに関するものである。
【0002】
【従来の技術】近年、半導体レーザダイオードや量子細
線構造の製造工程において、エッチングと再成長を組み
合わせた微細構造作製技術の開発が活発化している。こ
れは結晶の一部を選択的にエッチングしそこに改めて周
りの結晶とは電気的,光学的に異なるエピタキシャル層
の成長を行うことで、所望の電子状態を実現しようとす
る技術である。このようなプロセスにおいては所望の形
状を制御性よく形成する技術とともに再成長界面の清浄
度を制御する技術の開発が重要な課題として注目されて
いる。特にAlGaAsに関してはAlが非常に酸化し
やすい材料であるため、表面に形成される酸化膜によっ
てエッチングが阻害され所望の形状が得られず、あるい
は再成長界面が汚染されるために再成長層の結晶品質が
著しく低下するなどの問題点が生じ、デバイス応用に際
して解決すべき重要な課題となっている。
【0003】例えば特公平3−59576に従来のAl
GaAsのエッチング方法の一例とし以下に示す方法が
開示されている。即ち反応性ドライエッチングの手法を
用いてAlGaAsをエッチングする際にAlGaAs
の表面酸化を排除するため、AlGaAsに連続してG
aAs保護層をあらかじめ形成することでAlGaAs
表面の酸化膜の形成を未然に防止することができるとい
う方法である。反応性ドライエッチングを上記GaAs
保護層から開始することで初めてAlGaAsの良好な
エッチングができたと報告している。なお、AlGaA
sをHClガスを用いてガスエッチングする際に、Ga
Asキャップ層を採用することで、良好なエッチングが
可能である旨の記載は、上記公報の他、特開昭61−1
84892号公報にもなされている。
【0004】図34は例えば特公平3−55439に開
示された、第2の従来例である化合物半導体の気相エッ
チング方法を説明するための図である。図において、2
41は反応管、242は基板ホルダ、243は半導体基
板、244は抵抗加熱手段、245はバイパスパイプ、
246は低温領域、247は高温領域、248はエッチ
ングガス導入口をそれぞれ示している。
【0005】このエッチング方法は半導体基板243を
低温領域246で保持し、ここでHClを半導体基板2
43表面に充分に吸着させた後、半導体基板243を高
温領域247に移動させ、一定時間保持した後再び低温
領域246に移動させることを1サイクルとしてエッチ
ングを施す方法である。この方法によれば、温度400
℃程度の低温領域246ではHClガスを供給してもエ
ッチングを生じることはなく、基板表面へのClの吸着
のみが生じる。しかる後、半導体基板を600℃以上の
高温領域247に移動させた際に吸着したClがGaC
l3 として半導体表面から脱離し1分子層の単位でエッ
チングが行われるため、制御性よくエッチングを行うこ
とができる。
【0006】図35は例えばアプライドフィジックスレ
ターズ,1989年,55巻,2715〜2717ペー
ジ(Applied Physicss Letters, 55(1989), pp2715-271
7)に開示された、第3の従来例である量子細線レーザの
構造を示す断面構造図である。図において、250はn
+ −GaAs基板、251はn−Aly Ga1-y As第
1クラッド層、252はAlx Ga1-x Asバリア層、
253はGaAs量子井戸層、254はAlx Ga1-x
Asバリア層、255はp−Aly Ga1-y As第2ク
ラッド層、256はp+ −GaAsキャップ層、257
はTi/Au電極、258はイオン注入による高抵抗化
領域である。また259は量子細線が形成された活性領
域を示している。
【0007】この第3の従来例における半導体レーザ
は、V字型の溝を形成したn+ −GaAs基板250上
にn−Aly Ga1-y As第1クラッド層251、Al
x Ga1-x Asバリア層252,254とGaAsウェ
ル層253からなる活性層、p−Aly Ga1-y As第
2クラッド層255、及びP+ −GaAsキャップ層2
56を順次積層して形成されており、p−Aly Ga1-
y As第2クラッド層255の一部はイオン注入により
高抵抗化され電流狭窄層258を形成している。
【0008】ここで活性層は通常の平面基板上では量子
井戸構造となるが、V字型の溝の底部付近では以下に示
す理由により量子細線構造が形成される。
【0009】図において半導体主面は(100)面であ
り、V字型の溝は[0/11]方向に通常の写真製版工
程とウェットエッチングの手法を用いて形成されてい
る。従ってV字溝の側面は(111)A面となる。典型
的なMOCVDの成長条件では(100)面上の成長速
度と、(111)A面上の成長速度とはほぼ等しいた
め、図35に示すようにV字溝に沿って各層が平行に成
長するような成長形態をとる。この時V字底部の先端部
は若干の丸みを帯びているため、部分的には(100)
面が露呈しておりV字底部の先端部のごく狭い領域にお
いては(100)面と垂直な方向に成長し、V字側面と
比較して膜厚が厚くなる。このようにしてGaAs量子
井戸層はV字底部において三日月型の量子細線259を
形成する。
【0010】図33は例えばジャパニーズジャーナルオ
ブアプライドフィジックス,1991年,30巻,L9
04〜L906ページ(Japanese Journal of Applied
Physics, Vol.30, (1991) ,pp.L904-L906) に開示され
た、第4の従来例であるレーザ発振端面に窓構造を有す
る高出力レーザの構造の一例を示す斜視図である。図に
おいて、231はp−GaAs基板、232はn−Ga
As電流ブロック層、233はp−Al0.33Ga0.67A
sクラッド層、244はp−Al0.08Ga0.92As活性
層、235はn−Al0.33Ga0.67Asクラッド層、2
36はn−GaAsコンタクト層である。また237は
劈開により形成された(110)端面、238は劈開端
面237上に形成されたアンドープAl0.4 Ga0.6 A
s窓層である。
【0011】次に上記従来の高出力レーザに採用されて
いる窓構造について説明する。AlGaAs系の高出力
レーザにおいては、レーザの発振端面において多くの表
面準位が形成されている。この表面準位の影響により端
面近傍はレーザ中央部と比較して、等価的にバンドギャ
ップの減少が生じている。従ってレーザ光の波長に対し
ては端面近傍領域は吸収領域となり、光出力増加に伴っ
て上記吸収領域での局所的発熱が大きくなる。バンドギ
ャップは温度の上昇に伴って縮小するため、レーザ光の
吸収はさらに増大し、温度上昇を引き起こすという正帰
還がかかり、ついには溶融破壊にいたる。この現象を光
学損傷といいAlGaAs系の高出力レーザにおいて深
刻な問題となっている。窓構造はレーザ発振端面近傍領
域にレーザの発振波長よりもバンドギャップの大きい領
域を設けることで、端面近傍での光吸収を減少させ上記
光学損傷を防止する目的で設けられている。
【0012】上記従来の高出力レーザにおいては、窓構
造を形成するにあって以下に示す工程を施している。ま
ず通常のウェットエッチングとLPE成長を組み合わせ
てレーザ構造を作製する。即ち、p−GaAs基板23
1上にn−GaAs電流ブロック層232を結晶成長し
た後、素子中央部に電流ブロック層232を貫通し基板
231に達するストライプ状のV溝を形成する。この
後、ウエハ上にp−Al0.33Ga0.67Asクラッド層2
33、p−Al0.08Ga0.92As活性層244、n−A
l0.33Ga0.67Asクラッド層235、及びn−GaA
sコンタクト層236を順次結晶成長する。次にウェハ
を所望の厚みまで研磨した後、共振器長に相当する幅の
バー状に劈開する。典型的な高出力レーザでは共振器長
は300〜600μmである。次に劈開したウェハの共
振器端面に相当する部分に発振レーザ光のエネルギーバ
ンドギャップの大きい材料をMOCVD法により成長す
る。
【0013】本従来例の場合、レーザ発振波長は830
nmであり、エネルギーに換算して約1.49eVであ
るので、窓層として約1.93eVのバンドギャップを
有するアンドープAl0.4 Ga0.6 As層238を用い
ている。次に電極形成を行い最後に窓層端面のコーティ
ングを行った後、チップ分離を行いレーザチップとして
完成する。上記ジャパニーズジャーナルオブアプライド
フィジックス,1991年,30巻,L904〜L90
6ページには窓構造を採用することにより光学損傷が抑
制され高出力化と長寿命化を図ることができたと報告さ
れている。
【0014】また、図36はIEEE ジャーナルオブ
カンタムエレクトロニクス,1987年,23巻,72
0ページ(IEEE J. of Quantum Elections Vol.23(198
7), 720ページ)に示された方法を用いた、第5の従来
例である半導体レーザの製造方法を示す断面工程図であ
る。図において、300はn−GaAs基板、301は
n−GaAsバッファ層、302はn−AlGaAsク
ラッド層、303はアンドープGaAs活性層、304
はp−AlGaAsクラッド層、305はn−GaAs
電流ブロック層、306はSiO2 膜、307はp−A
lGaAs埋め込み層、308はp−GaAsコンタク
ト層である。
【0015】次に製造方法について説明する。まず、
(100)面を主面とするn−GaAs基板300上に
MOCVD法によりn−GaAsバッファ層301,n
−AlGaAsクラッド層302,アンドープGaAs
活性層303,p−AlGaAsクラッド層304,及
びn−GaAs電流ブロック層305を順次結晶成長し
た後、スパッタによりSiO膜306を電流ブロック層
305表面に成膜し、これを通常の写真製版プロセス等
を用いてパターニングしストライプ状の開口部を形成す
る(図36(a) )。開口部のストライプ方向は[0/1
1]である。
【0016】次に、酒石酸系のエッチング液を用いてn
−GaAs電流ブロック層305をエッチングし、図3
6(b) のように溝を形成する。ここで、このウェットエ
ッチングでは溝の底部にn−GaAs電流ブロック層3
05をわずかに残す。これはGaAs電流ブロック層を
残さずエッチングした場合、露出したp−AlGaAs
クラッド層304が空気中及び水溶液中で酸化し、その
上に成長する結晶に悪影響を与えるため、これを防止す
るためである。なおこの溝側面には(111)A面が現
れる。
【0017】次に、ウエハをMOCVD室の反応管内に
セットし、反応管内にHClとAsH3 を流して残りの
n−GaAs電流ブロック層305を気相エッチングし
て除去する(図36(c) )。
【0018】次に、上記気相エッチング工程に連続し
て、ウエハを空気をふれさせることなく反応管内におい
て溝内に選択的にp−AlGaAsクラッド層307を
MOCVDにより結晶成長させる。この際図36(d) の
ように、表面がフラットになるようには埋まらない。こ
れは、図37に示すように、側面の(111)A面と底
面の(100)面の両面から成長が始まり、側面とSi
O膜306が接したところから(100)表面に対して
約54°の角度をもつ(111)B面が形成され、この
図に示すようにウエハ上に凸の部分ができるからであ
る。
【0019】最後にSiO膜306をHF系エッチング
液で除去した後、再びMOCVD法でp−GaAsコン
タクト層308を成長する。図36(e) に示すように、
p−GaAsコンタクト層を厚く成長しても表面の凸部
は平坦にはならない。
【0020】ところで、異種基板上の結晶成長技術は、
例えばSi電子デバイスと化合物半導体発光デバイスの
融合化等、より高度な情報処理手段実現のためのキーテ
クノロジーであり、多くの研究機関で精力的な研究が行
われている。特にSi基板上のGaAs成長技術は応用
範囲の広範さからその技術の確立が強く望まれている
が、GaAsとSiの熱膨張係数の違いに起因してGa
As層に大きなストレスが残留し、その結果GaAs層
にクラックが発生するといった問題点が未解決の問題と
して残されている。
【0021】図38は、例えば米国特許5145793
号に開示された、第6の従来例であるSi基板上GaA
s結晶成長方法におけるクラック発生の抑制方法を説明
するための断面構造図である。図において、501はS
i基板、502はボロンナイトライド膜(以下、BN膜
と称す)、503は第1のGaAs層、505は第2の
GaAs層、506は第3のGaAs層、504はメサ
溝である。
【0022】まず、図38(a) に示すように、Si基板
501の第1の主面上に2μm以下の厚みの第1のGa
As層503をいわゆる2段階成長方法によって形成
し、その後、Si基板501の第2の主面上に常温でB
N膜502を形成する。ここで2段階成長法とは、50
0℃以下の低温で100〜400オングストローム程度
の低温バッファ層を形成し、しかる後GaAsの成長に
適した700℃程度の温度に昇温し、所望の厚みのGa
As層を成長させる方法であり、Si基板上のGaAs
成長に広く用いられている手法である。2段階成長法を
用いることでGaAsの3次元成長が抑制され、高品質
なエピタキシャル成長層が得られるという効果がある。
【0023】次に、図38(b) に示すように、第1のG
aAs層503のデバイス作成領域に相当する部分を取
り囲むようにメサ溝504を形成する。メサ溝504は
通常のフォトリソグラフィーとウエットエッチングによ
って容易に形成できる。
【0024】次に、このメサ溝504を形成したウエハ
を700〜800℃程度に昇温した後(図38(c) )、
ウエハ上に、図38(d) に示すように、デバイスの活性
層となる第2のGaAs層505,及び第3のGaAs
層506を順次通常のMOCVD法によって形成する。
この結晶成長では、メサ溝部に露出したSi基板501
表面上には自然酸化膜が形成されているためにGaAs
結晶は成長されず、GaAs層の選択成長が行なわれ
る。
【0025】本従来例においては、この後、第1のGa
As層503形成後に設けられたメサ溝504周辺部の
GaAs層を選択的に除去して、図38(e) に示すよう
に、メサ溝504より幅の広いメサ溝507を形成して
いる。第2,第3のGaAs層の成長工程において、メ
サ溝部に飛来した反応ガスはSi基板上には堆積せず、
メサ溝周辺部のGaAsの成長に消費される。このため
メサ溝周辺部では成長層が厚くなり、特にエッジ部分で
は鋭く盛り上がってしまう。この盛り上がり部分では、
機械的ストレスが集中するため、この部分からクラック
が発生してしまう。このような盛り上がり部分を選択的
に除去して形成されたのがメサ溝507である。
【0026】なお、本従来例においてSi基板の第2の
主面にBN膜502を形成しているのはウエハの反りを
抑制するためである。
【0027】次に、本従来例の効果について説明する。
図40に示すように、Si基板上のGaAs成長層のク
ラックの発生とGaAs層の厚みとは密接に関係してい
る。
【0028】すなわち、クラックはGaAs層の厚みが
3μm以上で発生し始め、GaAs層厚みの増加と共に
クラックの発生も増加する。これらクラックの発生状況
を調べたところ、大部分がウエハ端の異常成長を起点と
して発生することが明らかになった。そこで本従来例で
は、クラックがほとんど発生しない2μm以下の厚みの
第1のGaAs層503をまず成長し、次にデバイス領
域となる部分を囲むようにメサ溝504を形成した後、
デバイスの活性領域となる第2のGaAs層505,及
び第3のGaAs層506を形成するように構成してい
る。このように構成することで、ウエハ端からのクラッ
クはメサ溝504までは伝播するが、メサ溝504の内
側のエリアへは伝播せず、デバイス領域のクラック数を
抑制することができる。
【0029】
【発明が解決しようとする課題】次に、第1の従来例と
して示した特公平3−59576に開示されたAlGa
Asのエッチング方法における問題点について説明す
る。
【0030】図30,及び図31は第1の従来例におけ
るAlGaAsのエッチング方法の効果を確認するため
に行なった実験のサンプル構造を説明するための断面構
造図である。これら図において、1は再成長GaAs
層、2はAlx Ga1-x As層、23はGaAs基板、
211はGaAsキャップ層である。図30,図31に
示す第1,第2の2種類のサンプルをそれぞれ図30
(a) 〜(c) ,及び図31(a) 〜(c) の各工程に従って作
製した。まず第1の結晶成長工程として、第1のサンプ
ルでは図30(a) に示すように、GaAs基板23上に
Alx Ga1-x As層2とGaAsキャップ層211を
MOCVD法によって連続して成長した。一方、第2の
サンプルでは図31(a) に示すように、GaAs基板2
3上にAlxGa1-x As層2のみをMOCVD法によ
って成長した。各層の厚みはAlx Ga1-x As層2が
2μm、GaAsキャップ層211が0.1μmであ
る。この後、上記2種類のサンプルを一度チャンバーよ
り取出し、空気中で数日間保管した。次工程において
は、HClガスを用いたガスエッチングの手法を用い
て、図30(b) 及び図31(b) に示すように、1μmの
エッチングを施し、引き続き、同一チャンバー内で、図
30(c) 及び図31(c) に示すように、通常のMOCV
D法により再成長GaAs層1を2μm成長した。
【0031】図32に上記2種類のサンプルのAlx G
a1-x As層2と再成長GaAs層1の界面,即ち再成
長界面近傍の不純物分析をSIMS分析の手法を用いて
行った結果について示す。図において、1は再成長Ga
As層、2はAlx Ga1-xAs層、3は再成長界面で
ある。図32(a) は図30に示した第1のサンプルのS
IMS分析結果を、図32(b) は図31に示した第2の
サンプルのSIMS分析結果をそれぞれ示している。図
に示すように2種類のサンプルとも再成長界面に酸素
(O),塩素(Cl)の偏析が認められた。また2種類
のサンプルについて再成長GaAs層の転移密度を調べ
たところ、第2のサンプルが5×108 個/cm2 、第1
のサンプルが5×105 個/cm2 であった。
【0032】以上の結果は次のように解釈される。表面
酸化したAlx Ga1-x As層2よりエッチングを開始
した第2のサンプルではエッチング工程において表面の
酸化膜と塩素とが化合し、エッチング生成物としてウェ
ハ表面に付着,残留し、再成長界面3に偏析したものと
考えられる。さらにこの酸素,塩素の再成長界面3への
偏析が再成長GaAs層1の結晶品質を著しく劣化させ
る原因となっている。
【0033】一方GaAsキャップ層211を設けた第
1のサンプルではGaAsキャップ層211によりAl
x Ga1-x As層2表面の酸化が抑制され、再成長界面
3における酸素と塩素の偏析が第2のサンプルと比較し
て低いレベルに抑えられており、キャップ構造を採用す
ることによる改善効果が確認できた。しかし依然として
再成長界面への酸素,塩素の偏析は生じており、再成長
GaAs層の転移密度も化合物半導体デバイスに要求さ
れる典型的な転移密度1×104 個/cm2 と比較して1
桁以上劣化していた。この結果はGaAsキャップ層表
面のわずかな酸化膜によっても再成長界面3への酸素,
塩素の蓄積が生じることを示している。
【0034】即ちGaAsキャップ構造を採用しただけ
では、AlGaAsの清浄なエッチングを得ることは困
難であり、特公平3−59576に開示された技術のみ
では清浄なエッチングと高品質な再成長GaAs層を得
ることは困難であるなどの問題点があった。
【0035】次に第2の従来例として示した従来の化合
物半導体の気相エッチング方法における問題点について
説明する。第2の従来例における化合物半導体の気相エ
ッチング方法は上述のように構成されているので、高温
領域と低温領域との間でウェハの移動を繰り返さなけれ
ばならず、しかも基板温度が特定の温度となるまで一定
時間保持する必要があるために1サイクルのエッチング
にかかる時間が数分かかるなど、エッチングレートが極
めて遅く、実用的なプロセスではなかった。さらにGa
As表面からのAsの脱離とGaの脱離を独立に制御す
ることが困難であり、平滑なエッチングを行うことが困
難であるなどの問題点があった。
【0036】次に第3の従来例として示した従来の量子
細線レーザにおける問題点について説明する。第3の従
来例における量子細線レーザは上述のように構成されて
いるので、次に示すような問題点があった。即ちレーザ
の活性領域を形成する量子細線が制御性よく形成できな
いという問題点である。第3の従来例においては(11
1)A面で構成されたV字溝にレーザ構造を埋め込む構
成になっており、そのV字底部のごく狭い領域のみに三
日月型の量子細線を形成するとしている。しか上述のよ
うに典型的なMOCVD法の成長条件では(111)A
面上の成長速度は(100)面上の成長速度とほぼ等し
いため、V字表面には量子井戸構造が形成され、この量
子井戸構造に連続して厚みの厚い三日月型の量子細線が
形成されるため、活性領域のとる電子状態は量子井戸と
量子細線の複合された電子状態となり、レーザの発振モ
ードも多モード型となる。さらに量子細線が量子井戸と
結合された構造となっているので、量子細線としての特
性を独立に引き出すことが困難である。従って第3の従
来例では同一の特性を有する量子細線を制御性,再現性
よく形成することは困難であるなどの問題点があった。
【0037】次に第4の従来例として示した従来の高出
力レーザにおける問題点について説明する。第4の従来
例における高出力レーザは上述のように構成されてお
り、レーザの基本構造を構成する結晶成長工程を終了し
た後、ウェハを所望の厚みまで研磨し、次に共振器長に
相当する幅のバー状に劈開し、次に劈開したウェハの共
振器端面に相当する部分に窓層をMOCVD法により成
長し、次に電極形成を行ない、最後に窓層端面のコーテ
ィングを行なったのちチップ分離を行うという複雑な工
程により作製されている。通常半導体レーザの製造工程
は、量産性,再現性を確保するために電極形成まではウ
ェハ状態のまま行なわれる。即ち、共振器長に相当する
幅のバー状に劈開したウェハの共振器端面に相当する部
分に窓層を形成するという第4の従来例に示された方法
は極めて量産性に乏しく、工業的に有用な製造方法とは
考えにくい。さらに劈開により共振器端面を形成した後
に窓層をMOCVD法によって形成する場合、劈開を空
気中で行うかぎり共振器端面はすぐに酸化し表面準位を
形成する。すでに表面準位を形成した共振器端面上に窓
層を形成しても所望の効果を得ることは困難であり、所
望の効果を得るためには劈開から窓層成長までの工程を
不活性ガス中か真空中で行なう必要があるなどの問題点
があった。
【0038】上記第4の従来例がこのような複雑な工程
を用いて構成されている理由を次に示す。レーザの共振
器端面はレーザ光の反射端面でもあり、光学的に極めて
平坦な面で形成されている必要がある。さらに共振器方
向に垂直な平面である必要もある。その結果半導体の主
面を(100)面とし(100)面と垂直な劈開面を共
振器端面とする従来の製造方法が提案され、一般的な製
造方法として確立されるに至った。しかし半導体レーザ
の高出力化,多機能化が進むにつれウェハ状態のままで
レーザの共振器端面を形成する技術の確立が強く望まれ
るようになり、例えばリアクティブイオンエッチング法
(RIE法)などのドライエッチングの手法を用いた端
面形成法が開発されつつある。しかし現状のRIE法で
は垂直なエッチングは可能であるが、イオンの衝突によ
る物理的なダメージが共振器端面の結晶品質を劣化させ
るなどの問題が生じている。さらには劈開面と同等レベ
ルの平坦性を確保することが困難であり、RIE法によ
る端面形成技術の確立には至っていない。以上の理由に
より現有の技術ではレーザ発振端面は劈開により形成せ
ざるを得ないため、端面窓構造を有する高出力レーザの
製造方法は、上記第4の従来例のようにウェハを劈開し
た後に窓層を形成するという複雑な製造方法となってい
る。
【0039】次に第5の従来例として示した従来の半導
体レーザの製造方法における問題点について説明する。
第5の従来例における半導体レーザの製造方法は以上の
ように構成されているので、表面上に凸部ができ、結晶
成長後のプロセス、例えば上部電極のパターニング等に
おける写真製版ができなくなるという問題点があり、ま
た、この方法により製造された半導体レーザをジャンク
ションダウン(Junction-down )即ち、ヒートシンク上
にp−GaAsコンタクト層側をヒートシンクとの当接
面として組み立てた場合、活性層に圧縮ストレスがかか
りレーザの信頼性に影響するという問題点があった。
【0040】次に第6の従来例として示した従来の結晶
成長方法における問題点について説明する。従来のSi
基板上GaAs結晶成長方法は以上のように構成されて
いるので、次に示すような問題点があった。図39は従
来のSi基板上GaAs結晶成長方法の問題点を説明す
るための図である。図において、510はGaAs層、
511はクラックを示している。我々の詳細な実験によ
ると、従来の技術の項でも述べたようにGaAs層のク
ラックの大部分はウエハ端より発生しており、本従来例
におけるメサ構造により、ウエハ端で発生したクラック
はほぼ全数メサ溝504で分断され、デバイスエリアへ
は貫通しないことを確認した。しかし、5cm×5cmのメ
サ溝領域内に十数本のクラックが発生し、完全には抑制
できないという問題点に直面した。このようなクラック
の発生原因を詳細に調べたところ、図39(b) に示す菱
形状のピットを起点として発生していることが明らかに
なった。さらに、この菱形状のピットは第1のGaAs
503と第2のGaAs層505の界面より発生してい
ることも確認した。
【0041】この菱形状のピットが発生した原因は次の
ように説明される。すなわち、第1のGaAs層503
を成長させた後、フォトリソグラフィーとウエットエッ
チングによってメサ溝504を形成するが、このとき塗
布したレジストが完全に除去されず、不純物としてウエ
ハ表面に残留し、ピットの原因になったと考えられる。
一般にGaAs層はSi基板より表面クリーニングが困
難であり、一旦レジスト塗布等によって汚染されたGa
As層を清浄な状態にクリーニングするのは極めて困難
である。しかし、ウエハ端より発生するクラックの伝播
を遮断するためには、メサ溝504等によりデバイス領
域をウエハ端より孤立させる必要がある。
【0042】一方、上記問題点の解決策としてあらかじ
め絶縁膜によりパターニングしたSi基板上へのGaA
s成長も試みられたが、低温バッファ層成長時に絶縁膜
上へのポリクリスタルの析出が生じるという問題点が新
たに発生した。一般に低温バッファ層を成長させるよう
な500℃以下の温度領域においては良好な選択成長を
行うことは困難であり、絶縁膜上にポリクリスタルが析
出する。このポリクリスタル上に続けて700℃程度の
温度でGaAs層を成長すると新たなポリクリスタルの
成長が生じ、結果としてウエハ全面の結晶はつながった
状態になり、絶縁膜によりパターニングしたエリア内だ
けを孤立化させることはできない。このためウエハ端よ
り発生したクラックは、絶縁膜上のポリクリスタルを伝
播し、デバイスエリア内まで貫通する。
【0043】以上のような理由によりSi基板上のGa
As成長において、ウエハ端からのクラックの伝播を抑
制するためには本従来例のような構成にしなければなら
ず、結果として菱形状のピットが発生し、クラックの完
全な抑制は実現できないという問題点があった。
【0044】この発明は上記のような問題点を解消する
ためになされたもので、ドライエッチングの一手法であ
るガスエッチングとMOCVD法による結晶成長を組み
合わせた半導体装置の製造方法において、AlGaAs
の清浄なエッチングができるとともに再成長界面に不純
物が偏析しない半導体装置の製造方法を提供することを
目的とする。
【0045】また、この発明は、AlGaAsを塩素系
エッチングガスを用いてドライエッチングする際に、劈
開面と比較しても遜色のない平滑なエッチング面を得る
ことを目的とする。
【0046】また、この発明は、一原子層単位で制御で
きるとともに、平滑なエッチング面が得られる化合物半
導体のエッチング方法とこのエッチングを行なうに適し
た製造装置を提供することを目的とする。
【0047】また、この発明は、極めて均一に制御され
た量子細線構造の製造方法を提供することを目的とす
る。
【0048】また、この発明は、レーザの共振器に対し
て垂直でしかも光学的にも極めて平坦で鏡面性に優れ、
かつ物理的ダメージのない共振器端面をエッチングによ
り実現できる半導体レーザの製造方法を提供し、さらに
この方法を応用した窓構造を有する高出力レーザの製造
方法を提供することを目的とする。
【0049】また、この発明は、埋め込み成長後の表面
をフラットな状態とでき、結晶成長工程後の製造プロセ
スを容易とでき、ジャンクションダウンで組み立てた場
合でも信頼性の高い半導体レーザを作製できる半導体レ
ーザの製造方法を得ることを目的とする。
【0050】また、この発明は、絶縁膜によるパターニ
ングを施した基板上に500℃以下の低温でも良好な選
択成長が得られる結晶成長方法を得ることを目的として
おり、さらにこの技術を用いて、異種基板上への結晶成
長において、クラックの発生を完全に抑制することので
きる結晶成長方法を得ることを目的としている。
【0051】
【課題を解決するための手段】この発明に係る半導体装
置の製造方法は、Alを構成元素として含む化合物半導
体に絶縁膜によるパターニングを施す工程と、ドライエ
ッチングの手法を用いて微細構造を作製する工程と、上
記微細構造を化合物半導体で埋め込む工程とを含む化合
物半導体装置の製造方法において、上記Alを構成元素
として含む化合物半導体上に連続してAlを含まない化
合物半導体保護層を形成する第1の工程と、上記化合物
半導体保護層上に絶縁膜による選択マスクを形成する第
2の工程と、第2の工程を終えた半導体ウェハを硫化ア
ンモニウム溶液に浸漬する第3の工程と、反応管内にお
いて塩素系ガスを用いてエッチングを施す第4の工程
と、上記反応管内において上記第4の工程によって作製
された微細構造をMOCVDの手法を用いて化合物半導
体層で埋め込む第5の工程とを含むものである。
【0052】また、この発明に係る半導体装置の製造方
法は、Alを構成元素として含む化合物半導体に絶縁膜
によるパターニンクを施す工程と、ドライエッチングの
手法を用いて微細構造を作製する工程と、上記微細構造
を化合物半導体で埋め込む工程とを含む化合物半導体装
置の製造方法において、上記Alを構成元素として含む
化合物半導体上に連続してAlを含まない化合物半導体
保護層を形成する第1の工程と、上記化合物半導体保護
層上に絶縁膜による選択スマクを形成する第2の工程
と、反応管内において上記化合物半導体保護層の表面酸
化膜を除去する第3の工程と、上記反応管内において塩
素系ガスを用いてエッチングを施す第4の工程と、上記
反応管内において上記第4の工程によって作製された微
細構造をMOCVDの手法を用いて化合物半導体層で埋
め込む第5の工程とを含むものである。
【0053】また、この発明に係る半導体装置の製造方
法は、Alx Ga1-x As(0≦x≦1)を塩素系エッ
チングガスを用いたドライエッチングによりエッチング
する工程を含む半導体装置の製造方法において、上記ド
ライエッチングとして塩素系エッチングガスとV族ガス
と水素ガスとを同時に供給することにより行なうガスエ
ッチングの手法を用い、上記塩素系エッチングガスとし
てHClガス又はCl2 ガスを用い、上記V族ガスとし
てアルシン(AsH3 )ガス,ターシャリブチルアルシ
ン(C4 H9 AsH2 )ガス,又はトリメチルアルシン
((CH3 )3As)ガスのいずれかを用い、上記V族
ガスの分圧を8×10-3Torr以上0.08Torr
以下とし、かつ上記エッチングガス流量に対する上記V
族ガス流量の比を2.5以下としてエッチングを行なう
ものである。
【0054】また、この発明に係る半導体レーザの製造
方法は、半導体基板上に複数種類のAlx Ga1-x As
(0≦x≦1)からなり所定のレーザダイオード構造を
有する結晶構造を作製する第1の工程と、上記レーザダ
イオード構造の結晶構造上にエッチングマスクとなる絶
縁膜を形成する第2の工程と、塩素系エッチングガスと
V族ガスと水素ガスとを同時に供給することにより行な
うガスエッチングであって、上記塩素系エッチングガス
としてHClガス又はCl2 ガスを用い、上記V族ガス
としてアルシン(AsH3 )ガス,ターシャリブチルア
ルシン(C4 H9 AsH2 )ガス,又はトリメチルアル
シン((CH3 )3 As)ガスのいずれかを用い、上記
V族ガスの分圧を8×10-3Torr以上0.08To
rr以下とし、かつ上記エッチングガス流量に対する上
記V族ガス流量の比を2.5以下として行なうエッチン
グによりレーザダイオードの発振端面を形成する第3の
工程とを含むものである。
【0055】また、この発明に係る半導体レーザの製造
方法は、窓付き屈折率ガイド型の半導体レーザを製造す
る方法であって、半導体基板上に複数種類のAlx Ga
1-xAs(0≦x≦1)からなり活性領域を構成する半
導体積層構造を形成する第1の結晶成長工程と、該半導
体積層構造上にエッチングと結晶成長を選択的に行うた
めの保護膜を形成する工程と、上記保護膜をマスクとし
て用い、塩素系エッチングガスとV族ガスと水素ガスと
を同時に供給することにより行なうガスエッチングであ
って、上記塩素系エッチングガスとしてHClガス又は
Cl2 ガスを用い、上記V族ガスとしてアルシン(As
H3 )ガス,ターシャリブチルアルシン(C4 H9 As
H2 )ガス,又はトリメチルアルシン((CH3 )3 A
s)ガスのいずれかを用い、上記V族ガスの分圧を8×
10-3Torr以上0.08Torr以下とし、かつ上
記エッチングガス流量に対する上記V族ガス流量の比を
2.5以下として行なうエッチングにより上記半導体積
層構造をエッチングする工程と、該エッチング工程で残
された半導体積層構造を埋め込むようにレーザ発振領域
の材料と比較してバンドギャップが大きく、かつ半絶縁
性もしくは高抵抗の半導体材料を結晶成長し電流阻止領
域及び窓領域を一括同時に形成する第2の結晶成長工程
と、上記保護膜を除去する工程と、表面オーミックコン
タクト領域を形成する第3の結晶成長工程とを含むもの
である。
【0056】また、この発明に係る半導体装置の製造方
法は、 III−V族化合物半導体を塩素系エッチングガス
を用いてガスエッチングする工程を含む半導体装置の製
造方法において、V族水素化物ガスを導入すると同時に
塩素系ガスを上記V族水素化物ガスの導入時間より短い
時間だけパルス的に導入する第1のエッチング工程と、
上記V族水素化物ガスと上記塩素系ガスの導入を中断
し、反応管内を水素ガスでパージする第2のエッチング
工程とを含み、上記第1のエッチング工程と、上記第2
のエッチング工程とを周期的に繰り返し行なうようにし
たものである。
【0057】また、この発明に係る半導体装置の製造装
置は、 III−V族化合物半導体を塩素系ガスを用いてガ
スエッチングする装置であって、回転が可能なパンケー
キ型サセプタを有し、上記サセプタの表面は水素ガスに
よって複数の領域に分割されており、上記複数個の分割
領域のうち少なくとも1つの領域がV族水素化物ガスと
塩素系ガスと水素ガスの混合ガスで充填されており、少
なくとも1つの領域が水素ガスで充填されており、半導
体ウェハは水素ガスによって分割された上記各々の領域
を上記サセプタの回転によって順次移動できる構成とし
たものである。
【0058】また、この発明に係る半導体装置の製造方
法は、回転機構を有するパンケーキ型サセプタを有し、
上記サセプタの表面が水素ガスによって複数の領域に分
割されており、上記複数個の分割領域のうち少なくとも
1つの領域がV族水素化物ガスと塩素系ガスと水素ガス
の混合ガスで充填されており、少なくとも1つの領域が
水素ガスで充填された構造を有する半導体装置の製造装
置を用い、半導体ウェハを水素ガスによって分割された
上記各々の領域を上記サセプタの回転によって順次移動
させ、上記V族水素化物ガスと塩素系ガスと水素ガスの
混合ガスで充填された領域で第1のエッチングを行な
い、上記水素ガスで充填された領域で第2のエッチング
を行ない、上記サセプタの回転にともなって上記第1の
エッチングと上記第2のエッチングとを周期的に繰り返
し行なうようにしたものである。
【0059】また、この発明に係る量子細線構造の製造
方法は、{100}面を主面とする半導体基板上に第1
の半導体層を形成する工程と、上記第1の半導体層上に
〈011〉方向を長手方向とする細線状のエッチングマ
スクを形成する工程と、上記第1の半導体層を、塩素系
エッチングガスとV族ガスと水素ガスとを同時に供給す
ることにより行なうガスエッチングであって、上記塩素
系エッチングガスとしてHClガス又はCl2 ガスを用
い、上記V族ガスとしてアルシン(AsH3 )ガス,タ
ーシャリブチルアルシン(C4 H9 AsH2 )ガス,又
はトリメチルアルシン((CH3 )3 As)ガスのいず
れかを用い、上記V族ガスの分圧を8×10-3Torr
以上0.08Torr以下とし、かつ上記エッチングガ
ス流量に対する上記V族ガス流量の比を2.5以下とし
て行なうエッチングによりエッチングし、側面が{11
1}B面で構成されたV字型の溝を形成する工程と、上
記{111}B面で構成されたV字型の溝の底部付近に
上記第1の半導体よりバンドギャップの小さい第2の半
導体層を形成する工程と、上記第2の半導体層に引き続
いて第2の半導体よりハンドギャップの大きい第3の半
導体層を形成する工程とを含むものである。
【0060】また、この発明に係る量子細線構造の製造
方法は、半導体基板上に第1種の高抵抗半導体層と上記
第1種の半導体より電子親和力に小さい第2種の高抵抗
半導体層と第1種の高抵抗半導体層とを順次形成する工
程と、上記第2種の高抵抗半導体層に少なくとも凹部の
形状が逆三角形断面である凹凸周期構造を形成する工程
と、その上部に上記第2種のn型半導体層と上記第1種
のn型半導体層を順次形成する工程とを含んで構成され
る量子細線構造の製造方法であって、上記凹凸周期構造
の形成を、塩素系エッチングガスとV族ガスと水素ガス
とを同時に供給することにより行なうガスエッチングで
あって、上記塩素系エッチングガスとしてHClガス又
はCl2 ガスを用い、上記V族ガスとしてアルシン(A
sH3 )ガス,ターシャリブチルアルシン(C4 H9 A
sH2 )ガス,又はトリメチルアルシン((CH3 )3
As)ガスのいずれかを用い、上記V族ガスの分圧を8
×10-3Torr以上0.08Torr以下とし、かつ
上記エッチングガス流量に対する上記V族ガス流量の比
を2.5以下として行なうエッチングにより形成するよ
うにしたものである。
【0061】また、この発明に係る半導体レーザの製造
方法は、{100}面を主面とする第1導電型GaAs
基板上に、少なくとも第1導電型Aly Ga1-y Asク
ラッド層,Alz Ga1-z As(0≦z<y)活性層,
第2導電型Alw Ga1-w As(z<w)クラッド層,
第1導電型GaAs電流ブロック層を順次結晶成長する
工程と、上記結晶成長を行なった半導体ウェハ上に〈0
11〉方向を長手方向とするストライプ状開口部を有す
る絶縁膜パターンを形成する工程と、上記絶縁膜パター
ンをマスクとして塩素系エッチングガスを用いた気相エ
ッチングを行ない、{111}B面を側面とし上記第2
導電型クラッド層を底面とするストライプ状溝を形成す
る工程と、該溝を埋め込むように第2導電型Alw Ga
1-w As層を結晶成長する工程とを含むものである。
【0062】また、この発明に係る半導体レーザの製造
方法は、{100}面を主面とする第1導電型GaAs
基板上に、少なくとも第1導電型Aly Ga1-y Asク
ラッド層,Alz Ga1-z As(0≦z<y)活性層,
第2導電型Alw Ga1-w As(z<w)クラッド層を
順次結晶成長する工程と、上記結晶成長を行なった半導
体ウェハ上に〈011〉方向を長手方向とするストライ
プ状の絶縁膜パターンを形成する工程と、上記絶縁膜パ
ターンをマスクとして塩素系エッチングガスを用いた気
相エッチングを行ない、半導体レーザ構造を{111}
B面を側面とするリッジ形状にエッチング成形する工程
と、該リッジ両側を埋め込むように電流ブロック層を結
晶成長する工程とを含み、かつ上記エッチング工程に先
立って硫化アンモニウム処理もしくは反応炉内での表面
クリーニング処理によりウェハ表面の酸化膜を除去する
ようにしたものである。
【0063】また、この発明に係る結晶成長方法は、絶
縁膜パターンが形成された基板上にMOCVD法により
選択的に III−V族半導体層をエピタキシャル成長する
方法において、上記エピタキシャル成長を、原料ガスと
共にHClガス,またはCl2 ガスをIII 族ガス流量に
対し0.3以下のモル流量比で同時に供給して行なうよ
うにしたものである。
【0064】また、この発明に係る結晶成長方法は、第
1種の半導体基板上に第2種の半導体層をMOCVD法
によりエピタキシャル成長する結晶成長方法において、
第1種の半導体基板上に絶縁膜を形成し、該絶縁膜を第
1種の半導体基板のデバイス作成領域を取り囲むように
パターニングを施した後、上記絶縁膜のパターニングが
施された第1種の半導体基板上に500℃以下の温度で
第2種の半導体からなる低温バッファ層をエピタキシャ
ル成長し、これに引き続いて600℃以上の温度で第2
種の半導体層をエピタキシャル成長するようにし、かつ
上記第2種の半導体からなる低温バッファ層をエピタキ
シャル成長する工程を、原料ガスと共にHClガス,ま
たはCl2 ガスを同時に供給することにより行うように
したものである。
【0065】また、この発明に係る結晶成長方法は、上
記第2種の半導体からなる低温バッファ層をエピタキシ
ャル成長する工程において、原料ガスと共に供給するH
Clガス,またはCl2 ガスのIII 族ガス流量に対する
モル流量比を0.3以下としたものである。
【0066】
【作用】この発明に係る半導体装置の製造方法において
は、Alを構成元素として含む化合物半導体に絶縁膜に
よるパターニングを施す工程と、ドライエッチングの手
法を用いて微細構造を作製する工程と、上記微細構造を
化合物半導体で埋め込む工程とを含む化合物半導体装置
の製造方法において、上記Alを構成元素として含む化
合物半導体に連続してAlを含まない化合物半導体保護
層を形成し、上記保護層上に絶縁膜による選択マスクを
形成した後、半導体ウェハを硫化アンモニウム溶液に浸
漬し、その後、反応管内において塩素系ガスを用いてエ
ッチングを行ない、上記反応管内において上記エッチン
グ工程によって作製された微細構造をMOCVDの手法
を用いて化合物半導体層で埋め込むようにしたので、不
純物の偏析しない良好な再成長界面が得られ、再成長層
の結晶品質を向上できる。
【0067】また、この発明に係る半導体装置の製造方
法においては、Alを構成元素として含む化合物半導体
に絶縁膜によるパターニングを施す工程と、ドライエッ
チングの手法を用いて微細構造を作製する工程と、上記
微細構造を化合物半導体で埋め込む工程とを含む化合物
半導体装置の製造方法において、上記Alを構成元素と
して含む化合物半導体に連続してAlを含まない化合物
半導体保護層を形成し、上記保護層上に絶縁膜による選
択マスクを形成した後、半導体ウェハを反応管内にセッ
トし、該反応管内において上記保護層の表面酸化膜を除
去し、その後、反応管内において塩素系ガスを用いてエ
ッチングを行ない、上記反応管内において上記エッチン
グ工程によって作製された微細構造をMOCVDの手法
を用いて化合物半導体層で埋め込むようにしたので、不
純物の偏析しない良好な再成長界面が得られ、再成長層
の結晶品質を向上できる。
【0068】また、この発明に係る半導体装置の製造方
法においては、Alx Ga1-x As(0≦x≦1)を塩
素系エッチングガスを用いたドライエッチングによりエ
ッチングする工程を含む半導体装置の製造方法におい
て、上記ドライエッチングとして塩素系エッチングガス
とV族ガスと水素ガスとを同時に供給することにより行
なうガスエッチングの手法を用い、上記塩素系エッチン
グガスとしてHClガス又はCl2 ガスを用い、上記V
族ガスとしてアルシン(AsH3 )ガス,ターシャリブ
チルアルシン(C4 H9 AsH2 )ガス,又はトリメチ
ルアルシン((CH3 )3 As)ガスのいずれかを用
い、上記V族ガスの分圧を8×10-3Torr以上0.
08Torr以下とし、かつ上記エッチングガス流量に
対する上記V族ガス流量の比を2.5以下としてエッチ
ングを行なうようにしたので、極めて平滑なエッチング
面が得られるとともに、エッチング面へのダメージをも
防止することができる。
【0069】また、この発明に係る半導体レーザの製造
方法においては、半導体基板上にレーザダイオード構造
のGaAs及びAlGaAsからなる結晶構造を作製し
た後、上記レーザダイオード構造の結晶構造上にエッチ
ングマスクとなる絶縁膜を形成し、塩素系エッチングガ
スとV族ガスと水素ガスとを同時に供給することにより
行なうガスエッチングであって、上記塩素系エッチング
ガスとしてHClガス又はCl2 ガスを用い、上記V族
ガスとしてアルシン(AsH3 )ガス,ターシャリブチ
ルアルシン(C4 H9 AsH2 )ガス,又はトリメチル
アルシン((CH3 )3 As)ガスのいずれかを用い、
上記V族ガスの分圧を8×10-3Torr以上0.08
Torr以下とし、かつ上記エッチングガス流量に対す
る上記V族ガス流量の比を2.5以下として行なうエッ
チングによりレーザダイオードの発振端面を形成するよ
うにしたので、劈開端面に比しても遜色のないレーザ発
振端面をエッチングにより容易に形成することができ
る。
【0070】また、この発明に係る半導体レーザの製造
方法においては、窓付き屈折率ガイド型レーザダイオー
ドを製造する方法において、半導体基板上に複数種類の
Alx Ga1-x As(0≦x≦1)からなり活性領域を
構成する半導体積層構造を結晶成長し、該半導体積層構
造上にエッチングと結晶成長を選択的に行うための保護
膜を形成した後、上記保護膜をマスクとして用い、塩素
系エッチングガスとV族ガスと水素ガスとを同時に供給
することにより行なうガスエッチングであって、上記塩
素系エッチングガスとしてHClガス又はCl2 ガスを
用い、上記V族ガスとしてアルシン(AsH3 )ガス,
ターシャリブチルアルシン(C4 H9 AsH2 )ガス,
又はトリメチルアルシン((CH3 )3 As)ガスのい
ずれかを用い、上記V族ガスの分圧を8×10-3Tor
r以上0.08Torr以下とし、かつ上記エッチング
ガス流量に対する上記V族ガス流量の比を2.5以下と
して行なうエッチングにより上記半導体積層構造をエッ
チングし、この後、該エッチング工程で残された半導体
積層構造を埋め込むようにレーザ発振領域の材料と比較
してバンドギャップが大きく、かつ半絶縁性もしくは高
抵抗の半導体材料を結晶成長し電流阻止領域及び窓領域
を一括同時に形成し、上記保護膜を除去した後、ウェハ
上に表面オーミックコンタクト領域を結晶成長するよう
にしたので、端面窓構造を有する半導体レーザダイオー
ドを容易に形成することができる。
【0071】また、この発明に係る半導体装置の製造方
法においては、化合物半導体のエッチング工程を含むも
のにおいて、V族水素化物ガスを導入すると同時に塩素
系ガスを上記V族水素化物ガスの導入時間より短い時間
だけパルス的に導入する第1のエッチング工程と、上記
V族水素化物ガスと上記塩素系ガスの導入を中断し、反
応管内を水素ガスでパージする第2のエッチング工程を
含み、上記第1のエッチング工程と、上記第2のエッチ
ング工程とを周期的に繰り返し行なうようにしたので、
原子層レベルで制御され、しかも平滑なエッチングを容
易に行なうことができる。
【0072】また、この発明に係る半導体装置の製造装
置においては、回転が可能なパンケーキ型サセプタを有
し、上記サセプタの表面は水素ガスによって複数の領域
に分割されており、上記複数個の分割領域のうち少なく
とも1つの領域がV族水素化物ガスと塩素系ガスと水素
ガスの混合ガスで充填されており、少なくとも1つの領
域が水素ガスで充填されており、半導体ウェハが水素ガ
スによって分割された各々の領域を上記サセプタの回転
によって順次移動できる構成としたので、原子層レベル
で制御され、しかも平滑なエッチングを容易に行なうこ
とができる。
【0073】また、この発明に係る半導体装置の製造方
法においては、回転機構を有するパンケーキ型サセプタ
を有し、上記サセプタの表面が水素ガスによって複数の
領域に分割されており、上記複数個の分割領域のうち少
なくとも1つの領域がV族水素化物ガスと塩素系ガスと
水素ガスの混合ガスで充填されており、少なくとも1つ
の領域が水素ガスで充填された構造を有する半導体装置
の製造装置を用い、半導体ウェハを水素ガスによって分
割された上記各々の領域を上記サセプタの回転によって
順次移動させ、上記V族水素化物ガスと塩素系ガスと水
素ガスの混合ガスで充填された領域で第1のエッチング
を行ない、上記水素ガスで充填された領域で第2のエッ
チングを行ない、上記サセプタの回転にともなって上記
第1のエッチングと上記第2のエッチングとを周期的に
繰り返し行なうようにしたので、原子層レベルで制御さ
れ、しかも平滑なエッチングを容易に行なうことができ
る。
【0074】また、この発明に係る量子細線構造の製造
方法においては、{100}面を主面とする半導体基板
上に第1の半導体層を形成した後、上記第1の半導体層
上に〈011〉方向を長手方向とする細線状のエッチン
グマスクを形成し、上記第1の半導体層を、塩素系エッ
チングガスとV族ガスと水素ガスとを同時に供給するこ
とにより行なうガスエッチングであって、上記塩素系エ
ッチングガスとしてHClガス又はCl2 ガスを用い、
上記V族ガスとしてアルシン(AsH3 )ガス,ターシ
ャリブチルアルシン(C4 H9 AsH2 )ガス,又はト
リメチルアルシン((CH3 )3 As)ガスのいずれか
を用い、上記V族ガスの分圧を8×10-3Torr以上
0.08Torr以下とし、かつ上記エッチングガス流
量に対する上記V族ガス流量の比を2.5以下として行
なうエッチングによりエッチングし{111}B面で構
成されたV字型の溝を形成した後、上記{111}B面
で構成されたV字型の溝の底部付近に上記第1の半導体
よりバンドギャップの小さい第2の半導体層を形成し、
上記第2の半導体層に引き続いて第2の半導体よりバン
ドギャップの大きい第3の半導体層を形成するようにし
たので、量子細線を制御性よく形成することができる。
【0075】また、この発明に係る量子細線構造の製造
方法においては、半導体基板上に第1種の高抵抗半導体
層と、上記第1種の半導体より電子親和力の小さい第2
種の高抵抗半導体層と、第1種の高抵抗半導体層とを順
次形成した後、上記第2種の高抵抗半導体層に少なくと
も凹部の形状が逆三角形断面である凹凸周期構造を形成
し、その上部に上記第2種のn型半導体層と上記第1種
のn型半導体層を順次形成して構成される量子細線構造
の製造方法であって、上記凹凸周期構造の形成を、塩素
系エッチングガスとV族ガスと水素ガスとを同時に供給
することにより行なうガスエッチングであって、上記塩
素系エッチングガスとしてHClガス又はCl2 ガスを
用い、上記V族ガスとしてアルシン(AsH3 )ガス,
ターシャリブチルアルシン(C4 H9 AsH2 )ガス,
又はトリメチルアルシン((CH3 )3 As)ガスのい
ずれかを用い、上記V族ガスの分圧を8×10-3Tor
r以上0.08Torr以下とし、かつ上記エッチング
ガス流量に対する上記V族ガス流量の比を2.5以下と
して行なうエッチングにより形成するようにしたので、
優れた品質の量子細線を制御性よく形成することができ
る。
【0076】また、この発明に係る半導体レーザの製造
方法においては、{100}面を主面とする第1導電型
GaAs基板上に、少なくとも第1導電型Aly Ga1-
y Asクラッド層,Alz Ga1-z As(0≦z<y)
活性層,第2導電型Alw Ga1-w As(z<w)クラ
ッド層,第1導電型GaAs電流ブロック層を順次結晶
成長した後、上記結晶成長を行なった半導体ウェハ上に
〈011〉方向を長手方向とするストライプ状開口部を
有する絶縁膜パターンを形成し、該絶縁膜パターンをマ
スクとして気相エッチングを行ない、{111}B面を
側面とし上記第2導電型クラッド層を底面とするストラ
イプ状溝を形成し、該溝を埋め込むように第2導電型A
lw Ga1-w As層を結晶成長するようにしたから、側
面からの成長はなく底面からの成長のみにより溝が埋ま
り、埋め込み層を表面がフラットな状態に埋め込みする
ことができる。
【0077】また、この発明に係る半導体レーザの製造
方法においては、{100}面を主面とする第1導電型
GaAs基板上に、少なくとも第1導電型Aly Ga1-
y Asクラッド層,Alz Ga1-z As(0≦z<y)
活性層,第2導電型Alw Ga1-w As(z<w)クラ
ッド層を順次結晶成長した後、上記結晶成長を行なった
半導体ウェハ上に〈011〉方向を長手方向とするスト
ライプ状の絶縁膜パターンを形成し、該絶縁膜パターン
をマスクとして塩素系エッチングガスを用いた気相エッ
チングを行ない、活性領域を{111}B面を側面とす
るリッジ形状にエッチング成形し、該リッジ両側を埋め
込むように電流ブロック層を結晶成長するようにし、か
つ上記エッチング工程に先立って硫化アンモニウム処理
もしくは反応炉内での表面クリーニング処理によりウェ
ハ表面の酸化膜を除去するようにしたから、信頼性の高
い、AlGaAs系の材料からなる埋め込みヘテロ構造
の半導体レーザを実現することができる。
【0078】また、この発明に係る結晶成長方法におい
ては、絶縁膜パターンが形成された基板上にMOCVD
法により選択的に III−V族半導体層をエピタキシャル
成長する方法において、上記エピタキシャル成長を、原
料ガスと共にHClガス,またはCl2 ガスをIII 族ガ
ス流量に対し0.3以下のモル流量比で同時に供給して
行なうようにしたので、結晶品質の劣化を生じることな
く、良好な選択成長を行なうことができる。
【0079】また、この発明に係る結晶成長方法におい
ては、第1種の半導体基板上に第2種の半導体層をMO
CVD法によりエピタキシャル成長する結晶成長方法に
おいて、第1種の半導体基板上に絶縁膜を形成し、該絶
縁膜を第1種の半導体基板のデバイス作成領域を取り囲
むようにパターニングを施した後、上記絶縁膜のパター
ニングが施された第1種の半導体基板上に500℃以下
の温度で第2種の半導体からなる低温バッファ層をエピ
タキシャル成長し、これに引き続いて600℃以上の温
度で第2種の半導体層をエピタキシャル成長するように
し、かつ上記第2種の半導体からなる低温バッファ層を
エピタキシャル成長する工程を、原料ガスと共にHCl
ガス,またはCl2 ガスを同時に供給することにより行
うようにしたので、異種半導体基板上に結晶成長する半
導体層のクラックの発生を抑制できる。
【0080】また、この発明に係る結晶成長方法におい
ては、上記第2種の半導体からなる低温バッファ層をエ
ピタキシャル成長する工程において、原料ガスと共に供
給するHClガス,またはCl2 ガスのIII 族ガス流量
に対するモル流量比を0.3以下としたので、異種半導
体基板上に結晶成長する半導体層のクラックの発生を抑
制できるとともに、高品質な結晶成長ができる。
【0081】
【実施例】
実施例1.図1は本発明の第1の実施例による半導体装
置の製造方法を示す断面工程図であり、図において、2
3はGaAs基板、2はGaAs基板23上に結晶成長
されたAlGaAs層、11はAlGaAs層2上にA
lGaAs層2の結晶成長に連続して結晶成長されたG
aAsキャップ層である。12はGaAs層11表面に
形成された酸化膜、21はSiN膜パターン、13は硫
黄膜、1は再成長GaAs層である。
【0082】次に本実施例による半導体装置の製造方法
の工程について説明する。
【0083】まず第1の結晶成長工程としてGaAs基
板23上にAlx Ga1-x As層2とGaAsキャップ
層11をMOCVD方法により成長した。各層の厚みは
AlxGa1-x As層が2μm、GaAsキャップ層が
0.1μmである。上記サンプルは一度チャンバにより
取り出し、空気中で数日間保管した。この保管の間にサ
ンプルのGaAs層11表面には僅かながら酸化膜12
が形成される。この状態を図1(a) に示す。次に図1
(b) に示すようにサンプル表面上に所望形状のSiN膜
パターン21を形成する。次に上記サンプルを硫化アン
モニウム溶液に浸漬処理する。本実施例では硫化アンモ
ニウム溶液として(NH4 )2 S溶液を用い、60℃で
3時間浸漬した。この工程によりGaAs層11表面の
酸化膜12のうち、SiN膜パターン21に覆われてい
ない部分はエッチング除去され、図1(c) に示すように
硫黄膜13が形成される。次にMOCVDのチャンバに
ウェハをセットし、水素雰囲気中において450℃の温
度で30分間熱処理をした。次にAsH3 とHClとH
2 の混合ガスを用いて、図1(d) に示すように、SiN
膜パターン21をエッチングマスクとして深さ1μmの
エッチングを行ない、引き続いて同一チャンバ内でGa
As層1を成長した。
【0084】図2は上述の工程に従って作製したサンプ
ルの再成長界面近傍(図1(e) のII−II線断面)の不純
物分析をSIMS分析の手法を用いて行なった結果であ
る。
【0085】図において、1は再成長GaAs層、2は
Alx Ga1-x As層、3は再成長界面である。図に示
すように本実施例の製造方法により作製されたサンプル
では、再成長界面3への酸素(O),塩素(Cl)の偏
析は観測されず、再成長GaAs層の転位密度は1×1
4 個/cm-2まで改善された。図29(a) に示したよう
に従来の技術においてGaAsキャップ層を設けただけ
では再成長界面への不純物の偏析は完全には抑制できな
かったのに対し、GaAsキャップ層を設けさらにエッ
チング前処理として硫化アンモニウム処理を施すことで
再成長界面の清浄度および再成長GaAs層の結晶品質
を向上させることかできた。
【0086】硫化アンモニウム処理の効果については、
例えば応用物理第58巻,第9号,1989年,134
0〜1344ページに開示されている。すなわち硫化ア
ンモニウム処理によりGaAs表面の酸化膜がエッチン
グ除去され、次にGaAs表面第1層に硫黄原子が吸着
し、表面保護作用を有する。従って硫黄膜によりGaA
s表面は保護され新たな表面酸化を防止することができ
る。
【0087】また、例えば特開平4−10683号公報
には、GaAsあるいはAlGaAs上に結晶成長を行
なう前に、GaAsあるいはAlGaAsの表面を硫化
アンモニウム処理することにより、表面酸化膜を除去す
るとともに、新たな表面酸化を抑制するようにして、こ
の上に結晶成長される結晶層の品質を向上することが記
載されている。
【0088】しかし硫黄によって保護されたGaAs上
に高品質なGaAs層を成長させるためには成長前に何
らかの手段を用いて硫黄膜を除去する必要がある。本願
発明者の実験によるとMOCVD成長前の昇温による熱
クリーニングだけではGaAs表面の硫黄原子は完全に
は除去されず、再成長界面に偏析し、再成長層の結晶品
質を低下させることが明らかになった。一方、表面保護
膜である硫黄膜の有効な除去方法はこれまで報告されて
いなかった。
【0089】発明が解決しようとする課題の項でも述べ
たように、気相エッチング後の再成長における再成長界
面の清浄化のためには、エッチング前の表面が酸化され
ていないことが極めて重要である。硫化アンモニウム処
理はこの目的に適した前処理方法であるが、上述のよう
に、硫黄膜の除去を完全に行なうことができないという
問題点があった。本願発明者はこの問題点を解消する方
法としてHCl気相エッチングが硫黄膜の除去に極めて
有効であることを見いだし、さらに硫化アンモニウム処
理とHCl気相エッチングを組み合わせることで初めて
目的とする効果、即ち気相エッチング後に再成長する場
合においてその再成長界面を清浄なものとできる効果が
得られることを確認した。
【0090】上述のように気相エッチングしたAlGa
As上へのMOCVD再成長において、再成長界面の清
浄化を図るためにはキャップGaAs層の採用だけでは
極めて不十分である。これはキャップ層表面のわずかな
酸化によってもエッチングが阻害され、悪影響を及ぼす
ことを示しており、キャップGaAs層表面のクリーニ
ングこそ重要である。表面クリーニングの一手法である
硫化アンモニウム処理は、本実施例のようにHCl気相
エッチングと組み合わせることで初めて実用的な表面処
理方法として効果を確認することができ、HCl気相エ
ッチングとMOCVD成長を組み合わせた複合プロセス
の高度化を図ることができた。
【0091】なお、上記実施例では、硫黄膜13が形成
されたウェハをMOCVDのチャンバにセットし、水素
雰囲気中において熱処理をするようにしているが、この
熱処理は必ずしも水素雰囲気中で行なう必要はなく、ま
た、この熱処理は反応炉内でのウェハの昇温工程で兼ね
ることができる。
【0092】また、上記実施例ではアルミニウムを構成
元素として含む化合物半導体がAlGaAsであり、こ
の上に連続して結晶成長されるアルミニウムを含まない
化合物半導体層及び再成長される化合物半導体層がGa
Asであるものについて示したが、これ以外の化合物半
導体であっても本発明を適用することができる。
【0093】実施例2.次に本発明の第2の実施例によ
る半導体装置の製造方法について説明する。
【0094】本第2の実施例では、AlGaAs上に連
続してGaAs保護層を形成し、上記保護層上に絶縁膜
による選択マスクを形成するまでは上記第1の実施例と
同様であるが、この後硫化アンモニウムによる処理を行
なうのではなく、反応管内において上記保護層の表面酸
化膜を他のクリーニング法を用いて除去し、この後連続
して上記反応管内において塩素系ガスを用いてエッチン
グを施し、さらに上記反応管内において上記エッチング
によって作製された微細構造をMOCVDの手法を用い
て化合物半導体層で埋め込むものである。
【0095】上記第1の実施例では、GaAsキャップ
層をクリーニングする方法として、硫化アンモニウム処
理が有効であると述べたが、本第2の実施例のようにM
OCVDチャンバ内部で成長に先立って、他のクリーニ
ング方法によりGaAs表面のクリーニングを施しても
上記第1の実施例と同様、気相エッチング後に再成長す
る場合においてその再成長界面を清浄なものとできる。
上記他のクリーニング方法としては、例えば紫外線照射
によるクリーニングや水素プラズマによる酸化膜の還元
作用を用いたクリーニングでも同様の効果を奏すること
を確認した。
【0096】なお、本実施例においてもアルミニウムを
構成元素として含む化合物半導体がAlGaAsであ
り、この上に連続して結晶成長されるアルミニウムを含
まない化合物半導体層及び再成長される化合物半導体層
がGaAsであるものについて示したが、これ以外の化
合物半導体であっても本発明を適用することができるこ
とはいうまでもない。
【0097】実施例3.次に本発明の第3の実施例によ
る半導体装置の製造方法について説明する。本第3の実
施例による半導体装置の製造方法は、上記第1,第2の
実施例による半導体装置の製造方法においても行なわれ
る、化合物半導体の気相エッチングにおいて、より平滑
なエッチング面を得るための精密に制御されたエッチン
グ条件を与えるものである。本第3の実施例による半導
体装置の製造方法における気相エッチング方法は次に示
す実験によって開発した。
【0098】気相エッチングはAsH3 ガス,H2 ガ
ス,HClガスをチャンバ内に同時に供給することによ
り行なうガスエッチングの手法を用いた。エッチング温
度は750℃,エッチング圧力は10Torrとし、H
Clガス流量に対するAsH3ガス流量を種々変更した
ときのエッチング面状態について詳細に評価した。
【0099】エッチング実験に使用したサンプルは、A
lx Ga1-x As(x=0.48)上にGaAsキャッ
プ層を設けた構造で、各層の厚みはAlGaAs層が2
μm、GaAsキャップ層が0.1μmである。エッチ
ングはGaAsキャップ層から行ない、約1μmエッチ
ングした後の表面状態を微分干渉顕微鏡を用いて評価し
た。
【0100】この実験の結果、HClガス流量に対する
AsH3 ガス流量がある一定量を越えるとエッチング面
に表面荒れが生じ、平滑なエッチングができなくなり、
またAsH3 ガス流量がある一定量より少なくても平滑
なエッチング面は得られないことが明らかとなった。即
ち、AsH3 ガス,H2 ガス,HClガスをチャンバ内
に同時に供給することにより、GaAs又はAlGaA
sをガスエッチングする場合に、平滑なエッチング面を
得るためにはウェハに供給するAsH3 ガス,HClガ
スの流量を最適化し厳密に制御する必要がある。この結
果は次のように解釈される。AlGaAs表面が平滑に
エッチングされるために表面からのAs塩化物(AsC
l3 など),Ga塩化物(GaCl3 など),Al塩化
物(AlCl3 など)の脱離が均等に生じる必要があ
る。これに対しAs塩化物と,Ga塩化物,Al塩化物
の蒸発温度が異なるため(AsCl3 ;130℃,Ga
Cl3 ;201℃,AlCl3 ;180℃)、それぞれ
の塩化物を均等に表面から脱離させることは容易ではな
い。適度なAsH3 の添加によって基板表面からのAs
Cl3 の脱離が抑制され、それぞれの塩化物の脱離がバ
ランスされるものと考えられる。以上の理由により平滑
なエッチング面を得るためにはHClガス流量に対する
AsH3 ガス流量を最適化する必要がある。
【0101】図3(a) は、エッチング温度を750℃,
エッチング圧力を10Torr,10%のHClガス流
量を80sccm,トータルのガス流量を2.5slm
として、20%のAsH3 ガス流量を変化させたとき
の、AsH3 ガス流量とGaAs再成長層の転移密度
(EDP)との関係を示す図、図3(b) は同じ条件での
AsH3 ガス流量とエッチング面の酸素濃度(IO )及
び塩素濃度(ICl)との関係を示す図である。この実験
結果より、AsH3 ガス分圧(AsH3 ガス流量をトー
タルガス流量で割り、反応炉内圧力を掛けた値)が0.
016Torr、またHClガス流量に対するAsH3
ガス流量の比が0.5のときが最適なエッチング条件で
あり、AsH3 ガス分圧が8×10-3Torr以上0.
08Torr以下であり、かつHClガス流量に対する
AsH3 ガス流量比が2.5以下の条件でのみ平滑なエ
ッチング面が得られることが明らかになった。さらにこ
のエッチング方法によると通常のRIE法などで問題と
なっているエッチング面へのダメージが生じないことも
明らかになった。これはエッチングが純粋に化学反応の
みで生じているためと考えられる。
【0102】このように、本実施例では、Alx Ga1-
x As(0≦x≦1)を気相エッチングする工程を含む
半導体装置の製造方法において、気相エッチングとして
HClガス,AsH3 ガス,及び水素ガスを同時に供給
することにより行なうガスエッチングの手法を用い、A
sH3 ガス分圧を8×10-3Torr以上0.08To
rr以下とし、かつHClガス流量に対するAsH3 ガ
ス流量比を2.5以下としてエッチングするようにした
から、平滑なエッチング面が得られるとともに、エッチ
ング面へのダメージをも防止することができる。
【0103】なお、上記実施例ではエッチングガスとし
てHClガス、V族ガスとしてAsH3 ガスを用いてガ
スエッチングを行なうものについて示したが、エッチン
グガスとしてCl2 ガス、V族ガスとしてターシャリブ
チルアルシン(C4 H9 AsH2 )もしくはトリメチル
アルシン((CH3 )3 As)を用いてもよい。これら
のガスを用いた場合もエッチングの化学反応としては全
く同じであるので、V族ガスの分圧を8×10-3Tor
r以上0.08Torr以下とし、かつエッチングガス
流量に対するV族ガス流量の比を2.5以下としてエッ
チングを行なうことにより、上記実施例と同様の効果を
得ることができる。
【0104】さらに、本実施例によるエッチング方法
に、上記第1または第2の実施例による半導体装置の製
造方法で行なった表面クリーニング方法を組み合わせれ
ば、エッチング面への不純物の偏析が抑制され、再成長
を行なった場合には再成長層の結晶品質は極めて良好と
なる。
【0105】実施例4.次に本発明の第4の実施例によ
る半導体レーザの製造方法について説明する。
【0106】図4は上記第3の実施例に示したエッチン
グ方法によるエッチングを行なった場合のマスクパター
ンの形成方向とエッチング形状との関係を説明するため
の図である。図において、21はストライプ状のSiN
膜パターン、22はGaAsキャップ層、2はAlGa
As層、23はGaAs基板である。
【0107】図4(a) はGaAs基板23の(100)
面上にAlGaAs層2及びGaAsキャップ層22を
連続して結晶成長し、このキャップ層22上にストライ
プ状のSiN膜パターン21を形成した状態をしめす。
ここでSiN膜パターン21をそのストライプ方向が
[0/11]方向となるようにパターニングした場合と
[011]方向となるようにパターニングした場合とで
は気相エッチングによるエッチング形状が異なる。図4
(b) は上記SiN膜21のパターニングを[0/11]
方向に行なった後、エッチングを行なった場合のエッチ
ング形状を、図4(c) はSiN膜21のパターニングを
[011]方向に行なった後エッチングを行なった場合
のエッチング形状をそれぞれ示している。
【0108】図4(b) に示すように[0/11]方向に
ストライプ形成を行なった場合、エッチング形状は(0
11)面24と(311)面25とで構成された断面形
状となる。一方[011]方向にストライプ形成を行な
った場合、エッチング形状は(111)B面26で構成
された断面形状となる。表1にまとめたようにHCl気
相エッチングによるエッチング形状は通常のウェットエ
ッチングによるエッチング形状と比較すると明らかに異
なる。
【0109】
【表1】
【0110】ここで、HCl気相エッチングとして上記
第3の実施例によるエッチング方法を用いることによ
り、エッチングによって露呈する側面の平坦度は極めて
良好で劈開面と比較しても遜色がなく、側面のAlGa
As層2とGaAsキャップ層22の界面に段差を生じ
ることもなかった。
【0111】本第4の実施例による半導体レーザの製造
方法は、上記第3の実施例にかかるエッチング方法によ
るエッチング形状の特徴を利用したものである。即ち
[0/11]方向のストライプ状パターンをマスクとし
てエッチングを行なった場合、側面には(100)面と
垂直な(011)面24が一部露呈することを利用し、
この(011)面をレーザの発振端面とすることを特徴
としたものである。
【0112】図7は本第4の実施例による半導体レーザ
の製造方法を用いて作製された半導体レーザの一例を示
す斜視図であり、図において、50はn−GaAs基
板、51はn−Alx Ga1-x As第1クラッド層、5
2は活性層、53はp−AlxGa1-x As第2クラッド
層、54はn−GaAs電流ブロック層、55はp−G
aAs第2キャップ層、56はp−GaAsコンタクト
層、57は発光端面である。
【0113】図7に示す半導体レーザは次に示す工程に
より製造された。まず(100)GaAs基板50上に
通常のMOCVD成長とウェットエッチングを組み合わ
せた手法によりリッジ埋め込み型レーザの結晶構造を作
製する。このようなリッジ埋め込み型レーザの結晶構造
の作製工程は周知であるので詳細な説明は省略する。
【0114】なお、このとき共振器方向(リッジのスト
ライプ方向)は[011]方向としておく。次にレーザ
の共振器となる部分に絶縁膜となるマスキングを施し、
上記第3の実施例に示した手法を用いたエッチングを施
す。上述のように本エッチング方法によると共振器端面
57は(100)面と垂直な(011)面となるため、
レーザ発振端面を容易に形成することができる。得られ
た共振端面は極めて平滑であり、エッチングによるダメ
ージも生じないことから共振器端面と、劈開面と比較し
ても遜色がないことを確認した。
【0115】このように本実施例によれば、(100)
半導体基板上にGaAs及びAlGaAsからなるリッ
ジ埋め込み型レーザの結晶構造を作製した後、上記レー
ザダイオード構造の結晶構造上に[0/11]方向が長
手となるストライプ状のエッチングマスクを形成し、H
Clガス,AsH3 ガス,及び水素ガスを同時に供給す
ることにより行なうガスエッチングであって、AsH3
ガス分圧が8×10-3Torr以上0.08Torr以
下,HClガス流量に対するAsH3 ガス流量比が0.
25以下の条件のエッチングを行なうことによりレーザ
ダイオードの発振端面を形成するようにしたから、劈開
端面に比しても遜色のないレーザ発振端面をエッチング
により容易に形成することができる。
【0116】なお、上記実施例ではレーザの基本構造が
リッジ埋め込み型であるものについて示したが、他のレ
ーザ構造であってもよいことは言うまでもない。
【0117】また、上記実施例では(100)面を主面
とする基板を用い、レーザ端面として(011)面を形
成するようにしたものについて示したが、レーザ端面と
して(0/1/1)面を形成するようにしてもよい。ま
た(100)面と結晶工学的に等価な面を主面とする基
板を用い、この主面に対して、(100)面と(01
1)面もしくは(0/1/1)面との関係と等価な関係
を有する面を形成するようにしてもよい。
【0118】実施例5.次に本発明の第5の実施例によ
る半導体レーザの製造方法について説明する。
【0119】本第5の実施例による半導体レーザの製造
方法は(111)B面を発振端面とする半導体レーザを
作製するものである。図5は[011]方向のストライ
プ状パターンをマスクとしてHCl気相エッチングした
ときのエッチング形状を示す斜視図である。すでに述べ
たようにGaAs基板23の(100)主面上に結晶成
長した半導体層を、[011]方向のストライプ状パタ
ーンをマスクとしてエッチングを行なった場合、ストラ
イプに沿ったエッチング側面には(111)B面26が
露呈する。(111)B面の(100)主面に対する角
度θは約54°であるため、このままレーザ発振端面と
することはできない。しかし(111)B面が垂直な面
となるようにあらかじめ半導体基板の主面を選んでおけ
ば、(111)B面を発振端面としたレーザを構成する
ことができる。図6に示すように(111)B面に対し
て垂直な面は例えば(1/10)面であり、この面と結
晶工学的に等価な面を主面とする半導体基板上に用いれ
ば、第3の実施例によるエッチング方法を用いて、基板
主面に対して垂直な側面を形成することができる。以上
のように例えば(1/10)面を主面とするGaAs基
板上にレーザ構造の結晶構造を形成し、次にレーザの共
振器となる部分に絶縁膜によるマスキングを施した後、
上記第3の実施例に示した手法を用いてエッチングを施
すことでレーザ発振端面を容易に形成することができ
る。
【0120】なお、上記実施例では(1/10)面を主
面とする基板を用い、レーザ端面として(111)B面
を形成するようにしたものについて示したが、(1/1
0)面と結晶工学的に等価な{110}面を主面とする
基板を用い、〈011〉方向を長手とするストライプ状
パターンをマスクとして上記実施例と同様のエッチング
を行なえば、基板主面と垂直な(111)B面と結晶工
学的に等価な{111}B面が得られ、これをレーザ共
振器端面とすることができる。
【0121】実施例6.次に本発明の第6の実施例によ
る半導体レーザの製造方法について説明する。
【0122】この製造方法は第3の実施例に示したエッ
チング方法の特徴を利用して窓付き屈折率ガイド型半導
体レーザを作製するものである。図8及び図9は製造方
法の概略を示す断面工程図である。GaAs基板50は
(100)を主面としている。
【0123】図8は〈0/11〉方向からみた断面図で
あり、図9は〈011〉方向からみた断面図である。図
において、図7と同一符号は同一又は相当部分であり、
70はp−GaAs第1キャップ層、71は高抵抗Al
y Ga1-y As窓・ブロック層、72はp−電極、73
はn−電極である。
【0124】以下、本実施例による半導体レーザの製造
方法の工程を説明する。まず、(100)GaAs基板
50上に第1クラッド層51,活性層52,第2クラッ
ド層53,及びp−GaAs第1キャップ層70をMO
CVD法により順次形成する(図8(a) ,図9(a) )。
次にリッジ形成の選択マスクとしてSiN膜を[01
1]方向を共振器方向として形成する(図8(b) ,図9
(b) )。次に上記第3の実施例に示した方法によりエッ
チングを施す(図8(c) ,図9(c) )。すでに述べたよ
うに、共振器端面となるべき部分は、図8(c) に示すよ
うに、(011)面、即ち基板主面に対し垂直な面が形
成されるようにエッチングされる。ここでエッチングに
先立って第1または第2の実施例に示した表面クリーニ
ングを行なっておくことが望ましい。上記エッチングを
施した後、同一チャンバ内において通常のMOCVD成
長条件により、活性層よりもバンドギャップの大きい、
高抵抗Aly Ga1-y Asブロック層71を成長する
(図8(d) ,図9(d) )。図10(a) はこの工程が終了
したときの状態を示す斜視図である。このとき同一チャ
ンバ内で第1または第2の実施例に示した方法を用い
て、エッチング及び再成長を行なえば、窓層と共振器端
面の界面には不純物の偏析しない良好な埋め込み成長が
可能である。次にSiN膜21を除去し(図8(e) ,図
9(e) )、p−GaAsコンタクト層56を成長した後
(図8(f) ,図9(f) )、p−電極72,n−電極73
を形成する(図8(g) ,図9(g) )。以上の工程により
窓付き屈折率ガイド型半導体レーザの基本構造をウェハ
状態のまま作製することができる。最後に劈開などによ
りチップ分離してレーザチップとして完成する(図8
(h) )。
【0125】完成した窓付き屈折率ガイド型半導体レー
ザの斜視図を図10(b) に示す(電極は省略)。
【0126】従来の端面窓構造を有する半導体レーザは
すでに述べたように一度劈開による発振端面を形成した
後、上記発振端面に窓層を成長するという極めて量産性
に乏しい方法により製造していた。本第6の実施例によ
れば、窓構造のレーザを容易に得ることができるのみな
らず、再成長界面も良好な状態となるので高品質な窓付
き屈折率ガイド型半導体レーザを得ることができる。
【0127】なお、上記実施例では(100)面を主面
とする基板を用い、レーザ端面として(011)面を形
成するようにしたものについて示したが、レーザ端面と
して(0/1/1)面を形成するようにしてもよい。ま
た(100)面と結晶工学的に等価な面を主面とする基
板を用い、この主面に対して、(100)面と(01
1)面もしくは(0/1/1)面との関係と等価な関係
を有する面を形成するようにしてもよい。
【0128】実施例7.次に本発明の第7の実施例によ
る半導体レーザの製造方法について説明する。
【0129】本第7の実施例による半導体レーザの製造
方法は、上記第3の実施例のエッチング方法をリッジ成
形のためのエッチングに応用して、リッジウェーブガイ
ド型半導体レーザを作製するものである。図11は本第
7の実施例によるリッジウェーブガイド型半導体レーザ
の製造方法の主要工程を示す断面図である。図におい
て、図7と同一符号は同一又は相当部分である。
【0130】以下、本実施例による半導体レーザの製造
方法の工程を説明する。まず図11(a) に示すようにn
−GaAs基板50上にn−Alx Ga1-x As第1ク
ラッド層51,活性層52,p−Alx Ga1-x As第
2クラッド層53,p−GaAs第1キャップ層70を
順次MOCVD法により形成し、その上にSiN膜21
を形成しストライプ状にパターニングする。次に図11
(b) に示すように第3の実施例に示した方法によりリッ
ジエッチングを施しリッジ形成を行なう。SiN膜パタ
ーン21のストライプ方向が[011]方向であれば、
側面が(111)B面であるリッジが形成される。ここ
でリッジエッチングに先立って第1または第2の実施例
に示した表面クリーニンクを施すことが望ましい。次に
図11(c) に示すように上記図11(b) の工程と同一の
チャンバ内でMOCVD法によりn−GaAs電流ブロ
ック層54,p−GaAs第2キャップ層55を埋め込
み成長する。次に図11(d) に示すようにSiN膜21
を除去した後p−GaAsコンタクト層56をMOCV
D法により成長し、レーザの基本構造が完成する。
【0131】なお、図12はp−電極72,n−電極7
3を形成した後、劈開等によりチップ単位に分割するこ
とにより完成したリッジウェーブ型レーザの構造の概略
を示す斜視図である。
【0132】本第7の実施例では、上記第3の実施例に
示す気相エッチングによるリッジ形成とMOCVD選択
成長を組み合わせたので、ウエットエッチングによるリ
ッジ形成のような煩雑な工程を必要とせず、工程の大幅
な簡略化が可能である。さらにリッジエッチングに先立
って第1または第2の実施例に示した表面クリーニンク
を施せば、再成長界面も良好な状態となるので、特に高
出力レーザの寿命改善が図れるなどの効果を奏する。
【0133】なお、半導体レーザのリッジ形成をHCl
ガスを用いたガスエッチングにより行なうことについて
は、例えば特開昭60−163487号公報に記載され
ているが、この公報にはエッチング条件に関する記述は
なく、HClガスを用いたガスエッチングのリッジ成形
への適用は、上記第3の実施例によるエッチング法を用
いることで初めて実用化が可能となるものである。
【0134】実施例8.次に本発明の第8の実施例によ
る半導体装置の製造方法について説明する。図13は本
第8の実施例による半導体装置の製造方法である化合物
半導体のエッチング方法におけるガス導入シーケンスを
示した図である。図において、120はAsH3 供給領
域、121はH2 パージ領域、122はHCl供給領域
である。
【0135】図に示すように本エッチング方法はAsH
3 ガスを導入すると同時にHClガスを上記AsH3 ガ
スの導入時間より短い時間だけパルス的に導入する第1
のエッチング工程と、上記AsH3 ガスと上記HClガ
スの導入を中断し、反応管内を水素ガスでパージする第
2のエッチング工程を含み、上記第1のエッチング工程
と上記第2のエッチング工程とを周期的に繰り返し行な
うことにより一原子層単位でのエッチングを可能とした
ものである。
【0136】次に第8の実施例にかかる化合物半導体の
エッチング方法の原理について説明する。第3の実施例
の項でも述べたように、例えばHClガスを用いてGa
Asをエッチングする際に平滑なエッチング面を得るた
めには、AsH3 流量の最適化が必要である。これは適
度なAsH3 供給によってGaAs表面からAsCl3
の脱離が抑制され、AsCl3 とGaCl3 の脱離がバ
ランスした時に平滑なエッチングが得られるためであ
る。我々の実験によるとAsH3 流量の増加にともな
い、GaAsのエッチングレートが減少することが確認
された。これは過剰なAsH3 がAsCl3 の脱離を抑
制するためである。従って過剰なAsH3 を導入しなが
らHClガスをパルス的に導入した場合、GaAs基板
表面からはGaCl3 脱離のみ選択的に生じ、1原子層
のエッチングが可能である。このときAsCl3 は過剰
なAsH3 によってGaAs表面からの脱離が抑制され
表面に残留する。次にAsH3 の供給をストップすると
AsCl3 がGaAs表面から脱離する。上記2工程を
繰り返し行なうことで、1原子層単位で制御されたエッ
チングができる。
【0137】図14は上記のエッチング方法を用いてエ
ッチングを行なったときの、エッチングレートとHCl
ガスの供給パルス時間との関係を調べた結果である。図
に示すようにある特定のHClパルス時間で1ML/c
ycleのエッチングレートを持つことを確認した。な
お、本実施例ではこの特定のパルス時間として0.75
〜1.5秒が示されたが、この時間はHCl供給量によ
って異なってくるのでこの時間に限定されるものではな
い。
【0138】上述のように本第8の実施例によると、1
原子層単位で制御されたエッチングを容易に行なうこと
ができ、1サイクルに要する時間も4〜8秒と従来の原
子層制御エッチング方法と比較して大幅に短縮させるこ
とができた。
【0139】実施例9.次にこの発明の第9の実施例に
よる半導体装置の製造装置及びこの装置を用いた半導体
装置の製造方法について説明する。図15はこの発明の
第9の実施例による半導体装置の製造装置である化合物
半導体のエッチング装置の概略を示す断面構造図であ
り、図16は同装置の上面図である。図において、14
0は原料ガスインジェクタ、141はキャリアガスイン
ジェクタ、142はH2 ガスインジェクタ、143はウ
ェハトレイ、144はウェハ、145は反応チャンバ、
146はサセプタ、147は排気口である。
【0140】まずこのエッチング装置の構成について説
明する。H2 ガスインジェクタ142は複数個がサセプ
タ直上に配置されており、上記インジェクタ142より
噴出するH2 ガスによって形成される水素カーテン15
5によってサセプタ146は複数個の領域に分割され
る。本実施例では4つの領域151,152,153,
154に分割されている。原料ガスインジェクタ140
は上記分割された複数個の領域に独立に原料ガス、また
はエッチングガスを導入できるように複数個が配置され
ている。サセプタ146は回転機構を有しており、ウェ
ハ144はサセプタ146の回転ともに上記複数個に分
割された領域を順次移動できるように構成されている。
【0141】次にエッチング方法について説明する。例
えば図16において領域151と153にAsH3 ガス
とHClガスとH2 ガスを同時に供給し、領域152と
154にはH2 ガスを供給するものとする。上記8の実
施例で説明したとおり過剰なAsH3 供給下においては
GaAs表面からのGaCl3 の脱離のみ生じ、AsC
l3 の脱離は抑制される。即ちウェハ144が領域15
1又は領域153に位置するときにはGaの脱離のみ
を、領域152又は領域154に位置するときにはAs
の脱離のみを選択的に行なうことができ、1原子層単位
で制御されたエッチングを行なうことができる。またサ
セプタの回転により、複数個に分割した領域をウェハが
移動するように構成されているので、1サイクルのエッ
チングにかかる時間が従来のエッチング方法として比較
して大幅に短縮できる。
【0142】実施例10.次に本発明の第10の実施例
による量子細線構造の製造方法について説明する。図1
7,図18はGaAs基板23にV字型の溝を形成し、
その上にAlGaAs/GaAs多重層構造161を形
成したときの、V字溝内部への成長形態を示す図であ
る。ここでGaAs基板23の主面は(100)面であ
り、V字溝は図17では[011]方向に第3の実施例
に示した方法により形成し、図18では[0/11]方
向に硫酸系のウェットエッチングによりそれぞれ形成し
た。図17に示すように[011]方向のV字溝が形成
されている場合、V字の側面は(111)B面となる。
MOCVDの典型的な成長条件においては、(111)
B面と垂直な方向には成長速度を持たないため、V字側
面は未成長面162を形成する。V字内部にはV字外部
と連続性を持たない成長が生じ、(111)B面よりも
やや角度の浅い面を成長フロント163とした成長形態
を示すことが明らかになった。この成長フロント163
の面方位をその角度から同定したところ(311)B面
であること確認された。
【0143】一方図18に示すように、[0/11]方
向にV字溝を形成した場合、V字の側面は(111)A
面となる。(111)A面上の成長速度は(100)面
上の成長速度とほぼ等しいため、図18に示したように
V字内部とV字外部とは成長に連続性があり、面に沿う
ように平行に成長が進んでいく。図32に示す従来例の
問題点の説明のところでも述べたとおり、このような成
長形態を用いたのでは良好な量子細線を得ることは困難
であった。さらに図17に示したような(111)B面
を側面にもつV字溝の形態は通常のウェットエッチング
では困難であった。
【0144】図19はこの発明の第10の実施例による
量子細線の製造方法により作製された量子細線の構造を
示す断面図、図20はその製造工程を示す断面図であ
る。図において、181,183はAlGaAs層、1
82はGaAs量子細線、184はGaAs第2キャッ
プ層、185はGaAs第1キャップ層、186はSi
N膜である。
【0145】次に、工程について説明する。まずGaA
s基板180上にAlGaAs層181とGaAs第1
キャップ層185をMOCVD法により順次形成する
(図20(a) )。次に選択マスクとなるSiN膜186
を形成する。このときSiN膜の開口部は[011]方
向が長手方向となるように形成しておく(図20(b)
)。次に第3の実施例で示した方法により側面が(1
11)B面で構成されるV字型の溝を形成し(図20
(c) )、引き続いて同一チャンバー内でGaAs量子細
線182,AlGaAs層183,GaAs第2キャッ
プ層184をV字溝に選択成長する。ここで、GaAs
量子細線182は所望の量子効果が得られるように、そ
の幅が例えば20〜30nm程度となるように結晶成長
量をコントロールする。(111)B面を側面とするV
溝内部には図17に示したように成長するので、図19
に示すようなGaAs量子細線が容易に得られる。
【0146】このように本実施例では、(100)面を
主面とするGaAs基板上にAlGaAs層を形成し、
該AlGaAs層上に[011]方向を長手方向とする
ストライプ状開口を有するSiN膜パターンを形成し、
これをマスクとして上記AlGaAs層を第3の実施例
で示した方法によりエッチングして(111)B面で構
成されたV字型の溝を形成し、この(111)B面で構
成されたV字型の溝の底部付近にGaAs層を結晶成長
し、引き続いてAlGaAs層を結晶成長して溝を埋め
込むようにしたので、量子細線を制御性よく形成するこ
とができる。
【0147】なお、上記実施例では(100)面を主面
とする基板を用い、(111)B面を側面とするV字型
の溝を形成するようにしたものについて示したが、(1
00)面と結晶工学的に等価な{100}面を主面とす
る基板を用い、〈011〉方向を長手とするストライプ
状開口を有するパターンをマスクとして上記実施例と同
様のエッチングを行なえば、(111)B面と結晶工学
的に等価な{111}B面を側面とするV字型の溝が得
られ、これを埋め込むようにすれば、上記実施例と同様
の効果が得られるものである。
【0148】実施例11.図21は本発明の第11の実
施例による量子細線構造の製造方法により作製された量
子細線構造を示す断面図である。本願発明者の1人は以
前半導体装置とその製造方法という名称の量子細線とそ
の製造方法に関する発明を行なっている(特願平2−3
35827)。本第11の実施例による量子細線構造の
製造方法は、構造的には上記特願平2−335827に
示したものと同一の量子細線構造を製造する方法を改良
し、より高品質な量子細線が得られるようにしたもので
ある。図において、190は半絶縁性GaAs基板、1
91は高抵抗(以下i−と記す)GaAs層、192は
i−AlGaAsスペーサ層、193はn+ −GaAs
キャップ層、194は量子細線、195はSiN膜、1
96はn+ −GaAsキャップ層、197はn−AlG
aAs電子供給層である。
【0149】次に製造工程について説明する。図22は
図21に示す構造を同一基板上に複数形成した量子細線
構造を作製する方法を示す断面工程図であり、図におい
て、図21と同一符号は同一又は相当部分である。まず
(100)面を表面とする半絶縁性GaAs基板190
上にi−GaAs層191,i−AlGaAsスペーサ
層192,n+ −GaAsキャップ層193をMOCV
D法により順次結晶成長し、さらにn+ −GaAsキャ
ップ層193上にSiN膜195を成膜し、このSiN
膜195をパターニングして相互に平行な複数のストラ
イプ状開口部を形成する(図22(a) )。このときSi
N膜のストライプ状開口部は[011]方向が長手方向
となるように形成しておく。次に第3の実施例で示した
エッチング方法を用いて、図22(b) に示すように、V
字型の溝を形成し、引き続いて同一チャンバー内におい
てn−AlGaAs電子供給層197とn+ −GaAs
キャップ層196をV字溝内部に選択成長する(図22
(c) )。このときV字溝のエッチングに先立って上記第
1の実施例又は第2の実施例による半導体装置の製造方
法で用いた方法により表面クリーニングを施しておくこ
とが望ましい。次に、図22(d) に示すようにSiN膜
195を除去した後、図22(e) に示すようにn+ −G
aAsキャップ層196をウェハ全面に形成する。
【0150】上記の方法により作製された量子細線構造
では、V字溝の底部(頂点)付近のごく狭い領域のi−
GaAs層に選択的に量子細線194が形成される。こ
のような構造で量子細線194が形成される理由は上記
特願平2−335827に詳しく説明してあるとおりで
ある。
【0151】本第11の実施例によれば、ウェットエッ
チングと再成長を組み合わせた従来の量子細線の製造方
法と異なり、精度よく量子細線を形成でき、またV字溝
のエッチングに先立って上記第1の実施例又は第2の実
施例による半導体装置の製造方法で用いた方法により表
面クリーニングを施しておくことにより、再成長界面に
不純物の偏析しない良質な量子細線が得られる。
【0152】なお、上記第11の実施例においては、キ
ャップ層193としてn+ −GaAsを用いた場合につ
いて示したが、n+ −GaAsのかわりにi−GaAs
を用いてもよい。
【0153】実施例12.次に、本発明の第12の実施
例による半導体レーザの製造方法について説明する。図
23は本発明の第12の実施例による半導体レーザの製
造方法を示す断面工程図である。図において、200は
n−GaAs基板、201はn−GaAsバッファ層、
202はn−AlGaAsクラッド層、203はアンド
ープGaAs活性層、204はp−AlGaAsクラッ
ド層、205はn−GaAs電流ブロック層、206は
p−GaAsコンタクト層、207はSiO2 膜パター
ンである。
【0154】まずn−GaAs基板200上にMOCV
D法によりn−GaAsバッファ層201,n−AlG
aAsクラッド層202,アンドープGaAs活性層2
03,p−AlGaAsクラッド層204,n−GaA
s電流ブロック層205,及びp−GaAsコンタクト
層206を順次結晶成長する。次にスパッタによりコン
タクト層206上にSiO膜207を成膜し、通常の写
真製版を用いてSiO2 膜207をパターニングし、図
23(a) に示すように、ストライプ状の開口部を形成す
る。ここで開口部のストライプ方向は[011]方向で
ある。図24は図23(a) に示す工程で形成されるスト
ライプ状開口部の形状をより明確に示すための斜視図で
ある。次にMOCVD反応管内で、例えばHClガスを
用いたガスエッチングにより、p−GaAsコンタクト
層206,及びn−GaAs電流ブロック層205をエ
ッチングする。この溝の側面は(111)B面である。
なお、このエッチングとして上記第3の実施例に示すエ
ッチング法を用いることができることはいうまでもな
い。また、エッチングに際し、上記第1の実施例又は第
2の実施例による半導体装置の製造方法で用いた方法に
より表面クリーニングを施しておくことが望ましい。次
にMOCVD法によりp−AlGaAsクラッド層20
8,p−GaAsコンタクト層209を順次成長する。
この成長において側面である(111)B面は成長しな
い面であるため、図25に示すように、溝は底面からの
成長により埋まり、表面は図23(c) に示すようにフラ
ットに埋まる。
【0155】この後、SiO膜207を除去し、ウェハ
表面にp側電極、基板裏面側にn側電極を形成し、劈開
等によりチップ単位に分割することにより半導体レーザ
が完成する。
【0156】このように、本第12の実施例によれば、
従来とは90°異なる[011]方向を長手方向とする
ストライプ状の開口を有するパターンをマスクとして塩
素系ガスを用いてガスエッチングすることにより、電流
通路を形成するためのストライプ状溝を形成するように
したから、溝を、その表面がフラットとなるように埋め
込むことができ、結晶成長工程後の写真製版工程を容易
とでき、またレーザをジャンクションダウンで組み立て
た場合に活性層に圧縮応力がかかることを防止でき信頼
性を向上できる。
【0157】さらに、本実施例では埋め込み層が溝の底
面から順に埋まっていくので、p−GaAsコンタクト
層209をp−AlGaAs層208の埋め込み成長に
連続して成長させても、p−GaAsコンタクト層20
6と接続して成長させることができるので、図33の従
来例のようにp−GaAsコンタクト層306を埋め込
み成長工程とは別の結晶成長工程で成長させる必要はな
く、結晶成長工程を2回にすることができ、工程の短縮
化を図ることができる。なお、p−AlGaAs層20
8とp−GaAsコンタクト層209を一回の結晶成長
で連続して形成するのではなく、p−AlGaAs層2
08を埋め込んだ後、選択成長マスクパターン207を
除去して、ウェハ全面にp−GaAsコンタクト層20
9を結晶成長させるようにしてもよい。この場合は最初
の結晶成長工程でp−GaAsコンタクト層206まで
ではなく、図33の従来例と同様、n−GaAs電流ブ
ロック層205までを結晶成長するようにすればよい。
【0158】なお、上記実施例では(100)面を主面
とする基板を用い、(111)B面を側面とする溝を形
成するようにしたものについて示したが、(100)面
と結晶工学的に等価な{100}面を主面とする基板を
用い、〈011〉方向を長手とするストライプ状開口を
有するパターンをマスクとして上記実施例と同様のエッ
チングを行なえば、(111)B面と結晶工学的に等価
な{111}B面を側面とする溝が得られ、これを埋め
込むようにすれば、上記実施例と同様の効果が得られる
ものである。
【0159】実施例13.次に、本発明の第13の実施
例による半導体レーザの製造方法について説明する。本
実施例はAlGaAs系材料で信頼性の高い埋め込みヘ
テロ構造の半導体レーザを得るものである。図26(a)
〜(d) は本発明の第13の実施例による半導体レーザの
製造方法を示す断面工程図である。図において、210
はn−GaAs基板、211はn−AlGaAsクラッ
ド層、212はアンドープGaAs活性層、213はp
−AlGaAsクラッド層、214はSiO2 膜パター
ン、215はi−GaAs電流ブロック層、216はp
−GaAsコンタクト層である。
【0160】次に製造工程について説明する。まずn−
GaAs基板210上にMOCVD法によりn−AlG
aAsクラッド層211,アンドープGaAs活性層2
12,p−AlGaAsクラッド層213を順次結晶成
長する。なお、図示しないが、p−AlGaAsクラッ
ド層213上にはp−GaAsキャップ層を結晶成長す
る。次にスパッタによりウェハ上にSiO膜214を成
膜し、通常の写真製版を用いてSiO2 膜207をパタ
ーニングし、図26(a) に示すように、ストライプ状の
パターンを形成する。ここでパターン214のストライ
プ方向は[011]方向である。次にMOCVD反応管
内で、例えばHClガスを用いたガスエッチングによ
り、図26(b) に示すように、ダブルヘテロ構造をリッ
ジ状にエッチング成形する。このリッジの側壁は(11
1)B面である。このとき、エッチングに際し、上記第
1の実施例又は第2の実施例による半導体装置の製造方
法で用いた方法により表面クリーニングを施す。なお、
このエッチングとして上記第3の実施例に示すエッチン
グ法を用いることができることはいうまでもない。エッ
チング工程に連続して、MOCVD法によりi−GaA
s電流ブロック層215を結晶成長し、図26(c) に示
すように、リッジを埋め込む。その後、SiO2 膜パタ
ーン214を除去し、図26(d) に示すように、ウェハ
全面にp−GaAsコンタクト層を結晶成長する。
【0161】この後、コンタクト層216表面にp側電
極、基板210裏面側にn側電極を形成し、劈開等によ
りチップ単位に分割することにより半導体レーザが完成
する。
【0162】AlGaAs系材料では、再成長界面に界
面準位が形成されやすいため、活性層を含むダブルヘテ
ロ構造をリッジ状にエッチングした後にこれを電流ブロ
ック層で埋め込む、いわゆる埋め込みヘテロ構造のレー
ザを作製した場合、活性層の再成長界面部分での劣化が
著しく、信頼性が極めて低いという問題点があったが、
本実施例では、エッチングに際し、上記第1の実施例又
は第2の実施例による半導体装置の製造方法で用いた方
法により表面クリーニングを施すことにより、再成長界
面を清浄なものとでき、界面準位が形成されにくくする
ことができ、AlGaAs系材料からなる埋め込みヘテ
ロレーザの信頼性を向上できる。
【0163】なお、上記実施例では、電流ブロック層を
高抵抗のGaAs層で構成したものについて示したが、
図26(e) に示す変形例のように、p−GaAs層21
7,及びn−GaAs層218の二層構造とし、pnp
nサイリスタによる電流阻止構造を構成するようにして
もよい。
【0164】実施例14.以下、この発明の第14の実
施例を図について説明する。図27は本発明の第14の
実施例による結晶成長方法を示す工程図であり、図にお
いて、401はSi基板、402はシリコンナイトライ
ド膜(以下、SiN膜と称す)、403はGaAs層で
ある。
【0165】以下、工程を説明する。まず、図27(a)
に示すSi基板401上に、図27(b) に示すようにS
iN膜402を例えばプラズマCVD法によって形成す
る。
【0166】次に、図27(c) に示すように、上記Si
N膜402をデバイス作製領域を取り囲むようにパター
ニングを施す。次に、この基板をアンモニア水とH2 O
2 とH2 Oの混合液(以下、RCA洗浄液と称す)で洗
浄する。Si基板をRCA洗浄液を用いて洗浄すると基
板表面に残留したレジスト等による汚染が完全に除去さ
れ、清浄なSi表面にした後、弱く結合した酸化膜が形
成される。上記酸化膜はMOCVD反応炉で成長前に熱
処理を施すことにより、容易に除去される。
【0167】次に、熱処理を施してSi表面の清浄化を
行った後、図27(d) に示すように、21階成長法によ
りGaAs層403を所望の厚みだけ形成する。ここ
で、低温バッファ層形成は、原料であるAsH3 ガス,
及びトリメチルガリウム(TMG)と共にHClガスを
同時に供給することにより行った。本実施例において
は、HClガスのTMGに対するモル流量比が0.25
となるようにした。通常のMOCVD成長においては、
500℃以下の温度領域においては絶縁膜上へのポリク
リスタルの析出が生じ、良好な選択成長が得られないの
に対し、本実施例のように成長中に微量のHClガスを
導入することにより、ポリクリスタルの析出は完全に抑
制され、良好な選択成長が得られた。この結果、低温バ
ッファ層形成後に引き続いてGaAsの成長に適した7
00℃程度の温度で所望の厚みのGaAs層を成長した
際に、絶縁膜上へのポリクリスタルの析出はなく、絶縁
膜でパターニングされていない部分にのみGaAs層を
成長することができた。
【0168】発明が解決しようとする課題の項でも述べ
たように、従来の技術においては低温バッファ層を良好
に選択成長することが困難であり、この結果クラック抑
制することができないという問題点があった。そのた
め、従来例で述べたメサ溝によるクラックの伝播防止策
が採用され、効果を奏することを確認したが、この場合
は、ウエハ上にレジストが残留した状態で高温成長を行
なうことにより菱形状ピットが発生し、この菱形状ピッ
トを起点としてクラックが発生するため、クラックの完
全な抑制には至っていなかった。
【0169】本第14の実施例では、絶縁膜によるパタ
ーニングを施した後、Si基板のクリーニングをRCA
洗浄により行い、しかる後GaAs層を上述の方法によ
り成長するようにしたので、良好な選択成長を行うこと
ができた。ウエハ端から発生するクラックは全て絶縁膜
で遮断され、デバイス領域へのクラックの伝播は全くな
かった。さらに、選択成長領域は充分にクリーニングが
施されたSi基板上に行うことができるので、従来例に
見られたような菱形状のピットは発生せず、この菱形状
のピットによるクラックの発生も完全に抑制することが
できた。
【0170】なお、上記第14の実施例においては、S
i基板上にGaAsを成長した場合について説明した
が、Si基板上にInPを成長する場合、またはGaA
s基板上にInPを成長する場合でも同様の効果を奏す
ることを確認した。ここで、基板がGaAsである場合
は、絶縁膜パターン形成後に基板表面を充分にクリーニ
ングすることが困難である。しかし、本発明では、表面
にレジストが残留したGaAs層上に直接高温成長を行
なう従来の方法と異なり、この充分に清浄ではないGa
As基板上にはじめに形成されるのは低温バッファ層で
あるので、基板上の不純物を原因とする菱形状のピット
は発生しにくく、クラックを充分抑制することができる
ものである。
【0171】また、その他の異種基板上結晶成長に関し
ても本技術を用いることにより、上記第14の実施例で
示した同様の効果が得られることは容易に類推できる。
【0172】実施例15.図28はこの発明の第15の
実施例による結晶成長方法を説明するための図である。
このグラフはGaAs基板上にGaAsをMOCVD成
長する際に、結晶成長時にHClガスを添加することに
よる成長速度の変化を示したものである。
【0173】図に示すように、HCl流量が3sccm以下
の領域では成長速度はほとんど変化しないのに対し、H
Clガス流量が5sccm以上では、HClガス流量増加に
伴って成長速度が減少することが確認された。これはH
Clガスによるエッチング作用が材料ガスによる成長作
用と同時に起こっていることを反映している。この図か
ら、MOCVDによる均一性,再現性を損なうことな
く、選択成長性のみを改善するためには、HClガス流
量を一定量以下に設定することが極めて重要であること
が確認できる。すなわち、HClガスのTMGに対する
モル流量比が概略0.3以下となるようにHClガス流
量を設定することが極めて重要である。
【0174】図29は、HClガスをMOCVD成長時
に同時に供給することによる結晶品質への影響について
調べた結果であり、GaAs基板上に成長したAl0.37
Ga0.63As層の4.2Kにおけるフォトルミネッセン
ス(PL)スペクトルを示している。図において、41
0はHCl流量をHClガスのIII 族ガスに対するモル
流量比([HCl]/[III ])を0.25に設定して
成長した場合の、411は1.0に設定して成長した場
合のAl0.37Ga0.63As成長層の4.2KにおけるP
Lスペクトルをそれぞれ示している。図に示すように
[HCl]/[III ]を0.25に設定した場合、PL
スペクトルは通常のMCOVD成長と同等の良好な結晶
性を示したのに対し、[HCl]/[III ]を1に設定
して成長したサンプルではPLピーク強度が約1/10
0に減少し、不純物発光のピークが支配的な振る舞いを
示した。このサンプルの不純物分析をSIMSの手法に
より調べたところ、Cl,Oが結晶中に混入しているこ
とが明らかになった。この結果は、HClガスを多量に
添加することで結晶品質が悪化したことを示している。
【0175】以上、図28,図29に示す実験の結果よ
り、[HCl]/[III ]は0.3以下に抑えることが
結晶品質の面からも、均一性、再現性確保の面からも極
めて重要であることが初めて示された。
【0176】なお、上記実施例では、GaAs基板上に
GaAsあるいはAlGaAsを成長させた場合の結晶
品質について述べたが、GaAsオンSi等の異種基板
上の成長の際、特に低温バッファ層の成長の際にHCl
ガスを同時に供給する場合には、[HCl]/[III ]
を0.3以下にすることで結晶品質に優れ、かつクラッ
ク発生を防止できる良好な選択成長が得られることも確
認した。
【0177】また、上記第14,第15の実施例では、
材料ガスと同時にHClガスを流すようにしたものにつ
いて示したが、HClガスの代わりにCl2 ガスを流す
ようにしても良く、上記各実施例と同様の効果を奏す
る。
【0178】
【発明の効果】以上のように、この発明に係る半導体装
置の製造方法によれば、Alを構成元素として含む化合
物半導体に絶縁膜によるパターニクを施す工程と、ドラ
イエッチングの手法を用いて微細構造を作製する工程
と、上記微細構造を化合物半導体で埋め込む工程とを含
む化合物半導体装置の製造方法において、上記Alを構
成元素として含む化合物半導体に連続してAlを含まな
い化合物半導体保護層を形成し、上記保護層上に絶縁膜
による選択マスクを形成した後、半導体ウェハを硫化ア
ンモニウム溶液に浸漬し、その後、反応管内において塩
素系ガスを用いてエッチングを行ない、上記反応管内に
おいて上記エッチング工程によって作製された微細構造
をMOCVDの手法を用いて化合物半導体層で埋め込む
ようにしたので、不純物の偏析しない良好な再成長界面
が得られ、再成長層の結晶品質を向上できる効果があ
る。
【0179】また、この発明に係る半導体装置の製造方
法によれば、Alを構成元素として含む化合物半導体に
絶縁膜によるパターニクを施す工程と、ドライエッチン
グの手法を用いて微細構造を作製する工程と、上記微細
構造を化合物半導体で埋め込む工程とを含む化合物半導
体装置の製造方法において、上記Alを構成元素として
含む化合物半導体に連続してAlを含まない化合物半導
体保護層を形成し、上記保護層上に絶縁膜による選択マ
スクを形成した後、半導体ウェハを反応管内にセット
し、該反応管内において上記保護層の表面酸化膜を除去
し、その後、反応管内において塩素系ガスを用いてエッ
チングを行ない、上記反応管内において上記エッチング
工程によって作製された微細構造をMOCVDの手法を
用いて化合物半導体層で埋め込むようにしたので、不純
物の偏析しない良好な再成長界面が得られ、再成長層の
結晶品質を向上できる効果がある。
【0180】また、この発明に係る半導体装置の製造方
法によれば、Alx Ga1-x As(0≦x≦1)を塩素
系エッチングガスを用いたドライエッチングによりエッ
チングする工程を含む半導体装置の製造方法において、
上記ドライエッチングとして塩素系エッチングガスとV
族ガスと水素ガスとを同時に供給することにより行なう
ガスエッチングの手法を用い、上記塩素系エッチングガ
スとしてHClガス又はCl2 ガスを用い、上記V族ガ
スとしてアルシン(AsH3 )ガス,ターシャリブチル
アルシン(C4 H9 AsH2 )ガス,又はトリメチルア
ルシン((CH3 )3 As)ガスのいずれかを用い、上
記V族ガスの分圧を8×10-3Torr以上0.08T
orr以下とし、かつ上記エッチングガス流量に対する
上記V族ガス流量の比を2.5以下としてエッチングを
行なうようにしたので、極めて平滑なエッチング面が得
られるとともに、エッチング面へのダメージをも防止す
ることができる効果がある。
【0181】また、この発明に係る半導体レーザの製造
方法によれば、半導体基板上にレーザダイオード構造の
GaAs及びAlGaAsからなる結晶構造を作製した
後、上記レーザダイオード構造の結晶構造上にエッチン
グマスクとなる絶縁膜を形成し、塩素系エッチングガス
とV族ガスと水素ガスとを同時に供給することにより行
なうガスエッチングであって、上記塩素系エッチングガ
スとしてHClガス又はCl2 ガスを用い、上記V族ガ
スとしてアルシン(AsH3 )ガス,ターシャリブチル
アルシン(C4 H9 AsH2 )ガス,又はトリメチルア
ルシン((CH3 )3 As)ガスのいずれかを用い、上
記V族ガスの分圧を8×10-3Torr以上0.08T
orr以下とし、かつ上記エッチングガス流量に対する
上記V族ガス流量の比を2.5以下として行なうエッチ
ングによりレーザダイオードの発振端面を形成するよう
にしたので、劈開端面に比しても遜色のないレーザ発振
端面をエッチングにより容易に形成することができる効
果がある。
【0182】また、この発明に係る半導体レーザの製造
方法によれば、窓付き屈折率ガイド型レーザダイオード
を製造する方法において、半導体基板上に複数種類のA
lxGa1-x As(0≦x≦1)からなり活性領域を構
成する半導体積層構造を結晶成長し、該半導体積層構造
上にエッチングと結晶成長を選択的に行うための保護膜
を形成した後、上記保護膜をマスクとして用い、塩素系
エッチングガスとV族ガスと水素ガスとを同時に供給す
ることにより行なうガスエッチングであって、上記塩素
系エッチングガスとしてHClガス又はCl2 ガスを用
い、上記V族ガスとしてアルシン(AsH3 )ガス,タ
ーシャリブチルアルシン(C4 H9 AsH2 )ガス,又
はトリメチルアルシン((CH3 )3 As)ガスのいず
れかを用い、上記V族ガスの分圧を8×10-3Torr
以上0.08Torr以下とし、かつ上記エッチングガ
ス流量に対する上記V族ガス流量の比を2.5以下とし
て行なうエッチングにより上記半導体積層構造をエッチ
ングし、この後、該エッチング工程で残された半導体積
層構造を埋め込むようにレーザ発振領域の材料と比較し
てバンドギャップが大きく、かつ半絶縁性もしくは高抵
抗の半導体材料を結晶成長し電流阻止領域及び窓領域を
一括同時に形成し、上記保護膜を除去した後、ウェハ上
に表面オーミックコンタクト領域を結晶成長するように
したので、端面窓構造を有する半導体レーザダイオード
を容易に形成することができる効果がある。
【0183】また、この発明に係る半導体装置の製造方
法によれば、化合物半導体のエッチング工程を含むもの
において、V族水素化物ガスを導入すると同時に塩素系
ガスを上記V族水素化物ガスの導入時間より短い時間だ
けパルス的に導入する第1のエッチング工程と、上記V
族水素化物ガスと上記塩素系ガスの導入を中断し、反応
管内を水素ガスでパージする第2のエッチング工程を含
み、上記第1のエッチング工程と、上記第2のエッチン
グ工程とを周期的に繰り返し行なうように構成したの
で、原子層レベルで制御され、しかも平滑なエッチング
を容易に行なうことができる効果がある。
【0184】また、この発明に係る半導体装置の製造装
置は、回転が可能なパンケーキ型サセプタを有し、上記
サセプタの表面は水素ガスによって複数の領域に分割さ
れており、上記複数個の分割領域のうち少なくと1つの
領域がV族水素化物ガスと塩素系ガスと水素ガスの混合
ガスで充填されており、少なくとも1つの領域が水素ガ
スで充填されており、半導体ウェハが水素ガスによって
分割された各々の領域を上記サセプタの回転によって順
次移動できる構成としたので、原子層レベルで制御さ
れ、しかも平滑なエッチングを容易に行なうことができ
る効果がある。
【0185】また、この発明に係る半導体装置の製造方
法は、回転機構を有するパンケーキ型サセプタを有し、
上記サセプタの表面が水素ガスによって複数の領域に分
割されており、上記複数個の分割領域のうち少なくとも
1つの領域がV族水素化物ガスと塩素系ガスと水素ガス
の混合ガスで充填されており、少なくとも1つの領域が
水素ガスで充填された構造を有する半導体装置の製造装
置を用い、半導体ウェハを水素ガスによって分割された
上記各々の領域を上記サセプタの回転によって順次移動
させ、上記V族水素化物ガスと塩素系ガスと水素ガスの
混合ガスで充填された領域で第1のエッチングを行な
い、上記水素ガスで充填された領域で第2のエッチング
を行ない、上記サセプタの回転にともなって上記第1の
エッチングと上記第2のエッチングとを周期的に繰り返
し行なうようにしたので、原子層レベルで制御され、し
かも平滑なエッチングを容易に行なうことができる効果
がある。
【0186】また、この発明に係る量子細線構造の製造
方法によれば、{100}面を主面とする半導体基板上
に第1の半導体層を形成した後、上記第1の半導体層上
に〈011〉方向を長手方向とする細線状のエッチング
マスクを形成し、上記第1の半導体層を、塩素系エッチ
ングガスとV族ガスと水素ガスとを同時に供給すること
により行なうガスエッチングであって、上記塩素系エッ
チングガスとしてHClガス又はCl2 ガスを用い、上
記V族ガスとしてアルシン(AsH3 )ガス,ターシャ
リブチルアルシン(C4 H9 AsH2 )ガス,又はトリ
メチルアルシン((CH3 )3 As)ガスのいずれかを
用い、上記V族ガスの分圧を8×10-3Torr以上
0.08Torr以下とし、かつ上記エッチングガス流
量に対する上記V族ガス流量の比を2.5以下として行
なうエッチングによりエッチングし{111}B面で構
成されたV字型の溝を形成した後、上記{111}B面
で構成されたV字型の溝の底部付近に上記第1の半導体
よりバンドギャップの小さい第2の半導体層を形成し、
上記第2の半導体層に引き続いて第2の半導体よりバン
ドギャップの大きい第3の半導体層を形成するようにし
たので、量子細線を制御性よく形成することができる効
果がある。
【0187】また、この発明に係る量子細線構造の製造
方法によれば、半導体基板上に第1種の高抵抗半導体層
と、上記第1種の半導体より電子親和力の小さい第2種
の高抵抗半導体層と、第1種の高抵抗半導体層とを順次
形成した後、上記第2種の高抵抗半導体層に少なくとも
凹部の形状が逆三角形断面である凹凸周期構造を形成
し、その上部に上記第2種のn型半導体層と上記第1種
のn型半導体層を順次形成して構成される量子細線構造
の製造方法であって、上記凹凸周期構造の形成を、塩素
系エッチングガスとV族ガスと水素ガスとを同時に供給
することにより行なうガスエッチングであって、上記塩
素系エッチングガスとしてHClガス又はCl2 ガスを
用い、上記V族ガスとしてアルシン(AsH3 )ガス,
ターシャリブチルアルシン(C4 H9 AsH2 )ガス,
又はトリメチルアルシン((CH3)3 As)ガスのい
ずれかを用い、上記V族ガスの分圧を8×10-3Tor
r以上0.08Torr以下とし、かつ上記エッチング
ガス流量に対する上記V族ガス流量の比を2.5以下と
して行なうエッチングにより形成するようにしたので、
優れた品質の量子細線を制御性よく形成することができ
る効果がある。
【0188】また、この発明に係る半導体レーザの製造
方法によれば、{100}面を主面とする第1導電型G
aAs基板上に、少なくとも第1導電型Aly Ga1-y
Asクラッド層,Alz Ga1-z As(0≦z<y)活
性層,第2導電型Alw Ga1-w As(z<w)クラッ
ド層,第1導電型GaAs電流ブロック層を順次結晶成
長した後、上記結晶成長を行なった半導体ウェハ上に
〈011〉方向を長手方向とするストライプ状開口部を
有する絶縁膜パターンを形成し、該絶縁膜パターンをマ
スクとして気相エッチングを行ない、{111}B面を
側面とし上記第2導電型クラッド層を底面とするストラ
イプ状溝を形成し、該溝を埋め込むように第2導電型A
lw Ga1-w As層を結晶成長するようにしたから、側
面からの成長はなく底面からの成長のみにより溝が埋ま
り、埋め込み層を表面がフラットな状態に埋め込みする
ことができ、結晶成長工程後の写真製版プロセスが可能
となり、またジャンクションダウンで組み立てた場合に
も活性層にストレスがかからない信頼性の高い半導体レ
ーザが得られる効果がある。
【0189】また、この発明に係る半導体レーザの製造
方法によれば、{100}面を主面とする第1導電型G
aAs基板上に、少なくとも第1導電型Aly Ga1-y
Asクラッド層,Alz Ga1-z As(0≦z<y)活
性層,第2導電型Alw Ga1-w As(z<w)クラッ
ド層を順次結晶成長した後、上記結晶成長を行なった半
導体ウェハ上に〈011〉方向を長手方向とするストラ
イプ状の絶縁膜パターンを形成し、該絶縁膜パターンを
マスクとして塩素系エッチングガスを用いた気相エッチ
ングを行ない、活性領域を{111}B面を側面とする
リッジ形状にエッチング成形し、該リッジ両側を埋め込
むように電流ブロック層を結晶成長するようにし、かつ
上記エッチング工程に先立って硫化アンモニウム処理も
しくは反応炉内での表面クリーニング処理によりウェハ
表面の酸化膜を除去するようにしたから、信頼性の高
い、AlGaAs系の材料からなる埋め込みヘテロ構造
の半導体レーザを実現することができる効果がある。
【0190】また、この発明に係る結晶成長方法によれ
ば、絶縁膜パターンが形成された基板上にMOCVD法
により選択的に III−V族半導体層をエピタキシャル成
長する方法において、上記エピタキシャル成長を、原料
ガスと共にHClガス,またはCl2 ガスをIII 族ガス
流量に対し0.3以下のモル流量比で同時に供給して行
なうようにしたので、結晶品質の劣化を生じることな
く、良好な選択成長を行なうことができる効果がある。
【0191】また、この発明に係る結晶成長方法によれ
ば、第1種の半導体基板上に第2種の半導体層をMOC
VD法によりエピタキシャル成長する結晶成長方法にお
いて、第1種の半導体基板上に絶縁膜を形成し、該絶縁
膜を第1種の半導体基板のデバイス作成領域を取り囲む
ようにパターニングを施した後、上記絶縁膜のパターニ
ングが施された第1種の半導体基板上に500℃以下の
温度で第2種の半導体からなる低温バッファ層をエピタ
キシャル成長し、これに引き続いて600℃以上の温度
で第2種の半導体層をエピタキシャル成長するように
し、かつ上記第2種の半導体からなる低温バッファ層を
エピタキシャル成長する工程を、原料ガスと共にHCl
ガス,またはCl2 ガスを同時に供給することにより行
うようにしたので、異種半導体基板上に結晶成長する半
導体層のクラックの発生を抑制できる効果がある。
【0192】また、この発明に係る結晶成長方法によれ
ば、上記第2種の半導体からなる低温バッファ層をエピ
タキシャル成長する工程において、原料ガスと共に供給
するHClガス,またはCl2 ガスのIII 族ガス流量に
対するモル流量比を0.3以下としたので、異種半導体
基板上に結晶成長する半導体層のクラックの発生を抑制
できるとともに、高品質な結晶成長ができる効果があ
る。
【図面の簡単な説明】
【図1】この発明の第1の実施例による半導体装置の製
造方法を説明するための図である。
【図2】この発明の第1の実施例における化合物半導体
のエッチング方法の効果を説明するための不純物分析の
測定結果を示す図である。
【図3】この発明の第3の実施例による半導体装置の製
造方法を説明するための図である。
【図4】この発明の第4の実施例による半導体レーザの
製造方法を説明するための図である。
【図5】この発明の第5の実施例による半導体レーザの
製造方法を説明するための図である。
【図6】この発明の第5の実施例による半導体レーザの
製造方法を説明するための図である。
【図7】この発明の第4の実施例による半導体レーザの
製造方法により作製された半導体レーザの一例を示す図
である。
【図8】この発明の第6の実施例による窓付き屈折率ガ
イド型半導体レーザの製造方法を示す断面工程図であ
る。
【図9】この発明の第6の実施例による窓付き屈折率ガ
イド型半導体レーザの製造方法を示す断面工程図であ
る。
【図10】この発明の他の実施例にかかる窓付き屈折率
ガイド型半導体レーザの製造方法を説明するための斜視
図である。
【図11】この発明の第7の実施例によるリッジ型半導
体レーザの製造方法を示す断面工程図である。
【図12】この発明の第7の実施例によるリッジ型半導
体レーザの製造方法により作製されたリッジ型半導体レ
ーザの一例を示す斜視図である。
【図13】この発明の第8の実施例による半導体装置の
製造方法を説明するためのガス導入シーケンス図であ
る。
【図14】この発明の第8の実施例による半導体装置の
製造方法を説明するためのエッチングレートを示す図で
ある。
【図15】この発明の第9の実施例による半導体装置の
製造装置の概略を示す断面構造図である。
【図16】この発明の第9の実施例による半導体装置の
製造装置の概略を示す上面図である。
【図17】この発明の第10の実施例による量子細線構
造の製造方法を説明するための図である。
【図18】この発明の第10の実施例による量子細線構
造の製造方法を説明するための図である。
【図19】この発明の第10の実施例による量子細線構
造の製造方法を説明するための図である。
【図20】この発明の第10の実施例による量子細線構
造の製造方法を説明するための図である。
【図21】この発明の第11の実施例による量子細線構
造の製造方法を説明するための図である。
【図22】この発明の第11の実施例による量子細線構
造の製造方法を説明するための図である。
【図23】この発明の第12の実施例による半導体レー
ザの製造方法を示す断面工程図である。
【図24】この発明の第12の実施例による半導体レー
ザの製造方法を説明するための斜視図である。
【図25】この発明の第12の実施例による半導体レー
ザの製造方法における埋め込み結晶成長の様子を示す図
である。
【図26】この発明の第13の実施例による半導体レー
ザの製造方法を説明するための図である。
【図27】この発明の第14の実施例による結晶成長方
法を説明するための断面工程図である。
【図28】この発明の第15の実施例による結晶成長方
法を説明するための成長速度とHCl流量との関係を示
す図である。
【図29】この発明の第15の実施例による結晶成長方
法を説明するための4.2Kにおけるフォトルミネッセ
ンススペクトルを示す図である。
【図30】従来の化合物半導体のエッチング方法の問題
点を説明するための断面構造図である。
【図31】従来の化合物半導体のエッチング方法の問題
点を説明するための断面構造図である。
【図32】従来の化合物半導体のエッチング方法の問題
点を説明するための不純物分析結果を示す図である。
【図33】従来の窓構造の半導体レーザの構造を説明す
るための斜視図である。
【図34】従来の化合物半導体のエッチング方法を説明
するための図である。
【図35】従来の量子細線レーザにおける量子細線の問
題点を説明するための図である。
【図36】従来の半導体レーザの製造方法を示す断面工
程図である。
【図37】従来の半導体レーザの製造方法における埋め
込み結晶成長の様子を示す図である。
【図38】従来のSi基板上のGaAs成長方法の一例
を説明するための断面工程図である。
【図39】従来のSi基板上のGaAs成長方法の問題
点を説明するための図である。
【図40】Si基板上のGaAs成長層のクラックの発
生とGaAs層の厚みとの関係を示す図である。
【符号の説明】
1 再成長GaAs層 2 Alx Ga1-x As層 3 再成長界面 11 GaAsキャップ層 12 酸化膜 13 硫黄膜 21 SiN膜パターン 23 GaAs基板 24 (011)面 25 (311)面 26 (111)B面 50 n−GaAs基板 51 n−Alx Ga1-x As第1クラッド層 52 活性層 53 p−Alx Ga1-x As第2クラッド層 54 n−GaAs電流ブロック層 55 p−GaAs層 56 p−GaAsコンタクト層 57 発光端面 70 p−GaAs層 71 高抵抗Aly Ga1-y As窓・ブロック層 72 p−電極 73 n−電極 120 AsH3 供給領域 121 H2 パージ領域 122 HCl供給領域 140 原料ガスインジェクタ 141 キャリアガスインジェクタ 142 H2 ガスインジェクタ 143 ウェハトレイ 144 ウェハ 145 反応チャンバ 146 サセプタ 147 排気口 161 GaAs/AlGaAs多重層 162 未成長面 163 成長フロント 181 AlGaAs層 182 GaAs量子細線 183 AlGaAs層 184 GaAsキャップ層 185 GaAsキャップ層 186 SiN膜 191 i−GaAs層 192 i−AlGaAsスペーサ層 193 n+ −GaAsキャップ層 194 量子細線 195 SiN膜 196 n+ −GaAsキャップ層 197 n−AlGaAs電子供給層 200 n−GaAs基板 201 n−GaAs層 202 n−AlGaAsクラッド層 203 アンドープGaAs層 204 p−AlGaAsクラッド層 205 n−GaAs電流ブロック層 206 p−GaAsコンタクト層 207 SiO2 膜 208 p−AlGaAs埋め込み層 209 p−GaAs埋め込み層 401 Si基板402 SiN基板 403 GaAs層
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成5年7月14日
【手続補正1】
【補正対象書類名】明細書
【補正対象項目名】0040
【補正方法】変更
【補正内容】
【0040】次に第6の従来例として示した従来の結晶
成長方法における問題点について説明する。従来のSi
基板上GaAs結晶成長方法は以上のように構成されて
いるので、次に示すような問題点があった。図39は従
来のSi基板上GaAs結晶成長方法の問題点を説明す
るための図である。図において、510はGaAs層、
511はクラックを示している。我々の詳細な実験によ
ると、従来の技術の項でも述べたようにGaAs層のク
ラックの大部分はウエハ端より発生しており、本従来例
におけるメサ構造により、ウエハ端で発生したクラック
はほぼ全数メサ溝504で分断され、デバイスエリアへ
は貫通しないことを確認した。しかし、5cm×5cmのメ
サ溝領域内に十数本のクラックが発生し、完全には抑制
できないという問題点に直面した。このようなクラック
の発生原因を詳細に調べたところ、図39(b) に示す菱
形状のピットを起点として発生していることが明らかに
なった。さらに、この菱形状のピットは第1のGaAs
503と第2のGaAs層505の界面より発生して
いることも確認した。
【手続補正2】
【補正対象書類名】明細書
【補正対象項目名】0168
【補正方法】変更
【補正内容】
【0168】発明が解決しようとする課題の項でも述べ
たように、従来の技術においては低温バッファ層を良好
に選択成長することが困難であり、この結果クラック
抑制することができないという問題点があった。そのた
め、従来例で述べたメサ溝によるクラックの伝播防止策
が採用され、効果を奏することを確認したが、この場合
は、ウエハ上にレジストが残留した状態で高温成長を行
なうことにより菱形状ピットが発生し、この菱形状ピッ
トを起点としてクラックが発生するため、クラックの完
全な抑制には至っていなかった。
【手続補正3】
【補正対象書類名】明細書
【補正対象項目名】0175
【補正方法】変更
【補正内容】
【0176】なお、上記実施例では、GaAs基板上に
GaAsあるいはAlGaAsを成長させた場合の結晶
品質について述べたが、Si基板上のGaAs成長等の
異種基板上の成長の際、特に低温バッファ層の成長の際
にHClガスを同時に供給する場合には、[HCl]/
[III ]を0.3以下にすることで結晶品質に優れ、か
つクラック発生を防止できる良好な選択成長が得られる
ことも確認した。 ─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成6年4月21日
【手続補正3】
【補正対象書類名】明細書
【補正対象項目名】0176
【補正方法】変更
【補正内容】
【0176】なお、上記実施例では、GaAs基板上に
GaAsあるいはAlGaAsを成長させた場合の結晶
品質について述べたが、Si基板上のGaAs成長等の
異種基板上の成長の際、特に低温バッファ層の成長の際
にHClガスを同時に供給する場合には、[HCl]/
[III ]を0.3以下にすることで結晶品質に優れ、か
つクラック発生を防止できる良好な選択成長が得られる
ことも確認した。

Claims (28)

    【特許請求の範囲】
  1. 【請求項1】 Alを構成元素として含む化合物半導体
    に絶縁膜によるパターニングを施す工程と、ドライエッ
    チングの手法を用いて微細構造を作製する工程と、上記
    微細構造を化合物半導体で埋め込む工程とを含む化合物
    半導体装置の製造方法において、 上記Alを構成元素として含む化合物半導体上に連続し
    てAlを含まない化合物半導体保護層を形成する第1の
    工程と、 上記化合物半導体保護層上に絶縁膜による選択マスクを
    形成する第2の工程と、 第2の工程を終えた半導体ウェハを硫化アンモニウム溶
    液に浸漬する第3の工程と、 反応管内において塩素系ガスを用いてエッチングを施す
    第4の工程と、 上記反応管内において上記第4の工程によって作成され
    た微細構造をMOCVDの手法を用いて化合物半導体層
    で埋め込む第5の工程とを含むことを特徴とする半導体
    装置の製造方法。
  2. 【請求項2】 Alを構成元素として含む化合物半導体
    に絶縁膜によるパターニングを施す工程と、ドライエッ
    チングの手法を用いて微細構造を作製する工程と、上記
    微細構造を化合物半導体で埋め込む工程とを含む化合物
    半導体装置の製造方法において、 上記Alを構成元素として含む化合物半導体上に連続し
    てAlを含まない化合物半導体保護層を形成する第1の
    工程と、 上記化合物半導体保護層上に絶縁膜による選択マスクを
    形成する第2の工程と、 反応管内において上記化合物半導体保護層の表面酸化膜
    を除去する第3の工程と、 上記反応管内において塩素系ガスを用いてエッチングを
    施す第4の工程と、 上記反応管内において上記第4の工程によって作成され
    た微細構造をMOCVDの手法を用いて化合物半導体層
    で埋め込む第5の工程とを含むことを特徴とする半導体
    装置の製造方法。
  3. 【請求項3】 上記Alを構成元素として含む化合物半
    導体がAlGaAsであって、上記化合物半導体保護層
    がGaAsであることを特徴とする請求項1または2記
    載の半導体装置の製造方法。
  4. 【請求項4】 Alx Ga1-x As(0≦x≦1)を塩
    素系エッチングガスを用いたドライエッチングによりエ
    ッチングする工程を含む半導体装置の製造方法におい
    て、 上記ドライエッチングとして塩素系エッチングガスとV
    族ガスと水素ガスとを同時に供給することにより行なう
    ガスエッチングの手法を用い、上記塩素系エッチングガ
    スとしてHClガス又はCl2 ガスを用い、上記V族ガ
    スとしてアルシン(AsH3 )ガス,ターシャリブチル
    アルシン(C4 H9 AsH2 )ガス,又はトリメチルア
    ルシン((CH3 )3 As)ガスのいずれかを用い、 上記V族ガスの分圧を8×10-3Torr以上0.08
    Torr以下とし、かつ上記エッチングガス流量に対す
    る上記V族ガス流量の比を2.5以下としてエッチング
    を行なうことを特徴とする半導体装置の製造方法。
  5. 【請求項5】 上記塩素系エッチングガスとしてHCl
    ガス、上記V族ガスとしてアルシン(AsH3 )ガスを
    用いることを特徴とする請求項4記載の半導体装置の製
    造方法。
  6. 【請求項6】 半導体基板上に複数種類のAlx Ga1-
    x As(0≦x≦1)からなり所定のレーザダイオード
    構造を有する結晶構造を作製する第1の工程と、 上記レーザダイオード構造の結晶構造上にエッチングマ
    スクとなる絶縁膜を形成する第2の工程と、 塩素系エッチングガスとV族ガスと水素ガスとを同時に
    供給することにより行なうガスエッチングであって、上
    記塩素系エッチングガスとしてHClガス又はCl2 ガ
    スを用い、上記V族ガスとしてアルシン(AsH3 )ガ
    ス,ターシャリブチルアルシン(C4 H9 AsH2 )ガ
    ス,又はトリメチルアルシン((CH3)3 As)ガスの
    いずれかを用い、上記V族ガスの分圧を8×10-3To
    rr以上0.08Torr以下とし、かつ上記エッチン
    グガス流量に対する上記V族ガス流量の比を2.5以下
    として行なうエッチングによりレーザダイオードの発振
    端面を形成する第3の工程とを含むことを特徴とする半
    導体レーザの製造方法。
  7. 【請求項7】 上記結晶成長工程においてレーザダイオ
    ード表面が(100)面となるように結晶成長を行な
    い、上記ガスエッチング工程においてレーザ発振端面と
    して(011)面もしくは(0/1/1)面を形成する
    ことを特徴とする請求項6記載の半導体レーザの製造方
    法。
  8. 【請求項8】 上記結晶成長工程においてレーザダイオ
    ード表面が{110}面となるように結晶成長を行な
    い、上記ガスエッチング工程においてレーザ発振端面と
    して上記{110}面と垂直な{111}B面を形成す
    ることを特徴とする請求項6記載の半導体レーザの製造
    方法。
  9. 【請求項9】 窓付き屈折率ガイド型の半導体レーザを
    製造する方法において、 半導体基板上に複数種類のAlx Ga1-x As(0≦x
    ≦1)からなり活性領域を構成する半導体積層構造を形
    成する第1の結晶成長工程と、 該半導体積層構造上にエッチングと結晶成長を選択的に
    行うための保護膜を形成する工程と、 上記保護膜をマスクとして用い、塩素系エッチングガス
    とV族ガスと水素ガスとを同時に供給することにより行
    なうガスエッチングであって、上記塩素系エッチングガ
    スとしてHClガス又はCl2 ガスを用い、上記V族ガ
    スとしてアルシン(AsH3 )ガス,ターシャリブチル
    アルシン(C4 H9 AsH2 )ガス,又はトリメチルア
    ルシン((CH3 )3 As)ガスのいずれかを用い、上
    記V族ガスの分圧を8×10-3Torr以上0.08T
    orr以下とし、かつ上記エッチングガス流量に対する
    上記V族ガス流量の比を2.5以下として行なうエッチ
    ングにより上記半導体積層構造をエッチングする工程
    と、 該エッチング工程で残された半導体積層構造を埋め込む
    ようにレーザ発振領域の材料と比較してバンドギャップ
    が大きく、かつ半絶縁性もしくは高抵抗の半導体材料を
    結晶成長し電流阻止領域及び窓領域を一括同時に形成す
    る第2の結晶成長工程と、 上記保護膜を除去した後、ウェハ表面に表面オーミック
    コンタクト領域を形成する第3の結晶成長工程とを含む
    ことを特徴とする半導体レーザの製造方法。
  10. 【請求項10】 上記結晶成長工程においてレーザダイ
    オード表面が(100)面となるように結晶成長を行な
    い、上記ガスエッチング工程においてレーザ発振端面と
    して(011)面もしくは(0/1/1)面を形成する
    ことを特徴とする請求項5記載の半導体レーザの製造方
    法。
  11. 【請求項11】 III−V族化合物半導体を塩素系エッ
    チングガスを用いてガスエッチングする工程を含む半導
    体装置の製造方法において、 V族水素化物ガスを導入すると同時に塩素系ガスを上記
    V族水素化物ガスの導入時間より短い時間だけパルス的
    に導入する第1のエッチング工程と、 上記V族水素化物ガスと上記塩素系ガスの導入を中断
    し、反応管内を水素ガスでパージする第2のエッチング
    工程を含み、 上記第1のエッチング工程と、上記第2のエッチング工
    程とを周期的に繰り返し行なうことを特徴とする半導体
    装置の製造方法。
  12. 【請求項12】 上記V族水素化物ガスとしてAsH3
    ガスを用い、上記塩素系ガスとしてHClガスを用いる
    ことを特徴とする請求項11記載の半導体装置の製造方
    法。
  13. 【請求項13】 III−V族化合物半導体を塩素系ガス
    を用いてガスエッチングする半導体装置の製造装置にお
    いて、 回転が可能なパンケーキ型サセプタを有し、上記サセプ
    タの表面は水素ガスによって複数の領域に分割されてお
    り、上記複数個の分割領域のうち少なくとも1つの領域
    がV族水素化物ガスと塩素系ガスと水素ガスの混合ガス
    で充填されており、少なくとも1つの領域が水素ガスで
    充填されており、上記サセプタ上に載置された半導体ウ
    ェハは水素ガスによって分割された上記各々の領域を、
    上記サセプタの回転によって順次移動することを特徴と
    する半導体装置の製造装置。
  14. 【請求項14】 III−V族化合物半導体を塩素系ガス
    を用いてガスエッチングする工程を含む半導体装置の製
    造方法において、 回転機構を有するパンケーキ型サセプタを有し、上記サ
    セプタの表面が水素ガスによって複数の領域に分割され
    ており、上記複数個の分割領域のうち少なくとも1つの
    領域がV族水素化物ガスと塩素系ガスと水素ガスの混合
    ガスで充填されており、少なくとも1つの領域が水素ガ
    スで充填された構造を有する半導体装置の製造装置を用
    い、半導体ウェハを水素ガスによって分割された上記各
    々の領域を上記サセプタの回転によって順次移動させ、
    上記V族水素化物ガスと塩素系ガスと水素ガスの混合ガ
    スで充填された領域で第1のエッチングを行ない、上記
    水素ガスで充填された領域で第2のエッチングを行な
    い、上記サセプタの回転にともなって上記第1のエッチ
    ングと上記第2のエッチングとを周期的に繰り返し行な
    うことを特徴とする半導体装置の製造方法。
  15. 【請求項15】 上記V族水素化物ガスとしてAsH3
    ガスを用い、上記塩素系ガスとしてHClガスを用いる
    ことを特徴とする請求項14記載の半導体装置の製造方
    法。
  16. 【請求項16】 {100}面を主面とする半導体基板
    上に第1の半導体層を形成する工程と、 上記第1の半導体層上に〈011〉方向を長手方向とす
    る細線状のエッチングマスクを形成する工程と、 上記第1の半導体層を、塩素系エッチングガスとV族ガ
    スと水素ガスとを同時に供給することにより行なうガス
    エッチングであって、上記塩素系エッチングガスとして
    HClガス又はCl2 ガスを用い、上記V族ガスとして
    アルシン(AsH3 )ガス,ターシャリブチルアルシン
    (C4 H9 AsH2 )ガス,又はトリメチルアルシン
    ((CH3 )3 As)ガスのいずれかを用い、上記V族
    ガスの分圧を8×10-3Torr以上0.08Torr
    以下とし、かつ上記エッチングガス流量に対する上記V
    族ガス流量の比を2.5以下として行なうエッチングに
    よりエッチングし、側面が{111}B面で構成された
    断面V字型の溝を形成する工程と、 上記V字型の溝の底部付近に上記第1の半導体よりバン
    ドギャップの小さい第2の半導体層を形成する工程と、 上記第2の半導体層に引き続いて第2の半導体よりバン
    ドキャップの大きい第3の半導体層を形成する工程とを
    含むことを特徴とする量子細線構造の製造方法。
  17. 【請求項17】 半導体基板上に第1種の高抵抗半導体
    層と、上記第1種の半導体より電子親和力の小さい第2
    種の高抵抗半導体層と第1種の高抵抗半導体層とを順次
    形成する工程と、上記第2種の高抵抗半導体層に少なく
    とも凹部の形状が逆三角形断面である凹凸周期構造を形
    成する工程と、その上部に上記第2種のn型半導体層と
    上記第1種のn型半導体層を順次形成する工程とを含む
    量子細線構造の製造方法であって、 上記凹凸周期構造の形成を、塩素系エッチングガスとV
    族ガスと水素ガスとを同時に供給することにより行なう
    ガスエッチングであって、上記塩素系エッチングガスと
    してHClガス又はCl2 ガスを用い、上記V族ガスと
    してアルシン(AsH3 )ガス,ターシャリブチルアル
    シン(C4 H9 AsH2 )ガス,又はトリメチルアルシ
    ン((CH3 )3 As)ガスのいずれかを用い、上記V
    族ガスの分圧を8×10-3Torr以上0.08Tor
    r以下とし、かつ上記エッチングガス流量に対する上記
    V族ガス流量の比を2.5以下として行なうエッチング
    により形成することを特徴とする量子細線構造の製造方
    法。
  18. 【請求項18】 {100}面を主面とする第1導電型
    GaAs基板上に、少なくとも第1導電型Aly Ga1-
    y Asクラッド層,Alz Ga1-z As(0≦z<y)
    活性層,第2導電型Alw Ga1-w As(z<w)クラ
    ッド層,第1導電型GaAs電流ブロック層を順次結晶
    成長する工程と、 上記結晶成長を行なった半導体ウェハ上に〈011〉方
    向を長手方向とするストライプ状開口部を有する絶縁膜
    パターンを形成する工程と、 上記絶縁膜パターンをマスクとして塩素系エッチングガ
    スを用いた気相エッチングを行ない、{111}B面を
    側面とし上記第2導電型クラッド層を底面とするストラ
    イプ状溝を形成する工程と、 該溝を埋め込むように第2導電型Alw Ga1-w As層
    を結晶成長する工程とを含むことを特徴とする半導体レ
    ーザの製造方法。
  19. 【請求項19】 {100}面を主面とする第1導電型
    GaAs基板上に、少なくとも第1導電型Aly Ga1-
    y Asクラッド層,Alz Ga1-z As(0≦z<y)
    活性層,第2導電型Alw Ga1-w As(z<w)クラ
    ッド層,第1導電型GaAs電流ブロック層,及び第2
    導電型GaAsコンタクト層を順次結晶成長する工程
    と、 上記結晶成長を行なった半導体ウェハ上に〈011〉方
    向を長手方向とするストライプ状開口部を有する絶縁膜
    パターンを形成する工程と、 上記絶縁膜パターンをマスクとして塩素系エッチングガ
    スを用いた気相エッチングを行ない、{111}B面を
    側面とし上記第2導電型クラッド層を底面とするストラ
    イプ状溝を形成する工程と、 該溝を埋め込むように第2導電型Alw Ga1-w As
    層,及び第2導電型GaAs層を結晶成長する工程とを
    含むことを特徴とする半導体レーザの製造方法。
  20. 【請求項20】 {100}面を主面とする第1導電型
    GaAs基板上に、少なくとも第1導電型Aly Ga1-
    y Asクラッド層,Alz Ga1-z As(0≦z<y)
    活性層,第2導電型Alw Ga1-w As(z<w)クラ
    ッド層を順次結晶成長する工程と、 上記結晶成長を行なった半導体ウェハ上に〈011〉方
    向を長手方向とするストライプ状の絶縁膜パターンを形
    成する工程と、 上記絶縁膜パターンをマスクとして塩素系エッチングガ
    スを用いた気相エッチングを行ない、活性領域を{11
    1}B面を側面とするリッジ形状にエッチング成形する
    工程と、 該リッジ両側を埋め込むように電流ブロック層を結晶成
    長する工程を含み、かつ上記エッチング工程に先立って
    硫化アンモニウム処理もしくは反応炉内での表面クリー
    ニング処理によりウェハ表面の酸化膜を除去する工程と
    を含むことを特徴とする半導体レーザの製造方法。
  21. 【請求項21】 上記電流ブロック層として高抵抗もし
    くは半絶縁性のGaAs層を結晶成長させることを特徴
    とする請求項20記載の半導体レーザの製造方法。
  22. 【請求項22】 上記電流ブロック層として第2導電型
    GaAs層と第1導電型GaAs層とを順次結晶成長さ
    せることを特徴とする請求項20記載の半導体レーザの
    製造方法。
  23. 【請求項23】 絶縁膜パターンが形成された基板上に
    有機金属気相成長法により選択的に III−V族化合物半
    導体層をエピタキシャル成長する結晶成長方法におい
    て、 上記エピタキシャル成長を、原料ガスと共にHClガ
    ス,またはCl2 ガスをIII 族ガス流量に対し0.3以
    下のモル流量比で同時に供給して行なうことを特徴とす
    る結晶成長方法。
  24. 【請求項24】 第1種の半導体基板上に第2種の半導
    体層を有機金属気相成長法によりエピタキシャル成長す
    る結晶成長方法において、 第1種の半導体基板上に絶縁膜を形成する第1の工程
    と、 上記絶縁膜を第1種の半導体基板のデバイス作成領域を
    取り囲むようにパターニングを施す第2の工程と、 上記絶縁膜のパターニングが施された第1種の半導体基
    板上に500℃以下の温度で第2種の半導体からなる低
    温バッファ層をエピタキシャル成長する第3の工程と、 第3の工程に引き続いて600℃以上の温度で第2種の
    半導体層をエピタキシャル成長する第4の工程とを含
    み、 かつ、上記第2種の半導体からなる低温バッファ層をエ
    ピタキシャル成長する第3の工程は、原料ガスと共にH
    Clガス、またはCl2 ガスを同時に供給することによ
    り行うことを特徴とする結晶成長方法。
  25. 【請求項25】 請求項24に記載の結晶成長方法にお
    いて、上記第1種の半導体はSiであり、上記第2種の
    半導体はGaAsであることを特徴とする結晶成長方
    法。
  26. 【請求項26】 請求項24に記載の結晶成長方法にお
    いて、上記第1種の半導体はGaAsであり、上記第2
    種の半導体はInPであることを特徴とする結晶成長方
    法。
  27. 【請求項27】 請求項24に記載の結晶成長方法にお
    いて、上記第1種の半導体はSiであり、上記第2種の
    半導体はInPであることを特徴とする結晶成長方法。
  28. 【請求項28】 請求項24ないし請求項27のいずれ
    か記載の結晶成長方法において、上記第2種の半導体か
    らなる低温バッファ層をエピタキシャル成長する第3の
    工程において、原料ガスと共に供給するHClガス、ま
    たはCl2 ガスのIII 族ガス流量に対するモル流量比が
    0.3以下であることを特徴とする結晶成長方法。
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Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002118327A (ja) * 2000-10-06 2002-04-19 Furukawa Electric Co Ltd:The 化合物半導体装置の製造方法
JP2002176221A (ja) * 2000-12-05 2002-06-21 Mitsubishi Electric Corp 半導体レーザおよびその製造方法
JP2003068715A (ja) * 2001-08-28 2003-03-07 Furukawa Electric Co Ltd:The 半導体デバイスの製造方法
JP2007109928A (ja) * 2005-10-14 2007-04-26 Taiyo Nippon Sanso Corp 窒化物半導体製造装置部品の洗浄方法と洗浄装置
JP2008060554A (ja) * 2006-07-28 2008-03-13 Iqe Rf Llc 共通化合物半導体第3〜5族ウエハ上に集積デバイス用のエピタキシャルウエハを製造する方法
JP2008066647A (ja) * 2006-09-11 2008-03-21 Fujitsu Ltd 光半導体装置及びその製造方法
US7550304B2 (en) 2006-08-28 2009-06-23 Mitsubishi Electric Corporation Method for manufacturing semiconductor laser element
JP2013165262A (ja) * 2012-01-13 2013-08-22 Sumitomo Electric Ind Ltd 光半導体素子の製造方法
KR20160123441A (ko) * 2015-04-15 2016-10-26 삼성전자주식회사 반도체 장치의 제조 방법
US9819153B2 (en) 2013-08-02 2017-11-14 Fujitsu Limited Optical semiconductor device and manufacturing method thereof
US11329454B2 (en) 2018-03-26 2022-05-10 Mitsubishi Electric Corporation Method of manufacturing semiconductor device
JPWO2022180659A1 (ja) * 2021-02-24 2022-09-01
JP2025527148A (ja) * 2022-08-24 2025-08-20 インダストリー-アカデミック コーオペレイション ファウンデーション キョンサン ナショナル ユニバーシティ 多層遷移金属ジカルコゲナイド薄膜の表面特性及び厚さの制御方法

Families Citing this family (29)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3330218B2 (ja) * 1994-03-25 2002-09-30 三菱電機株式会社 半導体装置の製造方法,及び半導体装置
JP3446300B2 (ja) 1994-05-27 2003-09-16 三菱化学株式会社 V溝構造を有する半導体装置
JP3374878B2 (ja) * 1994-09-02 2003-02-10 三菱電機株式会社 半導体エッチング方法
EP0709902B1 (en) 1994-10-26 2002-01-23 Mitsubishi Chemical Corporation Light-emitting semiconductor device and method for manufacturing the same
JPH0945670A (ja) * 1995-07-29 1997-02-14 Hewlett Packard Co <Hp> Iii族−n系結晶の気相エッチング方法および再成長方法
US6639926B1 (en) * 1998-03-25 2003-10-28 Mitsubishi Chemical Corporation Semiconductor light-emitting device
JP2001230494A (ja) * 2000-02-17 2001-08-24 Mitsubishi Electric Corp 半導体レーザ素子及びその製造方法
TW456058B (en) * 2000-08-10 2001-09-21 United Epitaxy Co Ltd Light emitting diode and the manufacturing method thereof
EP1257025A3 (en) * 2001-04-18 2005-04-06 The Furukawa Electric Co., Ltd. Surface emitting semiconductor laser device
EP1282208A1 (en) * 2001-07-30 2003-02-05 Agilent Technologies, Inc. (a Delaware corporation) Semiconductor laser structure and method of manufacturing same
US20030235995A1 (en) * 2002-06-21 2003-12-25 Oluseyi Hakeem M. Method of increasing selectivity to mask when etching tungsten or tungsten nitride
JP2004119817A (ja) * 2002-09-27 2004-04-15 Sharp Corp 半導体レーザ素子およびその製造方法
GB2411520A (en) * 2004-02-25 2005-08-31 Agilent Technologies Inc Method of forming laser mesa by reactive ion etching followed by in situ etching in regrowth reactor
KR100855425B1 (ko) 2005-01-18 2008-08-29 마쯔시다덴기산교 가부시키가이샤 반도체 레이저 장치 및 그 제조방법
JP4656525B2 (ja) * 2006-04-24 2011-03-23 株式会社沖データ 半導体装置、ledヘッド及び画像形成装置
JP2009182249A (ja) * 2008-01-31 2009-08-13 Mitsubishi Electric Corp 半導体光素子の製造方法
US8313967B1 (en) * 2009-01-21 2012-11-20 Stc.Unm Cubic phase, nitrogen-based compound semiconductor films epitaxially grown on a grooved Si <001> substrate
NL2003357C2 (en) * 2009-08-14 2011-02-15 Univ Twente Method for manufacturing a single crystal nano-wire.
US10164082B2 (en) 2012-05-04 2018-12-25 Stc.Unm Growth of cubic crystalline phase structure on silicon substrates and devices comprising the cubic crystalline phase structure
US9520472B2 (en) 2012-05-04 2016-12-13 Stc.Unm Growth of cubic crystalline phase strucure on silicon substrates and devices comprising the cubic crystalline phase structure
US10453996B2 (en) 2012-05-04 2019-10-22 Stc.Unm Growth of cubic crystalline phase structure on silicon substrates and devices comprising the cubic crystalline phase structure
GB2529953B (en) * 2013-06-28 2020-04-01 Intel Corp Nanostructures and nanofeatures with Si (111) planes on Si (100) wafers for III-N epitaxy
CN105513964B (zh) * 2014-09-24 2019-12-31 中芯国际集成电路制造(上海)有限公司 晶体管的形成方法
US9431536B1 (en) 2015-03-16 2016-08-30 Taiwan Semiconductor Manufacturing Co., Ltd. Semiconductor device structure with raised source/drain having cap element
CN108039332B (zh) * 2017-12-29 2024-02-27 楚赟精工科技(上海)有限公司 双功能反应设备
EP3985812A4 (en) * 2019-06-17 2023-02-01 Nippon Telegraph And Telephone Corporation SEMICONDUCTOR LIGHT SOURCE ELEMENT AND METHOD OF MANUFACTURE OF SEMICONDUCTOR OPTICAL WAVEGUIDE WINDOW STRUCTURE
CN111180313A (zh) * 2020-01-03 2020-05-19 中国科学院半导体研究所 一种低位错原位刻蚀mocvd二次外延生长方法
US20230352912A1 (en) * 2020-09-18 2023-11-02 National Research Council Of Canada Buried heterostructure semiconductor laser and method of manufacture
CN114540785B (zh) * 2022-01-20 2022-12-02 陕西源杰半导体科技股份有限公司 波导对接结构生长方法、铝量子阱激光器及其制备方法

Family Cites Families (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
BE620887A (ja) 1959-06-18
NL293887A (ja) * 1962-06-11
US4354898A (en) 1981-06-24 1982-10-19 Bell Telephone Laboratories, Incorporated Method of preferentially etching optically flat mirror facets in InGaAsP/InP heterostructures
JPS6050923A (ja) * 1983-08-31 1985-03-22 Hitachi Ltd プラズマ表面処理方法
JPS60163487A (ja) 1984-02-03 1985-08-26 Nec Corp 半導体レ−ザ
JPS6175529A (ja) 1984-09-21 1986-04-17 Toshiba Corp ドライエツチング方法及び装置
US4734514A (en) * 1984-10-25 1988-03-29 Morton Thiokol, Inc. Hydrocarbon-substituted analogs of phosphine and arsine, particularly for metal organic chemical vapor deposition
FR2574601B1 (fr) * 1984-12-11 1987-07-17 Menigaux Louis Procede de fabrication d'un laser a semi-conducteur a ruban enterre
JPS61184892A (ja) 1985-02-12 1986-08-18 Nec Corp メサ型構造形成法
US4689115A (en) 1985-04-26 1987-08-25 American Telephone And Telegraph Company, At&T Bell Laboratories Gaseous etching process
JPS6381855A (ja) * 1986-09-25 1988-04-12 Mitsubishi Electric Corp ヘテロ接合バイポ−ラトランジスタの製造方法
FR2636176B1 (fr) 1988-09-08 1990-12-07 France Etat Procede de realisation d'un laser a semi-conducteur a forte puissance d'emission et a grande bande passante a partir d'une structure a ruban enterre du type brs, et laser ainsi obtenu
US4980314A (en) * 1989-06-06 1990-12-25 At&T Bell Laboratories Vapor processing of a substrate
JP2708897B2 (ja) 1989-07-21 1998-02-04 三洋電機株式会社 赤外線センサ付き電子レンジ
JPH0359576A (ja) 1989-07-28 1991-03-14 Mitsubishi Electric Corp 現像装置
JP3033104B2 (ja) * 1989-11-17 2000-04-17 ソニー株式会社 エッチング方法
JP2557546B2 (ja) 1990-03-30 1996-11-27 三菱電機株式会社 半導体装置の製造方法
JPH0410683A (ja) 1990-04-27 1992-01-14 Matsushita Electron Corp 半導体レーザ装置の製造方法
US5362973A (en) 1990-06-25 1994-11-08 Xerox Corporation Quantum fabricated via photo induced evaporation enhancement during in situ epitaxial growth
US5114877A (en) 1991-01-08 1992-05-19 Xerox Corporation Method of fabricating quantum wire semiconductor laser via photo induced evaporation enhancement during in situ epitaxial growth
JP2943510B2 (ja) 1991-08-09 1999-08-30 日本電気株式会社 可変波長半導体レーザ装置
JP3298161B2 (ja) 1991-10-29 2002-07-02 ソニー株式会社 ドライエッチング方法

Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002118327A (ja) * 2000-10-06 2002-04-19 Furukawa Electric Co Ltd:The 化合物半導体装置の製造方法
JP2002176221A (ja) * 2000-12-05 2002-06-21 Mitsubishi Electric Corp 半導体レーザおよびその製造方法
JP2003068715A (ja) * 2001-08-28 2003-03-07 Furukawa Electric Co Ltd:The 半導体デバイスの製造方法
JP2007109928A (ja) * 2005-10-14 2007-04-26 Taiyo Nippon Sanso Corp 窒化物半導体製造装置部品の洗浄方法と洗浄装置
JP2008060554A (ja) * 2006-07-28 2008-03-13 Iqe Rf Llc 共通化合物半導体第3〜5族ウエハ上に集積デバイス用のエピタキシャルウエハを製造する方法
US7550304B2 (en) 2006-08-28 2009-06-23 Mitsubishi Electric Corporation Method for manufacturing semiconductor laser element
JP2008066647A (ja) * 2006-09-11 2008-03-21 Fujitsu Ltd 光半導体装置及びその製造方法
JP2013165262A (ja) * 2012-01-13 2013-08-22 Sumitomo Electric Ind Ltd 光半導体素子の製造方法
US9819153B2 (en) 2013-08-02 2017-11-14 Fujitsu Limited Optical semiconductor device and manufacturing method thereof
KR20160123441A (ko) * 2015-04-15 2016-10-26 삼성전자주식회사 반도체 장치의 제조 방법
US11329454B2 (en) 2018-03-26 2022-05-10 Mitsubishi Electric Corporation Method of manufacturing semiconductor device
JPWO2022180659A1 (ja) * 2021-02-24 2022-09-01
JP2025527148A (ja) * 2022-08-24 2025-08-20 インダストリー-アカデミック コーオペレイション ファウンデーション キョンサン ナショナル ユニバーシティ 多層遷移金属ジカルコゲナイド薄膜の表面特性及び厚さの制御方法

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Publication number Publication date
GB2271466A (en) 1994-04-13
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GB9318519D0 (en) 1993-10-20
US6358316B1 (en) 2002-03-19

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