JPH06234242A - 多走査線プリントヘッド制御装置を有するプリンタおよびそのプリント方法 - Google Patents
多走査線プリントヘッド制御装置を有するプリンタおよびそのプリント方法Info
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- JPH06234242A JPH06234242A JP3293294A JP29329491A JPH06234242A JP H06234242 A JPH06234242 A JP H06234242A JP 3293294 A JP3293294 A JP 3293294A JP 29329491 A JP29329491 A JP 29329491A JP H06234242 A JPH06234242 A JP H06234242A
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Abstract
(57)【要約】
【目的】 異なる形式のプリントヘッドが要求する画素
データフォーマットを供給するのに、それぞれの異なっ
たプリントヘッド毎に特定構造の回路が必要とされるこ
とのないようにするための比較的に簡単な電子装置を用
いたプリンタを提供する。 【構成】 プリンタ（１０）は、プリントされるべき画
像のビットマッピングされたラスタマトリックッスから
のアクセスを行ない、ビットグループのビット数はプリ
ントヘッド（２０）のプリント素子（１９）の数に対応
している。このビットグループは、プリントヘッド（２
０）のプリント素子（１９）を駆動することによって画
像をプリントするために用いられる。ラスタ走査プリン
トヘッド（２０）を有するプリンタ（１０）において
は、選択されたビットグループは、プリントヘッド（２
０）のラスタ走査と同期してビットマッピングされたラ
スタマトリックスからアクセスされる。
データフォーマットを供給するのに、それぞれの異なっ
たプリントヘッド毎に特定構造の回路が必要とされるこ
とのないようにするための比較的に簡単な電子装置を用
いたプリンタを提供する。 【構成】 プリンタ（１０）は、プリントされるべき画
像のビットマッピングされたラスタマトリックッスから
のアクセスを行ない、ビットグループのビット数はプリ
ントヘッド（２０）のプリント素子（１９）の数に対応
している。このビットグループは、プリントヘッド（２
０）のプリント素子（１９）を駆動することによって画
像をプリントするために用いられる。ラスタ走査プリン
トヘッド（２０）を有するプリンタ（１０）において
は、選択されたビットグループは、プリントヘッド（２
０）のラスタ走査と同期してビットマッピングされたラ
スタマトリックスからアクセスされる。
Description
【０００１】
【産業上の利用分野】本発明は、プリンタに関し、特
に、多プリント素子プリントヘッドを有するプリンタに
関する。
に、多プリント素子プリントヘッドを有するプリンタに
関する。
【０００２】
【従来の技術】多くのプリンタは、画像がプリントされ
るべきプリント媒体（紙など）に対して物理的に接近し
て配置されたプリントヘッドを有する。プリントヘッド
は、通常１つまたはそれ以上のプリントワイヤまたはイ
ンクジェットのようなプリント素子を有し、そのそれぞ
れは、プリント媒体上にドットその他の画素（ピクセ
ル）をプリントしうる。プリントヘッドは、通常、画像
全体がプリントされ終るまで、プリント媒体を横切るラ
スタ運動により前後に走査される。
るべきプリント媒体（紙など）に対して物理的に接近し
て配置されたプリントヘッドを有する。プリントヘッド
は、通常１つまたはそれ以上のプリントワイヤまたはイ
ンクジェットのようなプリント素子を有し、そのそれぞ
れは、プリント媒体上にドットその他の画素（ピクセ
ル）をプリントしうる。プリントヘッドは、通常、画像
全体がプリントされ終るまで、プリント媒体を横切るラ
スタ運動により前後に走査される。
【０００３】必要な走査数を減少せしめるためには、プ
リントヘッド上に３３プリント素子というような多くの
プリント素子を垂直に配列すればよい。これらのプリン
ト素子のうちの選択されたものは、プリントヘッドがプ
リント媒体を横切って走査される時、プリンタからプリ
ントヘッドへ供給されるデータに従って作動せしめられ
る。プリントヘッドへ供給されるデータのフォーマット
は、必然的にプリントヘッドのプリント素子の数および
配置の関数となる。しかし、異なる製造業者からの異な
るモデルのプリンタ、および同一製造業者からの異なる
モデルのプリンタさえ、異なる形式のプリンタヘッドを
有することが多い。その結果、特定のプリントヘッドの
形式が要求する画素データフォーマットを供給するため
には、それぞれの異なったプリントヘッドに対し注文作
りの回路がしばしば必要となる。
リントヘッド上に３３プリント素子というような多くの
プリント素子を垂直に配列すればよい。これらのプリン
ト素子のうちの選択されたものは、プリントヘッドがプ
リント媒体を横切って走査される時、プリンタからプリ
ントヘッドへ供給されるデータに従って作動せしめられ
る。プリントヘッドへ供給されるデータのフォーマット
は、必然的にプリントヘッドのプリント素子の数および
配置の関数となる。しかし、異なる製造業者からの異な
るモデルのプリンタ、および同一製造業者からの異なる
モデルのプリンタさえ、異なる形式のプリンタヘッドを
有することが多い。その結果、特定のプリントヘッドの
形式が要求する画素データフォーマットを供給するため
には、それぞれの異なったプリントヘッドに対し注文作
りの回路がしばしば必要となる。
【０００４】
【発明が解決しようとする課題】本発明は、実用目的
上、上述の制約を、特に比較的に複雑でない電子装置を
必要とするのみで、回避しうる改良されたプリンタを提
供することを目的とする。
上、上述の制約を、特に比較的に複雑でない電子装置を
必要とするのみで、回避しうる改良されたプリンタを提
供することを目的とする。
【０００５】
【課題を解決するための手段】以上の、およびその他の
諸目的および諸利点は、プリントされるべき画像のビッ
トマッピングされたラスタマトリックスを発生し、この
マトリックスから、プリントヘッドのプリント素子の数
に対応する数のビットのグループをアクセスする、図示
されている実施例のプリンタによって達成される。この
ビットグループは、プリントヘッドのプリント素子を駆
動して画像をプリントするために用いられる。ラスタ走
査形プリントヘッドを有するプリンタにおいては、選択
されたビットグループは、ビットマッピングされたラス
タマトリックスから、プリントヘッドのラスタ走査と同
期してアクセスされる。
諸目的および諸利点は、プリントされるべき画像のビッ
トマッピングされたラスタマトリックスを発生し、この
マトリックスから、プリントヘッドのプリント素子の数
に対応する数のビットのグループをアクセスする、図示
されている実施例のプリンタによって達成される。この
ビットグループは、プリントヘッドのプリント素子を駆
動して画像をプリントするために用いられる。ラスタ走
査形プリントヘッドを有するプリンタにおいては、選択
されたビットグループは、ビットマッピングされたラス
タマトリックスから、プリントヘッドのラスタ走査と同
期してアクセスされる。
【０００６】例えば、図示されている実施例のプリンタ
のプリントヘッドは、単一垂直列内において垂直方向に
変位せしめられた３３プリント素子を有するラスタ走査
形プリントヘッドである。従って、このプリントヘッド
は、プリントヘッドのラスタ走査のそれぞれの通過中に
３３の隣接走査線をプリントしうる。プリンタのプリン
トエンジンが受入れうるフォーマットのプリントデータ
を形成するために、プリンタは、プリントされるべき画
像を画素の２次元ラスタマトリックスに変換する。図示
されている実施例においては、プリントヘッドのそれぞ
れのプリント素子はプリントワイヤまたはピンであり、
それは作動せしめられると、通常は紙であるプリント媒
体上にドットをプリントする。画素のラスタマトリック
スのそれぞれの画素は、画素データの値によって、プリ
ント媒体上のプリントされるべきドットまたはプリント
されざるべきドットに対応する。
のプリントヘッドは、単一垂直列内において垂直方向に
変位せしめられた３３プリント素子を有するラスタ走査
形プリントヘッドである。従って、このプリントヘッド
は、プリントヘッドのラスタ走査のそれぞれの通過中に
３３の隣接走査線をプリントしうる。プリンタのプリン
トエンジンが受入れうるフォーマットのプリントデータ
を形成するために、プリンタは、プリントされるべき画
像を画素の２次元ラスタマトリックスに変換する。図示
されている実施例においては、プリントヘッドのそれぞ
れのプリント素子はプリントワイヤまたはピンであり、
それは作動せしめられると、通常は紙であるプリント媒
体上にドットをプリントする。画素のラスタマトリック
スのそれぞれの画素は、画素データの値によって、プリ
ント媒体上のプリントされるべきドットまたはプリント
されざるべきドットに対応する。
【０００７】左から右へ走査し、またプリントされるべ
き画像の頂部から出発して、プリンタは、マトリックス
内の画素のそれぞれの列内の第１グループの３３画素
を、一時に１列アクセスし、これらの３３画素に対する
ビットデータを、それらの画素データの３３ビットに従
ってプリントヘッドのプリントワイヤが作動せしめられ
るように、適切なタイミングでプリントエンジンへ供給
する。プリントヘッドが走査を続ける時は、プリンタは
画素のラスタマトリックスの次列の第１グループの３３
画素をアクセスし、その画素データをプリントエンジン
へ供給する。このプロセスは、プリントヘッドが走査線
の終点に達するまで続けられる。この終点において、こ
こで「セグメント」と呼ぶ３３行の画素データが処理さ
れ終ったことになる。
き画像の頂部から出発して、プリンタは、マトリックス
内の画素のそれぞれの列内の第１グループの３３画素
を、一時に１列アクセスし、これらの３３画素に対する
ビットデータを、それらの画素データの３３ビットに従
ってプリントヘッドのプリントワイヤが作動せしめられ
るように、適切なタイミングでプリントエンジンへ供給
する。プリントヘッドが走査を続ける時は、プリンタは
画素のラスタマトリックスの次列の第１グループの３３
画素をアクセスし、その画素データをプリントエンジン
へ供給する。このプロセスは、プリントヘッドが走査線
の終点に達するまで続けられる。この終点において、こ
こで「セグメント」と呼ぶ３３行の画素データが処理さ
れ終ったことになる。
【０００８】図示されている実施例においては、プリン
トヘッドは、それぞれの走査線が完了する毎に、左から
右への運動と右から左への運動とを交互に行なう。すな
わち、第１走査線が走査され終った後には、プリント媒
体は前進せしめられることによって、次の走査線をプリ
ントヘッドの位置へ移動せしめ、プリントヘッドは次に
右から左への運動による走査を開始する。従って、プリ
ントヘッドが右から左への走査を開始する時は、プリン
タは、画素のラスタマトリックスの最後の列内の第２グ
ループの３３画素をアクセスする。第２グループの３３
画素は、それぞれの相次ぐ列から、ラスタマトリックス
の第１列に再び到達するまで、順次アクセスされる。こ
のプロセスは、画像全体がプリントされ終るまで、ラス
タマトリックスのそれぞれの後のセグメントに対して繰
返される。
トヘッドは、それぞれの走査線が完了する毎に、左から
右への運動と右から左への運動とを交互に行なう。すな
わち、第１走査線が走査され終った後には、プリント媒
体は前進せしめられることによって、次の走査線をプリ
ントヘッドの位置へ移動せしめ、プリントヘッドは次に
右から左への運動による走査を開始する。従って、プリ
ントヘッドが右から左への走査を開始する時は、プリン
タは、画素のラスタマトリックスの最後の列内の第２グ
ループの３３画素をアクセスする。第２グループの３３
画素は、それぞれの相次ぐ列から、ラスタマトリックス
の第１列に再び到達するまで、順次アクセスされる。こ
のプロセスは、画像全体がプリントされ終るまで、ラス
タマトリックスのそれぞれの後のセグメントに対して繰
返される。
【０００９】上述のアーキテクチャは、さまざまなプリ
ント素子配置を有する多くの異なった形式のプリントヘ
ッドに対し容易に適用されうることを認識すべきであ
る。すなわち、もしプリントヘッドが３３プリント素子
ではなく２２プリント素子を有する場合は、それぞれの
走査線セグメントが処理される時に、３３画素ではなく
２２画素から成るグループを順次アクセスするように、
プロシージャを容易に変更しうる。
ント素子配置を有する多くの異なった形式のプリントヘ
ッドに対し容易に適用されうることを認識すべきであ
る。すなわち、もしプリントヘッドが３３プリント素子
ではなく２２プリント素子を有する場合は、それぞれの
走査線セグメントが処理される時に、３３画素ではなく
２２画素から成るグループを順次アクセスするように、
プロシージャを容易に変更しうる。
【００１０】
【実施例】図１は、本発明の実施例のプリンタの概略図
である。全体が１０で示されているプリンタは、プリン
トされるべき画像のビットマッピングされたラスタマト
リックスを発生する、プリンタ用画像制御装置（ＩＰ
Ｍ）１２を含む。図２には、典型的なビットマッピング
されたラスタマトリックスのセグメントが示されてい
る。ラスタプリントヘッド制御装置（ＲＰＨＣ）１４
（図１）は、プリンタ用画像制御装置１２と、プリンタ
１０のプリントエンジン制御装置（ＰＥＣ）１６との間
のインタフェースをなす。ラスタプリントヘッド制御装
置１４は、プリンタ用画像制御装置１２から水平ラスタ
データの諸ワードを受取り、水平ラスタデータを、プリ
ントエンジン制御装置１６に対して適するフォーマット
の垂直データパターンに変換する。
である。全体が１０で示されているプリンタは、プリン
トされるべき画像のビットマッピングされたラスタマト
リックスを発生する、プリンタ用画像制御装置（ＩＰ
Ｍ）１２を含む。図２には、典型的なビットマッピング
されたラスタマトリックスのセグメントが示されてい
る。ラスタプリントヘッド制御装置（ＲＰＨＣ）１４
（図１）は、プリンタ用画像制御装置１２と、プリンタ
１０のプリントエンジン制御装置（ＰＥＣ）１６との間
のインタフェースをなす。ラスタプリントヘッド制御装
置１４は、プリンタ用画像制御装置１２から水平ラスタ
データの諸ワードを受取り、水平ラスタデータを、プリ
ントエンジン制御装置１６に対して適するフォーマット
の垂直データパターンに変換する。
【００１１】図示されている実施例においては、プリン
トエンジン制御装置１６によって制御されるプリントエ
ンジン１８は、図３に概略的に示されている３３ワイヤ
プリントヘッド２０を含む。プリントヘッド２０の３３
のプリントワイヤまたはピン１９は、単一垂直列をなし
て配置され、さまざまな様式でグループ化されうる。例
えば、ワイヤ１９は、プリントヘッド２０のそれぞれの
走査中に、プリントヘッドが文字の３つの行を同時にプ
リントしうるように３グループにグループ化されうる。
あるいは、全てのワイヤをグラフィクスのプリントのた
めにいっしょに使用することもできる。後に詳述される
ように、ラスタプリントヘッド制御装置１４は、プリン
タ用画像制御装置１２からの水平ラスタデータを変換す
る時、画素データを３３ビットの垂直グループに変換
し、それぞれのビットは、プリントヘッド２０の３３プ
リントワイヤの１つに対応する。
トエンジン制御装置１６によって制御されるプリントエ
ンジン１８は、図３に概略的に示されている３３ワイヤ
プリントヘッド２０を含む。プリントヘッド２０の３３
のプリントワイヤまたはピン１９は、単一垂直列をなし
て配置され、さまざまな様式でグループ化されうる。例
えば、ワイヤ１９は、プリントヘッド２０のそれぞれの
走査中に、プリントヘッドが文字の３つの行を同時にプ
リントしうるように３グループにグループ化されうる。
あるいは、全てのワイヤをグラフィクスのプリントのた
めにいっしょに使用することもできる。後に詳述される
ように、ラスタプリントヘッド制御装置１４は、プリン
タ用画像制御装置１２からの水平ラスタデータを変換す
る時、画素データを３３ビットの垂直グループに変換
し、それぞれのビットは、プリントヘッド２０の３３プ
リントワイヤの１つに対応する。
【００１２】図２には、プリンタ用画像制御装置１２に
より発生せしめられるビットマッピングされたラスタマ
トリックスのセグメントが示されている。図２のセグメ
ントは、プリントヘッド２０の１プリントヘッド走査線
に対する画素データを含む。すなわち、このマトリック
スセグメントは、３３行の画素ワードデータを有し、そ
れぞれの行は、プリントヘッド２０の１プリントワイヤ
のラスタ走査線に対応している。図示されている実施例
においては、それぞれの画素データワードは１６ビット
を有し、それぞれのビットは、プリントされるべき画像
の画素または「ドット」を表わす。データはラスタ形式
をなしており、画素を表わす諸ビットは水平に配置さ
れ、それぞれのワードの最上位ビット（ＭＳＢ）は、画
素ワードによって表わされる画像部分の最も左側の「ド
ット」に対応する。それぞれの画素またはドットは、図
示されている実施例においては単一ビットによって表わ
されるが、複数のビットをそれぞれの画素に関連せしめ
ることによって、関連の画素の、例えば強度、色、また
はその双方を表わしうるようにすることも期待されう
る。
より発生せしめられるビットマッピングされたラスタマ
トリックスのセグメントが示されている。図２のセグメ
ントは、プリントヘッド２０の１プリントヘッド走査線
に対する画素データを含む。すなわち、このマトリック
スセグメントは、３３行の画素ワードデータを有し、そ
れぞれの行は、プリントヘッド２０の１プリントワイヤ
のラスタ走査線に対応している。図示されている実施例
においては、それぞれの画素データワードは１６ビット
を有し、それぞれのビットは、プリントされるべき画像
の画素または「ドット」を表わす。データはラスタ形式
をなしており、画素を表わす諸ビットは水平に配置さ
れ、それぞれのワードの最上位ビット（ＭＳＢ）は、画
素ワードによって表わされる画像部分の最も左側の「ド
ット」に対応する。それぞれの画素またはドットは、図
示されている実施例においては単一ビットによって表わ
されるが、複数のビットをそれぞれの画素に関連せしめ
ることによって、関連の画素の、例えば強度、色、また
はその双方を表わしうるようにすることも期待されう
る。
【００１３】ラスタプリントヘッド制御装置１４は、プ
リンタ用画像制御装置１２から３３画素データワードの
垂直ブロックを受取って、それを順次１６グループの３
３垂直画素ビットに変換する。図４には、１つのそのよ
うな３３画素ビットの垂直グループが示されている。前
述のように、垂直グループのそれぞれのビットは、プリ
ントヘッド２０の１プリントワイヤに対応する。プリン
トヘッドの左から右への走査において、ブロック＃１
（図２）は、プリンタ用画像制御装置１２からラスタプ
リントヘッド制御装置１４へ送られるマトリックスセグ
メントの３３画素ワードの第１ブロックである。データ
はラスタ形式を有するので、ブロックの３３ワードのう
ちから送られる第１画素データワードは、ブロックの最
上部ワード（画素ワード＃１）であり、送られる第２ワ
ードは頂部からの画素ワードデータの第２ワード（ワー
ド＃２）であり、等となる。セグメントの残余ブロック
は、その後ラスタプリントヘッド制御装置１４へ、垂直
画素ビットグループへの変換のために、プリントヘッド
走査線の全ブロックが送られてしまうまで、順次送られ
る。プリントヘッドの右から左への走査においては、伝
送されるべき第１ブロックはブロック＃Ｚであり、第２
ブロックはそのすぐ左のブロック、すなわちブロック＃
Ｚ−１であり、等となる。
リンタ用画像制御装置１２から３３画素データワードの
垂直ブロックを受取って、それを順次１６グループの３
３垂直画素ビットに変換する。図４には、１つのそのよ
うな３３画素ビットの垂直グループが示されている。前
述のように、垂直グループのそれぞれのビットは、プリ
ントヘッド２０の１プリントワイヤに対応する。プリン
トヘッドの左から右への走査において、ブロック＃１
（図２）は、プリンタ用画像制御装置１２からラスタプ
リントヘッド制御装置１４へ送られるマトリックスセグ
メントの３３画素ワードの第１ブロックである。データ
はラスタ形式を有するので、ブロックの３３ワードのう
ちから送られる第１画素データワードは、ブロックの最
上部ワード（画素ワード＃１）であり、送られる第２ワ
ードは頂部からの画素ワードデータの第２ワード（ワー
ド＃２）であり、等となる。セグメントの残余ブロック
は、その後ラスタプリントヘッド制御装置１４へ、垂直
画素ビットグループへの変換のために、プリントヘッド
走査線の全ブロックが送られてしまうまで、順次送られ
る。プリントヘッドの右から左への走査においては、伝
送されるべき第１ブロックはブロック＃Ｚであり、第２
ブロックはそのすぐ左のブロック、すなわちブロック＃
Ｚ−１であり、等となる。
【００１４】図５には、ラスタプリントヘッド制御装置
１４の詳細な構造図が示されている。ラスタプリントヘ
ッド制御装置１４は、プリンタ用画像制御装置１２から
の画素データワードのブロックを記憶するための２つの
ランダムアクセスメモリ・バンクである、ＲＡＭバンク
ＡおよびＲＡＭバンクＢを有する。２対１マルチプレク
サ４０は、一方のＲＡＭバンクを選択して、３３画素デ
ータビットの垂直グループへの変換を行なうために画素
データワードをアンロードし、一方、他方のＲＡＭバン
クは、プリンタ用画像制御装置１２からの新しい画素デ
ータワードブロックをロードされる。
１４の詳細な構造図が示されている。ラスタプリントヘ
ッド制御装置１４は、プリンタ用画像制御装置１２から
の画素データワードのブロックを記憶するための２つの
ランダムアクセスメモリ・バンクである、ＲＡＭバンク
ＡおよびＲＡＭバンクＢを有する。２対１マルチプレク
サ４０は、一方のＲＡＭバンクを選択して、３３画素デ
ータビットの垂直グループへの変換を行なうために画素
データワードをアンロードし、一方、他方のＲＡＭバン
クは、プリンタ用画像制御装置１２からの新しい画素デ
ータワードブロックをロードされる。
【００１５】画素データワードは一時に１つ、選択され
たＲＡＭバンクから１６対１マルチプレクサ４２へ転送
され、マルチプレクサ４２は、その画素データワードか
ら１画素データビットを選択して、その選択された画素
データビットを、３３ビット・シフトレジスタ４４へ転
送する。左から右への走査においては、最上位ビットが
シフトレジスタ４４への転送のために選択される第１ビ
ットとなる。画素データワードブロックの次の画素デー
タワードが選択されたＲＡＭバンクからロードされた
後、１６対１マルチプレクサ４２は再び同じビット位
置、すなわちこの例においては最上位ビット、を選択し
てシフトレジスタ４４へ転送する。しかし、新しいビッ
トのローディングの前に、シフトレジスタ４４はまず内
部に蓄えられているデータを１ビット位置だけシフトせ
しめ、新しいビットのための場所を作る。従って、画素
データワードブロックの全体が選択されたＲＡＭバンク
からアンロードされ終った後には、シフトレジスタ４４
は、それぞれの画素データワードから１画素ビットずつ
取った、画素データの３３ビットを含むことになる。そ
れぞれの画素データビットは、画素データワードの同じ
ビット位置から選択されているので、シフトレジスタ４
４内に蓄えられた３３画素データビットは、図２に示さ
れているビットマッピングされた画素データ・ラスタマ
トリックスの画素データビットの垂直「スライス」また
はグループを構成する。３３ビット垂直グループの３３
ビットが全てシフトレジスタ４４内へロードされ終った
後には、それぞれの画素データビットは、３３個のピン
ラッチ４６の１つにラッチされ、それぞれのピンラッチ
は、プリントヘッド２０の３３プリントワイヤの１つに
対応している。ラッチ４６の出力は、タイマ回路４８の
出力と論理的に組合わされて、プリントエンジン制御装
置１６（図１）のプリントワイヤドライバを駆動する。
このプロセスは、画素データワードブロックからの画素
データの１６の列または垂直グループがプリントエンジ
ン１８によってプリントされてしまうまで続けられる。
たＲＡＭバンクから１６対１マルチプレクサ４２へ転送
され、マルチプレクサ４２は、その画素データワードか
ら１画素データビットを選択して、その選択された画素
データビットを、３３ビット・シフトレジスタ４４へ転
送する。左から右への走査においては、最上位ビットが
シフトレジスタ４４への転送のために選択される第１ビ
ットとなる。画素データワードブロックの次の画素デー
タワードが選択されたＲＡＭバンクからロードされた
後、１６対１マルチプレクサ４２は再び同じビット位
置、すなわちこの例においては最上位ビット、を選択し
てシフトレジスタ４４へ転送する。しかし、新しいビッ
トのローディングの前に、シフトレジスタ４４はまず内
部に蓄えられているデータを１ビット位置だけシフトせ
しめ、新しいビットのための場所を作る。従って、画素
データワードブロックの全体が選択されたＲＡＭバンク
からアンロードされ終った後には、シフトレジスタ４４
は、それぞれの画素データワードから１画素ビットずつ
取った、画素データの３３ビットを含むことになる。そ
れぞれの画素データビットは、画素データワードの同じ
ビット位置から選択されているので、シフトレジスタ４
４内に蓄えられた３３画素データビットは、図２に示さ
れているビットマッピングされた画素データ・ラスタマ
トリックスの画素データビットの垂直「スライス」また
はグループを構成する。３３ビット垂直グループの３３
ビットが全てシフトレジスタ４４内へロードされ終った
後には、それぞれの画素データビットは、３３個のピン
ラッチ４６の１つにラッチされ、それぞれのピンラッチ
は、プリントヘッド２０の３３プリントワイヤの１つに
対応している。ラッチ４６の出力は、タイマ回路４８の
出力と論理的に組合わされて、プリントエンジン制御装
置１６（図１）のプリントワイヤドライバを駆動する。
このプロセスは、画素データワードブロックからの画素
データの１６の列または垂直グループがプリントエンジ
ン１８によってプリントされてしまうまで続けられる。
【００１６】１６列の垂直画素データビットが出力され
終る時点までに、プリンタ用画像制御装置１２は、次の
画素データワードブロックを他方のＲＡＭバンクにロー
ドし終る。垂直画素データビットの最後の列がラッチさ
れてプリントエンジン制御装置へ送られ、他方のＲＡＭ
バンクがロードされ終った後、２対１マルチプレクサ４
０は、その正にロードされ終ったＲＡＭバンクへスイッ
チする。画素データワードが相次ぐ１６の垂直画素デー
タビット列に変換された後には、両ＲＡＭバンクは再び
スイッチしてプリントプロセスを継続する。
終る時点までに、プリンタ用画像制御装置１２は、次の
画素データワードブロックを他方のＲＡＭバンクにロー
ドし終る。垂直画素データビットの最後の列がラッチさ
れてプリントエンジン制御装置へ送られ、他方のＲＡＭ
バンクがロードされ終った後、２対１マルチプレクサ４
０は、その正にロードされ終ったＲＡＭバンクへスイッ
チする。画素データワードが相次ぐ１６の垂直画素デー
タビット列に変換された後には、両ＲＡＭバンクは再び
スイッチしてプリントプロセスを継続する。
【００１７】ラスタプリントヘッド制御装置１４はアド
レス制御論理装置５０を有し、プリンタ用画像制御装置
１２はそれによって、ラスタプリントヘッド制御装置内
のさまざまな位置をアクセスして選択的にデータを読取
り、または書込みうるようにされる。バッファ５２は、
データ転送機能を行なうために備えられている。
レス制御論理装置５０を有し、プリンタ用画像制御装置
１２はそれによって、ラスタプリントヘッド制御装置内
のさまざまな位置をアクセスして選択的にデータを読取
り、または書込みうるようにされる。バッファ５２は、
データ転送機能を行なうために備えられている。
【００１８】図６から図１６までには、ラスタプリント
ヘッド制御装置１４がさらに詳細に示されている。図６
から図１６までは、さまざまな集積回路の概略図を示
す。図示されている実施例のラスタプリントヘッド制御
装置は、１．２７ｍｍ（５０ミル）中心上の８４リード
ＪＥＤＥＣ規格プラスチックリード付チップキャリアパ
ッケージ内にパッケージされたＡＳＩＣとして製造され
る。デバイス１４は、下記の表１及び表２に示されてい
る入力および出力信号を有する。
ヘッド制御装置１４がさらに詳細に示されている。図６
から図１６までは、さまざまな集積回路の概略図を示
す。図示されている実施例のラスタプリントヘッド制御
装置は、１．２７ｍｍ（５０ミル）中心上の８４リード
ＪＥＤＥＣ規格プラスチックリード付チップキャリアパ
ッケージ内にパッケージされたＡＳＩＣとして製造され
る。デバイス１４は、下記の表１及び表２に示されてい
る入力および出力信号を有する。
【００１９】
【表１】
【表２】
【００２０】これらの信号の中には、プリンタ用画像制
御装置１２とラスタプリントヘッド制御装置１４との間
で、データ、指令、および状態情報の転送を行なうため
に用いられるＩＰＭデータバス１００の信号が含まれて
いる。図７に示されているように、ＩＰＭデータバス１
００は、全体が５２に示されている３状態バッファに結
合せしめられている。３状態バッファ５２の出力は、図
１２に示されたＲＡＭバンクＡおよびＢに結合せしめら
れている。プリンタ用画像制御装置１２からのそれぞれ
のブロックの画素データワードは、Ｉ ＤＡＴＡと記さ
れたデータバス上を転送されて、ＲＡＭバンクＡまたは
ＲＡＭバンクＢのいずれかの中の、図１０の１０２に全
体が示されているカウンタから発生せしめられる順次的
メモリアドレスＬＤ ＡＤＤＲに記憶される。いったん
選択されたＲＡＭバンクがプリンタ用画像制御装置１２
からの画素データワードブロックをロードされ終れば、
図１１の１０４に全体が示されている第２カウンタ回路
は、ロードされたＲＡＭバンク内の順次位置をアンロー
ドするために使用される順次的アドレスＵＮＬ ＡＤＤ
Ｒを発生して、画素データワードの垂直ブロックを、図
１３の４０に全体が示されている２対１マルチプレクサ
へ転送する。２対１マルチプレクサ４０の出力は、１６
対１マルチプレクサ４２の入力へ結合せしめられ、その
出力は、３３ビットシフトレジスタ４４の入力に結合せ
しめられている。前述のように、１６対１マルチプレク
サ４２は、２対１マルチプレクサ４０から供給された画
素データワードから１ビットを選択し、その選択された
ビットを、３３ビットシフトレジスタ４４へ転送し、レ
ジスタ４４は画素ビットを関連するプリントワイヤドラ
イバに対応する出力（Ｈ ＤＡＴＡ）へシフトする。
御装置１２とラスタプリントヘッド制御装置１４との間
で、データ、指令、および状態情報の転送を行なうため
に用いられるＩＰＭデータバス１００の信号が含まれて
いる。図７に示されているように、ＩＰＭデータバス１
００は、全体が５２に示されている３状態バッファに結
合せしめられている。３状態バッファ５２の出力は、図
１２に示されたＲＡＭバンクＡおよびＢに結合せしめら
れている。プリンタ用画像制御装置１２からのそれぞれ
のブロックの画素データワードは、Ｉ ＤＡＴＡと記さ
れたデータバス上を転送されて、ＲＡＭバンクＡまたは
ＲＡＭバンクＢのいずれかの中の、図１０の１０２に全
体が示されているカウンタから発生せしめられる順次的
メモリアドレスＬＤ ＡＤＤＲに記憶される。いったん
選択されたＲＡＭバンクがプリンタ用画像制御装置１２
からの画素データワードブロックをロードされ終れば、
図１１の１０４に全体が示されている第２カウンタ回路
は、ロードされたＲＡＭバンク内の順次位置をアンロー
ドするために使用される順次的アドレスＵＮＬ ＡＤＤ
Ｒを発生して、画素データワードの垂直ブロックを、図
１３の４０に全体が示されている２対１マルチプレクサ
へ転送する。２対１マルチプレクサ４０の出力は、１６
対１マルチプレクサ４２の入力へ結合せしめられ、その
出力は、３３ビットシフトレジスタ４４の入力に結合せ
しめられている。前述のように、１６対１マルチプレク
サ４２は、２対１マルチプレクサ４０から供給された画
素データワードから１ビットを選択し、その選択された
ビットを、３３ビットシフトレジスタ４４へ転送し、レ
ジスタ４４は画素ビットを関連するプリントワイヤドラ
イバに対応する出力（Ｈ ＤＡＴＡ）へシフトする。
【００２１】シフトレジスタ４４の３３Ｈ ＤＡＴＡ出
力のそれぞれは、関連のラッチ回路４６（図５）を有
し、ラッチ回路４６の例は、図１５のプリンタワイヤ
（１）に対する４６（１）に示されている。ラッチ回路
４６（１）は、４つのラッチ１０９を含み、それらのそ
れぞれの入力は、シフトレジスタ４４（図１３）の画素
データビット出力Ｈ ＤＡＴＡに結合せしめられてい
る。ラッチ回路４６（１）のそれぞれのラッチ１０９
は、クロック回路１１０からのクロックを受ける。４つ
のラッチ１０９のそれぞれの出力は、図１４の４つのタ
イマ回路ＡないしＤの１つの出力と、ゲート１１１によ
り論理的にＯＲ演算される。タイマ回路ＡないしＤは、
主として、行内の連続した水平画素位置においてプリン
トワイヤが２回作動せしめられることを防止するために
備えられたものである。ＡＮＤゲート１１２は、それぞ
れのＯＲゲート１１１の出力を結合せしめて、プリント
ワイヤ（１）に対するプリントエンジン制御装置１６へ
駆動信号を供給する。ラッチ回路４６（２）ないし４６
（５）は、図１６に示されているように、プリントワイ
ヤ（２）ないし（５）に対し実質的に同じものである。
残余のピンに対するラッチ回路も同じものであるので省
略されている。
力のそれぞれは、関連のラッチ回路４６（図５）を有
し、ラッチ回路４６の例は、図１５のプリンタワイヤ
（１）に対する４６（１）に示されている。ラッチ回路
４６（１）は、４つのラッチ１０９を含み、それらのそ
れぞれの入力は、シフトレジスタ４４（図１３）の画素
データビット出力Ｈ ＤＡＴＡに結合せしめられてい
る。ラッチ回路４６（１）のそれぞれのラッチ１０９
は、クロック回路１１０からのクロックを受ける。４つ
のラッチ１０９のそれぞれの出力は、図１４の４つのタ
イマ回路ＡないしＤの１つの出力と、ゲート１１１によ
り論理的にＯＲ演算される。タイマ回路ＡないしＤは、
主として、行内の連続した水平画素位置においてプリン
トワイヤが２回作動せしめられることを防止するために
備えられたものである。ＡＮＤゲート１１２は、それぞ
れのＯＲゲート１１１の出力を結合せしめて、プリント
ワイヤ（１）に対するプリントエンジン制御装置１６へ
駆動信号を供給する。ラッチ回路４６（２）ないし４６
（５）は、図１６に示されているように、プリントワイ
ヤ（２）ないし（５）に対し実質的に同じものである。
残余のピンに対するラッチ回路も同じものであるので省
略されている。
【００２２】ラスタプリントヘッド制御装置１４は、図
９の１２０に示されている２つの状態レジスタを有す
る。下記の表３に、これら２つの状態レジスタの内容を
示す。
９の１２０に示されている２つの状態レジスタを有す
る。下記の表３に、これら２つの状態レジスタの内容を
示す。
【００２３】
【表３】
【００２４】表３内に示されているように、これらの状
態レジスタは、プリンタ用画像制御装置１２が、画素デ
ータワードがＲＡＭバンク内へロードされるロードアド
レスを監視し、また画素データワードが垂直画素データ
ビットグループへの変換のために読取られるＲＡＭバン
クアドレスをも監視しうるようにする。もしエラーが生
じれば、制御装置１２は、状態Ｂレジスタをアクセスし
て、エラーコードのエラー（３）−（１）を読取りう
る。さらに、プリンタ用画像制御装置によりワイヤオン
タイム値が状態レジスタ内へロードされて、タイマ回路
ＡないしＤを制御しうる。図示されている実施例におい
ては、ラスタプリントヘッド制御装置１４のシステムク
ロックと比較したとき、プリントエンジン制御装置から
のピン起動パルス（ＰＥＣ Ｄ ＲＥＱ）の非同期性に
より、起動パルス持続時間（ＦＰＤ）は、１６／クロッ
ク周波数の分解能と、８／クロック周波数のエラーとを
有する。ワイヤオンタイム値は、次式の結果に最も近い
整数をとることによって決定される。
態レジスタは、プリンタ用画像制御装置１２が、画素デ
ータワードがＲＡＭバンク内へロードされるロードアド
レスを監視し、また画素データワードが垂直画素データ
ビットグループへの変換のために読取られるＲＡＭバン
クアドレスをも監視しうるようにする。もしエラーが生
じれば、制御装置１２は、状態Ｂレジスタをアクセスし
て、エラーコードのエラー（３）−（１）を読取りう
る。さらに、プリンタ用画像制御装置によりワイヤオン
タイム値が状態レジスタ内へロードされて、タイマ回路
ＡないしＤを制御しうる。図示されている実施例におい
ては、ラスタプリントヘッド制御装置１４のシステムク
ロックと比較したとき、プリントエンジン制御装置から
のピン起動パルス（ＰＥＣ Ｄ ＲＥＱ）の非同期性に
より、起動パルス持続時間（ＦＰＤ）は、１６／クロッ
ク周波数の分解能と、８／クロック周波数のエラーとを
有する。ワイヤオンタイム値は、次式の結果に最も近い
整数をとることによって決定される。
【００２５】
【数１】 ただし、ＦＰＤはｓｅｃを単位とし、クロック周波数は
Ｈｚを単位としている。
Ｈｚを単位としている。
【００２６】図８には、アドレスデコーダ論理装置５０
が詳細に示されている。このデコーダ論理装置は、いく
つかの入力／出力機能のためにアドレス信号をデコード
する。機能ＤＩＳＡＢＬＥ ＲＰＨＣに対応するアドレ
ス（相対アドレス０）が書込みを受けた時は、ラスタプ
リントヘッド制御装置１４は使用禁止モードに置かれ
る。プリントエンジン制御装置１６によるアクセスは完
全に使用禁止され、プリンタ用画像制御装置１２による
アクセスは、ワイヤオンタイマレジスタへの書込みと、
２つの状態バイトの読取りとに限定される。ＥＮＡＢＬ
Ｅ ＲＰＨＣ機能に対応するアドレス（相対アドレス
１）が書込みを受けた時は、ラスタプリントヘッド制御
装置１４は使用可能モードに置かれる。プリンタ用画像
制御装置１２は、全ての妥当位置への読取りおよび書込
みアクセスを行ないうる。ＳＴＡＴＵＳ Ａ−ＲＥＡＤ
機能に対応するアドレス（相対アドレス２）からの読取
りは、現在状態ワードをデータバス上へ出力する。ＷＩ
ＲＥ ＯＮ−ＴＩＭＥＲ／ＳＴＡＴＵＳ Ｂ読取り／書
込み出力に対応するアドレス位置（相対アドレス３）か
らの読取りは、現在の状態Ｂワードをデータバス上へ出
力する。この位置への書込みは、データバスの下位バイ
トをワイヤオンタイマレジスタ内へ書込む。ＲＡＭ Ｄ
ＡＴＡ読取り／書込み位置に対応するアドレス（相対ア
ドレス４）のアドレッシングは、信号Ｉ ＲＤ ＷＴ*
（表１）の状態により、現在選択されているＲＡＭの現
在の位置にデータを書込むか、または現在選択されてい
るＲＡＭからデータを読取る。
が詳細に示されている。このデコーダ論理装置は、いく
つかの入力／出力機能のためにアドレス信号をデコード
する。機能ＤＩＳＡＢＬＥ ＲＰＨＣに対応するアドレ
ス（相対アドレス０）が書込みを受けた時は、ラスタプ
リントヘッド制御装置１４は使用禁止モードに置かれ
る。プリントエンジン制御装置１６によるアクセスは完
全に使用禁止され、プリンタ用画像制御装置１２による
アクセスは、ワイヤオンタイマレジスタへの書込みと、
２つの状態バイトの読取りとに限定される。ＥＮＡＢＬ
Ｅ ＲＰＨＣ機能に対応するアドレス（相対アドレス
１）が書込みを受けた時は、ラスタプリントヘッド制御
装置１４は使用可能モードに置かれる。プリンタ用画像
制御装置１２は、全ての妥当位置への読取りおよび書込
みアクセスを行ないうる。ＳＴＡＴＵＳ Ａ−ＲＥＡＤ
機能に対応するアドレス（相対アドレス２）からの読取
りは、現在状態ワードをデータバス上へ出力する。ＷＩ
ＲＥ ＯＮ−ＴＩＭＥＲ／ＳＴＡＴＵＳ Ｂ読取り／書
込み出力に対応するアドレス位置（相対アドレス３）か
らの読取りは、現在の状態Ｂワードをデータバス上へ出
力する。この位置への書込みは、データバスの下位バイ
トをワイヤオンタイマレジスタ内へ書込む。ＲＡＭ Ｄ
ＡＴＡ読取り／書込み位置に対応するアドレス（相対ア
ドレス４）のアドレッシングは、信号Ｉ ＲＤ ＷＴ*
（表１）の状態により、現在選択されているＲＡＭの現
在の位置にデータを書込むか、または現在選択されてい
るＲＡＭからデータを読取る。
【００２７】機能ＳＷＩＴＣＨ ＲＡＭに対応する位置
にアドレス（相対アドレス５）が書込まれるか、または
それからアドレス（相対アドレス５）が読取られた時
は、データを受取るようにセットアップされたＲＡＭ
は、そのデータを出力するようにスイッチされる。ＡＤ
ＤＲＥＳＳ ＲＥＳＥＴ に対応する位置（相対アドレ
ス６）のアドレッシングは、ロードアドレスおよびアン
ロードアドレスの双方をゼロにリセットするので、次の
読取りおよび書込み動作は最初のＲＡＭアドレスから開
始されることになる。最後に、ＥＲＲＯＲ ＲＥＳＥＴ
に対応する位置（相対アドレス７）のアドレッシング
は、エラービットをリセットする。デコード回路５０は
さらに、１３０に示されている他のデコード回路を含
み、このデコード回路は、さらに特別な入力／出力機
能：ＳＴＡＴＵＳ ＲＥＡＤ* 、ＳＷＩＴＣＨ ＲＡＭ
* 、ＡＤＤＲ ＲＥＳＥＴ* 、ＥＲＲＯＲ ＲＥＳＥＴ
* 、ＲＥＡＤ ＲＡＭ* 、ＷＯＴ ＲＥＡＤ* 、ＷＲＩ
ＴＥ ＲＡＭ* 、ＷＯＴ ＷＲＩＴＥ* 、ＷＲＩＴＥ
ＲＡＭ ＬＯＮＧ* 、ＥＮＡＢＬＥ ＩＯ* 、およびＤ
ＩＲを定める。
にアドレス（相対アドレス５）が書込まれるか、または
それからアドレス（相対アドレス５）が読取られた時
は、データを受取るようにセットアップされたＲＡＭ
は、そのデータを出力するようにスイッチされる。ＡＤ
ＤＲＥＳＳ ＲＥＳＥＴ に対応する位置（相対アドレ
ス６）のアドレッシングは、ロードアドレスおよびアン
ロードアドレスの双方をゼロにリセットするので、次の
読取りおよび書込み動作は最初のＲＡＭアドレスから開
始されることになる。最後に、ＥＲＲＯＲ ＲＥＳＥＴ
に対応する位置（相対アドレス７）のアドレッシング
は、エラービットをリセットする。デコード回路５０は
さらに、１３０に示されている他のデコード回路を含
み、このデコード回路は、さらに特別な入力／出力機
能：ＳＴＡＴＵＳ ＲＥＡＤ* 、ＳＷＩＴＣＨ ＲＡＭ
* 、ＡＤＤＲ ＲＥＳＥＴ* 、ＥＲＲＯＲ ＲＥＳＥＴ
* 、ＲＥＡＤ ＲＡＭ* 、ＷＯＴ ＲＥＡＤ* 、ＷＲＩ
ＴＥ ＲＡＭ* 、ＷＯＴ ＷＲＩＴＥ* 、ＷＲＩＴＥ
ＲＡＭ ＬＯＮＧ* 、ＥＮＡＢＬＥ ＩＯ* 、およびＤ
ＩＲを定める。
【００２８】動作 最初に電力がラスタプリントヘッド制御装置１４に印加
されると、プリンタ用画像制御装置１２内にＩＰＭ Ｒ
ＥＳＥＴ* 信号（表１、図７）が発生し、ラスタプリン
トヘッド制御装置１４は、リセットドライバ２００によ
り使用禁止状態にされる。この時点における妥当なアク
セスは、２つの状態レジスタを読取ることと、ワイヤオ
ンタイマ（ＷＯＴ）値を状態Ｂレジスタ内に書込むこと
と、ラスタプリントヘッド制御装置１４を使用可能モー
ドにするためにＥＮＡＢＬＥ ＲＰＨＣアドレス（相対
アドレス１）に書込むことと、のみである。他の全ての
レジスタ、タイマ、およびカウンタは、リセット状態に
保持される。
されると、プリンタ用画像制御装置１２内にＩＰＭ Ｒ
ＥＳＥＴ* 信号（表１、図７）が発生し、ラスタプリン
トヘッド制御装置１４は、リセットドライバ２００によ
り使用禁止状態にされる。この時点における妥当なアク
セスは、２つの状態レジスタを読取ることと、ワイヤオ
ンタイマ（ＷＯＴ）値を状態Ｂレジスタ内に書込むこと
と、ラスタプリントヘッド制御装置１４を使用可能モー
ドにするためにＥＮＡＢＬＥ ＲＰＨＣアドレス（相対
アドレス１）に書込むことと、のみである。他の全ての
レジスタ、タイマ、およびカウンタは、リセット状態に
保持される。
【００２９】ラスタプリントヘッド制御装置１４が使用
可能にされると、２つのＲＡＭバンクの第１のもの（例
えばＲＡＭバンクＡ）は、第１ブロックの３３画素デー
タワードを受取る準備を完了する。従って、ラスタプリ
ントヘッド制御装置１４は、論理回路２１０からプリン
タ用画像制御装置１２へＢＵＦ ＥＭＰＴＹ* 信号（表
２、図１０）を出し、その後制御装置１２がデータを送
るのを待つ。
可能にされると、２つのＲＡＭバンクの第１のもの（例
えばＲＡＭバンクＡ）は、第１ブロックの３３画素デー
タワードを受取る準備を完了する。従って、ラスタプリ
ントヘッド制御装置１４は、論理回路２１０からプリン
タ用画像制御装置１２へＢＵＦ ＥＭＰＴＹ* 信号（表
２、図１０）を出し、その後制御装置１２がデータを送
るのを待つ。
【００３０】第１画素データワードが受取られると、バ
ッファ空信号ＢＵＦ ＥＭＰＴＹ*はインアクティブに
なる。全３３画素データワード（すなわち垂直ブロック
の全体）がラスタプリントヘッド制御装置１４へ送られ
た後には、内部フラッグがセットされ、論理回路２１２
からのＲＰＨＣ ＲＤＹ信号（表１、図８）はアクティ
ブになる。このフラッグがセットされた後に、もし３４
番目のワードが送られれば、論理回路２１４のＥＲＲＯ
Ｒ* 信号（表２、図１０）は、ＥＲＲＯＲ ＲＥＳＥＴ
（図８）指令が制御装置１２から受取られるまでアクテ
ィブになる。ラスタプリントヘッド制御装置１４は、プ
リントエンジン制御装置１６がラスタプリントヘッド制
御装置１４へ起動パルスＰＥＣ Ｄ ＲＥＱ（表１、図
７）を出すまで、この状態に留まる。プリント走査の最
初の起動パルスが受取られた時は、ワイヤドライバは１
つもアクティブ状態にはない。起動パルスの受取りによ
り、まさにロードされたばかりのＲＡＭバンク（例えば
ＲＡＭバンクＡ）はスイッチされることによってアンロ
ードされうるようになり、また他方のＲＡＭバンク（例
えばＲＡＭバンクＢ）はＢＵＦ ＥＭＰＴＹ* 信号の有
効化によってロードされうるようになる。
ッファ空信号ＢＵＦ ＥＭＰＴＹ*はインアクティブに
なる。全３３画素データワード（すなわち垂直ブロック
の全体）がラスタプリントヘッド制御装置１４へ送られ
た後には、内部フラッグがセットされ、論理回路２１２
からのＲＰＨＣ ＲＤＹ信号（表１、図８）はアクティ
ブになる。このフラッグがセットされた後に、もし３４
番目のワードが送られれば、論理回路２１４のＥＲＲＯ
Ｒ* 信号（表２、図１０）は、ＥＲＲＯＲ ＲＥＳＥＴ
（図８）指令が制御装置１２から受取られるまでアクテ
ィブになる。ラスタプリントヘッド制御装置１４は、プ
リントエンジン制御装置１６がラスタプリントヘッド制
御装置１４へ起動パルスＰＥＣ Ｄ ＲＥＱ（表１、図
７）を出すまで、この状態に留まる。プリント走査の最
初の起動パルスが受取られた時は、ワイヤドライバは１
つもアクティブ状態にはない。起動パルスの受取りによ
り、まさにロードされたばかりのＲＡＭバンク（例えば
ＲＡＭバンクＡ）はスイッチされることによってアンロ
ードされうるようになり、また他方のＲＡＭバンク（例
えばＲＡＭバンクＢ）はＢＵＦ ＥＭＰＴＹ* 信号の有
効化によってロードされうるようになる。
【００３１】前述のように、ＲＡＭバンクから現在アン
ロードされつつあるそれぞれの画素データワードの１ビ
ットは、次にシフトレジスタ４４（図１３）によって関
連するプリントワイヤの対応ラッチ４６（図１５、図１
６）へシフトされる。左から右への走査においては、ブ
ロックのそれぞれの画素データワードの最上位ビット
（ＭＳＢ）が最初に選択される。しかし、もしプリンタ
用画像制御装置１２からのＤＩＲＥＣＴＩＯＮ信号（表
１、図７）により指示されて、プリントヘッドが右から
左へ走査する場合は、それぞれのワードの最上位ビット
ではなく、最下位ビット（ＬＳＢ）が最初にラッチ４６
へシフトされる。
ロードされつつあるそれぞれの画素データワードの１ビ
ットは、次にシフトレジスタ４４（図１３）によって関
連するプリントワイヤの対応ラッチ４６（図１５、図１
６）へシフトされる。左から右への走査においては、ブ
ロックのそれぞれの画素データワードの最上位ビット
（ＭＳＢ）が最初に選択される。しかし、もしプリンタ
用画像制御装置１２からのＤＩＲＥＣＴＩＯＮ信号（表
１、図７）により指示されて、プリントヘッドが右から
左へ走査する場合は、それぞれのワードの最上位ビット
ではなく、最下位ビット（ＬＳＢ）が最初にラッチ４６
へシフトされる。
【００３２】次の起動パルスが受取られると、ラッチへ
シフトされたばかりのデータは、所定の場所にラッチさ
れ、タイマＡないしＤの第１タイマは、ワイヤオンタイ
ムレジスタからの値をロードされて始動せしめられる。
ラッチ４６の出力は、タイマとＯＲ演算されて、それら
はいっしょにピンドライバを駆動する。この第２起動パ
ルスはまた、ラッチの次の入力側への次のビットのシフ
ティングを開始せしめ、それらのラッチの内容は、次の
起動パルスによって出力せしめられる。このプロセス
は、３３画素データワードの垂直ブロック内に含まれる
１６列または１６グループのデータの全てがプリントさ
れてしまうまで続けられる。
シフトされたばかりのデータは、所定の場所にラッチさ
れ、タイマＡないしＤの第１タイマは、ワイヤオンタイ
ムレジスタからの値をロードされて始動せしめられる。
ラッチ４６の出力は、タイマとＯＲ演算されて、それら
はいっしょにピンドライバを駆動する。この第２起動パ
ルスはまた、ラッチの次の入力側への次のビットのシフ
ティングを開始せしめ、それらのラッチの内容は、次の
起動パルスによって出力せしめられる。このプロセス
は、３３画素データワードの垂直ブロック内に含まれる
１６列または１６グループのデータの全てがプリントさ
れてしまうまで続けられる。
【００３３】１６列の画素データビットが出力されてし
まう時までに、プリンタ用画像制御装置１２は、次の垂
直ブロックの画素データワードを利用可能なＲＡＭバン
ク内へロードし終る。画素データビットの最後の行がシ
フトアウトされ、かつ他方のＲＡＭがロードされ終った
時、両ＲＡＭバンクはスイッチされる。このプロセス
は、起動パルスがもう受取られなくなるまで続けられ
る。最後のデータブロックを現在アンロードしているバ
ッファは、完全に空になるかもしれず、あるいはならな
いかもしれない。制御装置１２は、全てのピンドライバ
がインアクティブになるまで待つ。この状態は、ワイヤ
オンタイマ値から計算されうる。制御装置１２は次に、
ラスタプリントヘッド制御装置１４をインアクティブモ
ードにして、デバイスを既知状態にする。
まう時までに、プリンタ用画像制御装置１２は、次の垂
直ブロックの画素データワードを利用可能なＲＡＭバン
ク内へロードし終る。画素データビットの最後の行がシ
フトアウトされ、かつ他方のＲＡＭがロードされ終った
時、両ＲＡＭバンクはスイッチされる。このプロセス
は、起動パルスがもう受取られなくなるまで続けられ
る。最後のデータブロックを現在アンロードしているバ
ッファは、完全に空になるかもしれず、あるいはならな
いかもしれない。制御装置１２は、全てのピンドライバ
がインアクティブになるまで待つ。この状態は、ワイヤ
オンタイマ値から計算されうる。制御装置１２は次に、
ラスタプリントヘッド制御装置１４をインアクティブモ
ードにして、デバイスを既知状態にする。
【００３４】以上の説明からわかるように、ラスタプリ
ントヘッド制御装置は、インクジェットプリントヘッド
を含むさまざまなプリントヘッドを有するさまざまに異
なったプリントエンジンに対し、容易に適応できる。例
えば、もしプリントヘッドのプリント素子の数が３３と
異なる場合は、それぞれの垂直ブロック内においてアク
セスされる画素データワードの数をそれに応じて変化せ
しめ、それによってラスタプリントヘッド制御装置が、
プリントヘッドのプリント素子の数に対応した画素デー
タビット行を与えるようにする。さらに、ラスタプリン
トヘッド制御装置は、水平方向にもやや変位せしめられ
た、すなわち傾けられた、垂直に変位せしめられたプリ
ント素子を有するプリントヘッドに対しても適応でき
る。
ントヘッド制御装置は、インクジェットプリントヘッド
を含むさまざまなプリントヘッドを有するさまざまに異
なったプリントエンジンに対し、容易に適応できる。例
えば、もしプリントヘッドのプリント素子の数が３３と
異なる場合は、それぞれの垂直ブロック内においてアク
セスされる画素データワードの数をそれに応じて変化せ
しめ、それによってラスタプリントヘッド制御装置が、
プリントヘッドのプリント素子の数に対応した画素デー
タビット行を与えるようにする。さらに、ラスタプリン
トヘッド制御装置は、水平方向にもやや変位せしめられ
た、すなわち傾けられた、垂直に変位せしめられたプリ
ント素子を有するプリントヘッドに対しても適応でき
る。
【００３５】もちろん、本発明のさまざまな面における
その他の改変は、本技術分野に習熟した者にとって明ら
かであるはずであり、そのあるものは研究の後において
のみ明らかになり、また他のものはありふれた電子的お
よび機械的設計に関するものであることを理解すべでき
ある。特定の応用に伴う特別の設計を有する他の実施例
もまた可能である。従って、本発明の範囲は、ここに説
明された特定の実施例により限定されるべきものではな
く、添付の特許請求の範囲およびそれと同等のものによ
ってのみ限定されるべきものである。
その他の改変は、本技術分野に習熟した者にとって明ら
かであるはずであり、そのあるものは研究の後において
のみ明らかになり、また他のものはありふれた電子的お
よび機械的設計に関するものであることを理解すべでき
ある。特定の応用に伴う特別の設計を有する他の実施例
もまた可能である。従って、本発明の範囲は、ここに説
明された特定の実施例により限定されるべきものではな
く、添付の特許請求の範囲およびそれと同等のものによ
ってのみ限定されるべきものである。
【図１】本発明の実施例によるプリンタの概略ブロック
図。
図。
【図２】プリントされるべき画像のビットマッピングさ
れたラスタマトリックスのセグメントの概略図。
れたラスタマトリックスのセグメントの概略図。
【図３】プリントワイヤプリントヘッドの概略図。
【図４】画素データビットの垂直グループの概略図。
【図５】図１のラスタプリントヘッド制御装置の概略ブ
ロック図。
ロック図。
【図６】図５のラスタプリントヘッド制御装置の詳細な
構造図。
構造図。
【図７】図５のラスタプリントヘッド制御装置の詳細な
構造図。
構造図。
【図８】図５のラスタプリントヘッド制御装置の詳細な
構造図。
構造図。
【図９】図５のラスタプリントヘッド制御装置の詳細な
構造図。
構造図。
【図１０】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１１】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１２】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１３】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１４】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１５】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
【図１６】図５のラスタプリントヘッド制御装置の詳細
な構造図。
な構造図。
１０ プリンタ １２ プリンタ用画像制御装置 １４ ラスタプリントヘッド制御装置 １９ プリントワイヤ ２０ ３３ワイヤプリントヘッド ４０ ２対１マルチプレクサ ４２ １６対１マルチプレクサ ４４ ３３ビットシフトレジスタ ４６ ピンラッチ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ワーナー エヌ．エム．アイ．ローウェン サル アメリカ合衆国カリフォルニア州ノース ハリィウッド，バンノールド アベニュー 4435 (72)発明者 スタン ディー．シュリィガイロ アメリカ合衆国カリフォルニア州エル セ グンド，ナンバー10，インディアナ コー ト 716
Claims (23)
- 【請求項１】 プリントヘッドがプリント媒体を横切っ
て複数の実質的に水平な通過を行なうのに伴い該プリン
ト媒体上に画像をプリントする該プリントヘッドを有す
るプリンタにおいて、該プリントヘッドが複数のプリン
ト素子であってそれぞれが隣接するプリント素子に対し
垂直に変位せしめられている該複数のプリント素子を含
み、 （ａ）プリントされるべき画像のビットマッピングされ
たラスタマトリックスを発生しかつ記憶するための第１
手段と、 （ｂ）該ビットマッピングされたラスタマトリックスか
ら前記プリントヘッドの前記プリント素子の数に対応す
る数のビットのグループをアクセスすることにより該プ
リントヘッドの該プリント素子を駆動して前記画像をプ
リントするための第２手段と、を備えていることを特徴
とするプリンタ。 - 【請求項２】 （ａ）前記プリントヘッドがｐ個のプリ
ント素子を有し、前記プリント媒体上をｎ回通過するこ
とによって前記画像をプリントするようになっており、 （ｂ）前記第１手段が前記ビットマッピングされたラス
タマトリックスの諸ビットを記憶するためのマトリック
スメモリ手段を含み、該マトリックスメモリのそれぞれ
の列が前記プリントヘッドのｎ回の通過に対応する少な
くともｎ個の隣接グループに論理的に分割され、それぞ
れの該グループが前記ｐ個のプリント素子に対応するｐ
個の連続ビットを含んでおり、 （ｃ）前記プリントヘッドのそれぞれの通過のために、
前記第２手段が該通過に対応するそれぞれの前記列内の
前記グループを順次アクセスし、該グループの諸ビット
を対応する前記プリント素子に印加するようになってい
る、請求項１記載のプリンタ。 - 【請求項３】 プリント媒体上に画像をプリントするた
めのプリンタにおいて、 （ａ）ｎ個のプリント素子のそれぞれが隣接するプリン
ト素子に対し垂直に変位せしめられている該ｎ個のプリ
ント素子を含むプリントヘッドと、 （ｂ）プリントされるべき画像のビットマッピングされ
たラスタマトリックスを記憶するための第１メモリ手段
であって、該メモリ手段が複数のメモリ領域を含み、そ
れぞれの該領域が前記ｎ個のプリント素子に対応する少
なくともｎ行と複数の列とを含み、それぞれの該列が前
記ｎ個のプリント素子に対応するｎワードを含み、それ
ぞれの該ワードがｍビットを含み、前記第１メモリ手段
と、 （ｃ）前記ｎ個のプリント素子に対応するｎ行と、１ワ
ードの前記ｍビットに対応するｍ個の１ビット列とを含
む第２メモリと、 （ｄ）１ワードの前記ｍビットに対応するｍ個の１ビッ
トセルを含む第３メモリと、 （ｅ）前記ビットマッピングされたラスタマトリックス
から前記プリントヘッドの前記プリント素子の数に対応
する数のビットのグループをアクセスすることにより該
プリントヘッドの該プリント素子を駆動して前記画像を
プリントするための制御手段と、を含むプリンタ。 - 【請求項４】 前記制御手段が、前記第１メモリ手段の
それぞれの部分に対し該部分の位置に応じて、 （ａ）前記メモリ領域のそれぞれの列から列位置に従っ
て前記第２メモリ内の対応位置へ前記ワードを順次転送
し、 （ｂ）（ａ）において転送されたそれぞれのワード列に
ついて、前記第２メモリのそれぞれの列から列位置に従
って前記第３メモリ内の対応セルへビットを順次転送
し、 （ｃ）（ｂ）において転送されたそれぞれのビット列に
ついて、前記第３メモリからビットを、対応する前記プ
リント素子へ供給するための手段を含む、請求項３記載
のプリンタ。 - 【請求項５】 プリント媒体上に画像をプリントするた
めのプリンタにおいて、該プリンタが該プリント媒体を
横切って実質的に横方向に第１方向および第２方向へ交
互に運動するプリントヘッドを含み、該プリントヘッド
が前記プリント媒体を横切って運動するのに伴って該プ
リント媒体のｊ本の連続する走査線上にプリントするｊ
個のプリント素子の実質的に垂直なアレイを前記プリン
トヘッドが有し、 （ａ）前記画像をｒ行およびｃ列の画素（ドット）を有
する画素の２次元ラスタマトリックスに変換するための
変換手段と、 （ｂ）前記ｒ行およびｃ列の画素マトリックスを記憶す
るためののマトリックス記憶手段と、 （ｃ）該マトリックス記憶手段内の第１画素列の最初の
ｊ画素をアクセスし、それらを印加することにより前記
プリントヘッドが前記プリント媒体を横切って前記第１
方向へ運動する時に該プリントヘッドの前記ｊ個のプリ
ント素子を駆動し、かつこのプロセスを前記マトリック
ス記憶手段内のそれぞれの列に対して繰返すための制御
手段と、を備えていることを特徴とするプリンタ。 - 【請求項６】 前記制御手段が、前記マトリックス記憶
手段内の最後の画素列の第２のｊ画素をアクセスし、そ
れらを印加することにより前記プリントヘッドが前記プ
リント媒体を横切って前記第２方向へ運動する時に該プ
リントヘッドの前記ｊ個のプリント素子を駆動し、かつ
このプロセスを前記マトリックス記憶手段内のそれぞれ
の列に対して繰返すための手段を含む、請求項５記載の
プリンタ。 - 【請求項７】 前記制御手段が、前記マトリックス記憶
手段内の第１画素列の第３のｊ画素をアクセスし、それ
らを印加することにより前記プリントヘッドが前記プリ
ント媒体を横切って前記第１方向へ運動する時に該プリ
ントヘッドの前記ｊ個のプリント素子を駆動し、かつこ
のプロセスを前記マトリックス記憶手段内のそれぞれの
列に対して繰返すための手段を含む、請求項５記載のプ
リンタ。 - 【請求項８】 プリント媒体上に画像をプリントするた
めのプリンタにおいて、該プリンタが該プリント媒体を
横切る連続的通過中にｊ本の隣接走査線をプリントする
プリントヘッドを含み、該プリントヘッドが該プリント
ヘッドの通過中に該ｊ本の隣接走査線をプリントするｊ
個のプリント素子の実質的に垂直なアレイを有し、 （ａ）前記画像をｒ行およびｃ列の画素（ドット）を有
する画素の２次元ラスタマトリックスに変換するための
変換手段および該ｒ行およびｃ列の画素マトリックスを
記憶するためのマトリックス記憶手段と、 （ｂ）該マトリックス記憶手段内のそれぞれの画素列内
の最初のｊ画素を順次アクセスし、それらを印加するこ
とにより前記プリントヘッドが前記プリント媒体を横切
って最初の通過を行なう時に該プリントヘッドの前記ｊ
個のプリント素子を駆動し、かつこのプロセスを前記マ
トリックス記憶手段内のそれぞれの列に対して繰返すた
めの制御手段と、を備えていることを特徴とするプリン
タ。 - 【請求項９】 前記制御手段が、前記マトリックス記憶
手段内のそれぞれの画素列中のｊ画素を、最後の列から
始めて第１行で終るようにアクセスし、それらを印加す
ることにより前記プリントヘッドが前記プリント媒体を
横切って第２通過を行なう時に該プリントヘッドの前記
ｊ個のプリント素子を駆動し、かつこのプロセスを前記
マトリックス記憶手段内のそれぞれの列に対して繰返す
ための手段を含む、請求項８記載のプリンタ。 - 【請求項１０】 １からｎまでにより表わされるｎ個の
プリント素子の垂直アレイまたは垂直から傾けられたア
レイを含むプリントヘッドを有するプリンタにおいて、 （ａ）プリントされるべき少なくとも１つの文字行のビ
ットマッピングされたラスタマトリックスを記憶するた
めの第１メモリであって、該メモリが、（１）前記ｎ個
のプリント素子に対応するｎ行と、（２）それぞれの列
が該ｎ個のプリント素子に対応するｎワードを含み、そ
れぞれの該ワードがｍビットを含む、複数の該列と、を
含む少なくとも１つのセグメントを含む前記第１メモリ
と、 （ｂ）（１）前記ｎ個のプリント素子に対応するｎ行
と、（２）１ワードの前記ｍビットに対応するｍ個の１
ビット列と、を含む第２メモリと、 （ｃ）１ワードの前記ｍビットに対応するｍ個の１ビッ
トセルを含む第３メモリと、 （ｄ）（１）前記第１メモリのそれぞれの列から、前記
プリントヘッドの走査方向によって決定される通りに該
第１メモリ内の第１列から始めその後は列位置に従っ
て、前記ワードを前記第２メモリ内の対応位置へ順次転
送し、（２）（１）において転送された諸ワードのそれ
ぞれの列について、前記第２メモリのそれぞれの列か
ら、前記プリントヘッドの走査方向によって決定される
通りに該第２メモリ内の第１列から始めその後は列位置
に従って、前記ビットを前記第３メモリ内の対応セルへ
転送し、（３）（２）において転送された諸ビットのそ
れぞれの列について、前記第３メモリから該ビットを対
応プリント素子へ供給するための制御手段と、を含むこ
とを特徴とするプリンタ。 - 【請求項１１】 （ａ）前記第１メモリ手段が複数のセ
グメントを含み、１つの該セグメントがプリントされる
べきそれぞれの文字行に対応しており、 （ｂ）前記制御手段が前記セグメントの位置に従ってそ
れぞれの該セグメントに対して順次動作を行なう、請求
項１０記載のプリンタ。 - 【請求項１２】 ｎ個のプリント素子の垂直アレイまた
は垂直から傾けられたアレイを含むプリントヘッドを有
し、該プリントヘッドがプリント媒体を横切って走査方
向に往復せしめられるのに伴い該プリント媒体上に少な
くとも１つの文字行をプリントするようになっているプ
リンタにおいて、 （ａ）プリントされるべき少なくとも１つの文字行のビ
ットマッピングされたラスタマトリックスを記憶するた
めの第１メモリであって、該メモリが（１）前記ｎ個の
プリント素子に対応するｎ行と、（２）それぞれの列が
該ｎ個のプリント素子に対応するｎワードを含み、それ
ぞれの該ワードがｎビットを含み、複数の該列と、を含
む少なくとも１つのセグメントを含む前記第１メモリ
と、 （ｂ）（１）前記ｎ個のプリント素子に対応するｎ行
と、（２）１ワードの前記ｍビットに対応するｍ個の１
ビット列と、を含む第２メモリと、 （ｃ）１ワードの前記ｍビットに対応するｍ個の１ビッ
トセルを含む第３メモリと、 （ｄ）（１）前記第１メモリのそれぞれの列から、前記
プリントヘッドの走査方向によって決定される通りに該
第１メモリ内の第１列から始めその後は列位置に従っ
て、前記ワードを前記第２メモリ内の対応位置へ順次転
送し、（２）（１）において転送された諸ワードのそれ
ぞれの列について、前記第２メモリのそれぞれの列か
ら、前記プリントヘッドの走査方向によって決定される
通りに該第２メモリ内の第１列から始めその後は列位置
に従って、前記ビットを前記第３メモリ内の対応セルへ
転送し、（３）（２）において転送された諸ビットのそ
れぞれの列について、前記第３メモリから該ビットを対
応プリント素子へ供給するための制御手段と、を含むこ
とを特徴とするプリンタ。 - 【請求項１３】 （ａ）前記第１メモリ手段が複数のセ
グメントを含み、１つの該セグメントがプリントされる
べきそれぞれの文字行に対応しており、 （ｂ）前記制御手段が前記セグメントの位置に従ってそ
れぞれの該セグメントに対して順次動作を行なう、請求
項１２記載のプリンタ。 - 【請求項１４】 （ａ）前記第１メモリがランダムアク
セスメモリから構成され、 （ｂ）前記第２メモリがランダムアクセスメモリから構
成され、 （ｃ）前記第３メモリがｍビットのシフトレジスタから
構成されている、請求項１３記載のプリンタ。 - 【請求項１５】 前記第３メモリの前記セルに対応する
ｍ個のラッチをさらに含み、かつ前記制御手段が該第３
メモリの該セルの内容を該対応ラッチ内にラッチするた
めの手段をさらに含む、請求項１２記載のプリンタ。 - 【請求項１６】 前記第２メモリが２つの別個のメモリ
バンクを含み、それぞれの該メモリバンクが （１）前記ｎ個のプリント素子に対応するｎ行と、 （２）１ワードの前記ｍビットに対応するｍ個の１ビッ
ト列と、を含み、かつ前記制御手段が前記第１メモリの
諸列からの前記ｎワードの転送を前記２バンクから交互
に行なう、請求項１５記載のプリンタ。 - 【請求項１７】 記録媒体上に画像をプリントするため
の非ラスタ形プリントヘッドを有するプリンタにおい
て、 （ａ）該画像を画素（ドット）の２次元ラスタマトリッ
クスに変換するための変換手段および該画素マトリック
スを記憶するための記憶手段と、 （ｂ）該ビットマッピングされたラスタマトリックスか
ら前記プリントヘッドのプリント素子数に対応する数の
ビットのグループをアクセスすることにより該プリント
ヘッドの該プリント素子を駆動して前記記憶手段からの
画素データにより所定順序でプリントを行なうべく前記
プリントヘッドを駆動して前記非ラスタ形プリントヘッ
ドによって前記画像をプリントするための手段と、を備
えていることを特徴とするプリンタ。 - 【請求項１８】 プリントヘッドがプリント媒体を横切
って複数の実質的に水平な通過を行なうのに伴い該プリ
ント媒体上に画像をプリントする該プリントヘッドを有
するプリンタであって、該プリントヘッドが複数のプリ
ント素子であってそれぞれが隣接するプリント素子に対
し垂直に変位せしめられている該複数のプリント素子を
含む、前記プリンタによるプリント方法にして、 （ａ）プリントされるべき画像のビットマッピングされ
たラスタマトリックスを発生しかつ記憶する段階と、 （ｂ）該ビットマッピングされたラスタマトリックスか
ら前記プリントヘッドの前記プリント素子の数に対応す
る数のビットのグループをアクセスする段階と、 （ｃ）該アクセスされたビットグループによって前記プ
リントヘッドの前記プリント素子を駆動することによっ
て前記画像をプリントする段階と、を含むプリント方
法。 - 【請求項１９】 プリント媒体上に画像をプリントする
ためのプリンタであって、該プリンタが該プリント媒体
を横切って実質的に横方向に第１方向および第２方向へ
交互に運動するプリントヘッドを含み、該プリントヘッ
ドが前記プリント媒体を横切って運動するのに伴って該
プリント媒体のｊ本の連続する走査線上にプリントする
ｊ個のプリント素子の実質的に垂直なアレイを前記プリ
ントヘッドが有している、前記プリンタによるプリント
方法にして、 （ａ）前記画像をｒ行およびｃ列の画素（ドット）を有
する画素の２次元ラスタマトリックスに変換する段階
と、 （ｂ）前記ｒ行およびｃ列の画素マトリックスを記憶す
る段階と、 （ｃ）マトリックス記憶手段内の第１画素列の最初のｊ
画素をアクセスし、それらを印加することにより前記プ
リントヘッドが前記プリント媒体を横切って前記第１方
向へ運動する時に該プリントヘッドの前記ｊ個のプリン
ト素子を駆動する段階と、 （ｄ）段階（ｃ）を前記マトリックスのそれぞれの残余
の列に対して繰返す段階と、を含むプリント方法。 - 【請求項２０】 （ａ）１からｎまでにより表わされる
ｎ個のプリント素子の垂直アレイまたは垂直から傾けら
れたアレイを含むプリントヘッドと、 （ｂ）プリントされるべき少なくとも１つの文字行のビ
ットマッピングされたラスタマトリックスを記憶するた
めの第１メモリであって、該メモリが（１）前記ｎ個の
プリント素子に対応するｎ行と、（２）それぞれの列が
該ｎ個のプリント素子に対応するｎワードを含み、それ
ぞれの該ワードがｍビットを含む、複数の該列と、を含
む少なくとも１つのセグメントを含む前記第１メモリ
と、 （ｃ）（１）前記ｎ個のプリント素子に対応するｎ行
と、（２）１ワードの前記ｍビットに対応するｍ個の１
ビット列と、を含む第２メモリと、 （ｄ）１ワードの前記ｍビットらに対応するｍ個の１ビ
ットセルを含む第３メモリと、を有するプリンタによる
プリント方法にして、（１）前記第１メモリのそれぞれ
の列から、前記プリントヘッドの走査方向によって決定
される通りに該第１メモリ内の第１列から始めその後は
列位置に従って、前記ワードを前記第２メモリ内の対応
位置へ順次転送する段階と、（２）（１）において転送
された諸ワードのそれぞれの列について、前記第２メモ
リのそれぞれの列から、前記プリントヘッドの走査方向
によって決定される通りに該第２メモリ内の第１列から
始めその後は列位置に従って、前記ビットを前記第３メ
モリ内の対応セルへ転送する段階と、（３）（２）にお
いて転送された諸ビットのそれぞれの列について、前記
第３メモリから該ビットを対応プリント素子へ供給する
段階と、を含むプリント方法。 - 【請求項２１】 （４）前記第１メモリ内のそれぞれの
残余のセグメントに対し、該セグメントの位置に従って
前記（１）から（３）までの諸段階を繰返す段階をさら
に含む請求項２０記載のプリント方法。 - 【請求項２２】 （４）前記マトリックス記憶手段内の
最後の画素列の次のｎ画素をアクセスし、それらを印加
することにより前記プリントヘッドの前記ｎ個のプリン
ト素子を駆動する段階と、（５）前記マトリックス記憶
手段内の次の前記セグメントのそれぞれの残余列に対し
段階（４）を繰返す段階と、をさらに含む請求項２０記
載のプリント方法。 - 【請求項２３】 プリント媒体上に画像をプリントする
ための非ラスタ形プリントヘッドを有するプリンタにお
いて、該プリンタヘッドが複数のプリント素子であって
それぞれが隣接するプリント素子に対し垂直に変位せし
められている該複数のプリント素子を含み、 （ａ）プリントされるべき画像のビットマッピングされ
たラスタマトリックスを発生しかつ記憶するための第１
手段と、 （ｂ）該ビットマッピングされたラスタマトリックスか
ら前記プリントヘッドの前記プリント素子の数に対応す
る数のビットのグループを所定の順序でアクセスするこ
とにより該プリントヘッドを駆動して該非ラスタ形プリ
ントヘッドによって前記画像をプリントするための第２
手段と、を備えていることを特徴とするプリンタ。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US613327 | 1990-11-09 | ||
| US07/613,327 US5347617A (en) | 1990-11-09 | 1990-11-09 | Printer having a multiple scan line printhead controller |
Publications (1)
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|---|---|
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| Application Number | Title | Priority Date | Filing Date |
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- 1991-11-08 JP JP3293294A patent/JPH06234242A/ja active Pending
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| Publication number | Publication date |
|---|---|
| GB2252694B (en) | 1995-01-18 |
| US5347617A (en) | 1994-09-13 |
| GB9123197D0 (en) | 1991-12-18 |
| DE4137300A1 (de) | 1992-05-14 |
| GB2252694A (en) | 1992-08-12 |
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