JPH0628519B2 - インバ−タ制御方式 - Google Patents

インバ−タ制御方式

Info

Publication number
JPH0628519B2
JPH0628519B2 JP59151313A JP15131384A JPH0628519B2 JP H0628519 B2 JPH0628519 B2 JP H0628519B2 JP 59151313 A JP59151313 A JP 59151313A JP 15131384 A JP15131384 A JP 15131384A JP H0628519 B2 JPH0628519 B2 JP H0628519B2
Authority
JP
Japan
Prior art keywords
inverter
power
phase
output
voltage
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP59151313A
Other languages
English (en)
Other versions
JPS6130968A (ja
Inventor
至 浅井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
Priority to JP59151313A priority Critical patent/JPH0628519B2/ja
Publication of JPS6130968A publication Critical patent/JPS6130968A/ja
Publication of JPH0628519B2 publication Critical patent/JPH0628519B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02MAPPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M7/00Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
    • H02M7/42Conversion of DC power input into AC power output without possibility of reversal
    • H02M7/44Conversion of DC power input into AC power output without possibility of reversal by static converters
    • H02M7/48Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Inverter Devices (AREA)

Description

【発明の詳細な説明】 〔発明の属する技術分野〕 本発明は、直流電力を交流電力に変換して出力する電源
としてのインバータを、他の電源を含む電源系統へ連系
接続し、該インバータから電源系統へ送り込む有効電力
を制御するためのインバータ制御方式に関するものであ
る。
かかるインバータとしては、太陽電池、燃料電池等から
得られた電池電力(直流電力)を交流電力に変換するイ
ンバータ(発電用インバータ)などがあり、かかる発電
用インバータを既設の電源系統へ接続し、該系統(例え
ば商用電源系統)における電圧や周波数(位相)を検出
し、それに対するインバータ出力電圧や周波数(位相)
を制御することにより、該インバータから電源系統へ補
給してやる有効電力(或いは無効電力)を調節すること
ができる。
第3図は発電用インバータと既設の電源系統と連系接続
を示す概念図である。同図において、1は発電用インバ
ータ、1Aは電圧形インバータ、1BはACフイルタを
兼ねた結合インピーダンス(本例では純リアクタンスL
とする)、2が商用電源系統、である。また、iは電
圧形インバータ1Aの出力電圧ベクトル、Lは出力電
流ベクトル、ωは電圧形インバータ1Aの角周波数、
sは電源系統2の系統電圧ベクトル、ωは同じく系統2
の角周波数、である。
第4図は、第3図に示した諸量のベクトル関係を示すベ
クトル図である。
同図から、インバータ出力電圧Vi、系統電圧Vs、両者
間の位相差、発電用インバータ1と商用電源系統2と
の間で授受される有効電力PGと無効電力QG等の間に
は、次の各式が成立することが理解されるであろう。
G=(Vs・Vi・sin)/ωL ……(1) QG=(Vs2−Vs・Vi・cos)/ωL ……(2) また、≒0なる条件のもとでは PG∝ ……(3) QG∝(Vs−Vi) ……(4) すなわち、インバータ1Aの出力位相を変えることによ
り有効電力PGが、また出力電圧Viの大きさを変えるこ
とにより、無効電力QGがそれぞれ変化することが上記
(3),(4)式より認められるのであろう。
他方、インバータ1Aの出力電圧位相は、インバータを
構成するスイツチング素子へ供給される点弧パルスの位
相に対応するからこれを変えれば出力電圧位相を可変で
きること、また出力電圧振幅は入力直流電圧やスイツチ
ング素子の導通時間幅によつて決定されることなどは周
知の通りである。つまりスイツチング素子の点弧駆動パ
ルスは、例えば第5図に示すような波形のものであり、
それに合わせて素子がオンオフ制御される。
そして、この第5図に示した角度表示360゜は連系す
る電源系統の1サイクル期間と一致するように定められ
る。
また、前述の電圧形インバータ1Aの代わりに電流形イ
ンバータを用いた場合でも、スイツチング素子へ供給さ
れる点弧パルスの位相や入力側直流電流の制御により、
上記と同様電源系統に送り込む有効電力や無効電力を制
御できるものであることは勿論である。
本発明は、以上説明したように、電源としてのインバー
タを他の電源系統へ連系接続し、該インバータの出力電
圧や出力位相を制御することにより、該インバータから
電源系統へ供給される電力を制御するようにしたインバ
ータ制御方式に関するものである。
〔従来技術とその問題点〕
一般に、発電用インバータと他の電源系統を連系接続し
た場合に、両者間の同期をとるためにフエイス・ロツク
ド・ループ(PLL)回路が用いられており、従来はか
かるPLL回路を利用して上述の如きインバータ制御が
行なわれていた。
第6図はPLL回路を用いた従来のインバータ制御方式
を示すブロツク図である。同図において、11は位相差
検出器(検出された位相差信号を更に通して出力させる
ためのローパスフイルタをも含むものとする)、12は
出力電力調節器、13は加算器、14は電圧制御発振器
(VCO)、15は点弧駆動パルス発生器、aは電源系
統電圧位相信号、bはインバータ出力電圧基本波位相信
号、cは位相差検出信号、dは進み位相指令信号、eは
周波数指令信号、fはクロツクパルス、gはインバータ
を構成するスイツチング素子の点弧駆動パルス信号、で
ある。
なお、パルス発生器15から信号bとgが出力するもの
として示してあるが、元来、信号bとgは一対一の対応
関係にあるものであることは先にも説明した通りであ
る。
次に回路動作を説明する。電源系統電圧位相信号aの位
相に対して、インバータ出力電圧基本波の位相bが進ん
でいる場合、その度合である位相差検出信号cが位相検
出器11より出力される。この位相差検出信号cの変動
に対応して周波数指令信号eが電圧制御発振器(VC
O)14に入力され、その出力fの周波数が上下する事
により、先の位相信号aとbが同一周波数となり両者の
位相が一定の関係になり、定常的な同期状態となる。
ここで電源系統電圧とインバータ出力電圧との間の位相
差を制御し、系統へのインバータからの出力電力を制御
するためには、位相信号aとbの間の位相関係は変える
必要があり、このため位相差検出器11の出力cに出力
電力調節器12からの出力(進み位相指令信号)dを加
算器13で加え、VCO14に持ち込むようにしてい
る。この時、VCO14から出力されるクロツク信号f
に合わせ、系統電圧と同一周期のパルス列が信号gとし
てパルス発生器15から読み出され、インバータを構成
するスイツチング素子へ点弧駆動信号として供給され
る。
またインバータ出力電圧を制御し、インバータから電源
系統へ供給される無効電力を制御したい場合には、パル
ス発生器15を例えば、第5図に示すようなパルス列が
発生できるような構成にしておき、インバータ出力電圧
の指令に合わせ、第5図における制御角αの大きさを異
ならせたパルス列をとり出してスイツチング素子へ供給
するようにすればよい。
さて、以上説明した如き、従来のインバータ制御方式に
は、次のような問題点があつた。
すなわち、第6図における位相差検出器11としては例
えばex−OR(排他的論理和)素子の如きものが用い
られるが、二つの信号間の位相差を検出するためには、
少なくとも当該信号の半サイクルの期間が必要であるか
ら、この位相差検出器に付加するローパスフイルタに
は、半サイクルより時定数の長いものを用いるようにし
て、半サイクルの間にVCO14の出力周波数が大幅に
変動したりする事のないようにしなければ安定な動作を
望むことは困難である。
またVCO14からのクロツク周波数をパルス発生器1
5の出力の単位位相角と対応させる場合には、同様に半
サイクルの時間でクロツク周波数が大幅に変化したりす
ると、インバータ出力の高調波の増加等の悪影響を招く
ので許容されない。
このようにして、インバータから電源系統へ供給される
電力の調節(増減)を行なわんとするとき、その際にお
けるインバータ出力周波数の系統周波数に対する再同期
化には、時定数の長い動作を必要とすることになる。換
言すると、インバータから電源系統へ供給する電力の調
節動作には長時間を要し、電源系統につながる負荷変動
に基因した連系接続点における電圧位相の変化や、イン
バータに対する出力指令値の変更等に対して、迅速に供
給電力の増減調節ができず、制御系として即応性に欠け
るという問題点が従来のインバータ制御方式にはあつ
た。
〔発明の目的〕
本発明は、上述の如き従来技術の欠点を解決するために
なされたものであり、従つて本発明の目的は、電源とし
てのインバータを、他の電源を含む電源系統へ連系接続
し、該インバータから電源系統へ供給する電力の増減調
節を行なう際、その調節動作を迅速に行なうことがで
き、制御系として即応性に富んだインバータ制御方式を
提供することにある。
〔発明の要点〕
本発明の要点は、インバータと電源系統との同期をとる
ための制御系はPLL回路により構成するが、インバー
タから電力系統へ供給する電力の調節のための制御系
は、それとは分離して別に構成することにより、制御系
として即応性に富んだインバータ制御方式の実現を可能
ならしめた点にある。
〔発明の実施例〕
次に図を参照して本発明の実施例を説明する。
第1図は本発明の一実施例を示すブロツク図である。同
図において、11は位相差検出器(ローパスフイルタを
含む)、12は出力電力調節器、14は電圧制御発振器
(VCO)、16a,16b,16cはそれぞれ分周
器、17はエツジトリガ回路、18はアツプダウンカウ
ンタ、19a,19bはそれぞれコンパレータ、20は
ROMまたはレベル変換器、21はインバータを構成す
るスイツチング素子の点弧駆動パルス発生器、である。
またaは電源系統の電圧位相信号、cは位相差検出信
号、eは周波数指令信号、d(d1,d2)は進み位相信
号、f,h,iはそれぞれ周波数は異なるがクロツクパ
ルス、gはインバータを構成するスイツチング素子の点
弧駆動パルス信号、jはプリセツトタイミング信号、k
はカウント出力、l1はアツプダウン反転しきい値、l2
はダウンアツプ反転しきい値、mはアツプダウン指令、
nは出力電圧指令、oはスイツチング位相指令、p,q
はそれぞれスイツチング位相の表示信号、である。
第1A図は第1図における各部信号のタイムチヤートで
ある。
第1図、第1A図を参照して回路動作を説明する。先ず
第1図において、位相差検出器11、VCO14、分周
器16a,bから成るループ回路は前述の場合と同様、
PLL回路を構成する。
但し、ここでは、このPLL回路の出力はインバータ出
力の位相とは関係がなく、系統電圧周期と対応する角度
単位をクロツク信号fとして提供することと、インバー
タ出力の進み遅れの角度を与えるタイミング信号jを与
えることを目的としている。
本実施例では、インバータの出力電圧指令信号nを、R
OM20により、前記インバータを構成するスイッチン
グ素子に対する点弧位相指令作成のためのカウント設定
値に変換する。このように変換して得られるカウント設
定値(第5図のαと対応)とアップダウンカウンタ18
の出力kをコンパレータ19bで比較した結果求められ
るパルスパターンpと、インバータにおける180゜導
通の基本パターンqをパルス発生器21で合成して(こ
の場合、パルス発生器21がex−OR素子であればよ
い)求めたパルスgが、第5図に示すパルス列に相当す
るものとなる。
即ち、インバータの出力電圧指令信号nの大きさによ
り、第5図に示す(90゜−α)と(90゜+α)との
間の幅2αを加減し、インバータ出力電圧の基本波成分
の大きさ(ひいては、インバータと系統間で授受される
無効電力の大きさ)を変えるわけであるが、これを第1
A図を参照して改めて説明する。
定常状態では、カウンタ18からの信号kは、デジタル
的に表された三角波信号(カウント値で表された三角波
信号)である。また、インバータの出力電圧指令信号n
は、ROM20により、パルス列p(点弧位相の表示信
号)を生成するためのカウント値で表された設定値に変
換されている。
ここでROM20は、出力電圧指令信号nの零から最大
値に対応させて、カウント数で表された値l1から(l
1+l2)/2までを記憶している。なお値l1は(α
=0゜)に相当し、値(l1+l2)/2は(α=45
゜)に相当している。つまり、出力電圧指令信号nをア
ドレスとしてROM20に与えることにより、対応した
カウント数で表された値(l1から(l1+l2)/2
までの範囲内の値)が、ROM20から読み出される訳
で、その値も第1A図ではnとして表されている。
次に、コンパレータ19bで比較を行い、k>nの区間
と、k<nの区間と、を区別することにより、パルス列
p(点弧位相の表示信号)を生成している、即ちk>n
の区間がハイレベル、k<nの区間がロウレベルとし
て、パルス列pが形成されている。
またコンパレータ19aでは、k≧l1となったとき、
その出力mはハイレベルからロウレベルに反転し、k≦
l2となったとき、その出力mはロウレベルからハイレ
ベルに反転するように動作する。
出力信号mを分周器16cで2分周すれば信号qが得ら
れる。信号pと信号qをパルス発生器21に導入し、e
x−OR素子の動作をさせればパルス列gが得られる。
従って出力電圧指令信号nの大きさを小さくすると、パ
ルス列pの各パルス幅2αが大きくなるという変化を生
じることになる。パルス発生器21からの出力パルス列
gは、既に述べた通り、第5図に示すパルス列に相当す
るものとなる。
このパルス列gの電源系統電圧の位相aに対する進み遅
れの角度に対応する量d1,d2が出力電力調節器12
から与えられ、この値をエツジトリガ回路17により生
成したプリセツトタイミングjに従つてアツプダウンカ
ウンタ18に周期的にプリセツトすることになる。
このカウンタ18のアツプダウン動作は、出力電力調節
器12からの位相指令dに変更がない時、電源系統の1
周期がアツプダウンの2周期に相当するように、アツプ
ダウンおよびダウンアツプの各しきい値l1,l2設け、
これらの値でアツプダウンの反転が起こるようにカウン
タ出力kとしきい値l1,l2の比較をコンパレータ19
aで行ない、その出力mをアツプダウン指令として用い
ることにより行なわれる。
このアツプダウン動作の1周期は、電源系統の1/2周期
に相当するものであり、しかも位相指令dにより調節さ
れた結果であるからコンパレータ19aの出力mを分周
器16cによつて2倍周期の信号に分周する事により、
インバータの180゜導通の基本パターンqが得られる
のである。またインバータ出力電圧の大きさを制御した
い場合には、指令信号nにより第5図に示すαの大きさ
に相当する量を変化させることができる。
以上のような回路構成でインバータの運転を行なう事に
よりインバータの出力電圧の位相や振幅を制御し、イン
バータから電源系統へ供給する有効電力や無効電力を制
御することができる。
なお、スイツチング素子の点弧駆動パルス信号gのパタ
ーンは、インバータ出力中の消去したい高調波の次数に
よつて変わりうるものであり、それに応じROM20や
コンパレータ19bの数、パルス発生器21の構成、カ
ウンタ18におけるアツプダウンの周期は変わりうる。
第2図は、かかる観点に立つてなされた本発明の他の実
施例の要部を示すブロツク図である。すなわち、インバ
ータ出力からの高調波除去を目的として、該インバータ
を構成するスイツチング素子のスイツチ回数を、第1図
に示した実施例の場合より増すようにした実施例を示し
ている。
第2A図は第2図における各部信号のタイムチヤートで
ある。
第2図、第2A図を参照する。同じ出力電圧指令nに対
して、異なつたスイツチング位相指令O1,O2を出力す
るROM20a,20b、それらに対応した2個のコンパレ
ータ19b1,19b2、また点弧駆動パルス発生器21が
示されている。
第2A図におけるスイツチング素子点弧駆動パルス信号
gの波形と、第1A図における信号gの波形を比較参照
することにより、本実施例の目的は容易に理解されるで
あろう。
本実施例の回路動作は、第1図、第1A図を参照して先
に説明した回路動作と本質的に相違する所はないので、
ここで繰り返すことはしない。
なお、電圧形インバータに代えて電流形インバータを用
いる場合は、出力相数により導通時間帯が異なり必ずし
も180度導通がパルスの基本パターンではないので、
基本パターンqの形成方法は異なつたものとなる。
尚、以上の説明ではインバータの相数を無視した説明に
してあるので、インバータを構成するスイツチング素子
へ供給される点弧パルスパターンと出力電圧パターンは
同一になるものとしてあるが、相数を無視しなければ、
それに応じて位相のずれた異なつたパターンになるもの
であることは勿論である。
〔発明の効果〕
この発明によれば、電源としてのインバータを電源系統
と連系接続して運転する場合に、系統同期のための制御
系と供給電力調節のための制御系を分離し、前者に用い
たPLL回路のVCOの発振周波数の変更を行うことな
くインバータの位相調節を行えるので、PLLの位相差
検出器におけるフイルタの時定数で位相調節動作が影響
をうけることはなく、高い即応性をもつて供給電力の調
節動作を行ないうるという利点がある。
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロツク図、第1A図
は第1図における各部信号のタイムチヤート、第2図は
本発明の他の実施例の要部を示すブロツク図、第2A図
は第2図における各部信号のタイムチヤート、第3図は
発電用インバータと既設の電源系統との連系接続を示す
概念図、第4図は第3図に示した諸量のベクトル関係を
示すベクトル図、第5図はインバータを構成するスイツ
チング素子へ供給される点弧駆動パルスの一例を示す波
形図、第6図はPLL回路を用いた従来のインバータ制
御方式を示すブロツク図、である。 符号説明 1……発電用インバータ、1A……電圧形インバータ、
1B……結合インピーダンス、2……商用電源系統、1
1……位相差検出器(ローパスフイルタを含む)、12
……出力電力調節器、13……加算器、14……電圧制
御発振器(VCO)、15,21……点弧駆動パルス発
生器、16a,16b,16c……分周器、17……エ
ツジトリガ回路、18……アツプダウンカウンタ、19
a,19b……コンパレータ、20a,20b……RO
Mまたはレベル変換器

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】直流電力を交流電力に変換して出力する電
    源としてのインバータを、他の電源を含む電源系統へ連
    系接続し、該インバータから電源系統へ給電する有効電
    力を制御するためのインバータ制御方式において、 前記系統の電圧位相と可変電圧発振器の発振出力から作
    成された或るクロック信号の位相とを比較してその位相
    差を検出すると共に、該位相差信号を前記可変電圧発振
    器に入力して前記電圧位相とクロック信号の位相が一致
    するようにしたフエース・ロックド・ループ回路と、前
    記クロック信号を入力されてカウントアップおよびダウ
    ンすることにより前記系統電圧の周期に同期した三角波
    を作成して出力するカウンタと、出力電圧レベルの設定
    器と、該設定器による設定レベルを前記インバータを構
    成するスイッチング素子に対する点弧位相指令作成のた
    めのカウント設定値に変換する変換回路と、該カウント
    設定値と前記三角波を比較して該カウント設定値の大小
    に依存したパルス幅をもつ第1のパルスを出力する比較
    器と、前記カウンタにおけるカウントアップとダウンの
    周期に同期した第2のパルスを発生する回路と、前記第
    1のパルスと第2のパルスから前記インバータの点弧位
    相指令信号を作成して出力する回路と、前記系統電圧の
    周期に同期した特定のタイミングで前記三角波のレベル
    を一定レベルだけ上下方向にシフトさせることにより出
    力電力を調節する手段と、を具備したことを特徴とする
    インバータの制御方式。
JP59151313A 1984-07-23 1984-07-23 インバ−タ制御方式 Expired - Lifetime JPH0628519B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59151313A JPH0628519B2 (ja) 1984-07-23 1984-07-23 インバ−タ制御方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59151313A JPH0628519B2 (ja) 1984-07-23 1984-07-23 インバ−タ制御方式

Publications (2)

Publication Number Publication Date
JPS6130968A JPS6130968A (ja) 1986-02-13
JPH0628519B2 true JPH0628519B2 (ja) 1994-04-13

Family

ID=15515913

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59151313A Expired - Lifetime JPH0628519B2 (ja) 1984-07-23 1984-07-23 インバ−タ制御方式

Country Status (1)

Country Link
JP (1) JPH0628519B2 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003109646A (ja) * 2001-09-28 2003-04-11 Mitsubishi Materials Corp 燃料電池のガス供給管構造
US20050118487A1 (en) * 2003-12-02 2005-06-02 Whiton John H. Small volume, fuel cell inlet fuel gas distributor having low pressure drop

Also Published As

Publication number Publication date
JPS6130968A (ja) 1986-02-13

Similar Documents

Publication Publication Date Title
EP0403616A1 (en) Dc content control for an inverter
JPS62147962A (ja) インバ−タの制御装置
US4389606A (en) Automatically synchronized synchronous motor drive system
US4689577A (en) Circuit for synchronizing an oscillator to a pulse train
US6757349B1 (en) PLL frequency synthesizer with lock detection circuit
US5298867A (en) Phase-locked loop with controlled phase slippage
JPH0628519B2 (ja) インバ−タ制御方式
JP3437661B2 (ja) 電力変換装置の同期制御方式
EP0454955B1 (en) Sampling clock generating circuit
JPH0763147B2 (ja) Pll回路
JPH04248714A (ja) 制御可能な周波発生器
US4071900A (en) Control device for an inverted rectifier
US3460052A (en) Oscillator phase and frequency synchronizing circuit
JP6758242B2 (ja) インバータ制御装置
JPS5535545A (en) Digital phase synchronous circuit
JPH03103046A (ja) 無停電電源装置の制御装置
JP3424415B2 (ja) 移相回路
Papadopoulos et al. A variable frequency controller for three phase dc/ac inverters
JPH0336114Y2 (ja)
JPS6449176A (en) Pll circuit
RU1777216C (ru) Многоканальное устройство дл управлени вентильным преобразователем
SU1624631A1 (ru) Способ формировани управл ющих импульсов в одноканальных системах фазового управлени вентильным преобразователем
JPH0410712A (ja) 位相同期制御回路
JPS5787241A (en) Phase synchronizing circuit for optional frequency conversion
KR19990030658A (ko) 고속 위상 동기 루프 및 그의 로킹 방법