JPH0629660A - 多層配線基板の製造方法 - Google Patents

多層配線基板の製造方法

Info

Publication number
JPH0629660A
JPH0629660A JP4182041A JP18204192A JPH0629660A JP H0629660 A JPH0629660 A JP H0629660A JP 4182041 A JP4182041 A JP 4182041A JP 18204192 A JP18204192 A JP 18204192A JP H0629660 A JPH0629660 A JP H0629660A
Authority
JP
Japan
Prior art keywords
layer
paste
conductive paste
printing
via hole
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP4182041A
Other languages
English (en)
Inventor
Akira Nakanishi
朗 中西
Keiichi Nakao
恵一 中尾
Akira Hashimoto
晃 橋本
Noboru Mori
昇 毛利
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP4182041A priority Critical patent/JPH0629660A/ja
Publication of JPH0629660A publication Critical patent/JPH0629660A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Production Of Multi-Layered Print Wiring Board (AREA)

Abstract

(57)【要約】 【目的】 多層配線基板において、微細ビアホールを従
来の方法とほとんど変わらない工程で安価に形成するこ
とを目的とする。 【構成】 第n層目(n≧1)導体上に、第n層と第
(n+1)層を接続するための導電ペーストを印刷、乾
燥(焼成)する工程と、絶縁層を形成する絶縁ペースト
を導電ペーストの膜13と同一以上の大きさのビアホー
ルパターンとして印刷、乾燥(焼成)する工程と、第
(n+1)層導体用導電ペーストを印刷、乾燥、焼成す
る工程を有している。これにより第n層と第(n+1)
層を接続するための導電ペーストで微細なパターンを形
成することにより、絶縁ペーストのにじみ、焼成による
ビアホール埋まりがなくなり、100μm以下のビアホ
ール径を有する多層配線基板を特殊な工程を必要とせず
安価に製造できる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、コンピュータ、AV機
器、通信機器をはじめとする各種電子機器に使用される
多層配線基板の製造方法に関する。
【0002】
【従来の技術】従来より、この種のガラスまたはセラミ
ックスを基材とする多層配線基板には大別すると2つあ
る。すなわち、1つはガラスまたはセラミックス基板上
に導電ペーストと絶縁ペーストを交互に印刷、焼成(焼
成は最後に一括して行うこともある)して得られる印刷
多層配線基板、もう1つは、セラミックスまたはガラス
セラミックスのグリーンシート上及びビアホール内に導
電ペーストを印刷または埋め込んだものを積層プレスし
て焼成したいわゆるグリーンシート多層配線基板であ
る。
【0003】これら2つのうち、前者はその寸法安定
性、低コストという長所を生かし各種電子機器に使用さ
れている。従来の印刷多層配線基板の製造方法の断面図
を図2に示し、次に説明する。
【0004】まず、図2(a)のようにガラスまたはセ
ラミック基板21上に導電ペーストをスクリーン印刷
し、焼成して第一層目の導体配線回路22を形成する。
次に図2(b)のようにビアホールを有する絶縁層23
をガラスまたはセラミックスを主成分とする絶縁ペース
トをスクリーン印刷し、乾燥後焼成することにより形成
し、さらにこの上の図2(c)のように第2層目の導体
配線回路24となる導電ペーストを印刷し、焼成により
形成する。絶縁ペーストの焼成と第2層目の導電ペース
トの焼成は同時に行うこともある。これをくり返して図
2(d)のように多層配線基板を製造する。
【0005】
【発明が解決しようとする課題】しかしながら、上記従
来の多層配線基板の製造方法には次のような課題があ
る。ビアホールを有する絶縁層を焼成後の膜厚5〜50
μm程度に形成する場合、一般的に用いられるスクリー
ン印刷では、印刷後の絶縁ペーストのにじみや焼成時の
絶縁ペースト中のガラス成分の溶融、流動等により、微
細なビアホールは埋まってしまうという現象が起こり、
ビアホール径としては、丸穴の場合その直径、角穴の場
合その一辺の長さが200〜250μm程度の歩留まり
良く製造できる最小径であり、200μm以下の小さな
ビアホールを形成することは非常に困難である。このこ
とは、多層配線基板の高密度化を妨げ、さらには電子機
器の小型化を阻害する要因ともなっている問題である。
【0006】この課題に対し、近年、絶縁ペーストを全
面に印刷、乾燥し、微細なビアホールをレーザー光をあ
てた部分の絶縁ペースト膜の溶解、飛散により形成する
方法、また、絶縁ペーストを全面に印刷、乾燥し、その
上に、ビアホールの径に等しいパターンで特殊な組成の
ペーストを印刷すると絶縁ペースト乾燥膜中に浸透し
て、現像により特殊な組成のペーストの浸透部分を溶解
除去して微細なビアホールを得る方法等が開発されつつ
ある。しかし、これらの方法は、レーザー装置や現像工
程、特殊な材料を必要とし、コストがかかること、応用
範囲が限定されること等の別の問題が存在する。
【0007】本発明はこの課題を解決するもので、ビア
ホール径が200μm以下、特に100μm径以下の微
細ビアホールを従来の製造方法とほとんど変わらない工
程で安価に形成する多層配線基板の製造方法を提供しよ
うとするものである。
【0008】
【課題を解決するための手段】この目的を達成するため
に本発明は、第n層目(n≧1)導体上に第n層と第
(n+1)層を接続するための導電ペーストを印刷によ
り形成する工程と、第n層と第(n+1)層間の絶縁層
を形成する絶縁ペーストを前記導電ペーストの膜と同一
以上の大きさのビアホールを有するパターンとして印刷
により形成する工程と、第(n+1)層目の導体用導電
ペーストを印刷により形成する工程を含むものである。
【0009】
【作用】本発明は、前記のような工程を含むために、次
に述べるように微細なビアホールを形成する働きを有し
ている。すなわち、第n層と第(n+1)層間の絶縁層
を形成する絶縁ペーストを印刷する前に、第n層と第
(n+1)層を接続するための導電ペーストを微細なド
ット状等で印刷し、乾燥、または乾燥、焼成しておくこ
とにより、絶縁ペースト印刷後のにじみや焼成時の絶縁
ペースト中のガラス成分等の溶融が起こっても導電ペー
ストの膜が防波堤の役目を果たし、第n層と第(n+
1)層の電気的接続を確実にすることができる。ビアホ
ールパターンを有する絶縁ペーストの印刷に比べ、第n
層と第(n+1)層を接続するための導電ペーストはメ
タルスクリーン版等を用いることにより、100μm径
以下のドット状パターンが比較的容易に形成できるの
で、結果的に100μm径以下の微細なビアホールを有
する多層配線基板が、特別な工程を必要とせず安価に製
造することができる。
【0010】
【実施例】以下、本発明の一実施例による製造方法につ
いて説明する。
【0011】まず、本発明の工程を図1を用いて説明す
る。図1(a)のようにガラスまたはセラミック基板1
1上に導電ペーストをスクリーン印刷し、焼成して第1
層目の導体配線回路12を形成する。次に、第1層と第
2層を接続するための導電ペーストを印刷し、乾燥また
は乾燥後焼成して導電ペーストの乾燥または焼成した膜
13を形成する。次に、絶縁ペーストを導電ペーストの
膜13と同一以上の大きさのビアホールを有するパター
ンとして印刷し、乾燥または乾燥後焼成して絶縁ペース
トの乾燥または焼成した膜14を形成する。次に、この
導電ペーストと絶縁ペーストの膜13,14上に導電ペ
ーストを印刷、乾燥後焼成して第2層目の導体配線回路
15を形成する。さらに必要ならば、これをくり返すこ
とでより多層の配線基板が製造できることになる。
【0012】次に、具体的な例を示す。 (実施例1)アルミナ基板上にAg−Pdペーストをス
クリーン印刷し、850℃で焼成して第1層目の導体配
線回路を形成した上に、同じくAg−Pdペーストを1
00μm角の大きさで焼成膜厚が40μmになるように
棒状に印刷し、乾燥した。
【0013】次に、150μm角のビアホールパターン
を有するスクリーン版を用いて。ガラスペーストの印
刷、乾燥を2回くり返し、焼成膜厚30μmになるよう
にしたところ、印刷直後のにじみにより、図1に示した
ようにAg−Pd乾燥膜に接する形となった。これを8
50℃で焼成してから、さらにこの焼成膜上にAg−P
dペーストをスクリーン印刷し、850℃で焼成して第
2層目の導体配線回路を形成した。以上の工程をさらに
2回くり返して、100μm角のビアホールを有する四
層配線基板を製造した。
【0014】(実施例2)アルミナ基板上にAuレジネ
ートペーストをスクリーン印刷し、850℃で焼成して
第1層目の導体配線回路を形成した上に、RuO2を主
成分とする抵抗体ペーストを80μm角の大きさで焼成
膜厚で30μmになるように印刷、乾燥し、850℃で
焼成した。
【0015】次に、200μm角のビアホールパターン
を有するスクリーン版を用いて、軟化点が700℃のガ
ラス粉末を主成分とするガラスペーストの印刷、乾燥を
2回くり返し、焼成膜厚20μmになるようにした。こ
の時、印刷直後のにじみによりガラスペースト乾燥膜の
ビアホール径は100〜150μmとなり。RuO2
ースト膜に接していないが、これを850℃で焼成する
と、ガラスペースト乾燥膜中の主成分である軟化点70
0℃のガラス粉末が溶融、流動するため、できあがった
ガラス焼成膜は、RuO2焼成膜を被覆することなく密
着した図1に示す状態になる。さらにこの焼成膜上にA
uレジネートペーストをスクリーン印刷し、700℃で
焼成して第2層目の導体配線回路を形成して、80μm
角のビアホールを有する二層配線基板を製造した。
【0016】実施例1,2に示した基板、ペースト材料
以外にも次のようなものが用いられる。基板は、アルミ
ナ基板の他、ガラス基板、ムライト基板、石英基板、シ
リコン基板、窒化アルミニウム基板、フェライト基板等
を用いることができる。導体配線回路用導電ペーストと
しては、Ag−Pdペースト、Auレジネートペースト
の他、Agペースト、Auペースト、Cuペースト、P
dペースト等の各種厚膜回路形成用ペースト、Agレジ
ネート、Cuレジネート、有機酸In、有機酸Sn等の
金属有機物(レジネート)ペースト等の一種または複数
種を用いることができる。第n層と第(n+1)層を接
続するための導電ペーストとしては、Ag−Pdペース
ト、RuO2ペーストの他に、Auペースト、Agペー
スト、Cuペースト、Pdペースト、SnO2ペースト
等の各種厚膜回路形成用、厚膜抵抗体形成用ペーストを
そのまま用いることができる。第n層と第(n+1)層
間の絶縁ペーストは、ガラスペーストの他、アルミナ、
ムライト等のセラミックスフィラーを含有したガラスセ
ラミックペースト、乾燥、焼成によりシリカ、アルミナ
等になるアルコキシドを主成分としたペーストも用いる
ことができる。
【0017】また、実施例1,2に示した以外の工法も
用いることができる。たとえば、導電ペーストやガラス
ペーストのパターン形成には、一般的には実施例1,2
に示したスクリーン印刷法を用いるが、他にオフセット
印刷、グラビア印刷等も用いることができる。焼成温
度、焼成雰囲気も、実施例1,2に示した以外の各使用
材料に適した条件を用いることができる。
【0018】
【発明の効果】以上の実施例から明らかなように本発明
による多層配線基板の製造方法は、次のような効果があ
る。すなわち、第n層と第(n+1)層を接続するため
の導電ペーストで微細なパターンを形成することによ
り、絶縁ペーストのにじみ、焼成によるビアホール埋ま
りがなくなり、ビアホール径200μm以下、特に10
0μm径以下のビアホールを有する多層配線基板を、従
来のスクリーン印刷、乾燥、焼成という工程以外の特別
な工程を必要とせずに安価に製造でき、基板の高密度
化、電子機器の小型化に貢献するところが大なるものが
ある。
【図面の簡単な説明】
【図1】本発明の一実施例による多層配線基板の製造方
法を示す断面図
【図2】従来の多層配線基板の製造方法を示す断面図
【符号の説明】
11 セラミック基板 12,15 導体配線回路 13,14 膜
───────────────────────────────────────────────────── フロントページの続き (72)発明者 毛利 昇 大阪府門真市大字門真1006番地 松下電器 産業株式会社内

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】ガラスまたはセラミック基板上に導電ペー
    ストと絶縁ペーストを交互に印刷、焼成して多層配線基
    板を得る際に、第n層目(n≧1)の導体上に第n層と
    第(n+1)層を接続するための導電ペーストを印刷に
    より形成する工程と、第n層と第(n+1)層間の絶縁
    層を形成する絶縁ペーストを前記導電ペーストの膜と同
    一以上の形状のビアホールを有するパターンとして印刷
    により形成する工程と、第(n+1)層目の導体用導電
    ペーストを印刷により形成する工程を含むことを特徴と
    する多層配線基板の製造方法。
JP4182041A 1992-07-09 1992-07-09 多層配線基板の製造方法 Pending JPH0629660A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4182041A JPH0629660A (ja) 1992-07-09 1992-07-09 多層配線基板の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4182041A JPH0629660A (ja) 1992-07-09 1992-07-09 多層配線基板の製造方法

Publications (1)

Publication Number Publication Date
JPH0629660A true JPH0629660A (ja) 1994-02-04

Family

ID=16111311

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4182041A Pending JPH0629660A (ja) 1992-07-09 1992-07-09 多層配線基板の製造方法

Country Status (1)

Country Link
JP (1) JPH0629660A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016134424A (ja) * 2015-01-16 2016-07-25 株式会社村田製作所 多層配線基板の製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016134424A (ja) * 2015-01-16 2016-07-25 株式会社村田製作所 多層配線基板の製造方法

Similar Documents

Publication Publication Date Title
JP3780386B2 (ja) セラミック回路基板及びその製造方法
JP3556164B2 (ja) 受動部品を埋め込む方法
JPH01282890A (ja) 多層回路の製造方法
US4914260A (en) Ceramic multi-layer printed circuit boards
US7186307B2 (en) Method for manufacturing a ceramic multilayer circuit board
US5292624A (en) Method for forming a metallurgical interconnection layer package for a multilayer ceramic substrate
US6846375B2 (en) Method of manufacturing multilayer ceramic wiring board and conductive paste for use
JPH09298368A (ja) セラミック配線基板
JP3064047B2 (ja) 多層セラミック回路基板
JP2001168406A (ja) 積層型圧電セラミック電子部品及びその製造方法
JP3111865B2 (ja) セラミック基板の製造方法
JP2001320151A (ja) セラミック回路基板の製造方法
JP2981515B2 (ja) 電子部品の製造方法
JP3495203B2 (ja) 回路基板の製造方法
JPH05327220A (ja) 多層セラミック基板の製造方法
JP3176258B2 (ja) 多層配線基板
JP2976088B2 (ja) 側面電極を有する表面実装用部品とその製造方法
JPH06260761A (ja) 厚膜多層印刷基板の製造方法
JP2515165B2 (ja) 多層配線基板の製造方法
JPH0380358B2 (ja)
JPH02256290A (ja) 厚膜回路基板の製造方法
JPH0340490A (ja) セラミック多層配線基板とその製造方法
JPH08307061A (ja) マルチチップモジュール用多層配線板及びその製造方法
JPH03259596A (ja) 多層配線基板およびその製造方法
JPH08242049A (ja) 多層配線基板用導電性ペースト