JPH0632166B2 - デ−タ記録再生装置 - Google Patents
デ−タ記録再生装置Info
- Publication number
- JPH0632166B2 JPH0632166B2 JP61088992A JP8899286A JPH0632166B2 JP H0632166 B2 JPH0632166 B2 JP H0632166B2 JP 61088992 A JP61088992 A JP 61088992A JP 8899286 A JP8899286 A JP 8899286A JP H0632166 B2 JPH0632166 B2 JP H0632166B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- demodulation
- circuit
- recording
- resynchronization information
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】 ＜発明の利用分野＞ 本発明は磁気記録あるいは光記録等において２−７変復
調方式を採用したデータ記録再生装置に関する。
調方式を採用したデータ記録再生装置に関する。
＜発明の背景＞ 可変語長一定比率データコードの順次符号化方法の１つ
として、特開昭５０−１４２１３１号公報に記載されて
いるように、２−７変復調方式が知られている。
として、特開昭５０−１４２１３１号公報に記載されて
いるように、２−７変復調方式が知られている。
この２−７変復調方式は第５図に示すようなコード化規
則にしたがってデータビット列を変復調するものであ
り、変調時に元データの１ビットが対応する２ビットコ
ードに変換される。この方式によれば、ラン長制限、す
なわち変調後のビットパターンにおけるビット“１”と
ビット“１”との間のビット“０”の個数は、最小でも
２個、最大７個である点に特徴があり、これにより記録
媒体上でビット“１”の連続が回避され、パターンピー
クシフト効果が低減される。
則にしたがってデータビット列を変復調するものであ
り、変調時に元データの１ビットが対応する２ビットコ
ードに変換される。この方式によれば、ラン長制限、す
なわち変調後のビットパターンにおけるビット“１”と
ビット“１”との間のビット“０”の個数は、最小でも
２個、最大７個である点に特徴があり、これにより記録
媒体上でビット“１”の連続が回避され、パターンピー
クシフト効果が低減される。
また、第６図に２−７変復調方式において採用される従
来の復調回路の一例を示す。この回路において、読取り
データＲＤＤＴを読取りクロックＲＤＣＫで動作するシ
フトレジスタ３１に入力し、シフトレジスタ３１の出力
を論理ゲート回路３２で組み合せ、この理論ゲート回路
３２の出力を復調クロック発生回路３３によって読取り
クロックＲＤＣＫを１／２周期化して得られた復調クロ
ックＤＭＣＫにより同期化し、復調データ３４を得る。
来の復調回路の一例を示す。この回路において、読取り
データＲＤＤＴを読取りクロックＲＤＣＫで動作するシ
フトレジスタ３１に入力し、シフトレジスタ３１の出力
を論理ゲート回路３２で組み合せ、この理論ゲート回路
３２の出力を復調クロック発生回路３３によって読取り
クロックＲＤＣＫを１／２周期化して得られた復調クロ
ックＤＭＣＫにより同期化し、復調データ３４を得る。
しかるに、この復調回路においては、復調クロックＤＭ
ＣＫをフリプフロップ３５とアンドゲート３６で得てお
り、たとえばノイズ等の原因で復調クロックＤＭＣＫに
誤反転を生じた場合、それ以後の復調データ３４が全て
誤ってしまうという欠点があった。
ＣＫをフリプフロップ３５とアンドゲート３６で得てお
り、たとえばノイズ等の原因で復調クロックＤＭＣＫに
誤反転を生じた場合、それ以後の復調データ３４が全て
誤ってしまうという欠点があった。
＜発明の目的＞ 本発明は上記問題点を解決すべくなされたものであり、
復調クロックに誤反転を生じた場合に復調データの誤り
の波及を最小限にとどめるようにしたデータ記録再生装
置の提供を目的とする。
復調クロックに誤反転を生じた場合に復調データの誤り
の波及を最小限にとどめるようにしたデータ記録再生装
置の提供を目的とする。
＜実施例＞ 第１図はデータの各ブロック間に再同期情報を挿入する
回路の構成を示す。１はタイミング生成回路、２はデー
タ蓄積回路、３は変調器、４は再同期情報生成回路、５
は切換スイッチである。変調器３は、２−７コード化規
則にしたがってデータ蓄積回路２からのデータを変調す
る。再同期情報生成回路４は、２−７変復調方式のラン
長制限を満足しコード化規則を満足しない再同期情報を
生成する。
回路の構成を示す。１はタイミング生成回路、２はデー
タ蓄積回路、３は変調器、４は再同期情報生成回路、５
は切換スイッチである。変調器３は、２−７コード化規
則にしたがってデータ蓄積回路２からのデータを変調す
る。再同期情報生成回路４は、２−７変復調方式のラン
長制限を満足しコード化規則を満足しない再同期情報を
生成する。
まず、外部から入力されたデータは、データ蓄積回路２
を介して変調器３によって変調され、切換スイッチ５を
介してデータを媒体に書き込む処理を行なう回路（図示
せず）へと導入されるが、各ブロック間で再同期情報を
挿入すべき位置ではタイミング生成回路１において発生
するタイミング信号６，７，８によって再同期情報の挿
入が行なわれる。その際、タイミング信号６はデータ蓄
積回路２を凍結し、凍結されたデータ蓄積回路２はその
間データの送出をストップする。タイミング信号７は、
次ブロックのデータを正しく変調するため、変調器３を
リセットする。切換スイッチ５は、タイミング信号８が
ハイレベルのとき再同期情報生成回路４の側に閉じ、再
同期情報生成回路４はタイムング信号８がハイレベルの
とき再同期情報パターンを出力する。
を介して変調器３によって変調され、切換スイッチ５を
介してデータを媒体に書き込む処理を行なう回路（図示
せず）へと導入されるが、各ブロック間で再同期情報を
挿入すべき位置ではタイミング生成回路１において発生
するタイミング信号６，７，８によって再同期情報の挿
入が行なわれる。その際、タイミング信号６はデータ蓄
積回路２を凍結し、凍結されたデータ蓄積回路２はその
間データの送出をストップする。タイミング信号７は、
次ブロックのデータを正しく変調するため、変調器３を
リセットする。切換スイッチ５は、タイミング信号８が
ハイレベルのとき再同期情報生成回路４の側に閉じ、再
同期情報生成回路４はタイムング信号８がハイレベルの
とき再同期情報パターンを出力する。
第２図は磁気記録、光記録等において採用される記録フ
ォーマットの一例を示す。記録媒体上のトラックは、同
図(a)に示すようにｎ１個のセクタに分割され、このセ
クタを単位としてデータが記録される。各セクタは、同
図(b)に示すようにＩＤ，ＳＹＮＣ等のフィールドから
なる制御信号記録エリアとｎ２個のブロックからなるユ
ーザーデータ記録エリアより構成される。各ブロック
は、同図(c)に示すようにｎ３個のバイトからなり、こ
のブロック列の最初もしくは最後に所定のコードビット
パターンからなる再同期情報が記録される。この再同期
情報であるコードビットパターンは、各ブロックのデー
タの変調後のビットパターンであり、再同期情報の誤検
出を防止するため、２−７コード化規則を満足しないパ
ターンとする。
ォーマットの一例を示す。記録媒体上のトラックは、同
図(a)に示すようにｎ１個のセクタに分割され、このセ
クタを単位としてデータが記録される。各セクタは、同
図(b)に示すようにＩＤ，ＳＹＮＣ等のフィールドから
なる制御信号記録エリアとｎ２個のブロックからなるユ
ーザーデータ記録エリアより構成される。各ブロック
は、同図(c)に示すようにｎ３個のバイトからなり、こ
のブロック列の最初もしくは最後に所定のコードビット
パターンからなる再同期情報が記録される。この再同期
情報であるコードビットパターンは、各ブロックのデー
タの変調後のビットパターンであり、再同期情報の誤検
出を防止するため、２−７コード化規則を満足しないパ
ターンとする。
第３図(a)はコードビットパターンの一例を示す。この
コードビットパターンは、２−７変復調方式のラン長制
限は満足するが、コード化規則は満足しない。さらに、
復調後のビットパターンは、必ず同図(b)に示すパター
ンになる。
コードビットパターンは、２−７変復調方式のラン長制
限は満足するが、コード化規則は満足しない。さらに、
復調後のビットパターンは、必ず同図(b)に示すパター
ンになる。
第４図は２−７変復調方式を採用したシステムにおいて
データの再生を行なう回路の構成を示す。１１は記録媒
体（図示せず）に対してデータの記録再生を行う駆動装
置、１２はＰＬＬ回路、１３はシフトレジスタとパター
ン判定器からなるパターン検出回路、１４は２−７復調
回路、１５は比較器、１６はマルチプレクサである。２
−７復調回路１４は、シフトレジスタ１７、ゲート群１
８、復調クロック発生回路１９，２０、フリップフロッ
プ２１，２２からなる。比較器１５は、再同期情報の復
調後のコードビットパターンたとえば第３図(b)に示す
コードビットパターンが予め設定されている。
データの再生を行なう回路の構成を示す。１１は記録媒
体（図示せず）に対してデータの記録再生を行う駆動装
置、１２はＰＬＬ回路、１３はシフトレジスタとパター
ン判定器からなるパターン検出回路、１４は２−７復調
回路、１５は比較器、１６はマルチプレクサである。２
−７復調回路１４は、シフトレジスタ１７、ゲート群１
８、復調クロック発生回路１９，２０、フリップフロッ
プ２１，２２からなる。比較器１５は、再同期情報の復
調後のコードビットパターンたとえば第３図(b)に示す
コードビットパターンが予め設定されている。
駆動装置１１により読み出されたデータは、ＰＬＬ回路
１２で同期化され、ＰＬＬ回路１２から読取りデータＲ
ＤＤＴと読取りクロックＲＤＣＫが出力され、この読取
りデータＲＤＤＴと読取りクロックＲＤＣＫはパターン
検出回路１３と２−７復調回路１４に入力される。パタ
ーン検出回路１３は、読取りデータＲＤＤＴを判別し、
ＳＹＮＣパターンと再同期情報を検出し、この検出信号
を出力する。
１２で同期化され、ＰＬＬ回路１２から読取りデータＲ
ＤＤＴと読取りクロックＲＤＣＫが出力され、この読取
りデータＲＤＤＴと読取りクロックＲＤＣＫはパターン
検出回路１３と２−７復調回路１４に入力される。パタ
ーン検出回路１３は、読取りデータＲＤＤＴを判別し、
ＳＹＮＣパターンと再同期情報を検出し、この検出信号
を出力する。
２−７復調回路１４に入力された読取りデータＲＤＤＴ
は、シフトレジスタ１７により並列化され、ゲート群１
８により組み合わされて、再び直列データ２３に変換さ
れる。また、読取りクロックＲＤＣＫは、ＲＤＣＫと▲
▼とに分けられ、読取りクロックＲＤＣＫは復
調クロック発生回路１９に入力され、読取りクロック▲
▼は復調クロック発生回路２０に入力される。
２つの復調クロック発生回路１９，２０は、互いに位相
の異なる復調クロックＤＭＣＫ１とＤＭＣＫ２をそれぞ
れ発生し、この復調クロックＤＭＣＫ１，ＤＭＣＫ２は
フリップフロップ２１，２２にそれぞれ入力される。フ
リップフロップ２１，２２において直列データ２３が同
期化され変調前のデータに変換されるが、位相の異なっ
た復調クロックによって復調されたそれぞれのデータは
互いに異なったものであり、片方のみ変調前のデータで
ある。
は、シフトレジスタ１７により並列化され、ゲート群１
８により組み合わされて、再び直列データ２３に変換さ
れる。また、読取りクロックＲＤＣＫは、ＲＤＣＫと▲
▼とに分けられ、読取りクロックＲＤＣＫは復
調クロック発生回路１９に入力され、読取りクロック▲
▼は復調クロック発生回路２０に入力される。
２つの復調クロック発生回路１９，２０は、互いに位相
の異なる復調クロックＤＭＣＫ１とＤＭＣＫ２をそれぞ
れ発生し、この復調クロックＤＭＣＫ１，ＤＭＣＫ２は
フリップフロップ２１，２２にそれぞれ入力される。フ
リップフロップ２１，２２において直列データ２３が同
期化され変調前のデータに変換されるが、位相の異なっ
た復調クロックによって復調されたそれぞれのデータは
互いに異なったものであり、片方のみ変調前のデータで
ある。
フリップフロップ２１，２２の出力は、比較器１５に入
力され、比較器１５はパータン検出回路１３からの再同
期情報検出信号を受けて第３図(b)のコードビットパタ
ーンとフリップフロップ２１，２２の出力とを比較す
る。この比較の結果、フリップフロップ２１，２２の出
力のうち第３図(b)のコードビットパターンと一致する
データに対する選択信号が比較器１５からマルチプレク
サ１６に与えられ、マルチプレクサ１６は２−７復調回
路１４からの変調前のデータのみを出力する。
力され、比較器１５はパータン検出回路１３からの再同
期情報検出信号を受けて第３図(b)のコードビットパタ
ーンとフリップフロップ２１，２２の出力とを比較す
る。この比較の結果、フリップフロップ２１，２２の出
力のうち第３図(b)のコードビットパターンと一致する
データに対する選択信号が比較器１５からマルチプレク
サ１６に与えられ、マルチプレクサ１６は２−７復調回
路１４からの変調前のデータのみを出力する。
この回路においては、復調クロック発生回路を２回路有
し、予め反転した復調クロックを持つことにより、たと
えば復調クロックＤＭＣＫ１に誤反転を生じた場合、復
調クロックＤＭＣＫ２によって復調したデータを選択的
に出力する。したがって、データの誤りがそのブロック
内に限定され、他へ波及しない。
し、予め反転した復調クロックを持つことにより、たと
えば復調クロックＤＭＣＫ１に誤反転を生じた場合、復
調クロックＤＭＣＫ２によって復調したデータを選択的
に出力する。したがって、データの誤りがそのブロック
内に限定され、他へ波及しない。
＜発明の効果＞ 以上詳述したように本発明においては、データの再生時
は位相の異なる２通りの復調クロックによってデータを
復調し、これらの復調データと所定のコードビットパタ
ーンとを比較していずれか一方の復調データを選択的に
出力するようにしたので、読取りクロックの抜けあるい
は湧き出し等の原因によりいずれかのブロックで復調ク
ロックに誤反転を生じても、データの誤りはそのブロッ
ク内に限定され、後続のブロックでは正常な復調動作が
可能となり、復調データの信頼性が向上する。
は位相の異なる２通りの復調クロックによってデータを
復調し、これらの復調データと所定のコードビットパタ
ーンとを比較していずれか一方の復調データを選択的に
出力するようにしたので、読取りクロックの抜けあるい
は湧き出し等の原因によりいずれかのブロックで復調ク
ロックに誤反転を生じても、データの誤りはそのブロッ
ク内に限定され、後続のブロックでは正常な復調動作が
可能となり、復調データの信頼性が向上する。
第１図は本発明の実施例の構成を示すブロック図、第２
図は本発明の実施例の記録媒体上の情報トラックの構成
を示す図、第３図は本発明の実施例のコードビットパタ
ーンを示す図、第４図は本発明の実地例の構成を示すブ
ロック図、第５図は２−７変復調方式のコード化規則を
示す図、第６図は従来例の復調回路の構成を示す図であ
る。 １……タイミング生成回路 ２……データ蓄積回路 ３……変調器 ４……再同期情報生成回路 ５……切換スイッチ １３……パターン検出回路 １４……２−７復調回路 １５……比較器 １６……マルチプレクサ １９，２０……復調クロック発生回路
図は本発明の実施例の記録媒体上の情報トラックの構成
を示す図、第３図は本発明の実施例のコードビットパタ
ーンを示す図、第４図は本発明の実地例の構成を示すブ
ロック図、第５図は２−７変復調方式のコード化規則を
示す図、第６図は従来例の復調回路の構成を示す図であ
る。 １……タイミング生成回路 ２……データ蓄積回路 ３……変調器 ４……再同期情報生成回路 ５……切換スイッチ １３……パターン検出回路 １４……２−７復調回路 １５……比較器 １６……マルチプレクサ １９，２０……復調クロック発生回路
フロントページの続き (72)発明者 山口 毅 大阪府大阪市阿倍野区長池町22番22号 シ ヤープ株式会社内 (72)発明者 出口 敏久 大阪府大阪市阿倍野区長池町22番22号 シ ヤープ株式会社内 (72)発明者 寺島 重男 大阪府大阪市阿倍野区長池町22番22号 シ ヤープ株式会社内 (56)参考文献 特開 昭61−22474（ＪＰ，Ａ)
Claims (1)
- 【請求項１】データを複数のブロックに分割し各ブロッ
ク間に再同期情報を挿入し２−７変復調方式を用いて記
録媒体に対する記録と再生を行う装置において、データ
の再生時は位相の異なる２通りの復調クロックにより再
生されたビット列を２通りに復調する復調手段と、復調
して得られたデータと再同期情報の復調ビットパターン
とを比較して正誤を判別する判別手段と、上記判別の結
果に応じて復調された２通りのデータのいずれか一方を
選択して出力するデータ選択手段とを備えたことを特徴
とするデータ記録再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61088992A JPH0632166B2 (ja) | 1986-04-17 | 1986-04-17 | デ−タ記録再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61088992A JPH0632166B2 (ja) | 1986-04-17 | 1986-04-17 | デ−タ記録再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62245573A JPS62245573A (ja) | 1987-10-26 |
| JPH0632166B2 true JPH0632166B2 (ja) | 1994-04-27 |
Family
ID=13958304
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61088992A Expired - Lifetime JPH0632166B2 (ja) | 1986-04-17 | 1986-04-17 | デ−タ記録再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0632166B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6122474A (ja) * | 1984-07-10 | 1986-01-31 | Sanyo Electric Co Ltd | 同期信号記録方法 |
-
1986
- 1986-04-17 JP JP61088992A patent/JPH0632166B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62245573A (ja) | 1987-10-26 |
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