JPH0644374B2 - デイスクプレ−ヤ - Google Patents
デイスクプレ−ヤInfo
- Publication number
- JPH0644374B2 JPH0644374B2 JP59258081A JP25808184A JPH0644374B2 JP H0644374 B2 JPH0644374 B2 JP H0644374B2 JP 59258081 A JP59258081 A JP 59258081A JP 25808184 A JP25808184 A JP 25808184A JP H0644374 B2 JPH0644374 B2 JP H0644374B2
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- signal
- clock
- speed
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/10527—Audio or video recording; Data buffering arrangements
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明はディジタル信号が記録さた光ディスク等を再生
するディスクプレーヤに関するものである。
するディスクプレーヤに関するものである。
従来の技術 ディジタル音声信号がピット列として記録された光ディ
スクを再生するプレーヤにおいては、一般にディスクの
回転を線速度が一定になるように制御しているが、機種
によっては線速度を可変として再生速度を制御できるよ
うにしたものがある。
スクを再生するプレーヤにおいては、一般にディスクの
回転を線速度が一定になるように制御しているが、機種
によっては線速度を可変として再生速度を制御できるよ
うにしたものがある。
第３図は再生速度を制御できるようにした光ディスクプ
レーヤの再生回路の一例を示す。
レーヤの再生回路の一例を示す。
図において、ディスク１はスピンドルモータ２により回
転駆動される。光学ピックアップ装置３は、送りモータ
４によりディスク１の半径方向に送られ、ディスク１に
記録されたデータを読み取ってＥＦＭ信号と成し、これ
をアンプ５に加える。このＥＦＭ信号は音声データ、位
置情報等の全てのデータを含み、またエラー成分を含ん
でいる。アンプ５は上記ＥＦＭ信号をＴＴＬレベルに変
換して、マイクロプロセッサを用いた信号処理回路６に
加える。また制御回路７はキー入力及び表示回路８から
のキー操作に応じた指示信号に基づいて制御信号をサー
ボ回路２２に送る。サーボ回路２２は上記制御信号と上
記位置情報と信号処理回路６から送られるリードフレー
ムクロック信号ＲＦＣＫ及びライトフレームクロック信
号ＷＦＣＫ等に基づいてモータ４及びピックアップ装置
３を制御する。
転駆動される。光学ピックアップ装置３は、送りモータ
４によりディスク１の半径方向に送られ、ディスク１に
記録されたデータを読み取ってＥＦＭ信号と成し、これ
をアンプ５に加える。このＥＦＭ信号は音声データ、位
置情報等の全てのデータを含み、またエラー成分を含ん
でいる。アンプ５は上記ＥＦＭ信号をＴＴＬレベルに変
換して、マイクロプロセッサを用いた信号処理回路６に
加える。また制御回路７はキー入力及び表示回路８から
のキー操作に応じた指示信号に基づいて制御信号をサー
ボ回路２２に送る。サーボ回路２２は上記制御信号と上
記位置情報と信号処理回路６から送られるリードフレー
ムクロック信号ＲＦＣＫ及びライトフレームクロック信
号ＷＦＣＫ等に基づいてモータ４及びピックアップ装置
３を制御する。
一方、ＰＬＬ回路９は基準信号発振器１０から得られる
例えば8.4672MHz の基準信号とＶＣＯ１１の出力信号と
を位相比較する。この比較出力はローパスフィルタ１２
を通じて制御信号となり、ＶＣＯ１１の発振周波数ｆ０
を制御する。このＶＣＯ１１の出力信号はマスタークロ
ック信号ＭＣＫとして信号処理回路６に供給される。
例えば8.4672MHz の基準信号とＶＣＯ１１の出力信号と
を位相比較する。この比較出力はローパスフィルタ１２
を通じて制御信号となり、ＶＣＯ１１の発振周波数ｆ０
を制御する。このＶＣＯ１１の出力信号はマスタークロ
ック信号ＭＣＫとして信号処理回路６に供給される。
また上記ローパスフィルタ１２の出力の一部はＲＦＰＬ
Ｌ回路１３を制御し、これによってこのＲＦＰＬＬ回路
１３は、上記ＷＦＣＫ信号の周波数4.3218MHz の２倍の
周波数である8.6436MHz の同期用クロック信号ＳＹＣＫ
を出力して信号処理回路６に供給する。従って、上記Ｓ
ＹＣＫ信号と上記ＭＣＫ信号とは常にＰＬＬによってそ
れらの周波数が同じ割合で制御されている。
Ｌ回路１３を制御し、これによってこのＲＦＰＬＬ回路
１３は、上記ＷＦＣＫ信号の周波数4.3218MHz の２倍の
周波数である8.6436MHz の同期用クロック信号ＳＹＣＫ
を出力して信号処理回路６に供給する。従って、上記Ｓ
ＹＣＫ信号と上記ＭＣＫ信号とは常にＰＬＬによってそ
れらの周波数が同じ割合で制御されている。
信号処理回路６はアンプ５から入力される音声データを
上記ＳＹＣＫ信号で同期させると共に、上記ＭＣＫ信号
を分周した信号でデータの読み取りを行う。読み取られ
た音声データはＤ／Ａ変換器１４でアナログ信号に変換
され、このアナログ信号からローパスフィルタ１５によ
りサンプリング周波数成分が除去されて、元のアナログ
音声信号が得られる。
上記ＳＹＣＫ信号で同期させると共に、上記ＭＣＫ信号
を分周した信号でデータの読み取りを行う。読み取られ
た音声データはＤ／Ａ変換器１４でアナログ信号に変換
され、このアナログ信号からローパスフィルタ１５によ
りサンプリング周波数成分が除去されて、元のアナログ
音声信号が得られる。
信号処理回路６はまた速度エラー信号ＳＥを作ってモー
タ制御回路１６に加える。モータ制御回路１６は上記Ｓ
Ｅ信号と、ｆ／ｖ変換回路１７から加えられる速度基準
電圧Ｖｓとを比較し、その比較出力に基づいてモータ２
を、ディスク１の線速度が一定となるように制御する。
ｆ／ｖ変換回路１７には、信号処理回路６よりＭＣＫ信
号を分周して得られる所定周波数のＲＦＣＫ信号が供給
されており、このＲＦＣＫ信号の周波数に応じて速度基
準電圧Ｖｓを得るようにしている。
タ制御回路１６に加える。モータ制御回路１６は上記Ｓ
Ｅ信号と、ｆ／ｖ変換回路１７から加えられる速度基準
電圧Ｖｓとを比較し、その比較出力に基づいてモータ２
を、ディスク１の線速度が一定となるように制御する。
ｆ／ｖ変換回路１７には、信号処理回路６よりＭＣＫ信
号を分周して得られる所定周波数のＲＦＣＫ信号が供給
されており、このＲＦＣＫ信号の周波数に応じて速度基
準電圧Ｖｓを得るようにしている。
以上はディスク１を標準速度に制御する場合であるが、
標準速度と異なる速度に変える場合は次のように成され
る。
標準速度と異なる速度に変える場合は次のように成され
る。
ディジタルスイッチ１８（又はアップ・ダウンスイッチ
でもよい。）により所望の速度を指示すると、ＰＬＬ制
御回路１９はＶＣＯ１１の周波数ｆ０が8.4672MHz から
変更されるようにＰＬＬ回路９を制御する。これによっ
ＭＣＫ信号の周波数ｆ０が所望速度に応じて変更され、
従って、このＭＣＫ信号を分周して得られる上記ＲＦＣ
Ｋ信号の周波数も変化する。この結果、ｆ／ｖ変換回路
１７から得られる基準電圧Ｖｓが変更されて、モータ２
の速度が変更される。尚、Ｄ／Ａ変換器１４はサンプリ
ング発振器２０により一定周波数でサンプリングされ
る。
でもよい。）により所望の速度を指示すると、ＰＬＬ制
御回路１９はＶＣＯ１１の周波数ｆ０が8.4672MHz から
変更されるようにＰＬＬ回路９を制御する。これによっ
ＭＣＫ信号の周波数ｆ０が所望速度に応じて変更され、
従って、このＭＣＫ信号を分周して得られる上記ＲＦＣ
Ｋ信号の周波数も変化する。この結果、ｆ／ｖ変換回路
１７から得られる基準電圧Ｖｓが変更されて、モータ２
の速度が変更される。尚、Ｄ／Ａ変換器１４はサンプリ
ング発振器２０により一定周波数でサンプリングされ
る。
上述した第３図の再生回路は再生速度を変えられるよう
にしたものであるが、再生速度を変えることのできない
従来の再生回路にオーバーサンプリングを用いたものが
知られている。音声データのサンプリング周波数が例え
ば44.1KHz であるとすると、サンプリング周波数成分を
除去するためローパスフィルタ１５は２２KHz 付近にカ
ットオフ点を持つものが用いられる。この場合、このロ
ーパスフィルタ１５は急峻なカットオフ特性を持つこと
が要求される。このためフィルタの位相の回り込みが生
じ、これによって周波数特性、歪率等が劣化し、音質に
影響を与える。
にしたものであるが、再生速度を変えることのできない
従来の再生回路にオーバーサンプリングを用いたものが
知られている。音声データのサンプリング周波数が例え
ば44.1KHz であるとすると、サンプリング周波数成分を
除去するためローパスフィルタ１５は２２KHz 付近にカ
ットオフ点を持つものが用いられる。この場合、このロ
ーパスフィルタ１５は急峻なカットオフ特性を持つこと
が要求される。このためフィルタの位相の回り込みが生
じ、これによって周波数特性、歪率等が劣化し、音質に
影響を与える。
この問題を解決するためにオーバーサンプリング法が用
いられている。即ち、Ｄ／Ａ変換器１４の前段に周波数
変換用のディジタルフィルタを設けて、このディジタル
フィルタを上記サンプリング周波数の２倍の周波数、例
えば88.2KHz で駆動する。これによって信号処理回路６
から出力されるデータが高速化されるためローパスフィ
ルタ１５には特に急峻な特性を持つものを必要としなく
なり、緩やかな特性のフィルタを使うことが可能とな
る。従って、前述した周波数特性及び歪率が改善され、
音質の向上をはかることができる。
いられている。即ち、Ｄ／Ａ変換器１４の前段に周波数
変換用のディジタルフィルタを設けて、このディジタル
フィルタを上記サンプリング周波数の２倍の周波数、例
えば88.2KHz で駆動する。これによって信号処理回路６
から出力されるデータが高速化されるためローパスフィ
ルタ１５には特に急峻な特性を持つものを必要としなく
なり、緩やかな特性のフィルタを使うことが可能とな
る。従って、前述した周波数特性及び歪率が改善され、
音質の向上をはかることができる。
発明が解決しようとする問題点 上述したオーバーサンプリングの方法は、ディスク１が
標準速度で回転する場合にのみ用いられ、第３図のよう
な速度変更手段を持つ再生回路に用いることは不可能で
あった。何故ならば上記ディジタルフィルタをサンプリ
ング周波数の２倍の周波数で駆動しても、速度変更に伴
ってＭＣＫ信号等の周波数も変化するため、ディジタル
フィルタにおいて同期が全くとれなくならからである。
また、速度を下げた場合はサンプリング周波数も低くな
るので、ローパスフィルタ１５のカットオフ周波数を低
くしなければ、音声帯域にビートを発生することがあ
る。
標準速度で回転する場合にのみ用いられ、第３図のよう
な速度変更手段を持つ再生回路に用いることは不可能で
あった。何故ならば上記ディジタルフィルタをサンプリ
ング周波数の２倍の周波数で駆動しても、速度変更に伴
ってＭＣＫ信号等の周波数も変化するため、ディジタル
フィルタにおいて同期が全くとれなくならからである。
また、速度を下げた場合はサンプリング周波数も低くな
るので、ローパスフィルタ１５のカットオフ周波数を低
くしなければ、音声帯域にビートを発生することがあ
る。
問題点を解決するための手段 第１図の実施例および第２図の実施例においては、クロ
ック生成手段１１、２２で生成するクロックの周波数を
２ｆ０と成し、この２ｆ０のクロックをディジタルフィ
ルタ２１に供給すると共に、分周器２３により１／２に
分周して信号処理回路６に供給するようにしている。
ック生成手段１１、２２で生成するクロックの周波数を
２ｆ０と成し、この２ｆ０のクロックをディジタルフィ
ルタ２１に供給すると共に、分周器２３により１／２に
分周して信号処理回路６に供給するようにしている。
なお、第２図の実施例においては、ＶＣＯ１１自体によ
り上記クロック生成手段が構成されている。これに対
し、第１図の実施例においては、ＶＣＯ１１および１／
４分周器２２により上記クロック生成手段が構成されて
いる。そして、ＶＣＯ１１の周波数、すなわちマスター
クロック信号ＭＣＫの周波数を８ｆ０と成し、このＭＣ
Ｋ信号をＤ／Ａ変換器１４に供給すると共に、このＭＣ
Ｋ信号を１／４に分周してディジタルフィルタ２１に供
給し、さらに、１／２に分周して信号処理回路６に供給
するようにしている。
り上記クロック生成手段が構成されている。これに対
し、第１図の実施例においては、ＶＣＯ１１および１／
４分周器２２により上記クロック生成手段が構成されて
いる。そして、ＶＣＯ１１の周波数、すなわちマスター
クロック信号ＭＣＫの周波数を８ｆ０と成し、このＭＣ
Ｋ信号をＤ／Ａ変換器１４に供給すると共に、このＭＣ
Ｋ信号を１／４に分周してディジタルフィルタ２１に供
給し、さらに、１／２に分周して信号処理回路６に供給
するようにしている。
作用 ディジタルフィルタ２１に２ｆ０のクロックが供給さ
れ、信号処理回路６にｆ０で且つディジタルフィルタ２
１と同期されたクロックが供給される。しかも速度変更
に伴って、上記ｆ０と２ｆ０のクロックは常に同期され
ながら変化する。これによって、第３図のような速度変
更手段を設けた再生回路にオーバーサンプリング法を適
用することが可能となる。
れ、信号処理回路６にｆ０で且つディジタルフィルタ２
１と同期されたクロックが供給される。しかも速度変更
に伴って、上記ｆ０と２ｆ０のクロックは常に同期され
ながら変化する。これによって、第３図のような速度変
更手段を設けた再生回路にオーバーサンプリング法を適
用することが可能となる。
実施例 第１図は本発明の第１の実施例を示し、第３図と同一部
分には同一符号を付してある。
分には同一符号を付してある。
第１図において、標準速度時には、ＶＣＯ１１はＰＬＬ
回路９によって周波数８ｆ０に制御されている。このＶ
ＣＯ１１から出力される８ｆ０のＭＣＫ信号は、Ｄ／Ａ
変換器１４に供給されると共に、１／４分周器２２で２
ｆ０に分周されてディジタルフィルタ２１に供給され、
さらに１／２分周器２３でｆ０に分周されて信号処理回
路６に供給される。尚、この場合第３図の発振器２０は
省略される。
回路９によって周波数８ｆ０に制御されている。このＶ
ＣＯ１１から出力される８ｆ０のＭＣＫ信号は、Ｄ／Ａ
変換器１４に供給されると共に、１／４分周器２２で２
ｆ０に分周されてディジタルフィルタ２１に供給され、
さらに１／２分周器２３でｆ０に分周されて信号処理回
路６に供給される。尚、この場合第３図の発振器２０は
省略される。
上記構成によれば、Ｄ／Ａ変換器１４、ディジタルフィ
ルタ２１及び信号処理回路６に夫々供給される８ｆ０，
２ｆ０及びｆ０の各クロックは互いに同期されており、
しかもディスク１の回転標準速度が変更されて、ＭＣＫ
信号の周波数が変更されても、上記各クロックは常に同
期される。従って、ディスク１の回転速度に拘らず、デ
ィジタルフィルタ２１を用いて、オーバーサンプリング
を行うことができる。またローパスフィルタ１５のカッ
トオフ周波数を低くする必要もなくなり、ビートの発生
を防止することができる。
ルタ２１及び信号処理回路６に夫々供給される８ｆ０，
２ｆ０及びｆ０の各クロックは互いに同期されており、
しかもディスク１の回転標準速度が変更されて、ＭＣＫ
信号の周波数が変更されても、上記各クロックは常に同
期される。従って、ディスク１の回転速度に拘らず、デ
ィジタルフィルタ２１を用いて、オーバーサンプリング
を行うことができる。またローパスフィルタ１５のカッ
トオフ周波数を低くする必要もなくなり、ビートの発生
を防止することができる。
第２図は第２の実施例を示す。
本実施例は、標準速度時におけるＶＣＯ１１の周波数を
２ｆ０に制御して、そのＭＣＫ信号をディジタルフィル
タ２１に直接供給すると共に、１／２分周器２３でｆ０
に分周して信号処理回路６に供給するようにしたもので
ある。尚、この場合はＤ／Ａ変換器１４にサンプリング
に発振器２０が設けられている。
２ｆ０に制御して、そのＭＣＫ信号をディジタルフィル
タ２１に直接供給すると共に、１／２分周器２３でｆ０
に分周して信号処理回路６に供給するようにしたもので
ある。尚、この場合はＤ／Ａ変換器１４にサンプリング
に発振器２０が設けられている。
また本実施例においては、第３図の再生回路における次
の問題も同時に解決している。
の問題も同時に解決している。
第３図の回路においては、モータ制御回路１６に加えら
れる基準電圧Ｖｓを速度に応じて変更するために、ｆ／
ｖ変換回路１７を用いている。しかしながらｆ／ｖ変換
回路１７は温度特性及びリニアリティに問題があり、こ
のため精度の高い速度制御が困難となり、また調整用の
ボリュームを必要としていた。
れる基準電圧Ｖｓを速度に応じて変更するために、ｆ／
ｖ変換回路１７を用いている。しかしながらｆ／ｖ変換
回路１７は温度特性及びリニアリティに問題があり、こ
のため精度の高い速度制御が困難となり、また調整用の
ボリュームを必要としていた。
上記の問題を解決するために本実施例においては、ロー
パスフィルタ１２から得られる制御電圧の一部を逆変換
回路２４に通じて基準電圧Ｖｓを得るようにしている。
上記ローパスフィルタ１２の出力電圧は、周波数の増大
に応じて増大する特性を示すので、これを逆変換回路２
４により、周波数の増大に応じて減少する特性に変更し
て、基準電圧Ｖｓを得るようにしている。
パスフィルタ１２から得られる制御電圧の一部を逆変換
回路２４に通じて基準電圧Ｖｓを得るようにしている。
上記ローパスフィルタ１２の出力電圧は、周波数の増大
に応じて増大する特性を示すので、これを逆変換回路２
４により、周波数の増大に応じて減少する特性に変更し
て、基準電圧Ｖｓを得るようにしている。
またローパスフィルタ１２の出力電圧はＶＣＯ１１を制
御する精度の高い制御電圧であるので、本方式を用いる
ことにより、精度の高い速度制御が可能となる。また調
整ボリューム等も不要となる。
御する精度の高い制御電圧であるので、本方式を用いる
ことにより、精度の高い速度制御が可能となる。また調
整ボリューム等も不要となる。
尚、本発明の第３の実施例として、第１図において、Ｖ
ＣＯ１１の周波数を２ｆ０として、ＭＣＫ信号を直接デ
ィジタルフィルタ２１に供給すると共に、１／２分周器
２３でｆ０に分周し信号処理回路６に供給するようにし
てもよい。
ＣＯ１１の周波数を２ｆ０として、ＭＣＫ信号を直接デ
ィジタルフィルタ２１に供給すると共に、１／２分周器
２３でｆ０に分周し信号処理回路６に供給するようにし
てもよい。
また本発明の第４の実施例として、第２図においてＶＣ
Ｏ１１の周波数を８ｆ０として、ＭＣＫ信号を直接にＤ
／Ａ変換器１４に供給すると共に、１／４分周して２ｆ
０のクロックをディジタルフィルタ２１に供給し、さら
に１／２分周してｆ０のクロックを信号処理回路６に供
給するようにしてもよい。
Ｏ１１の周波数を８ｆ０として、ＭＣＫ信号を直接にＤ
／Ａ変換器１４に供給すると共に、１／４分周して２ｆ
０のクロックをディジタルフィルタ２１に供給し、さら
に１／２分周してｆ０のクロックを信号処理回路６に供
給するようにしてもよい。
発明の効果 本発明は、ディスクの回転速度の変更を指示する指示手
段を設けたディジタルディスクプレーヤにおいて、信号
処理手段からの出力信号をオーバーサンプリングするこ
とにより高速化するディジタルフィルタを設け、上記指
示手段による回転速度変更の指示に応じて変化する第１
の周波数を有するクロックを上記ディジタルフィルタに
供給すると共に、この第１の周波数の整数分の１である
第２の周波数を有するクロックを上記信号処理手段に供
給するようにした。
段を設けたディジタルディスクプレーヤにおいて、信号
処理手段からの出力信号をオーバーサンプリングするこ
とにより高速化するディジタルフィルタを設け、上記指
示手段による回転速度変更の指示に応じて変化する第１
の周波数を有するクロックを上記ディジタルフィルタに
供給すると共に、この第１の周波数の整数分の１である
第２の周波数を有するクロックを上記信号処理手段に供
給するようにした。
したがって、上記指示手段の指示によりディスクの回転
速度を変えることによって再生速度を変えることができ
るから、必要に応じて再生速度を変えることにより再生
状態に変化を持たせることができる。
速度を変えることによって再生速度を変えることができ
るから、必要に応じて再生速度を変えることにより再生
状態に変化を持たせることができる。
また、ディスクの回転速度の如何にかゝわらず、信号処
理手段に供給されるクロックの周波数の整数倍である第
２の周波数を有するクロックをディジタルフィルタに供
給するようにしたから、ディスクの回転速度の如何にか
ゝわらず、ディジタルフィルタにおいて信号処理手段か
らの入力信号と第２の周波数を有するクロックとを同期
させることができ、このために、ディスクの回転速度の
如何にかゝわらず、良質の再生信号を得ることができ
る。
理手段に供給されるクロックの周波数の整数倍である第
２の周波数を有するクロックをディジタルフィルタに供
給するようにしたから、ディスクの回転速度の如何にか
ゝわらず、ディジタルフィルタにおいて信号処理手段か
らの入力信号と第２の周波数を有するクロックとを同期
させることができ、このために、ディスクの回転速度の
如何にかゝわらず、良質の再生信号を得ることができ
る。
また、ディスクの回転速度を低下させた場合にはサンプ
リング周波数も低くなるが、ディジタルフィルタからの
出力信号はオーバーサンプリングにより高速可されてい
るから、この高速化された出力信号がＤ／Ａ変換された
後に供給されるローパスフィルタは急峻なカットオフ特
性を持つ必要がなく、また、このローパスフィルタのカ
ットオフ周波数をディスクの回転速度の低下に応じて低
下させなくても、再生信号にビートを発生することがな
い。したがって、高価でありかつ高精度に構成し難い高
次数のローパスフィルタを用いる必要がないから、ロー
パスフィルタの周波数特性、歪率などの劣化を効果的に
防止することができ、このために、再生信号の質の低下
を防止することができ、また、この高次数のローパスフ
ィルタのカットオフ周波数をディスクの回転速度の変更
に応じて変更するための複雑な回路構成が不要である。
リング周波数も低くなるが、ディジタルフィルタからの
出力信号はオーバーサンプリングにより高速可されてい
るから、この高速化された出力信号がＤ／Ａ変換された
後に供給されるローパスフィルタは急峻なカットオフ特
性を持つ必要がなく、また、このローパスフィルタのカ
ットオフ周波数をディスクの回転速度の低下に応じて低
下させなくても、再生信号にビートを発生することがな
い。したがって、高価でありかつ高精度に構成し難い高
次数のローパスフィルタを用いる必要がないから、ロー
パスフィルタの周波数特性、歪率などの劣化を効果的に
防止することができ、このために、再生信号の質の低下
を防止することができ、また、この高次数のローパスフ
ィルタのカットオフ周波数をディスクの回転速度の変更
に応じて変更するための複雑な回路構成が不要である。
【図面の簡単な説明】 第１図は本発明の第１の実施例を示すブロック図、第２
図は第２の実施例を示すブロック図、第３図は従来例を
示すブロック図である。 なお図面に用いられた符号において、 ２……モータ ３……ピックアップ ６……信号処理回路 ９……ＰＬＬ回路 １１……ＶＣＯ １６……モータ制御回路 １９……ＰＬＬ制御回路 ２１……ディジタルフィルタ ２２，２３……分周器 である。
図は第２の実施例を示すブロック図、第３図は従来例を
示すブロック図である。 なお図面に用いられた符号において、 ２……モータ ３……ピックアップ ６……信号処理回路 ９……ＰＬＬ回路 １１……ＶＣＯ １６……モータ制御回路 １９……ＰＬＬ制御回路 ２１……ディジタルフィルタ ２２，２３……分周器 である。
Claims (1)
- 【請求項１】ディジタル信号が記録されたディスクを回
転駆動する駆動手段と、 上記ディスクから上記ディジタル信号を検出する検出手
段と、 上記検出されたディジタル信号を信号処理する信号処理
手段と、 上記信号処理手段からの出力信号をオーバーサンプリン
グすることにより高速化するディジタルフィルタと、 上記ディスクの回転速度の変更を指示する指示手段と、 第１の周波数を有するクロックを生成すると共に上記指
示手段による回転速度変更の指示に応じて上記第１の周
波数を変化させるクロック生成手段と、 上記クロック生成手段からの第１の周波数を有するクロ
ックを第２の周波数を有するクロックに分周する分周手
段とを備え、 上記クロック生成手段からの第１の周波数を有するクロ
ックを上記ディジタルフィルタに供給すると共に、 上記分周手段からの第２の周波数を有するクロックを上
記信号処理手段に供給するように構成したディスクプレ
ーヤ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59258081A JPH0644374B2 (ja) | 1984-12-06 | 1984-12-06 | デイスクプレ−ヤ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59258081A JPH0644374B2 (ja) | 1984-12-06 | 1984-12-06 | デイスクプレ−ヤ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61137279A JPS61137279A (ja) | 1986-06-24 |
| JPH0644374B2 true JPH0644374B2 (ja) | 1994-06-08 |
Family
ID=17315253
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59258081A Expired - Fee Related JPH0644374B2 (ja) | 1984-12-06 | 1984-12-06 | デイスクプレ−ヤ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0644374B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0289367U (ja) * | 1988-12-28 | 1990-07-16 | ||
| JP3657881B2 (ja) * | 1998-06-12 | 2005-06-08 | 株式会社ルネサステクノロジ | オーバーサンプリングａ／ｄ，ｄ／ａ変換装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6066368A (ja) * | 1983-09-20 | 1985-04-16 | Matsushita Electric Ind Co Ltd | デイスクプレ−ヤ |
-
1984
- 1984-12-06 JP JP59258081A patent/JPH0644374B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61137279A (ja) | 1986-06-24 |
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