JPH0645619A - ツェナーダイオード - Google Patents
ツェナーダイオードInfo
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- JPH0645619A JPH0645619A JP19510292A JP19510292A JPH0645619A JP H0645619 A JPH0645619 A JP H0645619A JP 19510292 A JP19510292 A JP 19510292A JP 19510292 A JP19510292 A JP 19510292A JP H0645619 A JPH0645619 A JP H0645619A
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- conductivity
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- Pending
Links
- 238000009792 diffusion process Methods 0.000 claims description 41
- 239000004065 semiconductor Substances 0.000 claims description 5
- 238000000926 separation method Methods 0.000 claims description 5
- 239000000758 substrate Substances 0.000 claims 3
- 230000003071 parasitic effect Effects 0.000 abstract description 19
- 238000002955 isolation Methods 0.000 abstract description 5
- 230000007257 malfunction Effects 0.000 abstract description 5
- 230000015556 catabolic process Effects 0.000 abstract description 4
- 238000000034 method Methods 0.000 abstract 1
- 238000001514 detection method Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 4
- 230000003321 amplification Effects 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
Landscapes
- Element Separation (AREA)
Abstract
(57)【要約】
【目的】 バッテリで駆動する自動車用半導体集積回路
の過大電源電圧に対する過電圧検出回路は、バッテリの
変動によるシステムの誤動作を防ぐため、あるいは、消
費電力が許容損失を超えないようにするため、バッテリ
電圧が一定電圧以上になったことを検知して、駆動電流
を少なくしたり、負荷の駆動を止めたりすることが要求
されている。 【構成】 ツェナーダイオードのPN接合を構成するP
型拡散層5と、その周囲をとり囲むP型分離層8の間
で、上記P型拡散層5をとり囲むように形成された、ア
ノード端子1と接続されたN型拡散層4およびN型エピ
タキシャル層7と同電位のN型高濃度拡散層9を有する
構成になる。この構成により、寄生PNPトランジスタ
のエミッタには殆んど電流が流れないようになり、誤動
作がなくなる。
の過大電源電圧に対する過電圧検出回路は、バッテリの
変動によるシステムの誤動作を防ぐため、あるいは、消
費電力が許容損失を超えないようにするため、バッテリ
電圧が一定電圧以上になったことを検知して、駆動電流
を少なくしたり、負荷の駆動を止めたりすることが要求
されている。 【構成】 ツェナーダイオードのPN接合を構成するP
型拡散層5と、その周囲をとり囲むP型分離層8の間
で、上記P型拡散層5をとり囲むように形成された、ア
ノード端子1と接続されたN型拡散層4およびN型エピ
タキシャル層7と同電位のN型高濃度拡散層9を有する
構成になる。この構成により、寄生PNPトランジスタ
のエミッタには殆んど電流が流れないようになり、誤動
作がなくなる。
Description
【0001】
【産業上の利用分野】本発明はバッテリで駆動する自動
車用半導体集積回路の過大電源電圧に対する過電圧検出
回路を構成するツェナーダイオードに関する。
車用半導体集積回路の過大電源電圧に対する過電圧検出
回路を構成するツェナーダイオードに関する。
【0002】
【従来の技術】近年、バッテリで駆動する自動車用半導
体集積回路の過大電源電圧に対する過電圧検出回路は、
バッテリの変動によりシステムの誤動作を防ぐため、あ
るいは、消費電力が許容損失を超えないようにするた
め、バッテリ電圧が一定電圧以上になったことを検知し
て、駆動電流を少なくしたり、負荷の駆動を止めたりす
ることが要求されている。
体集積回路の過大電源電圧に対する過電圧検出回路は、
バッテリの変動によりシステムの誤動作を防ぐため、あ
るいは、消費電力が許容損失を超えないようにするた
め、バッテリ電圧が一定電圧以上になったことを検知し
て、駆動電流を少なくしたり、負荷の駆動を止めたりす
ることが要求されている。
【0003】以下にツェナーダイオードを使用した過電
圧検出回路について説明する。図2は過電圧検出回路の
回路図である。図2において、10は第1の電源、11
はN個のツェナーダイオード、12は出力トランジス
タ、13は負荷、14はスイッチ素子、15は電流源、
16は第2の電源、17は第3の電源である。
圧検出回路について説明する。図2は過電圧検出回路の
回路図である。図2において、10は第1の電源、11
はN個のツェナーダイオード、12は出力トランジス
タ、13は負荷、14はスイッチ素子、15は電流源、
16は第2の電源、17は第3の電源である。
【0004】以上のように構成された過電圧検出回路に
ついて、以下その動作について説明する。ここで、ツェ
ナーダイオードの逆方向バイアスでの降伏電圧をVzと
する。
ついて、以下その動作について説明する。ここで、ツェ
ナーダイオードの逆方向バイアスでの降伏電圧をVzと
する。
【0005】まず、第1の電源1の電圧値がN・Vz以
上のとき、ツェナーダイオード11が逆バイアスされ、
第1の電源10より、出力トランジスタ12にベース電
流を注入し負荷13を駆動する。次に、第1の電源10
の電圧値がN・Vz以下のとき、出力トランジスタ12
はスイッチ14でベース電流の注入を制御することによ
り負荷13を駆動する。図2のツェナーダイオードの断
面図、平面図を図3(a),(b)に示す。図3におい
て、1はアノード端子、2はカソード端子、3は接地端
子、4はN型拡散層、5はP型拡散層、6はN型エピタ
キシャル層、7はN型埋め込み層、8はP型分離層であ
る。ツェナーダイオードのアノード1はエピタキシャル
層6の電位と同電位であり、N型拡散層4とP型拡散層
5が逆バイアスされて、ツェナーダイオードの降伏電圧
Vzに電圧が制限される。
上のとき、ツェナーダイオード11が逆バイアスされ、
第1の電源10より、出力トランジスタ12にベース電
流を注入し負荷13を駆動する。次に、第1の電源10
の電圧値がN・Vz以下のとき、出力トランジスタ12
はスイッチ14でベース電流の注入を制御することによ
り負荷13を駆動する。図2のツェナーダイオードの断
面図、平面図を図3(a),(b)に示す。図3におい
て、1はアノード端子、2はカソード端子、3は接地端
子、4はN型拡散層、5はP型拡散層、6はN型エピタ
キシャル層、7はN型埋め込み層、8はP型分離層であ
る。ツェナーダイオードのアノード1はエピタキシャル
層6の電位と同電位であり、N型拡散層4とP型拡散層
5が逆バイアスされて、ツェナーダイオードの降伏電圧
Vzに電圧が制限される。
【0006】
【発明が解決しようとする課題】このような従来の構成
では、P型拡散層5とN型拡散層4が順バイアスされる
とP型分離層8がコレクタとなって寄生のPNPトラン
ジスタを構成する。従って、図4に示すようにツェナー
ダイオード11は(N−1)個の寄生PNPトランジス
タ18を構成する。これはダーリントン接続を構成し、
初段のベースにリーク電流が流れると増幅されて最終段
のエミッタ電流を引っ張ろうとする。このときに、電流
源がオンしているときに、本来出力トランジスタ12の
ベース電流を供給して出力トランジスタ12をオンしよ
うとするが、寄生PNPトランジスタ18がオンする
と、そのベース電流が寄生PNPトランジスタ18に流
れて出力トランジスタ12をオフしてしまうという欠点
を有していた。
では、P型拡散層5とN型拡散層4が順バイアスされる
とP型分離層8がコレクタとなって寄生のPNPトラン
ジスタを構成する。従って、図4に示すようにツェナー
ダイオード11は(N−1)個の寄生PNPトランジス
タ18を構成する。これはダーリントン接続を構成し、
初段のベースにリーク電流が流れると増幅されて最終段
のエミッタ電流を引っ張ろうとする。このときに、電流
源がオンしているときに、本来出力トランジスタ12の
ベース電流を供給して出力トランジスタ12をオンしよ
うとするが、寄生PNPトランジスタ18がオンする
と、そのベース電流が寄生PNPトランジスタ18に流
れて出力トランジスタ12をオフしてしまうという欠点
を有していた。
【0007】本発明は、このような課題を解決し、寄生
トランジスタのエミッタには殆んど電流が流れず、誤動
作のない、ツェナーダイオードを提供することを目的と
する。
トランジスタのエミッタには殆んど電流が流れず、誤動
作のない、ツェナーダイオードを提供することを目的と
する。
【0008】
【課題を解決するための手段】上記目的を達成するため
に本発明は、ツェナーダイオードのPN接合を構成する
P型拡散層と、その周囲をとり囲むP型分離層の間で、
上記P型拡散層をとり囲むように形成されたアノード端
子と接続されたN型拡散層およびN型エピタキシャル層
と同電位のN型高濃度拡散層を有する構成による。
に本発明は、ツェナーダイオードのPN接合を構成する
P型拡散層と、その周囲をとり囲むP型分離層の間で、
上記P型拡散層をとり囲むように形成されたアノード端
子と接続されたN型拡散層およびN型エピタキシャル層
と同電位のN型高濃度拡散層を有する構成による。
【0009】
【作用】この構成によって、N個のツェナーダイオード
は、リーク電流で寄生PNPトランジスタがオンして
も、ツェナーダイオードを構成するP型拡散層の周りを
N型高濃度拡散層で囲むことにより、寄生PNPトラン
ジスタのhFEが小さくなり、ほとんど寄生トランジス
タのエミッタには電流が流れず、ベース電流は全て出力
トランジスタのベースに流れ込み、誤動作を防ぐことが
できる。
は、リーク電流で寄生PNPトランジスタがオンして
も、ツェナーダイオードを構成するP型拡散層の周りを
N型高濃度拡散層で囲むことにより、寄生PNPトラン
ジスタのhFEが小さくなり、ほとんど寄生トランジス
タのエミッタには電流が流れず、ベース電流は全て出力
トランジスタのベースに流れ込み、誤動作を防ぐことが
できる。
【0010】
【実施例】以下本発明の一実施例について、図面を参照
しながら説明する。
しながら説明する。
【0011】図1に本発明のツェナーダイオードの断面
図および平面図を示す。図1において図3の従来例と同
一部分には同一番号を付し、説明を省略する。すなわち
本発明の特徴はP型拡散層5をとり囲んだN型高濃度拡
散層9を設けたことである。ツェナーダイオードのアノ
ード1はN型エピタキシャル層6の電位と同電位であ
り、N型高濃度拡散層9も同じく同電位である。N型拡
散層4とP型拡散層5が逆バイアスされて、ツェナーダ
イオードの降伏電圧Vzに電圧が制限される。しかし、
P型拡散層5とN型拡散層4が順バイアスされるとP型
分離層8がコレクタとなって寄生のPNPトランジスタ
を構成するが、N型拡散層4とP型拡散層5の周りをN
型高濃度拡散層9で囲むことにより、寄生PNPトラン
ジスタのhFEが小さくなる。これを図2の回路に実施
すると、ダーリントン接続を構成する寄生PNPトラン
ジスタの初段のベースにリーク電流が流れても増幅しな
いために、電流源がオンしているときに、ベース電流が
寄生PNPトランジスタ18に流れずに、本来の機能の
出力トランジスタ12のベース電流を供給して出力トラ
ンジスタ12をオンしようとする。
図および平面図を示す。図1において図3の従来例と同
一部分には同一番号を付し、説明を省略する。すなわち
本発明の特徴はP型拡散層5をとり囲んだN型高濃度拡
散層9を設けたことである。ツェナーダイオードのアノ
ード1はN型エピタキシャル層6の電位と同電位であ
り、N型高濃度拡散層9も同じく同電位である。N型拡
散層4とP型拡散層5が逆バイアスされて、ツェナーダ
イオードの降伏電圧Vzに電圧が制限される。しかし、
P型拡散層5とN型拡散層4が順バイアスされるとP型
分離層8がコレクタとなって寄生のPNPトランジスタ
を構成するが、N型拡散層4とP型拡散層5の周りをN
型高濃度拡散層9で囲むことにより、寄生PNPトラン
ジスタのhFEが小さくなる。これを図2の回路に実施
すると、ダーリントン接続を構成する寄生PNPトラン
ジスタの初段のベースにリーク電流が流れても増幅しな
いために、電流源がオンしているときに、ベース電流が
寄生PNPトランジスタ18に流れずに、本来の機能の
出力トランジスタ12のベース電流を供給して出力トラ
ンジスタ12をオンしようとする。
【0012】
【発明の効果】以上のように本発明は、ツェナーダイオ
ードのPN接合を構成するP型拡散層と、その周囲をと
り囲むP型分離層の間で、上記P型拡散層をとり囲むよ
うに形成されたアノード端子と接続されたN型拡散層お
よびN型エピタキシャル層と同電位のN型高濃度拡散層
を有する構成によるので、寄生PNPトランジスタのh
FEが小さくなり、寄生トランジスタのエミッタには殆
んど電流が流れず、誤動作のないツェナーダイオードを
提供できる。
ードのPN接合を構成するP型拡散層と、その周囲をと
り囲むP型分離層の間で、上記P型拡散層をとり囲むよ
うに形成されたアノード端子と接続されたN型拡散層お
よびN型エピタキシャル層と同電位のN型高濃度拡散層
を有する構成によるので、寄生PNPトランジスタのh
FEが小さくなり、寄生トランジスタのエミッタには殆
んど電流が流れず、誤動作のないツェナーダイオードを
提供できる。
【図面の簡単な説明】
【図1】(a)は本発明のツェナーダイオードの断面図 (b)は(a)のツェナーダイオードの平面図
【図2】図1のツェナーダイオードを使用した過電圧検
出回路図
出回路図
【図3】(a)は従来のツェナーダイオードの断面図 (b)は(a)のツェナーダイオードの平面図
【図4】図2の過電圧検出回路図において寄生PNPト
ランジスタを含めた等価回路図
ランジスタを含めた等価回路図
1 アノード端子 2 カソード端子 3 接地端子 4 N型拡散層(逆導電型拡散層) 5 P型拡散層(一導電型拡散層) 6 N型エピタキシャル層(逆導電型エピタキシャル
層) 7 N型埋め込み層(逆導電型埋め込み層) 8 P型分離層(一導電型分離層) 9 N型高濃度拡散層(逆導電型高濃度拡散層)
層) 7 N型埋め込み層(逆導電型埋め込み層) 8 P型分離層(一導電型分離層) 9 N型高濃度拡散層(逆導電型高濃度拡散層)
Claims (1)
- 【請求項1】一導電型半導体基板と、その一導電型半導
体基板上に形成された四方を一導電型分離層で分離され
た逆導電型エピタキシャル層と、その逆導電型エピタキ
シャル層内部に、下部を逆導電型埋め込み層によって前
記一導電型半導体基板と分離して形成された一導電型拡
散層と、その一導電型拡散層の上部所定部に接して形成
された逆導電型拡散層と、前記一導電型拡散層と前記一
導電型分離層の間で、前記一導電型拡散層をとり囲むよ
うに形成された前記逆導電型拡散層および前記逆導電型
エピタキシャル層と同電位の逆導電型高濃度拡散層とを
有し、前記逆導電型拡散層をアノードとし、前記一導電
型拡散層をカソードとするツェナーダイオード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19510292A JPH0645619A (ja) | 1992-07-22 | 1992-07-22 | ツェナーダイオード |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19510292A JPH0645619A (ja) | 1992-07-22 | 1992-07-22 | ツェナーダイオード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0645619A true JPH0645619A (ja) | 1994-02-18 |
Family
ID=16335558
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19510292A Pending JPH0645619A (ja) | 1992-07-22 | 1992-07-22 | ツェナーダイオード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0645619A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7019379B2 (en) | 2003-01-09 | 2006-03-28 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device comprising voltage regulator element |
-
1992
- 1992-07-22 JP JP19510292A patent/JPH0645619A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7019379B2 (en) | 2003-01-09 | 2006-03-28 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device comprising voltage regulator element |
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