JPH0651409B2 - 記録用装置 - Google Patents

記録用装置

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JPH0651409B2
JPH0651409B2 JP59230035A JP23003584A JPH0651409B2 JP H0651409 B2 JPH0651409 B2 JP H0651409B2 JP 59230035 A JP59230035 A JP 59230035A JP 23003584 A JP23003584 A JP 23003584A JP H0651409 B2 JPH0651409 B2 JP H0651409B2
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アグフア・ゲヴエルト・ナ−ムロゼ・ベンノ−トチヤツプ
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Description

【発明の詳細な説明】 本発明は動いている光受容体上に情報を線状に記録する
記録用装置に関するものである。
かかる記録用装置は従来から公知であって、細長い記録
ヘッドを有する。この記録ヘッドは光受容体の移動方向
に対して横断方向に配置されて光受容体の幅全体にわた
って延びている。この記録ヘッドには個別に付勢可能な
多数の点状光源（放射線源）がその長さ方向に沿って分
布されて設けられている。かかる記録ヘッドの下を光受
容体が通過して行く時に、情報信号に応答して点状光源
が発光し、光受容体を情報露光させるようになってい
る。記録ヘッドは静止しており、光受容体はこの記録ヘ
ッドに近接して通過するのであるがその運動は連続的で
も段階的でもよい。
良好な解像度を達成するためには点状光源は充分に小さ
くなければならず、また、光受容体上の照射点の間隔は
十分に小さくなければならない。点状光源からの光を光
受容体へ伝達するのに、レンズ、ファイバー光学、ある
いは自己集束ファイバーなどの手段が用いられる。
光受容体上では１mmにつき少なくとも１０個の照射点が
必要であると考えられているので、２１６mm幅の光受容
体（標準ＤＩＮ Ａ４）を情報露光するには少なくとも
約２２００個の個別に付勢可能な点状光源を記録ヘッド
に設けることが必要である。このため、発光ダイオード
の如き点状光源をモノリシック半導体チップの上に一列
に複数個形成し、更にかかる半導体チップの複数個を一
列に並べ、かくして２２００個の如き点状光源の列を得
ることが出来る。
普通、記録ヘッドに設けられる前記多数の点状光源は記
録ヘッドの長手方向に平行な二本の列に沿っで配置され
ており、かつ互い違いになされている（光受容体の進行
方向に見て二本の列にある点状光源が重ならないように
なっている）。このような平行の互い違いの配列は、点
状光源を単一の列に詰めて並べるよりも倍の間隔を有し
て、しかも同じ解像度を達成している。しかし、光受容
体の運動方向に見て下流に位置する列の点状光源の付勢
時期は上流に位置する列の点状光源の付勢に対して所定
時間遅延させなければならない。かくすることにより、
二列の点状光源による光受容体上の露光点を共通の一直
線上に置くことが出来る。かかる遅延についての詳細は
例えば英国特許出願第２０４２７４６Ａ号、欧州特許第
８２２０１３１４．９を参照されたい。
かかる従来の記録用装置では、遅延機能は集積された遅
延回路により達成されている。この集積遅延回路は点状
光源の列（遅延駆動される方の列）を駆動するための集
積された駆動子回路に配線接続されている。これに必要
な導体配線接続の生産にはコストがかかる。更に、記録
用装置の生産コスト及び生産の複雑さは、もしも連続的
に接続されたメモリーと、メモリーを通し段階的に信号
を前進させるための組合されたスイッチ手段とが遅延期
間を情報の一ライン期間以上に伸ばすように導入される
ならば、更に増大する。
本発明の目的は、製作するのがより容易となりかつより
安価となる複数例の点状光源を有した記録用装置を提供
することである。
かかる目的を達成する本発明の記録用装置は光受容体の
運動方向に対して横断方向に配置され二列の平行に互い
違いに配置された複数の個々のアドレス可能かつ付勢可
能な点状光源を有した記録ヘッドと、付与された一連の
データビット入力信号に応答して各列における点状光源
を同時に付勢する駆動子回路とを具備し、点状光源の第
一の列と第二の列との間の距離を補償するために第二の
列の光源の付勢に対して第一の列の光源の付勢を遅延す
るための遅延手段を有する記録用装置において、 −各列の点状光源に対して設けられた前記駆動子回路
は、データビット信号を直列に読み込むシフトレジスタ
ーと、各点状光源のための各駆動子と、前記シフトレジ
スターから前記駆動子へ伝達されるデータビット信号を
所定の遅延期間保持しておく遅延手段とを組み入れた同
一種類の制御チップによりもたらされ、 −この制御チップは前記遅延手段が動作するモードと前
記遅延手段が非動作であるモードとのいずれかを選択で
き、そのために制御チップは二つの電圧入力点を備えて
おり、そのいずれかにモード制御電圧が印加されるよう
になっており、 −そして、第一の列の点状光源に対してあてがわれた制
御チップには遅延手段が動作するモードの方の電圧入力
点に電圧供給手段が接続されてこれにモード制御電圧を
印加し、第二の列の点状光源に対してあてがわれた制御
チップには遅延手段が非動作であるモードの方の電圧入
力点に電圧供給手段が接続されてこれにモード制御電圧
を印加した ことを特徴とする。
本発明の記録用装置の製造においては、微細な配線作業
は要求されなくなる。従来の技術においては遅延付勢さ
れる点状光源の列の為の駆動子回路に、必要な遅延回路
を接続する微細な配線作業が要求されていたのである。
これに対し、本発明では集積駆動子回路の一部として遅
延手段が制御チップに組み込まれているのである。更
に、点状光源の両方の列に標準設計の同一の標準設計の
制御チップがあてがわれるので、顕著な原価低廉化が達
成されるのである。これは遅延回路を有する制御チップ
と、遅延回路を有しない制御チップとの二種類を製造す
るよりも安価になり、かつこの二種類を区別して記録用
装置の製造工程に供給したりする必要性がなくなるから
である。
なお、点状光源の列は二列以上であってもよい。このよ
うな場合、一つの列を除く他のすべての列の点状光源の
ための制御チップは遅延動作モードにセットされる。勿
論、各列の遅延期間は、遅延なしの列との間の距離に応
じて異なる。説明を簡単にするため以下、二列の点状光
源について説明する。普通、二列の点状光源を使用すれ
ば十分でありかつ望ましく、それで制御チップも、モー
ド制御電圧を受ける電圧入力点も二つでよい。
一方の列の点状光源の付勢と他方の列の点状光源の付勢
との間の遅延時間は、光受容体の速度と光受容体の進行
方向における点状光源の列の像の間の距離とに依存す
る。このような遅延時間は例えば二ライン期間である。
点状光源は好ましくはLED である。
制御チップは好ましくは直列入力／並列出力のシフトレ
ジスターと、少なくとも一つの平行移送の遅延レジスタ
ーと、平行移送のラッチ・レジスターと、点状光源のた
めの駆動子とからなる。
点状光源の異なる列のための制御チップは、好ましく
は、点状光源のそれら二列に配置した同じ側の端から像
ラインのデータビット信号を受け取るようになってい
る。同時に、制御チップは、好ましくは、点状光源の各
列の近くに横に並べて配置される。このためには、シフ
トレジスターはいずれの端においてもデータビット信号
を受け取ることが出来しかも受け取った信号をどちらの
方向にもシフト出来ることを要求される。
制御チップは好ましくは、その遅延回路の動作、非動作
のモードを選択するための電圧入力点が、シフトレジス
ターのシフト方向を切り換えるための電圧入力点をも兼
ねている。従って、例えば遅延回路が動作するモードを
選択する電圧入力点に電圧を印加すると、シフト方向が
右となり、遅延回路が非動作であるモードを選択する電
圧入力点に電圧を印加すると、シフト方向が左となる。
点状光源の全体配列は、好ましくは、多数のモジュール
を端と端とを対接して一列に配置して得られる。この各
モジュールは一群の点状光源と、それに対する制御チッ
プとを担持している。かかるモジュールは記録用装置を
組み立てるのを容易にする。
好ましくは、各モジュールが接続子装置を含み、この接
続子装置を介して隣接する制御チップが相互に接続さ
れ、また制御チップが電圧供給ラインへ接続される。こ
れは、もしも欠陥のあるモジュールを取り換える場合
に、他のモジュールの細線接続に影響を及ぼすことなく
交換できるという利点を有する。また、接続子装置の各
々は点状光源への電流レベルを調整する手段を備えてい
ることも有益である。
第１図に示されている印刷機械は、付勢可能点状光源１
１の多数個を備えている露光ヘッド１０からなる記録用
装置と、点状光源の像を結ぶ光学的移送手段１２と、ド
ラム２０の形になった光受容体とを含んでいる。光受容
体用の円筒表面の公知の材料は、ドープしたセレン、ポ
リビニルカルバゾル、CdS ，CdSe，SeTe、等である。
印刷機械の動きは次の通りである。コロナ放電ステーシ
ョン１３はドラム２０の表面を帯電させる。ドラムの回
転の向きは矢印１４に示されている。ドラムはモーター
（図示せず）により駆動されている。露光ヘッド１０に
より露光されるドラム表面の区域は放電されるが、他
方、他の非露光区域はそれらの電荷を維持している。か
くして生じられた静電荷電模様は現像ステーション１５
で、トナー１６をドラム上の荷電模様に接触させること
により、現像される。
コロナ移送ステーション１７はトナー模様をドラム２０
の表面から紙１８上へと移送する。コロナ分離ステーシ
ョン１９は紙１８をドラムから分離させる。溶融ステー
ション２１は紙１８上のトナーを溶融して、永久コピー
となす。清掃ステーション９はドラム表面上になお残っ
ているトナー総てをそこから除去する。
光受容体は何らかの他の形、例えば電荷像を適当な支持
体上に移送するベルトの形、または、最終像が形成され
定着される光電導性紙の形をとることも出来よう。そう
した光電導性紙は、例えば、ZnO ，ハロゲン化銀、等の
感光性層を塗布した支持体を含みうる。
露光ヘッド１０と光学的移送手段１２の拡大斜視図が第
２図に示されている。露光ヘッド１０は断面が溝を有し
た細長いバー２２を含み、その溝に複数個の露光モジュ
ール２３が互いに連なって装着されている。各モジュー
ル２３は更に説明するように点状光源を二列含んでい
る。総てのモジュール２３は点状光源が二つの平行な列
２４及び２５を形成する。列２４，２５はドラム２０の
軸に平行である。
光学的移送手段１２は、光学軸がドラムの中心軸に向っ
ている自己焦点付けファイバーを複数個を備えている。
光学移送手段１２は点状光源の列２４をドラム２０上に
線２６で結像させ、点状光源の列２５を線２７で結像さ
せる。二本の線２６，２７は図では点で表してある。
光学的移送手段１２から見た露光ヘッド１０の図は第３
図に詳しく表わされている。バー２２の中に、複数個の
モジュール２３が互いに連なって全体の露光長ｌを形成
する。この長さｌはドラム２０の望む幅に該当する。露
光ヘッド１０を通過するドラム２０の運動の方向は、矢
印２８により示されている。バー２２は金属製でありそ
れにより三つの重要な性質、すなわち、良熱伝導性、良
寸法安定性、及び良電気伝導度を備えている。バー２２
には任意的に翼などを備えて、バー２２から空気への熱
移送を改良するようにしてもよい。バー２２に適する材
料は、例えば、真鍮、アルミニウム及び銅である。モジ
ュール２３は電気伝導性の迅速硬化エポキシ接着剤によ
り、バー２２の溝に適当にとめられている。記録用装置
への露光ヘッド１０の装着は、ヘッド１０の位置付けが
僅かばかり調整可能であるような具合になされる。それ
により点状光源の列２４及び２５がドラム２０の円筒表
面に正確に平行にならしめる。
露光ヘッド１０の一つのモジュール２３の拡大図が第４
図に描かれている。モジュール２３は金属底板２９を含
み、これに点状光源チップ３１が四つ、端と端とが接合
関係になって装着されている。各点状光源チップ３１は
点状光源の二つの列２４，２５を有している。なお、点
状光源とはこの実施例では発光ダイオードであるので、
LED なる用語を点状光源に対して使用する。LED は単結
晶チップ上に造られている。LED の二列は互い違いにさ
れている。LED チップ３１は示されている如く、両端が
斜めに切断されていて、チップ３１らが相互に隣接して
装着されると、それらのLED は、各列の隣のLED の間の
近接関係にも拘らず、二つの中断されていない列を形成
する（欧州特許出願第８２２０１３２．９号を身よ）。
チップ３１を四つ有したモジュール２３は、更に、バー
２２内で、複数個がお互いに近接して取付けられ、それ
らの端部のLED チップ３１の斜めに切られた端部ヘリは
お互いに接合している。かくの如くにして、等しく間を
あけたLED の二つの中断されていない列が記録ヘッドの
全長に渉って得られる。各LED の底チップ材料（本体の
例ではLED の陰極）への電気接続はバー２２（第３図）
を介して達成される。
LED 用の制御手段は二つの集積回路３４及び３５であ
る。回路３４は列２４のLED を制御し、回路３５は列２
５のLED を制御している。集積回路３４と３５も、チッ
プの形になって居り（ここでは「制御チップ」と呼ばれ
る）、それは同じような底板２９に付着されてもよい。
制御チップ３４，３５の各々は一つのモジュール２３の
四つのLED チップ３１を蔽う長さを有する。各モジュー
ル２３は厚膜構造の接続端子４４，４５を備えている。
これら接続子装置は制御チップを電圧供給ラインに電気
接続する。また、この接続子装置を介して隣接する制御
チップが相互に接続される。
LED チップ３１と制御チップ３４，３５とを底板２９上
に取付けてモジュール２３を形成したり、モジュール２
３をバー２２上に装着して記録ヘッド１０を造ったりす
るのは部分品の微細な寸法に鑑み、顕微鏡下にて行われ
ることが理解されよう。顕微鏡はまた制御チップ３４，
３５とLED チップ３１の間の電気接続をするためにも必
要である。各LED チップ３１と制御チップ３４，３５の
相当するパッド間の電気接続はアルミニウムの細線を用
いた公知の技法で達成することが出来る。
第５図は記録ヘッド１０のモジュール２３の下半分の電
気回路図を詳細に描いている。
制御チップ３５（制御チップ３４はチップ３５と同じ）
は、６４段階直列入／並列出シフトレジスター３６（デ
ータビット入出力用の端部ターミナル３７及び３８付
き）と、二つの遅延レジスター３９及び４０と、ラッチ
レジスター４１と、一個の矩形ブロックで表わされてい
る６４個の個別の駆動子４２（LED 列２５内では各LED
ごとに１個）と、かつ、該列２５内のLED 用の６４個の
出力結合用パッド４３とを含んでいる。結合用パッド４
３は二つの互い違いにした列に配列されていて、それに
よりそれらの間に一層多くの間隔を提供している。
制御チップ３５は下記の入力結合用パッド３７，３８，
４６〜５４を含む。すなわちシフトレジスター３６の入
出力用の端部ターミナルを形成するパッド３７及び３
８、駆動子４２の制御用トリガ信号を受信するパッド４
６、電流レベル制御信号を受信するパッド４７、レジス
ター３６を通る連続信号シフトを制御するクロック信号
用のパッド４８、駆動子４２及びLED の供給電圧用のパ
ッド４９、レジスターの供給電圧用のパッド５０、シフ
トレジスター３６を通る信号のシフト方向を制御し、か
つまた同時に、遅延レジスター３９及び４０の動作及び
非動作モードを制御するシフト方向制御電圧兼モード制
御電圧を受ける電圧入力点すなわち二つのパッド５１及
び５２、接地用のパッド５３、そして最後に一台のレジ
スターから他へのデータビットの移送を制御する負荷制
御用のパッド５４である。
接続子装置４５（４４も同じ）は接着剤結合によりモジ
ュール２９上に固定されている磁製支持体上に造られて
いる。
接続子装置４５は入力結合用パッドの列５５と出力結合
用パッドの列５６とを含み、列５５，５６の両端位置は
チップ３５の入力結合用パッド３７，３８の位置に相当
する。接続子装置４５の向き合った入力及び出力結合用
パッドはお互いに直接接合になっている。但し、パッド
５７及び５８を除く。これらは四つの直列抵抗体５９を
介して接続されている。
入力結合用パッド５５らは、記録ヘッドの全長に渉って
伸びており、必要な供給電圧と制御信号とを総てのモジ
ュールの該当する下部半分に対して提供する九つの導体
経路を有する印刷回路電導体条片７０へ接続されてい
る。類似の導体条片６０（第６図）が記録ヘッドの上部
半分に対して設けられている。
チップ３５の動作を以下の通り詳細に説明する。説明し
易いように、第５図にあるシフトレジスター３６内の信
号シフトは左方から右方へと起るものと仮定する。
結合用パッド３７はチップ３５のデータビット入力端子
を形成し、先行のチップ３５′の出力シフトレジスター
端子を構成する結合用パッド６１へ接続されている。こ
れは接続子装置４５′と４５及び線接続７４，７５及び
７６を経て起る。パッド３７で受信された信号は入力４
８にて印加されたクロック信号の制御下にシフトレジス
ター３６を通し順次右側へと段階的にシフトされる。レ
ジスターが数回（例えば、本例では６４回）、段階を経
たならば、次の段階付けは出力パッド３８にて、前記の
第一の受信信号をレジスター３６から去るようにさせ、
次のチップ３５″のシフトレジスターへ（入力パッド６
２にて）入るようにさせる。チップ３５″のシフトレジ
スターは、更に次のチップ３５′′′のシフトレジスタ
ーに同様に接続されている。
なお、レジスター３６を信号が前述の如く右方向にシフ
トして行くのは、直流設定電圧が入力パッド５２に掛け
られていることによる。直流設定電圧が入力パッド５１
に印加されるとレジスター３６を通る信号シフトは右か
ら左になる。実際に、この記録ヘッドでは直流電圧がパ
ッド５２に印加されているのでチップ３５の内部設計の
せいで、パッド４８にてのクロック信号に応答して左か
ら右へと信号シフトを行い、又、同時に、遅延レジスタ
ー３９及び４０を非動作にさせる。
結合用パッド５４はシフトレジスター３６内でデータ信
号を処理することを指示する「負荷」信号を受信する。
負荷信号、換言すれば「ライン」信号はレジスター３６
から総てのデータビットをLED 駆動子４２へ平行移送さ
せる。チップ３５の遅延レジスター３９及び４０は前述
の通り非動作であるから、シフトレジスター３６が受け
取ったデータビットはシフトレジスター３６から直接に
ラッチレジスター４１へ移送される。奇数LED の列２５
に対する駆動子４はラッチレジスター４１へ直接に接続
されている。しかしながら、駆動子４２は各ライン期間
の間、「負荷」信号に応答してラッチレジスター４１か
ら関連するデータビット信号を受信するけれども、これ
らの信号は駆動子４２が「トリガ」信号によって賦活さ
れる迄はそれぞれのLED へは出されない。奇数LED 用の
駆動子４２の総てを賦活するこのトリガ信号は、光受容
体速度監視器（図示せず）からの出力信号により決めら
れる時点で出される。なお、この時点は光受容体の速度
の如何なる先行変動にも拘らず、光受容体上に既定の均
質な記録線間隔を保つようになっている（詳しくは特開
昭６０−１３２４６０号公報参照）。
既に示した如く、第４図のチップ３４は、チップ３５と
同一である。しかしながら、チップ３４はチップ３５に
対して端と端とが反転されており、とはいえデータビッ
ト信号は記録ヘッド１０の同じ左端から供給されてい
る。従って、チップ３４の場合には、結合用パッド３８
がそれのデータビット入力端子として役立ち、逆に結合
用パッド３７がそれのデータビット出力端子として役立
つ。この為には、チップ３４では直流設定電圧がパッド
５１へ印加されていて、チップ３４のシフトレジスター
３６を通る信号シフトが、チップ３４がチップ３５に対
し端と端とが反転されているにも拘らず、左から右へと
起る。更に、チップ３４のパッド５１への設定電圧の印
加は遅延レジスター３９と４０とを動作状態にさせる。
従って、チップ３４のシフトレジスター３６により受信
されたデータビット信号は、レジスター３６からラッチ
レジスター４１へ直接に移送されないで、先ずそれの遅
延レジスター３９へ移送され、次いで遅延レジスター４
０へ、それから、ラッチレジスター４１へ移送される。
かかる移送の各々は上述した結合用パッド５４上の負荷
信号に応答して起る。そうした負荷信号の毎にチップ３
４のシフトレジスターからデータビット信号を第一遅延
レジスター３９へ移送し、また第一遅延レジスター３９
が既に受信していたデータビット信号を第二遅延レジス
ター４０へ移送し、また第二遅延レジスター４０がもっ
と前に受信していたデータビット信号をラッチレジスタ
ー４１へ移送するのを同時に惹起させる。そして、その
ラッチレジスターへ移送された信号は、これらの信号に
応答する接続された偶数LED を、それらの駆動子が速度
監視器（図示せず）により検知された光受容体の速度変
動に応答して出されたトリガ信号によりトリガされる
と、直ぐに駆動出来る。トリガ信号のタイミングは同じ
記録ラインに関する奇数及び偶数データビット信号が、
光受容体上に正確な横一線配列に記録されることを確実
ならしめるものである。奇数LED の付勢と同じ記録ライ
ンに属するデータビット信号に応答する偶数LED の付勢
との間には、基本的に二ライン期間の遅延があるが、こ
れに光受容体の速度変動をも補償するのに必要なプラス
またはマイナスの何らかの補正がることが注目されよう
（特開昭６０−１３２４６０号公報参照）。
相シフトされた準クロック信号がチップ３４及び３５内
に発生され、それが種々のレジスターを制御するので、
種々のレジスターを空にすることと再負荷することと
は、ラッチレジスターからシフトレジスター３６へと起
ることが理解されよう。
最後に、入力パッド４７に電流レベル制御信号が印加さ
れる。この信号は駆動子４２によりそれらの該当するLE
D 中に生ぜられる平均電流を決める。「平均」電流を参
照するのは、駆動子４２とLED との製作の公差のせい
で、LED を通る実際の電流は望む公称値よりも例えば１
０％も大きかったり小さかったりするからである。制御
信号の設定は直列の四つの異なる抵抗体５９を種々（１
５通り）に短絡させることにより変えられる。かくし
て、制御電流信号は線６４上の直流電圧（例えば５Ｖ）
と抵抗体５９の設定された抵抗との商である。LED を通
る実際電流は、チップ３５の電子回路中に設定された固
定因子による増幅の結果として該当する制御電流より数
倍大きい。例えば、５００μA の制御電流は３mAの平均
LED 電流を生じ得る。
接続子装置４５を通し各モジュールの制御手段に接続を
行う記述した技法は、例えば、英国特許出願第８２０５
０２４号に開示されている。これはモジュール２３をお
互いに直接側方接続するよりも利点を有し、欠陥モジュ
ールを良品で置換することが何時必要になっても、他の
モジュールへの細線接続を元のままに放置して行うこと
が出来る。
チップ３４と同一であるチップ３５を、本発明によって
使用することは、標準製造の重要な利点を与える。チッ
プ３５は不用な遅延レジスターを有していて、チップ３
４を贅沢に使用しているが、この無駄を補償する以上の
ものがある。
装置の電子ブロック回路が第６図に示されている。この
図において、６５は文字発生器、６６は制御ユニットで
ある。制御ユニット６６においてクロック信号、供給電
圧、およびトリガ、負荷信号が生ぜしめられる。これら
は線６７，６８（単純化されている）を介して印刷回路
電導体条片６０，７０へ、そして制御チップ３４，３５
へと供給される。クロック信号は線６９を介して半導体
スイッチ７１を制御する。この半導体スイッチは線７
２，７３を介してデータ信号を交互にLED の列２５，２
４へ与える。本例の記録ヘッド１０は３４５６個のLED
を有し、これが二つの列２５，２４に分けられて、各列
に１７２８個のLED が並んでいる。
実用的には、本装置は多くの他の回路を、設定及び再設
定回路，同期回路，安定回路，欠陥信号用回路等のよう
に種々の操作の制御用に含むであろう。そうした回路は
斯界技術では公知であり、それらの記述は、本装置の操
作の理解に対しては必要でない。
文字発生器６５は光受容体上に記録されるべき第一の像
ラインのデータ信号を生ずる。スイッチ７１はクロック
周波数、例えば３Mhz の大きさの程度の周波数で切り換
えられ、第一の像ラインの第１の像点の信号を線７２に
与え、第二の像点の信号を線７３に与え、第三の像点の
信号を線７２上に、第四の像点の信号を線７３に与える
というように交互に、第３４５６の像点の信号まで制御
する。かくして奇数番目の像点が制御手段３５のシフト
レジスター３６内に読み込まれ、偶数番目の像点が制御
チップ３４のシフトレジスター３６内に読み込まれてし
まう。なお、像点の３４５６個という数字は、記録ヘッ
ドが２７個の露光モジュールを有し、かつ各モジュール
が１２８個のLED を有することによる。
適切な負荷インパルス信号が制御装置６６により線６７
及び６８を経て制御チップ３４及び３５の入力パッド５
４へ送られると、チップ３５はデータ信号をシフトレジ
スター３６からラッチレジスター４１へと直接に平行に
通し、駆動子４２のトリガで該当する奇数LED へ印加さ
れるが、チップ３４はデータ信号をシフトレジスター３
６から第一遅延レジスター３９へと平行に通すようにな
っている。
光受容体が記録ラインの厚みに相当する距離（ラスター
ラインピッチ）だけ前進されると、チップ３５のラッチ
レジスター４１は適当な信号によって再設定され、ま
た、記録されるべき第二の像ラインを表わすデータ信号
が発生器６５により生ぜられる。
かくして第二の像ラインの信号は、制御チップ３４及び
３５内に第一の像ラインの信号と同じ具合に読み込まれ
る。そして、別の負荷インパルス信号が入力パッド５４
へ送信されると、制御チップ３５のシフトレジスター３
６内のデータビット信号は、直接にラッチレジスター４
１へ移送され、駆動子４２がトリガされると奇数LED ら
の付勢を直ぐに惹起する。なお、このトリガは速度監視
器によって検出される光受容体速度の変動に応じてお
り、光受容体に記録される像ラインの間隔が所定の間隔
を維持するようにする。しかしながら、制御チップ３４
の入力パッド５４へ負荷インパルスが送信されると、チ
ップ３４のシフトレジスター３６内に記憶された第二の
像ラインのデータビット信号を遅延レジスター３９へ移
送し、レジスター３９に前に記憶されていた信号を次の
遅延レジスター４０へ移送する。
それから第三の像ラインのデータビット信号が発生器６
５から制御チップ中へ供給される。入力パッド５４上に
次の負荷インパルス信号を生ぜしめると、制御チップ３
５の情報信号は前述と同様に直接に光受容体に記録さ
れ、他方、制御チップ３４のレジスターの各々内に記憶
された信号は一段階前進される。つまりシフトレジスタ
ー３６内に記憶されていた信号は、遅延レジスター３９
へ移送され、レジスター３９内に前に記憶されていた信
号は遅延レジスター４０へ移送され、レジスター４０内
に前に記憶された信号はラッチレジスター４１へ移され
て、駆動子４２がトリガされると直ちに光受容体に記録
される。なお、このトリガは速度監視器により検出され
る光受容体速度の変動に応じており、光受容体に記録さ
れる一つの同じ像ラインの奇数像点と偶数像点とが正し
い横の一線配列を確実ならしめる。このように一つの像
ラインの偶数像点の記録は、奇数像点の記録に対して二
ライン期間（ただし、光受容体速度の変動を自動調整）
だけ遅延される。この遅延はLED の二つの列２４，２５
の間の距離（これは光受容体の連続するラスターライン
の間の二倍である）を補償する。
第四の像ラインおよびその後の像ラインの記録は同じよ
うに行われる。
下記のデータは、図示した本発明の一実施例のものであ
る。
記録ヘッド： 正味記録長さｌ：２１６mm 各列のLED 数：１７２８ １mmの記録長さ当りのLED 数：１６ モジュールの数：２７ 列間隔＝１２５μｍ 互い違い：６２．５μｍ シフトレジスター３６、遅延レジスター３９，４０、及
びラッチレジスター４１：６４ビットクロック周波数：
３Mhz 抵抗体６９：４Kohm，２Kohm，１Kohm及び0.5 Kohm 光学移送手段１２：セルフォック、SLA 20型、日本板ガ
ラス会社製 記録速度：毎秒１０cm ただし、本発明は上記の態様に制限されるものではな
い。
各モジュール２３は、記された如き４個の小さいチップ
を配列する代りに一つの大きいチップにしてもよい。モ
ジュールはまた、LED の単一列を有するチップを二列平
行に並べてもよい。この異なる列のチップは欧州特許出
願第８２２０１３２４．９号に開示されている如く、互
い違いにした関係になっている。
各制御チップは、LED の列２４，２５間の間隔に従っ
て、多かれ少なかれ二つの遅延レジスターを内蔵してい
る。
もしも抵抗体５９の如き電流レベル調整が必要でないな
らば、接続子装置４５は省略出来、制御チップ３４，３
５は６０または７０のような印刷回路電導体条片へ直接
接続出来る。
【図面の簡単な説明】
第１図は本発明の記録用装置を備えた印刷機械の概略図
である。 第２図は第１図の印刷機械のうち本発明の記録用装置と
その周辺部の拡大斜視図である。 第３図は第２図のうち本発明の記録用装置に係る露光ヘ
ッドを示す平面図である。 第４図は第３図の露光ヘッドを構成する一つのモジュー
ルを拡大して示す図である。 第５図は第４図のモジュールの下半分の電子回路を詳細
に示す図である。 第６図は本発明の記録用装置の全体的な電子ブロック回
路図である。 １０は露光ヘッド、１１は点状光源、１２は光学的移送
手段、２０は光受容体、２４，２５は点状光源の列、３
４，３５は制御チップ、３６はシフトレジスター、３
９，４０は遅延レジスター、４２は駆動子、５１，５２
はモード制御電圧兼シフト方向制御電圧が選択して印加
される電圧入力点。
フロントページの続き (72)発明者 エチエンヌ・マリ・ド・コツク ベルギー国ベ 2520 エドジアン、ルナー ト、ド、リユデルラーン 16 (56)参考文献 特開 昭57−26874（ＪＰ，Ａ) 特開 昭58−134766（ＪＰ，Ａ) 特開 昭57−5184（ＪＰ，Ａ) 特開 昭58−142872（ＪＰ，Ａ)

Claims (7)

    【特許請求の範囲】
  1. 【請求項１】動いている光受容体上に線状に情報を記録
    する記録用装置であって、該装置は互違いにして平行列
    （２４，２５）になって配列され、光受容体をそれの運
    動の間に該列（２４，２５）に対してそれに垂直な方向
    によぎっている点を照射するようになっている多数個の
    個別にアドレス可能で付勢可能な点状放射線源（１１）
    をつけた記録ヘッド（１０）と、情報の一ライン期間の
    間に駆動子回路に連続的に印加されたそれぞれのデータ
    ビット入力信号に応答して各列の放射線源を同時に付勢
    する駆動子回路とを含んでおり、第一の該列（２４）の
    放射線源の付勢を第二の該列（２５）の線源付勢に対し
    て遅延しそれによりそうした列の間の距離に対して補償
    するところの遅延手段（３９，４０）がある記録用装置
    において、放射線源の異る列（２４，２５）に対する駆
    動子回路は、その各々がデータビット信号を連続的に読
    込むためのシフトレジスター（３６）と、複数個の放射
    線源に対する駆動子（４２）と、該シフトレジスター
    （３６）と該駆動子（４２）の間に置かれていて該シフ
    トレジスター（３６）から移送されたデータビット信号
    をそうした信号が該駆動子へ伝送される前の遅延期間の
    間保持する遅延手段（３９，４０）とを内蔵した同一の
    制御チップ（３４，３５）によりもたらされ、該制御チ
    ップ（３４，３５）の各々は種々のモードで働くことが
    出来るように形成されていて、その一つのモードに於て
    は該遅延手段（３９，４０）は動作し、他のモードでは
    そうした遅延手段は非動作的であり、また、いずれのモ
    ードで働くかはモード制御電圧を受けるために制御チッ
    プに設けられた種々の電圧入力点（５１，５２）のどれ
    が選ばれるかに依存していることを特徴とするところの
    記録用装置。
  2. 【請求項２】各々の制御チップ（３４，３５）は、直列
    入／並列出シフトレジスター手段（３６）と、少くとも
    一つの平行移送遅延レジスター（３９，４０）と、平行
    移送ラッチレジスター（４１）と、組合されている放射
    線源に対する駆動子（４２）とを含んでいるようになっ
    ているところの特許請求の範囲第１項記載の記録用装
    置。
  3. 【請求項３】放射線源（１１）の各列（２４，２５）の
    制御チップ（３４，３５）はその列の側部近くに配置さ
    れ、各制御チップは両端に端部ターミナル（３７，３
    ８）を有し、これら端部ターミナルを介して制御チップ
    はデータビット信号伝達ライン（７２，７２，７４，７
    ５）に接続されており、制御チップに設けられた二つの
    電圧入力点（５１，５２）の一つが選択されてシフト方
    向制御電圧を受けることに応じて各制御チップはそのシ
    フトレジスターに沿っていずれの方向にもデータビット
    信号をシフトさせることが出来、かつ各列の放射線源に
    対する制御チップ（３４，３５）は、データビット信号
    の供給がすべての制御チップに対して放射線源の全体配
    列の同じ端部から起りかつ総てのそうした信号が全体配
    列に沿って同じ方向にシフトしていくように、前記端部
    ターミナルを介してデータビット信号供給ラインに接続
    され、かつ前記電圧入力点を介して電圧供給手段に接続
    されている特許請求の範囲第１項又は第２項記載の記録
    用装置。
  4. 【請求項４】制御チップ（３４，３５）はモード制御電
    圧を受ける電圧入力点（５１，５２）とシフト方向制御
    電圧を受ける電圧入力点とが同じ電圧入力点になってい
    る特許請求の範囲第３項記載の記録用装置。
  5. 【請求項５】一列に配置された複数のモジュール（２
    ３）を有し、各モジュールは多数の放射線源（１１）と
    これらに組合された制御チップ（３４，３５）とを担持
    している特許請求の範囲第１項乃至第４項のいずれか一
    項に記載の記録用装置。
  6. 【請求項６】該一列に配置されたモジュールの各モジュ
    ール（２３）は、放射線源（１１）の各列（２４，２
    ５）に対して、接続子装置（４４，４５）を含み、それ
    を経て、その列の制御チップらはお互いにと、電圧供給
    ラインとへ導電的に接続されている特許請求の範囲第５
    項記載の記録用装置。
  7. 【請求項７】該接続子装置（４４，４５）の各々は、そ
    の接続子装置を経て供給されている放射線源への電流レ
    ベルを容易に調整することを許す手段（５９）が設けら
    れている特許請求の範囲第６項記載の記録用装置。
JP59230035A 1983-11-01 1984-10-31 記録用装置 Expired - Lifetime JPH0651409B2 (ja)

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EP83201562.2 1983-11-01
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