JPH0654584B2 - コード・データ記録装置 - Google Patents
コード・データ記録装置Info
- Publication number
- JPH0654584B2 JPH0654584B2 JP10302988A JP10302988A JPH0654584B2 JP H0654584 B2 JPH0654584 B2 JP H0654584B2 JP 10302988 A JP10302988 A JP 10302988A JP 10302988 A JP10302988 A JP 10302988A JP H0654584 B2 JPH0654584 B2 JP H0654584B2
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- 238000001514 detection method Methods 0.000 claims description 26
- 230000005540 biological transmission Effects 0.000 claims 1
- 238000013500 data storage Methods 0.000 claims 1
- 230000007547 defect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 230000004044 response Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は、デジタルオーディオテープデッキ（以下ＤＡ
Ｔという）のデジタルデータ入出力フォーマットである
デジタルオーディオインタフェース（以下ＤＡＩとい
う）の規格を利用したコード・データ記録装置に関す
る。
Ｔという）のデジタルデータ入出力フォーマットである
デジタルオーディオインタフェース（以下ＤＡＩとい
う）の規格を利用したコード・データ記録装置に関す
る。
従来の技術 本来ＤＡＴはオーディオ用に設計されていることから、
パソコンなどからのコード・データを単にインタフェー
スの変換を行うだけでコード・データの記録に用いる
と、コード・データの入力されたタイミングがＤＡＩの
フォーマットに変換されるタイミングとなり、そのまま
のタイミングでコード・データを記録するだけであっ
た。
パソコンなどからのコード・データを単にインタフェー
スの変換を行うだけでコード・データの記録に用いる
と、コード・データの入力されたタイミングがＤＡＩの
フォーマットに変換されるタイミングとなり、そのまま
のタイミングでコード・データを記録するだけであっ
た。
発明が解決しようとする課題 従来の構成によるコード・データ記録装置では、コード
・データはＤＡＩ送出回路側で決められる使用者の把握
できない位置に記録され、コード・データ記録装置であ
りながら、記録位置を指定できないという問題点を有し
ていた。
・データはＤＡＩ送出回路側で決められる使用者の把握
できない位置に記録され、コード・データ記録装置であ
りながら、記録位置を指定できないという問題点を有し
ていた。
本発明は上記従来技術に鑑み、ＤＡＩの規格を利用しデ
ータ記録領域内のある指定した領域にコード・データを
記録することの出来るコード・データ記録装置を提供す
ることを目的とする。
ータ記録領域内のある指定した領域にコード・データを
記録することの出来るコード・データ記録装置を提供す
ることを目的とする。
課題を解決するための手段 本発明は、上記問題を解決するため、データ入力回路
と、制御回路と、データ出力回路と、ブロックＩＤ検出
回路と、タイミング発生回路と、一致検出回路と、識別
データ発生回路を備えたコード・データ記録装置であ
る。
と、制御回路と、データ出力回路と、ブロックＩＤ検出
回路と、タイミング発生回路と、一致検出回路と、識別
データ発生回路を備えたコード・データ記録装置であ
る。
作用 本発明は前記した構成により、コード・データをデータ
記録領域内のある領域を指定して記録することにより、
コード・データを管理することが出来る。
記録領域内のある領域を指定して記録することにより、
コード・データを管理することが出来る。
実施例 第１図は、本発明の第１の実施例におけるコード・デー
タ記録装置の構成図を示すものである。第１図におい
て、１１は、データ入力回路、１２は、データ入力回路
１１からのコード・データと識別データ発生回路１７か
らの識別データを制御する制御回路、１３は、制御回路
１２からのデータをＤＡＩフォーマットで出力するデー
タ出力回路、１４は、ＤＡＩフォーマットからブロック
ＩＤの重畳されるべきタイミングを検出するブロックＩ
Ｄ検出回路、１５は、ブロックＩＤ検出回路１４からの
タイミングの１／Ｎのタイミングを発生させるタイミン
グ発生回路、１６は、ブロックＩＤ検出回路１４からの
タイミングとタイミング発生回路１５からのタイミング
の一致を検出する一致検出回路である。識別データ発生
回路１７は、一致検出回路１６からのタイミングにより
識別データを発生させる。
タ記録装置の構成図を示すものである。第１図におい
て、１１は、データ入力回路、１２は、データ入力回路
１１からのコード・データと識別データ発生回路１７か
らの識別データを制御する制御回路、１３は、制御回路
１２からのデータをＤＡＩフォーマットで出力するデー
タ出力回路、１４は、ＤＡＩフォーマットからブロック
ＩＤの重畳されるべきタイミングを検出するブロックＩ
Ｄ検出回路、１５は、ブロックＩＤ検出回路１４からの
タイミングの１／Ｎのタイミングを発生させるタイミン
グ発生回路、１６は、ブロックＩＤ検出回路１４からの
タイミングとタイミング発生回路１５からのタイミング
の一致を検出する一致検出回路である。識別データ発生
回路１７は、一致検出回路１６からのタイミングにより
識別データを発生させる。
以下にその動作を説明する。データ入力回路１１からの
データ入力要求により制御回路１２からダミー・データ
をデータ出力回路１３へ送出する。データ出力回路１３
から出力されたＤＡＩフォーマットによるデータからブ
ロックＩＤ検出回路１４によりサンプリング周波数が４
８ＫHzの場合４ｍ秒毎のブロックＩＤを検出し、制御回
路１２におけるブロックＩＤの重畳されるべきタイミン
グを検出する。ブロックＩＤ検出回路１４からのタイミ
ングを、予め指定した回数ＮだけカウントしブロックＩ
Ｄタイミングの１／Ｎのタイミングをタイミング発生回
路１５で発生させる。ブロックＩＤ検出回路１４からの
タイミングと、タイミング発生回路１５からのタイミン
グを一致検出回路１６で比較し、一致した時点を識別デ
ータ発生タイミングとして検出する。一致検出回路１６
からのタイミングにより、識別データ発生回路１７で識
別データを発生する。識別データ発生回路１７からの識
別データを制御回路１２からデータ出力回路１３へ送出
すると共にそれ以降データ入力回路１１からのデータを
識別データと同期させながらデータ出力回路１３へ送出
する。また、識別データ発生回路１７から識別データが
発生されない場合は、データ入力回路１１からの初めて
のデータ入力要求であるか、或は、データ入力中である
のに識別データ発生タイミングが正常に発生されていな
いかを、制御回路１２で判定することにより本装置内の
動作状況を管理することも可能となる。
データ入力要求により制御回路１２からダミー・データ
をデータ出力回路１３へ送出する。データ出力回路１３
から出力されたＤＡＩフォーマットによるデータからブ
ロックＩＤ検出回路１４によりサンプリング周波数が４
８ＫHzの場合４ｍ秒毎のブロックＩＤを検出し、制御回
路１２におけるブロックＩＤの重畳されるべきタイミン
グを検出する。ブロックＩＤ検出回路１４からのタイミ
ングを、予め指定した回数ＮだけカウントしブロックＩ
Ｄタイミングの１／Ｎのタイミングをタイミング発生回
路１５で発生させる。ブロックＩＤ検出回路１４からの
タイミングと、タイミング発生回路１５からのタイミン
グを一致検出回路１６で比較し、一致した時点を識別デ
ータ発生タイミングとして検出する。一致検出回路１６
からのタイミングにより、識別データ発生回路１７で識
別データを発生する。識別データ発生回路１７からの識
別データを制御回路１２からデータ出力回路１３へ送出
すると共にそれ以降データ入力回路１１からのデータを
識別データと同期させながらデータ出力回路１３へ送出
する。また、識別データ発生回路１７から識別データが
発生されない場合は、データ入力回路１１からの初めて
のデータ入力要求であるか、或は、データ入力中である
のに識別データ発生タイミングが正常に発生されていな
いかを、制御回路１２で判定することにより本装置内の
動作状況を管理することも可能となる。
以上のように、第１の実施例によれば、ブロックＩＤ検
出回路１４と、タイミング発生回路１５と、一致検出回
路１６と、識別データ発生回路１７を設けることにより
データ入力回路１１からのデータと、識別データ発生回
路１７からの識別データを合わせたデータ出力回路１３
からのＤＡＩデータ転送速度が1.536Ｍビット／秒とす
ると７６８バイト単位、或はタイミング発生回路１７で
指定されているＮによる７６８バイトのＮ倍でコード・
データを正確に管理しながら記録することが出来る。
出回路１４と、タイミング発生回路１５と、一致検出回
路１６と、識別データ発生回路１７を設けることにより
データ入力回路１１からのデータと、識別データ発生回
路１７からの識別データを合わせたデータ出力回路１３
からのＤＡＩデータ転送速度が1.536Ｍビット／秒とす
ると７６８バイト単位、或はタイミング発生回路１７で
指定されているＮによる７６８バイトのＮ倍でコード・
データを正確に管理しながら記録することが出来る。
第２図は、本発明の第２の実施例におけるコード・デー
タ記録装置の構成図を示すものである。第２図におい
て、２１は、データ入力回路、２２は、データ入力回路
からのコード・データと識別データ発生回路からの識別
データを制御する制御回路、２３は、制御回路からのデ
ータをＤＡＩフォーマットで出力するデータ出力回路、
２４は、ＤＡＩフォーマットからブロックＩＤの重畳さ
れるべきタイミングを検出するブロックＩＤ検出回路、
２５は、ブロックＩＤ検出回路からのタイミングの１／
Ｎのタイミングを発生させるタイミング発生回路、２６
は、ブロックＩＤ検出回路からのタイミングとタイミン
グ発生回路からのタイミングの一致を検出する一致検出
回路、２７は、一致検出回路からのタイミングにより識
別データを発生させる識別データ発生回路、２８は、デ
ータ入力回路２１から入力されたコード・データを一時
保存するメモリ回路である。
タ記録装置の構成図を示すものである。第２図におい
て、２１は、データ入力回路、２２は、データ入力回路
からのコード・データと識別データ発生回路からの識別
データを制御する制御回路、２３は、制御回路からのデ
ータをＤＡＩフォーマットで出力するデータ出力回路、
２４は、ＤＡＩフォーマットからブロックＩＤの重畳さ
れるべきタイミングを検出するブロックＩＤ検出回路、
２５は、ブロックＩＤ検出回路からのタイミングの１／
Ｎのタイミングを発生させるタイミング発生回路、２６
は、ブロックＩＤ検出回路からのタイミングとタイミン
グ発生回路からのタイミングの一致を検出する一致検出
回路、２７は、一致検出回路からのタイミングにより識
別データを発生させる識別データ発生回路、２８は、デ
ータ入力回路２１から入力されたコード・データを一時
保存するメモリ回路である。
以下にその動作を説明する。データ入力回路２１からの
データを制御回路２２でメモリ回路２８に保存すると共
にデータ出力回路２３へ送る。メモリ回路２８内のデー
タは、識別データ発生回路２７からの識別データの発生
タイミングによりクリアする。データ入力回路２１から
の最初のデータ入力要求による処理は終了していて識別
データ発生回路２７から識別データが発生されない場合
は、制御回路２２でメモリ回路２８から保存しておいた
コード・データを読みだしデータ出力回路２３へ送出す
る。
データを制御回路２２でメモリ回路２８に保存すると共
にデータ出力回路２３へ送る。メモリ回路２８内のデー
タは、識別データ発生回路２７からの識別データの発生
タイミングによりクリアする。データ入力回路２１から
の最初のデータ入力要求による処理は終了していて識別
データ発生回路２７から識別データが発生されない場合
は、制御回路２２でメモリ回路２８から保存しておいた
コード・データを読みだしデータ出力回路２３へ送出す
る。
以上のように、第２の実施例によれば、メモリ回路２８
を設けることにより、識別データの発生タイミングを制
御回路２２で監視しＤＡＩフォーマット上の誤りが発生
した場合、再記録することが可能となる。
を設けることにより、識別データの発生タイミングを制
御回路２２で監視しＤＡＩフォーマット上の誤りが発生
した場合、再記録することが可能となる。
尚、第１及び第２の実施例において識別データは、毎回
同じパターンを使用して単にインデックスとする以外
に、番地付けを行いアドレスとして使用してもよい。
同じパターンを使用して単にインデックスとする以外
に、番地付けを行いアドレスとして使用してもよい。
発明の効果 以上のように、本発明によればＤＡＩを利用してブロッ
クＩＤの重畳されるべきタイミングを検出し、そのタイ
ミングにより識別データを発生させる構成を付加するこ
とにより、現在市販されているＤＡＴをコード・データ
記録装置として使用することが出来、その実用的効果は
極めて大きい。
クＩＤの重畳されるべきタイミングを検出し、そのタイ
ミングにより識別データを発生させる構成を付加するこ
とにより、現在市販されているＤＡＴをコード・データ
記録装置として使用することが出来、その実用的効果は
極めて大きい。
第１図は本発明における第１の実施例のコード・データ
記録装置の要部構成図、第２図は本発明における第２の
実施例のコード・データ記録装置の要部構成図である。 １１…データ入力回路、１２…制御回路、１３…データ
出力回路、１４…ブロックＩＤ検出回路、１５…タイミ
ング発生回路、１６…一致検出回路、１７…識別データ
発生回路、２１…データ入力回路、２２…制御回路、２
３…データ出力回路、２４…ブロックＩＤ検出回路、２
５…タイミング発生回路、２６…一致検出回路、２７…
識別データ発生回路、２８…メモリ回路。
記録装置の要部構成図、第２図は本発明における第２の
実施例のコード・データ記録装置の要部構成図である。 １１…データ入力回路、１２…制御回路、１３…データ
出力回路、１４…ブロックＩＤ検出回路、１５…タイミ
ング発生回路、１６…一致検出回路、１７…識別データ
発生回路、２１…データ入力回路、２２…制御回路、２
３…データ出力回路、２４…ブロックＩＤ検出回路、２
５…タイミング発生回路、２６…一致検出回路、２７…
識別データ発生回路、２８…メモリ回路。
Claims (2)
- 【請求項１】データ入力回路と、制御回路と、データ出
力回路と、ブロックＩＤ検出回路と、タイミング発生回
路と、一致検出回路と、識別データ発生回路を具備し、
前記データ入力回路から入力されたデータを前記制御回
路で制御しながら前記データ出力回路へ送り、前記デー
タ出力回路から送出されたデータより前記ブロックＩＤ
検出回路によって前記制御回路に於けるブロックＩＤ送
出タイミングを検出し、そのブロックＩＤタイミングを
もとに前記タイミング発生回路により１／Ｎ（Ｎは正の
整数）のタイミングを発生し、前記一致検出回路により
識別データを発生させるタイミングを検出し、そのタイ
ミングによって前記識別データ発生回路から識別データ
を発生し、前記制御回路で特定の位置に識別データを挿
入することにより、コード・データを管理しながら記録
することを特徴とするコード・データ記録装置。 - 【請求項２】制御回路に付随したコード・データ保存用
メモリ回路を備え、装置内での不良が生じた場合前記メ
モリ回路からコード・データを読みだし再記録すること
ができる請求項(1)記載のコード・データ記録装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10302988A JPH0654584B2 (ja) | 1988-04-26 | 1988-04-26 | コード・データ記録装置 |
| ZA893141A ZA893141B (en) | 1988-04-26 | 1989-04-27 | Sultamsulfonamide derivatives and herbicides |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10302988A JPH0654584B2 (ja) | 1988-04-26 | 1988-04-26 | コード・データ記録装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01273274A JPH01273274A (ja) | 1989-11-01 |
| JPH0654584B2 true JPH0654584B2 (ja) | 1994-07-20 |
Family
ID=14343223
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10302988A Expired - Fee Related JPH0654584B2 (ja) | 1988-04-26 | 1988-04-26 | コード・データ記録装置 |
Country Status (2)
| Country | Link |
|---|---|
| JP (1) | JPH0654584B2 (ja) |
| ZA (1) | ZA893141B (ja) |
-
1988
- 1988-04-26 JP JP10302988A patent/JPH0654584B2/ja not_active Expired - Fee Related
-
1989
- 1989-04-27 ZA ZA893141A patent/ZA893141B/xx unknown
Also Published As
| Publication number | Publication date |
|---|---|
| ZA893141B (en) | 1990-04-25 |
| JPH01273274A (ja) | 1989-11-01 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |