JPH0693533B2 - 混成集積回路 - Google Patents

混成集積回路

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JPH0693533B2
JPH0693533B2 JP1276835A JP27683589A JPH0693533B2 JP H0693533 B2 JPH0693533 B2 JP H0693533B2 JP 1276835 A JP1276835 A JP 1276835A JP 27683589 A JP27683589 A JP 27683589A JP H0693533 B2 JPH0693533 B2 JP H0693533B2
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JP
Japan
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metal frame
integrated circuit
hybrid integrated
hybrid
die
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Application number
JP1276835A
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JPH03136392A (ja
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義隆 渡部
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NEC Corp
Original Assignee
NEC Corp
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/756Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink

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  • Structure Of Printed Boards (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、トランスファーモールドタイプの混成集積回
路(以下、ハイブリッドIC)に関し、特に複数の高電力
素子(以下、P0素子)を搭載したハイブリッドICに関す
る。
〔従来の技術〕
従来、この種のハイブリッドICは、第3図(a),
(b)に示すように複数のP0素子7を搭載していること
から、P0素子相互の絶縁性を確保するため、配線基板5
上にダイボンディングした構造となっていた。
〔発明が解決しようとする課題〕
上述した従来のハイブリッドICは、P0素子が配線基板上
にダイボンディングされていたため、放熱特性が十分に
得られないという欠点があった。
〔課題を解決するための手段〕
本発明は、金属フレームと配線基板と各種半導体部品か
らなるトランスファーモールド型混成集積回路におい
て、金属フレームを分割し複数の高電力素子を金属フレ
ームに直接搭載し、かつモールド樹脂外部に金属フレー
ムを露出させたことを特徴とする。
〔実施例〕
次に、本発明について図面を参照して説明する。第1図
は、本発明の一実施例を示す立体図であり、第2図は第
1図のAA′断面図である。図に示すように、直接P0素子
7がダイボンディングされる金属フレーム1と各種半導
体部品6を搭載した配線基板5を搭載するため金属フレ
ーム1′とを有し、P0素子7の放熱特性を向上させるた
め、P0素子7がダイボンディングされている金属フレー
ム1を外装樹脂3より露出させ放熱板兼用としている。
〔発明の効果〕
以上説明したように本発明は、金属フレームを分割する
ことにより金属フレームに直接P0素子をダイボンディン
グし、複数のP0素子搭載を可能とすると共に、P0素子を
直接ダイボンディングした金属フレームを外装樹脂外部
に露出させているので、放熱特性を良好にする効果があ
る。
【図面の簡単な説明】
第1図は、本発明の一実施例を説明するためのハイブリ
ッドIC立体図、第2図は、第1図のAA′断面図、第3図
(a),(b)は、従来のハイブリッドICの断面図であ
る。 1,1′…金属フレーム、2…リード端子、3…外装樹
脂、4…金属細線、5…配線基板、6…半導体部品、7
…高電力素子。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】金属フレームと配線基板と各種半導体部品
    からなるトランスファーモールド型混成集積回路におい
    て、金属フレームを分割し複数の高電力素子を金属フレ
    ームに直接搭載し、かつモールド樹脂外部に金属フレー
    ムを露出させたことを特徴とする混成集積回路。
JP1276835A 1989-10-23 1989-10-23 混成集積回路 Expired - Lifetime JPH0693533B2 (ja)

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JPH03136392A JPH03136392A (ja) 1991-06-11
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DE602004029366D1 (de) 2003-07-17 2010-11-11 Gunze Kk Nahtverstärkungsmaterial für ein automatisches nähgerät
IL310996A (en) * 2021-08-26 2024-04-01 Vishay Gen Semiconductor Llc Packaging with increased cooling for improved heat management for electrical components

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JPH03136392A (ja) 1991-06-11

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