JPH07109830B2 - 薄膜積層体における障壁の改良 - Google Patents

薄膜積層体における障壁の改良

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Description

【発明の詳細な説明】
【0001】
【産業用の利用分野】本発明は、一般に薄膜の障壁に関
し、特に薄膜拡散障壁に関し、更に詳細には電子デバイ
スおよび半導体および他の固体デバイスの接点に使用さ
れるような障壁に関する。
【0002】
【従来技術】薄膜メタラジにおいて一つの膜層から他の
膜層へ原子が拡散するという悪影響は長い間意識されて
いる。他の層から原子の相互拡散があるということは時
間と共に特性が変化するということを意味する。特性の
変化には固有抵抗、付着、延性、はんだ結合性のような
単一パラメータの直接変動というように簡単なものであ
る場合がある。原子規模の不純物レベルが関係する半導
体デバイスのような更に複雑な用途においては、拡散に
より出現する不要な原子が破滅的なデバイスの故障を生
む可能性がある。
【0003】通常、拡散は、比較的遅く、バルクの影響
は予測可能であると考えられている。しかし、薄膜の場
合には、この影響は、単にバルクの影響で予想されるよ
りはるかに速く進行する。距離が短いこと、粒界、およ
び欠陥が関連していると考えられる。
【0004】拡散障壁構造は通常、一連の膜層内部にお
いて、一つの場所から原子が存在すると害となる他の場
所への原子の移動を制御し、防止し、または遅らせるよ
うに動作する前記一連の膜層内に設けられた単一の層で
ある。
【0005】他の障壁構造層を薄膜積層体に挿入して相
互作用の可能性がある層同士の間に化合物の生成を防止
しまたは行わせることができる。
【0006】半導体技術では、拡散効果および化合物生
成効果は、デバイスの感度によってのみならず製造時の
プロセスウィンドウでの熱応力によっても悪化する。半
導体技術では、プロセスウィンドウは、温度レベルおよ
び、集積回路のようなデバイスまたはデバイスのアレイ
の製造の一工程に割り当たられたそのレベルにある時間
である。このようなデバイスまたはアレイを製作するに
あたっては、累積効果を持つ可能性のあるプロセスウィ
ンドウ温度変動が存在することがある。
【0007】半導体の技術では、製造または作業を容易
にするのに接点に必要とされる機能が存在し、その必要
な機能を与えることができる特定の金属をその目的のた
めに薄膜積層体に導入する。これらは、それぞれが異な
る目的のための異なる金属から成る多数の層とすること
ができる。例として、導電性には銅(Cu)またはアル
ミニウム(Al)、耐食およびはんだ接合性には金(A
u)、および接着にはクロム(Cr)がある。技術が進
展するにつれて、障壁技術が単層構造に入り込んでき
た。導電性のため一般的に存在するCuと耐食およびは
んだ接合性のため一般的に存在するAuとの間の原子の
拡散を遅らせるNiの薄膜拡散障壁構造が広範に使用さ
れてきている。このような構造の一例は、米国特許第
4,016,050号にある。
【0008】他の形式の障壁構造は、米国特許第4,8
16,424号に示されており、これでは窒化チタン
(TiN)−タングステン(W)を使用して、Alを導
体として使用する場合、Alとシリコン(Si)との相
互拡散を防止している。
【0009】更に他の障壁構造は、米国特許第4,47
8,881号に示されており、これでは製作時にWの層
をSi半導体デバイスのAl導体とNi導電層との間に
設けるが、この層は処理後AlとNiSi接触化合物と
の間の化学反応を防止するWの単一障壁層となる。
【0010】
【発明が解決しようとする課題】本発明は、半導体デバ
イスの接点に使用される障壁を改良することを目的とす
る。
【0011】
【課題を解決するための手段】障壁技術の改良は、少な
くとも3層を有する薄膜積層体に多層障壁構造を設ける
ことにより達成され、前記障壁構造の全体の制御、防止
または遅延の機能を高めるよう動作する少なくとも一つ
の材料から成る内層が存在する。内層の材料は、境界
面、粒界および欠陥の変化の形での原子移動防止特性、
相対濃度、および薄膜技術で吸い込み(sink)とし
て知られている状態の少なくとも幾つかの機能を発揮す
る。
【0012】NiAuNiの新しい拡散障壁構成が設け
られるが、これは積層体内のCuおよびAuの相互拡散
を防止すべき薄膜積層体に広範に使用されているNi単
層の拡散障壁構造に対する改良である。
【0013】本発明は、拡散種および相互反応種を根本
的に削減し、材料の選択幅を拡大し、全体として障壁を
より完全にするという利益をもたらす。AuNiAuN
iCuの薄膜積層体においては、CuのAuへの拡散が
実際的に除去されているため脆性が除去され、腐食が減
り、はんだ接合性が増大する。
【0014】
【実施例】図5を参照すると、層3と層4との間の拡散
として相互作用、化合物生成、および相互溶解を防止す
る目的で単層1が薄膜積層体2に導入されている、従来
技術の形式の障壁構造が示されている。障壁層構造は、
不必要な原子が層3または層4から他の層の原子に到達
してこれと相互作用するのを防止するか遅らせるかす
る。積層体2の薄膜層は、μmオーダーの厚さのもので
あり、製作中に多様な熱応力を受けると、層3または層
4の原子が他の層へ幾らか移動する。
【0015】図3、図4、図6、および図7で、スパッ
タ時間(分)に対する濃度(原子%)のグラフは、オー
ジェ電子分光法をスパッタ区画法と組み合わせて得られ
た深さプロファイルの結果を示したものである。スパッ
タリングは2KeVのアルゴンイオンを用い毎分50〜
60 の割合で行った。
【0016】次に図6を参照すると、図5の従来技術の
単層障壁について、広範に使用されているAuNiCu
の拡散障壁構造を半導体接点の環境に適用したオージェ
式材料分析グラフを示してある。
【0017】図6において、分析した試料は、厚さ2μ
mのCu層から厚さ2700ÅのAu層3への原子の拡
散を遅らせる目的で、スルファミン酸ニッケルの溶液か
ら電着されて積層体2に導入される厚さ2μmのNiの
障壁層1と、図5のように支持しているSi基板上に4
00Åの厚さのCr接着層を備えている。複数回処理の
熱応力の累積効果を模擬するように設計された2時間4
00℃のアニーリングサイクルを試料に加えた。図6の
分析は、単層Ni障壁1の遅延効果がこれら条件のもと
でCuが層4から障壁層1を通してAu層3にAu層3
が約10(原子)パーセントのCuおよび約10(原
子)パーセントのNiを含むレベルまで拡散するのを防
止するのに不十分であることを示している。
【0018】次に図7を参照すると、図6の分析は、A
u層においてCuおよびNiが実質上同じレベルで存在
するというマイクロプローブ式分析により確認される。
【0019】本発明の改良障壁を図1と関連して説明す
る。図1で、積層体2で、障壁は一方の側で層6により
層4から分離され他方の側で層7により層3から分離さ
れている中間層5から構成されている。中間層5は、移
動原子を捕らえまたは結合する際に当技術で知られてい
る吸い込み状態の機能を果たす。層6および層7は各々
一般に障壁として動作し、これらはまた材料の適合性を
緩和するのにも役立ち、したがってより完全な障壁に近
づく材料の組み合わせが可能になる。
【0020】層5は、相互作用するまたは拡散する原子
に出逢いまたは該原子が入り込むと、層の吸い込み機能
により原子を異なる、エネルギのもっと低い状態に変換
する元素または化合物とすることができる。
【0021】本発明の好適実施例は、半導体接点におけ
る改良された拡散障壁にある。改良された接点を図2に
概略図解してある。これまで説明したように、半導体接
点技術では、導電性のためのCuの層および耐食および
はんだ接合性のためのAuの層を、再現可能な信頼性あ
る高収率のデバイスとするために、相互反応しないよう
にしておかなければならない。しかし、複数の温度変動
のもとでの処理状態では、Cuを必要以上にAuの中に
拡散させるよう動作し、図6および図7に関連して図示
したように、CuはNi障壁層を通してAu層内に拡散
する。
【0022】本発明によれば、改良された障壁が積層体
10に設けられてCu導電層11から原子がAuの耐食
はんだ接合性高揚層12の中に拡散してその性質に影響
を与えることがないようにし、400℃、2時間のアニ
ーリングの後Au層12に存在するCuが約0.2ない
し0.44%に効果的に減少される。改良された障壁1
3は、3層から構成されている。すなわち、一方の側で
Niの層15によりCu層11から分離され且つ他方の
側でNiの層16によりAu層から分離されている中間
層14である。
【0023】層15および16は、標準応力および積層
体10の残りとの導電性の適合性について選択され、隣
接層から拡散する原子に対して障壁の機能を提供する。
中間層14は、積層体内での適合性ばかりでなく、層1
5を通過して拡散するAuまたはCuの原子、特にC
u、に対する吸い込み機能をも提供するように選択され
る。Cu3Au、CuAu、またはCuAu3のような化
合物が通常中間層14に形成される。
【0024】本発明の改良された障壁13の有効性を図
3および図4に関連して図解してある。これらの図は、
本発明の障壁を備えている積層体10のAu層12の、
400℃、2時間のアニーリングサイクル後の、オージ
ェ材料分析のグラフである。
【0025】図3および図2において、試料は、図示し
てないSi基板上に400Åの蒸着Cr接着層を備えて
おり、その上に2μmのCuの蒸着層11があり、その
上にpH3.25、電流密度15mA/cm2、および
温度50℃の堆積条件のもとで、当該技術分野で標準
の、SELREXR SULFAMEXRニッケルめっき
液から電着した厚さ1μmないし1.5μmのNiの層
15が存在する。層15の上には、pH8.70、電流
密度2.72mA/cm2、温度50℃の蒸着条件のも
とで、当該技術分野で標準の、SELREXR BDTR
510金めっき液から電着した厚さ1060ÅのAuの
中間層14がある。Ni層16およびAu層12は、そ
れぞれ、層15および層14と同じ条件および同じ厚さ
で連続して堆積される。
【0026】図3を参照すると、図2の層12のオージ
ェ分析のグラフが本発明の改良された障壁によるCuの
極端な降下を示している。
【0027】5kVのビームエネルギで行う個別探触に
よるマイクロプローブ分析では、Ni組成は、±3%の
精度で8.3原子%であり、三つの探触点の一つではC
uが検出されず、第2の点ではCuの組成は0.2原子
%であり、第3の点では0.44原子%であり、相対精
度は±50%、確度は±20%であった。
【0028】本発明の障壁を備えた図2のAu層12へ
のCuの移動の極端な低下は、図3および図4の双方の
オージェ分析図により確認される。
【0029】図4において、分析した試料はNi層15
および16の厚さが1.5μmであるということだけが
図3のものと異なっている。他のすべての層組成、寸
法、および製作は、図3の試料と同じである。
【0030】図4を参照すると、電子マイクロプローブ
分析からAu層12のNi組成は、相対精度±2%、相
対確度±5%で8.7原子%であり、一方三つの個別探
触点でのCuの組成は、同様で0.15原子%以下であ
った。
【0031】
【発明の効果】本発明は、半導体デバイスの接点に使用
される障壁を改良することができる。
【図面の簡単な説明】
【図1】本発明の改良された障壁の概略横断面図であ
る。
【図2】本発明の一実施例の概略横断面図である。
【図3】アニーリング後の本発明の改良された障壁のオ
ージェ分析グラフであり、外層がAuおよびCuで障壁
がNiAuNiである場合のものである。
【図4】アニーリング後の本発明の改良された障壁の異
なるNi厚さでのオージェ分析グラフであり、外層がA
uおよびCuであり、障壁がNiAuNiである場合の
ものである。
【図5】従来技術の単層障壁構造の概略横断面図であ
る。
【図6】アニーリング後の図1の単層障壁のオージェ分
析グラフであり、障壁層がNiで外層がAuおよびCu
である場合のものである。
【図7】アニーリング後の図1の単層障壁の異なるNi
厚さでのオージェ分析グラフであり、障壁層がNiで、
外層がAuおよびCuである場合のものである。
【符号の説明】
1 .. 障壁層 2 .. 薄膜積層体 3,12 .. Au層 5,14 .. 中間層 10 .. 積層体 11 .. Cu導電層 13 .. 改良された障壁 15,16 .. Ni層
───────────────────────────────────────────────────── フロントページの続き (72)発明者 キング−ニング・チユ アメリカ合衆国ニユーヨーク州チヤパツカ ア、ホワイトロウ・クローズ44番地 (56)参考文献 特開 昭63−53935(JP,A) 特開 平1−214053(JP,A) 実開 昭55−152067(JP,U) 実開 平1−67746(JP,U)

Claims (5)

    【特許請求の範囲】
  1. 【請求項1】電子装置のAuの第1層及びCuの第2層
    の間に形成された3層の障壁構造において、 上記3層は、 一方の面が上記第1層に接するNiの第3層と、 一方の面が上記第3層の他方の面に接するAuの第4層
    と、 一方の面が上記第4層の他方の面に接し、他方の面が上
    記第2層に接するNiの第5層とを有することを特徴と
    する上記障壁構造。
  2. 【請求項2】上記第2層の厚さはは2μmであり、上記
    第1及び第4層の厚さは1060Åであり、そして上記
    第3及び第4層の厚さは1μm乃至1.5μmであるこ
    とを特徴とする請求項1記載の障壁構造。
  3. 【請求項3】半導体の表面に形成された金属導体層、該
    金属導体層上に形成されたCu導体層及び該Cu導体層
    上に形成されたAu導体層を有する半導体装置におい
    て、 上記Cu導体層及び上記Au導体層の間に3層の障壁構
    造が形成され、 該障壁構造は、 上記Cu導体層上に形成されたNiの第1層、 該第1層上に形成されたAuの第2層、 該第2層上に形成されたNiの第3層を有することを特
    徴とする上記半導体装置。
  4. 【請求項4】上記Cu導体層の厚さは2μmであり、上
    記第1及び第3層の厚さは1μm乃至1.5μmであ
    り、そして上記第2層及び上記Au導体層の厚さは10
    60Åであることを特徴とする請求項3記載の半導体装
    置。
  5. 【請求項5】上記半導体はSiであり、そして上記金属
    導体層はCrであることを特徴とする請求項4記載の半
    導体装置。
JP3294798A 1990-10-22 1991-10-16 薄膜積層体における障壁の改良 Expired - Lifetime JPH07109830B2 (ja)

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