JPH07177407A - 撮像装置 - Google Patents
撮像装置Info
- Publication number
- JPH07177407A JPH07177407A JP5316805A JP31680593A JPH07177407A JP H07177407 A JPH07177407 A JP H07177407A JP 5316805 A JP5316805 A JP 5316805A JP 31680593 A JP31680593 A JP 31680593A JP H07177407 A JPH07177407 A JP H07177407A
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- JP
- Japan
- Prior art keywords
- circuit
- image
- signal
- difference
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- Withdrawn
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- Transforming Light Signals Into Electric Signals (AREA)
- Details Of Television Scanning (AREA)
Abstract
(57)【要約】
【目的】 高精細ＣＣＤを使うことなく画像の劣化の少
ない画像拡大を行う。 【構成】 映像信号を書き込みアドレスコントローラの
指定するフレームメモリのアドレスに書き込み、書き込
むタイミングとは異なるタイミングで読出しアドレスコ
ントローラの指定するフレームメモリのアドレスからデ
ータを読みだす拡大手段、前記映像信号による画像のエ
ッジ部を強調する為の可変差分手段を含むエッジ強調処
理回路、拡大手段による画像拡大率に応じて前記可変差
分手段の差分幅を可変し強調処理の特性を可変する制御
手段、を有する。
ない画像拡大を行う。 【構成】 映像信号を書き込みアドレスコントローラの
指定するフレームメモリのアドレスに書き込み、書き込
むタイミングとは異なるタイミングで読出しアドレスコ
ントローラの指定するフレームメモリのアドレスからデ
ータを読みだす拡大手段、前記映像信号による画像のエ
ッジ部を強調する為の可変差分手段を含むエッジ強調処
理回路、拡大手段による画像拡大率に応じて前記可変差
分手段の差分幅を可変し強調処理の特性を可変する制御
手段、を有する。
Description
【０００１】
【産業上の利用分野】本発明は電子ズーム機能を有する
カムコーダー等の撮像装置に関する。
カムコーダー等の撮像装置に関する。
【０００２】
【従来の技術】従来撮像信号をフレームメモリに一度書
き込み、フレームメモリから読み出すタイミングを変化
させると共に、読み出した撮像信号に補間データを補う
ことにより、撮像した画像を電子的に拡大する電子ズー
ムが開発されている。
き込み、フレームメモリから読み出すタイミングを変化
させると共に、読み出した撮像信号に補間データを補う
ことにより、撮像した画像を電子的に拡大する電子ズー
ムが開発されている。
【０００３】
【発明が解決しようとしている課題】しかし撮像装置で
電子ズームを用いて画像を拡大した場合、サンプリング
周波数が低くなることにより、水平・垂直解像度が劣化
し、解像感の低い画像となる。解像感を高めるために
は、高精細ＣＣＤ、高倍率レンズを搭載するという方法
があるが、これはコストが高く、容積が大きくなり実用
的でなかった。
電子ズームを用いて画像を拡大した場合、サンプリング
周波数が低くなることにより、水平・垂直解像度が劣化
し、解像感の低い画像となる。解像感を高めるために
は、高精細ＣＣＤ、高倍率レンズを搭載するという方法
があるが、これはコストが高く、容積が大きくなり実用
的でなかった。
【０００４】
【課題を解決するための手段】映像信号を書き込みアド
レスコントローラの指定するフレームメモリのアドレス
に書き込み、書き込むタイミングとは異なるタイミング
で読出しアドレスコントローラの指定するフレームメモ
リのアドレスからデータを読みだし、可変差分回路を含
むエッジ強調処理回路により前記映像信号による画像の
エッジ部を強調すると共に、拡大率に応じて差分幅を可
変し強調処理の特性を可変する。
レスコントローラの指定するフレームメモリのアドレス
に書き込み、書き込むタイミングとは異なるタイミング
で読出しアドレスコントローラの指定するフレームメモ
リのアドレスからデータを読みだし、可変差分回路を含
むエッジ強調処理回路により前記映像信号による画像の
エッジ部を強調すると共に、拡大率に応じて差分幅を可
変し強調処理の特性を可変する。
【０００５】又、拡大率に応じて差分回路の入力データ
と２種の遅延データの重み付き和とから差分値を決定し
強調処理の特性を可変する。
と２種の遅延データの重み付き和とから差分値を決定し
強調処理の特性を可変する。
【０００６】又、拡大率に応じて強調処理の度合いを可
変することを特徴とする。
変することを特徴とする。
【０００７】
【実施例】図１は本発明の実施例である。
【０００８】１は撮像レンズ・絞り・フィルターを有す
るレンズ、２は撮像装置であるＣＣＤ、３はガンマ補正
・ローパスフィルター・クリップ回路を有する撮像信号
処理回路、４はＡＤコンバータ（ＡＤＣ）、５はフレー
ムメモリ、６は画像の画素間データを補間する補間回
路、７は画像のエッジ強調を行うエッジ強調処理回路、
８はＤＡコンバータ（ＤＡＣ）、９はＶＴＲ等の撮像信
号を記録する記録回路である。１０は５のフレームメモ
リの書き込みアドレスを指定する書き込みアドレスコン
トローラ、１１はフレームメモリの読出しアドレスを指
定する読出しアドレスコントローラ、１２はテレ・ワイ
ド切り替えスイッチ、１３は倍率発生装置である。
るレンズ、２は撮像装置であるＣＣＤ、３はガンマ補正
・ローパスフィルター・クリップ回路を有する撮像信号
処理回路、４はＡＤコンバータ（ＡＤＣ）、５はフレー
ムメモリ、６は画像の画素間データを補間する補間回
路、７は画像のエッジ強調を行うエッジ強調処理回路、
８はＤＡコンバータ（ＤＡＣ）、９はＶＴＲ等の撮像信
号を記録する記録回路である。１０は５のフレームメモ
リの書き込みアドレスを指定する書き込みアドレスコン
トローラ、１１はフレームメモリの読出しアドレスを指
定する読出しアドレスコントローラ、１２はテレ・ワイ
ド切り替えスイッチ、１３は倍率発生装置である。
【０００９】レンズ１から光学的に入力された映像は、
ＣＣＤ２によって電気信号となる。撮像信号処理回路３
で信号処理されアナログ信号を出力する。この撮像信号
処理回路３の出力はＡＤＣ４でＡＤ変換され、書き込み
アドレスコントローラ１０で指定されるフレームメモリ
５のアドレスに書き込まれる。次いで、テレ・ワイド切
り替えスイッチ１２、倍率発生装置１３により読出しア
ドレスコントローラ１１を制御し、読出しアドレスコン
トローラ１１により指定されるアドレスから読み出され
る。読み出されたデータは補間回路６で画素間データは
補間され、エッジ強調処理回路７でエッジの強調処理が
なされ、ＤＡＣ８でＤＡ変換され記録回路９によって記
録される。
ＣＣＤ２によって電気信号となる。撮像信号処理回路３
で信号処理されアナログ信号を出力する。この撮像信号
処理回路３の出力はＡＤＣ４でＡＤ変換され、書き込み
アドレスコントローラ１０で指定されるフレームメモリ
５のアドレスに書き込まれる。次いで、テレ・ワイド切
り替えスイッチ１２、倍率発生装置１３により読出しア
ドレスコントローラ１１を制御し、読出しアドレスコン
トローラ１１により指定されるアドレスから読み出され
る。読み出されたデータは補間回路６で画素間データは
補間され、エッジ強調処理回路７でエッジの強調処理が
なされ、ＤＡＣ８でＤＡ変換され記録回路９によって記
録される。
【００１０】図２はエッジ強調処理回路７の詳細図であ
る。
る。
【００１１】１０１は可変差分回路１、１０２は可変差
分回路２、１０３は補正量演算回路、１０４は加算器、
１０５はディレイ回路である。
分回路２、１０３は補正量演算回路、１０４は加算器、
１０５はディレイ回路である。
【００１２】図２において映像信号が入力されると、そ
のときの倍率信号に応じて、可変差分回路１（１０
１）、可変差分回路２（１０２）で入力信号の２階差分
を計算することによりエッジを検出し、補正量演算回路
（１０３）で補正量を決定し、加算器（１０４）により
ディレイ回路（１０５）で出力タイミングを合わせた映
像信号に加算することでエッジ処理が行われる。
のときの倍率信号に応じて、可変差分回路１（１０
１）、可変差分回路２（１０２）で入力信号の２階差分
を計算することによりエッジを検出し、補正量演算回路
（１０３）で補正量を決定し、加算器（１０４）により
ディレイ回路（１０５）で出力タイミングを合わせた映
像信号に加算することでエッジ処理が行われる。
【００１３】図３は、可変差分回路１（１０１）の第１
の実施例である。
の実施例である。
【００１４】２０１〜４はレジスタ、２０５はコンパレ
ータ、２０６はデコーダ、２０７はセレクタ、２０８は
減算器である。
ータ、２０６はデコーダ、２０７はセレクタ、２０８は
減算器である。
【００１５】図３において、コンパレータ（２０５）、
デコーダ（２０６）において倍率信号は整数化され、映
像信号の遅延時間をセレクタ（２０７）により決定す
る。ついで、入力された映像信号との差分を計算する。
なお、図３は４倍の電子ズームを使用した場合の例であ
り、レジスタの段数は、ズームの倍率に応じて決定され
る。電子ズームによる倍率が高ければ、レジスタの段数
は増大し、倍率が低ければ、レジスタの段数は減少させ
ることができる。
デコーダ（２０６）において倍率信号は整数化され、映
像信号の遅延時間をセレクタ（２０７）により決定す
る。ついで、入力された映像信号との差分を計算する。
なお、図３は４倍の電子ズームを使用した場合の例であ
り、レジスタの段数は、ズームの倍率に応じて決定され
る。電子ズームによる倍率が高ければ、レジスタの段数
は増大し、倍率が低ければ、レジスタの段数は減少させ
ることができる。
【００１６】図４は、差分回路１（１０１）の出力説明
図である。
図である。
【００１７】現画像、２倍画像、その可変差分回路１出
力、４倍画像、その差可変分回路１出力であるが、２倍
の場合の可変差分回路１の出力値と、画像におけるその
部分の４倍の場合の可変差分回路１の出力値が等しくな
っている。また、差分回路２（１０２）においても同様
の手法を用いる。このようにして差分値を等しくすれ
ば、倍率が変化しても各エッジに対するエッジ補正量は
変わらない。
力、４倍画像、その差可変分回路１出力であるが、２倍
の場合の可変差分回路１の出力値と、画像におけるその
部分の４倍の場合の可変差分回路１の出力値が等しくな
っている。また、差分回路２（１０２）においても同様
の手法を用いる。このようにして差分値を等しくすれ
ば、倍率が変化しても各エッジに対するエッジ補正量は
変わらない。
【００１８】図５は、補正量演算回路（１０３）の実施
例の詳細図である。
例の詳細図である。
【００１９】３０１はベースクリップ回路、３０２は出
力反転回路、３０３は補正係数発生装置１、３０４は乗
算器である。
力反転回路、３０３は補正係数発生装置１、３０４は乗
算器である。
【００２０】補正量演算回路（１０３）には映像信号の
２階差分信号が入力される。前記入力信号をベースクリ
ップ回路（３０１）によりベースクリップし、出力反転
回路（３０２）により正負反転した信号を出力し、補正
係数発生装置（３０３）によって計算された補正係数と
乗算器（３０４）において掛け合わせ出力する。加算器
（１０４）において、補正量演算回路（１０３）出力を
映像信号に加えることによりエッジは強調される。
２階差分信号が入力される。前記入力信号をベースクリ
ップ回路（３０１）によりベースクリップし、出力反転
回路（３０２）により正負反転した信号を出力し、補正
係数発生装置（３０３）によって計算された補正係数と
乗算器（３０４）において掛け合わせ出力する。加算器
（１０４）において、補正量演算回路（１０３）出力を
映像信号に加えることによりエッジは強調される。
【００２１】図６は可変差分回路（１０１）の第２の実
施例である。
施例である。
【００２２】図３と同様に説明には４倍拡大の回路を用
いる。図６において、４０１〜４はレジスタ、４０５・
４０６はセレクタ、４０７・４０８は乗算器、４０９は
加算器、４１０は減算器、４１１は係数・切替え信号発
生装置である。
いる。図６において、４０１〜４はレジスタ、４０５・
４０６はセレクタ、４０７・４０８は乗算器、４０９は
加算器、４１０は減算器、４１１は係数・切替え信号発
生装置である。
【００２３】図７は、係数・切替え信号発生装置（４１
１）の詳細図である。
１）の詳細図である。
【００２４】図７において、５０１はコンパレータ、５
０２はデコーダ、５０３、５０４は減算器である。
０２はデコーダ、５０３、５０４は減算器である。
【００２５】図７では倍率信号が入力されると、コンパ
レータ（５０１）、デコーダ（５０２）において整数化
されたものを切替え信号とし、減算器（５０３）により
倍率信号とデコーダ（５０２）出力との差により係数ｋ
２を出力し、１と減算器（５０３）出力との差を減算器
（５０４）から計算することにより係数ｋ１を出力す
る。
レータ（５０１）、デコーダ（５０２）において整数化
されたものを切替え信号とし、減算器（５０３）により
倍率信号とデコーダ（５０２）出力との差により係数ｋ
２を出力し、１と減算器（５０３）出力との差を減算器
（５０４）から計算することにより係数ｋ１を出力す
る。
【００２６】図８は係数ｋ１、ｋ２、切替え信号の説明
図である。
図である。
【００２７】倍率信号が１〜４の範囲内で変化したと
き、差分幅に応じた切替え信号が決定される。倍率信号
が増大すれば、係数ｋ２は０〜１の範囲で増大し、切替
え信号が変化すると係数ｋ２は０にセットされる。反対
に、係数ｋ１は倍率信号が増大すると、１〜０の範囲で
減少し、切替え信号が変化すると係数ｋ１は１にセット
される。
き、差分幅に応じた切替え信号が決定される。倍率信号
が増大すれば、係数ｋ２は０〜１の範囲で増大し、切替
え信号が変化すると係数ｋ２は０にセットされる。反対
に、係数ｋ１は倍率信号が増大すると、１〜０の範囲で
減少し、切替え信号が変化すると係数ｋ１は１にセット
される。
【００２８】図９は、本発明の第３の実施例であり、エ
ッジ強調回路７の詳細図である。
ッジ強調回路７の詳細図である。
【００２９】６０１は１０１と同様な可変差分回路１、
６０２は１０２と同様な可変差分回路２、６０３はベー
スクリップ回路、６０４は出力反転回路、６０５は倍率
信号を入力に持つ補正係数発生回路２であり、６０６は
乗算器、６０７は加算器である。
６０２は１０２と同様な可変差分回路２、６０３はベー
スクリップ回路、６０４は出力反転回路、６０５は倍率
信号を入力に持つ補正係数発生回路２であり、６０６は
乗算器、６０７は加算器である。
【００３０】図９では、本発明の実施例１、２等の方法
で２階差分を計算した後、ベースクリップ回路（６０
３）によりベースクリップし、出力反転回路（６０４）
により正負反転した出力に、倍率信号に応じて可変であ
る補正係数発生装置（６０５）の出力を乗算器（６０
６）によって掛け合わせ、入力映像信号に加算器（６０
７）で加えることにより、エッジ補正信号が出力され
る。例えば、倍率信号の増大に応じて、補正係数発生装
置２（６０５）で出力される補正係数が増大するように
設定すれば、電子ズームによって高倍率画像を得た場合
の解像感の劣化した画像に対して、協力なエッジ補正を
することが可能となる。
で２階差分を計算した後、ベースクリップ回路（６０
３）によりベースクリップし、出力反転回路（６０４）
により正負反転した出力に、倍率信号に応じて可変であ
る補正係数発生装置（６０５）の出力を乗算器（６０
６）によって掛け合わせ、入力映像信号に加算器（６０
７）で加えることにより、エッジ補正信号が出力され
る。例えば、倍率信号の増大に応じて、補正係数発生装
置２（６０５）で出力される補正係数が増大するように
設定すれば、電子ズームによって高倍率画像を得た場合
の解像感の劣化した画像に対して、協力なエッジ補正を
することが可能となる。
【００３１】
【発明の効果】以上説明したように本発明によれば、従
来の撮像装置で電子ズームにより拡大された画像に比べ
て、高精細ＣＣＤを搭載することなく、画像の劣化の少
ない高品質な撮像信号が得られるので、低コスト高性能
な撮像装置が実現できる。
来の撮像装置で電子ズームにより拡大された画像に比べ
て、高精細ＣＣＤを搭載することなく、画像の劣化の少
ない高品質な撮像信号が得られるので、低コスト高性能
な撮像装置が実現できる。
【図１】本発明の実施例を示す図。
【図２】本発明の実施例中、エッジ強調処理回路７の詳
細図。
細図。
【図３】エッジ強調処理回路７中、可変差分回路１（１
０１）の第１の実施例を示す図。
０１）の第１の実施例を示す図。
【図４】図３の動作説明図。
【図５】エッジ強調処理回路７中、補正量演算回路（１
０４）の詳細図。
０４）の詳細図。
【図６】エッジ強調処理回路７中、可変差分回路１（１
０１）の第２の実施例を示す図。
０１）の第２の実施例を示す図。
【図７】図６中の係数・切替え信号発生装置（４１１）
の詳細図。
の詳細図。
【図８】図７の係数ｋ１、ｋ２、切替え信号の動作説明
図。
図。
【図９】第３の実施例（エッジ強調回路７）の詳細図。
Claims (1)
- 【請求項１】 映像信号を書き込みアドレスコントロー
ラの指定するフレームメモリのアドレスに書き込み、書
き込むタイミングとは異なるタイミングで読出しアドレ
スコントローラの指定するフレームメモリのアドレスか
らデータを読みだす拡大手段、前記映像信号による画像
のエッジ部を強調する為の可変差分手段を含むエッジ強
調処理回路、拡大手段による画像拡大率に応じて前記可
変差分手段の差分幅を可変し強調処理の特性を可変する
制御手段、を有する撮像装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5316805A JPH07177407A (ja) | 1993-12-16 | 1993-12-16 | 撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5316805A JPH07177407A (ja) | 1993-12-16 | 1993-12-16 | 撮像装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07177407A true JPH07177407A (ja) | 1995-07-14 |
Family
ID=18081123
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5316805A Withdrawn JPH07177407A (ja) | 1993-12-16 | 1993-12-16 | 撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07177407A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008236799A (ja) * | 2008-06-17 | 2008-10-02 | Canon Inc | 撮像装置及びその制御方法 |
| US7468749B2 (en) * | 2003-03-19 | 2008-12-23 | Sony Corporation | Image taking apparatus, and a method of controlling an edge enhancing level of an original image signal |
| US7602425B2 (en) | 2003-03-04 | 2009-10-13 | Canon Kabushiki Kaisha | Signal processing apparatus and image data generation apparatus with electronic reduction and enlargement signal processing capabilities |
| JP2014511071A (ja) * | 2011-03-16 | 2014-05-01 | クゥアルコム・インコーポレイテッド | ズームされた画像の生成 |
-
1993
- 1993-12-16 JP JP5316805A patent/JPH07177407A/ja not_active Withdrawn
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7602425B2 (en) | 2003-03-04 | 2009-10-13 | Canon Kabushiki Kaisha | Signal processing apparatus and image data generation apparatus with electronic reduction and enlargement signal processing capabilities |
| US8350944B2 (en) | 2003-03-04 | 2013-01-08 | Canon Kabushiki Kaisha | Signal processing apparatus and image data generation apparatus with electronic reduction and enlargement signal processing capabilities |
| US7468749B2 (en) * | 2003-03-19 | 2008-12-23 | Sony Corporation | Image taking apparatus, and a method of controlling an edge enhancing level of an original image signal |
| JP2008236799A (ja) * | 2008-06-17 | 2008-10-02 | Canon Inc | 撮像装置及びその制御方法 |
| JP2014511071A (ja) * | 2011-03-16 | 2014-05-01 | クゥアルコム・インコーポレイテッド | ズームされた画像の生成 |
| US9325905B2 (en) | 2011-03-16 | 2016-04-26 | Qualcomm Incorporated | Generating a zoomed image |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20010306 |