JPH07170461A - 撮像装置 - Google Patents
撮像装置Info
- Publication number
- JPH07170461A JPH07170461A JP5312015A JP31201593A JPH07170461A JP H07170461 A JPH07170461 A JP H07170461A JP 5312015 A JP5312015 A JP 5312015A JP 31201593 A JP31201593 A JP 31201593A JP H07170461 A JPH07170461 A JP H07170461A
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- Japan
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- circuit
- signal
- frame memory
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- Picture Signal Circuits (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Abstract
(57)【要約】
【目的】 電子ズーム機能を動作させるとき、高精細の
ＣＣＤを用いることなく劣化の少ない画像を得る。 【構成】 映像信号を書込みアドレスコントローラの指
定するフレームメモリのアドレスに書き込むと共に、書
き込みタイミングとは異なるタイミングで読出しアドレ
スコントローラの指定するフレームメモリのアドレスか
らデータを読み出す制御手段と、前記映像信号のエッジ
を強調するエッジ強調処理手段を有する。
ＣＣＤを用いることなく劣化の少ない画像を得る。 【構成】 映像信号を書込みアドレスコントローラの指
定するフレームメモリのアドレスに書き込むと共に、書
き込みタイミングとは異なるタイミングで読出しアドレ
スコントローラの指定するフレームメモリのアドレスか
らデータを読み出す制御手段と、前記映像信号のエッジ
を強調するエッジ強調処理手段を有する。
Description
【０００１】
【産業上の利用分野】電子ズーム機能を有するカムコー
ダー等の撮像装置に関する。
ダー等の撮像装置に関する。
【０００２】
【発明が解決しようとする課題】しかし撮像装置で電子
ズームを用いて画像を拡大した場合サンプリング周波数
が低くなることにより、水平・垂直解像度が劣化し、解
像感の低い画像となる。解像感を高めるためには、高精
細ＣＣＤ、高倍率レンズを搭載するという方法がある
が、これはコストが高く、容積が大きくなり実用的でな
かった。
ズームを用いて画像を拡大した場合サンプリング周波数
が低くなることにより、水平・垂直解像度が劣化し、解
像感の低い画像となる。解像感を高めるためには、高精
細ＣＣＤ、高倍率レンズを搭載するという方法がある
が、これはコストが高く、容積が大きくなり実用的でな
かった。
【０００３】
【課題を解決するための手段】フレームメモリ、前記フ
レームメモリの書込みアドレスを発生する書込みアドレ
スコントローラ、前記フレームメモリの読出しアドレス
を発生する読出しアドレスコントローラ、拡大された画
像のエッジを強調するエッジ強調処理回路を有し、映像
信号を書込みアドレスコントローラの指定するフレーム
メモリのアドレスに書き込み、書き込むタイミングとは
異なるタイミングで読出しアドレスコントローラの指定
するフレームメモリのアドレスからデータを読みだし、
エッジ強調処理回路により前記映像信号による画像のエ
ッジ部を強調する撮像装置であって、エッジ強調処理回
路では、輝度・色からエッジ検出を行い、輝度、色を補
正することを特徴とする撮像装置を提案する。
レームメモリの書込みアドレスを発生する書込みアドレ
スコントローラ、前記フレームメモリの読出しアドレス
を発生する読出しアドレスコントローラ、拡大された画
像のエッジを強調するエッジ強調処理回路を有し、映像
信号を書込みアドレスコントローラの指定するフレーム
メモリのアドレスに書き込み、書き込むタイミングとは
異なるタイミングで読出しアドレスコントローラの指定
するフレームメモリのアドレスからデータを読みだし、
エッジ強調処理回路により前記映像信号による画像のエ
ッジ部を強調する撮像装置であって、エッジ強調処理回
路では、輝度・色からエッジ検出を行い、輝度、色を補
正することを特徴とする撮像装置を提案する。
【０００４】
【実施例】図１は本発明の実施例である。
【０００５】１は撮像レンズ・絞り・フィルターを有す
るレンズ、２は撮像装置であるＣＣＤ、３はガンマ補正
・ローパスフィルター・クリップ回路を有する撮像信号
処理回路、４はＡＤコンバータ（ＡＤＣ）、５はフレー
ムメモリ、６は画像の画素間データを補間する補間回
路、７は画像のエッジ強調を行なうエッジ強調処理回
路、８はＤＡコンバータ（ＤＡＣ）、９はＶＴＲ等の撮
像信号を記録する記録回路である。１０は５のフレーム
メモリの書込みアドレスを指定する書込みアドレスコン
トローラ、１１はフレームメモリの読出しアドレスを指
定する読出しアドレスコントローラ、１２はテレ・ワイ
ド切り替えスイッチ、１３は倍率発生装置である。
るレンズ、２は撮像装置であるＣＣＤ、３はガンマ補正
・ローパスフィルター・クリップ回路を有する撮像信号
処理回路、４はＡＤコンバータ（ＡＤＣ）、５はフレー
ムメモリ、６は画像の画素間データを補間する補間回
路、７は画像のエッジ強調を行なうエッジ強調処理回
路、８はＤＡコンバータ（ＤＡＣ）、９はＶＴＲ等の撮
像信号を記録する記録回路である。１０は５のフレーム
メモリの書込みアドレスを指定する書込みアドレスコン
トローラ、１１はフレームメモリの読出しアドレスを指
定する読出しアドレスコントローラ、１２はテレ・ワイ
ド切り替えスイッチ、１３は倍率発生装置である。
【０００６】レンズ１から光学的に入力された映像は、
ＣＣＤ２によって電気信号となる。撮像信号処理回路３
で信号処理されアナログ信号を出力する。この撮像信号
処理回路３の出力はＡＤＣ４でＡＤ変換され、書込みア
ドレスコントローラ１０で指定されるフレームメモリ５
のアドレスに書き込まれる。次いで、テレ・ワイド切り
替えスイッチ１２、倍率発生装置１３により読み出しア
ドレスコントローラ１１を制御し、読出しアドレスコン
トローラ１１により指定されるアドレスから読み出され
る。読み出されたデータは補間回路６で画素間データは
補間され、エッジ強調処理回路７でエッジの強調処理が
なされ、ＤＡＣ８でＤＡ変換され記録回路９によって記
録される。
ＣＣＤ２によって電気信号となる。撮像信号処理回路３
で信号処理されアナログ信号を出力する。この撮像信号
処理回路３の出力はＡＤＣ４でＡＤ変換され、書込みア
ドレスコントローラ１０で指定されるフレームメモリ５
のアドレスに書き込まれる。次いで、テレ・ワイド切り
替えスイッチ１２、倍率発生装置１３により読み出しア
ドレスコントローラ１１を制御し、読出しアドレスコン
トローラ１１により指定されるアドレスから読み出され
る。読み出されたデータは補間回路６で画素間データは
補間され、エッジ強調処理回路７でエッジの強調処理が
なされ、ＤＡＣ８でＤＡ変換され記録回路９によって記
録される。
【０００７】図２はエッジ強調処理回路７の詳細図であ
る。
る。
【０００８】１０１は輝度差分回路１、１０２は絶対値
回路、１０３は輝度差分回路２、１０４は色信号差分回
路１、１０５は絶対値回路、１０６は色信号差分回路
２、１０７はエッジ判定回路、１０８，１０９はディレ
イ回路、１１１は輝度・色信号エンハンサである。
回路、１０３は輝度差分回路２、１０４は色信号差分回
路１、１０５は絶対値回路、１０６は色信号差分回路
２、１０７はエッジ判定回路、１０８，１０９はディレ
イ回路、１１１は輝度・色信号エンハンサである。
【０００９】図２において映像信号が入力されると、そ
の入力輝度信号から輝度差分回路１（１０１）、絶対値
回路（１０２）、輝度差分回路２（１０３）により輝度
信号のみによるエッジの判別を行い、入力色信号から、
色差分回路１（１０４）、絶対値回路（１０５）、色差
分回路２（１０６）により色信号のみによるエッジの判
別を行う。輝度の２階差分出力と色信号の２階差分を用
いてエッジ判定回路（１０７）でエッジを検出し、エッ
ジの前半（プリエッジ）、後半部分（ポストエッジ）を
判別する。
の入力輝度信号から輝度差分回路１（１０１）、絶対値
回路（１０２）、輝度差分回路２（１０３）により輝度
信号のみによるエッジの判別を行い、入力色信号から、
色差分回路１（１０４）、絶対値回路（１０５）、色差
分回路２（１０６）により色信号のみによるエッジの判
別を行う。輝度の２階差分出力と色信号の２階差分を用
いてエッジ判定回路（１０７）でエッジを検出し、エッ
ジの前半（プリエッジ）、後半部分（ポストエッジ）を
判別する。
【００１０】プリエッジ、もしくはポストエッジであれ
ば、プリエッジ信号もしくはポストエッジ信号がｏｎと
なり、どちらでも無ければ、ともにｏｆｆとなる。１０
８、１０９のディレイ回路により、タイミングを合わさ
れた輝度信号・色信号は輝度・色信号エンハンサ（１１
０）によりエッジの強調が行われる。
ば、プリエッジ信号もしくはポストエッジ信号がｏｎと
なり、どちらでも無ければ、ともにｏｆｆとなる。１０
８、１０９のディレイ回路により、タイミングを合わさ
れた輝度信号・色信号は輝度・色信号エンハンサ（１１
０）によりエッジの強調が行われる。
【００１１】図３は、輝度・色信号エンハンサ（１１
０）の詳細図である。
０）の詳細図である。
【００１２】２０１，２１４はディレイ回路、２０２，
２０９，２１５は１クロック遅延回路、２０３は係数ｋ
発生装置、２０４は係数（１−ｋ）発生装置、２０５，
２０６は乗算器、２０７は加算器、２０８，２１０，２
２０はセレクタ、２１１，２１２，２１８，２１９はメ
モリを含む時間軸反転回路、２１３，２１６，２１７は
２０３〜２０９を含むエッジ処理ブロックである。
２０９，２１５は１クロック遅延回路、２０３は係数ｋ
発生装置、２０４は係数（１−ｋ）発生装置、２０５，
２０６は乗算器、２０７は加算器、２０８，２１０，２
２０はセレクタ、２１１，２１２，２１８，２１９はメ
モリを含む時間軸反転回路、２１３，２１６，２１７は
２０３〜２０９を含むエッジ処理ブロックである。
【００１３】図３において、輝度信号が入力されたと
き、エッジ検出信号が共にｏｆｆであれば輝度信号はデ
ィレイ回路（２０１）、１クロック遅延回路（２０２）
を通過しセレクタ（２１０）より出力される。
き、エッジ検出信号が共にｏｆｆであれば輝度信号はデ
ィレイ回路（２０１）、１クロック遅延回路（２０２）
を通過しセレクタ（２１０）より出力される。
【００１４】プリエッジ信号がｏｎであれば、ディレイ
回路（２０１）を通過した輝度信号はセレクタ（２０
８）がプリ側を選択し、２０９により１クロック前の輝
度信号に係数発生装置（２０３）の出力ｋを乗算器（２
０６）で乗じたものと、現在の輝度信号に係数演算装置
（２０４）の出力（１−ｋ）を乗算器（２０５）によっ
て乗じたものとを加算器（２０７）により加算された値
をセレクタ（２１０）から出力する。
回路（２０１）を通過した輝度信号はセレクタ（２０
８）がプリ側を選択し、２０９により１クロック前の輝
度信号に係数発生装置（２０３）の出力ｋを乗算器（２
０６）で乗じたものと、現在の輝度信号に係数演算装置
（２０４）の出力（１−ｋ）を乗算器（２０５）によっ
て乗じたものとを加算器（２０７）により加算された値
をセレクタ（２１０）から出力する。
【００１５】ポストエッジ信号がｏｎであれば、時間軸
反転回路（２１１）内のメモリへの入力順の逆に出力す
ることによりあたかも時間軸が反転したかのごとく出力
することができる。２１１の出力をエッジ処理ブロック
（２１３）により、プリエッジ信号がｏｎである場合と
同様に処理を行う。更に２１３出力を時間軸反転回路
（２１２）により再反転することにより時間軸をもとに
戻す。２１２出力はセレクタ（２１０）により出力され
る。
反転回路（２１１）内のメモリへの入力順の逆に出力す
ることによりあたかも時間軸が反転したかのごとく出力
することができる。２１１の出力をエッジ処理ブロック
（２１３）により、プリエッジ信号がｏｎである場合と
同様に処理を行う。更に２１３出力を時間軸反転回路
（２１２）により再反転することにより時間軸をもとに
戻す。２１２出力はセレクタ（２１０）により出力され
る。
【００１６】色信号入力も輝度信号と同様の処理が行わ
れる。
れる。
【００１７】図４は、エッジ判定回路（１０７）の詳細
図である。
図である。
【００１８】３０１，３０５，３０９は輝度しきい回
路、３０２，３０６，３１０は色しきい回路、３０３，
３０４は論理和演算器、３０７，３０８，３１２，３１
３は論理積演算器、３１１はしきい値発生回路である。
路、３０２，３０６，３１０は色しきい回路、３０３，
３０４は論理和演算器、３０７，３０８，３１２，３１
３は論理積演算器、３１１はしきい値発生回路である。
【００１９】図４において、輝度差分回路２出力・色差
分回路２出力は、輝度しきい回路（３０１）・色しきい
回路（３０２）によって３値化され各々プリエッジ信号
ｏｎ、ポストエッジ信号ｏｎ、または共にｏｆｆとな
る。輝度しきい回路（３０１）、色しきい回路（３０
２）の出力の論理和を３０３、３０４でとることでプリ
・ポストエッジ信号を出力している。図４は、輝度によ
るエッジ信号と色信号によるエッジ信号とを共に拾って
いる。
分回路２出力は、輝度しきい回路（３０１）・色しきい
回路（３０２）によって３値化され各々プリエッジ信号
ｏｎ、ポストエッジ信号ｏｎ、または共にｏｆｆとな
る。輝度しきい回路（３０１）、色しきい回路（３０
２）の出力の論理和を３０３、３０４でとることでプリ
・ポストエッジ信号を出力している。図４は、輝度によ
るエッジ信号と色信号によるエッジ信号とを共に拾って
いる。
【００２０】図５では、同様に輝度しきい回路（３０
５）、色しきい回路（３０６）によるエッジ信号の論理
積を３０７、３０８でとることにより、輝度・色信号と
もにエッジ信号を出力している部分にプリエッジ信号・
ポストエッジ信号を出力する。
５）、色しきい回路（３０６）によるエッジ信号の論理
積を３０７、３０８でとることにより、輝度・色信号と
もにエッジ信号を出力している部分にプリエッジ信号・
ポストエッジ信号を出力する。
【００２１】図６では、図５と同じ動作であるが、色差
分回路２出力の値により、しきい値発生回路（３１１）
で輝度しきい回路（３０９）のしきい値を変化させる。
輝度しきい回路（３０９）・色しきい回路（３１０）に
より各々の信号によるプリ・ポストエッジ信号が出力さ
れると３１２、３１３により図５と同様に論理積をと
る。しきい値発生回路（３１１）では、色差分回路２出
力信号が大きくなると発生するしきい値が小さくなるよ
うに設計されている。これは、輝度差が小さく、色の差
が大きいエッジに対してエッジ検出効果が大きくなる。
分回路２出力の値により、しきい値発生回路（３１１）
で輝度しきい回路（３０９）のしきい値を変化させる。
輝度しきい回路（３０９）・色しきい回路（３１０）に
より各々の信号によるプリ・ポストエッジ信号が出力さ
れると３１２、３１３により図５と同様に論理積をと
る。しきい値発生回路（３１１）では、色差分回路２出
力信号が大きくなると発生するしきい値が小さくなるよ
うに設計されている。これは、輝度差が小さく、色の差
が大きいエッジに対してエッジ検出効果が大きくなる。
【００２２】図７は、図２に示されているエッジ強調処
理回路（７）の動作説明図であり、輝度信号に対する効
果を説明している。
理回路（７）の動作説明図であり、輝度信号に対する効
果を説明している。
【００２３】図７（ａ）ような輝度信号が入力されたと
き、輝度差分回路２（１０３）出力は（ｂ）のようにエ
ッジの変曲点の前部で正、後部で負となる。輝度しきい
回路により（ｂ）を３値化し、（ｃ）を得る。（ｃ）の
正の部分からプリエッジ信号（ｄ）、負の部分からポス
トエッジ信号（ｅ）を得る。エンハンサ（１１０）で
は、プリエッジで過去の信号を現在の信号に影響させ、
ポストエッジで時間的に未来の信号を現在の信号に影響
させる。このとき図３に示されている係数ｋが１であれ
ば（ｆ）の実線のように強調され、１より小さければ、
破線のようになる。
き、輝度差分回路２（１０３）出力は（ｂ）のようにエ
ッジの変曲点の前部で正、後部で負となる。輝度しきい
回路により（ｂ）を３値化し、（ｃ）を得る。（ｃ）の
正の部分からプリエッジ信号（ｄ）、負の部分からポス
トエッジ信号（ｅ）を得る。エンハンサ（１１０）で
は、プリエッジで過去の信号を現在の信号に影響させ、
ポストエッジで時間的に未来の信号を現在の信号に影響
させる。このとき図３に示されている係数ｋが１であれ
ば（ｆ）の実線のように強調され、１より小さければ、
破線のようになる。
【００２４】これと同じ処理が色信号も行われ、輝度・
色信号共にエッジ強調が行われる。
色信号共にエッジ強調が行われる。
【００２５】
【発明の効果】以上説明したように本発明によれば、従
来の撮像装置で電子ズームにより拡大された画像に比べ
て、高精細ＣＣＤを搭載することなく、画像の劣化の少
ない高品質な撮像信号が得られるので、低コスト高性能
な撮像装置が実現できる。
来の撮像装置で電子ズームにより拡大された画像に比べ
て、高精細ＣＣＤを搭載することなく、画像の劣化の少
ない高品質な撮像信号が得られるので、低コスト高性能
な撮像装置が実現できる。
【図１】本発明の実施例を示す図。
【図２】本発明の実施例中、エッジ強調処理回路７の詳
細図。
細図。
【図３】エッジ強調処理回路７中、輝度・色信号エンハ
ンサ（１１０）の詳細図。
ンサ（１１０）の詳細図。
【図４】エッジ強調処理回路７中、エッジ判定回路（１
０７）の一例の詳細図。
０７）の一例の詳細図。
【図５】エッジ判定回路１０７の別の例の回路図。
【図６】エッジ判定回路１０７の更に他の例の回路図。
【図７】エッジ強調処理回路７の動作図。
Claims (1)
- 【請求項１】 フレームメモリ、前記フレームメモリの
書込みアドレスを発生する書込みアドレスコントロー
ラ、前記フレームメモリの読出しアドレスを発生する読
出しアドレスコントローラ、拡大された画像のエッジを
強調するエッジ強調処理回路を有し、映像信号を前記書
込みアドレスコントローラの指定するフレームメモリの
アドレスに書き込み、書き込みタイミングとは異なるタ
イミングで読出しアドレスコントローラの指定するフレ
ームメモリのアドレスからデータを読みだす制御手段
と、前記映像信号による画像のエッジ部を強調すると共
に輝度・色からエッジ検出を行い、輝度、色を補正する
エッジ強調処理手段を有することを特徴とする撮像装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5312015A JPH07170461A (ja) | 1993-12-13 | 1993-12-13 | 撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5312015A JPH07170461A (ja) | 1993-12-13 | 1993-12-13 | 撮像装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07170461A true JPH07170461A (ja) | 1995-07-04 |
Family
ID=18024192
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5312015A Withdrawn JPH07170461A (ja) | 1993-12-13 | 1993-12-13 | 撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07170461A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100459389B1 (ko) * | 1997-09-30 | 2005-05-09 | 엘지전자 주식회사 | 디지털스틸카메라의보간회로 |
| JP2006217385A (ja) * | 2005-02-04 | 2006-08-17 | Sharp Corp | テレビ画像処理装置 |
| JP2014511071A (ja) * | 2011-03-16 | 2014-05-01 | クゥアルコム・インコーポレイテッド | ズームされた画像の生成 |
-
1993
- 1993-12-13 JP JP5312015A patent/JPH07170461A/ja not_active Withdrawn
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100459389B1 (ko) * | 1997-09-30 | 2005-05-09 | 엘지전자 주식회사 | 디지털스틸카메라의보간회로 |
| JP2006217385A (ja) * | 2005-02-04 | 2006-08-17 | Sharp Corp | テレビ画像処理装置 |
| JP2014511071A (ja) * | 2011-03-16 | 2014-05-01 | クゥアルコム・インコーポレイテッド | ズームされた画像の生成 |
| US9325905B2 (en) | 2011-03-16 | 2016-04-26 | Qualcomm Incorporated | Generating a zoomed image |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20010306 |