JPH07230302A - 差分回路 - Google Patents
差分回路Info
- Publication number
- JPH07230302A JPH07230302A JP1931294A JP1931294A JPH07230302A JP H07230302 A JPH07230302 A JP H07230302A JP 1931294 A JP1931294 A JP 1931294A JP 1931294 A JP1931294 A JP 1931294A JP H07230302 A JPH07230302 A JP H07230302A
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- Japan
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- signal
- differential
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Abstract
(57)【要約】
【目的】この発明は、時間的差分の正確な取出しを実現
したうえで、構成の簡略化と共に、小形化を図ることに
ある。 【構成】検出回路１０の検出信号を微分回路２０で微分
して微分波形を有するピ―ク状信号に変換して、このピ
―ク状信号のピ―ク値をＳ／Ｈ回路２１で１サンプリン
グ期間保持することで、差分信号を得るように構成し、
所期の目的を達成したものである。
したうえで、構成の簡略化と共に、小形化を図ることに
ある。 【構成】検出回路１０の検出信号を微分回路２０で微分
して微分波形を有するピ―ク状信号に変換して、このピ
―ク状信号のピ―ク値をＳ／Ｈ回路２１で１サンプリン
グ期間保持することで、差分信号を得るように構成し、
所期の目的を達成したものである。
Description
【０００１】
【産業上の利用分野】この発明は、例えば太陽センサの
ＣＣＤセンサ等のディジタル型の検出回路で周期的にサ
ンプリングした検出信号よりＰＩＤ制御信号を生成する
ための微分処理の前処理として差分信号を取出す差分回
路に関する。
ＣＣＤセンサ等のディジタル型の検出回路で周期的にサ
ンプリングした検出信号よりＰＩＤ制御信号を生成する
ための微分処理の前処理として差分信号を取出す差分回
路に関する。
【０００２】
【従来の技術】一般に、ＰＩＤ制御信号を生成するＰＩ
Ｄ制御回路としては、図３に示すように、ＣＣＤセンサ
等のディジタル型検出回路１０で周期的にサンプリング
した検出信号Ｓ（ｎ）を比例回路１１、積分回路１２及
び微分回路１３に導き、比例（Ｐ）、積分（Ｉ）及び微
分（Ｄ）を施して比例信号Ｋ・Ｓn 、積分信号Ｓn 及び
速度補償用の微分信号Ｓ｛（ｎ）−Ｓ（ｎ−１）｝／Δ
Ｔ ×Ｘ（ｎ）を生成した後、加算器１４で加算してＰ
ＩＤ制御信号を得ている。この場合、微分回路１３とし
ては、検出信号Ｓ（ｎ）から差分回路１３ａで、１サン
プリング毎の時間的差分信号Ｓ（ｎ）−Ｓ（ｎ−１）を
求めた後、除算器１３ｂで差分信号Ｓ（ｎ）−Ｓ（ｎ−
１）よりサンプリング周期ΔＴを除算して速度補償回路
１３ｃで速度補償ゲインを乗ずることにより微分信号
｛Ｓ（ｎ）−Ｓ（ｎ−１）｝／ΔＴ×Ｘ（ｎ）を得てい
る。
Ｄ制御回路としては、図３に示すように、ＣＣＤセンサ
等のディジタル型検出回路１０で周期的にサンプリング
した検出信号Ｓ（ｎ）を比例回路１１、積分回路１２及
び微分回路１３に導き、比例（Ｐ）、積分（Ｉ）及び微
分（Ｄ）を施して比例信号Ｋ・Ｓn 、積分信号Ｓn 及び
速度補償用の微分信号Ｓ｛（ｎ）−Ｓ（ｎ−１）｝／Δ
Ｔ ×Ｘ（ｎ）を生成した後、加算器１４で加算してＰ
ＩＤ制御信号を得ている。この場合、微分回路１３とし
ては、検出信号Ｓ（ｎ）から差分回路１３ａで、１サン
プリング毎の時間的差分信号Ｓ（ｎ）−Ｓ（ｎ−１）を
求めた後、除算器１３ｂで差分信号Ｓ（ｎ）−Ｓ（ｎ−
１）よりサンプリング周期ΔＴを除算して速度補償回路
１３ｃで速度補償ゲインを乗ずることにより微分信号
｛Ｓ（ｎ）−Ｓ（ｎ−１）｝／ΔＴ×Ｘ（ｎ）を得てい
る。
【０００３】図４はこのような従来の差分回路を示すも
ので、検出回路１０で周期的にサンプリングした検出信
号Ｓ（ｎ）（図４中実線で示す）をアナログ遅延線１で
一定期間ΔＴだけ遅延させた遅延信号Ｓ（ｎ−１）（図
５（ａ）中破線で示す）を生成する。そして、この遅延
信号Ｓ（ｎ−１）は、検出信号Ｓ（ｎ）と共に差分アン
プ２に導かれて、その差分が取出され、図５（ｂ）に示
すような差分信号Ｓ（ｎ）−Ｓ（ｎ−１）が生成され
る。
ので、検出回路１０で周期的にサンプリングした検出信
号Ｓ（ｎ）（図４中実線で示す）をアナログ遅延線１で
一定期間ΔＴだけ遅延させた遅延信号Ｓ（ｎ−１）（図
５（ａ）中破線で示す）を生成する。そして、この遅延
信号Ｓ（ｎ−１）は、検出信号Ｓ（ｎ）と共に差分アン
プ２に導かれて、その差分が取出され、図５（ｂ）に示
すような差分信号Ｓ（ｎ）−Ｓ（ｎ−１）が生成され
る。
【０００４】ところが、上記差分回路では、構成が複雑
な差分アンプ２を使用している構成上、複雑で、大形と
なるために、特に、宇宙搭載機器等のスペ―ス的要求の
厳しい電子機器に適用するのに不向きであるという問題
を有していた。
な差分アンプ２を使用している構成上、複雑で、大形と
なるために、特に、宇宙搭載機器等のスペ―ス的要求の
厳しい電子機器に適用するのに不向きであるという問題
を有していた。
【０００５】また、上記アナログ遅延線１に換えて、図
示しないサンプル・ホ―ルド回路を備えたものもある
が、同様に差分アンプを備えなければならないために、
同様の問題を有する。
示しないサンプル・ホ―ルド回路を備えたものもある
が、同様に差分アンプを備えなければならないために、
同様の問題を有する。
【０００６】
【発明が解決しようとする課題】以上述べたように、従
来の差分回路では、複雑な差分アンプを備えなければな
らないために、構成が複雑で、大形となるという問題を
有していた。この発明は上記の事情に鑑みてなされたも
ので、時間的差分の正確な取出しを実現したうえで、構
成の簡略化と共に、小形化を図り得るようにした差分回
路を提供することを目的とする。
来の差分回路では、複雑な差分アンプを備えなければな
らないために、構成が複雑で、大形となるという問題を
有していた。この発明は上記の事情に鑑みてなされたも
ので、時間的差分の正確な取出しを実現したうえで、構
成の簡略化と共に、小形化を図り得るようにした差分回
路を提供することを目的とする。
【０００７】
【課題を解決するための手段】この発明は、検出回路で
周期的にサンプリングした検出信号の現時点と１サンプ
リング前の差分信号を取出してなる差分回路において、
前記検出回路の検出信号を微分して微分波形を有する信
号に変換する微分回路と、この微分回路で得た信号のピ
―ク値を１サンプリング期間保持して差分信号を得るサ
ンプル・ホ―ルド回路とを備えて構成したものである。
周期的にサンプリングした検出信号の現時点と１サンプ
リング前の差分信号を取出してなる差分回路において、
前記検出回路の検出信号を微分して微分波形を有する信
号に変換する微分回路と、この微分回路で得た信号のピ
―ク値を１サンプリング期間保持して差分信号を得るサ
ンプル・ホ―ルド回路とを備えて構成したものである。
【０００８】
【作用】上記構成によれば、差分信号は検出信号を微分
回路で微分した微分波形を有した信号に変換して、その
信号のピ―ク値をサンプル・ホ―ルド回路で、１サンプ
リング期間保持することにより得られる。従って、構成
が複雑な差分アンプを備えなくて済むことにより、その
構成の簡略化と共に、小形化が図れる。
回路で微分した微分波形を有した信号に変換して、その
信号のピ―ク値をサンプル・ホ―ルド回路で、１サンプ
リング期間保持することにより得られる。従って、構成
が複雑な差分アンプを備えなくて済むことにより、その
構成の簡略化と共に、小形化が図れる。
【０００９】
【実施例】以下、この発明の実施例について、図面を参
照して詳細に説明する。図１はこの発明の一実施例に係
る差分回路を示すもので、例えば前記図３の微分回路１
３における差分回路１３ａに対応される。すなわち、Ｃ
ＣＤセンサ等の検出回路１０の出力端には微分回路２０
が接続される。この微分回路２０はコンデンサＣ及び抵
抗Ｒで形成され、その出力端には前記除算器１３ｂ（図
３参照）に接続されるサンプル・ホ―ルド（Ｓ／Ｈ）回
路２１が接続される。
照して詳細に説明する。図１はこの発明の一実施例に係
る差分回路を示すもので、例えば前記図３の微分回路１
３における差分回路１３ａに対応される。すなわち、Ｃ
ＣＤセンサ等の検出回路１０の出力端には微分回路２０
が接続される。この微分回路２０はコンデンサＣ及び抵
抗Ｒで形成され、その出力端には前記除算器１３ｂ（図
３参照）に接続されるサンプル・ホ―ルド（Ｓ／Ｈ）回
路２１が接続される。
【００１０】上記構成により、検出回路１０で周期的に
サンプリングされた検出信号Ｓ（ｎ）（図２（ａ）参
照）は微分回路２１に導かれて微分され、図４（ｂ）に
示すように微分波形を有したパルス状信号に変換され
る。このパルス状信号は、その波高値が１サンプリング
前の検出信号Ｓ（ｎ−１）との差分値となり、検出信号
Ｓ（ｎ）の変化点で微分回路２０からＳ／Ｈ回路２１に
導かれる。このＳ／Ｈ回路２１は、微分波形のピ―ク値
でサンプリングし、その後、一定時間ΔＴの期間保持し
て、図２（ｃ）に示すような差分信号Ｓ（ｎ）−Ｓ（ｎ
−１）を得て除算器１３ｂ（図３参照）に出力し、前記
と同様に微分信号Ｓ｛（ｎ）−Ｓ（ｎ−１）｝／ΔＴ
×Ｘ（ｎ）が生成される。
サンプリングされた検出信号Ｓ（ｎ）（図２（ａ）参
照）は微分回路２１に導かれて微分され、図４（ｂ）に
示すように微分波形を有したパルス状信号に変換され
る。このパルス状信号は、その波高値が１サンプリング
前の検出信号Ｓ（ｎ−１）との差分値となり、検出信号
Ｓ（ｎ）の変化点で微分回路２０からＳ／Ｈ回路２１に
導かれる。このＳ／Ｈ回路２１は、微分波形のピ―ク値
でサンプリングし、その後、一定時間ΔＴの期間保持し
て、図２（ｃ）に示すような差分信号Ｓ（ｎ）−Ｓ（ｎ
−１）を得て除算器１３ｂ（図３参照）に出力し、前記
と同様に微分信号Ｓ｛（ｎ）−Ｓ（ｎ−１）｝／ΔＴ
×Ｘ（ｎ）が生成される。
【００１１】このように、上記差分回路は、検出回路１
０の検出信号を微分回路２０で微分して微分波形を有す
るピ―ク状信号に変換して、このピ―ク状信号のピ―ク
値をＳ／Ｈ回路２１で１サンプリング期間保持すること
で、差分信号を得るように構成したことにより、従来の
ように、構成が複雑な差分アンプ２（図４参照）を備え
なくて済むために、可及的に構成の簡略化と共に、小形
化が図れる。なお、この発明は上記実施例に限ることな
く、その他、この発明の要旨を逸脱しない範囲で種々の
変形を実施し得ることは勿論のことである。
０の検出信号を微分回路２０で微分して微分波形を有す
るピ―ク状信号に変換して、このピ―ク状信号のピ―ク
値をＳ／Ｈ回路２１で１サンプリング期間保持すること
で、差分信号を得るように構成したことにより、従来の
ように、構成が複雑な差分アンプ２（図４参照）を備え
なくて済むために、可及的に構成の簡略化と共に、小形
化が図れる。なお、この発明は上記実施例に限ることな
く、その他、この発明の要旨を逸脱しない範囲で種々の
変形を実施し得ることは勿論のことである。
【００１２】
【発明の効果】以上詳述したように、この発明によれ
ば、時間的差分の正確な取出しを実現したうえで、構成
の簡略化と共に、小形化を図り得るようにした差分回路
を提供することができる。
ば、時間的差分の正確な取出しを実現したうえで、構成
の簡略化と共に、小形化を図り得るようにした差分回路
を提供することができる。
【図面の簡単な説明】
【図１】この発明の一実施例に係る差分回路を示す回路
構成図。
構成図。
【図２】図１の動作を説明するために示した波形図。
【図３】この発明の適用されるＰＩＤ制御回路を示す回
路構成図。
路構成図。
【図４】従来の差分回路を示す回路構成図。
【図５】図４の動作を説明するために示した波形図。
１０…検出回路、１１…比例回路、１２…積分回路、１
３…微分回路、１３ａ…差分回路、１３ｂ…除算器、１
３ｃ…速度補償回路、１４…加算器、２０…微分回路、
２１…サンプル・ホ―ルド回路。
３…微分回路、１３ａ…差分回路、１３ｂ…除算器、１
３ｃ…速度補償回路、１４…加算器、２０…微分回路、
２１…サンプル・ホ―ルド回路。
Claims (1)
- 【請求項１】 検出回路で周期的にサンプリングした検
出信号の現時点と１サンプリング前の差分信号を取出し
てなる差分回路において、 前記検出回路の検出信号を微分して微分波形を有する信
号に変換する微分回路と、 この微分回路で得た信号のピ―ク値を１サンプリング期
間保持して差分信号を得るサンプル・ホ―ルド回路とを
具備したことを特徴とする差分回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1931294A JP2856667B2 (ja) | 1994-02-16 | 1994-02-16 | 差分回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1931294A JP2856667B2 (ja) | 1994-02-16 | 1994-02-16 | 差分回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07230302A true JPH07230302A (ja) | 1995-08-29 |
| JP2856667B2 JP2856667B2 (ja) | 1999-02-10 |
Family
ID=11995903
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1931294A Expired - Fee Related JP2856667B2 (ja) | 1994-02-16 | 1994-02-16 | 差分回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2856667B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2023276707A1 (ja) * | 2021-07-02 | 2023-01-05 | 国立研究開発法人科学技術振興機構 | スパイキングニューロン回路システムおよびスパイキングニューロン回路 |
-
1994
- 1994-02-16 JP JP1931294A patent/JP2856667B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2023276707A1 (ja) * | 2021-07-02 | 2023-01-05 | 国立研究開発法人科学技術振興機構 | スパイキングニューロン回路システムおよびスパイキングニューロン回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2856667B2 (ja) | 1999-02-10 |
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Legal Events
| Date | Code | Title | Description |
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| LAPS | Cancellation because of no payment of annual fees |