JPH0731703B2 - 信号処理回路 - Google Patents
信号処理回路Info
- Publication number
- JPH0731703B2 JPH0731703B2 JP1131744A JP13174489A JPH0731703B2 JP H0731703 B2 JPH0731703 B2 JP H0731703B2 JP 1131744 A JP1131744 A JP 1131744A JP 13174489 A JP13174489 A JP 13174489A JP H0731703 B2 JPH0731703 B2 JP H0731703B2
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- Japan
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- transistor
- emitter
- voltage
- input
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Description
【発明の詳細な説明】 産業上の利用分野 本発明は二信号の差の関数である出力信号を得る信号処
理回路に関するものである。
理回路に関するものである。
従来の技術 ビテオカメラでは、オートフォーカスシステムを構成す
る測距方式の１つとして近赤外光を利用した三角測距方
式が採用されている。この方式は、測距対象物に向う光
軸に対して直角方向に受光素子より間隔をおいて配置さ
れた赤外光発光素子から対象物に対して赤外光を発射
し、その対象物での反射光を受光素子で結像し、その像
の位置から入射光の角度を検出するようになっている。
この場合、前記受光素子として分割型のホトダイオード
やPSD（ポジション・センシティブ・ダイオード）を用
いた信号処理回路が用意されており、受光した光強度の
分布から入射光の位置（従って対象物の距離）を検出す
ることができるようになっている。
る測距方式の１つとして近赤外光を利用した三角測距方
式が採用されている。この方式は、測距対象物に向う光
軸に対して直角方向に受光素子より間隔をおいて配置さ
れた赤外光発光素子から対象物に対して赤外光を発射
し、その対象物での反射光を受光素子で結像し、その像
の位置から入射光の角度を検出するようになっている。
この場合、前記受光素子として分割型のホトダイオード
やPSD（ポジション・センシティブ・ダイオード）を用
いた信号処理回路が用意されており、受光した光強度の
分布から入射光の位置（従って対象物の距離）を検出す
ることができるようになっている。
たとえばPSDの第１の出力から取り出された赤外光生成
電流をIa、また第２の出力から取り出された赤外光生成
電流をIbとすると被写体（対象物）までの距離はIa/Ib
に反比例するので、この二信号の比Ia/Ibから被写体ま
での距離が求まる。
電流をIa、また第２の出力から取り出された赤外光生成
電流をIbとすると被写体（対象物）までの距離はIa/Ib
に反比例するので、この二信号の比Ia/Ibから被写体ま
での距離が求まる。
発明が解決しようとする課題 しかしながら、このような信号処理回路では、被写体が
無限遠に存するとき、二入力が無信号状態となり、発生
するノイズのために出力が不定となってしまう。斯る問
題を解決するために、コンパレータを用いて赤外光生成
電流が或るレベル以下に小さくなったことを判定して無
限遠とする回路も提案されているが、この場合にはコン
パレータ自体が比較的複雑である上にコンパレータの出
力に基づいて無限遠相当の信号になす手段も必要となる
ことから全体として構成が複雑になるという欠点があ
る。
無限遠に存するとき、二入力が無信号状態となり、発生
するノイズのために出力が不定となってしまう。斯る問
題を解決するために、コンパレータを用いて赤外光生成
電流が或るレベル以下に小さくなったことを判定して無
限遠とする回路も提案されているが、この場合にはコン
パレータ自体が比較的複雑である上にコンパレータの出
力に基づいて無限遠相当の信号になす手段も必要となる
ことから全体として構成が複雑になるという欠点があ
る。
本発明はこのような点に鑑みなされたものであって、簡
単な構成によって上記の問題を解決する新規な信号処理
回路を提供することを目的とする。
単な構成によって上記の問題を解決する新規な信号処理
回路を提供することを目的とする。
課題を解決するための手段 上記の目的を達成するため本発明では、第１の入力信号
電圧がベースに入力され、コレクタは接地され、エミッ
タは第１定電流源に接続された第１のPNP型トランジス
タと、第２の入力信号電圧がベースに入力され、コレク
タは接地され、エミッタは第２定電流源に接続された第
２のPNP型トランジスタと、前記第１のPNP型トランジス
タのエミッタと前記第２のPNP型トランジスタのエミッ
タとが入力部に接続された差動増幅器を有する。２つの
入力信号電圧の差の関数である出力信号を前記差動増幅
器の出力側に得る信号処理回路において、 前記第１のPNP型トランジスタのエミッタにエミッタが
接続され、コレクタは接地され、ベースには一定のクラ
ンプ電圧が印加される第３のPNP型トランジスタを有す
る構成としている。
電圧がベースに入力され、コレクタは接地され、エミッ
タは第１定電流源に接続された第１のPNP型トランジス
タと、第２の入力信号電圧がベースに入力され、コレク
タは接地され、エミッタは第２定電流源に接続された第
２のPNP型トランジスタと、前記第１のPNP型トランジス
タのエミッタと前記第２のPNP型トランジスタのエミッ
タとが入力部に接続された差動増幅器を有する。２つの
入力信号電圧の差の関数である出力信号を前記差動増幅
器の出力側に得る信号処理回路において、 前記第１のPNP型トランジスタのエミッタにエミッタが
接続され、コレクタは接地され、ベースには一定のクラ
ンプ電圧が印加される第３のPNP型トランジスタを有す
る構成としている。
作用 このような構成によると、入力信号が小さくなってノイ
ズが無視しえなくなった状態のとき、少くとも一方の入
力の信号レベルはクランプされるので、二信号の差の関
数である信号を出力する例えば演算増幅器の出力値は固
定状態となり、ノイズによる出力の不定は解消される。
ズが無視しえなくなった状態のとき、少くとも一方の入
力の信号レベルはクランプされるので、二信号の差の関
数である信号を出力する例えば演算増幅器の出力値は固
定状態となり、ノイズによる出力の不定は解消される。
実施例 以下、図面に示す本発明の一実施例について説明する。
図において、Ia,IbはそれぞれPSDて生成された第1,第２
の信号電流であり、電流・電圧変換器（１）（２）によ
って電圧V1，V2に変換される。ここで、電流・電圧変換
器（１）（２）は特にこれに限る必要はないが、入力が
小さい程、出力レベルが高くなるように構成されてい
る。第１の電圧V1はPNP型の第１トランジスタ(Q1)のベ
ースに印加される。この第１トランジスタ(Q2)には同じ
くPNP型の第２のトランジスタ(Q2)が接続され、これら
のトランジスタ(Q1)(Q2)のエミッタは第１定電流源(I1)
に共通に接続され、コレクタは接地点に接続されてい
る。第２トランジスタ(Q2)のベースには一定電圧Vcが与
えられるようになっている。一方、第２の電圧V2はPNP
型の第３トランジスタ(Q3)のベースに与えられる。この
第３トランジスタ(Q3)のエミッタは第２の定電流源(I2)
に接続され、コレクタは接地されている。（３）は電圧
変換され個別の経路から与えられる第１信号と第２信号
の比を取る演算増幅器（差動増幅器）であって、差動対
をなすNPN型の第４トランジスタ(Q4)のベースは（ａ）
点に接続され、第５トランジスタ(Q5)のベースは（ｂ）
点に接続されている。(I0)はこれらのトランジスタのエ
ミッタ側に設けられた第３の定電流源である。
図において、Ia,IbはそれぞれPSDて生成された第1,第２
の信号電流であり、電流・電圧変換器（１）（２）によ
って電圧V1，V2に変換される。ここで、電流・電圧変換
器（１）（２）は特にこれに限る必要はないが、入力が
小さい程、出力レベルが高くなるように構成されてい
る。第１の電圧V1はPNP型の第１トランジスタ(Q1)のベ
ースに印加される。この第１トランジスタ(Q2)には同じ
くPNP型の第２のトランジスタ(Q2)が接続され、これら
のトランジスタ(Q1)(Q2)のエミッタは第１定電流源(I1)
に共通に接続され、コレクタは接地点に接続されてい
る。第２トランジスタ(Q2)のベースには一定電圧Vcが与
えられるようになっている。一方、第２の電圧V2はPNP
型の第３トランジスタ(Q3)のベースに与えられる。この
第３トランジスタ(Q3)のエミッタは第２の定電流源(I2)
に接続され、コレクタは接地されている。（３）は電圧
変換され個別の経路から与えられる第１信号と第２信号
の比を取る演算増幅器（差動増幅器）であって、差動対
をなすNPN型の第４トランジスタ(Q4)のベースは（ａ）
点に接続され、第５トランジスタ(Q5)のベースは（ｂ）
点に接続されている。(I0)はこれらのトランジスタのエ
ミッタ側に設けられた第３の定電流源である。
このような第１図の回路において、第３トランジスタ(Q
3)はベースに印加される入力電圧（第２の電圧V2）の大
小に拘わらずに常にON状態になっている。これに対し、
第１トランジスタ(Q1)はベースに印加される入力電圧
（第１の電圧V1）がVcよりも一定値以上高くなると、OF
Fとなり、第２トランジスタ(Q2)のみがONする。第１の
電圧V1がVcよりも一定値以上高くなれば第１トランジス
タ(Q1)はOFFするが、逆にVcよりも一定値以上低くなる
と、第２トランジスタ(Q2)がOFFとなる。
3)はベースに印加される入力電圧（第２の電圧V2）の大
小に拘わらずに常にON状態になっている。これに対し、
第１トランジスタ(Q1)はベースに印加される入力電圧
（第１の電圧V1）がVcよりも一定値以上高くなると、OF
Fとなり、第２トランジスタ(Q2)のみがONする。第１の
電圧V1がVcよりも一定値以上高くなれば第１トランジス
タ(Q1)はOFFするが、逆にVcよりも一定値以上低くなる
と、第２トランジスタ(Q2)がOFFとなる。
今、V1＜Vcであれば V3＝V1＋VBE1 V4＝V2＋VBE3 となる。VBE1，VBE3はそれぞれ第1,第３トランジスタの
ベース・エミッタ順方向電圧である。ここで、I1＝I2と
すると V4−V3＝VBE5−VBE4＝V2−V1 …… となる。VBE4，VBE5は第4,第５トランジスタのベース・
エミッタ順方向電圧である。
ベース・エミッタ順方向電圧である。ここで、I1＝I2と
すると V4−V3＝VBE5−VBE4＝V2−V1 …… となる。VBE4，VBE5は第4,第５トランジスタのベース・
エミッタ順方向電圧である。
また、熱電圧をVTとし、トランジスタの逆方向飽和電流
をIsとすると、 従って、出力電流Ioutは、 と表わすことができ、ここで式を用いて、 を得る。
をIsとすると、 従って、出力電流Ioutは、 と表わすことができ、ここで式を用いて、 を得る。
被写体が無限遠のときは式のV1−V2は略０になり、こ
れに代って第1,第３トランジスタ(Q1)(Q3)のベースに到
来するノイズのために出力電流（従って測距出力）Iout
は不定となる。しかしながら、本実施例では第２トラン
ジスタ(Q2)を設け、しかもこの第２トランジスタ(Q2)の
ベースを固定の電圧値に保持するので、入力された二信
号のうち一方の信号は一定の値にクランプされることに
なる。即ち、被写体が著しく遠くなって入力される二信
号が小さな値であるとき、V1≒V2＞Vcとなり、第１トラ
ンジスタ(Q1)がOFFで第２トランジスタ(Q2)がONの状態
となるためV3＝Vc＋VBE2となり、第４トランジスタ(Q4)
側のベースの入力電圧は固定される。一方、このときで
も第３トランジスタ(Q3)はONしているので、高いV2の値
に伴ない第５トランジスタ(Q5)のベース電圧Vcは高いレ
ベルとなる。従って、V4》V3が成り立ち、第４トランジ
スタ(Q4)がOFFで、第５トランジスタ(Q5)がONの状態と
なる。このため、出力電流IoutはIout≒I0となり、殆ど
一定の測距出力を得ることができる。
れに代って第1,第３トランジスタ(Q1)(Q3)のベースに到
来するノイズのために出力電流（従って測距出力）Iout
は不定となる。しかしながら、本実施例では第２トラン
ジスタ(Q2)を設け、しかもこの第２トランジスタ(Q2)の
ベースを固定の電圧値に保持するので、入力された二信
号のうち一方の信号は一定の値にクランプされることに
なる。即ち、被写体が著しく遠くなって入力される二信
号が小さな値であるとき、V1≒V2＞Vcとなり、第１トラ
ンジスタ(Q1)がOFFで第２トランジスタ(Q2)がONの状態
となるためV3＝Vc＋VBE2となり、第４トランジスタ(Q4)
側のベースの入力電圧は固定される。一方、このときで
も第３トランジスタ(Q3)はONしているので、高いV2の値
に伴ない第５トランジスタ(Q5)のベース電圧Vcは高いレ
ベルとなる。従って、V4》V3が成り立ち、第４トランジ
スタ(Q4)がOFFで、第５トランジスタ(Q5)がONの状態と
なる。このため、出力電流IoutはIout≒I0となり、殆ど
一定の測距出力を得ることができる。
以上において、本発明の信号処理回路を測距に用いる場
合を別に挙げて説明したが、本発明はこれに限るもので
はなく、種々の用途に向けることができるものである。
合を別に挙げて説明したが、本発明はこれに限るもので
はなく、種々の用途に向けることができるものである。
発明の効果 以上説明したように本発明によれば、二信号の差の関数
である信号を出力する信号処理回路において、入力信号
が小さくなってノイズが無視しえなくなった状態のとき
でも出力の不定は生じないので、常に有効な出力を得る
ことができるという効果がある。しかも、その構成は複
雑化することはなく簡素に実現できる。
である信号を出力する信号処理回路において、入力信号
が小さくなってノイズが無視しえなくなった状態のとき
でも出力の不定は生じないので、常に有効な出力を得る
ことができるという効果がある。しかも、その構成は複
雑化することはなく簡素に実現できる。
第１図は本発明を実施した信号処理回路の回路図であ
る。 Ia…第１の信号電流,Ib…第２の信号電流,Iout…出力電
流，(Q2)…第２トランジスタ,Vc…クランプ用の一定電
圧，（３）…演算増幅器。
る。 Ia…第１の信号電流,Ib…第２の信号電流,Iout…出力電
流，(Q2)…第２トランジスタ,Vc…クランプ用の一定電
圧，（３）…演算増幅器。
Claims (1)
- 【請求項１】第１の入力信号電圧がベースに入力され、
コレクタは接地され、エミッタは第１定電流源に接続さ
れた第１のPNP型トランジスタと、第２の入力信号電圧
がベースに入力され、コレクタは接地され、エミッタは
第２定電流源に接続された第２のPNP型トランジスタ
と、前記第１のPNP型トランジスタのエミッタと前記第
２のPNP型トランジスタのエミッタとが入力部に接続さ
れた差動増幅器を有する、２つの入力信号電圧の差の関
数である出力信号を前記差動増幅器の出力側に得る信号
処理回路において、 前記第１のPNP型トランジスタのエミッタにエミッタが
接続され、コレクタは接地され、ベースには一定のクラ
ンプ電圧が印加される第３のPNP型トランジスタを有す
ることを特徴とする信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1131744A JPH0731703B2 (ja) | 1989-05-25 | 1989-05-25 | 信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1131744A JPH0731703B2 (ja) | 1989-05-25 | 1989-05-25 | 信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02310684A JPH02310684A (ja) | 1990-12-26 |
| JPH0731703B2 true JPH0731703B2 (ja) | 1995-04-10 |
Family
ID=15065175
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1131744A Expired - Fee Related JPH0731703B2 (ja) | 1989-05-25 | 1989-05-25 | 信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0731703B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6064622U (ja) * | 1983-10-05 | 1985-05-08 | パイオニア株式会社 | スライス回路 |
-
1989
- 1989-05-25 JP JP1131744A patent/JPH0731703B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02310684A (ja) | 1990-12-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080410 Year of fee payment: 13 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090410 Year of fee payment: 14 |
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| LAPS | Cancellation because of no payment of annual fees |