JPH08163510A - 映像信号処理回路 - Google Patents
映像信号処理回路Info
- Publication number
- JPH08163510A JPH08163510A JP29534094A JP29534094A JPH08163510A JP H08163510 A JPH08163510 A JP H08163510A JP 29534094 A JP29534094 A JP 29534094A JP 29534094 A JP29534094 A JP 29534094A JP H08163510 A JPH08163510 A JP H08163510A
- Authority
- JP
- Japan
- Prior art keywords
- video signal
- reduction
- circuit
- pass filter
- low
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Television Systems (AREA)
Abstract
(57)【要約】
【目的】 ラインフリッカを除去しながら、縮小時にお
いて、画像のぼけによる画質の劣化を最小限に抑える。 【構成】 パソコンの映像信号に縮小回路２によって縮
小処理を施し、縮小された映像信号をインタレース表示
されるＮＴＳＣ方式の映像信号に変換する映像信号処理
回路において、縮小回路２の前段にラインフリッカ防止
用の垂直方向のローパスフィルタ１を挿入すると共に、
ローパスフィルタ１のフィルタ係数Ｋを縮小率に応じて
変更する。より具体的には、フィルタ係数Ｋを縮小率の
増加に応じて大きく設定する。
いて、画像のぼけによる画質の劣化を最小限に抑える。 【構成】 パソコンの映像信号に縮小回路２によって縮
小処理を施し、縮小された映像信号をインタレース表示
されるＮＴＳＣ方式の映像信号に変換する映像信号処理
回路において、縮小回路２の前段にラインフリッカ防止
用の垂直方向のローパスフィルタ１を挿入すると共に、
ローパスフィルタ１のフィルタ係数Ｋを縮小率に応じて
変更する。より具体的には、フィルタ係数Ｋを縮小率の
増加に応じて大きく設定する。
Description
【０００１】
【産業上の利用分野】本発明は、入力される第１方式の
映像信号に縮小処理を施し、この縮小処理後の映像信号
を、インターレース表示される第２方式の映像信号に変
換する回路に関する。
映像信号に縮小処理を施し、この縮小処理後の映像信号
を、インターレース表示される第２方式の映像信号に変
換する回路に関する。
【０００２】
【従来の技術】近年、マルチメディア時代を迎え、パソ
コンのビデオ出力や高品位テレビジョン等の映像信号に
縮小処理を施し、この縮小処理後の映像信号を、標準テ
レビジョン方式であるＮＴＳＣ方式の映像信号に変換す
ることが、要求されるようになってきた。
コンのビデオ出力や高品位テレビジョン等の映像信号に
縮小処理を施し、この縮小処理後の映像信号を、標準テ
レビジョン方式であるＮＴＳＣ方式の映像信号に変換す
ることが、要求されるようになってきた。
【０００３】このような回路においては、出力されるＮ
ＴＳＣ方式の映像信号がインタレース表示される信号で
あるため、ラインフリッカが発生し、これによって画質
の劣化が起こる。そこで、従来では、縮小処理回路の前
段に垂直方向のローパスフィルタを設け、このローパス
フィルタによってラインフリッカを除去することが行わ
れていた。
ＴＳＣ方式の映像信号がインタレース表示される信号で
あるため、ラインフリッカが発生し、これによって画質
の劣化が起こる。そこで、従来では、縮小処理回路の前
段に垂直方向のローパスフィルタを設け、このローパス
フィルタによってラインフリッカを除去することが行わ
れていた。
【０００４】
【発明が解決しようとする課題】上記したラインフリッ
カ防止用のローパスフィルタは、垂直方向の解像度を落
とすことになるため、フィルタ係数の選択を誤ると画像
のぼけが生じ、かえって画質の劣化を引き起こす恐れが
ある。しかも、縮小処理を施す場合は、その縮小率によ
ってラインフリッカの影響度が異なるため、例えば、ほ
ぼ１／１に近い縮小率では高画質で表示されても、１／
２程度に縮小率が増加するとぼけによる画質劣化が激し
くなるという問題が発生する。しかしながら、従来の回
路構成においては、ローパスフィルタのフィルタ係数は
固定値に定められていた。
カ防止用のローパスフィルタは、垂直方向の解像度を落
とすことになるため、フィルタ係数の選択を誤ると画像
のぼけが生じ、かえって画質の劣化を引き起こす恐れが
ある。しかも、縮小処理を施す場合は、その縮小率によ
ってラインフリッカの影響度が異なるため、例えば、ほ
ぼ１／１に近い縮小率では高画質で表示されても、１／
２程度に縮小率が増加するとぼけによる画質劣化が激し
くなるという問題が発生する。しかしながら、従来の回
路構成においては、ローパスフィルタのフィルタ係数は
固定値に定められていた。
【０００５】
【課題を解決するための手段】本発明は、第１の方式の
映像信号に縮小回路によって縮小処理を施し、該縮小さ
れた映像信号をインタレース表示される第２の方式の映
像信号に変換する映像信号処理回路において、前記縮小
回路の前段にラインフリッカ防止用の垂直方向のローパ
スフィルタを挿入すると共に、該ローパスフィルタのフ
ィルタ係数を縮小率に応じて変更することにより、上記
課題を解決するものである。
映像信号に縮小回路によって縮小処理を施し、該縮小さ
れた映像信号をインタレース表示される第２の方式の映
像信号に変換する映像信号処理回路において、前記縮小
回路の前段にラインフリッカ防止用の垂直方向のローパ
スフィルタを挿入すると共に、該ローパスフィルタのフ
ィルタ係数を縮小率に応じて変更することにより、上記
課題を解決するものである。
【０００６】そして、本発明は、前記フィルタ係数を、
前記縮小率の増加に応じて大きく設定することを特徴と
する。
前記縮小率の増加に応じて大きく設定することを特徴と
する。
【０００７】
【作用】本発明によれば、縮小率に応じてフィルタ係数
が変化するので、縮小率に応じてフィルタ効果が変化し
て、画像のぼけによる画質の劣化が最小限に抑えられ
る。
が変化するので、縮小率に応じてフィルタ効果が変化し
て、画像のぼけによる画質の劣化が最小限に抑えられ
る。
【０００８】
【実施例】図１は、本発明の実施例の構成を示すブロッ
ク図であり、１はノンインタレース表示されるパソコン
からの映像信号を、図示しないＡＤ変換器を介してデジ
タル信号として入力する垂直方向のローパスフィルタ、
２はローパスフィルタ１から出力される映像信号に縮小
率に応じた縮小処理を施す縮小回路、３はフレームメモ
リ４が接続され、入力されるパソコンの同期信号とＮＴ
ＳＣ方式の同期信号に基づき走査線の変換を行う走査線
変換回路、５は変換された映像信号にウインドウ表示等
の表示制御を行うと共にデジタル映像信号をアナログ映
像信号に変換して出力する表示制御回路、６は各回路の
制御を行う制御回路である。
ク図であり、１はノンインタレース表示されるパソコン
からの映像信号を、図示しないＡＤ変換器を介してデジ
タル信号として入力する垂直方向のローパスフィルタ、
２はローパスフィルタ１から出力される映像信号に縮小
率に応じた縮小処理を施す縮小回路、３はフレームメモ
リ４が接続され、入力されるパソコンの同期信号とＮＴ
ＳＣ方式の同期信号に基づき走査線の変換を行う走査線
変換回路、５は変換された映像信号にウインドウ表示等
の表示制御を行うと共にデジタル映像信号をアナログ映
像信号に変換して出力する表示制御回路、６は各回路の
制御を行う制御回路である。
【０００９】図２は、ローパスフィルタ１の具体回路図
であり、ここでは、ｎ−１，ｎ，ｎ＋１ラインの上下合
わせて３ライン分の信号にそれぞれ重み付けを行うこと
によってフィルタ効果を得るものであって、１水平同期
信号（１Ｈ）分だけ信号を遅延させる２つの遅延素子１
０，１１と、ｎ−１，ｎ，ｎ＋１の各ラインの信号に、
各々、（１−Ｋ）／２，Ｋ，（１−Ｋ）／２の乗数を乗
算する乗算器１２，１３，１４と、３つの乗算器の出力
を加算する加算器１５とより構成されている。
であり、ここでは、ｎ−１，ｎ，ｎ＋１ラインの上下合
わせて３ライン分の信号にそれぞれ重み付けを行うこと
によってフィルタ効果を得るものであって、１水平同期
信号（１Ｈ）分だけ信号を遅延させる２つの遅延素子１
０，１１と、ｎ−１，ｎ，ｎ＋１の各ラインの信号に、
各々、（１−Ｋ）／２，Ｋ，（１−Ｋ）／２の乗数を乗
算する乗算器１２，１３，１４と、３つの乗算器の出力
を加算する加算器１５とより構成されている。
【００１０】従って、係数Ｋが１の場合はフィルタ効果
はなくなり、Ｋが１から徐々に減少するにつれてフィル
タ効果が大きくなる特性を有する。そこで、制御信号に
より制御回路６に縮小率が指定されると、制御回路６は
この指定された縮小率に応じて係数Ｋを決定し、ローパ
スフィルタ１中の乗算器の乗数を係数Ｋに基づき変更す
る。具体的には、縮小率の増加に応じてＫを大きくする
ようにしており、これによって、縮小率が大きくなれば
なるほどフィルタ効果がなくなるようになる。つまり、
Ｋが一定であれば、縮小率が大きくなればなるほど画像
がぼけてしまうが、実施例では、縮小率が大きくなれば
フィルタ効果が薄れるように構成されているために、画
像のぼけがくい止められ、このぼけによる画質の劣化が
防止されることとなる。
はなくなり、Ｋが１から徐々に減少するにつれてフィル
タ効果が大きくなる特性を有する。そこで、制御信号に
より制御回路６に縮小率が指定されると、制御回路６は
この指定された縮小率に応じて係数Ｋを決定し、ローパ
スフィルタ１中の乗算器の乗数を係数Ｋに基づき変更す
る。具体的には、縮小率の増加に応じてＫを大きくする
ようにしており、これによって、縮小率が大きくなれば
なるほどフィルタ効果がなくなるようになる。つまり、
Ｋが一定であれば、縮小率が大きくなればなるほど画像
がぼけてしまうが、実施例では、縮小率が大きくなれば
フィルタ効果が薄れるように構成されているために、画
像のぼけがくい止められ、このぼけによる画質の劣化が
防止されることとなる。
【００１１】このように、ローパスフィルタ１では、画
像のぼけを最小限に抑えるようにラインフリッカ除去の
処理が、入力される映像信号に対して行われ、その後、
縮小回路２によって制御部６から指定された縮小率に応
じた縮小処理が施される。次に、縮小処理された映像信
号は、フレームメモリ４を利用することによって、走査
線変換回路３において同期信号に基づき走査線の変換処
理が行われ、表示制御回路５を介してＮＴＳＣ方式の縮
小された映像信号として出力される。
像のぼけを最小限に抑えるようにラインフリッカ除去の
処理が、入力される映像信号に対して行われ、その後、
縮小回路２によって制御部６から指定された縮小率に応
じた縮小処理が施される。次に、縮小処理された映像信
号は、フレームメモリ４を利用することによって、走査
線変換回路３において同期信号に基づき走査線の変換処
理が行われ、表示制御回路５を介してＮＴＳＣ方式の縮
小された映像信号として出力される。
【００１２】尚、係数Ｋを決定する方法としては、予め
縮小率とＫとの対応関係を登録したテーブルを用意して
おき、ここから読み出すようにしても良いし、あるい
は、簡単な演算回路を用いても良い。ところで、上述し
た実施例は、ノンインタレースのパソコンビデオ出力を
ＮＴＳＣ方式のインタレース映像信号に変換する例を示
したが、これに限定されるものではなく、例えば、高品
位テレビジョンのインタレース映像信号を標準のＮＴＳ
Ｃ方式のインタレース映像信号に変換する場合にも本発
明は適用できるものである。
縮小率とＫとの対応関係を登録したテーブルを用意して
おき、ここから読み出すようにしても良いし、あるい
は、簡単な演算回路を用いても良い。ところで、上述し
た実施例は、ノンインタレースのパソコンビデオ出力を
ＮＴＳＣ方式のインタレース映像信号に変換する例を示
したが、これに限定されるものではなく、例えば、高品
位テレビジョンのインタレース映像信号を標準のＮＴＳ
Ｃ方式のインタレース映像信号に変換する場合にも本発
明は適用できるものである。
【００１３】
【発明の効果】本発明によれば、縮小率に応じてローパ
スフィルタのフィルタ効果が変更されるので、ラインフ
リッカを除去しながら、画像のぼけによる画質の劣化を
最小限に抑えることが可能となる。
スフィルタのフィルタ効果が変更されるので、ラインフ
リッカを除去しながら、画像のぼけによる画質の劣化を
最小限に抑えることが可能となる。
【図１】本発明の実施例の構成を示すブロック図であ
る。
る。
【図２】実施例におけるローパスフィルタの具体構成を
示す回路図である。
示す回路図である。
１ ローパスフィルタ ２ 縮小回路 ３ 走査線変換回路 ４ フレームメモリ ５ 表示制御回路 ６ 制御回路 １０、１１ 遅延素子 １２、１３、１４ 乗算器 １５ 加算器
Claims (2)
- 【請求項１】 第１の方式の映像信号に縮小回路によっ
て縮小処理を施し、該縮小された映像信号をインタレー
ス表示される第２の方式の映像信号に変換する映像信号
処理回路において、前記縮小回路の前段にラインフリッ
カ防止用の垂直方向のローパスフィルタを挿入すると共
に、該ローパスフィルタのフィルタ係数を縮小率に応じ
て変更することを特徴とする映像信号処理回路。 - 【請求項２】 前記フィルタ係数は、前記縮小率の増加
に応じて大きく設定されることを特徴とする請求項１記
載の映像信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29534094A JPH08163510A (ja) | 1994-11-29 | 1994-11-29 | 映像信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29534094A JPH08163510A (ja) | 1994-11-29 | 1994-11-29 | 映像信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08163510A true JPH08163510A (ja) | 1996-06-21 |
Family
ID=17819354
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29534094A Pending JPH08163510A (ja) | 1994-11-29 | 1994-11-29 | 映像信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08163510A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20010032562A (ko) * | 1997-12-31 | 2001-04-25 | 텔레크루즈 테크날러지 인코퍼레이티드 | 네트워크 응용데이터의 텔레비젼 표시에서의 플리커감소방법 및 장치 |
-
1994
- 1994-11-29 JP JP29534094A patent/JPH08163510A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20010032562A (ko) * | 1997-12-31 | 2001-04-25 | 텔레크루즈 테크날러지 인코퍼레이티드 | 네트워크 응용데이터의 텔레비젼 표시에서의 플리커감소방법 및 장치 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20031210 |
|
| A131 | Notification of reasons for refusal |
Effective date: 20031216 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040213 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20040824 |