JPH08172131A - 半導体装置の配線形成方法 - Google Patents
半導体装置の配線形成方法Info
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- JPH08172131A JPH08172131A JP6334242A JP33424294A JPH08172131A JP H08172131 A JPH08172131 A JP H08172131A JP 6334242 A JP6334242 A JP 6334242A JP 33424294 A JP33424294 A JP 33424294A JP H08172131 A JPH08172131 A JP H08172131A
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- H10P14/6302—Non-deposition formation processes
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- H10P14/6314—Formation by oxidation, e.g. oxidation of the substrate of a metallic layer
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】
【目的】物理的気相成長法及びリフロー処理を同一の成
膜装置を用いて行う必要がなく、しかも、リフロー処理
前に金属配線材料の表面処理を行う必要が無い半導体装
置の配線形成方法を提供する。 【構成】半導体装置の配線形成方法は、(イ)基体上に
物理的気相成長法にて金属配線材料から成る金属配線材
料層22を形成し、(ロ)該金属配線材料層22上に酸
化防止膜23を形成し、(ハ)該金属配線材料層22を
リフローさせて、酸化防止膜23を構成する成分を金属
配線材料中に完全に固溶させ、(ニ)該金属配線材料層
22をパターニングする各工程から成る。
膜装置を用いて行う必要がなく、しかも、リフロー処理
前に金属配線材料の表面処理を行う必要が無い半導体装
置の配線形成方法を提供する。 【構成】半導体装置の配線形成方法は、(イ)基体上に
物理的気相成長法にて金属配線材料から成る金属配線材
料層22を形成し、(ロ)該金属配線材料層22上に酸
化防止膜23を形成し、(ハ)該金属配線材料層22を
リフローさせて、酸化防止膜23を構成する成分を金属
配線材料中に完全に固溶させ、(ニ)該金属配線材料層
22をパターニングする各工程から成る。
Description
【0001】
【産業上の利用分野】本発明は、物理的気相成長法(P
VD法)及び所謂高温リフロー法に基づいた半導体装置
の配線形成方法に関する。
VD法)及び所謂高温リフロー法に基づいた半導体装置
の配線形成方法に関する。
【0002】
【従来の技術】半導体デバイスの高集積化に伴い、寸法
ルールが微細化している。そして、半導体デバイスの配
線形成プロセスにおいては、狭くて深い(アスペクト比
の高い)コンタクトホール、ビアホール、スルーホール
(以下、総称して接続孔と呼ぶ)を安定に形成する技術
が極めて重要となっている。接続孔は、例えば導体層の
上方に形成された絶縁層に開口部を設け、かかる開口部
内に金属配線材料を埋め込むことによって形成される。
アルミニウム系合金から成る金属配線材料をスパッタ法
にて開口部内を含む絶縁層上に成膜する場合、アルミニ
ウム系合金のスパッタ粒子が開口部の側壁の影になる部
分には多く入射しない、所謂シャドウイング効果が生じ
る。その結果、開口部内でのアルミニウム系合金のカバ
レッジが悪くなり、アルミニウム系合金の堆積が少ない
開口部底部の近傍において断線不良が発生し易いという
問題が生じている。そのため、開口部内を金属配線材料
で確実に埋め込むプロセス技術が要求されている。
ルールが微細化している。そして、半導体デバイスの配
線形成プロセスにおいては、狭くて深い(アスペクト比
の高い)コンタクトホール、ビアホール、スルーホール
(以下、総称して接続孔と呼ぶ)を安定に形成する技術
が極めて重要となっている。接続孔は、例えば導体層の
上方に形成された絶縁層に開口部を設け、かかる開口部
内に金属配線材料を埋め込むことによって形成される。
アルミニウム系合金から成る金属配線材料をスパッタ法
にて開口部内を含む絶縁層上に成膜する場合、アルミニ
ウム系合金のスパッタ粒子が開口部の側壁の影になる部
分には多く入射しない、所謂シャドウイング効果が生じ
る。その結果、開口部内でのアルミニウム系合金のカバ
レッジが悪くなり、アルミニウム系合金の堆積が少ない
開口部底部の近傍において断線不良が発生し易いという
問題が生じている。そのため、開口部内を金属配線材料
で確実に埋め込むプロセス技術が要求されている。
【0003】このようなプロセス技術の1つに、スパッ
タ法にてアルミニウム系合金を絶縁層上に成膜した後、
熱処理を施すことによって、開口部内にアルミニウム系
合金を流し込む、高温アルミニウムリフロー法がある。
高温アルミニウムリフロー法による開口部の埋め込みに
おいては、アルミニウム系合金を再結晶温度以上(アル
ミニウム系合金の組成によって異なるが、通常350゜
C程度以上)、融点以下で加熱する。これによって、絶
縁層上に成膜されたアルミニウム系合金は流動化状態と
なり、開口部内に流れ込み、開口部はアルミニウム系合
金で埋め込まれる。アルミニウム系合金の表面が酸化さ
れないよう、アルミニウム系合金を大気に曝すことな
く、同一成膜装置内でアルミニウム系合金の成膜及びリ
フロー処理を行った方が、開口部内へのアルミニウム系
合金の流れ込みが良好となる。
タ法にてアルミニウム系合金を絶縁層上に成膜した後、
熱処理を施すことによって、開口部内にアルミニウム系
合金を流し込む、高温アルミニウムリフロー法がある。
高温アルミニウムリフロー法による開口部の埋め込みに
おいては、アルミニウム系合金を再結晶温度以上(アル
ミニウム系合金の組成によって異なるが、通常350゜
C程度以上)、融点以下で加熱する。これによって、絶
縁層上に成膜されたアルミニウム系合金は流動化状態と
なり、開口部内に流れ込み、開口部はアルミニウム系合
金で埋め込まれる。アルミニウム系合金の表面が酸化さ
れないよう、アルミニウム系合金を大気に曝すことな
く、同一成膜装置内でアルミニウム系合金の成膜及びリ
フロー処理を行った方が、開口部内へのアルミニウム系
合金の流れ込みが良好となる。
【0004】また、高温アルミニウムリフロー法におい
て、開口部内へのアルミニウム系合金の埋め込み性の改
善及びリフロー温度の低下を目的として、リフロー処理
時に不活性ガス中で高圧を加える場合がある。以下、こ
のような方法を高圧リフロー法と呼ぶ。この場合にも、
アルミニウム系合金を大気に曝すことなく、同一成膜装
置内でアルミニウム系合金の成膜及びリフロー処理を行
った方が、開口部内へのアルミニウム系合金の流れ込み
が良好となる。
て、開口部内へのアルミニウム系合金の埋め込み性の改
善及びリフロー温度の低下を目的として、リフロー処理
時に不活性ガス中で高圧を加える場合がある。以下、こ
のような方法を高圧リフロー法と呼ぶ。この場合にも、
アルミニウム系合金を大気に曝すことなく、同一成膜装
置内でアルミニウム系合金の成膜及びリフロー処理を行
った方が、開口部内へのアルミニウム系合金の流れ込み
が良好となる。
【0005】アルミニウム系合金を大気に曝すことな
く、同一成膜装置内でアルミニウム系合金の成膜及びリ
フロー処理を行った場合の半導体基板等の模式的な一部
断面図を図6の(A)及び(B)に示す。また、アルミ
ニウム系合金を成膜した後、アルミニウム系合金を大気
に曝し、その後リフロー処理した場合の半導体基板等の
模式的な一部断面図を図7に示す。尚、図中、参照番号
130は半導体基板、131は素子分離領域、133は
ゲート電極、135はソース・ドレイン領域、140は
半導体基板130上に形成された絶縁層、136は絶縁
層140に形成された開口部、141は所謂密着層、1
42はアルミニウム系合金層である。図6の(A)は、
アルミニウム系合金層142を絶縁層140上に成膜し
た後の模式的な一部断面図である。また、図6の(B)
及び図7は、リフロー処理後の模式的な一部断面図であ
る。
く、同一成膜装置内でアルミニウム系合金の成膜及びリ
フロー処理を行った場合の半導体基板等の模式的な一部
断面図を図6の(A)及び(B)に示す。また、アルミ
ニウム系合金を成膜した後、アルミニウム系合金を大気
に曝し、その後リフロー処理した場合の半導体基板等の
模式的な一部断面図を図7に示す。尚、図中、参照番号
130は半導体基板、131は素子分離領域、133は
ゲート電極、135はソース・ドレイン領域、140は
半導体基板130上に形成された絶縁層、136は絶縁
層140に形成された開口部、141は所謂密着層、1
42はアルミニウム系合金層である。図6の(A)は、
アルミニウム系合金層142を絶縁層140上に成膜し
た後の模式的な一部断面図である。また、図6の(B)
及び図7は、リフロー処理後の模式的な一部断面図であ
る。
【0006】
【発明が解決しようとする課題】図7に示すように、ア
ルミニウム系合金を成膜した後、アルミニウム系合金を
大気に曝し、その後リフロー処理を行うと、開口部13
6内にアルミニウム系合金が十分流れ込まず、開口部1
36の底部にボイドが発生し易い。それ故、同一成膜装
置を用いてアルミニウム系合金の成膜及びリフロー処理
を行う必要がある。しかしながら、このような同一成膜
装置内での処理を行うためには、成膜チャンバーとリフ
ロー(又は高圧リフロー)処理チャンバーをクラスター
装置化しなければならない。このような成膜装置は高価
であり、半導体装置の製造コストの上昇に繋がる。
ルミニウム系合金を成膜した後、アルミニウム系合金を
大気に曝し、その後リフロー処理を行うと、開口部13
6内にアルミニウム系合金が十分流れ込まず、開口部1
36の底部にボイドが発生し易い。それ故、同一成膜装
置を用いてアルミニウム系合金の成膜及びリフロー処理
を行う必要がある。しかしながら、このような同一成膜
装置内での処理を行うためには、成膜チャンバーとリフ
ロー(又は高圧リフロー)処理チャンバーをクラスター
装置化しなければならない。このような成膜装置は高価
であり、半導体装置の製造コストの上昇に繋がる。
【0007】また、アルミニウム系合金の成膜後、別の
装置でリフロー処理を行う場合には、リフロー処理の直
前にアルミニウム系合金層142の表面に生成した酸化
膜をスパッタエッチング等によって除去するクリーニン
グ工程が必要となる。しかしながら、同一装置内でクリ
ーニング工程とリフロー処理を行う場合、装置が高価に
なり、結果として半導体装置の製造コストの上昇を招
く。
装置でリフロー処理を行う場合には、リフロー処理の直
前にアルミニウム系合金層142の表面に生成した酸化
膜をスパッタエッチング等によって除去するクリーニン
グ工程が必要となる。しかしながら、同一装置内でクリ
ーニング工程とリフロー処理を行う場合、装置が高価に
なり、結果として半導体装置の製造コストの上昇を招
く。
【0008】従って、本発明の目的は、例えばアルミニ
ウム系合金等の金属配線材料を物理的気相成長法にて成
膜し、その後、リフロー処理を行う場合、同一の成膜装
置を用いる必要がなく、しかも、リフロー処理前に金属
配線材料の表面処理を行う必要が無い半導体装置の配線
形成方法を提供することにある。
ウム系合金等の金属配線材料を物理的気相成長法にて成
膜し、その後、リフロー処理を行う場合、同一の成膜装
置を用いる必要がなく、しかも、リフロー処理前に金属
配線材料の表面処理を行う必要が無い半導体装置の配線
形成方法を提供することにある。
【0009】
【課題を解決するための手段】上記の目的を達成するた
めの本発明の第1の態様に係る半導体装置の配線形成方
法は、(イ)基体上に物理的気相成長法にて金属配線材
料から成る金属配線材料層を形成する工程と、(ロ)該
金属配線材料層上に酸化防止膜を形成する工程と、
(ハ)該金属配線材料層をリフローさせて、酸化防止膜
を構成する成分を金属配線材料中に完全に固溶させる工
程と、(ニ)該金属配線材料層をパターニングして配線
を形成する工程、から成ることを特徴とする。
めの本発明の第1の態様に係る半導体装置の配線形成方
法は、(イ)基体上に物理的気相成長法にて金属配線材
料から成る金属配線材料層を形成する工程と、(ロ)該
金属配線材料層上に酸化防止膜を形成する工程と、
(ハ)該金属配線材料層をリフローさせて、酸化防止膜
を構成する成分を金属配線材料中に完全に固溶させる工
程と、(ニ)該金属配線材料層をパターニングして配線
を形成する工程、から成ることを特徴とする。
【0010】本発明の第1の態様に係る半導体装置の配
線形成方法においては、前記工程(ロ)と工程(ハ)の
間に、半導体装置を大気に曝露する工程を含むことがで
きる。
線形成方法においては、前記工程(ロ)と工程(ハ)の
間に、半導体装置を大気に曝露する工程を含むことがで
きる。
【0011】本発明の第1の態様に係る半導体装置の配
線形成方法における基体としては、例えば半導体基板の
上に形成された絶縁層を挙げることができる。この絶縁
層には、配線と電気的に接続されるコンタクトホールや
ビヤホール、スルーホールといった接続孔が形成されて
いてもよい。
線形成方法における基体としては、例えば半導体基板の
上に形成された絶縁層を挙げることができる。この絶縁
層には、配線と電気的に接続されるコンタクトホールや
ビヤホール、スルーホールといった接続孔が形成されて
いてもよい。
【0012】上記の目的を達成するための本発明の第2
の態様に係る半導体装置の配線形成方法は、金属配線材
料層から成る配線、及び該金属配線材料層を構成する金
属配線材料が埋め込まれた接続孔を形成する配線形成方
法である。そして、(イ)導体層が設けられた基体上に
絶縁層を形成し、該導体層の上方の絶縁層に開口部を形
成する工程と、(ロ)絶縁層上に、金属配線材料から成
る金属配線材料層を物理的気相成長法にて形成する工程
と、(ハ)該金属配線材料層上に酸化防止膜を形成する
工程と、(ニ)該金属配線材料層をリフローさせて、酸
化防止膜を構成する成分を金属配線材料中に完全に固溶
させ、且つ、該金属配線材料で開口部を埋め込み、接続
孔を形成する工程と、(ホ)該金属配線材料層をパター
ニングして配線を形成する工程、から成ることを特徴と
する。
の態様に係る半導体装置の配線形成方法は、金属配線材
料層から成る配線、及び該金属配線材料層を構成する金
属配線材料が埋め込まれた接続孔を形成する配線形成方
法である。そして、(イ)導体層が設けられた基体上に
絶縁層を形成し、該導体層の上方の絶縁層に開口部を形
成する工程と、(ロ)絶縁層上に、金属配線材料から成
る金属配線材料層を物理的気相成長法にて形成する工程
と、(ハ)該金属配線材料層上に酸化防止膜を形成する
工程と、(ニ)該金属配線材料層をリフローさせて、酸
化防止膜を構成する成分を金属配線材料中に完全に固溶
させ、且つ、該金属配線材料で開口部を埋め込み、接続
孔を形成する工程と、(ホ)該金属配線材料層をパター
ニングして配線を形成する工程、から成ることを特徴と
する。
【0013】導体層としては、基体に相当する半導体基
板に形成されたソース・ドレイン領域、あるいは半導体
基板の上に形成された基体に相当する絶縁層上に設けら
れた配線層を挙げることができる。
板に形成されたソース・ドレイン領域、あるいは半導体
基板の上に形成された基体に相当する絶縁層上に設けら
れた配線層を挙げることができる。
【0014】本発明の第2の態様に係る半導体装置の配
線形成方法においては、物理的気相成長法にて金属配線
材料層を形成した後において、開口部の底部にはボイド
が残り、且つ、開口部の上方は金属配線材料層によって
塞がれており、前記工程(ニ)において、高圧下、金属
配線材料層をリフローさせる態様を含めることができ
る。
線形成方法においては、物理的気相成長法にて金属配線
材料層を形成した後において、開口部の底部にはボイド
が残り、且つ、開口部の上方は金属配線材料層によって
塞がれており、前記工程(ニ)において、高圧下、金属
配線材料層をリフローさせる態様を含めることができ
る。
【0015】更に、本発明の第2の態様に係る半導体装
置の配線形成方法においては、前記工程(ハ)と工程
(ニ)の間に、半導体装置を大気に曝露する工程を含む
ことができる。
置の配線形成方法においては、前記工程(ハ)と工程
(ニ)の間に、半導体装置を大気に曝露する工程を含む
ことができる。
【0016】本発明の第1あるいは第2の態様に係る半
導体装置の配線形成方法においては、酸化防止膜は、室
温で強固な酸化膜を形成し難い材料から成り、酸化防止
膜の膜厚は、金属配線材料層をリフローさせたとき酸化
防止膜を構成する成分が金属配線材料中に完全に固溶す
る限界量以下の量に相当する膜厚とすることが望まし
い。ここで、室温で強固な酸化膜を形成し難い材料と
は、金属配線材料層をリフローさせたときに、酸化防止
膜を構成する成分が金属配線材料中に完全に固溶し、し
かも、金属配線材料層上に酸化防止膜あるいは酸化防止
膜の酸化膜が残るような材料であってはならないことを
意味する。
導体装置の配線形成方法においては、酸化防止膜は、室
温で強固な酸化膜を形成し難い材料から成り、酸化防止
膜の膜厚は、金属配線材料層をリフローさせたとき酸化
防止膜を構成する成分が金属配線材料中に完全に固溶す
る限界量以下の量に相当する膜厚とすることが望まし
い。ここで、室温で強固な酸化膜を形成し難い材料と
は、金属配線材料層をリフローさせたときに、酸化防止
膜を構成する成分が金属配線材料中に完全に固溶し、し
かも、金属配線材料層上に酸化防止膜あるいは酸化防止
膜の酸化膜が残るような材料であってはならないことを
意味する。
【0017】酸化防止膜は、金属配線材料層をリフロー
するときの金属配線材料層の温度であるリフロー温度に
おいて金属配線材料中に完全に固溶し、酸化され難い材
料から構成する必要があり、Ag、Cu、Si及びGe
から成る群から選択された少なくとも1種類の材料から
成ることが好ましい。金属配線材料としては、純アルミ
ニウム、Al−Cu、Al−Si、Al−Si、Al−
Si−Cu、Al−Ge、Al−Si−Ge等の種々の
アルミニウム合金、あるいは銅を挙げることができる。
するときの金属配線材料層の温度であるリフロー温度に
おいて金属配線材料中に完全に固溶し、酸化され難い材
料から構成する必要があり、Ag、Cu、Si及びGe
から成る群から選択された少なくとも1種類の材料から
成ることが好ましい。金属配線材料としては、純アルミ
ニウム、Al−Cu、Al−Si、Al−Si、Al−
Si−Cu、Al−Ge、Al−Si−Ge等の種々の
アルミニウム合金、あるいは銅を挙げることができる。
【0018】本発明においては、金属配線材料層をリフ
ローさせて、酸化防止膜を構成する成分を金属配線材料
中に完全に固溶させる。即ち、例えば、金属配線材料を
溶媒(原子)、酸化防止膜を構成する成分を媒質(原
子)とする一次固溶体を形成する。リフロー温度は、金
属配線材料の組成及び酸化防止膜の組成に依存するが、
酸化防止膜を構成する成分が金属配線材料中に完全に固
溶する温度以上(一次固溶体を形成する温度以上)、金
属配線材料を構成する成分と酸化防止膜を構成する成分
の系における共晶温度以下(例えば金属配線材料がアル
ミニウム系合金から成る場合、部分的に溶融する共晶温
度577゜C以下)とする。
ローさせて、酸化防止膜を構成する成分を金属配線材料
中に完全に固溶させる。即ち、例えば、金属配線材料を
溶媒(原子)、酸化防止膜を構成する成分を媒質(原
子)とする一次固溶体を形成する。リフロー温度は、金
属配線材料の組成及び酸化防止膜の組成に依存するが、
酸化防止膜を構成する成分が金属配線材料中に完全に固
溶する温度以上(一次固溶体を形成する温度以上)、金
属配線材料を構成する成分と酸化防止膜を構成する成分
の系における共晶温度以下(例えば金属配線材料がアル
ミニウム系合金から成る場合、部分的に溶融する共晶温
度577゜C以下)とする。
【0019】物理的気相成長法として、真空蒸着法、あ
るいは、マグネトロンスパッタ法、DCスパッタ法、R
Fスパッタ法、ECRスパッタ法、基体にバイアスを印
加するバイアススパッタ法、あるいはこれらの組み合わ
せ等の各種スパッタ法を挙げることができる。
るいは、マグネトロンスパッタ法、DCスパッタ法、R
Fスパッタ法、ECRスパッタ法、基体にバイアスを印
加するバイアススパッタ法、あるいはこれらの組み合わ
せ等の各種スパッタ法を挙げることができる。
【0020】
【作用】本発明においては、金属配線材料層のリフロー
処理時、酸化防止膜を構成する成分を金属配線材料中に
完全に固溶させる。金属配線材料層のリフロー処理後、
酸化防止膜は金属配線材料層の表面に残存しない。従っ
て、酸化防止膜が、後の半導体装置の製造工程、あるい
は最終的に作製される半導体装置に何等悪影響を及ぼす
ことはない。しかも、リフロー処理前に金属配線材料層
の表面に酸化防止膜が形成されているので、半導体装置
を大気に曝露しても金属配線材料層の表面が酸化される
ことを防止し得る。それ故、成膜チャンバーとリフロー
(又は高圧リフロー)処理チャンバーとがクラスター装
置化された成膜装置を用いる必要がなく、また、リフロ
ー処理前に金属配線材料層の表面に生成した酸化膜を除
去する必要もない。
処理時、酸化防止膜を構成する成分を金属配線材料中に
完全に固溶させる。金属配線材料層のリフロー処理後、
酸化防止膜は金属配線材料層の表面に残存しない。従っ
て、酸化防止膜が、後の半導体装置の製造工程、あるい
は最終的に作製される半導体装置に何等悪影響を及ぼす
ことはない。しかも、リフロー処理前に金属配線材料層
の表面に酸化防止膜が形成されているので、半導体装置
を大気に曝露しても金属配線材料層の表面が酸化される
ことを防止し得る。それ故、成膜チャンバーとリフロー
(又は高圧リフロー)処理チャンバーとがクラスター装
置化された成膜装置を用いる必要がなく、また、リフロ
ー処理前に金属配線材料層の表面に生成した酸化膜を除
去する必要もない。
【0021】もしも、図8に示すように、開口部の底部
にボイドが残らず、開口部の上方が金属配線材料層で塞
がれていない状態になると、開口部内の金属配線材料層
の表面に酸化防止膜を形成することが困難となる。然る
に、本発明の第2の態様に係る半導体装置の配線形成方
法において、物理的気相成長法にて金属配線材料層を形
成した後において、開口部の底部にはボイドが残り、且
つ、開口部の上方は金属配線材料層によって塞がれるよ
うに、金属配線材料層を成膜すれば、金属配線材料層の
表面に確実に酸化防止膜を形成することができる。尚、
このような状態に金属配線材料層を成膜した場合、常圧
のリフロー処理では、開口部の底部に形成されたボイド
を金属配線材料で埋め込むことが困難となる場合があ
る。このような場合には、高圧下、金属配線材料層をリ
フローさせて、開口部の底部に形成されたボイドを金属
配線材料で確実に埋め込めばよい。
にボイドが残らず、開口部の上方が金属配線材料層で塞
がれていない状態になると、開口部内の金属配線材料層
の表面に酸化防止膜を形成することが困難となる。然る
に、本発明の第2の態様に係る半導体装置の配線形成方
法において、物理的気相成長法にて金属配線材料層を形
成した後において、開口部の底部にはボイドが残り、且
つ、開口部の上方は金属配線材料層によって塞がれるよ
うに、金属配線材料層を成膜すれば、金属配線材料層の
表面に確実に酸化防止膜を形成することができる。尚、
このような状態に金属配線材料層を成膜した場合、常圧
のリフロー処理では、開口部の底部に形成されたボイド
を金属配線材料で埋め込むことが困難となる場合があ
る。このような場合には、高圧下、金属配線材料層をリ
フローさせて、開口部の底部に形成されたボイドを金属
配線材料で確実に埋め込めばよい。
【0022】
【実施例】以下、図面を参照して、実施例に基づき本発
明を説明する。
明を説明する。
【0023】(実施例1)実施例1は、本発明の第1の
態様に係る半導体装置の配線形成方法に関する。実施例
1においては、物理的気相成長法はDCスパッタ法であ
る。金属配線材料は、Al−0.5%Cuから成り、酸
化防止膜はアモルファスシリコンから成る。実施例1に
おいては、基体は、半導体基板10の上に形成された絶
縁層20から成る。以下、図1及び図2を参照して、実
施例1の半導体装置の配線形成方法を説明する。
態様に係る半導体装置の配線形成方法に関する。実施例
1においては、物理的気相成長法はDCスパッタ法であ
る。金属配線材料は、Al−0.5%Cuから成り、酸
化防止膜はアモルファスシリコンから成る。実施例1に
おいては、基体は、半導体基板10の上に形成された絶
縁層20から成る。以下、図1及び図2を参照して、実
施例1の半導体装置の配線形成方法を説明する。
【0024】半導体基板10には、LOCOS構造若し
くはトレンチ構造を有する素子分離領域11、SiO2
から成るゲート酸化膜12、ポリシリコン、ポリサイド
あるいはシリサイドから成るゲート電極13、ゲート電
極の側壁に形成されそしてSiO2から成るゲートサイ
ドウオール14、ソース・ドレイン領域15が、公知の
方法で予め形成されている。また、絶縁層20は、例え
ばSiO2から成り、CVD法にて形成することができ
る。絶縁層20(基体20と呼ぶ場合がある)の形成
後、ソース・ドレイン領域15の上方の絶縁層20に、
フォトリソグラフィ技術及びエッチング技術を用いて開
口部16を設ける。
くはトレンチ構造を有する素子分離領域11、SiO2
から成るゲート酸化膜12、ポリシリコン、ポリサイド
あるいはシリサイドから成るゲート電極13、ゲート電
極の側壁に形成されそしてSiO2から成るゲートサイ
ドウオール14、ソース・ドレイン領域15が、公知の
方法で予め形成されている。また、絶縁層20は、例え
ばSiO2から成り、CVD法にて形成することができ
る。絶縁層20(基体20と呼ぶ場合がある)の形成
後、ソース・ドレイン領域15の上方の絶縁層20に、
フォトリソグラフィ技術及びエッチング技術を用いて開
口部16を設ける。
【0025】そして、かかる開口部16にメタルプラグ
18を埋め込み接続孔19を形成する。接続孔19の形
成においては、先ず、開口部16内を含む絶縁層20上
にTi層及びTiN層を、順次例えばスパッタ法で形成
する。Ti層は、ソース・ドレイン領域15とメタルプ
ラグとの間のコンタクト抵抗の低減を目的として形成さ
れる。一方、TiN層は、メタルプラグを構成する金属
配線材料で開口部16内を埋め込む際、金属配線材料に
よってソース・ドレイン領域15が損傷を受けることを
防止するバリア層としての機能を有する。Ti層及びT
iN層の成膜条件は、後述する条件と同様とすればよ
い。尚、TiN層の成膜後、TiN層のバリア性を向上
させるために、窒素ガス雰囲気中若しくは窒素ガスと酸
素ガスの混合ガス雰囲気中で650゜C×60秒程度の
RTA(Rapid Thermal Annealing)処理を行うことが
好ましい。このような工程で形成されたTi層及びTi
N層を纏めて、以下バリアメタル層17と呼ぶ。その
後、所謂ブランケットタングステンCVD法で開口部1
6にタングステンから成る金属配線材料を埋め込み、接
続孔19を形成する。即ち、開口部16内を含む絶縁層
20上にCVD法にてタングステンから成る金属配線材
料を堆積させた後、タングステンから成る金属配線材料
及びバリアメタル層17をエッチバックして、絶縁層2
0上の金属配線材料及びバリアメタル層を除去し、開口
部16内にタングステンから成るメタルプラグ18及び
バリアメタル層17を残す。こうして、接続孔19が形
成される(図1の(A)参照)。尚、エッチバックの関
係で、通常、接続孔19の頂面は絶縁層20の表面より
下に位置する。ブランケットタングステンCVD法の条
件、及びエッチバックの条件を以下に例示する。 ブランケットタングステンCVD条件 使用ガス :WF6/H2/Ar=80/500/28
00sccm 圧力 :1.1×105Pa 成膜温度 :450゜C エッチバック条件 使用ガス :SF6/Ar=110/90sccm 圧力 :35Pa RFパワー :275kW
18を埋め込み接続孔19を形成する。接続孔19の形
成においては、先ず、開口部16内を含む絶縁層20上
にTi層及びTiN層を、順次例えばスパッタ法で形成
する。Ti層は、ソース・ドレイン領域15とメタルプ
ラグとの間のコンタクト抵抗の低減を目的として形成さ
れる。一方、TiN層は、メタルプラグを構成する金属
配線材料で開口部16内を埋め込む際、金属配線材料に
よってソース・ドレイン領域15が損傷を受けることを
防止するバリア層としての機能を有する。Ti層及びT
iN層の成膜条件は、後述する条件と同様とすればよ
い。尚、TiN層の成膜後、TiN層のバリア性を向上
させるために、窒素ガス雰囲気中若しくは窒素ガスと酸
素ガスの混合ガス雰囲気中で650゜C×60秒程度の
RTA(Rapid Thermal Annealing)処理を行うことが
好ましい。このような工程で形成されたTi層及びTi
N層を纏めて、以下バリアメタル層17と呼ぶ。その
後、所謂ブランケットタングステンCVD法で開口部1
6にタングステンから成る金属配線材料を埋め込み、接
続孔19を形成する。即ち、開口部16内を含む絶縁層
20上にCVD法にてタングステンから成る金属配線材
料を堆積させた後、タングステンから成る金属配線材料
及びバリアメタル層17をエッチバックして、絶縁層2
0上の金属配線材料及びバリアメタル層を除去し、開口
部16内にタングステンから成るメタルプラグ18及び
バリアメタル層17を残す。こうして、接続孔19が形
成される(図1の(A)参照)。尚、エッチバックの関
係で、通常、接続孔19の頂面は絶縁層20の表面より
下に位置する。ブランケットタングステンCVD法の条
件、及びエッチバックの条件を以下に例示する。 ブランケットタングステンCVD条件 使用ガス :WF6/H2/Ar=80/500/28
00sccm 圧力 :1.1×105Pa 成膜温度 :450゜C エッチバック条件 使用ガス :SF6/Ar=110/90sccm 圧力 :35Pa RFパワー :275kW
【0026】尚、このような構成は本発明の第1の態様
に係る半導体装置の配線形成方法にとって必須の構成で
はない。絶縁層20に接続孔19が形成されていない場
合もあるし、あるいは又、接続孔19の底部に下層配線
が形成されている場合もある。かかる下層配線は、下層
絶縁層の上に形成されていてもよいし、場合によっては
下層絶縁層に埋め込まれていてもよい。
に係る半導体装置の配線形成方法にとって必須の構成で
はない。絶縁層20に接続孔19が形成されていない場
合もあるし、あるいは又、接続孔19の底部に下層配線
が形成されている場合もある。かかる下層配線は、下層
絶縁層の上に形成されていてもよいし、場合によっては
下層絶縁層に埋め込まれていてもよい。
【0027】以下、本発明の第1の態様に係る半導体装
置の配線形成方法を説明する。
置の配線形成方法を説明する。
【0028】[工程−100]先ず、絶縁層から成る基
体20上に、物理的気相成長法(具体的にはDCスパッ
タ法)にて金属配線材料から成る金属配線材料層22を
形成する。Al−0.5%Cuから成る金属配線材料の
基体20に対する濡れ性及び密着性を向上させるため
に、更には、金属配線材料層がエレクトロマイグレーシ
ョンやストレスマイグレーション等によって断線した場
合でも配線全体が断線しないように配線に冗長効果を持
たせるために、予め、基体20の表面にTiから成る下
地層21をスパッタ法で形成することが望ましい。次い
で、DCスパッタ法にてAl−0.5%Cuから成る金
属配線材料層22を下地層21の上に形成する(図1の
(B)参照)。下地層21及び金属配線材料層22の成
膜条件を以下に例示する。 下地層21の成膜条件 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 金属配線材料層22の成膜条件 ターゲット :Al−0.5%Cu プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :10kW 成膜温度 :150゜C 膜厚 :0.5μm
体20上に、物理的気相成長法(具体的にはDCスパッ
タ法)にて金属配線材料から成る金属配線材料層22を
形成する。Al−0.5%Cuから成る金属配線材料の
基体20に対する濡れ性及び密着性を向上させるため
に、更には、金属配線材料層がエレクトロマイグレーシ
ョンやストレスマイグレーション等によって断線した場
合でも配線全体が断線しないように配線に冗長効果を持
たせるために、予め、基体20の表面にTiから成る下
地層21をスパッタ法で形成することが望ましい。次い
で、DCスパッタ法にてAl−0.5%Cuから成る金
属配線材料層22を下地層21の上に形成する(図1の
(B)参照)。下地層21及び金属配線材料層22の成
膜条件を以下に例示する。 下地層21の成膜条件 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 金属配線材料層22の成膜条件 ターゲット :Al−0.5%Cu プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :10kW 成膜温度 :150゜C 膜厚 :0.5μm
【0029】[工程−110]次に、同一DCスパッタ
装置内で、金属配線材料層22を大気に曝すことなく、
金属配線材料層22の上に酸化防止膜23を形成する
(図2の(A)参照)。実施例1においては、酸化防止
膜23はアモルファスシリコンから成る。尚、この場
合、アモルファスシリコンの厚さは、その後の金属配線
材料層22のリフロー処理時のリフロー温度で酸化防止
膜23を構成する成分が金属配線材料中に完全に固溶す
る限界量以下の量とすることが望ましい。例えばリフロ
ー温度を450゜Cとした場合、酸化防止膜23の厚さ
は、Al−0.5%Cuから成る金属配線材料層22の
厚さ(例えば0.5μm)の約0.5%(例えば2.5
nm)以下であることが望ましい。ここで、約0.5%
の値が、金属配線材料層22をリフローさせたとき酸化
防止膜23を構成する成分が金属配線材料中に完全に固
溶する限界量である。このような膜厚の酸化防止膜23
であっても、金属配線材料層22の表面が酸化されるこ
とを効果的に防止することができる。RFスパッタ法に
よる酸化防止膜23の成膜条件を以下に例示する。尚、
酸化防止膜23の厚さを2nmとした。 プロセスガス:Ar=100sccm 圧力 :0.4Pa RFパワー :3kW 成膜温度 :150゜C 膜厚 :2nm
装置内で、金属配線材料層22を大気に曝すことなく、
金属配線材料層22の上に酸化防止膜23を形成する
(図2の(A)参照)。実施例1においては、酸化防止
膜23はアモルファスシリコンから成る。尚、この場
合、アモルファスシリコンの厚さは、その後の金属配線
材料層22のリフロー処理時のリフロー温度で酸化防止
膜23を構成する成分が金属配線材料中に完全に固溶す
る限界量以下の量とすることが望ましい。例えばリフロ
ー温度を450゜Cとした場合、酸化防止膜23の厚さ
は、Al−0.5%Cuから成る金属配線材料層22の
厚さ(例えば0.5μm)の約0.5%(例えば2.5
nm)以下であることが望ましい。ここで、約0.5%
の値が、金属配線材料層22をリフローさせたとき酸化
防止膜23を構成する成分が金属配線材料中に完全に固
溶する限界量である。このような膜厚の酸化防止膜23
であっても、金属配線材料層22の表面が酸化されるこ
とを効果的に防止することができる。RFスパッタ法に
よる酸化防止膜23の成膜条件を以下に例示する。尚、
酸化防止膜23の厚さを2nmとした。 プロセスガス:Ar=100sccm 圧力 :0.4Pa RFパワー :3kW 成膜温度 :150゜C 膜厚 :2nm
【0030】[工程−120]その後、スパッタ装置か
ら半導体基板を取り出して、半導体装置(実際には、半
導体装置の中間物である)を大気中に曝し(曝露し)、
別のリフロー処理専用装置(例えば炉)で金属配線材料
層22をリフローさせて、酸化防止膜23を構成する成
分を金属配線材料中に完全に固溶させる(図2の(B)
参照)。即ち、Alを溶媒原子、Siを溶質原子とする
一次固溶体を形成する。尚、酸化防止膜23を構成する
成分が金属配線材料中に完全に固溶した後の金属配線材
料層を参照番号22Aで表した。この場合、リフロー処
理前に、予め、スパッタエッチング等によって金属配線
材料層22の表面をクリーニングする必要は無い。リフ
ロー処理の条件を以下に例示する。 リフロー温度 :450゜C リフロー時間 :2分 リフロー雰囲気:アルゴンガス 雰囲気の圧力 :大気圧あるいはそれ以下
ら半導体基板を取り出して、半導体装置(実際には、半
導体装置の中間物である)を大気中に曝し(曝露し)、
別のリフロー処理専用装置(例えば炉)で金属配線材料
層22をリフローさせて、酸化防止膜23を構成する成
分を金属配線材料中に完全に固溶させる(図2の(B)
参照)。即ち、Alを溶媒原子、Siを溶質原子とする
一次固溶体を形成する。尚、酸化防止膜23を構成する
成分が金属配線材料中に完全に固溶した後の金属配線材
料層を参照番号22Aで表した。この場合、リフロー処
理前に、予め、スパッタエッチング等によって金属配線
材料層22の表面をクリーニングする必要は無い。リフ
ロー処理の条件を以下に例示する。 リフロー温度 :450゜C リフロー時間 :2分 リフロー雰囲気:アルゴンガス 雰囲気の圧力 :大気圧あるいはそれ以下
【0031】尚、リフロー処理の方式として基板裏面ガ
ス加熱方式を採用することもできる。基板裏面ガス加熱
方式とは、半導体基板の裏面に配置したヒーターブロッ
クを所定の温度(加熱温度)に加熱し、ヒーターブロッ
クと半導体基板の裏面の間にアルゴンから成るプロセス
ガスを導入することによって基体を加熱する方式であ
る。加熱方式としては、この方式以外にもランプ加熱方
式等を用いることができる。
ス加熱方式を採用することもできる。基板裏面ガス加熱
方式とは、半導体基板の裏面に配置したヒーターブロッ
クを所定の温度(加熱温度)に加熱し、ヒーターブロッ
クと半導体基板の裏面の間にアルゴンから成るプロセス
ガスを導入することによって基体を加熱する方式であ
る。加熱方式としては、この方式以外にもランプ加熱方
式等を用いることができる。
【0032】リフロー温度は、図5の(A)のAl−S
i二元素系平衡状態図に示すように、0.4%のシリコ
ンが金属配線材料を構成するAl中に完全に固溶する約
440゜C以上、部分的に金属配線材料が溶融する可能
性のある共晶温度577゜C以下にする必要がある。ま
た、リフロー雰囲気の圧力には特に制限は無いが、リフ
ロー処理中に金属配線材料層が酸化や窒化されないよう
に、高純度の不活性ガス雰囲気中でリフロー処理を行う
ことが好ましい。
i二元素系平衡状態図に示すように、0.4%のシリコ
ンが金属配線材料を構成するAl中に完全に固溶する約
440゜C以上、部分的に金属配線材料が溶融する可能
性のある共晶温度577゜C以下にする必要がある。ま
た、リフロー雰囲気の圧力には特に制限は無いが、リフ
ロー処理中に金属配線材料層が酸化や窒化されないよう
に、高純度の不活性ガス雰囲気中でリフロー処理を行う
ことが好ましい。
【0033】[工程−130]その後、フォトリソグラ
フィ技術及びエッチング技術を用いて、絶縁層20上の
金属配線材料層22及び下地層21をパターニングし
て、配線層を形成する。パターニングの条件を以下に例
示する。 使用ガス :BCl3/Cl2=60/90sccm 圧力 :2Pa RFパワー :1.2kW
フィ技術及びエッチング技術を用いて、絶縁層20上の
金属配線材料層22及び下地層21をパターニングし
て、配線層を形成する。パターニングの条件を以下に例
示する。 使用ガス :BCl3/Cl2=60/90sccm 圧力 :2Pa RFパワー :1.2kW
【0034】(実施例2)実施例2は、本発明の第2の
態様に係る半導体装置の配線形成方法に関する。実施例
2においては、基体は半導体基板から成り、ソース・ド
レイン領域が導体層に相当する。また、物理的気相成長
法はDCスパッタ法とした。金属配線材料は、Al−
0.5%Cuから成り、酸化防止膜はアモルファスシリ
コンから成る。以下、図3及び図4を参照して、実施例
2の半導体装置の配線形成方法を説明する。
態様に係る半導体装置の配線形成方法に関する。実施例
2においては、基体は半導体基板から成り、ソース・ド
レイン領域が導体層に相当する。また、物理的気相成長
法はDCスパッタ法とした。金属配線材料は、Al−
0.5%Cuから成り、酸化防止膜はアモルファスシリ
コンから成る。以下、図3及び図4を参照して、実施例
2の半導体装置の配線形成方法を説明する。
【0035】[工程−200]先ず、公知の方法に基づ
き、基体30であるシリコン半導体基板に素子分離領域
31を形成した後、シリコン半導体基板の表面にSiO
2から成るゲート酸化膜32を形成する。次いで、ポリ
シリコン、ポリサイドあるいはシリサイドから成るゲー
ト電極33を、例えばCVD法、フォトリソグラフィ技
術及びエッチング技術を用いて形成する。その後、LD
D構造を形成するためのイオン注入を行い、次いで、全
面にSiO2膜を堆積させた後、SiO2膜をエッチバッ
クし、SiO2から成るゲートサイドウオール34をゲ
ート電極33の側壁に形成する。次に、不純物のイオン
注入を行った後、基体30にイオン注入された不純物を
活性化するために活性化アニール処理を行い、ソース・
ドレイン領域を形成する。こうして、図3の(A)に示
すように、シリコン半導体基板から成る基体30に、ソ
ース・ドレイン領域から成る導体層35が形成される。
尚、図3の(A)に示した構造では、素子分離領域31
をLOCOS構造としたが、所謂トレンチ構造を有する
素子分離領域とすることもできる。
き、基体30であるシリコン半導体基板に素子分離領域
31を形成した後、シリコン半導体基板の表面にSiO
2から成るゲート酸化膜32を形成する。次いで、ポリ
シリコン、ポリサイドあるいはシリサイドから成るゲー
ト電極33を、例えばCVD法、フォトリソグラフィ技
術及びエッチング技術を用いて形成する。その後、LD
D構造を形成するためのイオン注入を行い、次いで、全
面にSiO2膜を堆積させた後、SiO2膜をエッチバッ
クし、SiO2から成るゲートサイドウオール34をゲ
ート電極33の側壁に形成する。次に、不純物のイオン
注入を行った後、基体30にイオン注入された不純物を
活性化するために活性化アニール処理を行い、ソース・
ドレイン領域を形成する。こうして、図3の(A)に示
すように、シリコン半導体基板から成る基体30に、ソ
ース・ドレイン領域から成る導体層35が形成される。
尚、図3の(A)に示した構造では、素子分離領域31
をLOCOS構造としたが、所謂トレンチ構造を有する
素子分離領域とすることもできる。
【0036】[工程−210]次に、導体層35が形成
された基体30上に絶縁層40を形成する。絶縁層40
は、例えばSiO2から成り、CVD法にて形成するこ
とができる。その後、導体層35の上方の絶縁層40
に、フォトリソグラフィ技術及びエッチング技術を用い
て開口部36を設ける(図3の(B)参照)。
された基体30上に絶縁層40を形成する。絶縁層40
は、例えばSiO2から成り、CVD法にて形成するこ
とができる。その後、導体層35の上方の絶縁層40
に、フォトリソグラフィ技術及びエッチング技術を用い
て開口部36を設ける(図3の(B)参照)。
【0037】[工程−220]次に、開口部36内を含
む絶縁層40上に、Ti層及びTiN層を順次スパッタ
法で成膜する。尚、Ti層は、導体層35と後に形成さ
れる金属配線材料との間のコンタクト抵抗の低減を目的
として形成される。一方、TiN層は、金属配線材料で
開口部36内を埋め込む際、金属配線材料によって導体
層35が損傷を受けることを防止するバリア層としての
機能を有する。Ti層及びTiN層のスパッタ条件を以
下に例示する。尚、TiN層の成膜後、TiN層のバリ
ア性を向上させるために、窒素ガス雰囲気中若しくは窒
素ガスと酸素ガスの混合ガス雰囲気中で650゜C×6
0秒程度のRTA処理を行うことが好ましい。このよう
な工程で形成されたTi層及びTiN層を纏めて、以下
バリアメタル層41と呼ぶ。 Ti層の成膜条件 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 膜厚 :30nm TiN層の成膜条件 ガス :Ar/N2=30/80sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 膜厚 :70nm
む絶縁層40上に、Ti層及びTiN層を順次スパッタ
法で成膜する。尚、Ti層は、導体層35と後に形成さ
れる金属配線材料との間のコンタクト抵抗の低減を目的
として形成される。一方、TiN層は、金属配線材料で
開口部36内を埋め込む際、金属配線材料によって導体
層35が損傷を受けることを防止するバリア層としての
機能を有する。Ti層及びTiN層のスパッタ条件を以
下に例示する。尚、TiN層の成膜後、TiN層のバリ
ア性を向上させるために、窒素ガス雰囲気中若しくは窒
素ガスと酸素ガスの混合ガス雰囲気中で650゜C×6
0秒程度のRTA処理を行うことが好ましい。このよう
な工程で形成されたTi層及びTiN層を纏めて、以下
バリアメタル層41と呼ぶ。 Ti層の成膜条件 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 膜厚 :30nm TiN層の成膜条件 ガス :Ar/N2=30/80sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C 膜厚 :70nm
【0038】[工程−230]その後、絶縁層40上に
(より具体的には、実施例2においては、バリアメタル
層41の上に)、Al−0.5%Cuから成る金属配線
材料層42を物理的気相成長法にて形成する(図3の
(C)参照)。実施例2においては、物理的気相成長法
はDCスパッタ法とした。尚、金属配線材料層42の成
膜に先立ち、バリアメタル層41の上に厚さ20nmの
Tiから成る下地層(図示せず)を、金属配線材料層の
濡れ性向上のために、スパッタ法にて形成しておくこと
が望ましい。金属配線材料層42の成膜条件を以下に例
示する。 金属配線材料層42の成膜条件 ターゲット :Al−0.5%Cu プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :20kW 成膜温度 :300゜C 膜厚 :0.5μm
(より具体的には、実施例2においては、バリアメタル
層41の上に)、Al−0.5%Cuから成る金属配線
材料層42を物理的気相成長法にて形成する(図3の
(C)参照)。実施例2においては、物理的気相成長法
はDCスパッタ法とした。尚、金属配線材料層42の成
膜に先立ち、バリアメタル層41の上に厚さ20nmの
Tiから成る下地層(図示せず)を、金属配線材料層の
濡れ性向上のために、スパッタ法にて形成しておくこと
が望ましい。金属配線材料層42の成膜条件を以下に例
示する。 金属配線材料層42の成膜条件 ターゲット :Al−0.5%Cu プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :20kW 成膜温度 :300゜C 膜厚 :0.5μm
【0039】尚、成膜後のアルミニウム系合金から成る
金属配線材料層42の形状は、図3の(C)に示すよう
に、ブリッジ状が望ましい。即ち、開口部36の底部に
はボイドが残り、且つ、開口部36の上方は金属配線材
料層42によって塞がれていることが望ましい。このよ
うな形状にしない場合、即ち、金属配線材料層が図8に
示すような形状となったのでは、開口部内の金属配線材
料層の表面に酸化防止膜を形成することが困難となるか
らである。金属配線材料層42をこのような形状とする
ためには、成膜時の金属配線材料の流動性を高めればよ
い。そのために、実施例2においては、成膜温度を30
0゜Cと高めに設定してある。
金属配線材料層42の形状は、図3の(C)に示すよう
に、ブリッジ状が望ましい。即ち、開口部36の底部に
はボイドが残り、且つ、開口部36の上方は金属配線材
料層42によって塞がれていることが望ましい。このよ
うな形状にしない場合、即ち、金属配線材料層が図8に
示すような形状となったのでは、開口部内の金属配線材
料層の表面に酸化防止膜を形成することが困難となるか
らである。金属配線材料層42をこのような形状とする
ためには、成膜時の金属配線材料の流動性を高めればよ
い。そのために、実施例2においては、成膜温度を30
0゜Cと高めに設定してある。
【0040】[工程−240]次に、同一DCスパッタ
装置内で、金属配線材料層42を大気に曝すことなく、
金属配線材料層42の上に酸化防止膜43を形成する
(図4の(A)参照)。酸化防止膜43は、実施例1と
同様に、厚さ2nmのアモルファスシリコンから成る。
酸化防止膜43の成膜条件は、実施例1の[工程−11
0]と同様とすることができる。
装置内で、金属配線材料層42を大気に曝すことなく、
金属配線材料層42の上に酸化防止膜43を形成する
(図4の(A)参照)。酸化防止膜43は、実施例1と
同様に、厚さ2nmのアモルファスシリコンから成る。
酸化防止膜43の成膜条件は、実施例1の[工程−11
0]と同様とすることができる。
【0041】[工程−250]その後、DCスパッタ装
置から半導体基板を取り出して、半導体装置(実際に
は、半導体装置の中間物である)を大気中に曝し、別の
リフロー処理専用装置(例えば炉)で金属配線材料層4
2をリフローさせて、酸化防止膜43を構成する成分を
金属配線材料中に完全に固溶させ、且つ、金属配線材料
で開口部36を埋め込み、接続孔39を形成する(図4
の(B)参照)。この場合、リフロー処理前に、予め、
スパッタエッチング等によって金属配線材料層42の表
面をクリーニングする必要は無い。リフロー処理の条件
は、例えば実施例1の[工程−120]と同様とするこ
とができる。開口部36の底部のボイドは、金属配線材
料で完全に埋め込まれる。尚、酸化防止膜43を構成す
る成分が金属配線材料中に完全に固溶した後の金属配線
材料層を参照番号42Aで表した。
置から半導体基板を取り出して、半導体装置(実際に
は、半導体装置の中間物である)を大気中に曝し、別の
リフロー処理専用装置(例えば炉)で金属配線材料層4
2をリフローさせて、酸化防止膜43を構成する成分を
金属配線材料中に完全に固溶させ、且つ、金属配線材料
で開口部36を埋め込み、接続孔39を形成する(図4
の(B)参照)。この場合、リフロー処理前に、予め、
スパッタエッチング等によって金属配線材料層42の表
面をクリーニングする必要は無い。リフロー処理の条件
は、例えば実施例1の[工程−120]と同様とするこ
とができる。開口部36の底部のボイドは、金属配線材
料で完全に埋め込まれる。尚、酸化防止膜43を構成す
る成分が金属配線材料中に完全に固溶した後の金属配線
材料層を参照番号42Aで表した。
【0042】[工程−260]その後、実施例1の[工
程−130]と同様の方法で、フォトリソグラフィ技術
及びエッチング技術を用いて、絶縁層40上の金属配線
材料層42及び下地層をパターニングして、配線層を形
成する。
程−130]と同様の方法で、フォトリソグラフィ技術
及びエッチング技術を用いて、絶縁層40上の金属配線
材料層42及び下地層をパターニングして、配線層を形
成する。
【0043】(実施例3)実施例3は実施例2の変形で
ある。実施例3が実施例2と相違する点は、金属配線材
料として純アルミニウムを用いた点、及び酸化防止膜が
銅(Cu)から成る点、リフロー処理を高圧下で行う点
にある。尚、実施例3の半導体装置の配線形成方法の各
工程の内、バリアメタル層41の形成までは、実施例2
の[工程−200]〜[工程−220]と同様とするこ
とができるので、それ以降の工程のみを、以下、説明す
る。
ある。実施例3が実施例2と相違する点は、金属配線材
料として純アルミニウムを用いた点、及び酸化防止膜が
銅(Cu)から成る点、リフロー処理を高圧下で行う点
にある。尚、実施例3の半導体装置の配線形成方法の各
工程の内、バリアメタル層41の形成までは、実施例2
の[工程−200]〜[工程−220]と同様とするこ
とができるので、それ以降の工程のみを、以下、説明す
る。
【0044】[工程−300]バリアメタル層41の形
成の後、絶縁層40上に、純アルミニウムから成る金属
配線材料層42を物理的気相成長法にて形成する(図3
の(C)参照)。物理的気相成長法はDCスパッタ法と
した。尚、金属配線材料層42の成膜に先立ち、バリア
メタル層41の上に厚さ20nmのTiから成る下地層
をスパッタ法にて形成しておくことが望ましい。金属配
線材料層42の成膜条件を以下に例示する。 金属配線材料層42の成膜条件 ターゲット :Al プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :20kW 成膜温度 :300゜C 膜厚 :0.5μm
成の後、絶縁層40上に、純アルミニウムから成る金属
配線材料層42を物理的気相成長法にて形成する(図3
の(C)参照)。物理的気相成長法はDCスパッタ法と
した。尚、金属配線材料層42の成膜に先立ち、バリア
メタル層41の上に厚さ20nmのTiから成る下地層
をスパッタ法にて形成しておくことが望ましい。金属配
線材料層42の成膜条件を以下に例示する。 金属配線材料層42の成膜条件 ターゲット :Al プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :20kW 成膜温度 :300゜C 膜厚 :0.5μm
【0045】尚、実施例3においては、リフロー処理を
高圧下で行うので、成膜後のアルミニウム系合金から成
る金属配線材料層42の形状を、図3の(C)に示すよ
うに、ブリッジ状とする必要がある。図8に示すよう
に、開口部の底部に金属配線材料が堆積し、しかも、開
口部の側壁に十分な厚さの金属配線材料が堆積していな
い場合、開口部内の金属配線材料層の表面に酸化防止膜
を形成することが困難となるだけでなく、リフロー処理
を高圧下で行っても、開口部内に十分な量の金属配線材
料を押し込むことができず、金属配線材料で埋め込まれ
た接続孔の信頼性に乏しくなるからである。尚、実施例
3においても、金属配線材料層42をこのような形状と
するためには、成膜時の金属配線材料の流動性を高めれ
ばよいので、金属配線材料層42の成膜温度を300゜
Cと高めに設定してある。
高圧下で行うので、成膜後のアルミニウム系合金から成
る金属配線材料層42の形状を、図3の(C)に示すよ
うに、ブリッジ状とする必要がある。図8に示すよう
に、開口部の底部に金属配線材料が堆積し、しかも、開
口部の側壁に十分な厚さの金属配線材料が堆積していな
い場合、開口部内の金属配線材料層の表面に酸化防止膜
を形成することが困難となるだけでなく、リフロー処理
を高圧下で行っても、開口部内に十分な量の金属配線材
料を押し込むことができず、金属配線材料で埋め込まれ
た接続孔の信頼性に乏しくなるからである。尚、実施例
3においても、金属配線材料層42をこのような形状と
するためには、成膜時の金属配線材料の流動性を高めれ
ばよいので、金属配線材料層42の成膜温度を300゜
Cと高めに設定してある。
【0046】[工程−310]次に、同一DCスパッタ
装置内で、金属配線材料層42を大気に曝すことなく、
金属配線材料層42の上に酸化防止膜43を形成する
(図4の(A)参照)。酸化防止膜43は、実施例2と
は異なり、厚さ5nmの銅(Cu)から成る。酸化防止
膜43の成膜条件を以下に例示する。尚、この場合、C
uから成る酸化防止膜43の厚さは、その後のリフロー
時のリフロー温度で、酸化防止膜43を構成する成分が
金属配線材料中に完全に固溶する厚さでなければなら
ず、例えばリフロー温度を400゜Cとした場合、純ア
ルミニウムから成る金属配線材料層42の厚さ(例えば
0.5μm)の約1.2%(例えば6nm)以下である
ことが望ましい。ここで、約1.2%の値が、金属配線
材料層42をリフローさせたとき酸化防止膜43を構成
する成分が金属配線材料中に完全に固溶する限界量であ
る。 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C [工程−320]その後、DCスパッタ装置から半導体
基板を取り出して、半導体装置(実際には、半導体装置
の中間物である)を大気中に曝し、別のリフロー処理専
用装置(例えば炉)で金属配線材料層42を高圧下でリ
フローさせて、酸化防止膜43を構成する成分を金属配
線材料中に完全に固溶させ、且つ、金属配線材料で開口
部36を埋め込み、接続孔39を形成する(図4の
(B)参照)。リフロー処理の条件を以下に例示する。
開口部36の上方のブリッジ状の金属配線材料層42の
部分及びその近傍の金属配線材料層42は、高圧不活性
ガスの圧力によって開口部36内に押し込まれ、開口部
36の底部のボイドは金属配線材料で完全に埋め込まれ
る。 基体加熱温度:400゜C 加熱時間 :2分 加熱雰囲気 :アルゴンガス 雰囲気の圧力:106Pa以上
装置内で、金属配線材料層42を大気に曝すことなく、
金属配線材料層42の上に酸化防止膜43を形成する
(図4の(A)参照)。酸化防止膜43は、実施例2と
は異なり、厚さ5nmの銅(Cu)から成る。酸化防止
膜43の成膜条件を以下に例示する。尚、この場合、C
uから成る酸化防止膜43の厚さは、その後のリフロー
時のリフロー温度で、酸化防止膜43を構成する成分が
金属配線材料中に完全に固溶する厚さでなければなら
ず、例えばリフロー温度を400゜Cとした場合、純ア
ルミニウムから成る金属配線材料層42の厚さ(例えば
0.5μm)の約1.2%(例えば6nm)以下である
ことが望ましい。ここで、約1.2%の値が、金属配線
材料層42をリフローさせたとき酸化防止膜43を構成
する成分が金属配線材料中に完全に固溶する限界量であ
る。 プロセスガス:Ar=100sccm 圧力 :0.4Pa DCパワー :5kW 成膜温度 :150゜C [工程−320]その後、DCスパッタ装置から半導体
基板を取り出して、半導体装置(実際には、半導体装置
の中間物である)を大気中に曝し、別のリフロー処理専
用装置(例えば炉)で金属配線材料層42を高圧下でリ
フローさせて、酸化防止膜43を構成する成分を金属配
線材料中に完全に固溶させ、且つ、金属配線材料で開口
部36を埋め込み、接続孔39を形成する(図4の
(B)参照)。リフロー処理の条件を以下に例示する。
開口部36の上方のブリッジ状の金属配線材料層42の
部分及びその近傍の金属配線材料層42は、高圧不活性
ガスの圧力によって開口部36内に押し込まれ、開口部
36の底部のボイドは金属配線材料で完全に埋め込まれ
る。 基体加熱温度:400゜C 加熱時間 :2分 加熱雰囲気 :アルゴンガス 雰囲気の圧力:106Pa以上
【0047】尚、加熱温度は図5の(B)のAl−Cu
二元素系平衡状態図に示すように、1%のCuが金属配
線材料中に完全に固溶する約380゜C以上、金属配線
材料が部分的に溶ける可能性がある共晶温度548゜C
以下にする必要がある。また、実施例1と同様に、リフ
ロー処理中に金属配線材料層が酸化や窒化されることを
避けるために、高純度の不活性ガス雰囲気にすることが
好ましい。
二元素系平衡状態図に示すように、1%のCuが金属配
線材料中に完全に固溶する約380゜C以上、金属配線
材料が部分的に溶ける可能性がある共晶温度548゜C
以下にする必要がある。また、実施例1と同様に、リフ
ロー処理中に金属配線材料層が酸化や窒化されることを
避けるために、高純度の不活性ガス雰囲気にすることが
好ましい。
【0048】[工程−330]その後、実施例1の[工
程−130]と同様の方法で、フォトリソグラフィ技術
及びエッチング技術を用いて、絶縁層40上の金属配線
材料層42及び下地層をパターニングして、配線層を形
成する。
程−130]と同様の方法で、フォトリソグラフィ技術
及びエッチング技術を用いて、絶縁層40上の金属配線
材料層42及び下地層をパターニングして、配線層を形
成する。
【0049】以上、本発明を好ましい実施例に基づき説
明したが、本発明はこれらの実施例に限定されるもので
はない。実施例においては、絶縁層20,40の上に配
線を形成したが、例えば絶縁層20,40に溝部を形成
し、かかる溝部内を含む絶縁層上に下地層、金属配線材
料層、酸化防止膜を形成し、リフロー処理を施した後
に、絶縁層上の金属配線材料層及び下地層をエッチバッ
ク法や化学的・機械的研磨法(CMP法)で除去するこ
とによって、溝部に埋め込まれた形態の配線構造とする
こともできる。
明したが、本発明はこれらの実施例に限定されるもので
はない。実施例においては、絶縁層20,40の上に配
線を形成したが、例えば絶縁層20,40に溝部を形成
し、かかる溝部内を含む絶縁層上に下地層、金属配線材
料層、酸化防止膜を形成し、リフロー処理を施した後
に、絶縁層上の金属配線材料層及び下地層をエッチバッ
ク法や化学的・機械的研磨法(CMP法)で除去するこ
とによって、溝部に埋め込まれた形態の配線構造とする
こともできる。
【0050】実施例2及び実施例3においては、導体層
35はソース・ドレイン領域としたが、導体層35は、
下層絶縁層の上に形成された下層配線層、あるいは下層
絶縁層に形成された溝部内に設けられた下層配線層とす
ることもできる。
35はソース・ドレイン領域としたが、導体層35は、
下層絶縁層の上に形成された下層配線層、あるいは下層
絶縁層に形成された溝部内に設けられた下層配線層とす
ることもできる。
【0051】酸化防止膜として、CuやSi以外にも、
例えばAgやGeから構成することもできる。尚、Al
−Ag及びAl−Geの二元素系平衡状態図を図5の
(C)及び(D)に示す。
例えばAgやGeから構成することもできる。尚、Al
−Ag及びAl−Geの二元素系平衡状態図を図5の
(C)及び(D)に示す。
【0052】実施例においては、絶縁層20,40をS
iO2から構成したが、その他、BPSG、PSG、B
SG、AsSG、PbSG、SbSG、SOG、SiO
N又はSiN等の公知の絶縁材料、あるいはこれらの絶
縁層を積層したものから構成することができる。必要に
応じて、絶縁層の形成後、例えば、熱処理や化学的・機
械的研磨法(CMP法)、エッチバック法等により、絶
縁層20,40の平坦化処理を行うことが望ましい。
iO2から構成したが、その他、BPSG、PSG、B
SG、AsSG、PbSG、SbSG、SOG、SiO
N又はSiN等の公知の絶縁材料、あるいはこれらの絶
縁層を積層したものから構成することができる。必要に
応じて、絶縁層の形成後、例えば、熱処理や化学的・機
械的研磨法(CMP法)、エッチバック法等により、絶
縁層20,40の平坦化処理を行うことが望ましい。
【0053】実施例においてはTi層やTiN層をスパ
ッタ法で成膜したが、その代わりにCVD法を用いて成
膜することもできる。メタルプラグ18はタングステン
に限定されず、他の高融点金属材料若しくは高融点金属
化合物、例えば銅若しくはTiNから構成することもで
きる。CVD法による銅、TiN及びTiの成膜条件を
以下に例示する。尚、HFAとは、ヘキサフルオロアセ
チルアセトネートの略である。 銅のCVD成膜条件 使用ガス : Cu(HFA)2/H2=10/100
0sccm 圧力 : 2.6×103Pa 基板加熱温度: 350゜C パワー : 500W TiNのECR CVD条件 使用ガス : TiCl4/H2/N2=20/2
6/8sccm マイクロ波パワー 2.8kW 基板RFバイアス: −50W 温度 : 750゜C 圧力 : 0.12Pa TiのECR CVD条件 使用ガス : TiCl4/H2/Ar=15/5
0/43sccm マイクロ波パワー: 2.0kW 温度 : 500゜C 圧力 : 0.3Pa
ッタ法で成膜したが、その代わりにCVD法を用いて成
膜することもできる。メタルプラグ18はタングステン
に限定されず、他の高融点金属材料若しくは高融点金属
化合物、例えば銅若しくはTiNから構成することもで
きる。CVD法による銅、TiN及びTiの成膜条件を
以下に例示する。尚、HFAとは、ヘキサフルオロアセ
チルアセトネートの略である。 銅のCVD成膜条件 使用ガス : Cu(HFA)2/H2=10/100
0sccm 圧力 : 2.6×103Pa 基板加熱温度: 350゜C パワー : 500W TiNのECR CVD条件 使用ガス : TiCl4/H2/N2=20/2
6/8sccm マイクロ波パワー 2.8kW 基板RFバイアス: −50W 温度 : 750゜C 圧力 : 0.12Pa TiのECR CVD条件 使用ガス : TiCl4/H2/Ar=15/5
0/43sccm マイクロ波パワー: 2.0kW 温度 : 500゜C 圧力 : 0.3Pa
【0054】下地層は、Tiの他、TiN、TiON、
TiW、W等の導電性を有する高融点金属若しくはその
化合物から構成することができる。
TiW、W等の導電性を有する高融点金属若しくはその
化合物から構成することができる。
【0055】
【発明の効果】本発明の半導体装置の配線形成方法にお
いては、金属配線材料層の上に酸化防止膜を形成してお
くことにより、一度大気中に半導体装置が曝されても金
属配線材料層の表面が酸化されることがない。従って、
金属配線材料層の成膜とリフロー処理(高圧リフローを
含む)を別の装置で行うことができる。また、リフロー
処理前に、スパッタエッチング等による金属配線材料層
の表面クリーニング処理を行う必要がない。その結果、
配線形成の工程全体の低コスト化が図れる。即ち、従来
の成膜装置をそのまま利用して、クラスター装置化する
こと無く、金属配線材料層等の成膜及び金属配線材料層
の高圧リフロー処理を含むリフロー処理を行うことがで
きる。また、リフロー処理装置あるいは高圧リフロー処
理装置が、熱処理及び/又は高圧処理部分のみで済むた
め、装置の低コスト化及びバッチ処理化に有利となる。
更には、酸化防止膜の金属配線材料中への固溶によっ
て、リフロー温度の低下が期待できるし、酸化防止膜を
銅から構成すれば、銅が金属配線材料中に固溶されるこ
とによって、金属配線材料層の信頼性も向上する。
いては、金属配線材料層の上に酸化防止膜を形成してお
くことにより、一度大気中に半導体装置が曝されても金
属配線材料層の表面が酸化されることがない。従って、
金属配線材料層の成膜とリフロー処理(高圧リフローを
含む)を別の装置で行うことができる。また、リフロー
処理前に、スパッタエッチング等による金属配線材料層
の表面クリーニング処理を行う必要がない。その結果、
配線形成の工程全体の低コスト化が図れる。即ち、従来
の成膜装置をそのまま利用して、クラスター装置化する
こと無く、金属配線材料層等の成膜及び金属配線材料層
の高圧リフロー処理を含むリフロー処理を行うことがで
きる。また、リフロー処理装置あるいは高圧リフロー処
理装置が、熱処理及び/又は高圧処理部分のみで済むた
め、装置の低コスト化及びバッチ処理化に有利となる。
更には、酸化防止膜の金属配線材料中への固溶によっ
て、リフロー温度の低下が期待できるし、酸化防止膜を
銅から構成すれば、銅が金属配線材料中に固溶されるこ
とによって、金属配線材料層の信頼性も向上する。
【図1】実施例1の半導体装置の配線形成方法を説明す
るための工程図である。
るための工程図である。
【図2】図1に引き続き、実施例1の半導体装置の配線
形成方法を説明するための工程図である。
形成方法を説明するための工程図である。
【図3】実施例2の半導体装置の配線形成方法を説明す
るための工程図である。
るための工程図である。
【図4】図3に引き続き、実施例2の半導体装置の配線
形成方法を説明するための工程図である。
形成方法を説明するための工程図である。
【図5】二元素系平衡状態図である。
【図6】従来の高温リフロー法を説明するための図であ
る。
る。
【図7】従来の高温リフロー法における問題点を説明す
るための図である。
るための図である。
【図8】成膜後の開口部近傍における金属配線材料の状
態を模式的に示す図である。
態を模式的に示す図である。
10,30 基体 11,31 素子分離領域 12,32 ゲート酸化膜 13,33 ゲート電極 14,34 ゲートサイドウオール 15, ソース・ドレイン領域 16,36 開口部 17,41 バリアメタル層 18 メタルプラグ 19,44 接続孔 20,40 絶縁層 21 下地層 22,22A,42,42A 金属配線材料層 23,43 酸化防止膜 35 導体層(ソース・ドレイン領域)
Claims (7)
- 【請求項1】(イ)基体上に物理的気相成長法にて金属
配線材料から成る金属配線材料層を形成する工程と、 (ロ)該金属配線材料層上に酸化防止膜を形成する工程
と、 (ハ)該金属配線材料層をリフローさせて、酸化防止膜
を構成する成分を金属配線材料中に完全に固溶させる工
程と、 (ニ)該金属配線材料層をパターニングして配線を形成
する工程、から成ることを特徴とする半導体装置の配線
形成方法。 - 【請求項2】前記工程(ロ)と工程(ハ)の間に、半導
体装置を大気に曝露する工程を含むことを特徴とする請
求項1に記載の半導体装置の配線形成方法。 - 【請求項3】金属配線材料層から成る配線、及び該金属
配線材料層を構成する金属配線材料が埋め込まれた接続
孔を形成するための半導体装置の配線形成方法であっ
て、 (イ)導体層が設けられた基体上に絶縁層を形成し、該
導体層の上方の絶縁層に開口部を形成する工程と、 (ロ)絶縁層上に、金属配線材料から成る金属配線材料
層を物理的気相成長法にて形成する工程と、 (ハ)該金属配線材料層上に酸化防止膜を形成する工程
と、 (ニ)該金属配線材料層をリフローさせて、酸化防止膜
を構成する成分を金属配線材料中に完全に固溶させ、且
つ、該金属配線材料で開口部を埋め込み、接続孔を形成
する工程と、 (ホ)該金属配線材料層をパターニングして配線を形成
する工程、から成ることを特徴とする半導体装置の配線
形成方法。 - 【請求項4】物理的気相成長法にて金属配線材料層を形
成した後において、開口部の底部にはボイドが残り、且
つ、開口部の上方は金属配線材料層によって塞がれてお
り、前記工程(ニ)において、高圧下、金属配線材料層
をリフローさせることを特徴とする請求項3に記載の半
導体装置の配線形成方法。 - 【請求項5】前記工程(ハ)と工程(ニ)の間に、半導
体装置を大気に曝露する工程を含むことを特徴とする請
求項3又は請求項4に記載の半導体装置の配線形成方
法。 - 【請求項6】酸化防止膜は、室温で強固な酸化膜を形成
し難い材料から成り、酸化防止膜の膜厚は、金属配線材
料層をリフローさせたとき酸化防止膜を構成する成分が
金属配線材料中に完全に固溶する限界量以下の量に相当
する膜厚であることを特徴とする請求項1乃至請求項5
のいずれか1項に記載の半導体装置の配線形成方法。 - 【請求項7】酸化防止膜は、Ag、Cu、Si及びGe
から成る群から選択された少なくとも1種類の材料から
成ることを特徴とする請求項1乃至請求項6のいずれか
1項に記載の半導体装置の配線形成方法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33424294A JP3365112B2 (ja) | 1994-12-16 | 1994-12-16 | 半導体装置の配線形成方法 |
| US08/568,667 US5985751A (en) | 1994-12-16 | 1995-12-07 | Process for fabricating interconnection of semiconductor device |
| KR1019950050135A KR960026643A (ko) | 1994-12-16 | 1995-12-14 | 반도체장치의 배선 제조방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33424294A JP3365112B2 (ja) | 1994-12-16 | 1994-12-16 | 半導体装置の配線形成方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08172131A true JPH08172131A (ja) | 1996-07-02 |
| JP3365112B2 JP3365112B2 (ja) | 2003-01-08 |
Family
ID=18275140
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33424294A Expired - Fee Related JP3365112B2 (ja) | 1994-12-16 | 1994-12-16 | 半導体装置の配線形成方法 |
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|---|---|
| US (1) | US5985751A (ja) |
| JP (1) | JP3365112B2 (ja) |
| KR (1) | KR960026643A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6171957B1 (en) | 1997-07-16 | 2001-01-09 | Mitsubishi Denki Kabushiki Kaisha | Manufacturing method of semiconductor device having high pressure reflow process |
| KR100309811B1 (ko) * | 1998-12-30 | 2002-07-06 | 박종섭 | 반도체소자의금속배선형성방법 |
| JP2005101102A (ja) * | 2003-09-22 | 2005-04-14 | Toshiba Corp | 半導体レーザ素子用サブマウント |
Families Citing this family (19)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5789317A (en) * | 1996-04-12 | 1998-08-04 | Micron Technology, Inc. | Low temperature reflow method for filling high aspect ratio contacts |
| JP3201321B2 (ja) * | 1997-11-10 | 2001-08-20 | 日本電気株式会社 | 配線用アルミニウム膜の形成方法 |
| US6140236A (en) * | 1998-04-21 | 2000-10-31 | Kabushiki Kaisha Toshiba | High throughput A1-Cu thin film sputtering process on small contact via for manufacturable beol wiring |
| US6982226B1 (en) * | 1998-06-05 | 2006-01-03 | Agere Systems Inc. | Method of fabricating a contact with a post contact plug anneal |
| JP2000133712A (ja) * | 1998-08-18 | 2000-05-12 | Seiko Epson Corp | 半導体装置の製造方法 |
| TW412792B (en) * | 1999-02-10 | 2000-11-21 | Applied Materials Inc | Etching back process for solving the plug loss |
| US6211085B1 (en) * | 1999-02-18 | 2001-04-03 | Taiwan Semiconductor Company | Method of preparing CU interconnect lines |
| US6451698B1 (en) * | 1999-04-07 | 2002-09-17 | Koninklijke Philips Electronics N.V. | System and method for preventing electrochemical erosion by depositing a protective film |
| JP3892621B2 (ja) * | 1999-04-19 | 2007-03-14 | 株式会社神戸製鋼所 | 配線膜の形成方法 |
| US6683761B2 (en) | 2000-11-09 | 2004-01-27 | Seagate Technology Llc | Magnetoresistive sensor with laminate electrical interconnect |
| US6436814B1 (en) | 2000-11-21 | 2002-08-20 | International Business Machines Corporation | Interconnection structure and method for fabricating same |
| KR100400035B1 (ko) * | 2001-02-21 | 2003-09-29 | 삼성전자주식회사 | 균일한 접촉 저항을 갖는 콘택을 구비한 반도체 소자 및그의 제조방법 |
| JP2003023070A (ja) * | 2001-07-05 | 2003-01-24 | Mitsubishi Electric Corp | 半導体装置およびその製造方法 |
| KR100641502B1 (ko) * | 2002-12-30 | 2006-10-31 | 동부일렉트로닉스 주식회사 | 반도체 소자 제조시 듀얼 다마신 공정을 이용한 콘텍형성방법 |
| KR100792358B1 (ko) * | 2006-09-29 | 2008-01-09 | 주식회사 하이닉스반도체 | 반도체 소자의 금속배선 및 그 형성방법 |
| KR101476120B1 (ko) * | 2008-06-12 | 2014-12-26 | 주성엔지니어링(주) | 박막형 태양전지 및 그 제조방법 |
| US8487386B2 (en) * | 2009-06-18 | 2013-07-16 | Imec | Method for forming MEMS devices having low contact resistance and devices obtained thereof |
| US9960078B1 (en) | 2017-03-23 | 2018-05-01 | International Business Machines Corporation | Reflow interconnect using Ru |
| US20230343697A1 (en) * | 2022-04-20 | 2023-10-26 | Samsung Electronics Co., Ltd. | Semiconductor device including spacer via structure and method of manufacturing the same |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5747361A (en) * | 1991-05-01 | 1998-05-05 | Mitel Corporation | Stabilization of the interface between aluminum and titanium nitride |
| KR100281887B1 (ko) * | 1994-01-18 | 2001-03-02 | 윤종용 | 반도체장치의 제조방법 |
| US5610099A (en) * | 1994-06-28 | 1997-03-11 | Ramtron International Corporation | Process for fabricating transistors using composite nitride structure |
-
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Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6171957B1 (en) | 1997-07-16 | 2001-01-09 | Mitsubishi Denki Kabushiki Kaisha | Manufacturing method of semiconductor device having high pressure reflow process |
| KR100309811B1 (ko) * | 1998-12-30 | 2002-07-06 | 박종섭 | 반도체소자의금속배선형성방법 |
| JP2005101102A (ja) * | 2003-09-22 | 2005-04-14 | Toshiba Corp | 半導体レーザ素子用サブマウント |
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| Publication number | Publication date |
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