JPH0818310A - 半導体パッケージ - Google Patents

半導体パッケージ

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Publication number
JPH0818310A
JPH0818310A JP6146068A JP14606894A JPH0818310A JP H0818310 A JPH0818310 A JP H0818310A JP 6146068 A JP6146068 A JP 6146068A JP 14606894 A JP14606894 A JP 14606894A JP H0818310 A JPH0818310 A JP H0818310A
Authority
JP
Japan
Prior art keywords
package
cavity
lid
circuit
film
Prior art date
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Pending
Application number
JP6146068A
Other languages
English (en)
Inventor
Teru Jiyosawa
輝 如澤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kyocera Corp
Original Assignee
Kyocera Corp
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Filing date
Publication date
Application filed by Kyocera Corp filed Critical Kyocera Corp
Priority to JP6146068A priority Critical patent/JPH0818310A/ja
Publication of JPH0818310A publication Critical patent/JPH0818310A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K9/00Screening of apparatus or components against electric or magnetic fields
    • H05K9/0007Casings
    • H05K9/0056Casings specially adapted for microwave applications

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  • Waveguides (AREA)

Abstract

(57)【要約】 【目的】信頼性を損ねずに共振を抑えることが出来る、
回路または半導体装置のパッケージを提供する。 【構成】キャビテイ内に半導体素子及び回路基板を搭載
し、金属キャップで封止してなる半導体パッケージにお
いて、前記パッケージ内のキャビテイに面する部位又は
キャビテイ側面の少なくとも一部に抵抗体の膜を形成し
た。 【効果】パッケージの共振を抑えることが出来、使用可
能な周波数帯域を広げ信頼性を劣化させることがなく、
小型化も可能となる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置パッケージ
に関し、特にマイクロ波、ミリ波で使用されるパッケー
ジに関するものである。
【0002】
【従来の技術】従来のパッケージは、図8のように、パ
ッケージの内部の回路9と外部とを電気的に接続する端
子11を有し、天井となる面全てが開口部となった金属
の箱体8と、その開口部を封止する図7に示す金属製の
蓋7によって構成されている。このような回路モジュー
ル用パッケージでは、回路9に流れる信号の周波数が高
くなると、端子11と回路基板10上の線路9aとの接
続部や線路9aと半導体装置9bとの接続部等での信号
の散乱、放射が増大する。この放射された信号のうち箱
体8と蓋7で囲まれたキャビテイの寸法による周波数
【0003】
【数1】
【0004】を持った信号は、このキャビテイ内に電磁
波として蓄えられる。この電磁波が再び線路9aに吸収
され、信号とともに半導体装置9bに伝達されると、異
常発振や破壊を招き、端子11を通りパッケージ外部に
伝達されると、この回路モジュールに接続された回路に
悪影響を与える。
【0005】
【発明が解決しようとする課題】このため、回路モージ
ュルに入出力できる信号の周波数帯域は、回路を封止す
るパッケージ内部の体積による周波数、すなわち共振周
波数を除く周波数帯域に限られる。このパッケージのキ
ャビテイ内で起こる共振を抑えるため、箱体8や蓋7の
キャビテイに面する部位に電波吸収体を接着することが
行われてきた(実開63−55545号公報)。しか
し、この場合は、使用中剥離しやすく封止されている半
導体装置を破損する恐れがあり、信頼性の面で問題があ
った。
【0006】本発明は、信頼性を損ねずに共振を抑える
ことが出来る、回路または半導体装置のパッケージを提
供することを目的としている。
【0007】
【課題を解決するための手段】上記課題を解決するため
に、本発明は、キャビテイ内に半導体素子及び回路基板
を搭載し、金属キャップで封止してなる半導体パッケー
ジにおいて、前記パッケージ内のキャビテイに面する部
位の少なくとも一部に抵抗体の膜を形成した。また、パ
ッケージ内のキャビテイの側面の少なくとも一部に抵抗
体の膜を形成した。
【0008】
【作用】本発明は、上記のように構成したので、キャビ
テイ又はキャビテイに面する部位に形成した抵抗体の膜
によりキャビテイ内で起こる共振を抑えることが出来
る。
【0009】
【実施例】以下図面を用いて本発明の実施例を説明す
る。図1乃至図3は、本発明の一実施例を示す。図3
は、本発明の回路モジュールの半導体パッケージの斜視
図、図1、図2は、その蓋の構造である。半導体パッケ
ージは、回路のモジュールを封止するパッケージの内部
の回路4と外部とを電気的に接続する端子6を有し、そ
の天井となる面全てが開口部となった金属の箱体3と、
その開口部に接着される金属製の蓋1のキャビテイ対向
面である内側に抵抗体の膜2が形成されて、半導体パッ
ケージが構成されている。
【0010】抵抗体の膜2は、キャビテイ内に放射され
た電磁波を吸収し、共振を抑圧する。したがって、抵抗
体の膜2を設けたことで、パッケージの使用できる周波
数帯域を広げることが出来る。抵抗体の膜2は、図1で
示す通り蓋1の一部位に形成されていても効果がある
が、図2のように箱体3と接着部位を除くキャビテイに
面する全ての部位に形成されていると大きな効果が得ら
れる。また、蓋1でなく、箱体3に抵抗膜が形成されて
いても同様の効果が得られる。
【0011】図4乃至図6は、別の実施例を示す。図6
は、本発明を用いたMMIC(マイクロ波半導体素子)
用のパッケージの斜視図、図4、図5は、その蓋12の
構造である。MMICを封止するパッケージは、パッケ
ージ内部のMMIC15と外部とを電気的に接続する端
子16を有し、その天井となる面全てが開口部となった
金属の箱体14とその開口部に接着される抵抗膜13が
形成された金属の蓋12によって構成されている。
【0012】また、この抵抗体の膜13は、厚膜印刷や
薄膜印刷によって形成することが出来るので、強い接着
力を得ることが出来、剥離して回路を破損することがな
い。さらに、電波吸収体を接着するために必要なスペー
スも必要ないため、小型化にも十分に対応できる。
【0013】
【発明の効果】以上説明したように、本発明は、マイク
ロ波、ミリ波で使われるパッケージの一次モードと二次
モードの共振周波数の間の周波数帯で使用される回路ま
たは半導体装置のパッケージの蓋等に抵抗体の膜をつけ
たことにより、パッケージの共振を抑えることが出来る
のでパッケージの使用が可能な周波数帯域を広げること
が出来、またそれによって信頼性を劣化させることがな
く、小型化も可能となる。
【図面の簡単な説明】
【図1】本発明の回路用パッケージの実施例の斜視図。
【図2】抵抗体の膜を形成した蓋の斜視図。
【図3】複数の抵抗体の膜を形成した蓋の斜視図。
【図4】本発明のMMIC用パッケージの実施例の斜視
図。
【図5】抵抗体の膜を形成した蓋の斜視図。
【図6】複数の抵抗体の膜を形成した蓋の斜視図。
【図7】従来の回路用パッケージの実施例の斜視図。
【図8】蓋の斜視図。
【符号の説明】 1 蓋 2 抵抗体の膜 3 箱体 4 回路 5 回路基板 6 端子 7 蓋 8 箱体 9 回路 9a 線路 9b 半導体装置 10 回路基板 11 端子 12 蓋 13 抵抗体の膜 14 箱体 15 MMIC 16 端子

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】キャビテイ内に半導体素子及び回路基板を
    搭載し、金属キャップで封止してなる半導体パッケージ
    において、前記パッケージ内のキャビテイに面する部位
    の少なくとも一部に抵抗体の膜を形成したことを特徴と
    する半導体パッケ−ジ
  2. 【請求項2】キャビテイ内に半導体素子及び回路基板を
    搭載し、金属キャップで封止してなる半導体パッケージ
    において、前記パッケージ内のキャビテイの側面の少な
    くとも一部に抵抗体の膜を形成したことを特徴とする半
    導体パッケ−ジ
JP6146068A 1994-06-28 1994-06-28 半導体パッケージ Pending JPH0818310A (ja)

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