JPH08213911A - 電流源により駆動された変換器 - Google Patents

電流源により駆動された変換器

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JPH08213911A
JPH08213911A JP7271665A JP27166595A JPH08213911A JP H08213911 A JPH08213911 A JP H08213911A JP 7271665 A JP7271665 A JP 7271665A JP 27166595 A JP27166595 A JP 27166595A JP H08213911 A JPH08213911 A JP H08213911A
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analog
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JP7271665A
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Jr George Francis Gross
フランシス グロス，ジュニヤ ジョージ
Thayamkulangara R Viswanathan
ラマスワミー ヴィスワナザン ザヤムクランガラ
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AT&T Corp
Original Assignee
AT&T Corp
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    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00—Analogue/digital conversion; Digital/analogue conversion
    • H03M1/66—Digital/analogue converters
    • H—ELECTRICITY
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    • H03M1/66—Digital/analogue converters
    • H03M1/74—Simultaneous conversion
    • H03M1/76—Simultaneous conversion using switching tree
    • H03M1/765—Simultaneous conversion using switching tree using a single level of switches which are controlled by unary decoded digital signals

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Analogue/Digital Conversion (AREA)

Abstract

(57)【要約】 【課題】 デジタル的に符号化された信号に対応するア
ナログ電圧を正確に発生するデジタル・アナログ変換器
を提供する。 【解決手段】 電流源（１２、１１２、２１２）により
駆動される抵抗ストリング（１４、１１４、２１４）を
有するデジタル・アナログ変換器（１０、１００、１１
０、２００）を含む集積回路が開示されている。抵抗ス
トリングは電流源に接続される。中間タップ（Ｔ1 から
Ｔn+1 、Ｔ1 からＴ25、Ｔ1 からＴ17）が、抵抗接続点
ならびに抵抗−電流源の接続点において規定される。ス
イッチングトランジスタ（Ｍ1 からＭn+1 ；Ｍ1 からＭ
25；Ｍ1 −Ｍ17）が出力ノードとそれぞれの中間タップ
の間に接続される。関連した中間タップを出力ノード
（１６、１１８、２３２）に電気的に接続し、トランジ
スタを予め定められた状態に選択的に切り換えるため
に、選択回路（２、２０６）がスイッチングトランジス
タの端子に接続されている。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、一般的には、アナ
ログ・デジタル変換器（ＤＡＣｓ）に関するものであ
り、より詳しくは、電流源により駆動される、この種の
変換器に関するものである。
【０００２】
【発明が解決しようとする課題】ＤＡＣｓは、デジタル
的に符号化された信号をアナログ信号に変換するため、
あるいはアナログ・デジタル変換器の一部としての逐次
近似回路（ｓｕｃｃｅｓｓｉｖｅ ａｐｐｒｏｘｉｍａ
ｔｉｏｎ ｃｉｒｃｕｉｔｒｙ）とともに使用される。
ＤＡＣｓはデジタル的に符号化された信号を、デジタル
信号に比例するアナログ信号に変換する。ＤＡＣｓは、
抵抗ストリングに印加された電圧を使用する。トランジ
スタのような、スイッチが、抵抗接続点において、並び
に抵抗−電位接続点において、中間タップを出力ノード
に接続する。デジタル的に符号化された信号は、どのス
イッチをオンするのかを決定するために復号化される。
出力ノードにおいて生成されたアナログ電圧の大きさ
は、どのスイッチがオンされるのかに依存してる。デジ
タル的に符号化された信号に対応するアナログ電圧を正
確に発生するためには、抵抗ストリングのレジスタンス
を同じレジスタンスとする必要がある。抵抗ストリング
内を同じレジスタンスとした場合でも、電圧駆動された
抵抗ストリングの基準電圧源に直列にノイズ電圧が励起
され、ＤＡＣが抵抗ストリング内の各抵抗の電圧、つま
り各中間タップにおける電圧を変化することから、出力
ノードにおけるアナログ電圧は不正確となってしまう。
中間タップにおけるノイズ電圧は同じではなく、このた
め出力ノードにおいて誤ったアナログ電圧が生成されて
しまう。
【０００３】
【課題を解決するための手段】本発明の例示的な実施の
形態によれば、集積回路は、抵抗ストリングが電流源に
よる駆動される、デジタル・アナログ変換器を含んでい
る。中間タップが、抵抗接続点および抵抗−電流源接続
点において規定されている。スイッチングトランジスタ
が出力ノードとそれぞれの中間タップとの間に接続され
ている。トランジスタを選択的に予め定められた状態に
切り換え、関連する中間タップを出力ノードに電気的に
接続するために、選択回路が各スイッチングトランジス
タの端子に接続されている。
【０００４】
【発明の実施の形態】本発明の例示的な実施の形態に係
るＤＡＣ１０の図式的な概要を図１に示した。ＤＡＣ１
０は、単一終端モード（ｓｉｎｇｌｅ−ｅｎｄｅｄ ｍ
ｏｄｅ）で動作して示されている。ＤＡＣ１０は、抵抗
ストリングに一定の電流を提供するために、抵抗ストリ
ングに接続された電流源を含んでいる。ＭＯＳトランジ
スタとして示された、スイッチは、中間タップを共通の
出力ノードに接続する。出猟ノードにおいて生成される
アナログ電圧の大きさは、どのスイッチがオンされるか
に依存する。出力は出力増幅器により増幅される。本発
明によるＤＡＣは、モノシリック集積回路の形で制作さ
れるのに適している。
【０００５】抵抗ストリング１４は、ユーザが決めた数
ｎの直列の抵抗Ｒ1 からＲn で構成される。抵抗ストリ
ングは電流源１２に接続され、これは、ＤＡＣ１０がデ
ジタル・アナログ変換器として使用されたときには、既
知の一定電流を抵抗ストリング１４に提供する。抵抗ス
トリングに含まれる抵抗のレジスタンス値は用途依存し
たものであり、また消費電力、抵抗ストリング間の電
位、並びに抵抗ストリングの抵抗の数のような種々のパ
ラメータに基づいて、当業者が用意に選択できるもので
ある。抵抗接続点においては、電流源−抵抗接続点と同
様に、スイッチが接続点と出力ノード１６との間に接続
されている。接続点は中間タップＴ1 からＴn+1 を規定
する。好ましくはトランジスタである、スイッチは、図
示した例ではＭＯＳトランジスタＭ1 からＭn+1 として
示されている。
【０００６】トランジスタＭ1 は電流源１２の正の端子
と抵抗Ｒ1 の接続点の間に接続されている。トランジス
タＭn+1 は、電流源１２の負の端子と抵抗Ｒn の接続点
の間に接続されている。トランジスタＭ2 からＭn は、
それぞれ中間タップＴ2 からＴn を、出力ノードにそれ
ぞれ接続する。トランジスタは典型的には同じであり、
導通状態では抵抗ストリング１４内の抵抗のレジスタン
スに比べて非常に大きいインピーダンスを有している。
出力増幅器１８は出力ノード１６において出力信号を増
幅し、また出力を、電圧出力から電流出力のような、他
の形式に変える。
【０００７】デジタル・アナログ変換器の技術において
知られているように、所望のアナログ信号の表示であ
る、デジタル的に符号化された信号６は、復号化回路に
提供される。復号化回路はデジタル的に符号化された信
号を復号化し、また関連した中間タップにおける電圧を
出力ノードに伝達するために駆動回路は適当なスイッチ
をオンする。単一のスイッチがオンされ、あるいは多数
のスイッチが同時にオン状態に切り換えられる。スイッ
チングトランジスタＭ1 からＭn+1 はスイッチングトラ
ンジスタ選択および駆動回路２により制御される。デジ
タル的に符号化された入力６を増大するための出力ノー
ド１６における階段の出力電圧を提供する、単調な入力
−出力特性が、中間タップＴ1 からＴn+1 に得られる。
【０００８】本発明によれば、電流源１２は抵抗ストリ
ング１４に一定の電流を供給する。中間タップの各１つ
を出力ノード１６に接続するために、トランジスタＭ1
からＭn+1 の１つまたはそれより多くが切り換えられ
る。トランジスタＭ1 からＭn+ 1 を選択的に切り換える
ことで、関連する中間タップにおける抵抗ストリング１
４内の電圧が、出力ノード１６に供給される。トランジ
スタＭ1 からＭn+1 の複数を選択的に切り換えることに
より、中間タップにおける電圧の中間の電圧が、出力ノ
ード１６に供給される。
【０００９】電流源１２内の固有の高インピーダンスに
より、電流源−抵抗ストリングのループ内で励起され
た、ノイズ電圧は電流を変えることはない。出力ノード
１６において生成された電圧は抵抗ストリング１４通過
する電流および抵抗ストリング１４内の抵抗のレジスタ
ンスだけに依存するため、出力ノード１６において生成
された電圧の精度はこのようなノイズ電圧の影響を受け
ることがない。
【００１０】電流駆動されたＤＡＣは差分モード（ｄｉ
ｆｆｅｒｅｎｔｉａｌ ｍｏｄｅ）においても同様に動
作する。差分モードのＤＡＣ１００の図式的な概要を図
２に例示した。抵抗ストリング１１４は例示的に２４の
抵抗を有しており、これにより２５の中間タップＴ1 か
らＴ25が規定される。中間にある中間タップは、グラン
ドのような基準電位に接続されている。ノイズがなくて
一定の電流が電流源１１２により供給され、中間他タッ
プＴ1 からＴ12は正の電圧で動作し、中間タップＴ13は
グランド電位に保持され、また中間タップＴ14からＴ25
は負の電圧で動作する。出力１１８にアナログ出力電圧
を供給することで、スイッチングトランジスタは、基準
電圧に接続された中間タップの回りに対称的にオンされ
る。ＤＡＣ１０とともに、単一のスイッチングトランジ
スタは、アナログ出力電圧を提供するためにオンされ、
ＤＡＣ１００とともにトランジスタは基準電圧に接続さ
れた中間タップの回りで対称的に対でオンされる。例え
ば、トランジスタＭ6 がオンされた場合には、トランジ
スタＭ20が同様にオンされる。出力１１８においてアナ
ログ出力電圧を提供するためにトランジスタＭ2 とＭ3
がオンされた場合には、トランジスタＭ24とＭ23が同様
にオンされる。差分モードＤＡＣ１００の抵抗ストリン
グ１１４の正と負の電圧側の多数のトランジスタは、本
明細書中に取り入れる「抵抗の数が減じられたデジタル
・アナログ変換器およびその使用方法」と題された米国
特許出願第０８／３２７１７４号の教示にしたがってオ
ンすることができる。
【００１１】抵抗ストリング１４の正の電圧側上で動作
するトランジスタＭ1 からＭ12の１つまたはそれより多
くをオンすることで、キャパシタＣ１が充電される。同
様に、抵抗ストリング１４の負の電圧側上で動作するト
ランジスタＭ14からＭ25の１つまたはそれより多くをオ
ンすることで、キャパシタＣ２が充電される。キャパシ
タの充電が完了したならば、スイッチ内の電流は零にな
る。よって、各スイッチの電圧降下も零になる。ＤＡＣ
の動作はスイッチの抵抗ないしスイッチの非線形性に影
響されない。よって、ＤＡＣ動作のためには電流が零に
減少するまでスイッチが閉じられていることが重要であ
る。
【００１２】抵抗ストリング１１４の正の電圧側上のス
イッチングトランジスタは、キャパシタＣ１とともにサ
ンプルホールド回路１２０を形成する。抵抗ストリング
１１４の負の電圧側上のスイッチングトランジスタは、
キャパシタＣ２とともにサンプルホールド回路１２２を
形成する。キャパシタの電圧は、差分増幅器１２４に正
と負の入力を提供するキャパシタ電圧はコモンモードの
ノイズを無くすために差分増幅器１２４により加えら
れ、この結果、差分増幅器１２４の出力１１８において
ノイズのないアナログ出力が得られる。
【００１３】図３は、図２に示した実施の形態と抵抗ス
トリング内の数が同じ抵抗および中間タップに接続され
た数が同じスイッチを使用し、アナログ出力への追加の
ビットを有するデジタル的に符号化された入力を変換す
ることができるＤＡＣ１１０の回路を図式的に示したも
のである。ＤＡＣ１１０はＤＡＣ１００よりも１つまた
はそれより多くのビットを有するデジタル的に符号化さ
れた信号を許容し、また２倍の数の離散したアナログ出
力を生成し、このアナログ出力は正と負の両方の範囲に
延在する。典型的には、デジタル的に符号化された入力
の範囲の中点は零アナログ出力い対応する。デジタル的
に符号化された入力の全ての範囲を出力に変換するため
の他の技術を使用することもできる。２つのレベルの復
号化が採用される。最下位ビットが信号の大きさを生成
するために復号化される。最上位ビットはどの抵抗の信
号がどのキャパシタに接続されるかを決定するために第
２段階で復号化される。
【００１４】本発明の例示的な実施の形態に係るデジタ
ル・アナログ変換器を組み込んだアナログ・デジタル変
換器２０を図４に示した。アナログ・デジタル変換器は
アナログ電流信号を対応するデジタル的に符号化された
信号に変換する。スイッチングトランジスタＭ1 からＭ
17は上記したようなあるいは他の公知の形態で構成され
る。アナログ・デジタル変換は２段階の手順で完了す
る。第１の段階では、電圧を発生するためにアナログ電
流が抵抗ストリングを通過する。全体の抵抗ストリング
で発生した電圧はサンプルホールド回路により保持され
る。第２段階では、逐次近似回路（ｓｕｃｃｅｓｉｖｅ
ａｐｐｒｏｘｉｍａｔｉｏｎ ｃｉｒｃｕｉｔｒｙ）
が一連の中間タップ電圧を、サンプルホールド回路によ
り保持された電圧により近似するように反復して発生す
る。逐次近似プロセスは、サンプルホールド回路により
保持された電圧のデジタル的な等価が決定されるまで継
続される。
【００１５】アナログ・デジタル変換器２００内では、
アナログ電流信号２０２が、トランジスタＭ30、Ｍ31、
およびＭ34がオン状態にまたトランジスタＭ32とＭ33が
オフ状態に切り換えられて、ライン２０１上に受信され
る。トランジスタＭ34は、電流源２１２により生成され
た電流をグランドに落とす。抵抗ストリング２１４で発
生した電圧はキャパシタ２０３を充電し、また正の入力
を比較器２０４に提供する。トランジスタＭ30、Ｍ31、
およびＭ34は次いでオフ状態に切り換えられ、またトラ
ンジスタＭ32とＭ33はオン状態に切り換えられる。トラ
ンジスタＭ33はアナログ電流信号２０２をグランドに落
とす。トランジスタＭ30、Ｍ31、Ｍ32、Ｍ33、およびＭ
34は、キャパシタ２０３とともに、抵抗ストリング２１
４で発生した電圧を比較器２０４への正の入力として保
持する、サンプルホールド回路を構成する。逐次近似回
路２０６は最初に適当なスイッチングトランジスタＭ1
からＭ17をオンし、出力ノード３１４に抵抗ストリング
２１４の中間点電圧を生成する。出力ノード３１４にお
ける電圧は、比較時２０４に負の入力として供給され、
ここでキャパシタ２０３上で保持された電圧と比較され
る。キャパシタ２０３上に保持された電圧と電流逐次近
似反復により出力ノード３１４において発生した電圧の
差を表す、比較器２０４からの出力２３２が正である場
合には、抵抗ストリング２１４の上半分の中間点が比較
器２０４への入力として電気的に接続されまたキャパシ
タ２０３に保持された電圧と比較される。出力２３２が
負である場合には、抵抗ストリング２１４の下半分の中
間点が比較器２０４への入力として電気的に接続され
る。オンに切り換えられるスイッチングトランジスタの
選択は、上記したように、逐次近似回路２０６により制
御される。仮のビットパターンから開始して、各反復は
２進ないし他の符号方式における表示２３４の１ビット
を決定し、また逐次近似プロセスは全てのビットが決定
されるまで継続される。逐次近似プロセスは当業者には
公知であり、上記したあるいはいずれかの公知の方法に
より構成される。２進の表示２３４は逐次近似回路２０
６およびアナログ・デジタル変換器２００の出力として
供給される。
【００１６】本発明は特に通信システムおよびデジタル
・アナログおよびアナログ・デジタル変換器用途におい
て集積回路を採用する装置に有用である。そして、この
ような通信システムや装置を、変換器の抵抗ストリング
において励起されるノイズを受けないようにすることが
できる。
【００１７】図４に示したアナログ・デジタル変換器は
単一終端モードで動作するものとして示したが、当業者
であれば差分モードで動作するアナログ・デジタル変換
器を構成することは容易である。
【図面の簡単な説明】
【図１】本発明の例示的な実施の形態に係る、単一終端
モードのデジタル・アナログ変換器の図式的な概要の説
明図である。
【図２】本発明の例示的な実施の形態に係る、差分モー
ドのデジタル・アナログ変換器の図式的な概要の説明図
である。
【図３】追加の精度のビットを達成することができる、
差分モードのアナログ・デジタル変換器の図式的な概要
の説明図である。
【図４】アナログ・デジタル変換器の図式的な概要の説
明図である。
【符号の説明】
１０ ＤＡＣ １２ 電流源 １４ 抵抗ストリング
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ザヤムクランガラ ラマスワミー ヴィス ワナザン アメリカ合衆国 19529 ペンシルヴァニ ア，ケンプトン，ボックス 149イー，ア ールデーナンバー１

Claims (11)

    【特許請求の範囲】
  1. 【請求項１】 出力ノードにおいてアナログ出力を提供
    するためのデジタル・アナログ変換器を含む集積回路に
    おいて、 正の端子と負の端子を有する電流源（例えば、１２、１
    １２、２１２）、 電流源の正と負の端子に接続された抵抗ストリング（例
    えば、１４、１１４、２１４）であり、抵抗ストリング
    は複数の直列に接続された抵抗（例えば、Ｒ1−Ｒn ；
    Ｒ1 −Ｒ24；Ｒ1 −Ｒ16）からなり、電流パスを提供
    し、 抵抗ストリング内の抵抗の接続点および抵抗ストリング
    と電流源の正と負の端子の接続点において規定された中
    間タップ（例えばＴ1 −Ｔn+1 ；Ｔ1 −Ｔ25；Ｔ1 −Ｔ
    17）、 複数のスイッチングトランジスタ（例えば、Ｍ1 −Ｍ
    n+1 ；Ｍ1 −Ｍ25；Ｍ1−Ｍ17）であり、各スイッチン
    グトランジスタは出力ノード（例えば、１６、１１８、
    ２３２）とそれぞれの中間タップの間に接続され、並び
    にトランジスタを予め定めら得た状態に選択的に切り換
    えるために各スイッチングトランジスタの端子に接続さ
    れた選択回路（例えば、２、２０６）であり、これによ
    り対応するスイッチングトランジスタが予め定められた
    状態に切り換えられたときには中間タップ（例えばＴ1
    −Ｔn+1 ；Ｔ1 −Ｔ25；Ｔ1 −Ｔ17）が出力ノード（例
    えば、１６、１１８、２３２）に接続される、ことから
    なる集積回路。
  2. 【請求項２】 ただ１つのスイッチングトランジスタ
    （例えば、Ｍ1 −Ｍn+ 1 ；Ｍ1 −Ｍ25；Ｍ1 −Ｍ17）
    が、一度に予め定められた状態に切り換えることができ
    る、請求項１記載の集積回路。
  3. 【請求項３】 少なくとも２つのスイッチングトランジ
    スタ（例えば、Ｍ1−Ｍn+1 ；Ｍ1 −Ｍ25；Ｍ1 −
    Ｍ17）が、同時に予め定められた状態に切り換えること
    ができる、請求項１記載の集積回路。
  4. 【請求項４】 デジタル・アナログ変換器が単一の終端
    モードで動作する、請求項１記載の集積回路。
  5. 【請求項５】 アナログ出力を提供するための集積回路
    において、 正の端子と負の端子を有する電流源（例えば、１２、１
    １２、２１２）、 電流源の正と負の端子に接続された抵抗ストリング（例
    えば、１４、１１４、２１４）であり、抵抗ストリング
    は複数の直列に接続された抵抗（例えば、Ｒ1−Ｒn ；
    Ｒ1 −Ｒ24；Ｒ1 −Ｒ16）からなり、電流パスを提供
    し、 抵抗ストリング内の抵抗の接続点において、および抵抗
    ストリングと電流源の正と負の端子の接続点において規
    定された中間タップ（例えばＴ1 −Ｔn+1 ；Ｔ1 −
    Ｔ25；Ｔ1 −Ｔ17）であり、中間タップの１つ（例え
    ば、Ｔ13）が基準電位に接続され、前記１つの中間タッ
    プが他の中間タップを、前記１つの中間タップと電流源
    の正の端子の間における第１のグループの中間タップ
    （例えば、Ｔ1 −Ｔ12）と、前記１つの中間タップ（例
    えば、Ｔ13）と電流源の負の端子の間における第２のグ
    ループの中間タップ（例えば、Ｔ14−Ｔ25）に分割し、 第１のノードと、第１のグループの中間タップのそれぞ
    れの中間タップの間に接続された第１の複数のスイッチ
    ングトランジスタ（例えば、Ｍ1 からＭ12）、 第２のノードと、第２のグループの中間タップのそれぞ
    れの中間タップの間に接続された第２の複数のスイッチ
    ングトランジスタ（例えば、Ｍ14からＭ25）、 第１および第２の入力ポートおよび出力ポートを有する
    差動増幅器（例えば、１２４）であり、差動増幅器の第
    １の入力ポートは第１の出力ノードにこれから信号を受
    信するために接続され、差動増幅器の第２の入力ポート
    は第２の出力ノードにこれから信号を受信するために接
    続され、差動増幅器はその出力ポート（例えば、１１
    ８）においてその第１および第２の入力ポートにおいて
    受信した信号の差である信号を提供し、これによりコモ
    ンモードノイズが差動増幅器の出力において生成された
    アナログ信号から排除される、集積回路。
  6. 【請求項６】 第１および第２の複数のトランジスタ内
    の各スイッチングトランジスタの端子に接続された選択
    回路（例えば、２０６）を有し、選択回路はトランジス
    タの選択された１つの状態をデジタル的に符号化された
    信号に応答して予め定められた状態に切り換えるための
    ものである、請求項５記載の集積回路。
  7. 【請求項７】 変換器が差分モードで動作する、請求項
    ５記載の集積回路。
  8. 【請求項８】 選択回路（例えば、２、２０６）が、少
    なくとも２つのスイッチングトランジスタを予め定めれ
    た状態に同時に切り換えることができる、請求項５記載
    の集積回路。
  9. 【請求項９】 少なくとも２つのスイッチングトランジ
    スタの１つが、第１の複数のスイッチングトランジスタ
    （例えば、Ｍ1 からＭ12）であり、また少なくとも２つ
    のスイッチングトランジスタの他の１つが、第２の複数
    のスイッチングトランジスタ（例えば、Ｍ14からＭ25）
    である、請求項８記載の集積回路。
  10. 【請求項１０】 アナログ信号のデジタル表示を発生す
    るためのアナログ・デジタル変換器を含む集積回路にお
    いて、 正の端子と負の端子を有する電流源（例えば、１２、１
    １２、２１２）、 電流パスを提供する抵抗ストリング（例えば、２１４）
    であり、抵抗ストリングは複数の直列に接続された抵抗
    （例えば、Ｒ1 −Ｒ16）からなり、抵抗ストリングは電
    流源の正と負の端子に接続されており、 抵抗ストリング内の抵抗の接続点および抵抗ストリング
    と電流源の正と負の端子の接続点において規定された中
    間タップ（例えばＴ1 −Ｔ17）、 複数のスイッチングトランジスタ（例えば、Ｍ1 −
    Ｍ17）であり、各スイッチングトランジスタは出力ノー
    ド（例えば、３１４）とそれぞれの中間タップの間に接
    続され、 第１および第２の入力リード並びに出力ポート（例えば
    ２３２）を有する比較器（例えば、２０４）であり、第
    １の入力リードは発生したアナログ信号を受信するため
    に出力ノード（例えば、３１４）に接続され、第２の入
    力リードはアナログ信号を受信するために接続され、比
    較器はその出力ポート（例えば、２３２）において、そ
    の第１および第２の入力リードにおいて受信した信号の
    間の差である差の信号を提供し、 逐次近似スイッチングトランジスタ選択および駆動回路
    （例えば、２０６）であり、逐次近似回路は比較器から
    の差の出力を受信し、抵抗ストリングが電流源により励
    起されたときに発生されたアナログ信号を生成するため
    に、逐次近似回路はスイッチングトランジスタを予め定
    められた状態に選択的にスイッチングするために複数の
    スイッチングトランジスタのそれぞれの端子に接続され
    ており、逐次近似回路はアナログ信号を逐次近似してそ
    のデジタル的な表示を出力として生成する、集積回路。
  11. 【請求項１１】 変換器が単一終端モードで動作する、
    請求項１０記載の集積回路。
JP7271665A 1994-10-21 1995-10-20 電流源により駆動された変換器 Pending JPH08213911A (ja)

Applications Claiming Priority (2)

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