JPH08293524A - 半導体装置およびその製造方法 - Google Patents
半導体装置およびその製造方法Info
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】
【構成】 本発明の半導体装置は、中央が凹状に所定深
さにザグリ加工された外囲器3と、外囲器の凹状部内に
配列された複数のパッド5と、外囲器の凹状部内に、素
子領域が第1のパッドの列に対向するよう配置され、第
1のパッドに金属ボール12を介して電気的に接続され
た第2のパッド1を有する半導体チップ6と、半導体チ
ップ6を完全に覆うよう凹状部内に流し込まれたポッテ
ィング部材2とを具備する。 【効果】 本発明を用いることにより、外囲器の外形寸
法の縮小、製造工程削減、及びポッティング剤の未充填
防止による信頼性の向上等の効果が得られる。
さにザグリ加工された外囲器3と、外囲器の凹状部内に
配列された複数のパッド5と、外囲器の凹状部内に、素
子領域が第1のパッドの列に対向するよう配置され、第
1のパッドに金属ボール12を介して電気的に接続され
た第2のパッド1を有する半導体チップ6と、半導体チ
ップ6を完全に覆うよう凹状部内に流し込まれたポッテ
ィング部材2とを具備する。 【効果】 本発明を用いることにより、外囲器の外形寸
法の縮小、製造工程削減、及びポッティング剤の未充填
防止による信頼性の向上等の効果が得られる。
Description
【0001】
【産業上の利用分野】本発明は半導体装置及びその製造
方法に関する。特に、高密度化、高集積化に有利な半導
体装置の外囲器に関する。
方法に関する。特に、高密度化、高集積化に有利な半導
体装置の外囲器に関する。
【0002】
【従来の技術】従来より半導体装置の外囲器として金属
リードフレームを有するSOP,SOJ等が存在する
が、このような構造は実際の半導体素子よりも外形寸法
が大きくなりがちであり、高密度化、高集積化の妨げに
なっていた。さらに、前述の半導体装置をプリント配線
板に実装した際、半導体装置に用いられているモールド
樹脂および金属リードフレームとプリント配線板の熱膨
張係数の違いから、長期にわたる高温/低温の温度サイ
クルが加わった場合に生じる応力により、半田接合部に
クラックが発生し電気的導通が保てなくなる。
リードフレームを有するSOP,SOJ等が存在する
が、このような構造は実際の半導体素子よりも外形寸法
が大きくなりがちであり、高密度化、高集積化の妨げに
なっていた。さらに、前述の半導体装置をプリント配線
板に実装した際、半導体装置に用いられているモールド
樹脂および金属リードフレームとプリント配線板の熱膨
張係数の違いから、長期にわたる高温/低温の温度サイ
クルが加わった場合に生じる応力により、半田接合部に
クラックが発生し電気的導通が保てなくなる。
【0003】一方、高密度化、高集積化という点から
は、半導体素子を直接プリント配線板に実装するフリッ
プチップやCOBといった構造が用いられている。しか
しながら、このような構造は半導体素子を直接プリント
配線板に実装しているため、樹脂封止型半導体装置と比
較すると機械的衝撃に弱く、製造装置や技術を新たに導
入する必要がある。
は、半導体素子を直接プリント配線板に実装するフリッ
プチップやCOBといった構造が用いられている。しか
しながら、このような構造は半導体素子を直接プリント
配線板に実装しているため、樹脂封止型半導体装置と比
較すると機械的衝撃に弱く、製造装置や技術を新たに導
入する必要がある。
【0004】従来は、半田接合部クラック対策として半
導体素子を保護する材料をモールド樹脂ではなく、プリ
ント配線板と同一材料であるガラスエポキシ材を用いる
ことで熱膨張係数の違いをなくしていた。さらに半導体
装置と外部との電気接触を金属リードフレームではな
く、図4(a)における半導体素子の構造の平面図に示
すように半導体装置側面に半円柱状の金属接触部10を
設けることにより可能にしていた。また、図4の素子
は、高密度化、高集積化という点で、金属接触部10を
通じて複数の半導体装置を積み重ねて接合することがで
き多段実装を可能としている。
導体素子を保護する材料をモールド樹脂ではなく、プリ
ント配線板と同一材料であるガラスエポキシ材を用いる
ことで熱膨張係数の違いをなくしていた。さらに半導体
装置と外部との電気接触を金属リードフレームではな
く、図4(a)における半導体素子の構造の平面図に示
すように半導体装置側面に半円柱状の金属接触部10を
設けることにより可能にしていた。また、図4の素子
は、高密度化、高集積化という点で、金属接触部10を
通じて複数の半導体装置を積み重ねて接合することがで
き多段実装を可能としている。
【0005】図4(b)は図4(a)のA−A’線にて
断面をとった図であり、ザグリ加工を施し、ボンディン
グパット5を設けたガラスエポキシ材3にマウント剤7
を介して半導体素子6と物理的に接続し、半導体素子6
上のコンタクトパッド1とボンディングパット5を金線
4にて電気的に接続している。さらに、半導体素子6の
外部との接触を防ぐためにポッティング剤2で封止して
いる。また、ポッティング剤2で封止後の電気的導通確
認のために、ガラスエポキシ材3に導通確認用パッド1
1を設けている。
断面をとった図であり、ザグリ加工を施し、ボンディン
グパット5を設けたガラスエポキシ材3にマウント剤7
を介して半導体素子6と物理的に接続し、半導体素子6
上のコンタクトパッド1とボンディングパット5を金線
4にて電気的に接続している。さらに、半導体素子6の
外部との接触を防ぐためにポッティング剤2で封止して
いる。また、ポッティング剤2で封止後の電気的導通確
認のために、ガラスエポキシ材3に導通確認用パッド1
1を設けている。
【0006】従来技術による樹脂封止型半導体装置の製
作工程を図5(a),(b),(c),(d),
(e),(f)にて説明する。断面図は、図4(a)の
A−A’線にて断面をとったものである。図5(a)は
ザグリ加工を施し、ボンディングパッド5および電気接
続確認用パッド11を設けたガラスエポキシ材3にマウ
ント剤7を塗布し、マウント剤7上に半導体素子6を載
せる工程を表している。図5(b)はマウント剤7上に
載せた半導体素子6を固定させるために、加熱してマウ
ント剤を硬化させる工程を表している。図5(c)は半
導体素子6上の各コンタクトパッド1と各ボンディング
パッド5を金線4にて電気的に接続する工程を表してい
る。図5(d),(e),(f)は半導体素子を外部接
触から保護するために、ポッティング剤2の塗布後低圧
中にて脱泡し、加熱して硬化させる工程を表している。
作工程を図5(a),(b),(c),(d),
(e),(f)にて説明する。断面図は、図4(a)の
A−A’線にて断面をとったものである。図5(a)は
ザグリ加工を施し、ボンディングパッド5および電気接
続確認用パッド11を設けたガラスエポキシ材3にマウ
ント剤7を塗布し、マウント剤7上に半導体素子6を載
せる工程を表している。図5(b)はマウント剤7上に
載せた半導体素子6を固定させるために、加熱してマウ
ント剤を硬化させる工程を表している。図5(c)は半
導体素子6上の各コンタクトパッド1と各ボンディング
パッド5を金線4にて電気的に接続する工程を表してい
る。図5(d),(e),(f)は半導体素子を外部接
触から保護するために、ポッティング剤2の塗布後低圧
中にて脱泡し、加熱して硬化させる工程を表している。
【0007】しかし、上述したような半導体素子の外囲
器構造は以下の様な問題点を有していた。第一に図4
(b)に示すようにガラスエポキシ材3と半導体素子6
の電気的接合に金線4を用いていることである。金線4
にて電気的接合を行う場合、必ずガラスエポキシ材3上
に半導体素子6の外形寸法よりも外側にボンディングパ
ッド5を形成する必要がある。これは樹脂封止型半導体
装置の外形寸法が大きくなるため、高密度化、高集積化
という点において問題となる。
器構造は以下の様な問題点を有していた。第一に図4
(b)に示すようにガラスエポキシ材3と半導体素子6
の電気的接合に金線4を用いていることである。金線4
にて電気的接合を行う場合、必ずガラスエポキシ材3上
に半導体素子6の外形寸法よりも外側にボンディングパ
ッド5を形成する必要がある。これは樹脂封止型半導体
装置の外形寸法が大きくなるため、高密度化、高集積化
という点において問題となる。
【0008】第二に図5(a),(b),(c)に示す
ように金線4による電気的接合とガラスエポキシ材3へ
の半導体素子6の接着にマウント剤7を使用しているた
め製造工程が増加する。これは製造コスト上昇につなが
る。
ように金線4による電気的接合とガラスエポキシ材3へ
の半導体素子6の接着にマウント剤7を使用しているた
め製造工程が増加する。これは製造コスト上昇につなが
る。
【0009】
【発明が解決しようとする課題】上記したように、従来
の半導体装置は、外形寸法が比較的大きくなる、製造工
程数が増大する等の問題点が存在した。本発明は上記欠
点を除去し外形寸法が比較的小さく、製造工程数を削減
することにより製造コストを低減した半導体装置及びそ
の製造方法を提供することを目的とする。
の半導体装置は、外形寸法が比較的大きくなる、製造工
程数が増大する等の問題点が存在した。本発明は上記欠
点を除去し外形寸法が比較的小さく、製造工程数を削減
することにより製造コストを低減した半導体装置及びそ
の製造方法を提供することを目的とする。
【0010】
【課題を解決するための手段】上記目的を達成するため
に、本発明では、中央が凹状に所定深さにザグリ加工さ
れた外囲器と、外囲器の凹状部内に配列された複数の第
1のパッドと、外囲器の凹状部内に、素子領域が前記第
1のパッドの列に対向するよう配置され、第1のパッド
に金属ボールを介して電気的に接続された第2のパッド
を有する半導体チップと、半導体チップを完全に覆うよ
う凹状部内に流し込まれたポッティング部材とを具備す
ることを特徴とする半導体装置を提供する。
に、本発明では、中央が凹状に所定深さにザグリ加工さ
れた外囲器と、外囲器の凹状部内に配列された複数の第
1のパッドと、外囲器の凹状部内に、素子領域が前記第
1のパッドの列に対向するよう配置され、第1のパッド
に金属ボールを介して電気的に接続された第2のパッド
を有する半導体チップと、半導体チップを完全に覆うよ
う凹状部内に流し込まれたポッティング部材とを具備す
ることを特徴とする半導体装置を提供する。
【0011】この半導体装置の外囲器はガラスエポキシ
材により構成されている。この様な半導体装置の製造方
法として、本発明においては、中央が凹状に所定深さに
ザグリ加工されこの凹状部内に複数のパッドが形成され
た外囲器の凹状部内に、半導体チップをこの素子領域が
パッドの列に対向するよう配置しつつ、パッドに金属ボ
ールを介して電気的に接続する工程と、凹状部内にポッ
ティング部材を流し込むとともに外囲器の中央に形成さ
れた貫通穴より吸引することにより半導体チップをポッ
ティング部材で完全に覆う工程とを具備する半導体装置
の製造方法を提供する。
材により構成されている。この様な半導体装置の製造方
法として、本発明においては、中央が凹状に所定深さに
ザグリ加工されこの凹状部内に複数のパッドが形成され
た外囲器の凹状部内に、半導体チップをこの素子領域が
パッドの列に対向するよう配置しつつ、パッドに金属ボ
ールを介して電気的に接続する工程と、凹状部内にポッ
ティング部材を流し込むとともに外囲器の中央に形成さ
れた貫通穴より吸引することにより半導体チップをポッ
ティング部材で完全に覆う工程とを具備する半導体装置
の製造方法を提供する。
【0012】より詳細には、ガラスエポキシ板をこの中
央が凹状に所定深さになるようザグリ加工することによ
り外囲器を形成し、外囲器の凹状部内に複数のパッドを
形成する工程と、外囲器の凹状部内に所定高さの絶縁部
材を配置する工程と、半導体チップの複数のコンタクト
パッド上に金属ボールを配置する工程と、絶縁部材上に
半導体チップを載せつつ、複数のパッドとコンタクトパ
ッドとを互いに対向させ、金属ボールを介して電気的に
接続する工程と、凹状部内にポッティング部材を流し込
むとともに外囲器の中央に形成された貫通穴より吸引す
ることにより半導体チップをポッティング部材で完全に
覆う工程とを具備する半導体装置の製造方法を提供す
る。
央が凹状に所定深さになるようザグリ加工することによ
り外囲器を形成し、外囲器の凹状部内に複数のパッドを
形成する工程と、外囲器の凹状部内に所定高さの絶縁部
材を配置する工程と、半導体チップの複数のコンタクト
パッド上に金属ボールを配置する工程と、絶縁部材上に
半導体チップを載せつつ、複数のパッドとコンタクトパ
ッドとを互いに対向させ、金属ボールを介して電気的に
接続する工程と、凹状部内にポッティング部材を流し込
むとともに外囲器の中央に形成された貫通穴より吸引す
ることにより半導体チップをポッティング部材で完全に
覆う工程とを具備する半導体装置の製造方法を提供す
る。
【0013】
【作用】本発明で提供する手段を用いることにより、第
1のパッドを半導体チップの直下に形成することがで
き、これが半導体装置の外形寸法を小さくする一助とな
っている。また、ボンディングワイヤを用いないため、
外囲器の高さを低くすることができる。これらはみな、
半導体装置の高密度化、高集積化に好適である。
1のパッドを半導体チップの直下に形成することがで
き、これが半導体装置の外形寸法を小さくする一助とな
っている。また、ボンディングワイヤを用いないため、
外囲器の高さを低くすることができる。これらはみな、
半導体装置の高密度化、高集積化に好適である。
【0014】さらに、本発明は、金属ボールを用いて一
括したボンディングが可能となり、同時に絶縁部材によ
り半導体チップと外囲器との接着を行うため、製造工程
の削減、つまり製造コストの削減につながる。
括したボンディングが可能となり、同時に絶縁部材によ
り半導体チップと外囲器との接着を行うため、製造工程
の削減、つまり製造コストの削減につながる。
【0015】
【実施例】本発明における実施例の平面図を図1(a)
に示す。本発明における樹脂封止型半導体装置は、ザグ
リ加工を施したガラスエポキシ材料3上に半導体素子6
のコンタクトパッドと同一位置にボンディングパッド5
を設け、このボンディングパッド5の内側に半導体素子
6を接着するための絶縁接着テープ8を貼付けており、
さらに、半導体装置6を保護するためにポッティング剤
2を塗布した際に、ポッティング剤2が半導体素子6全
体を覆うことができるようにガラスエポキシ材3の底部
中央に吸引口9を有する構造となっている。
に示す。本発明における樹脂封止型半導体装置は、ザグ
リ加工を施したガラスエポキシ材料3上に半導体素子6
のコンタクトパッドと同一位置にボンディングパッド5
を設け、このボンディングパッド5の内側に半導体素子
6を接着するための絶縁接着テープ8を貼付けており、
さらに、半導体装置6を保護するためにポッティング剤
2を塗布した際に、ポッティング剤2が半導体素子6全
体を覆うことができるようにガラスエポキシ材3の底部
中央に吸引口9を有する構造となっている。
【0016】図1(a)および図1(b)には吸引面積
を広く確保するために絶縁接着テープ8の内側に半導体
素子6の長辺方向よりも大きい凹部20を設けた構造が
示されている。
を広く確保するために絶縁接着テープ8の内側に半導体
素子6の長辺方向よりも大きい凹部20を設けた構造が
示されている。
【0017】次に、本発明における樹脂封止型半導体装
置の製造工程を図2(a),(b),(c),(d),
(e)を用いて説明する。断面図は、図1(a)のB−
B’線でとったものである。図2(a)は、ザグリ加工
と底部中央部に吸引口9を施し、ボンディングパッド5
および電気接続確認用パッド11、さらに半導体素子6
接着のための絶縁接着テープ8を貼付けたガラスエポキ
シ材3に、球状金属12をコンタクトパッド1に取り付
けた半導体素子6を載せる工程を表している。図2
(b)は、ガラスエポキシ材3と半導体素子6の電気的
接合と絶縁接着テープ8の硬化を加熱することによって
同時に行う工程を表している。
置の製造工程を図2(a),(b),(c),(d),
(e)を用いて説明する。断面図は、図1(a)のB−
B’線でとったものである。図2(a)は、ザグリ加工
と底部中央部に吸引口9を施し、ボンディングパッド5
および電気接続確認用パッド11、さらに半導体素子6
接着のための絶縁接着テープ8を貼付けたガラスエポキ
シ材3に、球状金属12をコンタクトパッド1に取り付
けた半導体素子6を載せる工程を表している。図2
(b)は、ガラスエポキシ材3と半導体素子6の電気的
接合と絶縁接着テープ8の硬化を加熱することによって
同時に行う工程を表している。
【0018】図2(c),(d),(e)は、半導体素
子6を外部接触等から保護するためにポッティング剤2
を塗布し、同時に吸引口9から吸引することで半導体素
子6全体を覆い、脱泡、加熱して硬化させる工程を表し
ている。
子6を外部接触等から保護するためにポッティング剤2
を塗布し、同時に吸引口9から吸引することで半導体素
子6全体を覆い、脱泡、加熱して硬化させる工程を表し
ている。
【0019】従来技術では、図4(b)に示すようにガ
ラスエポキシ材3と半導体素子6の電気的接合に金線4
を用いていたため、半導体素子6よりも外側にボンディ
ングパッド5を形成しなければならず、半導体装置の外
形寸法が大きくなっていた。
ラスエポキシ材3と半導体素子6の電気的接合に金線4
を用いていたため、半導体素子6よりも外側にボンディ
ングパッド5を形成しなければならず、半導体装置の外
形寸法が大きくなっていた。
【0020】しかしながら、本発明においては図1
(b)に示すように電気的接合に球状金属12を用いる
ことにより、ボンディングパッド5を半導体素子6の下
部に形成することができるようになり、図3に示すよう
に半導体装置の外形寸法を従来技術より小さくできる。
さらに、電気的接合を球状金属12にすることで電気的
接触部の高さをボンディングのループ高さから球状金属
12の直径に置き換えることができ半導体装置の厚さを
薄くすることが可能となる。このことは、従来技術より
も半導体装置の高密度化、高集積化につなげることを示
唆している。
(b)に示すように電気的接合に球状金属12を用いる
ことにより、ボンディングパッド5を半導体素子6の下
部に形成することができるようになり、図3に示すよう
に半導体装置の外形寸法を従来技術より小さくできる。
さらに、電気的接合を球状金属12にすることで電気的
接触部の高さをボンディングのループ高さから球状金属
12の直径に置き換えることができ半導体装置の厚さを
薄くすることが可能となる。このことは、従来技術より
も半導体装置の高密度化、高集積化につなげることを示
唆している。
【0021】さらに、金線4による電気接合では各コン
タクトパッド1をそれぞれ接合しなければならないが、
球状金属12を用いることにより一括した接合が可能と
なり、同時に図2(b)に示すように絶縁接着テープ8
による半導体素子6の接着も行うことができるため、製
造工程の削減、つまり製造コストの削減をすることがで
きる。
タクトパッド1をそれぞれ接合しなければならないが、
球状金属12を用いることにより一括した接合が可能と
なり、同時に図2(b)に示すように絶縁接着テープ8
による半導体素子6の接着も行うことができるため、製
造工程の削減、つまり製造コストの削減をすることがで
きる。
【0022】一方、前述したように電気的接触部の高さ
を球状金属12で置き換えるため、ガラスエポキシ材3
下部と半導体素子の間が非常に狭くなりポッティング剤
2が入りづらくなる。しかしながら、図1(a)に示す
ように、本発明の半導体装置はガラスエポキシ材3の底
部中央吸引口9と吸引面積を広く確保するために絶縁接
着テープ8の内側に半導体素子6の長辺方向よりも大き
い凹部20を設けた構造をとっている。そのため、図2
(c)に示すように、ポッティング剤2を塗布すると同
時に吸引口9から吸引することにより、ガラスエポキシ
材3下部と半導体素子6との間にポッティング剤2を引
き込むことができ半導体素子6を完全に覆うことが可能
となる。この時、吸引口9からポッティング剤2がはみ
出すことが懸念されるが、ポッティング剤2の粘度や吸
引力、吸引時間等の条件を考慮することにより、はみ出
しを防止することは可能である。
を球状金属12で置き換えるため、ガラスエポキシ材3
下部と半導体素子の間が非常に狭くなりポッティング剤
2が入りづらくなる。しかしながら、図1(a)に示す
ように、本発明の半導体装置はガラスエポキシ材3の底
部中央吸引口9と吸引面積を広く確保するために絶縁接
着テープ8の内側に半導体素子6の長辺方向よりも大き
い凹部20を設けた構造をとっている。そのため、図2
(c)に示すように、ポッティング剤2を塗布すると同
時に吸引口9から吸引することにより、ガラスエポキシ
材3下部と半導体素子6との間にポッティング剤2を引
き込むことができ半導体素子6を完全に覆うことが可能
となる。この時、吸引口9からポッティング剤2がはみ
出すことが懸念されるが、ポッティング剤2の粘度や吸
引力、吸引時間等の条件を考慮することにより、はみ出
しを防止することは可能である。
【0023】以上、本発明を図1ないし図3を用いて説
明したが、本発明はこれに限られることはなく、本発明
の主旨を逸脱しない限り種々の変形が可能であることは
いうまでもない。
明したが、本発明はこれに限られることはなく、本発明
の主旨を逸脱しない限り種々の変形が可能であることは
いうまでもない。
【0024】
【発明の効果】以上説明したように、本発明によれば、
パッドを半導体チップの直下に形成することができ、こ
れが半導体装置の外形寸法を小さくする一助となってい
る。また、ボンディングワイヤを用いないため、外囲器
の高さを低くすることができる。これらはみな、半導体
装置の高密度化、高集積化に好適である。
パッドを半導体チップの直下に形成することができ、こ
れが半導体装置の外形寸法を小さくする一助となってい
る。また、ボンディングワイヤを用いないため、外囲器
の高さを低くすることができる。これらはみな、半導体
装置の高密度化、高集積化に好適である。
【0025】さらに、本発明は、金属ボールを用いて一
括したボンディングが可能となり、同時に絶縁部材によ
り半導体チップと外囲器との接着を行うため、製造工程
の削減、つまり製造コストの削減につながる。さらに、
ポッティング剤の未充填防止による信頼性の向上等の効
果も得られる。
括したボンディングが可能となり、同時に絶縁部材によ
り半導体チップと外囲器との接着を行うため、製造工程
の削減、つまり製造コストの削減につながる。さらに、
ポッティング剤の未充填防止による信頼性の向上等の効
果も得られる。
【図1】本発明の実施例を示した半導体装置の平面図及
び断面図である。
び断面図である。
【図2】本発明の実施例の製造工程を示した半導体装置
の断面図である。
の断面図である。
【図3】本発明と従来例の半導体装置を比較した断面図
である。
である。
【図4】従来の半導体装置の平面図及び断面図である。
【図5】従来の半導体装置の製造工程を示した断面図で
ある。
ある。
1 コンタクトパッド 2 ポッティング剤 3 ガラスエポキシ材 4 金線 5 ボンディングパッド 6 半導体素子 7 マウント剤 8 絶縁接着テープ 9 吸引口 10 金属接触部 11 導通確認用パッド 12 球状金属 20 吸引面積を確保するための凹部
Claims (5)
- 【請求項1】 中央が凹状に所定深さにザグリ加工され
た外囲器と、前記外囲器の凹状部内に配列された複数の
第1のパッドと、前記外囲器の凹状部内に、素子領域が
前記第1のパッドの列に対向するよう配置され、前記第
1のパッドに金属ボールを介して電気的に接続された第
2のパッドを有する半導体チップと、前記半導体チップ
を完全に覆うよう前記凹状部内に流し込まれたポッティ
ング部材とを具備することを特徴とする半導体装置。 - 【請求項2】 請求項1記載の半導体装置において、前
記外囲器はガラスエポキシ材により構成されていること
を特徴とする半導体装置。 - 【請求項3】 中央が凹状に所定深さにザグリ加工され
この凹状部内に複数のパッドが形成された外囲器の前記
凹状部内に、半導体チップをこの素子領域が前記パッド
の列に対向するよう配置しつつ、前記パッドに金属ボー
ルを介して電気的に接続する工程と、前記凹状部内にポ
ッティング部材を流し込むとともに前記外囲器の中央に
形成された貫通穴より吸引することにより前記半導体チ
ップを前記ポッティング部材で完全に覆う工程とを具備
する半導体装置の製造方法。 - 【請求項4】 ガラスエポキシ板をこの中央が凹状に所
定深さになるようザグリ加工することにより外囲器を形
成する工程と、前記外囲器の凹状部内に複数のパッドを
形成する工程と、前記外囲器の凹状部内に所定高さの絶
縁部材を配置する工程と、半導体チップの複数のコンタ
クトパッド上に金属ボールを配置する工程と、前記絶縁
部材上に前記半導体チップを載せつつ、前記複数のパッ
ドと前記コンタクトパッドとを互いに対向させ、前記金
属ボールを介して電気的に接続する工程と、前記凹状部
内にポッティング部材を流し込むとともに前記外囲器の
中央に形成された貫通穴より吸引することにより前記半
導体チップを前記ポッティング部材で完全に覆う工程と
を具備する半導体装置の製造方法。 - 【請求項5】 前記絶縁部材はポリイミドテープにより
構成されていることを特徴とする請求項4記載の半導体
装置の製造方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7096367A JPH08293524A (ja) | 1995-04-21 | 1995-04-21 | 半導体装置およびその製造方法 |
| TW085104384A TW390004B (en) | 1995-04-21 | 1996-04-12 | Device for storing semiconductor chip and method for making the same |
| US08/634,678 US5834835A (en) | 1995-04-21 | 1996-04-18 | Semiconductor device having an improved structure for storing a semiconductor chip |
| KR1019960011934A KR100200254B1 (ko) | 1995-04-21 | 1996-04-19 | 반도체 장치 및 그 제조 방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7096367A JPH08293524A (ja) | 1995-04-21 | 1995-04-21 | 半導体装置およびその製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08293524A true JPH08293524A (ja) | 1996-11-05 |
Family
ID=14163012
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7096367A Pending JPH08293524A (ja) | 1995-04-21 | 1995-04-21 | 半導体装置およびその製造方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5834835A (ja) |
| JP (1) | JPH08293524A (ja) |
| KR (1) | KR100200254B1 (ja) |
| TW (1) | TW390004B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN103050416A (zh) * | 2012-12-07 | 2013-04-17 | 中国电子科技集团公司第十一研究所 | 用于百万像素碲镉汞混成芯片的底部填充方法及装置 |
Families Citing this family (26)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPH05335183A (ja) * | 1992-05-28 | 1993-12-17 | Murata Mfg Co Ltd | 多層基板を備えた電子部品及びその製造方法 |
| FR2748156B1 (fr) * | 1996-04-26 | 1998-08-07 | Suisse Electronique Microtech | Dispositif comprenant deux substrats destines a former un microsysteme ou une partie d'un microsysteme et procede d'assemblage de deux substrats micro-usines |
| JPH1064956A (ja) * | 1996-08-20 | 1998-03-06 | Fujitsu Ltd | フェースダウンボンディング半導体装置 |
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| US6057175A (en) * | 1997-12-04 | 2000-05-02 | Medtronic, Inc. | Method of making encapsulated package |
| US6586829B1 (en) * | 1997-12-18 | 2003-07-01 | Si Diamond Technology, Inc. | Ball grid array package |
| US6150724A (en) * | 1998-03-02 | 2000-11-21 | Motorola, Inc. | Multi-chip semiconductor device and method for making the device by using multiple flip chip interfaces |
| JP3610787B2 (ja) * | 1998-03-24 | 2005-01-19 | セイコーエプソン株式会社 | 半導体チップの実装構造体、液晶装置及び電子機器 |
| GB2340996B (en) * | 1998-08-26 | 2003-07-09 | Lsi Logic Corp | Low skew signal distribution circuits |
| JP2000223657A (ja) * | 1999-02-03 | 2000-08-11 | Rohm Co Ltd | 半導体装置およびそれに用いる半導体チップ |
| JP2000260912A (ja) * | 1999-03-05 | 2000-09-22 | Fujitsu Ltd | 半導体装置の実装構造及び半導体装置の実装方法 |
| US6392289B1 (en) | 1999-04-15 | 2002-05-21 | Micron Technology, Inc. | Integrated circuit substrate having through hole markings to indicate defective/non-defective status of same |
| FR2805410B1 (fr) * | 2000-02-23 | 2002-09-06 | Andre Rene Georges Gennesseaux | Systeme autonome de cogeneration d'electricite et de chaleur comportant un stockage d'energie par volant d'inertie |
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| US7190060B1 (en) | 2002-01-09 | 2007-03-13 | Bridge Semiconductor Corporation | Three-dimensional stacked semiconductor package device with bent and flat leads and method of making same |
| US6936495B1 (en) | 2002-01-09 | 2005-08-30 | Bridge Semiconductor Corporation | Method of making an optoelectronic semiconductor package device |
| US6891276B1 (en) | 2002-01-09 | 2005-05-10 | Bridge Semiconductor Corporation | Semiconductor package device |
| KR100506035B1 (ko) * | 2003-08-22 | 2005-08-03 | 삼성전자주식회사 | 반도체 패키지 및 그 제조방법 |
| TWI241696B (en) * | 2004-11-26 | 2005-10-11 | Delta Electronics Inc | Chip package structure |
| US8138027B2 (en) * | 2008-03-07 | 2012-03-20 | Stats Chippac, Ltd. | Optical semiconductor device having pre-molded leadframe with window and method therefor |
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| CA2092165C (en) * | 1992-03-23 | 2001-05-15 | Tuyosi Nagano | Chip carrier for optical device |
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-
1995
- 1995-04-21 JP JP7096367A patent/JPH08293524A/ja active Pending
-
1996
- 1996-04-12 TW TW085104384A patent/TW390004B/zh not_active IP Right Cessation
- 1996-04-18 US US08/634,678 patent/US5834835A/en not_active Expired - Fee Related
- 1996-04-19 KR KR1019960011934A patent/KR100200254B1/ko not_active Expired - Fee Related
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| Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
| Publication number | Publication date |
|---|---|
| US5834835A (en) | 1998-11-10 |
| KR100200254B1 (ko) | 1999-06-15 |
| KR960039305A (ko) | 1996-11-25 |
| TW390004B (en) | 2000-05-11 |
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