JPH08293732A - 発振回路 - Google Patents
発振回路Info
- Publication number
- JPH08293732A JPH08293732A JP7095746A JP9574695A JPH08293732A JP H08293732 A JPH08293732 A JP H08293732A JP 7095746 A JP7095746 A JP 7095746A JP 9574695 A JP9574695 A JP 9574695A JP H08293732 A JPH08293732 A JP H08293732A
- Authority
- JP
- Japan
- Prior art keywords
- inverter
- feedback
- oscillation
- circuit
- oscillation circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Oscillators With Electromechanical Resonators (AREA)
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】
【目的】 帰還抵抗を選択することができ、発振周波数
安定化のためのＣＲ時定数の調整を容易に行え、また、
発振周波数を選択することができる発振回路を提供する
ことを目的とする。 【構成】 発振回路における発振回路接続端１０２、１
０３にコンデンサ１０４、１０５および発振子１０６を
接続する。制御装置１０７によってオン、オフ制御され
るスイッチング素子１０８、１０９のそれぞれに帰還抵
抗１１０、１１１を接続した直列回路をインバータ１１
２に並列に接続し、前記スイッチング素子１０８、１０
９をオン、オフ制御する制御装置１０７を設けた構成と
する。
安定化のためのＣＲ時定数の調整を容易に行え、また、
発振周波数を選択することができる発振回路を提供する
ことを目的とする。 【構成】 発振回路における発振回路接続端１０２、１
０３にコンデンサ１０４、１０５および発振子１０６を
接続する。制御装置１０７によってオン、オフ制御され
るスイッチング素子１０８、１０９のそれぞれに帰還抵
抗１１０、１１１を接続した直列回路をインバータ１１
２に並列に接続し、前記スイッチング素子１０８、１０
９をオン、オフ制御する制御装置１０７を設けた構成と
する。
Description
【０００１】
【産業上の利用分野】本発明は、半導体集積回路の発振
回路に関する。
回路に関する。
【０００２】
【従来の技術】以下に従来の半導体集積回路の発振回路
について説明する。図２は、従来の発振回路の構成を示
す。同図に示すように、半導体集積回路１はインバータ
７と、このインバータ７に並列に接続された帰還抵抗８
とで発振回路を構成し、その出力側にインバータ９を接
続している。前記発振回路接続端２、３と接地間にはそ
れぞれにコンデンサ４、５を接続し、また発振回路接続
端２、３間には発振子６を接続している。
について説明する。図２は、従来の発振回路の構成を示
す。同図に示すように、半導体集積回路１はインバータ
７と、このインバータ７に並列に接続された帰還抵抗８
とで発振回路を構成し、その出力側にインバータ９を接
続している。前記発振回路接続端２、３と接地間にはそ
れぞれにコンデンサ４、５を接続し、また発振回路接続
端２、３間には発振子６を接続している。
【０００３】以上のように構成された発振回路につい
て、以下その動作について説明する。前記インバータ７
と前記帰還抵抗８で構成されている発振回路の前記イン
バータ７の出力は、電源を投入したとき、必ず”出力＝
Ｈレベル”か”出力＝Ｌレベル”かになる。仮に”出力
＝Ｈレベル”になれば、前記帰還抵抗８を介して等価コ
ンデンサ（前記コンデンサ４、５の直列合成値とする）
に電荷を充電する。前記等価コンデンサが充電されてい
くと前記発振回路接続端２での電位は、前記インバータ
７のスレッショルド電圧を越え、前記インバータ７の出
力は反転する。また、前記帰還抵抗８を介して前記等価
コンデンサに蓄えられた電荷は放電し、前記インバータ
７の出力は再度反転する。したがって、充電と放電を繰
り返して発振を行い、前記インバータ９を介し信号を出
力する。
て、以下その動作について説明する。前記インバータ７
と前記帰還抵抗８で構成されている発振回路の前記イン
バータ７の出力は、電源を投入したとき、必ず”出力＝
Ｈレベル”か”出力＝Ｌレベル”かになる。仮に”出力
＝Ｈレベル”になれば、前記帰還抵抗８を介して等価コ
ンデンサ（前記コンデンサ４、５の直列合成値とする）
に電荷を充電する。前記等価コンデンサが充電されてい
くと前記発振回路接続端２での電位は、前記インバータ
７のスレッショルド電圧を越え、前記インバータ７の出
力は反転する。また、前記帰還抵抗８を介して前記等価
コンデンサに蓄えられた電荷は放電し、前記インバータ
７の出力は再度反転する。したがって、充電と放電を繰
り返して発振を行い、前記インバータ９を介し信号を出
力する。
【０００４】
【発明が解決しようとする課題】しかしながら上記従来
の発振回路の構成では、プロセス上や実装上でのバラツ
キによる発振周波数不安定時に、帰還抵抗８の抵抗値が
固定であるため、発振周波数安定化のためのＣＲ時定数
の調整を容易に行えないという問題や、発振周波数を選
択できないという問題があった。
の発振回路の構成では、プロセス上や実装上でのバラツ
キによる発振周波数不安定時に、帰還抵抗８の抵抗値が
固定であるため、発振周波数安定化のためのＣＲ時定数
の調整を容易に行えないという問題や、発振周波数を選
択できないという問題があった。
【０００５】本発明は、上記従来の問題を解決するもの
で、発振周波数を安定化できる発振回路を提供すること
を目的とする。
で、発振周波数を安定化できる発振回路を提供すること
を目的とする。
【０００６】
【課題を解決するための手段】この目的を達成するため
に本発明の発振回路は、発振回路におけるインバータに
複数の帰還抵抗を並列に接続し、前記帰還抵抗を制御す
る手段を備えた構成を有している。
に本発明の発振回路は、発振回路におけるインバータに
複数の帰還抵抗を並列に接続し、前記帰還抵抗を制御す
る手段を備えた構成を有している。
【０００７】
【作用】この構成によって、発振回路の帰還抵抗が制御
できるため、発振周波数安定化のためのＣＲ時定数の調
整を容易に行え、また、発振周波数を選択することがで
きることとなる。
できるため、発振周波数安定化のためのＣＲ時定数の調
整を容易に行え、また、発振周波数を選択することがで
きることとなる。
【０００８】
【実施例】以下、本発明の一実施例について図面を参照
しながら説明する。図１は、本発明の一実施例の発振回
路の構成を示すものである。図１に示すように、半導体
集積回路１０１におけるインバータ１１２の発振回路接
続端１０２、１０３と接地間にはそれぞれコンデンサ１
０４、１０５を接続するとともに、発振回路接続端１０
２、１０３間に発振子１０６を接続する。上記構成は前
述の従来例と同じであり、本実施例の特徴はつぎの構成
にある。すなわち、前記インバータ１１２に対し、スイ
ッチング素子１０８と帰還抵抗１１０の直列回路および
スイッチング素子１０９と帰還抵抗１１１の直列回路を
並列に接続し、前記スイッチング素子１０８、１０９に
制御装置１０７を接続した構成にある。図中の１１３は
信号取出し用のインバータである。なお本実施例では、
前記スイッチング素子１０８、１０９とそれぞれ直列に
接続された帰還抵抗１１０、１１１の２個だけの並列接
続としているが、スイッチング素子、帰還抵抗を２個以
上の複数個としてもよい。
しながら説明する。図１は、本発明の一実施例の発振回
路の構成を示すものである。図１に示すように、半導体
集積回路１０１におけるインバータ１１２の発振回路接
続端１０２、１０３と接地間にはそれぞれコンデンサ１
０４、１０５を接続するとともに、発振回路接続端１０
２、１０３間に発振子１０６を接続する。上記構成は前
述の従来例と同じであり、本実施例の特徴はつぎの構成
にある。すなわち、前記インバータ１１２に対し、スイ
ッチング素子１０８と帰還抵抗１１０の直列回路および
スイッチング素子１０９と帰還抵抗１１１の直列回路を
並列に接続し、前記スイッチング素子１０８、１０９に
制御装置１０７を接続した構成にある。図中の１１３は
信号取出し用のインバータである。なお本実施例では、
前記スイッチング素子１０８、１０９とそれぞれ直列に
接続された帰還抵抗１１０、１１１の２個だけの並列接
続としているが、スイッチング素子、帰還抵抗を２個以
上の複数個としてもよい。
【０００９】以上のように構成された発振回路につい
て、以下その動作を説明する。前記スイッチング素子１
０８、１０９のオン、オフ制御は、前記制御装置１０７
に入力される信号によって行われる。前記帰還抵抗１１
０、１１１は、それぞれに接続された前記スイッチング
素子１０８、１０９のオン、オフ制御により、抵抗値と
しては前記帰還抵抗１１０の抵抗値、または前記抵抗１
１１の抵抗値、または前記帰還抵抗１１０と前記帰還抵
抗１１１との並列接続抵抗値となる。
て、以下その動作を説明する。前記スイッチング素子１
０８、１０９のオン、オフ制御は、前記制御装置１０７
に入力される信号によって行われる。前記帰還抵抗１１
０、１１１は、それぞれに接続された前記スイッチング
素子１０８、１０９のオン、オフ制御により、抵抗値と
しては前記帰還抵抗１１０の抵抗値、または前記抵抗１
１１の抵抗値、または前記帰還抵抗１１０と前記帰還抵
抗１１１との並列接続抵抗値となる。
【００１０】前記帰還抵抗１１０、１１１と前記インバ
ータ１１２で構成されている発振回路の前記インバータ
１１２の出力は、電源を投入したとき、必ず”出力＝Ｈ
レベル”か”出力＝Ｌレベル”かになる。仮に”出力＝
Ｈレベル”になれば、前記制御装置１０７によって制御
された前記帰還抵抗１１０、１１１を介して等価コンデ
ンサ（前記コンデンサ１０４、１０５の直列合成値とす
る）に電荷を充電する。前記等価コンデンサが充電され
ていくと、前記発振回路接続端１０２での電位は、前記
インバータ１１２のスレッショルド電圧を越え、前記イ
ンバータ１１２の出力は反転する。また、前記制御装置
１０７によって制御された前記帰還抵抗１１０、１１１
を介して前記等価コンデンサに蓄えられた電荷は放電
し、前記インバータ１１２の出力は再度反転する。した
がって、充電と放電を繰り返して発振を行い、前記イン
バータ１１３を介し信号を出力する。
ータ１１２で構成されている発振回路の前記インバータ
１１２の出力は、電源を投入したとき、必ず”出力＝Ｈ
レベル”か”出力＝Ｌレベル”かになる。仮に”出力＝
Ｈレベル”になれば、前記制御装置１０７によって制御
された前記帰還抵抗１１０、１１１を介して等価コンデ
ンサ（前記コンデンサ１０４、１０５の直列合成値とす
る）に電荷を充電する。前記等価コンデンサが充電され
ていくと、前記発振回路接続端１０２での電位は、前記
インバータ１１２のスレッショルド電圧を越え、前記イ
ンバータ１１２の出力は反転する。また、前記制御装置
１０７によって制御された前記帰還抵抗１１０、１１１
を介して前記等価コンデンサに蓄えられた電荷は放電
し、前記インバータ１１２の出力は再度反転する。した
がって、充電と放電を繰り返して発振を行い、前記イン
バータ１１３を介し信号を出力する。
【００１１】以上のように本実施例によれば、前記帰還
抵抗１１０、１１１を並列に接続し、それぞれに接続さ
れている前記スイッチング素子１０８、１０９をオン、
オフ制御することによって、発振回路の帰還抵抗値を簡
単に選択することができ、発振周波数安定化のためのＣ
Ｒ時定数の調整を容易に行え、また、発振周波数を選択
することができる。
抵抗１１０、１１１を並列に接続し、それぞれに接続さ
れている前記スイッチング素子１０８、１０９をオン、
オフ制御することによって、発振回路の帰還抵抗値を簡
単に選択することができ、発振周波数安定化のためのＣ
Ｒ時定数の調整を容易に行え、また、発振周波数を選択
することができる。
【００１２】
【発明の効果】以上の実施例の説明より明らかなよう
に、本発明は発振回路のインバータに複数の帰還抵抗を
並列に接続し、前記帰還抵抗にはスイッチング素子を接
続し、前記スイッチング素子をオン、オフ制御する制御
装置を設けることにより、帰還抵抗を選択することがで
き、発振周波数安定化のためのＣＲ時定数の調整が行え
る優れた発振回路を実現するものである。
に、本発明は発振回路のインバータに複数の帰還抵抗を
並列に接続し、前記帰還抵抗にはスイッチング素子を接
続し、前記スイッチング素子をオン、オフ制御する制御
装置を設けることにより、帰還抵抗を選択することがで
き、発振周波数安定化のためのＣＲ時定数の調整が行え
る優れた発振回路を実現するものである。
【図１】本発明の一実施例の発振回路の構成図
【図２】従来の発振回路の構成図
１０１ 半導体集積回路 １０２ 発振回路接続端 １０３ 発振回路接続端 １０４ コンデンサ １０５ コンデンサ １０６ 発振子 １０７ 制御装置 １０８ スイッチング素子 １０９ スイッチング素子 １１０ 帰還抵抗 １１１ 帰還抵抗 １１２ インバータ １１３ インバータ
Claims (3)
- 【請求項１】 インバータと、前記インバータに並列に
接続された帰還抵抗と、インバータの両端の発振回路接
続端と接地間にそれぞれ接続されたコンデンサと、前記
発振回路接続端間に接続された発振子よりなり、前記帰
還抵抗を可変としたことを特徴とする発振回路。 - 【請求項２】 帰還抵抗を可変とする手段は、帰還抵抗
に直列に接続されたスイッチング素子と、前記スイッチ
ング素子をオン、オフ制御する制御装置よりなる請求項
１記載の発振回路。 - 【請求項３】 帰還抵抗とスイッチング素子の直列回路
が、複数個で、かつ、並列に接続されたことを特徴とす
る請求項２記載の発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7095746A JPH08293732A (ja) | 1995-04-21 | 1995-04-21 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7095746A JPH08293732A (ja) | 1995-04-21 | 1995-04-21 | 発振回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08293732A true JPH08293732A (ja) | 1996-11-05 |
Family
ID=14146066
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7095746A Pending JPH08293732A (ja) | 1995-04-21 | 1995-04-21 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08293732A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010070784A1 (ja) * | 2008-12-19 | 2010-06-24 | パナソニック株式会社 | 温度補償型発振回路 |
| US10826430B2 (en) | 2018-08-30 | 2020-11-03 | Seiko Epson Corporation | Semiconductor device, movement and electronic watch |
-
1995
- 1995-04-21 JP JP7095746A patent/JPH08293732A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010070784A1 (ja) * | 2008-12-19 | 2010-06-24 | パナソニック株式会社 | 温度補償型発振回路 |
| US10826430B2 (en) | 2018-08-30 | 2020-11-03 | Seiko Epson Corporation | Semiconductor device, movement and electronic watch |
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