JPH08337015A - 記録装置 - Google Patents
記録装置Info
- Publication number
- JPH08337015A JPH08337015A JP7169263A JP16926395A JPH08337015A JP H08337015 A JPH08337015 A JP H08337015A JP 7169263 A JP7169263 A JP 7169263A JP 16926395 A JP16926395 A JP 16926395A JP H08337015 A JPH08337015 A JP H08337015A
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- Japan
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- recording apparatus
- recording device
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- Record Information Processing For Printing (AREA)
Abstract
(57)【要約】
【目的】 ホストコンピュータからのデータを受信して
印刷する記録装置であって、双方向パラレルインターフ
ェイスのＥＰＣモードでデータの送受信を行う記録装置
おいて、ホストコンピュータの異常を検知し、記録装置
側でユーザに知らせることを目的とする。 【構成】 ホストコンピュータ等の外部機器からのキャ
ラクタデータを画像データとして印刷する記録装置であ
って、所定の規格に基づいたパラレルインタフェース
と、ホストコンピュータとのデータの送受信を前記規格
の特定のモードを用いて行うハードウェアとを有する記
録装置に、記録装置からホストコンピュータに対しての
リバース転送時、転送開始から転送終了までの時間を監
視するタイマを設ける。
印刷する記録装置であって、双方向パラレルインターフ
ェイスのＥＰＣモードでデータの送受信を行う記録装置
おいて、ホストコンピュータの異常を検知し、記録装置
側でユーザに知らせることを目的とする。 【構成】 ホストコンピュータ等の外部機器からのキャ
ラクタデータを画像データとして印刷する記録装置であ
って、所定の規格に基づいたパラレルインタフェース
と、ホストコンピュータとのデータの送受信を前記規格
の特定のモードを用いて行うハードウェアとを有する記
録装置に、記録装置からホストコンピュータに対しての
リバース転送時、転送開始から転送終了までの時間を監
視するタイマを設ける。
Description
【０００１】
【産業上の利用分野】本発明は、ホストコンピュータ等
の外部機器より文字データを入力して記録媒体に記録す
る記録装置に関するものである。
の外部機器より文字データを入力して記録媒体に記録す
る記録装置に関するものである。
【０００２】
【従来の技術】従来、記録装置において、ホストコンピ
ュータ（以下、単にホストという場合もある）から印刷
データ、および制御データのインタフェースとしてセン
トロニクス社の８ビットパラレルインタフェースが広く
用いられている。ところが、最近ホストからのデータ受
信だけでなく周辺機器からの情報をホスト側に送信でき
るインタフェースとして双方向セントロニクスがＩＥＥ
Ｅ１２８４規格として一般に普及しつつある。このＩＥ
ＥＥ１２８４にはいくつかのモードがあり、その中のひ
とつとしてＥＣＰモードがある。このモードは８ビット
パラレルデータが双方向で高速のデータ送受信が可能で
ある。記録装置からホストへのリバース転送時、記録装
置側のデータ送信タイミングの応答時間規定は規格とし
て定められているが、ホスト側のデータ受信時の応答規
定は正確には定められていない。そのため記録装置から
ホストにデータ転送中は、１バイト送信後、ホストの状
態に関わらず次のデータ転送まで無条件に待ち状態とな
っている。
ュータ（以下、単にホストという場合もある）から印刷
データ、および制御データのインタフェースとしてセン
トロニクス社の８ビットパラレルインタフェースが広く
用いられている。ところが、最近ホストからのデータ受
信だけでなく周辺機器からの情報をホスト側に送信でき
るインタフェースとして双方向セントロニクスがＩＥＥ
Ｅ１２８４規格として一般に普及しつつある。このＩＥ
ＥＥ１２８４にはいくつかのモードがあり、その中のひ
とつとしてＥＣＰモードがある。このモードは８ビット
パラレルデータが双方向で高速のデータ送受信が可能で
ある。記録装置からホストへのリバース転送時、記録装
置側のデータ送信タイミングの応答時間規定は規格とし
て定められているが、ホスト側のデータ受信時の応答規
定は正確には定められていない。そのため記録装置から
ホストにデータ転送中は、１バイト送信後、ホストの状
態に関わらず次のデータ転送まで無条件に待ち状態とな
っている。
【０００３】
【発明が解決しようとする課題】上記従来例では次のよ
うな欠点があった。記録装置からホストに対してリバー
スデータ転送中、ホストがハングアップ等暴走状態にあ
るとき、あるいは記録装置からの制御信号を判別できな
かった場合、記録装置側では待ち状態となるため通信が
止まってしまい、記録装置からのリバースデータ転送途
中状態で記録装置の処理もされないままとなってしまう
恐れがある。しかもユーザからはどうゆう状態か判別で
きないという欠点がある。本発明は上記従来例に鑑みな
されたものでホストとの通信状態を監視するタイマを設
け、ホストの異常を検知し、記録装置側でユーザに知ら
せることを目的とする。
うな欠点があった。記録装置からホストに対してリバー
スデータ転送中、ホストがハングアップ等暴走状態にあ
るとき、あるいは記録装置からの制御信号を判別できな
かった場合、記録装置側では待ち状態となるため通信が
止まってしまい、記録装置からのリバースデータ転送途
中状態で記録装置の処理もされないままとなってしまう
恐れがある。しかもユーザからはどうゆう状態か判別で
きないという欠点がある。本発明は上記従来例に鑑みな
されたものでホストとの通信状態を監視するタイマを設
け、ホストの異常を検知し、記録装置側でユーザに知ら
せることを目的とする。
【０００４】
【課題を解決するための手段】ＩＥＥＥ１２８４双方向
セントロニクスのＥＣＰモードにおけるリバース転送タ
イミング規格の一部を図１に示す。リバース転送時はＰ
ｅｒｉｐｈＣｌｋ信号とＨｏｓｔＡｃｋ信号のハンドシ
ェイクで行われ、ここに示すＴＨ、ＴＬ、Ｔ∞はそれぞ
れのタイミングにおける時間規定である。
セントロニクスのＥＣＰモードにおけるリバース転送タ
イミング規格の一部を図１に示す。リバース転送時はＰ
ｅｒｉｐｈＣｌｋ信号とＨｏｓｔＡｃｋ信号のハンドシ
ェイクで行われ、ここに示すＴＨ、ＴＬ、Ｔ∞はそれぞ
れのタイミングにおける時間規定である。
【０００５】ここでわかるように記録装置側のＰｅｒｉ
ｐｈＣｌｋ信号がＬｏｗになった後のホストの応答信号
であるＨｏｓｔＡｃｋ信号の時間規定は最大無限となっ
ている。記録装置側はこのＨｏｓｔＡｃｋ信号の立ち上
がりを検出後ＰｅｒｉｐｈＣｌｋ信号を３５ｍＳ以内に
Ｈｉｇｈとする規定である。ＩＥＥＥ１２８４規格のＥ
ＣＰモードリバース転送時、ＰｅｒｉｐｈＣｌｋ信号の
立ち上がり出力と同時に、タイマを起動し、ＨｏｓｔＡ
ｃｋ信号の立ち上がり入力時にタイマをリセットする。
タイマの設定時間を予め設定できるようにし、設定時間
を越えたときＣＰＵに対して割り込みを発生させると同
時に記録装置の表示部にホスト異常の表示をする。
ｐｈＣｌｋ信号がＬｏｗになった後のホストの応答信号
であるＨｏｓｔＡｃｋ信号の時間規定は最大無限となっ
ている。記録装置側はこのＨｏｓｔＡｃｋ信号の立ち上
がりを検出後ＰｅｒｉｐｈＣｌｋ信号を３５ｍＳ以内に
Ｈｉｇｈとする規定である。ＩＥＥＥ１２８４規格のＥ
ＣＰモードリバース転送時、ＰｅｒｉｐｈＣｌｋ信号の
立ち上がり出力と同時に、タイマを起動し、ＨｏｓｔＡ
ｃｋ信号の立ち上がり入力時にタイマをリセットする。
タイマの設定時間を予め設定できるようにし、設定時間
を越えたときＣＰＵに対して割り込みを発生させると同
時に記録装置の表示部にホスト異常の表示をする。
【０００６】
【実施例】以下、図面を参照して本発明の実施例を詳細
に説明する。
に説明する。
【０００７】（実施例１）図２は本発明の一実施例によ
る記録装置電気ブロック図である。図２において、１０
０は記録装置に接続されるホストコンピュータであり、
１０２はこの装置における動作、処理を実行するＣＰＵ
であり、１０３はＣＰＵ１０２の制御プログラムや文字
フォント等各種データを格納するＲＯＭであり、１０４
は各種データを一時保存するためのＲＡＭでであり、双
方向セントロニクスにおけるホストからの受信データ、
あるいはホストへの送信データはこのＲＡＭに格納され
る。
る記録装置電気ブロック図である。図２において、１０
０は記録装置に接続されるホストコンピュータであり、
１０２はこの装置における動作、処理を実行するＣＰＵ
であり、１０３はＣＰＵ１０２の制御プログラムや文字
フォント等各種データを格納するＲＯＭであり、１０４
は各種データを一時保存するためのＲＡＭでであり、双
方向セントロニクスにおけるホストからの受信データ、
あるいはホストへの送信データはこのＲＡＭに格納され
る。
【０００８】１０１はホストコンピュータ等の外部機器
との間でＩＥＥＥ１２８４規格双方向セントロニクスの
プロトコル通信制御を行うインタフェース部である。こ
のインタフェース部については後述する。１０８は記録
装置の設定状態、動作モード、エラーメッセージを表示
する表示部である。１０５は記録装置が記録媒体に画像
を記録するためにＣＰＵ１０２から制御信号をヘッドド
ライバに供給し、記録ヘッドに画像データを転送して印
字するＨＥＡＤ駆動部である。
との間でＩＥＥＥ１２８４規格双方向セントロニクスの
プロトコル通信制御を行うインタフェース部である。こ
のインタフェース部については後述する。１０８は記録
装置の設定状態、動作モード、エラーメッセージを表示
する表示部である。１０５は記録装置が記録媒体に画像
を記録するためにＣＰＵ１０２から制御信号をヘッドド
ライバに供給し、記録ヘッドに画像データを転送して印
字するＨＥＡＤ駆動部である。
【０００９】キャリッジモータドライバとキャリッジモ
ータのＣＲ駆動部１０７、紙送りモータドライバと紙送
りモータのＬＦ駆動部１０６はＣＰＵ１０２からそれぞ
れのドライバに制御信号を供給し、印字を記録媒体に行
う際に必要な記録ヘッドの水平方向移動と垂直方向移動
を促す制御系である。
ータのＣＲ駆動部１０７、紙送りモータドライバと紙送
りモータのＬＦ駆動部１０６はＣＰＵ１０２からそれぞ
れのドライバに制御信号を供給し、印字を記録媒体に行
う際に必要な記録ヘッドの水平方向移動と垂直方向移動
を促す制御系である。
【００１０】次に、本発明において、制御の手順を同様
に図２を用いて説明する。まずインタフェース部１０１
によって入力されたデータはＲＡＭ１０４に一時格納さ
れ、ＲＯＭ１０３に格納してあるプログラムにそってＣ
ＰＵ１０２によりコマンド、イメージデータ、キャラク
タコードの解析が行われる。キャラクタコードの場合、
予め格納してあるフォントデータをＲＯＭ１０３より読
みだされ、ＲＡＭ１０４に順次格納される。１ライン分
の展開が終了するか、もしくは外部機器のホストコンピ
ュータより印字命令が入力された時点でＣＲ駆動部１０
７をドライブし、ＨＥＡＤ駆動部１０５にＲＡＭ１０４
より印字データが転送され、印字が行われる。印字終了
後、ＬＦ駆動部１０６のがドライブされ、一連のシーケ
ンスが終了する。またＩＥＥＥ１２８４双方向セントロ
ニクスにおいて、ホストコンピュータ１００よりネゴシ
エイションが行われ、ＥＣＰモードでのデータ送受信を
行う場合、まずインタフェース制御部１０１において、
ホストとのプロトコル解析が行われる。
に図２を用いて説明する。まずインタフェース部１０１
によって入力されたデータはＲＡＭ１０４に一時格納さ
れ、ＲＯＭ１０３に格納してあるプログラムにそってＣ
ＰＵ１０２によりコマンド、イメージデータ、キャラク
タコードの解析が行われる。キャラクタコードの場合、
予め格納してあるフォントデータをＲＯＭ１０３より読
みだされ、ＲＡＭ１０４に順次格納される。１ライン分
の展開が終了するか、もしくは外部機器のホストコンピ
ュータより印字命令が入力された時点でＣＲ駆動部１０
７をドライブし、ＨＥＡＤ駆動部１０５にＲＡＭ１０４
より印字データが転送され、印字が行われる。印字終了
後、ＬＦ駆動部１０６のがドライブされ、一連のシーケ
ンスが終了する。またＩＥＥＥ１２８４双方向セントロ
ニクスにおいて、ホストコンピュータ１００よりネゴシ
エイションが行われ、ＥＣＰモードでのデータ送受信を
行う場合、まずインタフェース制御部１０１において、
ホストとのプロトコル解析が行われる。
【００１１】ＥＣＰモード時、リバース転送要求がホス
トコンピュータ１００からインタフェース制御部１０１
に送られた場合の詳細を図３を参照して説明する。図３
はＥＣＰモードにおけるリバース転送時のハンドシェイ
ク信号とタイマを記述していて、それ以外の信号につい
てはここでは省略している。Ｉ１００はＥＣＰモード時
におけるホストコンピュータからのデータ受信部であ
り、データは印刷データ、または印字を制御するコマン
ド等である。Ｉ１０１はＥＣＰモード時における記録装
置からホストコンピュータへのデータ送信部であり、記
録装置の設定状態等のコマンド、ステータスがホストか
らの要求に従い送信される。
トコンピュータ１００からインタフェース制御部１０１
に送られた場合の詳細を図３を参照して説明する。図３
はＥＣＰモードにおけるリバース転送時のハンドシェイ
ク信号とタイマを記述していて、それ以外の信号につい
てはここでは省略している。Ｉ１００はＥＣＰモード時
におけるホストコンピュータからのデータ受信部であ
り、データは印刷データ、または印字を制御するコマン
ド等である。Ｉ１０１はＥＣＰモード時における記録装
置からホストコンピュータへのデータ送信部であり、記
録装置の設定状態等のコマンド、ステータスがホストか
らの要求に従い送信される。
【００１２】ホストコンピュータからリバース転送要求
がされた場合、まず送信データがここでセットされホス
トコンピュータへの送信データとした出力される。この
ときＩ１０４に入力されるＨｏｓｔＡｃｋ信号がＬｏｗ
であり、ホストコンピュータがＲｅａｄｙであることを
確認し、制御信号出力部Ｉ１０３のＰｅｒｉｐｈＣｌｋ
信号をＬｏｗにする。このＰｅｒｉｐｈＣｌｋ信号をＬ
ｏｗにするとき、同時にタイマカウント部１１０５のタ
イマが起動する。このタイマカウント部には予めタイム
アウト時間を設定しておき、タイマがカウントアップさ
れる毎に、この設定時間と比較される。ホストコンピュ
ータからのＨｏｓｔＡｃｋ信号は制御信号入力部Ｉ１０
４に入力され、ＨｏｓｔＡｃｋ信号のＨｉｇｈが検出さ
れた場合、タイマカウント部１１０５がクリアされる。
その後ＰｅｒｉｐｈＣｌｋ信号をＨｉｇｈにし、ホスト
コンピュータはこの信号のＨｉｇｈを確認後、Ｈｏｓｔ
Ａｃｋ信号をＬｏｗにし、再びＲｅａｄｙ状態となり、
記録装置側は次の１バイト送信可能となり、再度このシ
ーケンスが繰り返されデータを順次送信する。タイマカ
ウント部Ｉ１０５において、予め設定されていたタイム
アウト時間を経過してもＨｏｓｔＡｃｋ信号がＨｉｇｈ
にならなかつた場合、タイムアウト信号（Ｔｉｍｅｏｕ
ｔ）が前述図２のＣＰＵに割り込み信号として出力され
る。ＣＰＵはこの割り込み信号を受け付けると、表示部
に対してホスト異常を知らせる。同時にリバース転送デ
ータ送信を中断し、ＥＣＰモードから抜ける。
がされた場合、まず送信データがここでセットされホス
トコンピュータへの送信データとした出力される。この
ときＩ１０４に入力されるＨｏｓｔＡｃｋ信号がＬｏｗ
であり、ホストコンピュータがＲｅａｄｙであることを
確認し、制御信号出力部Ｉ１０３のＰｅｒｉｐｈＣｌｋ
信号をＬｏｗにする。このＰｅｒｉｐｈＣｌｋ信号をＬ
ｏｗにするとき、同時にタイマカウント部１１０５のタ
イマが起動する。このタイマカウント部には予めタイム
アウト時間を設定しておき、タイマがカウントアップさ
れる毎に、この設定時間と比較される。ホストコンピュ
ータからのＨｏｓｔＡｃｋ信号は制御信号入力部Ｉ１０
４に入力され、ＨｏｓｔＡｃｋ信号のＨｉｇｈが検出さ
れた場合、タイマカウント部１１０５がクリアされる。
その後ＰｅｒｉｐｈＣｌｋ信号をＨｉｇｈにし、ホスト
コンピュータはこの信号のＨｉｇｈを確認後、Ｈｏｓｔ
Ａｃｋ信号をＬｏｗにし、再びＲｅａｄｙ状態となり、
記録装置側は次の１バイト送信可能となり、再度このシ
ーケンスが繰り返されデータを順次送信する。タイマカ
ウント部Ｉ１０５において、予め設定されていたタイム
アウト時間を経過してもＨｏｓｔＡｃｋ信号がＨｉｇｈ
にならなかつた場合、タイムアウト信号（Ｔｉｍｅｏｕ
ｔ）が前述図２のＣＰＵに割り込み信号として出力され
る。ＣＰＵはこの割り込み信号を受け付けると、表示部
に対してホスト異常を知らせる。同時にリバース転送デ
ータ送信を中断し、ＥＣＰモードから抜ける。
【００１３】（実施例２）上記実施例ではＨｏｓｔＡｃ
ｋ信号とＰｅｒｉｐｈＣｌｋ信号のハンドシェイク信号
をタイマにより監視しているが、ＤＭＡによりデータの
送受信を高速に行う場合、上記実施例のほかにＤＭＡ開
始から終了までの時間を監視することも可能である。こ
の場合、予めＤＭＡ転送データ数がわかっているためこ
の転送データ数に応じた時間を設定し、この時間以内に
ＤＭＡ転送が終了しない場合、表示部にホスト異常を知
らせる。図４に実施例２におけるブロック図を示す。点
線内がＤＭＡ転送の場合のインタフェース制御部であ
る。ＤＭＡ開始と同時にＳ１０２のタイマカウント部タ
イマが起動される。このタイマカウント部にはＤＭＡを
開始する前に予めＤＭＡ転送データ数に応じた設定時間
を格納しておく。そしてＳ１０４のＤＭＡ転送部におい
て、転送カウンタが行進され、。転送が終了すると終了
信号がＳ１０２のタイマカウンタ部に出力され、タイマ
がリセットされる。設定時間内にＤＭＡが終了しない場
合、Ｓ１０２のタイマカウント部からＴｉｍｅｏｕｔ信
号がＣＰＵに割り込み信号として出力される。
ｋ信号とＰｅｒｉｐｈＣｌｋ信号のハンドシェイク信号
をタイマにより監視しているが、ＤＭＡによりデータの
送受信を高速に行う場合、上記実施例のほかにＤＭＡ開
始から終了までの時間を監視することも可能である。こ
の場合、予めＤＭＡ転送データ数がわかっているためこ
の転送データ数に応じた時間を設定し、この時間以内に
ＤＭＡ転送が終了しない場合、表示部にホスト異常を知
らせる。図４に実施例２におけるブロック図を示す。点
線内がＤＭＡ転送の場合のインタフェース制御部であ
る。ＤＭＡ開始と同時にＳ１０２のタイマカウント部タ
イマが起動される。このタイマカウント部にはＤＭＡを
開始する前に予めＤＭＡ転送データ数に応じた設定時間
を格納しておく。そしてＳ１０４のＤＭＡ転送部におい
て、転送カウンタが行進され、。転送が終了すると終了
信号がＳ１０２のタイマカウンタ部に出力され、タイマ
がリセットされる。設定時間内にＤＭＡが終了しない場
合、Ｓ１０２のタイマカウント部からＴｉｍｅｏｕｔ信
号がＣＰＵに割り込み信号として出力される。
【００１４】
【発明の効果】以上説明したように、ＩＥＥＥ１２８４
双方向セントロニクスのＥＣＰモードでリバース転送を
行う際、ホストの異常時、永久に待ち状態になることな
く、記録装置側で通信異常が検知でき、ユーザに対して
ホスト異常を知らせることが可能となる。
双方向セントロニクスのＥＣＰモードでリバース転送を
行う際、ホストの異常時、永久に待ち状態になることな
く、記録装置側で通信異常が検知でき、ユーザに対して
ホスト異常を知らせることが可能となる。
【図１】図１は、本発明のＥＣＰモードにおけるリバー
ス転送タイミングである。
ス転送タイミングである。
【図２】図２は、本発明の実施例１に関する記録装置の
電気ブロック図である。
電気ブロック図である。
【図３】図３は、本発明のＥＣＰモードインタフェース
制御部である。
制御部である。
【図４】図４は、本発明での実施例２におけるインタフ
ェース制御部である。
ェース制御部である。
１００ ホストコンピュータ １０１ インターフェイス制御部 １０２ ＣＰＵ １０３ ＲＯＭ １０４ ＲＡＭ １０５ ＨＥＡＤ制御部 １０６ ＬＦ駆動部 １０７ ＣＲ駆動部 １０８ 表示部 １１００ ＥＰＣモードデータ受信部 １１０１ ＥＰＣモードデータ送信部 １１０３ 制御信号出力部 １１０４ 制御信号入力部 １１０５ タイマーカウント部
Claims (4)
- 【請求項１】 ホストコンピュータ等の外部機器からの
キャラクタデータを画像データとして印刷する記録装置
であって、所定の規格に基づいたパラレルインタフェー
スと、ホストコンピュータとのデータの送受信を前記規
格の特定のモードを用いて行うハードウェアとを有する
記録装置において、記録装置からホストコンピュータに
対してのリバース転送時、転送開始から転送終了までの
時間を監視するタイマを設けたことを特徴とする記録装
置。 - 【請求項２】 請求項１記載の記録装置において、転送
開始から転送終了までの時間を監視するタイマが予め設
定した時間を越えた時ＣＰＵに対して割り込みを発生さ
せる手段を設けたことを特徴とする記録装置。 - 【請求項３】 請求項１記載の記録装置において、転送
開始から転送終了までの時間を監視するタイマが予め設
定した時間を越えた時、記録装置の表示部に転送未終
了、ホストコンピュータの異常の表示を表すことを特徴
とする記録装置。 - 【請求項４】 請求項１乃至３のいずれか１つに記載の
記録装置において、前記所定の規格がＩＥＥＥ１２８４
規格双方向セントロニクスであり、前記特定のモードが
ＩＥＥＥ１２８４規格のＥＣＰモードであることを特徴
とする記録装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7169263A JPH08337015A (ja) | 1995-06-12 | 1995-06-12 | 記録装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7169263A JPH08337015A (ja) | 1995-06-12 | 1995-06-12 | 記録装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08337015A true JPH08337015A (ja) | 1996-12-24 |
Family
ID=15883274
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7169263A Pending JPH08337015A (ja) | 1995-06-12 | 1995-06-12 | 記録装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08337015A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7999954B2 (en) | 2006-01-26 | 2011-08-16 | Seiko Epson Corporation | Methods and devices for host error detection by a printer |
-
1995
- 1995-06-12 JP JP7169263A patent/JPH08337015A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7999954B2 (en) | 2006-01-26 | 2011-08-16 | Seiko Epson Corporation | Methods and devices for host error detection by a printer |
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