JPH0851388A - 高速係数更新取扱いを有する等化装置 - Google Patents

高速係数更新取扱いを有する等化装置

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JPH0851388A
JPH0851388A JP7023468A JP2346895A JPH0851388A JP H0851388 A JPH0851388 A JP H0851388A JP 7023468 A JP7023468 A JP 7023468A JP 2346895 A JP2346895 A JP 2346895A JP H0851388 A JPH0851388 A JP H0851388A
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JP7023468A
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Young-Sang Kim
榮祥 金
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WiniaDaewoo Co Ltd
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Daewoo Electronics Co Ltd
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    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
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    • HELECTRICITY
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    • H04L25/03Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
    • H04L25/03006Arrangements for removing intersymbol interference
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Abstract

(57)【要約】 (修正有) 【目的】 高速な係数更新取扱いが可能な等化装置を提
供する。 【構成】 等化装置内の更新回路は、データサンプルを
格納すると共に桁送りして1セットのデータサンプルを
提供する桁送りレジスタ31と、前記データサンプルに
エラー信号を乗じて、1セットのエラー加重データサン
プルを提供する乗算器32と、第1及び第2制御信号に
応答して、第1及び第2セットのスケール済みのエラー
加重データサンプルを発生するスケーリング回路と、更
新済みのフィルター計数のセットを発生する加算器34
と、更新済みのフィルター計数のセットを加算器への以
前のフィルター計数のセットとして格納するFIFOバッフ
ァ35と、フィルター出力信号の平均2乗エラーが予め
定められた臨界値と比較して、第1及び第2制御信号を
発生する制御手段とを含む。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、高精細度テレビジョン
信号受信システムで用いられる等化装置に関し、特に高
速係数更新取扱いを提供しうる向上の等化装置に関す
る。
【0002】
【従来の技術】HDTVシステムにおけるテレビジョン信号
などは、テレビジョン信号伝送源からラジオチャネルを
通してHDTV信号受信端へ伝送される。伝送チャネルを通
したテレビジョン信号などの伝送に係わった固有の問題
の1つは、チャネル歪みと付加雑音などが、例えば伝送
されたテレビジョン信号内に含まれたデータシンボルな
どを歪ませることによって、HDTV信号受信システムが受
信されたシンボルレベルなどを判断する性能を悪化させ
る。このような問題を解決するために、一般的なHDTV信
号受信システムはチャネル適応的等化器を備えている。
【0003】このような従来技術のチャネル適応的等化
器はフィルタリングデバイスを備えることによって、例
えば伝送チャネルの時間による応答に左右される周波数
から発生される増幅及び位相歪みを受信信号から除去し
て、改善されたシンボル判断力を提供する。特に、チャ
ネル適応的等化器は伝送チャネルの伝送関数をエミュレ
ートし、受信信号に対する伝送関数の逆関数を提供する
ことによって歪み効果を校正する。
【0004】HDTV信号受信システムで用いられる等化装
置の1つは、Samir N.Hulyalkarらの「Adavanced Digit
al HDTV Transmission System for Terrestrial Video
Simulcasting」,IEEE Journal on Selected Areas in C
ommunications,11,No,1.119-125頁(1993年1月)に開示さ
れており、これは、いわゆるタップ係数(tap coefficie
nts)と呼ばれる多数の等化係数を有する有限インパルス
応答フィルターとトレーニングシーケンスを用いる必要
がない自己調節が可能な係数更新モジュールを含む。こ
の係数更新モジュールは、ブラインドモードと、直接判
断モードとの2つのステップで取り扱われる。ブライン
ドモードに於てフィルター係数などは公知の非線形関数
を採用して算出された粗いエラー信号に応答して、それ
らの初期値まで粗く調整される。直接判断モードに於て
フィルター係数は公知の判断関数を用いて算出された判
断エラー信号を用いて、それらの最適値まで最終的に更
新される。
【0005】しかし、更新されるフィルター係数が単一
の取扱いデバイスを用いて繰り返しに算出、更新される
ので、このような等化装置は更新済みの係数を得るため
の多くの計算時間を要する。
【0006】
【発明が解決しようとする課題】従って、本発明の主な
目的は高速係数更新取扱いが可能な改善の等化装置を提
供することにある。
【0007】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明では、テレビジョン信号の受信システムで
用いるものであって、フィルタリング済みの出力信号を
生成するように、伝送チャネルにおける元の信号から歪
んだ受信テレビジョン信号を等化するためのフィルター
係数のセットを有して、該受信テレビジョン信号は多数
のデータサンプルを備えて、該フィルタリング済みの出
力信号はその対応する多数のフィルター出力データサン
プルを有する等化フィルターと、前記フィルタリング済
みの出力信号に応答して、エラー値のセットを格納する
と共に前記フィルタリング済みの出力データサンプルに
対応するエラー信号を生成するエラー信号生成手段と、
前記データサンプル及びエラー信号に応答して、更新済
みのフィルター係数のセットを等化フィルターへのフィ
ルター係数のセットとして生成する更新回路とを備える
等化装置に於て、前記更新回路は、前記データサンプル
を格納すると共に桁送り、1セットのデータサンプルを
提供する桁送りレジスタと、前記1セットのデータサン
プルにエラー信号を乗じて、1セットのエラー加重デー
タサンプルを提供する乗算器と、第1制御信号に応答し
て、第1スケール値で前記エラー加重データサンプルの
セットをスケールダウン(scale down)して、第1セット
のスケール済みのエラー加重データサンプルを発生する
と共に、第2制御信号に応答して、前記エラー加重デー
タサンプルのセットを第2スケール値でスケールダウン
して、第2セットのスケール済みのエラー加重データサ
ンプルを発生するスケーリング回路と、前記第1または
第2セットのスケール済みのエラー加重データサンプル
を以前のフィルター計数のセットに加算して、更新回路
の出力として更新済みのフィルター計数のセットを発生
する加算手段と、前記更新済みのフィルター計数のセッ
トを前記加算手段への前記以前のフィルター計数のセッ
トとして格納するFIFOバッファ手段と、前記フィルター
出力信号の平均2乗エラーが予め定められた臨界値と同
じであるかまたは小さい場合、第2制御信号を発生し、
また平均2乗エラーが予め定められた値より大きい場
合、第1制御信号を発生する制御手段とを含む。
【0008】
【実施例】以下、本発明の等化装置について添付の図面
を参照してより詳しく説明する。
【0009】図1には、本発明による等化装置が示され
ている。この等化装置はフィルター係数のセットを有す
る等化フィルター回路10と、該フィルター係数のセット
を更新する係数更新モジュール20とを含む。
【0010】受信テレビジョン信号は、公知のサンプリ
ング回路により多数のデータサンプリングにサンプリン
グされて、等化フィルター回路10及び後記する係数更新
モジュールに連続的に供給される。等化フィルター回路
10は有限インパルス応答(finite impulse response;FI
R)フィルターからなり、伝送チャネルから受信されたそ
のテレビジョン信号は、フィルタリング済みの信号を生
成するようにテレビジョン信号に含まれているフィルタ
ー係数のセットを用いて、FIRフィルターでフィルタリ
ングされると共に等化される。そのフィルタリング済み
の信号は対応する多数のフィルタリング済みのデータサ
ンプルを含み、そのフィルタリング済みのデータサンプ
ルは連続的に係数更新モジュール及び次のプロセッサ、
例えばデコーダ(図示せず)へ供給される。
【0011】受信テレビジョン信号y(n)は、等化装置へ
供給されて等化フィルター10によりフィルタリングされ
て、伝送チャネル(図示せず)で歪んだ受信テレビジョン
信号y(n)が校正され、伝送前に歪んでいない元のテレビ
ジョン信号に近接した等化済みのテレビジョン信号とし
てフィルタリング済みの信号として出力される。
【0012】公知のように、等化フィルター回路10から
のフィルタリング済みの信号(Z(n))は(1)式のように
表現される。
【0013】
【数1】
【0014】ここで、Wiは等化フィルターへのベクトル
またはフィルター係数で、Mはフィルターセルの数を表
す正の整数である。
【0015】フィルター係数のセットW(n)は、等化済み
のテレビジョン信号が得られるまで係数更新モジュール
により連続して更新され、(2)式のように表現され
る。
【0016】
【数2】W(n+1)=W(n)+μY(n)e(n) …(2)
【0017】ここで、μは、Y(n)は受信されたデータサ
ンプルのベクトルで、スケールフィルターを表す小さい
数で、例えば2-10または2-12、e(n)はエラー信号であ
る。従って、係数更新モジュールは等化フィルター10が
元のテレビジョン信号に近似の等化済みのテレビジョン
信号として、フィルタリング済みの信号(Z(n))を生成す
るように、フィルター係数W(n)の最適セットに収束す
る。
【0018】係数更新モジュールは2つのステップ、即
ちブラインドモードと直接判断モードで取扱いするよう
になっており、第1メモリ21、マルチプレクサ23、係数
更新回路24、第2メモリ25及びモード選択回路26を含
む。ブラインドモードに於て、等化フィルター回路10か
らのフィルタリング済みのデータサンプルに応答して、
第1メモリ21がマルチプレクサ23を通じて係数更新回路
24へ供給される第1エラー信号を生成する。
【0019】予測されるフィルタリング済みのデータサ
ンプルと予め定められた固定値間の差とを表わす粗いエ
ラー値は、算出されて第1メモリ21に格納され、ここ
で、元の非歪みデータサンプルの平均値は予め定められ
た固定値として好ましく選択される。このような方法で
予測される全てのフィルタリング済みのデータサンプル
に対応する全粗いエラー値は、ルックアップ表として算
出されて、第1メモリ21に格納される。この場合、予測
されるフィルタリング済みのデータサンプルをTビット
と想定すれば、予測されるフィルタリング済みのデータ
サンプルの組み合わせ可能な全数と要求されるメモリの
大きさは2Tになる。ここで、Tは正の整数である。本
発明によれば、第1メモリ21には電気的に消去可能なプ
ログラム可能読取り専用記憶装置(EEPROM)が用いられ
る。
【0020】前述のように、予測されるフィルタリング
済みのデータサンプルに対応するフィルタリング済みの
データサンプルに応答して、第1メモリ21はその対応す
る粗いエラー値を表す第1エラー信号を生成するのに役
立つ。
【0021】係数更新回路24は、初期収束を提供するた
めに、第1エラー信号及びフィルタリング済みのデータ
サンプルに対応するデータサンプルを受信して、粗く更
新済みの係数を生成し、その生成された係数は等価フィ
ルター10に供給される。初期収束を提供するための粗い
更新係数は、等化フィルター10の内部に維持されたフィ
ルター係数の以前のセットを替える。
【0022】一方、直接判断モードに於ける第2メモリ
25は、フィルタリング済みのデータサンプルを受信し
て、マルチプレクサ23を通して係数更新回路24へ供給さ
れる第2エラー信号を生成する。
【0023】対応する元の非歪みデータサンプルと予測
されるフィルタリング済みのデータサンプルとの差を表
わす精しいエラー値は、算出されて第2メモリ25に格納
される。このような方式に於て、予測されるフィルタリ
ング済みのデータサンプルに対応する全ての精しいエラ
ー値はルックアップ表として算出され、第2メモリ25に
格納される。また、第2メモリ25にも電気的に消去可能
なプログラム可能な読取り専用記憶装置(EEPROM)が用い
られる。
【0024】上述のように、第2メモリ25は予測される
フィルタリング済みのデータサンプルに対応するフィル
タリング済みのデータサンプルに応答し、その対応する
精しいエラー値を表す第2エラー信号を出力する。
【0025】係数更新回路24は、フィルター係数の最適
収束を達成するために、第2エラー信号及びフィルタリ
ング済みのデータサンプルに対応するデータサンプルを
受信して、精しい更新係数のセットを生成する。その精
しい更新係数は等化フィルター10へ供給されて、等化フ
ィルター10内部に維持されたフィルター係数の以前のフ
ィルター係数を置き替える。
【0026】モード変更取扱いは2つのモード選択信
号、即ちブラインドモード信号及び直接判断モード信号
を生成するモード選択回路26により制御される。このモ
ード選択回路26はフィルタリング済みの信号を受信し
て、それに対して平均二乗エラー(Mean Square Error;M
SE)を算出する。このMSEは、いわゆるアイパターン(Eye
Pattern)に基づいて、実験的に特定され得る予め定め
られた臨界値と比較される。このMSEが予め定められた
エラー値より大きい場合、モード選択回路26はブライン
ドモード信号を生成する。このブラインドモード信号は
マルチプレクサ23にとって第1メモリ21からの第1エラ
ー信号をマルチプレクサ23を通じて、エラー信号として
係数更新回路24へ供給するのに役立つ。
【0027】一方、MSEが予め定められたエラー値より
小さい場合、モード選択回路26は直接判断モード信号を
生成する。この直接判断モード信号はマルチプレクサ23
にとって第2メモリ25からの第2エラー信号をマルチプ
レクサ23に通してエラー信号として係数更新回路24へ供
給するのに役立つ。
【0028】図2は、本発明による係数更新回路24の詳
細なブロック図を表わす。この係数更新回路24は受信テ
レビジョン信号及びエラー信号に応答して、等化フィル
ターへのフィルター係数のセットとして更新済みのフィ
ルター係数のセットを生成する。この回路24は乗算器3
2、スケーリング(scaling)回路33、加算器34、先入先出
(FIFO)バッファメモリ35を含む。
【0029】現データサンプルは桁送りレジスタ31に格
納されるが、この桁送りレジスタ31はM個の格納場所を
有し、現データサンプルを含むデータサンプルのセット
を並列に発生する。その後、桁送りレジスタ31は次のデ
ータサンプルに応答して、次のデータサンプルを格納
し、現データサンプルを桁送りデータサンプルの次のセ
ットを生成する。データサンプルのセット及び対応する
エラー信号は同時に乗算器32へ供給される。この乗算器
32はデータサンプルと対応するエラー信号を乗じて、エ
ラー加重されたデータサンプルのセットを供給する。そ
の後、エラー加重データサンプルのセットはスケーリン
グ回路33へ供給される。
【0030】スケーリング回路33は、モード選択回路26
からのブラインドモード信号に応答して、第1スケール
値を有するエラー加重データサンプルのセットをスケー
ルダウンさせ、これによって、スケール済みのエラー加
重データサンプルの第1セットを生成すると共に第2制
御信号に応答して第2スケール値を有するエラー加重デ
ータサンプルのセットをスケールダウンさせ、スケール
済みのエラー加重サンプルの第2セットを生成する。式
(2)に表わされたように、第1スケール値は2-10で、
第2スケール値は2-12である。従って、スケーリング
回路33は10ビットシフタ33a、12-ビットシフタ33b及び
マルチプレクサ33cを用いることによって好ましく具現
される。
【0031】本技術分野で公知のように、10-ビットシ
フタ33aは各々のエラー加重データサンプルの全てのビ
ットを10ビットだけ桁送りして、スケール済みのエラー
加重サンプルの第1セットをマルチプレクサ33cへ供給
する。同様に、12-ビットシフタ33bは各々のエラー加重
データサンプルの全てのビットを12ビットだけ桁送りし
て、スケール済みのエラー加重データサンプルの第2セ
ットをマルチプレクサ33cへ供給する。
【0032】マルチプレクサ33cはモード選択回路26か
らのブラインドモード信号に応答して、スケール済みの
エラー加重データサンプルの第1セットを加算器34へ供
給し、モード選択回路26からの判断モード信号に応答し
て、スケール済みのエラー加重データサンプルの第2セ
ットを加算器34へ供給する。
【0033】この加算器34はそのスケール済みのエラー
加重データサンプルの第1または第2セットと、FIFOバ
ッファメモリ35からの以前のフィルター係数のセットと
を受信し、スケール済みのエラー加重データサンプルの
セットを以前のフィルター係数のセット12と加えて、更
新回路の出力として更新済みのフィルター係数のセット
を生成する。この計数は等化フィルター10及びFIFOバッ
ファメモリ35へ供給される。
【0034】FIFOバッファメモリ35は以前のフィルター
係数のセットとして、更新済みのフィルター係数のセッ
トを格納すると共に加算器34へ供給するのに役立つ。
【0035】上述のように、フィルター係数のセットは
受信データサンプル及びエラー信号を用いることによっ
て、最適フィルター係数のセットが得られるまで繰り返
し、効果的に更新される。
【0036】上記の説明から明らかなように、係数更新
回路は乗算器、シフタ、加算器及びマルチプレクサのよ
うな簡単な回路素子の単一組み合わせから具現可能であ
り、フィルター係数の更新を遅延することなく、効果的
に行い得る。更に、第1及び第2エラー信号はフィルタ
リング済みのデータサンプルによってアクセスされるよ
うに予め算出され、第1及び第2メモリに各々格納され
る。その結果、エラー信号は大幅に低減された遅延時間
で得られるので、等化装置の高速な係数更新取扱いが可
能となる。
【0037】本発明は特定の実施例について説明した
が、本発明の範囲を逸脱することなく、当業者は種々の
改変をなし得るであろう。
【0038】
【発明の効果】本発明に基づく等化装置によれば、エラ
ー信号に対する遅延時間を大幅に減らすことが可能とな
り、高速に係数の更新取扱いができる。
【図面の簡単な説明】
【図1】本発明による高速係数更新取扱いを有する等化
装置のブロック図である。
【図2】図1に示された係数更新回路の詳細なブロック
図である。
【符号の説明】
10 等化フィルター 21 第1メモリ 25 第2メモリ 23、33c マルチプレクサ 24 係数更新回路 26 モード選択回路

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 テレビジョン信号の受信システムで用い
    るものであって、フィルタリング済みの出力信号を生成
    するように、伝送チャネルにおける元の信号から歪んだ
    受信テレビジョン信号を等化するためのフィルター係数
    のセットを有し、該受信テレビジョン信号は多数のデー
    タサンプルを備えて、前記フィルタリング済みの出力信
    号はその対応する多数のフィルター出力データサンプル
    を有する等化フィルターと、該フィルタリング済みの出
    力信号に応答してエラー値のセットを格納すると共に前
    記フィルタリング済みの出力データサンプルに対応する
    エラー信号を生成するエラー信号生成手段と、該データ
    サンプル及びエラー信号に応答して、更新済みのフィル
    ター係数のセットを等化フィルターへのフィルター係数
    のセットとして生成する更新回路とを備える等化装置に
    於て、 前記更新回路は、 前記データサンプルを格納するとともに桁送りして、1
    セットのデータサンプルを提供する桁送りレジスタと、 前記1セットのデータサンプルにエラー信号を乗じて、
    1セットのエラー加重データサンプルを提供する乗算器
    と、 第1制御信号に応答して、第1スケール値で前記エラー
    加重データサンプルのセットをスケールダウン(scale d
    own)して、第1セットのスケール済みのエラー加重デー
    タサンプルを発生するとともに、第2制御信号に応答し
    て、前記エラー加重データサンプルのセットを第2スケ
    ール値でスケールダウンして、第2セットのスケール済
    みのエラー加重データサンプルを発生するスケーリング
    回路と、 前記第1または第2セットのスケール済みのエラー加重
    データサンプルを以前のフィルター計数のセットに加算
    して、更新回路の出力として更新済みのフィルター計数
    のセットを発生する加算手段と、 前記更新済みのフィルター計数のセットを前記加算手段
    への前記以前フィルター計数のセットとして格納するFI
    FOバッファ手段と、 前記フィルター出力信号の平均2乗エラーが予め定めら
    れた臨界値と同じであるかまたは小さい場合、第2制御
    信号を発生し、また平均2乗エラーが予め定められた値
    より大きい場合、第1制御信号を発生する制御手段とを
    含むことを特徴とする等化装置。
  2. 【請求項2】 前記スケーリング回路が、 前記各エラー加重データサンプルの全ビットをNビット
    だけ桁送りして、前記第1セットのスケール済みのエラ
    ー加重データサンプルを生成するNビットシフタ(Nは正
    の整数)と、 前記各エラー加重データサンプルの全ビットをMビット
    だけ桁送りして、前記第2セットのスケール済みのエラ
    ー加重データサンプルを生成するMビットシフタ(Mは正
    の整数)と、 前記第1制御信号に応答して、前記第1セットのスケー
    ル済みのエラー加重データサンプルを前記加算手段へ提
    供し、前記第2制御信号に応答して、前記第2セットの
    スケール済みのエラー加重データサンプルを前記加算手
    段へ提供するマルチプレクサとを含むことを特徴とする
    請求項1記載の等化装置。
  3. 【請求項3】 前記エラー信号生成手段が、 予測されるフィルタリング済みのデータサンプルと予め
    定められた値との差を各々表わす粗いエラー値のセット
    を格納すると共に前記予測されるフィルタリング済みの
    データサンプルに対応するフィルタリング済みのデータ
    サンプルと第1制御信号に応答して、その対応するエラ
    ー信号として粗いエラー値を表わす第1エラー信号を生
    成する第1メモリ手段と、 予測されるフィルタリング済みのデータサンプルと対応
    する元のデータサンプルとの差を各々表わす精しいエラ
    ー値のセットを格納すると共に、前記予測されるフィル
    タリング済みのデータサンプルに対応するフィルタリン
    グ済みのデータサンプルと第2制御信号に応答して、そ
    の対応するエラー信号として精しいエラー値を表す第2
    エラー信号を生成する第2メモリ手段とを備えることを
    特徴とする請求項1に記載の等化装置。
JP7023468A 1994-01-18 1995-01-18 高速係数更新取扱いを有する等化装置 Pending JPH0851388A (ja)

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