JPH088251B2 - 酸化シリコン膜の形成方法 - Google Patents
酸化シリコン膜の形成方法Info
- Publication number
- JPH088251B2 JPH088251B2 JP34031089A JP34031089A JPH088251B2 JP H088251 B2 JPH088251 B2 JP H088251B2 JP 34031089 A JP34031089 A JP 34031089A JP 34031089 A JP34031089 A JP 34031089A JP H088251 B2 JPH088251 B2 JP H088251B2
- Authority
- JP
- Japan
- Prior art keywords
- oxide film
- oxygen
- silicon oxide
- film
- sio
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 238000000034 method Methods 0.000 title claims description 19
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 title claims description 15
- 229910052814 silicon oxide Inorganic materials 0.000 title claims description 15
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 31
- 229910052760 oxygen Inorganic materials 0.000 claims description 31
- 239000001301 oxygen Substances 0.000 claims description 31
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 22
- 229920005591 polysilicon Polymers 0.000 claims description 21
- -1 oxygen ions Chemical class 0.000 claims description 11
- 239000004065 semiconductor Substances 0.000 claims description 4
- 230000001678 irradiating effect Effects 0.000 claims description 3
- 238000009751 slip forming Methods 0.000 claims 1
- 239000010408 film Substances 0.000 description 67
- 239000000758 substrate Substances 0.000 description 29
- 229910004298 SiO 2 Inorganic materials 0.000 description 23
- 230000003647 oxidation Effects 0.000 description 19
- 238000007254 oxidation reaction Methods 0.000 description 19
- 229910052710 silicon Inorganic materials 0.000 description 14
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 13
- 239000010703 silicon Substances 0.000 description 13
- 230000007547 defect Effects 0.000 description 7
- 238000001947 vapour-phase growth Methods 0.000 description 6
- 230000015572 biosynthetic process Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 5
- 230000008021 deposition Effects 0.000 description 4
- 238000009792 diffusion process Methods 0.000 description 4
- 230000015556 catabolic process Effects 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 3
- 239000013078 crystal Substances 0.000 description 3
- 230000007423 decrease Effects 0.000 description 3
- 125000001475 halogen functional group Chemical group 0.000 description 3
- 238000002128 reflection high energy electron diffraction Methods 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 2
- 238000004140 cleaning Methods 0.000 description 2
- 150000001875 compounds Chemical class 0.000 description 2
- 230000005684 electric field Effects 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 150000002500 ions Chemical class 0.000 description 2
- 230000001590 oxidative effect Effects 0.000 description 2
- 229910052594 sapphire Inorganic materials 0.000 description 2
- 239000010980 sapphire Substances 0.000 description 2
- 241000894006 Bacteria Species 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- 229910021486 amorphous silicon dioxide Inorganic materials 0.000 description 1
- 238000002484 cyclic voltammetry Methods 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000001035 drying Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000010292 electrical insulation Methods 0.000 description 1
- 238000002474 experimental method Methods 0.000 description 1
- 239000010419 fine particle Substances 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 238000010574 gas phase reaction Methods 0.000 description 1
- 239000004615 ingredient Substances 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 235000014593 oils and fats Nutrition 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000002161 passivation Methods 0.000 description 1
- 239000011148 porous material Substances 0.000 description 1
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Chemical compound [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 239000012808 vapor phase Substances 0.000 description 1
- 239000006200 vaporizer Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
Landscapes
- Formation Of Insulating Films (AREA)
Description
【発明の詳細な説明】 （産業上の利用分野） 本発明は、酸化シリコン膜の形成方法に関する。
（従来の技術と発明が解決しようとする課題） 従来、シリコン酸化膜の形成方法はシリコン基板の熱
酸化もしくは、気相成長によるものであった。シリコン
基板の熱酸化によれば高品質のシリコン酸化膜が得ら
れ、また界面はシリコン基板内に形成されるため界面準
位密度も少ない。しかし、熱酸化のためには800℃以上
の高温を必要とし、熱酸化の過程で不純物の拡散によっ
て、基板内に形成した不純物プロファイルが崩れてしま
うという欠点がある。一方、気相成長によれば低温の酸
化膜形成が可能ではある。しかし、この気相成長では気
相中でシリコンと酸素の反応が起こりSiO2粒子となって
基板上に降り積もるため、酸化膜中にはボイドが多数存
在する。このため、気相成長によって形成した酸化膜
は、熱酸化膜に比べて耐圧が低くリーク電流も多い。さ
らに、シリコン表面の清浄化が行われないため、界面準
位密度が多く、MOSデバイスのゲート酸化膜等高品質の
酸化膜が要求される箇所には使用することができないと
いう問題点があった。さらに、MOSデバイスのゲート酸
化膜は、LSIの高密度化に伴い薄膜化の傾向にあり、近
い将来には100Åあるいはそれ以下の膜厚が必要になる
と予想される。特にDRAMでは、α線によるソフトエラー
を防止するためにキャパシタ容量を少なくすることが困
難な状況にあり、従って微細化に伴う容量の減少を酸化
膜の薄膜化で補う必要がある。さらに、チップサイズの
大型化によりゲート領域の占める面積も広くなりつつあ
り、大面積にわたって耐圧不良の無い電気的絶縁性の優
れた酸化膜が要求される。一方、酸化膜厚が薄くなって
も動作電圧を下げることが実用上困難であり、酸化膜は
従来よりも高い電界強度のもとで使用される傾向にあ
る。しかし、熱酸化膜は膜厚が薄くなると、ピンホール
やウィークスポットなど絶縁不良をひきおこす欠陥が多
数発生する。この原因はSiとSiO2の界面に存在するSiOx
層の影響が酸化膜厚が薄くなってくると無視し得なくな
ってくること、また微粒子、有機物、油脂、あるいはバ
クテリアの付着などによる表面の汚染であると考えられ
ている。
酸化もしくは、気相成長によるものであった。シリコン
基板の熱酸化によれば高品質のシリコン酸化膜が得ら
れ、また界面はシリコン基板内に形成されるため界面準
位密度も少ない。しかし、熱酸化のためには800℃以上
の高温を必要とし、熱酸化の過程で不純物の拡散によっ
て、基板内に形成した不純物プロファイルが崩れてしま
うという欠点がある。一方、気相成長によれば低温の酸
化膜形成が可能ではある。しかし、この気相成長では気
相中でシリコンと酸素の反応が起こりSiO2粒子となって
基板上に降り積もるため、酸化膜中にはボイドが多数存
在する。このため、気相成長によって形成した酸化膜
は、熱酸化膜に比べて耐圧が低くリーク電流も多い。さ
らに、シリコン表面の清浄化が行われないため、界面準
位密度が多く、MOSデバイスのゲート酸化膜等高品質の
酸化膜が要求される箇所には使用することができないと
いう問題点があった。さらに、MOSデバイスのゲート酸
化膜は、LSIの高密度化に伴い薄膜化の傾向にあり、近
い将来には100Åあるいはそれ以下の膜厚が必要になる
と予想される。特にDRAMでは、α線によるソフトエラー
を防止するためにキャパシタ容量を少なくすることが困
難な状況にあり、従って微細化に伴う容量の減少を酸化
膜の薄膜化で補う必要がある。さらに、チップサイズの
大型化によりゲート領域の占める面積も広くなりつつあ
り、大面積にわたって耐圧不良の無い電気的絶縁性の優
れた酸化膜が要求される。一方、酸化膜厚が薄くなって
も動作電圧を下げることが実用上困難であり、酸化膜は
従来よりも高い電界強度のもとで使用される傾向にあ
る。しかし、熱酸化膜は膜厚が薄くなると、ピンホール
やウィークスポットなど絶縁不良をひきおこす欠陥が多
数発生する。この原因はSiとSiO2の界面に存在するSiOx
層の影響が酸化膜厚が薄くなってくると無視し得なくな
ってくること、また微粒子、有機物、油脂、あるいはバ
クテリアの付着などによる表面の汚染であると考えられ
ている。
そこで、本発明者は分子状のSiとECRによって発生し
た酸素プラズマを同時に基板に供給したところ、低温で
酸化膜が形成できることを見出した。また、この方法で
は気相成長による酸化膜の堆積と異なり分子線領域で行
うため、気相反応ではなく表面でSiの酸化であり、気相
成長に比べてより緻密な膜の形成が行えることがわかっ
た。さらに、SiO2形成前にSiMBEでSiのバッファーエピ
タキシャル層を成長することによってSiO2/Si界面を原
子オーダーで平坦にすることができ、界面の凹凸による
電界集中に起因する耐圧の低下を減少させることができ
た。このようにして形成した酸化膜の耐圧及びリーク電
流は同じ厚さの熱酸化膜と同等であった。
た酸素プラズマを同時に基板に供給したところ、低温で
酸化膜が形成できることを見出した。また、この方法で
は気相成長による酸化膜の堆積と異なり分子線領域で行
うため、気相反応ではなく表面でSiの酸化であり、気相
成長に比べてより緻密な膜の形成が行えることがわかっ
た。さらに、SiO2形成前にSiMBEでSiのバッファーエピ
タキシャル層を成長することによってSiO2/Si界面を原
子オーダーで平坦にすることができ、界面の凹凸による
電界集中に起因する耐圧の低下を減少させることができ
た。このようにして形成した酸化膜の耐圧及びリーク電
流は同じ厚さの熱酸化膜と同等であった。
しかし、この方法は、基板Si表面を清浄化しても上層
SiO2とSi基板表面とが完全にはつながらず、界面にダン
グリングボンドが残り、このダングリングボントに起因
する界面準位が発生するという問題があった。界面準位
密度は熱酸化膜の場合に比べると約10倍多くMOSのゲー
ト酸化膜としては用いることができなかった。また、低
温成長であるため、SiO2中に空孔が多数存在し、この欠
陥に伴うリーク電流も100Å以下の膜厚では熱酸化膜に
比べて多く、問題であった。
SiO2とSi基板表面とが完全にはつながらず、界面にダン
グリングボンドが残り、このダングリングボントに起因
する界面準位が発生するという問題があった。界面準位
密度は熱酸化膜の場合に比べると約10倍多くMOSのゲー
ト酸化膜としては用いることができなかった。また、低
温成長であるため、SiO2中に空孔が多数存在し、この欠
陥に伴うリーク電流も100Å以下の膜厚では熱酸化膜に
比べて多く、問題であった。
本発明の目的は、この様な従来の欠点を除去して、低
温形成でき、界面準位が少なく、欠陥に伴うリーク電流
が少ない酸化シリコン形成方法を提供することにある。
温形成でき、界面準位が少なく、欠陥に伴うリーク電流
が少ない酸化シリコン形成方法を提供することにある。
（課題を解決するための手段） 本発明は、真空槽内で清浄面を出した半導体上に、酸
素イオン（O-）および原子状酸素（Ｏ）のうち少なくと
も一方を照射することにより表面に第１シリコン酸化膜
を形成し、続けて同一真空槽内で第１シリコン酸化膜上
に薄いポリシリコン膜を形成し、酸素イオン（O-）およ
び原子状酸素（Ｏ）のうち少なくとも一方を照射するこ
とによりポリシリコン膜を酸化することを、所定の酸化
膜厚になるまで繰り返すことを特徴とするシリコン酸化
膜の形成方法である。
素イオン（O-）および原子状酸素（Ｏ）のうち少なくと
も一方を照射することにより表面に第１シリコン酸化膜
を形成し、続けて同一真空槽内で第１シリコン酸化膜上
に薄いポリシリコン膜を形成し、酸素イオン（O-）およ
び原子状酸素（Ｏ）のうち少なくとも一方を照射するこ
とによりポリシリコン膜を酸化することを、所定の酸化
膜厚になるまで繰り返すことを特徴とするシリコン酸化
膜の形成方法である。
また第１シリコン酸化膜形成前に薄いポリシリコン膜
を形成しておきこのポリシリコン膜を同様にして酸化す
ること及び同じようにして薄いポリシリコン膜の形成と
その酸化を繰り返すことも本発明に含まれる。
を形成しておきこのポリシリコン膜を同様にして酸化す
ること及び同じようにして薄いポリシリコン膜の形成と
その酸化を繰り返すことも本発明に含まれる。
（作用） 本発明の原理について説明する。従来の熱酸化では、
酸化はSiO2と基板Si結晶界面において起こっているた
め、酸素のSiO2中での拡散と基板結晶Siのバックボンド
を切るために多くのエネルギーを必要とし、これが酸化
温度と時間を決定している。第２図（ａ）に示すよう
に、表面側から分子状のSiと原子状酸素もしくは酸素イ
オンの少なくとも一方を供給すると、酸化はいつも表面
で起こり、しかも結晶を組んでいる基板Siのバックボン
ドを切る必要がないため、低温で酸化膜が形成できる。
しかし、以上のような酸化膜形成方法では低温でのSiO2
の堆積であるため、第２図（ｂ）に示すように、基板Si
表面を清浄化しても上層SiO2とSi基板表面とが完全には
つながらず、界面にダングリングボンドが残り、このダ
ングリングボンドに起因する界面準位が発生する。ま
た、第２図（ｂ）に示すようにSiO2中に空孔24が存在
し、この欠陥に伴うリーク電流も100Å以下の薄い膜厚
では熱酸化膜に比べて多い。
酸化はSiO2と基板Si結晶界面において起こっているた
め、酸素のSiO2中での拡散と基板結晶Siのバックボンド
を切るために多くのエネルギーを必要とし、これが酸化
温度と時間を決定している。第２図（ａ）に示すよう
に、表面側から分子状のSiと原子状酸素もしくは酸素イ
オンの少なくとも一方を供給すると、酸化はいつも表面
で起こり、しかも結晶を組んでいる基板Siのバックボン
ドを切る必要がないため、低温で酸化膜が形成できる。
しかし、以上のような酸化膜形成方法では低温でのSiO2
の堆積であるため、第２図（ｂ）に示すように、基板Si
表面を清浄化しても上層SiO2とSi基板表面とが完全には
つながらず、界面にダングリングボンドが残り、このダ
ングリングボンドに起因する界面準位が発生する。ま
た、第２図（ｂ）に示すようにSiO2中に空孔24が存在
し、この欠陥に伴うリーク電流も100Å以下の薄い膜厚
では熱酸化膜に比べて多い。
そこで、本発明者は、第３図（ａ）に示すように予め
清浄化したシリコン基板表面に酸素イオンもしくは原子
状酸素を照射したところ、希薄な酸素雰囲気中でも、第
３図（ｂ）に示すようにシリコン基板が酸化され表面に
SiO2が形成される事を見出した。この、SiO2は基板の酸
化によって形成されたものであり、膜質、界面状態とも
に熱酸化膜と同等である。しかし、SiO2の形成速度は、
SiO2が厚くなりSiO2中での酸素の拡散が律速する様にな
るとすぐに低下してしまい、20Å以上の膜厚の酸化膜の
形成ができなかった。現在、MOSトランジスタのゲート
酸化膜として使われている酸化膜の膜厚は60〜100Åで
あり、低温でさらに厚い膜の形成が必要である。
清浄化したシリコン基板表面に酸素イオンもしくは原子
状酸素を照射したところ、希薄な酸素雰囲気中でも、第
３図（ｂ）に示すようにシリコン基板が酸化され表面に
SiO2が形成される事を見出した。この、SiO2は基板の酸
化によって形成されたものであり、膜質、界面状態とも
に熱酸化膜と同等である。しかし、SiO2の形成速度は、
SiO2が厚くなりSiO2中での酸素の拡散が律速する様にな
るとすぐに低下してしまい、20Å以上の膜厚の酸化膜の
形成ができなかった。現在、MOSトランジスタのゲート
酸化膜として使われている酸化膜の膜厚は60〜100Åで
あり、低温でさらに厚い膜の形成が必要である。
そこで、本発明者は、第１図（ａ）に示すように、清
浄化したシリコン基板表面に、酸素イオンもしくは原子
状酸素を照射して20Å程度のSiO2を形成し、次に第１図
（ｂ）に示すように、この上にシリコンの分子線を供給
して10Å程度のポリシリコン層を形成し、第１図（ｃ）
に示すように、ふたたび酸素イオンもしくは原子状酸素
を照射してこのポリシリコン層を酸化すると合計40Åの
酸化膜が形成される事を見出した。この工程を繰り返せ
ば、SiO2中での酸素の拡散によって決定されてしまう膜
厚以上の厚い膜を低温で形成できる。ポリシリコンの膜
厚があまり厚いとそれを酸化して形成される酸化膜が厚
くなってしまい拡散律速の厚さになってしまうので、ポ
リシリコンは数10Å以下が望ましい。また、酸化膜の膜
厚は供給するシリコン分子線量によって決定されるため
に膜厚の制御性も極めて良い。この様な方法ならばたと
え室温で成長しても、耐圧、リーク電流、界面準位密度
共に熱酸化によって形成された酸化膜と同程度のものを
作ることができた。
浄化したシリコン基板表面に、酸素イオンもしくは原子
状酸素を照射して20Å程度のSiO2を形成し、次に第１図
（ｂ）に示すように、この上にシリコンの分子線を供給
して10Å程度のポリシリコン層を形成し、第１図（ｃ）
に示すように、ふたたび酸素イオンもしくは原子状酸素
を照射してこのポリシリコン層を酸化すると合計40Åの
酸化膜が形成される事を見出した。この工程を繰り返せ
ば、SiO2中での酸素の拡散によって決定されてしまう膜
厚以上の厚い膜を低温で形成できる。ポリシリコンの膜
厚があまり厚いとそれを酸化して形成される酸化膜が厚
くなってしまい拡散律速の厚さになってしまうので、ポ
リシリコンは数10Å以下が望ましい。また、酸化膜の膜
厚は供給するシリコン分子線量によって決定されるため
に膜厚の制御性も極めて良い。この様な方法ならばたと
え室温で成長しても、耐圧、リーク電流、界面準位密度
共に熱酸化によって形成された酸化膜と同程度のものを
作ることができた。
本方法は、ECR照射して始めに基板を酸化する工程を
行わずにSi分子線を送り薄いポリシリコンを形成してか
らECRによる酸化を行えば、基板を酸化することなくSiO
2を形成することができるため、基板はSiである必要は
なく化合物半導体上でも同様な酸化膜が得られた。
行わずにSi分子線を送り薄いポリシリコンを形成してか
らECRによる酸化を行えば、基板を酸化することなくSiO
2を形成することができるため、基板はSiである必要は
なく化合物半導体上でも同様な酸化膜が得られた。
（実施例） 次に実施例について具体的に説明する。実験は40ccの
電子銃式Si蒸着器及び100WのECR型プラズマ源を備えたM
BE装置を用いて行った。試料ウエハーには４インチｎ型
Si（100）0.01〜0.02Ωcm基板を用いた。98℃CNH4OH系
洗浄液（NH4OH：H2O2：H2O＝1:6:20）で基板を10分間洗
浄し、10分水洗した。乾燥後、形成室内に搬送し10Åの
ａ−Siを堆積後、800℃１分間加熱して清浄化して、成
長温度500℃でバッファ層であるエピタキシャル層を300
0Å成長した。基板温度を室温に下げた後、清浄面にECR
プラズマ源から酸素プラズマを照射して表面を約20Å酸
化した。この時、RHEEDパターンが清浄面を示す2x1から
アモルファスSiO2層が形成されていることを示すハロー
パターンに変化することを確認した。バッシベーション
膜形成室内の酸素分圧は5x10-5Torrであった。5x10-5To
rrにおける気体の平均自由工程は数10cmあるため雰囲気
中での反応は少なく、SiO2形成に関与する反応は表面上
で起こる。この後、基板温度を500℃に上げて電子銃式S
i蒸着器よりSi分子線を供給し、酸素プラズマによって
形成した酸化膜上に10Åのポリシリコン層を形成した。
この時、RHEEDパターンはハローパターンから多結晶シ
リコンが形成された事を示すリングパターンに変化する
事を確かめた。ふたたび、基板温度を室温に下げた後、
ポリシリコン表面にECRプラズマ源より酸素プラズマを
照射して20Åのポリシリコンを完全に酸化した。この
時、RHEEDパターンはリングパターンからハローパター
ンに変化した。
電子銃式Si蒸着器及び100WのECR型プラズマ源を備えたM
BE装置を用いて行った。試料ウエハーには４インチｎ型
Si（100）0.01〜0.02Ωcm基板を用いた。98℃CNH4OH系
洗浄液（NH4OH：H2O2：H2O＝1:6:20）で基板を10分間洗
浄し、10分水洗した。乾燥後、形成室内に搬送し10Åの
ａ−Siを堆積後、800℃１分間加熱して清浄化して、成
長温度500℃でバッファ層であるエピタキシャル層を300
0Å成長した。基板温度を室温に下げた後、清浄面にECR
プラズマ源から酸素プラズマを照射して表面を約20Å酸
化した。この時、RHEEDパターンが清浄面を示す2x1から
アモルファスSiO2層が形成されていることを示すハロー
パターンに変化することを確認した。バッシベーション
膜形成室内の酸素分圧は5x10-5Torrであった。5x10-5To
rrにおける気体の平均自由工程は数10cmあるため雰囲気
中での反応は少なく、SiO2形成に関与する反応は表面上
で起こる。この後、基板温度を500℃に上げて電子銃式S
i蒸着器よりSi分子線を供給し、酸素プラズマによって
形成した酸化膜上に10Åのポリシリコン層を形成した。
この時、RHEEDパターンはハローパターンから多結晶シ
リコンが形成された事を示すリングパターンに変化する
事を確かめた。ふたたび、基板温度を室温に下げた後、
ポリシリコン表面にECRプラズマ源より酸素プラズマを
照射して20Åのポリシリコンを完全に酸化した。この
時、RHEEDパターンはリングパターンからハローパター
ンに変化した。
はじめに、形成された酸化膜の界面準位を調べるため
にMOSキャパシターを試作しCV測定（ターマン法）によ
り界面準位密度を求めた。第１表に分子状のSiと酸素プ
ラズマを同時に供給した従来例の場合と、酸素プラズマ
による酸化とポリシリコンの堆積を繰り返した場合及び
熱酸化の場合の界面準位の比較を示す。酸化膜の膜厚は
60Åであった。
にMOSキャパシターを試作しCV測定（ターマン法）によ
り界面準位密度を求めた。第１表に分子状のSiと酸素プ
ラズマを同時に供給した従来例の場合と、酸素プラズマ
による酸化とポリシリコンの堆積を繰り返した場合及び
熱酸化の場合の界面準位の比較を示す。酸化膜の膜厚は
60Åであった。
表１からわかる様に、分子状のSiと酸素プラズマを同
時に供給した場合には、1012〜1013cm-2であった界面準
位が、酸素プラズマによる酸化とポリシリコンの堆積を
繰り返した場合には約１桁下がり1011cm-2となり、ほぼ
熱酸化膜と同程度まで界面準位密度を下げることができ
た。第４図は同サンプルのＩ−Ｖ測定の結果である。リ
ーク電流は酸素プラズマとSi分子線を用いて形成した膜
（ｃ）では膜中に存在する空孔の影響により多いが、酸
素プラスマによる酸化とポリシリコンの堆積を繰り返し
て形成した膜（ｂ）では、熱酸化膜（ａ）と同じく欠陥
が少なく、リーク電流も少ないことがわかった。
時に供給した場合には、1012〜1013cm-2であった界面準
位が、酸素プラズマによる酸化とポリシリコンの堆積を
繰り返した場合には約１桁下がり1011cm-2となり、ほぼ
熱酸化膜と同程度まで界面準位密度を下げることができ
た。第４図は同サンプルのＩ−Ｖ測定の結果である。リ
ーク電流は酸素プラズマとSi分子線を用いて形成した膜
（ｃ）では膜中に存在する空孔の影響により多いが、酸
素プラスマによる酸化とポリシリコンの堆積を繰り返し
て形成した膜（ｂ）では、熱酸化膜（ａ）と同じく欠陥
が少なく、リーク電流も少ないことがわかった。
最後に、本方法で形成したSiO2/Si界面の平坦正を評
価するためにSi（100）面上に500℃で3000Åのエピタキ
シャルバッファー層を成長後、酸素プラズマによる酸化
とポリシリコンの堆積を繰り返して50ÅのSiO2を形成し
界面の断面格子像を観察した。MBEでバッファー層を成
長しているため界面は極めて平坦であり、界面の乱れは
通常のSi（100）ウエハーを用いた場合、数100Åごとに
観察される１原子層ステップだけであった。これはもと
のMBE成長バッファー層上に存在するものである。この
１原子層ステップの密度はウエハー表面の傾きに依存
し、正確にjust面を使った場合、数1000Åの平坦なテラ
スを得ることができた。
価するためにSi（100）面上に500℃で3000Åのエピタキ
シャルバッファー層を成長後、酸素プラズマによる酸化
とポリシリコンの堆積を繰り返して50ÅのSiO2を形成し
界面の断面格子像を観察した。MBEでバッファー層を成
長しているため界面は極めて平坦であり、界面の乱れは
通常のSi（100）ウエハーを用いた場合、数100Åごとに
観察される１原子層ステップだけであった。これはもと
のMBE成長バッファー層上に存在するものである。この
１原子層ステップの密度はウエハー表面の傾きに依存
し、正確にjust面を使った場合、数1000Åの平坦なテラ
スを得ることができた。
なお、本実施例ではシリコンウエハーを対象とした
が、本発明の方法は表面にのみシリコンが存在するSOS
（Silicon on Sapphire）基板や更に一般にSOI（Silico
n on Insulator）基板等にも当然適用できる。また、本
方法は、Siも表面側から供給するために、本質的に基板
はSiである必要はなく、化合物半導体上でも同様に良質
な酸化膜が得られることを確認した。
が、本発明の方法は表面にのみシリコンが存在するSOS
（Silicon on Sapphire）基板や更に一般にSOI（Silico
n on Insulator）基板等にも当然適用できる。また、本
方法は、Siも表面側から供給するために、本質的に基板
はSiである必要はなく、化合物半導体上でも同様に良質
な酸化膜が得られることを確認した。
また、本実施例では酸化のためにECRプラズマ源から
の酸素イオン（O-）と原子状酸素（Ｏ）を両方用いた
が、これに限る必要はない。酸素イオン（O-）を照射し
たいときはプラズマ源から電極を用いてO-イオンのみを
引き出し他の成分を排気し、原子状酸素（Ｏ）を照射し
たいときはプラズマ源から電極を用いてイオン成分を除
去した後、基板に照射すれば良いことは明らかである。
なおECRプラズマ源からの酸素プラズマには、O-、Ｏの
他に酸素分子（O2）も含まれているが、本発明では低温
で酸化するのでO2は酸化にはほとんど寄与しない。
の酸素イオン（O-）と原子状酸素（Ｏ）を両方用いた
が、これに限る必要はない。酸素イオン（O-）を照射し
たいときはプラズマ源から電極を用いてO-イオンのみを
引き出し他の成分を排気し、原子状酸素（Ｏ）を照射し
たいときはプラズマ源から電極を用いてイオン成分を除
去した後、基板に照射すれば良いことは明らかである。
なおECRプラズマ源からの酸素プラズマには、O-、Ｏの
他に酸素分子（O2）も含まれているが、本発明では低温
で酸化するのでO2は酸化にはほとんど寄与しない。
（発明の効果） 以上、詳細に述べた通り本発明によれば、室温で、電
気的に熱酸化膜と同等な界面準位の極めて少ない酸化膜
の形成を行うことができる。
気的に熱酸化膜と同等な界面準位の極めて少ない酸化膜
の形成を行うことができる。
第１図は、本発明方法の原理の概念図、第２図は、従来
技術の原理の概念図、第３図は、従来技術の原理の概念
図、第４図は、Ｉ−Ｖ特性のSiO2形成方法依存性を示す
図である。
技術の原理の概念図、第３図は、従来技術の原理の概念
図、第４図は、Ｉ−Ｖ特性のSiO2形成方法依存性を示す
図である。
Claims (2)
- 【請求項１】真空槽内で清浄面を出した半導体上に、酸
素イオン（O-）および原子状酸素（Ｏ）のうち少なくと
も一方を照射することにより表面に第１シリコン酸化膜
を形成し、続けて同一真空槽内で第１シリコン酸化膜上
に薄いポリシリコン膜を形成し、酸素イオン（O-）およ
び原子状酸素（Ｏ）のうち少なくとも一方を照射するこ
とによりポリシリコン膜を酸化することを、所望の酸化
膜厚になるまで繰り返すことを特徴とする酸化シリコン
膜の形成方法。 - 【請求項２】第１シリコン酸化膜形成前に薄いポリシリ
コン膜を形成し、酸素イオン（O-）および原子状酸素
（Ｏ）のうち少なくとも一方を照射して前記ポリシリコ
ン膜を酸化して第１シリコン酸化膜を形成する請求項１
に記載の酸化シリコン膜の形成方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34031089A JPH088251B2 (ja) | 1989-12-28 | 1989-12-28 | 酸化シリコン膜の形成方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34031089A JPH088251B2 (ja) | 1989-12-28 | 1989-12-28 | 酸化シリコン膜の形成方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03201434A JPH03201434A (ja) | 1991-09-03 |
| JPH088251B2 true JPH088251B2 (ja) | 1996-01-29 |
Family
ID=18335723
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34031089A Expired - Fee Related JPH088251B2 (ja) | 1989-12-28 | 1989-12-28 | 酸化シリコン膜の形成方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH088251B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5443863A (en) * | 1994-03-16 | 1995-08-22 | Auburn University | Low-temperature oxidation at surfaces using ozone decomposition products formed by microwave discharge |
| JP2013254794A (ja) * | 2012-06-05 | 2013-12-19 | Fujitsu Ltd | 酸化膜の製造方法 |
-
1989
- 1989-12-28 JP JP34031089A patent/JPH088251B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03201434A (ja) | 1991-09-03 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP2937817B2 (ja) | 半導体基板表面の酸化膜の形成方法及びｍｏｓ半導体デバイスの製造方法 | |
| TWI250578B (en) | Semiconductor device and manufacturing method therefor | |
| CN1574226A (zh) | 形成绝缘体上硅锗衬底材料的方法、衬底材料及异质结构 | |
| TW200418185A (en) | A method for making a semiconductor device having an ultra-thin high-k gate dielectric | |
| JPH0648683B2 (ja) | 薄膜酸化物用の成長修正熱酸化方法 | |
| TW200406024A (en) | Manufacture method of semiconductor device with gate insulating films of different thickness | |
| JPH088251B2 (ja) | 酸化シリコン膜の形成方法 | |
| JP2006196910A (ja) | 半導体基板のインサイチュ洗浄方法及びこれを採用する半導体素子の製造方法 | |
| JP3589801B2 (ja) | 半導体基板表面の酸化膜の形成方法 | |
| JP3647850B2 (ja) | 半導体装置およびその製造方法 | |
| JP2000216241A (ja) | 半導体装置の製造方法 | |
| JP3533377B2 (ja) | 半導体基板表面の酸化膜の形成方法及び半導体装置の製造方法 | |
| JPH07297151A (ja) | 半導体装置の製造方法 | |
| US5021358A (en) | Semiconductor fabrication process using sacrificial oxidation to reduce tunnel formation during tungsten deposition | |
| JPH08255770A (ja) | 半導体装置の製造方法 | |
| JP2001127280A (ja) | 半導体装置の製造方法及びｐチャネル型半導体装置の製造方法 | |
| JP2720677B2 (ja) | Ｍｉｓトランジスタとその形成方法 | |
| JPH03166726A (ja) | 酸化シリコン形成方法および形成装置 | |
| JP2001308319A (ja) | 絶縁ゲート型化合物半導体装置 | |
| KR100329745B1 (ko) | 알루미나를 사용한 게이트 절연막 형성방법 | |
| JP4027913B2 (ja) | 半導体装置の製造方法 | |
| CN108417488B (zh) | 一种复合绝缘结构、晶体管以及复合绝缘结构和晶体管的制作方法 | |
| JPH05267281A (ja) | 酸化シリコン層の形成方法 | |
| Lai et al. | The leakage current effect of thin gate oxides (2.4–2.7 nm) with in situ native oxide desorption | |
| JPH04139825A (ja) | シリコン酸化膜の形成方法及びその装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |