JPH09312375A - リードフレーム、半導体装置及び半導体装置の製造方法 - Google Patents

リードフレーム、半導体装置及び半導体装置の製造方法

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JPH09312375A
JPH09312375A JP9008964A JP896497A JPH09312375A JP H09312375 A JPH09312375 A JP H09312375A JP 9008964 A JP9008964 A JP 9008964A JP 896497 A JP896497 A JP 896497A JP H09312375 A JPH09312375 A JP H09312375A
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亮一 太田
Takashi Konno
貴史 今野
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Hitachi Ltd
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Abstract

(57)【要約】 【課題】 多リードの半導体装置のショート或はワイヤ
流れの発生を防止し、ボンディングを安定させることが
可能な技術を提供する。 【解決手段】 絶縁体を介して支持体をインナーリード
に固定し、この支持体に半導体チップを搭載する半導体
チップ搭載領域を設け、前記インナーリードの先端を前
記半導体チップ搭載領域の全周囲にわたって等間隔に配
置することにより、前記インナーリードの先端をより半
導体チップ搭載領域に接近させる。前記インナーリード
の先端を、前記半導体チップ搭載領域の全周囲に配置
し、半導体チップ搭載領域のコーナー部に対応するイン
ナーリード先端のリードピッチを他のインナーリード先
端のリードピッチよりも広くする。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、リードフレーム及
び半導体装置に関し、特に、多リードのリードフレーム
及び半導体装置に適用して有効な技術に関するものであ
る。
【0002】
【従来の技術】LSI等の半導体装置は、集積度の向上
に伴って、より複雑な回路が搭載されその機能も高度な
ものとなっている。このような高機能化によって、半導
体装置にはより多くの外部端子が必要となり、このため
に半導体チップに設けられるパッド電極及び半導体装置
の外部端子であるリードの数もそれに対応して増加する
こととなる。例えば、ロジック半導体装置では、外部端
子の数は数百にも及んでいる。このような多リードの半
導体装置としては、QFP(Quad FlatPac
kage)型の半導体装置が知られている。このQFP
型の半導体装置では、半導体チップを封止する封止体の
四側面に夫々複数のリードを設けるために、多リード化
に適しており、半導体装置を実装基板に実装する場合
に、半導体装置周囲のスペースを有効に利用できるとい
う利点がある。
【0003】このようなQFP型の半導体装置の組み立
てに用いられるリードフレームとしては、例えば日経B
P社刊「VLSIパッケージング技術(上)」、199
3年5月31日発行、P155〜P164に示されてお
り、特にP157及びP159には具体的なパターンが
示されている。
【0004】また、前記微細化によって半導体チップに
形成される素子数が増加し、それらの素子がより高速に
動作するために、半導体チップからの発熱も増大するこ
ととなる。この問題に対処するために放熱性を向上させ
た半導体装置として、例えば前記「VLSIパッケージ
ング技術(下)」P200〜P203にヒートスプレッ
ダを設けた半導体装置が記載されている。この半導体装
置では半導体チップにヒートスプレッダを取り付けるこ
とによって、半導体装置の放熱性を向上させている。
【0005】
【発明が解決しようとする課題】前記多リード化に対応
するために、リードフレームでは、各リード間の間隔で
あるリードピッチ及びリードの幅寸法を小さくすること
が求められている。
【0006】また、同様に半導体チップには前記高機能
化によって多くのパッド電極が設けられており、各パッ
ド電極間の間隔であるパッドピッチも小さくなってい
る。一般に半導体チップのパッド電極のピッチは種々の
ものがあるが、ウエハ当たりのチップ取得数を向上させ
るために、チップサイズは小さいことが望ましく、この
ため各パッド電極間のピッチも一段と小さく設定される
傾向にある。
【0007】このような理由から、多リードと各パッド
電極との間をAu等のワイヤを用いてボンディングする
場合、間隔が小さくなったことにより、隣接するワイヤ
相互が接触するショートが発生しやすくなるという問題
がある。特に半導体チップのコーナー部分では、パッド
電極にボンディングしたワイヤが、半導体チップに対し
て斜め方向にワイヤが伸びるために、パッドピッチが同
一であってもワイヤ相互間の間隔が小さくなるので、そ
の傾向が強くなる。
【0008】また、ワイヤボンディング後の樹脂モール
ドの際に、各リードの機械的強度の低下或はワイヤ間隔
の減少によって、モールド樹脂の流動によりワイヤが変
形するワイヤ流れが生じることがあり、この変形により
ワイヤのショートが発生するという問題がある。
【0009】加えて、QFPでは、中央に搭載された半
導体チップに近づくにつれてリードの配置領域が狭まっ
てくる。このため、リードの加工精度の限界から、リー
ドピッチを半導体チップのパッドピッチに対して充分に
微細化できない場合には、リードの先端を半導体チップ
に近付けることができなくなるので、パッド電極とリー
ドとをボンディングするワイヤを長くせざるを得ない。
このようにワイヤを長くした場合には、前記ショート或
はワイヤ流れの発生の確率が高くなる。
【0010】また、このようなリードの微細化によっ
て、各リードの機械的強度は低下するために、僅かな力
により変形しやすくなり、このような変形によっても前
記ショートが発生する。
【0011】本発明の課題は、多リードの半導体装置の
ショート或はワイヤ流れの発生を防止し、ボンディング
を安定させることが可能な技術を提供することにある。
【0012】本発明の他の課題は、多リードの半導体装
置の放熱特性を向上させることが可能な技術を提供する
ことにある。
【0013】本発明の前記ならびにその他の課題と新規
な特徴は、本明細書の記述及び添付図面から明らかにな
るであろう。
【0014】
【課題を解決するための手段】本願において開示される
発明のうち、代表的なものの概要を簡単に説明すれば下
記の通りである。
【0015】支持体に半導体チップを搭載し、この支持
体に絶縁体を介してインナーリードを固定した半導体装
置について、前記支持体の全面に設けた接着剤層によっ
てインナーリード先端を前記半導体チップ搭載領域の全
周囲に固定する。
【0016】更に、各インナーリード先端のリードピッ
チについて最大のリードピッチが最小のリードピッチの
2倍未満とする。
【0017】更に、半導体チップのコーナー部に対応す
るインナーリード先端のリードピッチを他のリード先端
のリードピッチよりも広くする。
【0018】或は、半導体チップのコーナー部に対応す
るインナーリード間に封止体外に導出しないダミーリー
ドを設ける。
【0019】更に、半導体チップのコーナー部に位置す
るパッド電極のパッドピッチを、他のパッド電極のパッ
ドピッチよりも広くする。
【0020】上述した手段によれば、インナーリード先
端を前記半導体チップ搭載領域の全周囲に固定すること
によって、前記インナーリードの先端をより半導体チッ
プ搭載領域に接近させることが可能となるので、隣接す
るワイヤ相互が接触するショート、或はモールド樹脂の
流動によりワイヤが変形するワイヤ流れが減少する。
【0021】また、コーナー部に対応するインナーリー
ド先端のリードピッチを他のインナーリード先端のリー
ドピッチよりも広くすることが可能となるので、隣接す
るワイヤ相互が接触するショート、或はモールド樹脂の
流動によりワイヤが変形するワイヤ流れが減少する。
【0022】更に、ダミーリードを設けることにより、
樹脂の流れに乱れが生じにくくなるので、ボイドによる
樹脂注入不良が減少する。
【0023】更に、タブ吊りリードがないためにクロス
ボンディングを容易に行なうことが可能となる。
【0024】更に、予め支持体の全面に接着剤層を形成
し、これによってインナーリードを固定することによ
り、支持体付リードフレームの製造工程を容易にし、製
造コストを低減することができる。
【0025】更に、半導体チップを支持体に搭載するこ
とにより、半導体チップで発生した熱は支持体を通じて
外部に放熱可能となっており、半導体チップの放熱特性
を向上させることが可能となる。
【0026】以下、本発明の実施の形態を説明する。な
お、実施の形態を説明するための全図において、同一機
能を有するものは同一符号を付け、その繰り返しの説明
は省略する。
【0027】
【発明の実施の形態】
(実施の形態1)図1は本発明の一実施の形態であるQ
FP型半導体装置に用いられるリードフレームを示す平
面図であり、図2は図1に示すリードフレームの縦断面
図である。リードフレーム1は、例えばFe‐Ni系合
金からなり、中央の半導体チップ(破線にて示す)搭載
領域2の全周囲にわたって複数のリード3のインナーリ
ード4の先端が配置されている。また、前記リードフレ
ーム1は、Cu系合金でもよい。
【0028】各リード3は、ダムバー6により、或はリ
ードフレームの枠体となるタイバー19により一体とな
っており、各リード3のダムバー6内側部分及び外側部
分が夫々インナーリード4及びアウターリード5とな
る。
【0029】このようなリードパターンは、周知のエッ
チング技術、あるいはプレス技術などによって形成さ
れ、通常のQFP型半導体装置では、リード3は数十本
から数百本が配置され、本実施の形態では104本のリ
ード3が配置されている。各リード3のインナーリード
4の先端は、支持体の全面に形成された絶縁性の接着剤
7によって支持体8の表面に固定されている。
【0030】本発明に係るリードフレーム1では、イン
ナーリード4に固定された支持体8の半導体チップ搭載
領域2に半導体チップを固定する。このため、半導体チ
ップを搭載するタブ(ダイパッド)を支持するタブ吊り
リードは設けられておらず、タブ吊りリードの設けられ
ていた領域をインナーリード4の配置に利用している。
【0031】このために、従来タブ吊りリードの設けら
れていたコーナー部にもインナーリード4が配置されて
おり、該部を含む全周囲にて、各インナーリード先端の
間隔であるリードピッチについては、最大のリードピッ
チが最小のリードピッチの2倍未満となっており、各イ
ンナーリード4間には他のリードを配置する余地はなく
なっている。つまり、隣接するインナーリードの先端に
おける許容すべき最大のリード間隔(L)と、リードフ
レームの加工精度、或は設計値により予め決定される最
小のインナーリード間隔(W1)及び最小のインナーリ
ード幅(W2)の関係が次の(式1)を満たすように、
本形態のリードフレームは作成されている。
【0032】
【数1】(L)<2×(W1)+(W2)……(式1) そこで本実施の形態では、前記インナーリード4を、こ
のタブ吊りリードの設けられていた位置を含めた前記半
導体チップ搭載領域の全周囲にわたって等間隔に配置す
ることによって、同一のリードピッチであっても、イン
ナーリード4の先端をより半導体チップ搭載領域2に接
近させることが可能となる。このため、半導体チップの
搭載後にワイヤボンディングを行う際に、ワイヤ長さを
短縮することが可能となり、樹脂封止時のワイヤ流れを
低減しワイヤ間のショートが低減する。
【0033】ここで、支持体8には、熱伝導性の良好な
材料例えばCu系材料、Al系材料等を用いることによ
って、半導体装置の放熱性を向上させることができる。
【0034】また、複数のリード3のインナーリード4
を支持体8に固定することにより、各リード3の機械的
強度が改善されるので、インナーリード4のリードピッ
チを小さくしても、外部からの力によるインナーリード
4の変形が生じにくくなる。このため、ボンディングワ
イヤ間のショートを防止することが可能となる。
【0035】なお、従来のヒートスプレッダを用いた技
術でもタブレスとしたものはあったが、従来はヒートス
プレッダが放熱の問題としてのみ捉えられていた。本発
明によれば、これを積極的にリードピッチの問題解決に
利用し、ボンディングの安定性を向上させるものであ
る。
【0036】次に、図1に示すリードフレーム及びそれ
を用いた半導体装置の製造方法について図2、図3及び
図4を用いて説明する。
【0037】先ず、図3中(a)に示すように、予め支
持体8のインナーリード4と接着される面の全面に接着
剤7を塗布形成する。接着剤としては、例えばエポキシ
樹脂、フェノール樹脂等の熱硬化性樹脂、或はポリエチ
レン、塩化ビニール樹脂等の熱可塑性樹脂等が用いられ
る。支持体8は、金属の薄板を打ち抜き等によって加工
したものであるが、接着剤7の塗布はこの加工前でも加
工後であってもよい。
【0038】全面に接着剤7を塗布することで、接着剤
塗布時のマスキング等を不要にし、支持体8を有するリ
ードフレームの製造コストを低減できる。
【0039】次に、図3中(b)に示すように、パター
ニングされたリードフレーム1の各インナーリード4
を、接着剤7によって支持体8に接着する。この状態が
図2となる。本形態の場合は、300℃程度の熱処理に
よって、接着剤7をキュアし接着した。
【0040】次に、図3中(c)に示すように、半導体
チップ10をAgペースト12によって支持体8の半導
体チップ搭載領域2に接着する。従来は、インナーリー
ド4に接着剤7を塗布し支持体8に接着する方法が採ら
れていたが、この方法では接着剤の塗布時にインナーリ
ードを変形させてしまうために不良品となる等の問題が
あったが、本発明では予め支持体8に塗布した接着剤7
によって、インナーリード4の接着を行なうことによ
り、前述した問題を解決することが可能となる。
【0041】この後、図4に示すように、半導体チップ
10のパッド電極11とインナーリード4とがAu等の
ボンディングワイヤ13によって接続するが、このワイ
ヤボンディングの際に、本実施の形態では、インナーリ
ード4が支持体8に固定されているので、この支持体8
の裏面を真空吸引することによって、インナーリード4
を固定してワイヤボンディングを行うことができるの
で、従来のリードフレームのごとくインナーリードを押
圧固定するウインドクランパを用いる必要がない。
【0042】ワイヤボンディング終了後に、半導体チッ
プ10、支持体8、ボンディングワイヤ13及びインナ
ーリード4が例えばエポキシ樹脂からなる封止体14に
よって封止され、前述したダムバー6及びタイバー19
が切断されて各リード3は電気的に分離される。この
後、封止体14から延在するアウターリード5は、一例
として図4ではガルウイング状に成形されて半導体装置
9が完成する。
【0043】(実施の形態2)次に、本発明の他の実施
の形態である半導体装置を図5及び図6を用いて説明す
る。図5は半導体チップ10のパッド電極11の配置を
説明する平面図であり、図6は半導体チップ10のコー
ナー部分のボンディング状態を説明する部分拡大平面図
である。
【0044】本実施の形態の半導体装置では、インナー
リード4に固定された支持体8の半導体チップ搭載領域
に半導体チップ10を固定する。このため、半導体チッ
プ10を搭載するタブ(ダイパッド)を支持するタブ吊
りリードは設けられておらず、タブ吊りリードの設けら
れていた領域をインナーリード4の配置に利用してい
る。
【0045】このために、従来タブ吊りリードの設けら
れていたコーナー部にもインナーリード4が配置されて
おり、該部を含む全周囲にて各インナーリード先端の間
隔であるリードピッチについては、全周囲にわたって略
等間隔に配置されており、同一のリードピッチであって
も、インナーリード4の先端をより半導体チップ10に
接近させることが可能となる。なお、各インナーリード
4の先端のリードピッチPは、180μm〜220μm
程度に設定される。
【0046】半導体チップ10の外部端子となるパッド
電極11は、半導体チップ10の周縁部に複数設けられ
ているが、本実施の形態では、半導体チップのコーナー
に近づくにつれてパッドピッチを広く設けてある。
【0047】図6に示す例では、半導体チップ10のパ
ッド電極11の内周縁部中央よりのパッドピッチをP1
とした場合に、以降のパッドピッチをコーナーに近づく
につれて、P2=1.1P1,P3=1.2P1,P4
=1.3P1と0.1P1ずつ広くする構成となってい
る。なお、高集積度の半導体装置に用いられる半導体チ
ップ10では、パッド電極11のピッチは80μm〜1
00μm程度に設定される。
【0048】パッド電極11とインナーリード4の先端
とは、ワイヤ13によって接続するボンディングが行な
われているが、パッド電極11はコーナーに近づくにつ
れて、パッドピッチが広く配置されているので、コーナ
ー部分のワイヤ13がワイヤ流れなどによって変形した
場合でも隣接するワイヤ13と接触しショートするのを
防止することができる。なお、ボンディングワイヤ13
としては、直径が25μm〜35μm程度のAu細線等
が用いられている。
【0049】また、半導体チップ10は、ワイヤ13の
取り回し等の点から、周縁部外端のパッド電極11と半
導体チップ10のコーナーを挟んで隣接する他の周縁部
外端のパッド電極11とのパッドピッチP5は、他のパ
ッドピッチより広くなっており、この部分ではリードピ
ッチP6よりも広くなっている。
【0050】また、ワイヤボンディングの際に、本実施
の形態では、インナーリード4が支持体8に固定されて
いるので、この支持体8の裏面を真空吸引することによ
って、インナーリード4を固定してワイヤボンディング
を行うことができるので、従来のリードフレームのごと
くインナーリードを押圧固定するウインドクランパを用
いる必要がない。
【0051】ワイヤボンディング終了後に、半導体チッ
プ10、支持体8、ボンディングワイヤ13及びインナ
ーリード4が例えばエポキシ樹脂からなる封止体14に
よって封止され、ダムバー6及び前記タイバー19が切
断されて各リード3は電気的に分離され、封止体14か
ら延在するアウターリード5は、一例として図4ではガ
ルウイング状に成形されて半導体装置9が完成する。
【0052】このような本実施の形態の半導体装置で
は、ワイヤ流れによる不良品の発生を従来に比較して略
半分に低減することができる。
【0053】なお、前記パッドピッチの拡げ方として
は、前述した周縁部中央から一律に拡げる方法の他に、
コーナー部を部分的に拡げる方法等によっても本発明は
実施が可能である。
【0054】(実施形態3)次に、本発明の他の実施の
形態である半導体装置を図7及び図16を用いて説明す
る。
【0055】図7は本発明の他の実施の形態であるQF
P型半導体装置に用いられるリードフレームを部分的に
示す平面図であり、図16は半導体装置を部分的に示す
平面図である。
【0056】リードフレーム1は、例えばFe‐Ni系
合金又は、Cu系合金からなり、中央の半導体チップ
(破線にて示す)搭載領域2の全周囲にわたって複数の
リード3のインナーリード4の先端が配置されている。
【0057】各リード3のインナーリード4及び半導体
チップ10は、絶縁性の接着剤によって支持体8の表面
に固定されている。接着剤としては、例えばエポキシ樹
脂、フェノール樹脂等の熱硬化性樹脂、或はポリエチレ
ン、塩化ビニール樹脂等の熱可塑性樹脂等が用いられ
る。
【0058】本実施の形態の半導体装置では、インナー
リード4に固定された支持体8の半導体チップ搭載領域
に半導体チップ10を固定する。このため、半導体チッ
プ10を搭載するタブ(ダイパッド)を支持するタブ吊
りリードは設けられておらず、タブ吊りリードの設けら
れていた領域をインナーリード4の配置に利用すること
ができる。
【0059】そこで本実施の形態では、インナーリード
4の先端を、半導体チップ搭載領域2の全周囲に配置
し、半導体チップ搭載領域2のコーナー部に対応するイ
ンナーリード4先端のリードピッチを他のインナーリー
ド4先端のリードピッチよりも広くすることが可能とな
る。このため、半導体チップの搭載後にワイヤボンディ
ングを行う際に、ワイヤ13相互の間隔が広くなり、ワ
イヤ13間のショートが低減する。
【0060】ここで、支持体8には、熱伝導性の良好な
材料例えばCu系材料、Al系材料等を用いることによ
って、半導体装置の放熱性を向上させることができる。
【0061】また、複数のリード3のインナーリード4
を支持体8に固定することにより、各リード3の機械的
強度が改善されるので、インナーリード4のリードピッ
チを小さくしても、外部からの力による変形が生じにく
くなる。このため、ボンディングワイヤ13間のショー
トを防止することが可能となる。
【0062】また、パッド電極11は、半導体チップ1
0の周縁部に複数設けられているが、本実施の形態で
は、半導体チップのコーナーに近づくにつれてパッドピ
ッチを広く設けてある。なお、高集積度の半導体装置に
用いられる半導体チップ10では、パッド電極11のピ
ッチは80μm〜100μm程度に設定される。
【0063】パッド電極11とインナーリード4の先端
とは、ワイヤ13によって接続するボンディングが行な
われているが、パッド電極11はコーナーに近づくにつ
れて、パッドピッチが広く配置されているので、コーナ
ー部分のワイヤ13がワイヤ流れなどによって変形した
場合でも隣接するワイヤ13と接触しショートするのを
防止することができる。なお、ボンディングワイヤ13
としては、直径が25μm〜35μm程度のAu細線等
が用いられている。
【0064】また、半導体チップ10は、ある程度の汎
用性をもたせるために、周縁部外端のパッド電極11と
隣接する他の周縁部外端のパッド電極11とのパッドピ
ッチは、他のパッドピッチより広くなっており、リード
ピッチよりも広くなることもある。このような場合に前
記外端のパッド電極11をよりコーナーに近付けてパッ
ドピッチの拡大を図ることも可能である。
【0065】また、ワイヤボンディングの際に、本実施
の形態では、インナーリード4が支持体8に固定されて
いるので、この支持体8の裏面を真空吸引することによ
って、インナーリード4を固定してワイヤボンディング
を行うことができるので、従来のリードフレームのごと
くインナーリードを押圧固定するウインドクランパを用
いる必要がない。
【0066】ワイヤボンディング終了後に、半導体チッ
プ10、支持体8、ボンディングワイヤ13及びインナ
ーリード4が例えばエポキシ樹脂からなる封止体14に
よって封止され、ダムバー6及び前記タイバー19が切
断されて各リード3は電気的に分離され、封止体14か
ら延在するアウターリード5は成形されて半導体装置9
が完成する。
【0067】このような本実施の形態の半導体装置で
は、ワイヤ流れによる不良品の発生を従来に比較して略
半分に低減することができる。
【0068】なお、前記パッドピッチの拡げ方として
は、前述した周縁部中央から一律に拡げる方法の他に、
コーナー部を部分的に拡げる方法等によっても本発明は
実施が可能である。
【0069】(実施の形態4)次に、本発明の他の実施
の形態であるリードフレームを図17を用いて説明す
る。図17はリードフレームを説明する部分拡大平面図
である。
【0070】本実施の形態のリードフレーム1では、イ
ンナーリード4に固定された支持体8の半導体チップ搭
載領域2に半導体チップ(破線にて示す)を固定する。
このため、半導体チップ10を搭載するタブ(ダイパッ
ド)を支持するタブ吊りリードは設けられておらず、タ
ブ吊りリードの設けられていた領域をインナーリード4
の配置に利用している。
【0071】このようなインナーリード4の配置を行な
った場合には、コーナー部におけるアウターリード5の
配置については、アウターリード5の保護或は樹脂注入
流路の確保等のために、封止体14のコーナーから若干
離してアウターリード5が配置されることとなる。この
ため、封止体14のコーナー部ではインナーリード4が
配置されない空間が生じてしまうことがある。
【0072】このような空間が生じた場合には、樹脂注
入時にこの部分にて注入された樹脂の流れに乱れが生じ
るためにボイドが発生し樹脂注入不良の原因となること
がある。
【0073】このような問題を解決するために本実施の
形態では、従来タブ吊りリードの設けられていたコーナ
ー部に、リードフレーム切除後は封止体外に導出しない
ダミーのインナーリードであるダミーリード20を設け
る。ダミーリード20は、他のインナーリード4よりも
幅広で先端がインナーリード4の先端よりも外方に設け
られており、インナーリード4の先端は、半導体チップ
搭載領域2の全周囲にわたって配置されている。
【0074】本実施の形態ではこのダミーリード20に
よって樹脂の流れに乱れが生じるのを防止する。従っ
て、このような本実施の形態の半導体装置では、ボイド
による樹脂注入不良品の発生を低減することができる。
【0075】また、支持板8の四隅を幅広のダミーリー
ド20で固定することによって、支持板8をより強固に
支持することが可能となる。
【0076】更に、リードフレームの状態で工程間を搬
送するリードフレーム搬送では、リードフレーム切断前
のこのダミーリード20の封止体導出部を保持すること
によって搬送を行なうことが可能であり、アウターリー
ド5を保持して搬送することにより生じるアウターリー
ド5の変形を防止することができる。
【0077】(実施の形態5)次に、本発明の他の実施
の形態である半導体装置を図18及び図19を用いて説
明する。図18は本発明者が本発明に至る段階で検討し
た半導体装置を説明する部分拡大平面図であり、図19
は本実施の形態の半導体装置を説明する部分拡大平面図
である。
【0078】図18に示す半導体装置では、インナーリ
ードと半導体チップのパッド電極との接続は、インナー
リードと、このインナーリードに対向する半導体チップ
の辺に設けられたパッド電極とが接続されている。
【0079】しかしながら、同一の半導体チップを異種
の封止体に封止する必要がある場合等に、前記半導体チ
ップのコーナー部に対応するインナーリード先端が、こ
のインナーリードと対向する半導体チップの辺とコーナ
ーを挟んで隣接する他の辺に設けられた半導体チップの
パッド電極と接続されるクロスボンディングが要求され
ることがある。
【0080】このような場合に、図18に示す如く半導
体チップ10をタブ21に固定し、このタブ21をタブ
吊りリード22によつて支持する従来の半導体装置で
は、ボンディングワイヤ13がタブ吊りリード22上を
横切ることとなる。このため、ボンディングワイヤ13
とタブ吊りリード22との接触による不良の発生を防止
するために、このようなボンディングには種々の制限が
設けられており、ボンディングが困難であった。
【0081】本実施の形態の半導体装置では、インナー
リード4に固定された支持体8に半導体チップ10を固
定する。このため、半導体チップ10を搭載するタブ2
1(ダイパッド)及びこのタブを支持するタブ吊りリー
ド22は設けられておらず、タブ吊りリード22の設け
られていた領域をインナーリード4の配置に利用してい
る。
【0082】このようなインナーリード4の配置を行な
うことによつて、前述したクロスボンディングを行なっ
ても、ボンディングワイヤ13とタブ吊りリード22と
の接触による不良の発生がなくなり、製品の信頼性が向
上することとなる。
【0083】また、前記クロスボンディングを容易に行
なうことが可能となり、ボンディングの自由度が向上す
ることとなる。
【0084】(実施の形態6)図8は本発明の他の実施
の形態であるリードフレームを示す断面図であり、図9
はこのリードフレームを用いて製造した半導体装置を示
す縦断面図である。
【0085】本実施の形態によるリードフレーム1は、
既述した実施の形態によるリードフレームの構成に加え
て、支持体8の半導体チップ搭載領域2とインナーリー
ド4先端との間に、ワイヤ支持部15を設けたことを特
徴としている。
【0086】このワイヤ支持部15は、支持体8の搭載
領域2の周囲に配置され、半導体装置を組み立てると
き、半導体チップのパッド電極と各リードとの間にボン
ディングされるワイヤのループを一定の高さに支持する
ことができる。ワイヤ支持部15は、例えばポリイミド
樹脂、エポキシ樹脂などの絶縁材料を接着剤等によって
支持体8に固定する、或は、支持体8を部分的に加工し
て、少なくともワイヤが接する部分を絶縁処理すること
によって形成する。
【0087】このような、実施の形態によるリードフレ
ーム1によれば、ボンディングワイヤを支持するワイヤ
支持部15を有しているので、ワイヤのループ高さを一
定に確保することができるため、ワイヤ相互のショート
を低減することができるという効果が得られる。
【0088】(実施の形態7)図10は本発明の他の実
施の形態であるリードフレームを示す断面図であり、図
11はこのリードフレームを用いて製造した半導体装置
を示す縦断面図である。
【0089】本実施の形態によるリードフレーム1は、
既述した実施の形態によるリードフレームの構成に加え
て、支持体8の半導体チップ搭載領域2とインナーリー
ド4先端との間に、支持体8を保持する治具16に設け
たワイヤ支持部15を突出させるスリット17を設けた
ことを特徴としている。
【0090】リードフレーム1を治具16保持した際
に、治具16に設けられたワイヤ支持部15が、このス
リット17から突出することとなる。ワイヤ支持部15
は、ワイヤボンディング終了後にスリット17から退避
することとなるので、絶縁性の有無を問われない。
【0091】本実施の形態では、治具16に設けたワイ
ヤ支持部15をリードフレーム1のスリット17に挿入
することにより、ボンディングが安定するという効果が
得られる。
【0092】(実施の形態8)図12は本発明の他の実
施の形態であるリードフレームを示す断面図であり、図
13はこのリードフレームを用いて製造した半導体装置
を示す縦断面図である。
【0093】本実施の形態によるリードフレーム1は、
既述した実施の形態によるリードフレームの構成に加え
て、支持体8の半導体チップ搭載領域2が、搭載する半
導体チップ10のパッド電極11とインナーリード4表
面とが略同じ高さとなるべくオフセットされていること
を特徴としている。このようなオフセット形状は、周知
のプレス技術などを利用することにより容易に加工する
ことができる。
【0094】このような加工を行なうことによって、イ
ンナーリード4表面の高さ位置H1と搭載される半導体
チップ10の表面の高さ位置H2とを略等しくすること
により、半導体チップ10のパッド電極11と各インナ
ーリード4とのワイヤボンディングの際に、ボンディン
グされるワイヤ13のループの安定性を高めることがで
きる。ワイヤ13のループの安定性を高めることによっ
て、ループ形状が一定となるので樹脂モールド時におけ
るワイヤ流れを減少することが可能となる。
【0095】(実施の形態9)図14は本発明の他の実
施の形態であるリードフレームに用いられる支持体8を
示す平面図であり、図15はこの支持体8に半導体チッ
プ10を搭載した状態を示す平面図である。
【0096】本実施の形態によるリードフレーム1は、
既述した実施の形態によるリードフレーム1の構成に加
えて、支持体8の表面に、搭載される半導体チップ10
の各種寸法に対応した複数のマーカ18を設けたことを
特徴としている。このようなマーカ18は、印刷、プレ
スなどの技術によって、容易に設けることができる。
【0097】このように、搭載される半導体チップのサ
イズに対応したマーカ18を設けることにより、半導体
チップを搭載する際に、半導体チップを搭載する正確な
位置の確認が容易になるので、半導体チップのチップボ
ンディング作業の効率が向上する。
【0098】更に、半導体チップの位置決め精度が向上
するので、ワイヤの長さを一定に保つことが可能とな
り、ボンディングワイヤのループを安定に保つことがで
きる。ワイヤのループの安定性を高めることによって、
ループ形状が一定となるので樹脂モールド時におけるワ
イヤ流れを減少することが可能となる。
【0099】以上、本発明者によってなされた発明を、
前記実施の形態に基づき具体的に説明したが、本発明
は、前記実施の形態に限定されるものではなく、その要
旨を逸脱しない範囲において種々変更可能であることは
勿論である。
【0100】例えば、前記実施の形態では各リードが固
定される支持体として方形状のものを例示したが、支持
体として円形状のものを用いることも可能である。この
ような円形状の支持体を用いた場合には、樹脂モールド
時に樹脂の流れがスムーズになるので、ボイドの発生を
減少できるという効果が得られる。
【0101】また、前記実施の形態で用いた支持体にア
ースボンドを目的としたボンディングエリアを設けるこ
とによって、アースボンド対応可能なリードフレームと
して更に広い用途への適用が可能となる。
【0102】さらに、支持体に対して搭載する半導体チ
ップは1個に限定されず、複数個の半導体チップを搭載
することも可能であり、これによりマルチチップの半導
体装置に本発明を適用することも可能である。
【0103】以上の説明では、主として本発明者によっ
てなされた発明をその背景となった利用分野である半導
体装置に適用した場合について説明したが、それに限定
されるものではなく、本発明は、リードフレームを用い
て電子部品を実装するものには広く適用が可能である。
【0104】
【発明の効果】本願において開示される発明のうち代表
的なものによって得られる効果を簡単に説明すれば、下
記の通りである。
【0105】(1)本発明によれば、インナーリードの
先端を前記半導体チップ搭載領域の全周囲にわたって等
間隔に配置することにより、前記インナーリードの先端
をより半導体チップ搭載領域に接近させることができる
という効果がある。
【0106】(2)本発明によれば、上記効果(1)に
より、ボンディングワイヤの長さを短縮することができ
るという効果がある。
【0107】(3)本発明によれば、インナーリードの
先端を、前記半導体チップ搭載領域の全周囲に配置し、
半導体チップ搭載領域のコーナー部に対応するインナー
リード先端のリードピッチを他のインナーリード先端の
リードピッチよりも広くすることができるという効果が
ある。
【0108】(4)本発明によれば、上記効果(3)に
より、コーナー部にてボンディングワイヤ相互の間隔が
広くなるという効果がある。
【0109】(5)本発明によれば、上記効果(2)
(4)により、隣接するワイヤ相互が接触するショー
ト、或はモールド樹脂の流動によりワイヤが変形するワ
イヤ流れが減少するという効果がある。
【0110】(6)本発明によれば、半導体チップを支
持体に搭載することにより、半導体チップで発生した熱
は支持体を通じて外部に放熱可能となっており、半導体
チップの放熱特性を向上させることが可能となるという
効果がある。
【0111】(7)本発明によれば、ダミーリードを設
けることにより、注入する樹脂の流れの乱れによるボイ
ドの発生を防止することが可能となるという効果があ
る。
【0112】(8)本発明によれば、タブ吊りリードを
なくすことにより、クロスボンディングを容易に行なう
ことが可能となるという効果がある。
【0113】(9)本発明によれば、支持体に予め接着
剤を形成することにより、支持体付リードフレームの製
造工程を容易にし、製造コストを低減することが可能と
なるという効果がある。
【図面の簡単な説明】
【図1】本発明の一実施の形態であるリードフレームを
示す平面図である。
【図2】図1に示すリードフレームの縦断面図である。
【図3】本発明の一実施の形態であるリードフレームの
製造方法を示す縦断面図である。
【図4】本発明の一実施の形態である半導体装置を示す
縦断面図である。
【図5】本発明の他の実施の形態である半導体装置に用
いられる半導体チップを示す平面図である。
【図6】図5の部分的に拡大して示す平面図である。
【図7】図7は本発明の他の実施の形態であるQFP型
半導体装置に用いられるリードフレームを部分的に示す
平面図である。
【図8】本発明の他の実施の形態であるリードフレーム
を示す断面図である。
【図9】図8に示すリードフレームを用いて製造した半
導体装置を示す縦断面図である。
【図10】本発明の他の実施の形態であるリードフレー
ムを示す断面図である。
【図11】図10に示すリードフレームを用いて製造し
た半導体装置を示す縦断面図である。
【図12】本発明の他の実施の形態であるリードフレー
ムを示す断面図である。
【図13】図12に示すリードフレームを用いて製造し
た半導体装置を示す縦断面図である。
【図14】本発明の他の実施の形態であるリードフレー
ムに用いられる支持体8を示す平面図である。
【図15】図14に示す支持体8に半導体チップ10を
搭載した状態を示す平面図である。
【図16】図16は本発明の他の実施の形態である半導
体装置を部分的に示す平面図である。
【図17】図17は本発明の他の実施の形態である半導
体装置を部分的に示す平面図である。
【図18】図18は本発明者が本発明に至る段階で検討
した半導体装置を部分的に示す平面図である。
【図19】図19は本発明の他の実施の形態である半導
体装置を部分的に示す平面図である。
【符号の説明】
1…リードフレーム、2…半導体チップ搭載領域、3…
リード、4…インナーリード、5…アウターリード、6
…ダムバー、7…接着剤、8…支持体、9…半導体装
置、10…半導体チップ、11…パッド電極、12…接
着剤、13…ボンディングワイヤ、14…封止体、15
…ワイヤ支持部、16…治具、17…スリット、18…
マーカ、19…タイバー、20…ダミーリード、21…
タブ、22…タブ吊りリード、P1,P2,P3,P
4,P5…パッド電極のピッチ、P6…コーナー部のリ
ードピッチ、H1…支持体の表面の高さ位置、H2…支
持体の中央位置(半導体チップの搭載位置)の高さ位
置。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 長野 宗一 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内 (72)発明者 平野 次彦 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内 (72)発明者 太田 亮一 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内 (72)発明者 今野 貴史 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内 (72)発明者 建部 堅一 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内 (72)発明者 岡本 敏昭 北海道亀田郡七飯町字中島145番地 日立 北海セミコンダクタ株式会社内

Claims (22)

    【特許請求の範囲】
  1. 【請求項1】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れていることを特徴とする半導体装置。
  2. 【請求項2】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、各インナーリード先端のリードピッチについて最大
    のリードピッチが最小のリードピッチの2倍未満となっ
    ていることを特徴とする半導体装置。
  3. 【請求項3】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、半導体チップのコーナー部に対応するインナーリー
    ド先端のリードピッチを他のリード先端のリードピッチ
    よりも広くしたことを特徴とする半導体装置。
  4. 【請求項4】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、各インナーリード先端のリードピッチについて最大
    のリードピッチが最小のリードピッチの2倍未満となっ
    ており、半導体チップのコーナー部に対応するインナー
    リード先端のリードピッチを他のリード先端のリードピ
    ッチよりも広くしたことを特徴とする半導体装置。
  5. 【請求項5】 前記半導体チップコーナー部に対応する
    インナーリード先端のリードピッチを、半導体チップの
    コーナーに近づくにつれて広くしたことを特徴とする請
    求項3又は請求項4に記載の半導体装置。
  6. 【請求項6】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、 半導体チップのコーナー部に対応するインナーリード間
    に封止体外に導出しないダミーリードを設けたことを特
    徴とする半導体装置。
  7. 【請求項7】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、各インナーリード先端のリードピッチについて最大
    のリードピッチが最小のリードピッチの2倍未満となっ
    ており、 半導体チップのコーナー部に対応するインナーリード間
    に封止体外に導出しないダミーリードを設けたことを特
    徴とする半導体装置。
  8. 【請求項8】 前記ダミーリードの先端が前記インナー
    リードの先端よりも外方にあることを特徴とする請求項
    6又は請求項7に記載の半導体装置。
  9. 【請求項9】 支持体に半導体チップを搭載し、この支
    持体に絶縁体を介してインナーリードを固定した半導体
    装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、前記半導体チップのコーナー部に位置するパッド電
    極のパッドピッチを、他のパッド電極のパッドピッチよ
    りも広くしたことを特徴とする半導体装置。
  10. 【請求項10】 支持体に半導体チップを搭載し、この
    支持体に絶縁体を介してインナーリードを固定した半導
    体装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、各インナーリード先端のリードピッチについて最大
    のリードピッチが最小のリードピッチの2倍未満となっ
    ており、前記半導体チップのコーナー部に位置するパッ
    ド電極のパッドピッチを、他のパッド電極のパッドピッ
    チよりも広くしたことを特徴とする半導体装置。
  11. 【請求項11】 前記半導体チップの複数のパッド電極
    のパッドピッチを、半導体チップのコーナーに近づくに
    つれて広くしたことを特徴とする請求項9又は請求項1
    0に記載の半導体装置。
  12. 【請求項12】 支持体に半導体チップを搭載し、この
    支持体に絶縁体を介してインナーリードを固定した半導
    体装置であって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、 前記半導体チップのコーナー部に対応するインナーリー
    ド先端が、このインナーリードと対向する半導体チップ
    の辺とコーナーを挟んで隣接する他の辺に設けられた半
    導体チップのパッド電極にクロスボンディングされてい
    ることを特徴とする半導体装置。
  13. 【請求項13】 前記半導体チップのコーナーを挟んで
    隣接するパッド電極のパッドピッチが、これらのパッド
    電極に対応するインナーリード先端のリードピッチより
    も広くなっていることを特徴とする請求項1乃至請求項
    12の何れか一項に記載の半導体装置。
  14. 【請求項14】 前記インナーリードの先端を前記半導
    体チップの全周囲にわたって配置することにより、前記
    インナーリードの先端をより半導体チップに接近させた
    ことを特徴とする請求項1乃至請求項13の何れか一項
    に記載の半導体装置。
  15. 【請求項15】 前記インナーリードは、絶縁性の接着
    剤を介して支持体に固定されたことを特徴とする請求項
    1乃至請求項14の何れか一項に記載の半導体装置。
  16. 【請求項16】 前記支持体は、熱伝導性の良好な材料
    からなることを特徴とする請求項1乃至請求項15の何
    れか一項に記載の半導体装置。
  17. 【請求項17】 前記支持体の半導体チップとインナー
    リード先端との間に、ワイヤ支持部を設けたことを特徴
    とする請求項1乃至請求項16の何れか一項に記載の半
    導体装置。
  18. 【請求項18】 前記支持体の半導体チップとインナー
    リード先端との間に、ワイヤ支持部を突出させるスリッ
    トを設けたことを特徴とする請求項1乃至請求項16の
    何れか一項に記載の半導体装置。
  19. 【請求項19】 前記支持体の半導体チップ搭載領域
    が、搭載する半導体チップのパッド電極とインナーリー
    ド表面とが略同じ高さとなるべくオフセットされている
    ことを特徴とする請求項1乃至請求項18の何れか一項
    に記載の半導体装置。
  20. 【請求項20】 支持体の半導体チップ搭載領域に半導
    体チップを搭載し、この支持体に絶縁体を介してインナ
    ーリードを固定した半導体装置の製造方法であって、 前記支持体の全面に形成した接着剤層によつてインナー
    リードを支持体の半導体チップ搭載領域の全周囲に固定
    する工程と、 前記半導体チップを支持体の半導体チップ搭載領域に固
    定する工程と、 前記インナーリードと前記半導体チップとをボンディン
    グする工程とを有することを特徴とする半導体装置の製
    造方法。
  21. 【請求項21】 半導体チップを搭載する半導体チップ
    搭載領域を支持体に設け、この半導体チップ搭載領域の
    周囲に絶縁体を介してインナーリードを固定したリード
    フレームであって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ードの先端を前記半導体チップ搭載領域の全周囲に固定
    することを特徴とするリードフレーム。
  22. 【請求項22】 半導体チップを搭載する半導体チップ
    搭載領域を支持体に設け、この半導体チップ搭載領域の
    周囲に絶縁体を介してインナーリードを固定したリード
    フレームであって、 前記支持体の全面に設けた接着剤層によってインナーリ
    ード先端が前記半導体チップ搭載領域の全周囲に固定さ
    れ、各インナーリード先端のリードピッチについて最大
    のリードピッチが最小のリードピッチの2倍未満となっ
    ていることを特徴とするリードフレーム。
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