JPH1012796A - 半導体装置 - Google Patents
半導体装置Info
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- JPH1012796A JPH1012796A JP8167283A JP16728396A JPH1012796A JP H1012796 A JPH1012796 A JP H1012796A JP 8167283 A JP8167283 A JP 8167283A JP 16728396 A JP16728396 A JP 16728396A JP H1012796 A JPH1012796 A JP H1012796A
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- lead
- lead frame
- semiconductor device
- semiconductor chip
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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-
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W44/20—Electrical arrangements for controlling or matching impedance at high-frequency [HF] or radio frequency [RF]
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W72/5449—Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Lead Frames For Integrated Circuits (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】
【課題】 リードフレームを用いて形成する半導体装
置において、パッケージの一辺の側にのみ引出し用端子
があるために、反対側のパッドと接続するためのリード
がアイランド部を囲んで設けられて、必要箇所にアイラ
ンド部の吊りピンを設けることが困難な場合に、必要箇
所に吊りピンを設けてアイランド部の安定化をはかる。 【解決手段】引出し用端子の側と反対側のパッド4bを
接続するためのリードフレームを2分割して1a,1b
とし、リードの端部1a1と1b1の間に必要とする吊り
ピン6を設ける。半導体チップ2の配線7にパッド4c
を設け、端部1a 1,1b1とボンディングワイヤ3cで
接続してリドフレーム1aとbを電気的に接続する。
置において、パッケージの一辺の側にのみ引出し用端子
があるために、反対側のパッドと接続するためのリード
がアイランド部を囲んで設けられて、必要箇所にアイラ
ンド部の吊りピンを設けることが困難な場合に、必要箇
所に吊りピンを設けてアイランド部の安定化をはかる。 【解決手段】引出し用端子の側と反対側のパッド4bを
接続するためのリードフレームを2分割して1a,1b
とし、リードの端部1a1と1b1の間に必要とする吊り
ピン6を設ける。半導体チップ2の配線7にパッド4c
を設け、端部1a 1,1b1とボンディングワイヤ3cで
接続してリドフレーム1aとbを電気的に接続する。
Description
【0001】
【発明の属する技術分野】本発明は半導体装置に関し、
特にリードフレームを用いたパッケージ形態を有する半
導体装置に関する。
特にリードフレームを用いたパッケージ形態を有する半
導体装置に関する。
【0002】
【従来の技術】従来この種類の半導体装置は、図2に示
すように、ボディ内側の縁29aからボディ内側29内
へリードフレーム20のフィンガー状のリード21を突
出させ、半導体チップ22のパッド24と各リード21
とを、ボンディングワイヤ23で放射状に接続して形成
しているため、リードフレーム20のパターンは規則的
で単純な形状をなしていた。したがって、半導体チップ
22を搭載するためのアイランド部25をボディ内側2
9内に保持する吊りピン26は、リードフレーム20の
パターンの間に容易に設けることができ、図示のように
アイランド部25の4辺に設けることができるので、樹
脂封止工程においてアイランド部25は傾斜することな
く位置は安定しており、容易にパッケージを形成するこ
とができた。
すように、ボディ内側の縁29aからボディ内側29内
へリードフレーム20のフィンガー状のリード21を突
出させ、半導体チップ22のパッド24と各リード21
とを、ボンディングワイヤ23で放射状に接続して形成
しているため、リードフレーム20のパターンは規則的
で単純な形状をなしていた。したがって、半導体チップ
22を搭載するためのアイランド部25をボディ内側2
9内に保持する吊りピン26は、リードフレーム20の
パターンの間に容易に設けることができ、図示のように
アイランド部25の4辺に設けることができるので、樹
脂封止工程においてアイランド部25は傾斜することな
く位置は安定しており、容易にパッケージを形成するこ
とができた。
【0003】しかしながら、電子機器回路が益々複雑高
度の機能をもつようになって、半導体装置に要求される
高速動作の実現や、実装面積の低減を図るために、パッ
ケージの引出し用端子や半導体チップのパッドの配置が
特殊化するにつれて、リードフレームのパターンが複雑
化し、例えば図3に示すように、パッケージの引出し用
端子がパッケージの一辺の側、すなわちボディ内側の縁
39aの側にのみ設けられ、しかもチップ32上のパッ
ド34bが引出し用端子の側とは反対側の辺上に在るよ
うな場合には、反対側のパッド34bをボンディングす
るためには、引出し用端子のある側からリードフレーム
を伸ばして、チップ32の周囲を囲むような伸ばしたリ
ード31aを配置するようになっていた。そのためアイ
ランド部35を保持するための吊りピン36をアイラン
ド周囲の必要な箇所、この場合はアイランド部35の左
右の辺に設けられないことがあった。
度の機能をもつようになって、半導体装置に要求される
高速動作の実現や、実装面積の低減を図るために、パッ
ケージの引出し用端子や半導体チップのパッドの配置が
特殊化するにつれて、リードフレームのパターンが複雑
化し、例えば図3に示すように、パッケージの引出し用
端子がパッケージの一辺の側、すなわちボディ内側の縁
39aの側にのみ設けられ、しかもチップ32上のパッ
ド34bが引出し用端子の側とは反対側の辺上に在るよ
うな場合には、反対側のパッド34bをボンディングす
るためには、引出し用端子のある側からリードフレーム
を伸ばして、チップ32の周囲を囲むような伸ばしたリ
ード31aを配置するようになっていた。そのためアイ
ランド部35を保持するための吊りピン36をアイラン
ド周囲の必要な箇所、この場合はアイランド部35の左
右の辺に設けられないことがあった。
【0004】
【発明が解決しようとする課題】上述した従来の半導体
装置のうち、パッケージの引出し用端子がパッケージの
一辺の側にしか設けられず、しかもチップ上のパッドが
引出し用端子とは反対側の辺上にも在る場合には、引出
し用端子のある側からリードフレームを伸ばしてチップ
の周囲を囲むような伸ばしたリードを配置する必要があ
るために、アイランド部を保持するための連結部(吊り
ピン)をアイランドの周囲の必要箇所に設けることがで
きず、連結部の数が減って樹脂封入工程でアイランド部
が不安定となって傾斜し、遂にはアイランド部がパッケ
ージから突出するという不具合を生じる欠点がある。
装置のうち、パッケージの引出し用端子がパッケージの
一辺の側にしか設けられず、しかもチップ上のパッドが
引出し用端子とは反対側の辺上にも在る場合には、引出
し用端子のある側からリードフレームを伸ばしてチップ
の周囲を囲むような伸ばしたリードを配置する必要があ
るために、アイランド部を保持するための連結部(吊り
ピン)をアイランドの周囲の必要箇所に設けることがで
きず、連結部の数が減って樹脂封入工程でアイランド部
が不安定となって傾斜し、遂にはアイランド部がパッケ
ージから突出するという不具合を生じる欠点がある。
【0005】この欠点を除くために、図4に示すよう
に、アイランド部45の周囲の連結部を必要とする部分
46aと、チップ42を囲むように伸ばして配置された
リード41aの部分とを、ポリイミド系テープで形成さ
れたシール48などで接続して固定するという方法もあ
るが、この場合はシール材の分だけコストが高くなると
いう欠点がある。
に、アイランド部45の周囲の連結部を必要とする部分
46aと、チップ42を囲むように伸ばして配置された
リード41aの部分とを、ポリイミド系テープで形成さ
れたシール48などで接続して固定するという方法もあ
るが、この場合はシール材の分だけコストが高くなると
いう欠点がある。
【0006】本発明の目的は、リードフレームを用いて
形成する半導体装置において、パッケージの引出し用端
子がパッケージの一辺の側にのみ設けられ、しかも半導
体チップ上のパッドが引出し用端子とは反対側の辺上に
あるため、チップの周囲を囲んで設けられたリードに妨
げられて、アイランド部を保持する連結部を必要箇所に
設けることが困難な場合であっても、アインランド部が
樹脂封止工程において傾斜せず、安定した半導体チップ
を具備した半導体装置を提供することにある。
形成する半導体装置において、パッケージの引出し用端
子がパッケージの一辺の側にのみ設けられ、しかも半導
体チップ上のパッドが引出し用端子とは反対側の辺上に
あるため、チップの周囲を囲んで設けられたリードに妨
げられて、アイランド部を保持する連結部を必要箇所に
設けることが困難な場合であっても、アインランド部が
樹脂封止工程において傾斜せず、安定した半導体チップ
を具備した半導体装置を提供することにある。
【0007】
【課題を解決するための手段】本発明の半導体装置は、
リードフレームパターンの中央部に配設されたアイラン
ド部に搭載された半導体チップと、リードフレームと
を、電気的に接続して形成する半導体装置であって、半
導体チップの少なくとも一辺に沿って配設されたリード
フレームの少なくとも1個のリードが、少なくとも2個
に分割されて、分割された両端部の間の間隙を横切るア
イランド部を保持するための連結部と、分割されたリー
ドの両端部を電気的に接続するために、半導体チップに
設けられた配線の一部分と、リードの両端部とを電気的
に接続する手段とを有している。
リードフレームパターンの中央部に配設されたアイラン
ド部に搭載された半導体チップと、リードフレームと
を、電気的に接続して形成する半導体装置であって、半
導体チップの少なくとも一辺に沿って配設されたリード
フレームの少なくとも1個のリードが、少なくとも2個
に分割されて、分割された両端部の間の間隙を横切るア
イランド部を保持するための連結部と、分割されたリー
ドの両端部を電気的に接続するために、半導体チップに
設けられた配線の一部分と、リードの両端部とを電気的
に接続する手段とを有している。
【0008】このように形成された本発明の半導体装置
を用いることにより、パッケージの引き出し用端子や半
導体チップのパッドの配列が特殊化してリードフレーム
のパターンが複雑化し、そのためにアイランド部を保持
する連結部を設ける必要のある箇所が、リードフレーム
によって妨げられて、必要とする箇所に連結部を設ける
ことが出来ない場合であっても、リードフレームを切断
して間隙を設け、その間隙に連結部を設けることができ
る。したがってアイランド部は安定して保持され、樹脂
封入工程においてアイランドが傾斜する不具合を防止す
ることができる。また切断されたリードフレームの両端
部を半導体チップの配線の一部と接続することによっ
て、分断されたリードフレームが電気的に接続されるこ
ととなり、リードフレームパターンの配置を簡潔に行う
ことができる。
を用いることにより、パッケージの引き出し用端子や半
導体チップのパッドの配列が特殊化してリードフレーム
のパターンが複雑化し、そのためにアイランド部を保持
する連結部を設ける必要のある箇所が、リードフレーム
によって妨げられて、必要とする箇所に連結部を設ける
ことが出来ない場合であっても、リードフレームを切断
して間隙を設け、その間隙に連結部を設けることができ
る。したがってアイランド部は安定して保持され、樹脂
封入工程においてアイランドが傾斜する不具合を防止す
ることができる。また切断されたリードフレームの両端
部を半導体チップの配線の一部と接続することによっ
て、分断されたリードフレームが電気的に接続されるこ
ととなり、リードフレームパターンの配置を簡潔に行う
ことができる。
【0009】
【発明の実施の形態】次ぎに本発明の実施の形態につい
て図面を参照して説明する。図1は本発明の半導体装置
の一実施の形態を示す部分平面略図である。
て図面を参照して説明する。図1は本発明の半導体装置
の一実施の形態を示す部分平面略図である。
【0010】本発明の半導体装置の半導体チップ2は、
4辺形状のボディ内側9の中に設けられたアイランド部
5の上に配設されている。ボディ内側9の中には半導体
チップ2の周りに多数のリ-ド1a〜1cより形成され
たリードフレーム10のパターンが配設され、各リード
1a〜1cは半導体チップ2に設けられたパッド4a〜
4cと、ボンディングワイヤ3a〜3cによって電気的
に接続されている。
4辺形状のボディ内側9の中に設けられたアイランド部
5の上に配設されている。ボディ内側9の中には半導体
チップ2の周りに多数のリ-ド1a〜1cより形成され
たリードフレーム10のパターンが配設され、各リード
1a〜1cは半導体チップ2に設けられたパッド4a〜
4cと、ボンディングワイヤ3a〜3cによって電気的
に接続されている。
【0011】アイランド部5は、ボディ内側9の4辺の
縁9a〜9cからボディ内側9の中へ伸びる4箇の吊り
ピン6によってボディ内側9の中に安定して保持され、
その上で半導体チップ2を接着固定している。
縁9a〜9cからボディ内側9の中へ伸びる4箇の吊り
ピン6によってボディ内側9の中に安定して保持され、
その上で半導体チップ2を接着固定している。
【0012】本実施例の場合は、パッケージを形成した
後、リードフレーム10の引出し用端子(不図示)が、
半導体チップ2の一方の側(図ではボディ内側の縁9a
の側)にのみ設けられる場合である。半導体チップ2の
パッドは、ボディ内側の縁9aの辺の側に設けられたパ
ッド4aの他に、反対側の辺の側にも2個のパッド4b
が設けられている。パッド4aはフィンガー状のリード
1cとボンディングワイヤ3aによって電気的に接続さ
れている。反対側の2箇のパッド4bを、ボディ内側の
縁9aの側の不図示の引出し用端子と電気的に接続する
ために、リードフレーム10の左右に配設された各1箇
のリード1aを、アイランド部5の周囲を囲むように伸
ばして配設する必要があるが、そのリードはアイランド
部5の左右を保持している吊りピン6の部分に妨げら
れ、リード1aと1bの2個に分割されて電気的に不連
続となる。
後、リードフレーム10の引出し用端子(不図示)が、
半導体チップ2の一方の側(図ではボディ内側の縁9a
の側)にのみ設けられる場合である。半導体チップ2の
パッドは、ボディ内側の縁9aの辺の側に設けられたパ
ッド4aの他に、反対側の辺の側にも2個のパッド4b
が設けられている。パッド4aはフィンガー状のリード
1cとボンディングワイヤ3aによって電気的に接続さ
れている。反対側の2箇のパッド4bを、ボディ内側の
縁9aの側の不図示の引出し用端子と電気的に接続する
ために、リードフレーム10の左右に配設された各1箇
のリード1aを、アイランド部5の周囲を囲むように伸
ばして配設する必要があるが、そのリードはアイランド
部5の左右を保持している吊りピン6の部分に妨げら
れ、リード1aと1bの2個に分割されて電気的に不連
続となる。
【0013】分割されたリード1aと1bを電気的に接
続するため、半導体チップ2の配線パターンのうち配線
7の部分に2個のパッド4cを設け、それぞれリード1
a,1bの端部1a1,1b1とボンディングワイヤ3c
によって接続する。反対側のパッド4bは、リード1a
の端部1a2とボンディングワイヤ3bによって接続さ
れる。
続するため、半導体チップ2の配線パターンのうち配線
7の部分に2個のパッド4cを設け、それぞれリード1
a,1bの端部1a1,1b1とボンディングワイヤ3c
によって接続する。反対側のパッド4bは、リード1a
の端部1a2とボンディングワイヤ3bによって接続さ
れる。
【0014】このようにボディ内側9の一方の側にのみ
引出し用端子があり、しかも半導体チップ2のパッド4
bが引出し用端子と反対側にも在るために、パッド4b
と接続すべきリード1aがアイランド部の吊りピン6に
よって妨げられて、リード1aと1bとに分割されるよ
うな場合であっても、半導体チップ2の上の配線パター
ンの一部の配線7を用いることによって、リード1aと
1bとを電気的に接続することができる。
引出し用端子があり、しかも半導体チップ2のパッド4
bが引出し用端子と反対側にも在るために、パッド4b
と接続すべきリード1aがアイランド部の吊りピン6に
よって妨げられて、リード1aと1bとに分割されるよ
うな場合であっても、半導体チップ2の上の配線パター
ンの一部の配線7を用いることによって、リード1aと
1bとを電気的に接続することができる。
【0015】このように、リードフレームのパターンに
半導体チップの配線を共用することによって、アイラン
ドの連結部を任意に必要とする箇所に設けることができ
るので、樹脂封止工程においてもアイランド部を安定し
て保持することができるとともに、リードフレームパタ
ーンの配置を簡潔に行うことができる。
半導体チップの配線を共用することによって、アイラン
ドの連結部を任意に必要とする箇所に設けることができ
るので、樹脂封止工程においてもアイランド部を安定し
て保持することができるとともに、リードフレームパタ
ーンの配置を簡潔に行うことができる。
【0016】上述の実施の形態においは、リードフレー
ムの一部分が半導体チップの配線の部分を共用する例に
ついて述べたが、これと反対に、半導体チップの配線
が、リードフレームの一部分を共用した半導体装置を製
作することもできる。
ムの一部分が半導体チップの配線の部分を共用する例に
ついて述べたが、これと反対に、半導体チップの配線
が、リードフレームの一部分を共用した半導体装置を製
作することもできる。
【0017】
【発明の効果】以上説明したように本発明は、リードフ
レームパターンに妨げられてアイランド部を保持するの
に必要な箇所にアイランド部の連結部を設けることがで
きない場合、リードフレームの一部を切断して、切断し
た部分に半導体チップ上の配線を共用することにより、
必要な連結部を上述の切断した部分に設けることが可能
となるため、樹脂封止工程においてアイランド部の安定
を保つことができるので、組立コストの低減と歩留りの
向上とを図ることができるという効果を奏する。
レームパターンに妨げられてアイランド部を保持するの
に必要な箇所にアイランド部の連結部を設けることがで
きない場合、リードフレームの一部を切断して、切断し
た部分に半導体チップ上の配線を共用することにより、
必要な連結部を上述の切断した部分に設けることが可能
となるため、樹脂封止工程においてアイランド部の安定
を保つことができるので、組立コストの低減と歩留りの
向上とを図ることができるという効果を奏する。
【図1】本発明の半導体装置の部分平面略図である。
【図2】従来の半導体装置の部分平面略図である。
【図3】従来の技術による別の半導体装置の部分平面略
図である。
図である。
【図4】図3と同様の図である。
1a,1b,1c,21,31a,41a リード 1a1,1a2,1b1 リード端部 2,22,32,42 半導体チップ 3a,3b,3c,23 ボンディングワイヤ 4a,4b,4c,24,34a,34b パッド 5,25,35,45 アイランド部 6,26,36,46 吊りピン/連結部 7 配線 9,29 ボディ内側 9a,9b,29a,39a ボディ内側の縁 10,20 リードフレーム 46a 連結部を必要とする部分 48 シール
Claims (3)
- 【請求項1】 リードフレームを用いて形成する半導体
装置において、前記リードフレームの一部分が、半導体
チップの配線の部分を共用することを特徴とする半導体
装置。 - 【請求項2】 リードフレームを用いて形成する半導体
装置において、半導体チップの配線が、前記リードフレ
ームの一部分を共用することを特徴とする半導体装置。 - 【請求項3】 リードフレームパターンの中央部に配設
されたアイランド部に搭載された半導体チップと、前記
リードフレームとを電気的に接続して形成する半導体装
置であって、 前記半導体チップの少なくとも一辺に沿って配設された
前記リードフレームの少なくとも1個のリードが、少な
くとも2個に分割されて、該分割された両端部の間の間
隙を横切る前記アイランド部を保持するための連結部
と、 前記分割されたリードの両端部を電気的に接続するため
に、前記半導体チップに設けられた配線の一部分と前記
リードの両端部とを電気的に接続する手段とを有する請
求項1に記載の半導体装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8167283A JP2803642B2 (ja) | 1996-06-27 | 1996-06-27 | 半導体装置 |
| US08/883,437 US5869884A (en) | 1996-06-27 | 1997-06-26 | Semiconductor device having lead terminal on only one side of a package |
| TW086108957A TW516192B (en) | 1996-06-27 | 1997-06-26 | Semiconductor device having lead terminal on only one side of a package |
| KR1019970028101A KR100270496B1 (ko) | 1996-06-27 | 1997-06-27 | 패키지일측에만리드단자를구비한반도체장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8167283A JP2803642B2 (ja) | 1996-06-27 | 1996-06-27 | 半導体装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1012796A true JPH1012796A (ja) | 1998-01-16 |
| JP2803642B2 JP2803642B2 (ja) | 1998-09-24 |
Family
ID=15846889
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8167283A Expired - Fee Related JP2803642B2 (ja) | 1996-06-27 | 1996-06-27 | 半導体装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5869884A (ja) |
| JP (1) | JP2803642B2 (ja) |
| KR (1) | KR100270496B1 (ja) |
| TW (1) | TW516192B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2019203139A1 (ja) * | 2018-04-19 | 2019-10-24 | ローム株式会社 | 半導体装置 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6621140B1 (en) | 2002-02-25 | 2003-09-16 | Rf Micro Devices, Inc. | Leadframe inductors |
| US20060214271A1 (en) * | 2005-03-23 | 2006-09-28 | Jeremy Loraine | Device and applications for passive RF components in leadframes |
Citations (2)
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|---|---|---|---|---|
| JPS5678355U (ja) * | 1979-11-13 | 1981-06-25 | ||
| JPH06349889A (ja) * | 1993-06-11 | 1994-12-22 | Matsushita Electric Ind Co Ltd | 半導体装置 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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